JPH0486938U - - Google Patents
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- Publication number
- JPH0486938U JPH0486938U JP12668690U JP12668690U JPH0486938U JP H0486938 U JPH0486938 U JP H0486938U JP 12668690 U JP12668690 U JP 12668690U JP 12668690 U JP12668690 U JP 12668690U JP H0486938 U JPH0486938 U JP H0486938U
- Authority
- JP
- Japan
- Prior art keywords
- circuit section
- adder circuit
- adder
- overflow
- output
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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Description
第１図及び第２図は、本考案によるカウンタ回
路を示すためのもので、第１図はブロツク図、第
２図は、パ比較回路に適用した構成を示すブロツ
ク図、第３図は従来のカウンタ回路を示す回路図
である。 １は加算回路部、３ａは入力側、３ｃはオーバ
フロー信号、４はデータ入力、９はオーバフロー
ビツト付出力、２１はゲート回路部である。
路を示すためのもので、第１図はブロツク図、第
２図は、パ比較回路に適用した構成を示すブロツ
ク図、第３図は従来のカウンタ回路を示す回路図
である。 １は加算回路部、３ａは入力側、３ｃはオーバ
フロー信号、４はデータ入力、９はオーバフロー
ビツト付出力、２１はゲート回路部である。
Claims (1)
- 【実用新案登録請求の範囲】 入力されるデータ入力４を加算回路部１にて加
算し、オーバーフロービツト付出力９を得るよう
にしたカウンタ回路において、 前記加算回路部１に接続されたラツチ回路部２
１を設け、前記加算回路部１のオーバーフロー信
号３ｃを前記加算回路部１の入力側３ａに帰還す
るように構成したことを特徴とするカウンタ回路
。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12668690U JPH0486938U (ja) | 1990-11-30 | 1990-11-30 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP12668690U JPH0486938U (ja) | 1990-11-30 | 1990-11-30 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0486938U true JPH0486938U (ja) | 1992-07-28 |
Family
ID=31874227
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP12668690U Pending JPH0486938U (ja) | 1990-11-30 | 1990-11-30 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0486938U (ja) |
-
1990
- 1990-11-30 JP JP12668690U patent/JPH0486938U/ja active Pending
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