JPH0511059A - シンチレーシヨンカメラ - Google Patents
シンチレーシヨンカメラInfo
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- JPH0511059A JPH0511059A JP18564591A JP18564591A JPH0511059A JP H0511059 A JPH0511059 A JP H0511059A JP 18564591 A JP18564591 A JP 18564591A JP 18564591 A JP18564591 A JP 18564591A JP H0511059 A JPH0511059 A JP H0511059A
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Abstract
(57)【要約】
【目的】 高計数率時の計数率特性の向上及び位置演算
精度の向上により画像の劣化を防ぐ。 【構成】 各非線形増幅器出力またはその加算出力を積
分するデジタル積分器を、パルス信号ごとに時間的に３
段階以上に分割してそれぞれデジタル信号の積分を行う
３個以上のデジタル積分回路と、前半の少なくとも２段
階の積分値をパイルアップ時の予測値に変換する変換器
とを含んで構成する。
精度の向上により画像の劣化を防ぐ。 【構成】 各非線形増幅器出力またはその加算出力を積
分するデジタル積分器を、パルス信号ごとに時間的に３
段階以上に分割してそれぞれデジタル信号の積分を行う
３個以上のデジタル積分回路と、前半の少なくとも２段
階の積分値をパイルアップ時の予測値に変換する変換器
とを含んで構成する。
Description
【０００１】
【産業上の利用分野】この発明は、アンガー型ガンマカ
メラやＥＣＴ装置などの核医学診断装置に関し、とくに
シンチレーションカメラに関する。
メラやＥＣＴ装置などの核医学診断装置に関し、とくに
シンチレーションカメラに関する。
【０００２】
【従来の技術】シンチレーションカメラでは、放射線の
入射によってシンチレータに生じた光を光電子増倍管で
電気信号に変換することによってパルス信号を得、この
各光電子増倍管の出力パルス信号をそれぞれプリアンプ
で増幅した後、非線形増幅器を経て位置演算回路に送っ
て、位置信号を得るようにしている。この位置演算回路
には、非線形増幅器からのそれぞれのパルス信号または
それらを加算した後の信号を積分する積分器が含まれて
いる。上記の非線形増幅器は、パルス信号の波高が放射
線入射位置によって異なるので、それを調整するためで
ある。たとえば放射線が光電子増倍管の中心付近に入射
したときは、その光電子増倍管の周辺に入射したときよ
りパルス信号波高が大きくなるので、抑圧特性を持たせ
て信号波高を小さくする。また、スレッショルド特性を
持たせ、波高が小さい信号では以降の回路が動作しない
ようにすることもある。
入射によってシンチレータに生じた光を光電子増倍管で
電気信号に変換することによってパルス信号を得、この
各光電子増倍管の出力パルス信号をそれぞれプリアンプ
で増幅した後、非線形増幅器を経て位置演算回路に送っ
て、位置信号を得るようにしている。この位置演算回路
には、非線形増幅器からのそれぞれのパルス信号または
それらを加算した後の信号を積分する積分器が含まれて
いる。上記の非線形増幅器は、パルス信号の波高が放射
線入射位置によって異なるので、それを調整するためで
ある。たとえば放射線が光電子増倍管の中心付近に入射
したときは、その光電子増倍管の周辺に入射したときよ
りパルス信号波高が大きくなるので、抑圧特性を持たせ
て信号波高を小さくする。また、スレッショルド特性を
持たせ、波高が小さい信号では以降の回路が動作しない
ようにすることもある。
【０００３】上記の積分器としては、通常のガンマカメ
ラではアナログ積分器を用いるのが一般的である。ま
た、計数率特性の向上のため、デジタル積分器が用いら
れることもある（特開昭６１−３２８４及び特開昭６１
−３９６１８を参照）。
ラではアナログ積分器を用いるのが一般的である。ま
た、計数率特性の向上のため、デジタル積分器が用いら
れることもある（特開昭６１−３２８４及び特開昭６１
−３９６１８を参照）。
【０００４】
【発明が解決しようとする課題】しかしながら、アナロ
グ積分器を用いるのでは計数率特性に難点があるし、デ
ジタル積分器を用いる場合も、従来のように単にデジタ
ル積分器を用いたというだけの構成では位置演算結果の
精度が悪いという問題がある。すなわち、上記のように
非線形増幅器を用いている関係で、波高ごとに抑圧され
たりされなかたりするので、増幅率が単一パルス内でも
時間的に波高が大きくなることに応じて変化する。その
ため、一般的なデジタル積分器では、パイルアップ時な
どに積分時間を短くすると、スレッショルド特性は弱
く、抑圧特性は強くなるというように、非線形増幅器に
よる非線形度が結果として相対的に大きく異なったこと
に相当する事態が生じ、位置演算結果がかなり変化す
る。
グ積分器を用いるのでは計数率特性に難点があるし、デ
ジタル積分器を用いる場合も、従来のように単にデジタ
ル積分器を用いたというだけの構成では位置演算結果の
精度が悪いという問題がある。すなわち、上記のように
非線形増幅器を用いている関係で、波高ごとに抑圧され
たりされなかたりするので、増幅率が単一パルス内でも
時間的に波高が大きくなることに応じて変化する。その
ため、一般的なデジタル積分器では、パイルアップ時な
どに積分時間を短くすると、スレッショルド特性は弱
く、抑圧特性は強くなるというように、非線形増幅器に
よる非線形度が結果として相対的に大きく異なったこと
に相当する事態が生じ、位置演算結果がかなり変化す
る。
【０００５】この発明は、上記に鑑み、計数率特性を向
上させるとともに、位置演算精度を向上させて画像の劣
化を防ぐように改善したシンチレーションカメラを提供
することを目的とする。
上させるとともに、位置演算精度を向上させて画像の劣
化を防ぐように改善したシンチレーションカメラを提供
することを目的とする。
【０００６】
【課題を解決するための手段】上記の目的を達成するた
め、この発明によるシンチレーションカメラにおいて
は、位置演算回路に含まれて各非線形増幅器出力または
その加算出力を積分する積分器としてデジタル積分器を
用い、そのデジタル積分器を、パルス信号ごとに時間的
に３段階以上に分割してそれぞれデジタル信号の積分を
行う３個以上のデジタル積分回路と、前半の少なくとも
２段階の積分値をパイルアップ時の予測値に変換する変
換器とを含んで構成したことが特徴となっている。前半
の２段階の積分値から予測値を得、パイルアップ時には
この予測値を用いて積分出力を得ることができ、２段階
までの積分時間で済むため、積分時間の短縮によって高
計数率時の数え落しがなくなり、計数率特性が向上す
る。また、パイルアップによる位置演算の誤差がなく、
しかも予測値は非線形増幅器の効果をも取り入れたもの
とすることができるので、この予測値を用いた場合でも
通常の長い積分時間による積分出力とほとんど変わらな
い積分出力が得られる。そのため、高計数率時におい
て、位置演算の精度を高め、画像の歪や均一性の劣化な
どを防止できる。
め、この発明によるシンチレーションカメラにおいて
は、位置演算回路に含まれて各非線形増幅器出力または
その加算出力を積分する積分器としてデジタル積分器を
用い、そのデジタル積分器を、パルス信号ごとに時間的
に３段階以上に分割してそれぞれデジタル信号の積分を
行う３個以上のデジタル積分回路と、前半の少なくとも
２段階の積分値をパイルアップ時の予測値に変換する変
換器とを含んで構成したことが特徴となっている。前半
の２段階の積分値から予測値を得、パイルアップ時には
この予測値を用いて積分出力を得ることができ、２段階
までの積分時間で済むため、積分時間の短縮によって高
計数率時の数え落しがなくなり、計数率特性が向上す
る。また、パイルアップによる位置演算の誤差がなく、
しかも予測値は非線形増幅器の効果をも取り入れたもの
とすることができるので、この予測値を用いた場合でも
通常の長い積分時間による積分出力とほとんど変わらな
い積分出力が得られる。そのため、高計数率時におい
て、位置演算の精度を高め、画像の歪や均一性の劣化な
どを防止できる。
【０００７】
【実施例】以下、この発明の一実施例について図面を参
照しながら詳細に説明する。図１はこの実施例にかかる
シンチレーションカメラの全体の構成を示すブロック図
で、この図において、シンチレータ及びライトガイド１
に多数の光電子増倍管２１、２２、…、２ｎが結合され
ており、その各出力がプリアンプ３１、３２、…、３ｎ
のそれぞれを経て非線形増幅器４１、４２、…、４ｎの
各々に送られる。この例では非線形増幅器４１、４２、
…、４ｎは、入力パルス波高が高いときにそれを抑圧す
る抑圧特性を有しているものとする。
照しながら詳細に説明する。図１はこの実施例にかかる
シンチレーションカメラの全体の構成を示すブロック図
で、この図において、シンチレータ及びライトガイド１
に多数の光電子増倍管２１、２２、…、２ｎが結合され
ており、その各出力がプリアンプ３１、３２、…、３ｎ
のそれぞれを経て非線形増幅器４１、４２、…、４ｎの
各々に送られる。この例では非線形増幅器４１、４２、
…、４ｎは、入力パルス波高が高いときにそれを抑圧す
る抑圧特性を有しているものとする。
【０００８】また、上記のプリアンプ出力は加算回路５
に送られて加算され、その加算後の信号が、入射した放
射線のエネルギーを表す信号Ｅａとしてタイミング回路
６に送られる。タイミング回路６ではこの入力信号Ｅａ
に基づいて、回路各部のタイミングを定めるためのタイ
ミング信号を生じる。
に送られて加算され、その加算後の信号が、入射した放
射線のエネルギーを表す信号Ｅａとしてタイミング回路
６に送られる。タイミング回路６ではこの入力信号Ｅａ
に基づいて、回路各部のタイミングを定めるためのタイ
ミング信号を生じる。
【０００９】上記非線形増幅器４１、４２、…、４ｎの
出力は重み付け加算回路７、８に送られて重み付け加算
され、放射線のＸ方向入射位置に対応する信号Ｘａ、Ｙ
方向入射位置に対応する信号Ｙｂが加算回路７、８のそ
れぞれから得られる。また、これら非線形増幅器４１、
４２、…、４ｎの出力は加算回路９により単純に加算さ
れ、単純加算信号Ｚａ（この信号は入射放射線エネルギ
ーに対応している）が得られる。
出力は重み付け加算回路７、８に送られて重み付け加算
され、放射線のＸ方向入射位置に対応する信号Ｘａ、Ｙ
方向入射位置に対応する信号Ｙｂが加算回路７、８のそ
れぞれから得られる。また、これら非線形増幅器４１、
４２、…、４ｎの出力は加算回路９により単純に加算さ
れ、単純加算信号Ｚａ（この信号は入射放射線エネルギ
ーに対応している）が得られる。
【００１０】これらの信号Ｘａ，Ｙａ，Ｚａ，Ｅａはそ
れぞれ並列型Ａ／Ｄ変換器１０、１１、１２、１３によ
りＡ／Ｄ変換される。図３は加算回路９の出力信号Ｚａ
の波形例を示し、横軸にＡ／Ｄ変換器１２のサンプリン
グ間隔を示す。この図３に示すようなパルス信号Ｐ１，
Ｐ３等の大きさが順次サンプリングされてデジタル信号
として出力される。得られたデジタル信号Ｘｄ，Ｙｄ，
Ｚｄ，Ｅｄがデジタル積分器１４、１５、１６、１７に
送られて積分され、積分出力INT Ｘ，INT Ｙ，INT Ｚ，
INT Ｅがそれぞれ得られる。積分出力INT Ｘは割算回路
１９でINT Ｚにより割算され、積分出力INT Ｙは割算回
路２０でINT Ｚにより割算されて、Ｘ方向位置信号DIV
Ｘ及びＹ方向位置信号DIV Ｙがそれぞれ得られる。積分
出力INTＥはエネルギー信号として出力されるととも
に、波高分析器１８に送られ、このエネルギー信号波高
が所定のウインド内に入っているかどうかの判定を受
け、入っていない場合タイミング回路６はタイミング信
号の発生を停止してこの放射線入射事象についての処理
を中止し、入っている場合にはタイミング信号を発生す
るとともにＵＮＢＬＡＮＫ信号を発生する。
れぞれ並列型Ａ／Ｄ変換器１０、１１、１２、１３によ
りＡ／Ｄ変換される。図３は加算回路９の出力信号Ｚａ
の波形例を示し、横軸にＡ／Ｄ変換器１２のサンプリン
グ間隔を示す。この図３に示すようなパルス信号Ｐ１，
Ｐ３等の大きさが順次サンプリングされてデジタル信号
として出力される。得られたデジタル信号Ｘｄ，Ｙｄ，
Ｚｄ，Ｅｄがデジタル積分器１４、１５、１６、１７に
送られて積分され、積分出力INT Ｘ，INT Ｙ，INT Ｚ，
INT Ｅがそれぞれ得られる。積分出力INT Ｘは割算回路
１９でINT Ｚにより割算され、積分出力INT Ｙは割算回
路２０でINT Ｚにより割算されて、Ｘ方向位置信号DIV
Ｘ及びＹ方向位置信号DIV Ｙがそれぞれ得られる。積分
出力INTＥはエネルギー信号として出力されるととも
に、波高分析器１８に送られ、このエネルギー信号波高
が所定のウインド内に入っているかどうかの判定を受
け、入っていない場合タイミング回路６はタイミング信
号の発生を停止してこの放射線入射事象についての処理
を中止し、入っている場合にはタイミング信号を発生す
るとともにＵＮＢＬＡＮＫ信号を発生する。
【００１１】加算回路７、８、９、Ａ／Ｄ変換器１０、
１１、１２、デジタル積分器１４、１５、１６及び割算
回路１９、２０により、位置演算回路が形成されること
になる。
１１、１２、デジタル積分器１４、１５、１６及び割算
回路１９、２０により、位置演算回路が形成されること
になる。
【００１２】４つのデジタル積分器１４〜１７は、この
実施例では入力デジタル信号を時間的に３分割して積分
した後それらを加算する、３分割型のデジタル積分器と
して構成されている。それらはすべて同じ構成であるか
ら、デジタル積分器１６についてその詳細を図２に示
し、それについてのみ説明する。図２において、入力さ
れたデジタル信号Ｚｄはまず加算器６１を通り、レジス
タ６２に格納される。この入力デジタル信号Ｚｄは、Ａ
／Ｄ変換器１２によってサンプリング及びＡ／Ｄ変換さ
れたものであるから、図３のパルス信号Ｐ１，Ｐ３等の
各サンプリング時点での大きさを表すデジタル値として
順次送られてきたものとなる。このレジスタ６２に格納
されたデジタル値はマルチプレクサ６５により選択され
て再び加算器６１に送られてつぎのデジタル値に加算さ
れ、再びレジスタ６２に格納される、ということが繰り
返されて、積分がなされ、積分値がレジスタ６２に形成
されていく。レジスタ６３、６４においても同様に積分
値が得られるが、マルチプレクサ６５は、パルス信号Ｐ
１、Ｐ３の立上りからａ期間でレジスタ６２を、ｂ期間
でレジスタ６３を、ｃ期間でレジスタ６４をそれぞれ選
択するので、ａ期間での積分動作が加算器６１とレジス
タ６２とにより、ｂ期間での積分動作が加算器６１とレ
ジスタ６３とにより、ｃ期間での積分動作が加算器６１
とレジスタ６４とにより、それぞれ行われることにな
る。
実施例では入力デジタル信号を時間的に３分割して積分
した後それらを加算する、３分割型のデジタル積分器と
して構成されている。それらはすべて同じ構成であるか
ら、デジタル積分器１６についてその詳細を図２に示
し、それについてのみ説明する。図２において、入力さ
れたデジタル信号Ｚｄはまず加算器６１を通り、レジス
タ６２に格納される。この入力デジタル信号Ｚｄは、Ａ
／Ｄ変換器１２によってサンプリング及びＡ／Ｄ変換さ
れたものであるから、図３のパルス信号Ｐ１，Ｐ３等の
各サンプリング時点での大きさを表すデジタル値として
順次送られてきたものとなる。このレジスタ６２に格納
されたデジタル値はマルチプレクサ６５により選択され
て再び加算器６１に送られてつぎのデジタル値に加算さ
れ、再びレジスタ６２に格納される、ということが繰り
返されて、積分がなされ、積分値がレジスタ６２に形成
されていく。レジスタ６３、６４においても同様に積分
値が得られるが、マルチプレクサ６５は、パルス信号Ｐ
１、Ｐ３の立上りからａ期間でレジスタ６２を、ｂ期間
でレジスタ６３を、ｃ期間でレジスタ６４をそれぞれ選
択するので、ａ期間での積分動作が加算器６１とレジス
タ６２とにより、ｂ期間での積分動作が加算器６１とレ
ジスタ６３とにより、ｃ期間での積分動作が加算器６１
とレジスタ６４とにより、それぞれ行われることにな
る。
【００１３】そして、これらの各期間の終わりで得られ
た積分値はレジスタ６２、６３、６４の各々に保持され
る。このａ期間の積分値及びｂ期間の積分値は変換テー
ブルメモリ６６に送られてこれをアクセスし、そこに格
納されていた値を読み出す。レジスタ６２、６３、６４
の値、及び変換テーブルメモリ６６からの値はマルチプ
レクサ６７で順次選択され、加算器６８及びレジスタ６
９により繰り返し加算されることによって、レジスタ６
２、６３の積分値の和に、レジスタ６４の積分値または
変換テーブルメモリ６６から読み出した値が加算され
る。
た積分値はレジスタ６２、６３、６４の各々に保持され
る。このａ期間の積分値及びｂ期間の積分値は変換テー
ブルメモリ６６に送られてこれをアクセスし、そこに格
納されていた値を読み出す。レジスタ６２、６３、６４
の値、及び変換テーブルメモリ６６からの値はマルチプ
レクサ６７で順次選択され、加算器６８及びレジスタ６
９により繰り返し加算されることによって、レジスタ６
２、６３の積分値の和に、レジスタ６４の積分値または
変換テーブルメモリ６６から読み出した値が加算され
る。
【００１４】たとえば、図３のＡ，Ｂに示すように、ｃ
期間で、パルス信号Ｐ１、Ｐ３にパルス信号Ｐ２、Ｐ４
がパイルアップしたとき、変換テーブルメモリ６６から
の値が加えられたものが積分出力INT Ｚとして出力され
る。このようなパイルアップが生じない通常の場合に、
レジスタ６２、６３、６４に形成された、各期間の積分
値が加算されて積分出力INT Ｚとして出力される。マル
チプレクサ６５に対する各期間に応じた制御はタイミン
グ回路６からの信号によって行われる。またパイルアッ
プの検出は、別途行われるが、通常の構成でよいため、
ここではその説明は省略する。
期間で、パルス信号Ｐ１、Ｐ３にパルス信号Ｐ２、Ｐ４
がパイルアップしたとき、変換テーブルメモリ６６から
の値が加えられたものが積分出力INT Ｚとして出力され
る。このようなパイルアップが生じない通常の場合に、
レジスタ６２、６３、６４に形成された、各期間の積分
値が加算されて積分出力INT Ｚとして出力される。マル
チプレクサ６５に対する各期間に応じた制御はタイミン
グ回路６からの信号によって行われる。またパイルアッ
プの検出は、別途行われるが、通常の構成でよいため、
ここではその説明は省略する。
【００１５】ここで分かるように、変換テーブルメモリ
６６からの値は、パイルアップ時において、パルス信号
Ｐ１，Ｐ３についてのｃ期間での積分値を代用するもの
である。これらのパルス信号Ｐ１，Ｐ３は、同じエネル
ギーのもので本来同じ波形になるはずのものであるが、
入射位置が異なるために大きさが異なり、その結果非線
形増幅器４１、４２、…、４ｎにおいて受けた抑圧効果
も異なるものとなっている。この例では、パルス信号Ｐ
３は、光電子増倍管の中心付近に入射した放射線によっ
て生じたものであり、点線で示すような大きな波高とな
るはずのところ、非線形増幅によってより高い部分が抑
圧されるので、ｂ期間において波高が実線のように低く
なっている。
６６からの値は、パイルアップ時において、パルス信号
Ｐ１，Ｐ３についてのｃ期間での積分値を代用するもの
である。これらのパルス信号Ｐ１，Ｐ３は、同じエネル
ギーのもので本来同じ波形になるはずのものであるが、
入射位置が異なるために大きさが異なり、その結果非線
形増幅器４１、４２、…、４ｎにおいて受けた抑圧効果
も異なるものとなっている。この例では、パルス信号Ｐ
３は、光電子増倍管の中心付近に入射した放射線によっ
て生じたものであり、点線で示すような大きな波高とな
るはずのところ、非線形増幅によってより高い部分が抑
圧されるので、ｂ期間において波高が実線のように低く
なっている。
【００１６】このようにａ，ｂ，ｃの各期間で非線形度
が異なるため、ａ，ｂ期間の積分値の合計に対して定数
の倍率を単純に乗算してｃ期間での積分値を求める近似
的な方法では、不正確な予測値しか得られない。そこ
で、ａ，ｂの各期間の積分値の比較からｃ期間での積分
値を正確に予測する必要が生じる。この実施例では、
ａ，ｂの各期間の積分値に対応するｃ期間の積分値の予
測値をあらかじめ求めて、変換テーブルメモリ６６に格
納しておき、それをａ，ｂの各期間の積分値でアクセス
して読み出すようにしている。そのため、パイルアップ
時に正確なｃ期間の積分値の予測値が得られ、結果とし
てパイルアップ時にも正確な積分出力が得られるので、
位置精度及びエネルギー精度が向上する。
が異なるため、ａ，ｂ期間の積分値の合計に対して定数
の倍率を単純に乗算してｃ期間での積分値を求める近似
的な方法では、不正確な予測値しか得られない。そこ
で、ａ，ｂの各期間の積分値の比較からｃ期間での積分
値を正確に予測する必要が生じる。この実施例では、
ａ，ｂの各期間の積分値に対応するｃ期間の積分値の予
測値をあらかじめ求めて、変換テーブルメモリ６６に格
納しておき、それをａ，ｂの各期間の積分値でアクセス
して読み出すようにしている。そのため、パイルアップ
時に正確なｃ期間の積分値の予測値が得られ、結果とし
てパイルアップ時にも正確な積分出力が得られるので、
位置精度及びエネルギー精度が向上する。
【００１７】したがって、高計数率時にパイルアップが
生じ易くなった場合、積分時間がａ、ｂ期間の和となり
短くなるので、数え落しが少なくなって計数率特性が向
上する。また、そのように積分時間を短縮することによ
って、１つ目のパルス情報に２つ目のパルス情報が混じ
ることを排除できるので、パイルアップによる位置演算
の誤差を防ぐことができる。積分値の予測値を非線形効
果を考慮した上で得ることができるので、パイルアップ
時にも非パイルアップ時の長い積分時間の場合とほとん
ど同じ積分出力を得ることができ、画像の歪や均一性が
劣化することがない。
生じ易くなった場合、積分時間がａ、ｂ期間の和となり
短くなるので、数え落しが少なくなって計数率特性が向
上する。また、そのように積分時間を短縮することによ
って、１つ目のパルス情報に２つ目のパルス情報が混じ
ることを排除できるので、パイルアップによる位置演算
の誤差を防ぐことができる。積分値の予測値を非線形効
果を考慮した上で得ることができるので、パイルアップ
時にも非パイルアップ時の長い積分時間の場合とほとん
ど同じ積分出力を得ることができ、画像の歪や均一性が
劣化することがない。
【００１８】なお、この発明は、その要旨を逸脱しない
範囲で種々に変更可能である。たとえば、デジタル積分
器は、上記では時間的に３分割して積分する３分割型と
して構成しているが、４分割以上の構成も可能である。
また、上記では加算回路７、８、９（及び加算回路５）
の出力をＡ／Ｄ変換し、多分割型デジタル積分器で積分
するという構成をとっているが、プリアンプ３１、３
２、…、３ｎ及び非線形増幅器４１、４２、…、４ｎを
経た、各光電子増倍管２１、２２、…、２ｎごとの出力
を、Ａ／Ｄ変換し、多分割型デジタル積分器で積分し、
その後加算回路及び割算回路に通すという構成をとるこ
とも可能である。さらに、上記では変換テーブルメモリ
６６からｃ期間での予測値を読み出し、それとａ，ｂ期
間の積分値とを加算する構成としているが、変換テーブ
ルメモリ６６に格納しておく予測値としてａ，ｂ，ｃ全
期間の積分値とし、これをａ，ｂ期間の積分値でアクセ
スしてそのまま全期間の積分出力として出力するよう構
成することもできる。
範囲で種々に変更可能である。たとえば、デジタル積分
器は、上記では時間的に３分割して積分する３分割型と
して構成しているが、４分割以上の構成も可能である。
また、上記では加算回路７、８、９（及び加算回路５）
の出力をＡ／Ｄ変換し、多分割型デジタル積分器で積分
するという構成をとっているが、プリアンプ３１、３
２、…、３ｎ及び非線形増幅器４１、４２、…、４ｎを
経た、各光電子増倍管２１、２２、…、２ｎごとの出力
を、Ａ／Ｄ変換し、多分割型デジタル積分器で積分し、
その後加算回路及び割算回路に通すという構成をとるこ
とも可能である。さらに、上記では変換テーブルメモリ
６６からｃ期間での予測値を読み出し、それとａ，ｂ期
間の積分値とを加算する構成としているが、変換テーブ
ルメモリ６６に格納しておく予測値としてａ，ｂ，ｃ全
期間の積分値とし、これをａ，ｂ期間の積分値でアクセ
スしてそのまま全期間の積分出力として出力するよう構
成することもできる。
【００１９】
【発明の効果】以上実施例について説明したように、こ
の発明のシンチレーションカメラによれば、高計数率時
の数え落しを少なくして計数率特性を向上させるととも
に、高計数率時の位置演算精度を高めて画像の歪や均一
性の劣化などをなくすことができる。
の発明のシンチレーションカメラによれば、高計数率時
の数え落しを少なくして計数率特性を向上させるととも
に、高計数率時の位置演算精度を高めて画像の歪や均一
性の劣化などをなくすことができる。
【図１】この発明の一実施例を示すブロック図。
【図２】同実施例の一部を詳しく示すブロック図。
【図３】同実施例における信号波形を表すタイムチャー
ト。
ト。
１ シンチレータ及びライトガイド 21、22、…2n 光電子増倍管 31、32、…3n プリアンプ 41、42、…4n 非線形増幅器 5、7、8、9 加算回路 ６ タイミング回路 10、11、12、13 Ａ／Ｄ変換器 14、15、16、17 デジタル積分器 １８ 波高分析器 19、20 割算回路 61、68 加算器 62、63、64、69 レジスタ 65、67 マルチプレクサ ６６ 変換テーブルメモリ
Claims (1)
- 【特許請求の範囲】 【請求項１】 シンチレータと、該シンチレータからの
光を電気的パルス信号に変換する光電変換器と、該パル
ス信号を非線形増幅する非線形増幅器と、Ａ／Ｄ変換器
とデジタル積分器との組み合わせを３組以上含んで、上
記非線形増幅器の出力パルス信号からデジタル位置信号
を得る位置演算回路とを有するシンチレーションカメラ
において、上記デジタル積分器は、パルス信号ごとに時
間的に３段階以上に分割してそれぞれデジタル信号の積
分を行う３個以上のデジタル積分回路と、前半の少なく
とも２段階の積分値をパイルアップ時の予測値に変換す
る変換器とが含まれることが特徴となっているシンチレ
ーションカメラ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18564591A JPH0511059A (ja) | 1991-06-30 | 1991-06-30 | シンチレーシヨンカメラ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18564591A JPH0511059A (ja) | 1991-06-30 | 1991-06-30 | シンチレーシヨンカメラ |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0511059A true JPH0511059A (ja) | 1993-01-19 |
Family
ID=16174397
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP18564591A Pending JPH0511059A (ja) | 1991-06-30 | 1991-06-30 | シンチレーシヨンカメラ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0511059A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH08322826A (ja) * | 1995-05-31 | 1996-12-10 | Matsushita Electric Ind Co Ltd | Ｘ線撮像装置 |
| JP2011047798A (ja) * | 2009-08-27 | 2011-03-10 | Mitsubishi Electric Corp | 放射線分布検出回路 |
-
1991
- 1991-06-30 JP JP18564591A patent/JPH0511059A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH08322826A (ja) * | 1995-05-31 | 1996-12-10 | Matsushita Electric Ind Co Ltd | Ｘ線撮像装置 |
| JP2011047798A (ja) * | 2009-08-27 | 2011-03-10 | Mitsubishi Electric Corp | 放射線分布検出回路 |
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