JPH05136758A - 多重速度変換装置 - Google Patents

多重速度変換装置

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JPH05136758A
JPH05136758A JP3300501A JP30050191A JPH05136758A JP H05136758 A JPH05136758 A JP H05136758A JP 3300501 A JP3300501 A JP 3300501A JP 30050191 A JP30050191 A JP 30050191A JP H05136758 A JPH05136758 A JP H05136758A
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JP
Japan
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speed
time division
division switch
point
matching circuit
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Pending
Application number
JP3300501A
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English (en)
Inventor
Chikako Ueno
千佳子 上野
Takashi Kakiwaki
隆 垣脇
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NEC Corp
NEC Communication Systems Ltd
Original Assignee
NEC Corp
NEC Communication Systems Ltd
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Publication date
Application filed by NEC Corp, NEC Communication Systems Ltd filed Critical NEC Corp
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Priority to US07/976,398 priority patent/US5369636A/en
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    • H04JMULTIPLEX COMMUNICATION
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    • H04J3/16Time-division multiplex systems in which the time allocation to individual channels within a transmission cycle is variable, e.g. to accommodate varying complexity of signals, to vary number of channels transmitted
    • H04J3/1605Fixed allocated frame structures
    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04QSELECTING
    • H04Q11/00Selecting arrangements for multiplex systems
    • H04Q11/04Selecting arrangements for multiplex systems for time-division multiplexing
    • H04Q11/0428Integrated services digital network, i.e. systems for transmission of different types of digitised signals, e.g. speech, data, telecentral, television signals
    • H04Q11/0435Details
    • H04Q11/0471Terminal access circuits
    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04QSELECTING
    • H04Q2213/00Indexing scheme relating to selecting arrangements in general and for multiplex systems
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  • Use Of Switch Circuits For Exchanges And Methods Of Control Of Multiplex Exchanges (AREA)
  • Data Exchanges In Wide-Area Networks (AREA)

Abstract

(57)【要約】 【目的】 同期・非同期モードでの複数の異速度非IS
DN端末を、CCITT勧告V.110方式により64
kbpsでISDN網と通信をする多重速度変換装置の提
供。 【構成】 CCITT勧告V.110に従った速度整合
回路(1)を時分割スイッチ(2)に接続する。R点速
度整合回路(3.1〜3.4)を時分割スイッチに接続
する。これら各回路を中央制御回路(4)により、R点
速度整合回路と時分割スイッチ、速度整合回路の速度の
設定を行い、ユーザ速度をR点速度整合回路・時分割ス
イッチ間より遅い速度に限定することにより、非ISD
N端末複数台が双方で通信を行うことが可能となる。

Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】本発明は、CCITT勧告V.1
10方式においてR点多重化を実現する多重速度変換装
置に関する。
【0002】
【従来の技術】従来のCCITT勧告V.110方式速
度変換装置の使用方法では、図3のブロック図に示すよ
うに、非ISDN系端末(5.1〜5.n)と、CCI
TT勧告V.110に従って動作するCCITT勧告
V.110速度変換装置(10.1〜10.n)と、同
等の非ISDN系端末(9.1〜9.n)と、CCIT
T勧告V.110速度変換装置(11.1〜11.n)
とが、CCITT勧告V.110方式に従って通信を行
う際には、回線交換1チャネルでは1台のCCITT勧
告V.110速度変換装置に対し、非ISDN端末が1
台しか接続できなかった。
【0003】
【発明が解決しようとする課題】従来の速度変換装置
は、ビットマッピング方式による速度整合であるため、
1チャネルでは双方1台の非ISDN端末しか接続する
ことができず、非ISDN端末・速度整合装置間の通信
速度が遅い場合でもISDN網の64kbpsの速度で通信
を行うため、マッピングデータの密度が高く、無駄が多
かった。
【0004】そこで、本発明の技術的課題は、上記欠点
を鑑み時分割スイッチ・R点速度整合回路間の通信速度
以下の範囲内で同期・非同期モードでの異速度の端末の
多重化が可能な速度変換装置を提供することにある。
【0005】
【課題を解決するための手段】本発明によれば、CCI
TT勧告V.110に従った速度整合を行う速度整合回
路と、該速度整合回路と接続され、時分割により多重化
する時分割スイッチと、該時分割スイッチとCCITT
勧告で規定するR点インターフェイスとを接続し、前記
時分割スイッチへ同期速度でデータを供給するR点速度
整合回路と、前記時分割スイッチと前記R点速度整合回
路と間の速度を32kbps以下の同期モードの一定速度と
する中央制御回路とを有することを特徴とする多重速度
変換装置が得られる。
【0006】また、本発明によれば、前記多重速度変換
装置において、ユーザ速度を前記時分割スイッチと前記
R点速度整合回路と間の速度以下の同期・非同期モード
とすることを特徴とする多重速度変換装置が得られる。
【0007】即ち、本発明の速度変換装置は、CCIT
T勧告V.110方式に従った速度整合回路と、複数の
シリアル線と接続し、時分割により多重化し、シリアル
線で前記速度整合回路と接続する時分割スイッチと、前
記時分割スイッチとR点インタフェースとを接続し、前
記時分割スイッチへ同期速度でデータを供給するR点速
度整合回路と、前記各回路を制御する中央制御部とで構
成され、ターミナルアダプタおよびISDN標準端末内
に含まれる速度変換装置において、前記R点速度整合回
路と前記時分割スイッチとの速度を32kbps以下の同期
モード(32kbps,16kbps,8kbps)の一定速度に限
定し、ユーザ速度を前記R点速度整合回路と時分割スイ
ッチ間の速度以下の範囲内での同期・非同期モードに限
定することにより、複数のシリアル線から異速度で入っ
てくるデータを時分割により整合し、64kbpsでISD
N網と通信を行う構成である。
【0008】
【実施例】次に、本発明の実施例について図面を参照し
て説明する。
【0009】図1は本発明の一実施例のブロック図で、
図2は、使用方法を示すブロック図である。
【0010】ISDN網と接続するCCITT勧告V.
110に従った速度整合回路(1)を時分割スイッチ
(2)に接続し、CCITT勧告で規定するR点インタ
フェースとの速度整合を行うR点速度整合回路(3.1
〜3.4)を時分割スイッチに接続し、前記各回路の制
御を行う中央制御回路(4)を前記各回路と接続してい
る。
【0011】次に動作について説明する。
【0012】CCITT勧告V.110方式による通信
を行う際に、中央制御回路(4)により、R点速度整合
回路(3.1〜3.4)と時分割スイッチ(2)の速度
の設定を行う。
【0013】図1を例にとり、図5のフローチャートの
流れにそって説明する。
【0014】R点速度整合回路(3.1〜3.4)が4
つ接続されているため、R点速度整合回路(3.1〜
3.4)と時分割スイッチ(2)間の速度を、(64kb
ps)÷(R点速度整合回路数)により16kbps(同期モ
ード)を限定速度とする。
【0015】ユーザ速度を前記R点速度整合回路・時分
割スイッチ間より遅い速度に限定する。速度整合回路の
速度を64kbpsに設定する。
【0016】送信時にはR点よりR点速度整合回路で定
めたユーザ速度でデータが時分割スイッチに送信され
る。
【0017】時分割スイッチでは4つのR点速度整合回
路から各16kbpsで受信したデータを時分割により64
kbpsデータに整合し、速度変換回路を経由し、ISDN
網へ送出される。
【0018】また受信時には、64kbpsでISDN網か
ら受信したデータを速度変換回路を経由し、時分割スイ
ッチが受信する。
【0019】これを送信時の逆の方法で64kbpsデータ
を4つの16kbpsデータに時分割し速度整合され、R点
速度整合回路によりユーザ速度に速度整合されたデータ
がR点へ送出される。
【0020】以上の動作により、64kbps回線交換1チ
ャネルにより図2で示すように非ISDN端末複数台
(5.1〜5.nと9.1〜9.n)が双方で通信を行
うことが可能となる。
【0021】
【発明の効果】以上説明したように、本発明は、速度整
合回路と、該速度整合回路と接続する時分割スイッチ
と、前記時分割スイッチへ同期速度でデータを供給する
R点速度整合回路と、前記各回路を制御する中央制御部
を設けることにより、64kbpsの回線交換1チャネルで
CCITT勧告V.110方式速度整合方式により、複
数の非ISDN端末を双方で通信を行うことができ、従
来難しいとされていたCCITT勧告V.110方式に
従った速度整合方式による異速度端末の多重化が可能と
なり、経済的効果および64kbpsによる回線交換の有効
活用ができる。
【図面の簡単な説明】
【図1】本発明の一実施例のブロック図である。
【図2】本発明の速度変換装置の使用方法を示すブロッ
ク図である。
【図3】従来の速度変換装置の使用方法を示すブロック
図である。
【図4】一実施例で紹介した速度変換方法でユーザーデ
ータとISDN網との整合イメージ図である。
【図5】本発明で説明した中央制御部の処理をあらわす
フローチャートである。
【符号の説明】
1 速度整合回路 2 時分割スイッチ 3.1〜3.4 R点速度整合回路 4 中央制御部 5.1〜5.n,9.1〜9.n 非ISDN端末 6,8 ターミナルアダプタ 7 ISDN網 10.1〜10.n,11.1〜11.n CCIT
T勧告V.110端末
───────────────────────────────────────────────────── フロントページの続き (51)Int.Cl.5 識別記号 庁内整理番号 FI 技術表示箇所 H04L 29/10 H04Q 5/00 8627−5K 11/04

Claims (2)

    【特許請求の範囲】
  1. 【請求項1】 CCITT勧告V.110に従った速度
    整合を行う速度整合回路と、 該速度整合回路と接続され、時分割により多重化する時
    分割スイッチと、 該時分割スイッチとCCITT勧告で規定するR点イン
    ターフェイスとを接続し、前記時分割スイッチへ同期速
    度でデータを供給するR点速度整合回路と、 前記時分割スイッチと前記R点速度整合回路と間の速度
    を32kbps以下の同期モードの一定速度とする中央制御
    回路とを有することを特徴とする多重速度変換装置。
  2. 【請求項2】 請求項1記載の多重速度変換装置におい
    て、 ユーザ速度を前記時分割スイッチと前記R点速度整合回
    路と間の速度以下の同期・非同期モードとすることを特
    徴とする多重速度変換装置。
JP3300501A 1991-11-15 1991-11-15 多重速度変換装置 Pending JPH05136758A (ja)

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JP3300501A JPH05136758A (ja) 1991-11-15 1991-11-15 多重速度変換装置
US07/976,398 US5369636A (en) 1991-11-15 1992-11-13 Multiple communication speed converting apparatus

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JP3300501A JPH05136758A (ja) 1991-11-15 1991-11-15 多重速度変換装置

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JPH05136758A true JPH05136758A (ja) 1993-06-01

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ID=17885578

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JP3300501A Pending JPH05136758A (ja) 1991-11-15 1991-11-15 多重速度変換装置

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JP (1) JPH05136758A (ja)

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US5369636A (en) 1994-11-29

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