JPH0516781B2 - - Google Patents
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- JPH0516781B2 JPH0516781B2 JP60262974A JP26297485A JPH0516781B2 JP H0516781 B2 JPH0516781 B2 JP H0516781B2 JP 60262974 A JP60262974 A JP 60262974A JP 26297485 A JP26297485 A JP 26297485A JP H0516781 B2 JPH0516781 B2 JP H0516781B2
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- Japan
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- line sensor
- reading
- light
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- H04N1/04—Scanning arrangements, i.e. arrangements for the displacement of active reading or reproducing elements relative to the original or reproducing medium, or vice versa
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- H04N25/00—Circuitry of solid-state image sensors [SSIS]; Control thereof
- H04N25/70—SSIS architectures; Circuits associated therewith
- H04N25/701—Line sensors
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- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N25/00—Circuitry of solid-state image sensors [SSIS]; Control thereof
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- H04N25/701—Line sensors
- H04N25/7013—Line sensors using abutted sensors forming a long line
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- Multimedia (AREA)
- Signal Processing (AREA)
- Facsimile Scanning Arrangements (AREA)
Description
【発明の詳細な説明】
（発明の技術分野）
この発明は、CCD（Charge Coupled Device）
等のラインセンサを複数本ライン状に接続して、
大きなサイズの原稿に対しても効率的な読取りが
行なえるようにしたラインセンサの読取回路に関
する。
等のラインセンサを複数本ライン状に接続して、
大きなサイズの原稿に対しても効率的な読取りが
行なえるようにしたラインセンサの読取回路に関
する。
（発明の技術的背景とその問題点）
CCD等のラインセンサの読取り幅は通常２〜
３cm程度であり、このようなラインセンサでB5
又はA4版といつた原稿を読取る場合、原稿の読
取り長さに対してラインセンサの読取り幅が非常
に短い。すなわち、第３図に示すようにラインセ
ンサ１に対して、原稿２の読取り長さは破線部３
のように通常長いので、ラインセンサ１で原稿２
を読取る場合はレンズ系４を介し、原稿２を縮小
させて、ラインセンサ１の受光素子上に結像させ
て読取らなければならない。このため、光路長が
長くなり、読取り装置が大型になる欠点がある。
３cm程度であり、このようなラインセンサでB5
又はA4版といつた原稿を読取る場合、原稿の読
取り長さに対してラインセンサの読取り幅が非常
に短い。すなわち、第３図に示すようにラインセ
ンサ１に対して、原稿２の読取り長さは破線部３
のように通常長いので、ラインセンサ１で原稿２
を読取る場合はレンズ系４を介し、原稿２を縮小
させて、ラインセンサ１の受光素子上に結像させ
て読取らなければならない。このため、光路長が
長くなり、読取り装置が大型になる欠点がある。
このような欠点をなくすため、複数本のライン
センサをたとえば第４図に示すように読取り位置
を異ならせて配置し、原稿の読取り長さに等しい
読取り幅を持たせたものが開発されている。この
場合、各ラインセンサ１Ａ〜１Ｄの光電変換特性
を等しくする必要があるため、各ラインセンサ１
Ａ〜１Ｄの先頭部分の受光素子に光を遮断するた
めの遮光マスク５を設け、この遮光部の出力信号
を同一レベルに揃えることによつて、各ラインセ
ンサ１Ａ〜１Ｄの光電変換特性を等しくしてい
る。このような構成とした場合、各ラインセンサ
１Ａ〜１Ｄの出力信号は、第５図に示すように遮
光マスク５に対応した基準黒レベルＳ１と、有効
な画像信号部分Ｓ２が出力され、各ラインセンサ
１Ａ〜１Ｄの出力を単純に合成したのでは、原稿
２を正確に読取ることは出来ない。
センサをたとえば第４図に示すように読取り位置
を異ならせて配置し、原稿の読取り長さに等しい
読取り幅を持たせたものが開発されている。この
場合、各ラインセンサ１Ａ〜１Ｄの光電変換特性
を等しくする必要があるため、各ラインセンサ１
Ａ〜１Ｄの先頭部分の受光素子に光を遮断するた
めの遮光マスク５を設け、この遮光部の出力信号
を同一レベルに揃えることによつて、各ラインセ
ンサ１Ａ〜１Ｄの光電変換特性を等しくしてい
る。このような構成とした場合、各ラインセンサ
１Ａ〜１Ｄの出力信号は、第５図に示すように遮
光マスク５に対応した基準黒レベルＳ１と、有効
な画像信号部分Ｓ２が出力され、各ラインセンサ
１Ａ〜１Ｄの出力を単純に合成したのでは、原稿
２を正確に読取ることは出来ない。
一方、第１図の一点鎖線部１０で示すようなラ
インセンサユニツト１０も開発されている。すな
わち、ラインセンサユニツト１０はたとえば５個
のラインセンサ１１〜１５の読取り位置を副走査
方向にも異ならせて配列し、各ラインセンサ１１
〜１５の遮光部１１Ｍ〜１５Ｍがそれぞれの前段
のラインセンサの後端と重なるようにしている。
このときの出力信号は、第６図に示すように遮光
マスク１１Ｍ〜１５Ｍに対応した基準黒レベルＳ
１と、有効な画像信号部分Ｓ２と、次段のライン
センサとの重なり部分Ｓ３とが出力される。
インセンサユニツト１０も開発されている。すな
わち、ラインセンサユニツト１０はたとえば５個
のラインセンサ１１〜１５の読取り位置を副走査
方向にも異ならせて配列し、各ラインセンサ１１
〜１５の遮光部１１Ｍ〜１５Ｍがそれぞれの前段
のラインセンサの後端と重なるようにしている。
このときの出力信号は、第６図に示すように遮光
マスク１１Ｍ〜１５Ｍに対応した基準黒レベルＳ
１と、有効な画像信号部分Ｓ２と、次段のライン
センサとの重なり部分Ｓ３とが出力される。
このようなラインセンサユニツト１０は、出力
信号の処理をどのようにするかが問題となる。
信号の処理をどのようにするかが問題となる。
（発明の目的）
この発明は、上述のようなラインセンサユニツ
トの出力信号の処理を、正確かつ高速に行ない得
るようにした読取回路を提供することを目的とし
ている。
トの出力信号の処理を、正確かつ高速に行ない得
るようにした読取回路を提供することを目的とし
ている。
（発明の概要）
この発明はラインセンサの読取回路に関するも
ので、それぞれの先端部分の受光素子に遮光マス
クを有した複数本のラインセンサを、それぞれの
遮光マスクの部分が前段のラインセンサの後端に
重なるように配列して構成したラインセンサユニ
ツトと、前記ラインセンサのそれぞれの出力信号
を並列的にデイジタル化するＡ／Ｄ変換部と、そ
れぞれが前記ラインセンサの有効な読取り画素数
以上の記憶容量を有し、前記Ａ／Ｄ変換部からの
対応するラインセンサに係る情報をそれぞれが記
憶する複数の記憶素子で構成されるラインメモリ
とを備え、前記ラインメモリに記憶する際、それ
ぞれの前記記憶素子の後端部までに前記遮光マス
クに基準黒レベル情報が頂度記憶されるような前
記記憶素子における記憶位置から、対応する前記
ラインセンサに係る情報を順次書込んでいき、前
記後端部に達したら先頭部に戻つて書込みを進め
るようにし、読出しは前記ラインメモリにおいて
直列に構成した前記記憶素子のうちの先頭より順
次行なうようにしたものである。
ので、それぞれの先端部分の受光素子に遮光マス
クを有した複数本のラインセンサを、それぞれの
遮光マスクの部分が前段のラインセンサの後端に
重なるように配列して構成したラインセンサユニ
ツトと、前記ラインセンサのそれぞれの出力信号
を並列的にデイジタル化するＡ／Ｄ変換部と、そ
れぞれが前記ラインセンサの有効な読取り画素数
以上の記憶容量を有し、前記Ａ／Ｄ変換部からの
対応するラインセンサに係る情報をそれぞれが記
憶する複数の記憶素子で構成されるラインメモリ
とを備え、前記ラインメモリに記憶する際、それ
ぞれの前記記憶素子の後端部までに前記遮光マス
クに基準黒レベル情報が頂度記憶されるような前
記記憶素子における記憶位置から、対応する前記
ラインセンサに係る情報を順次書込んでいき、前
記後端部に達したら先頭部に戻つて書込みを進め
るようにし、読出しは前記ラインメモリにおいて
直列に構成した前記記憶素子のうちの先頭より順
次行なうようにしたものである。
（発明の実施例）
第１図はこの発明の一実施例を示すものであ
り、ラインセンサユニツト１０を構成するライン
センサ１１〜１５はそれぞれ駆動回路２１〜２５
で駆動され、ラインセンサ１１〜１５の各出力信
号はサンプルホールド回路３１〜３５にそれぞれ
入力され、ホールドされた信号がＡ／Ｄ変換器４
０（４１〜４５）に入力されてデイジタル信号に
変換される。ここで、ラインセンサ１１〜１５は
読取り位置を副走査方向にも異ならせて配列され
ているため、ラインセンサの出力信号は同一走査
線上を読取つた信号とならない。従つて、ライン
センサ内部もしくはサンプルホールド回路で出力
信号を遅延させるようにして、同一走査線上を読
取つた信号とを出力できるようにしておく。
り、ラインセンサユニツト１０を構成するライン
センサ１１〜１５はそれぞれ駆動回路２１〜２５
で駆動され、ラインセンサ１１〜１５の各出力信
号はサンプルホールド回路３１〜３５にそれぞれ
入力され、ホールドされた信号がＡ／Ｄ変換器４
０（４１〜４５）に入力されてデイジタル信号に
変換される。ここで、ラインセンサ１１〜１５は
読取り位置を副走査方向にも異ならせて配列され
ているため、ラインセンサの出力信号は同一走査
線上を読取つた信号とならない。従つて、ライン
センサ内部もしくはサンプルホールド回路で出力
信号を遅延させるようにして、同一走査線上を読
取つた信号とを出力できるようにしておく。
Ａ／Ｄ変換器４０のＡ／Ｄ変換出力は、制御回
路（図示せず）によつて切換えられる書込み用の
ラインメモリ５０又は６０に入力され、読出し用
になつているラインメモリか直列画像信号として
Ｓ５０又はＳ６０が出力される。２系列のライン
メモリ５０及び６０は制御回路によつて、書込み
用又は読出し用として交互に切換えられるように
なつており、ラインメモリ５０にＡ／Ｄ変換器４
０からのデータが書込まれている時にはラインメ
モリ６０が読出し用となつており、ラインメモリ
６０から直列の画像信号Ｓ６０が読出され、Ａ／
Ｄ変換器４０の出力がラインメモリ６０に書込ま
れている時にはラインメモリ５０が読出し用とな
つており、ラインメモリ５０から既に書込まれて
いるデータが画像信号Ｓ５０として出力されるこ
とになる。又、この発明では、ラインセンサ１１
〜１５の各出力信号が並列的にサンプルホールド
回路３１〜３５でサンプルホールドされ、そのホ
ールド値がそれぞれＡ／Ｄ変換器４１〜４５で
Ａ／Ｄ変換され、その後にラインメモリ５０又は
６０のそれぞれに対応する記憶素子に並列的に書
込まれてデータが記憶されるようになつており、
既に書込みが終了したラインメモリ５０又は６０
からは直列的に画像信号Ｓ５０又はＳ６０が出力
されるようになつている。
路（図示せず）によつて切換えられる書込み用の
ラインメモリ５０又は６０に入力され、読出し用
になつているラインメモリか直列画像信号として
Ｓ５０又はＳ６０が出力される。２系列のライン
メモリ５０及び６０は制御回路によつて、書込み
用又は読出し用として交互に切換えられるように
なつており、ラインメモリ５０にＡ／Ｄ変換器４
０からのデータが書込まれている時にはラインメ
モリ６０が読出し用となつており、ラインメモリ
６０から直列の画像信号Ｓ６０が読出され、Ａ／
Ｄ変換器４０の出力がラインメモリ６０に書込ま
れている時にはラインメモリ５０が読出し用とな
つており、ラインメモリ５０から既に書込まれて
いるデータが画像信号Ｓ５０として出力されるこ
とになる。又、この発明では、ラインセンサ１１
〜１５の各出力信号が並列的にサンプルホールド
回路３１〜３５でサンプルホールドされ、そのホ
ールド値がそれぞれＡ／Ｄ変換器４１〜４５で
Ａ／Ｄ変換され、その後にラインメモリ５０又は
６０のそれぞれに対応する記憶素子に並列的に書
込まれてデータが記憶されるようになつており、
既に書込みが終了したラインメモリ５０又は６０
からは直列的に画像信号Ｓ５０又はＳ６０が出力
されるようになつている。
このような構成において、この発明では、ライ
ンセンサ１１〜１５はそれぞれ図示の左端部に設
けられている遮光マスク１１Ｍ〜１５Ｍの位置よ
り画像を読取るようになつているが、サンプルホ
ールド回路３１〜３５及びＡ／Ｄ変換器４１〜４
５を経たデイジタル信号を、ラインメモリを構成
する各記憶素子５１〜５５又は６１〜６５へ書込
む時には、各記憶素子の中間部から順次書込みを
行ない、最後端に達した時に先頭部にリターンし
て次のデータを書込むようにする。第２図に例を
挙げて説明すると、ラインセンサ１１の有効な読
取り画素数の容量を持つた記憶素子が５１であ
り、ラインセンサ１２の有効な読取り画素数の容
量を持つた記憶素子が５２であるとした場合、ラ
インセンサ１１の出力信号をデイジタル化したデ
ータは記憶素子５１のＰ１をスタートアドレスと
して書込みを開始し、記憶素子５２に対してはス
タートアドレスＰ２よりデータを書込むようにす
る（第２図Ａ）。従つて、第２図Ａでは例えば、
記憶素子５１ではアドレスＰ１より遮光マスク１
１Ｍの基準黒レベルの信号が順次書込まれ、その
後に有効な画像信号が書込まれることになる。な
お、第２図Ａ〜Ｃにおいて、斜線部は基準黒ラベ
ル信号Ｓ１が書込まれた状態を示し、交叉線部は
有効な画像信号部分Ｓ２が書込まれた状態を示し
ている。そして、記憶素子５１の最後部PE１に
書込みを完了した後は、同図Ｂに示すように書込
みアドレスは最前部PS１に戻る。このとき有効
な画像データが記憶素子５１の最前部から書込ま
れるように、スタートアドレスＰ１を調整する。
そして、有効な画像信号が上記スタートアドレス
Ｐ１を過ぎても有効な画像信号を新しく書込み、
この書込みによつて古い基準黒レベルの信号を消
去する（第２図Ｃ）。そして、ラインセンサの有
効な読取画素数の容量を持つた記憶素子には、最
前部から最後部まで有効な画像データが書込ま
れ、ラインメモリ５０又は６０には有効な画像デ
ータのみが書込まれる。したがつて、ラインメモ
リ５０又は６０から直列的に読出すと、第５図に
示したような不要な基準黒レベルＳ１は、画像信
号Ｓ５０又はＳ６０に含まれないことになる。
ンセンサ１１〜１５はそれぞれ図示の左端部に設
けられている遮光マスク１１Ｍ〜１５Ｍの位置よ
り画像を読取るようになつているが、サンプルホ
ールド回路３１〜３５及びＡ／Ｄ変換器４１〜４
５を経たデイジタル信号を、ラインメモリを構成
する各記憶素子５１〜５５又は６１〜６５へ書込
む時には、各記憶素子の中間部から順次書込みを
行ない、最後端に達した時に先頭部にリターンし
て次のデータを書込むようにする。第２図に例を
挙げて説明すると、ラインセンサ１１の有効な読
取り画素数の容量を持つた記憶素子が５１であ
り、ラインセンサ１２の有効な読取り画素数の容
量を持つた記憶素子が５２であるとした場合、ラ
インセンサ１１の出力信号をデイジタル化したデ
ータは記憶素子５１のＰ１をスタートアドレスと
して書込みを開始し、記憶素子５２に対してはス
タートアドレスＰ２よりデータを書込むようにす
る（第２図Ａ）。従つて、第２図Ａでは例えば、
記憶素子５１ではアドレスＰ１より遮光マスク１
１Ｍの基準黒レベルの信号が順次書込まれ、その
後に有効な画像信号が書込まれることになる。な
お、第２図Ａ〜Ｃにおいて、斜線部は基準黒ラベ
ル信号Ｓ１が書込まれた状態を示し、交叉線部は
有効な画像信号部分Ｓ２が書込まれた状態を示し
ている。そして、記憶素子５１の最後部PE１に
書込みを完了した後は、同図Ｂに示すように書込
みアドレスは最前部PS１に戻る。このとき有効
な画像データが記憶素子５１の最前部から書込ま
れるように、スタートアドレスＰ１を調整する。
そして、有効な画像信号が上記スタートアドレス
Ｐ１を過ぎても有効な画像信号を新しく書込み、
この書込みによつて古い基準黒レベルの信号を消
去する（第２図Ｃ）。そして、ラインセンサの有
効な読取画素数の容量を持つた記憶素子には、最
前部から最後部まで有効な画像データが書込ま
れ、ラインメモリ５０又は６０には有効な画像デ
ータのみが書込まれる。したがつて、ラインメモ
リ５０又は６０から直列的に読出すと、第５図に
示したような不要な基準黒レベルＳ１は、画像信
号Ｓ５０又はＳ６０に含まれないことになる。
なお、上述の実施例ではラインセンサを５個直
列に接続しているが、ラインセンサの接続数は任
意である。また、ラインセンサを構成する各記憶
素子の記憶容量をラインセンサの有効な読取り画
素数以上にしても良い。この場合には、余つた記
憶容量部分を読出さないようにする。
列に接続しているが、ラインセンサの接続数は任
意である。また、ラインセンサを構成する各記憶
素子の記憶容量をラインセンサの有効な読取り画
素数以上にしても良い。この場合には、余つた記
憶容量部分を読出さないようにする。
（発明の効果）
以上のようにこの発明の読取回路によれば、ラ
インセンサを複数個段違いにかつライン状に接続
して長く構成しても、各ラインセンサの遮光マス
ク部及び重なり部分を消去してメモリに書込むこ
とができるので、ラインメモリからは原稿に対応
した直列画像データを読取ることができる。ま
た、ラインメモリを読取り用及び書込み用で交互
に切換えて利用するようにすれば、高速度の画像
読取りが可能となる。
インセンサを複数個段違いにかつライン状に接続
して長く構成しても、各ラインセンサの遮光マス
ク部及び重なり部分を消去してメモリに書込むこ
とができるので、ラインメモリからは原稿に対応
した直列画像データを読取ることができる。ま
た、ラインメモリを読取り用及び書込み用で交互
に切換えて利用するようにすれば、高速度の画像
読取りが可能となる。
第１図はこの発明の一実施例を示す回路構成
図、第２図Ａ〜Ｃはこの発明の動作例を説明する
ための図、第３図はラインセンサで原稿を読取る
場合の一例を示す図、第４図はラインセンサを直
列に接続したラインセンサユニツトの例を示す
図、第５図及び第６図はそれぞれラインセンサの
データの出力を説明するための図である。 １……ラインセンサ、２……原稿、４……レン
ズ系、１０……ラインセンサユニツト、１１〜１
５……ラインセンサ、２１〜２５……駆動回路、
３１〜３５……サンプルホールド回路、４０……
Ａ／Ｄ変換器、５０，６０……ラインメモリ。
図、第２図Ａ〜Ｃはこの発明の動作例を説明する
ための図、第３図はラインセンサで原稿を読取る
場合の一例を示す図、第４図はラインセンサを直
列に接続したラインセンサユニツトの例を示す
図、第５図及び第６図はそれぞれラインセンサの
データの出力を説明するための図である。 １……ラインセンサ、２……原稿、４……レン
ズ系、１０……ラインセンサユニツト、１１〜１
５……ラインセンサ、２１〜２５……駆動回路、
３１〜３５……サンプルホールド回路、４０……
Ａ／Ｄ変換器、５０，６０……ラインメモリ。
Claims (1)
- 【特許請求の範囲】 １ それぞれの先端部分の受光素子に遮光マスク
を有した複数本のラインセンサを、それぞれの遮
光マスクの部分が前段のラインセンサの後端に重
なるように配列して構成したラインセンサユニツ
トと、前記ラインセンサのそれぞれの出力信号を
並列的にデイジタル化するＡ／Ｄ変換部と、それ
ぞれが前記ラインセンサの有効な読取り画素数以
上の記憶容量を有し、前記Ａ／Ｄ変換部からの対
応するラインセンサに係る情報をそれぞれが記憶
する複数の記憶素子で構成されるラインメモリと
を備え、前記ラインメモリに記憶する際、それぞ
れの前記記憶素子の後端部までに前記遮光マスク
に基準黒レベル情報が頂度記憶されるような前記
記憶素子における記憶位置から、対応する前記ラ
インセンサに係る情報を順次書込んでいき、前記
後端部に達したら先頭部に戻つて書込みを進める
ようにし、読出しは前記ラインメモリにおいて直
列に構成した前記記憶素子のうちの先頭より順次
行なうようにしたことを特徴とするラインセンサ
の読取回路。 ２ 前記ラインメモリは書込み用及び読出し用の
２系列から成り、交互に切換えて使用するように
した特許請求の範囲第１項に記載のラインセンサ
の読取回路。
Priority Applications (4)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60262974A JPS62122461A (ja) | 1985-11-22 | 1985-11-22 | ラインセンサの読取回路 |
| EP86116166A EP0223260B1 (en) | 1985-11-22 | 1986-11-21 | Signal reading circuit for masked and overlapping linear image sensors |
| DE86116166T DE3689610T2 (de) | 1985-11-22 | 1986-11-21 | Signalleseschaltungsanordnung für maskierte und überlappende lineare Bildsensoren. |
| US06/934,578 US4754338A (en) | 1985-11-22 | 1986-11-24 | Signal reading circuit for masked and overlapping linear image sensors |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60262974A JPS62122461A (ja) | 1985-11-22 | 1985-11-22 | ラインセンサの読取回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS62122461A JPS62122461A (ja) | 1987-06-03 |
| JPH0516781B2 true JPH0516781B2 (ja) | 1993-03-05 |
Family
ID=17383133
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60262974A Granted JPS62122461A (ja) | 1985-11-22 | 1985-11-22 | ラインセンサの読取回路 |
Country Status (4)
| Country | Link |
|---|---|
| US (1) | US4754338A (ja) |
| EP (1) | EP0223260B1 (ja) |
| JP (1) | JPS62122461A (ja) |
| DE (1) | DE3689610T2 (ja) |
Families Citing this family (9)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS63191469A (ja) * | 1987-02-03 | 1988-08-08 | Toshiba Corp | 画像読取装置 |
| JPS63234765A (ja) * | 1987-03-24 | 1988-09-30 | Dainippon Screen Mfg Co Ltd | 画像読取装置 |
| EP0292253B1 (en) * | 1987-05-22 | 1992-03-18 | Oki Electric Industry Company, Limited | Contact-type image scanner |
| JPH01171361A (ja) * | 1987-12-25 | 1989-07-06 | Fuji Xerox Co Ltd | 原稿読取装置 |
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