JPH05176111A - Ｃｃｄの開始ビット自動検索装置 - Google Patents
Ｃｃｄの開始ビット自動検索装置Info
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- JPH05176111A JPH05176111A JP3341136A JP34113691A JPH05176111A JP H05176111 A JPH05176111 A JP H05176111A JP 3341136 A JP3341136 A JP 3341136A JP 34113691 A JP34113691 A JP 34113691A JP H05176111 A JPH05176111 A JP H05176111A
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- Japan
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- pixel
- ccd
- scanning
- signal
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Links
- 238000007599 discharging Methods 0.000 claims abstract description 18
- 238000010586 diagram Methods 0.000 description 7
- 102100031048 Coiled-coil domain-containing protein 6 Human genes 0.000 description 5
- 101000777370 Homo sapiens Coiled-coil domain-containing protein 6 Proteins 0.000 description 5
- 238000006243 chemical reaction Methods 0.000 description 5
Landscapes
- Transforming Light Signals Into Electric Signals (AREA)
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- Facsimile Scanning Arrangements (AREA)
Abstract
(57)【要約】
【目的】この発明は、イメージセンサの面倒で正確を期
し難い取り付け位置調整を不要にすることを目的とす
る。 【構成】 この発明は、ＣＣＤの有効画素エリアの走査
開始画素位置情報を記憶する記憶手段６と、走査開始信
号によりＣＣＤの画素信号排出を開始させ記憶手段６に
記憶されている走査開始画素位置情報により有効画素エ
リアの走査開始画素位置より１画素手前の画素まで走査
クロックに従って画素信号を順次に排出させる第１の画
素信号排出手段７と、走査クロックを計数してその計数
値が設定値に達したことによりＣＣＤから設定画素位置
以後の画素信号を順次に排出させる第２の画素信号排出
手段８とを備えたものである。
し難い取り付け位置調整を不要にすることを目的とす
る。 【構成】 この発明は、ＣＣＤの有効画素エリアの走査
開始画素位置情報を記憶する記憶手段６と、走査開始信
号によりＣＣＤの画素信号排出を開始させ記憶手段６に
記憶されている走査開始画素位置情報により有効画素エ
リアの走査開始画素位置より１画素手前の画素まで走査
クロックに従って画素信号を順次に排出させる第１の画
素信号排出手段７と、走査クロックを計数してその計数
値が設定値に達したことによりＣＣＤから設定画素位置
以後の画素信号を順次に排出させる第２の画素信号排出
手段８とを備えたものである。
Description
【０００１】
【産業上の利用分野】本発明はＣＣＤの開始ビット自動
検索装置に関する。
検索装置に関する。
【０００２】
【従来の技術】従来、イメージセンサは例えば図８に示
すように１次元のＣＣＤ１とレンズ２とを筐体３内に設
けたもの４が用いられ、ＣＣＤ１はレンズ２により被写
体、例えばカード，通帳等の媒体５が結像される。ＣＣ
Ｄ１の長手方向の有効な画素エリアＡは予めユーザによ
り設定され、この有効画素エリアＡに対応した範囲が媒
体５の有効な幅方向読み取りエリアＢとなる。
すように１次元のＣＣＤ１とレンズ２とを筐体３内に設
けたもの４が用いられ、ＣＣＤ１はレンズ２により被写
体、例えばカード，通帳等の媒体５が結像される。ＣＣ
Ｄ１の長手方向の有効な画素エリアＡは予めユーザによ
り設定され、この有効画素エリアＡに対応した範囲が媒
体５の有効な幅方向読み取りエリアＢとなる。
【０００３】媒体５は搬送器によりＣＣＤ１の長手方向
と直角な方向へ搬送され、ＣＣＤ１はＣＣＤ駆動回路か
らのクロックにより駆動される。そして、ＣＣＤ１は媒
体５における読み取りライン上の有効な幅方向読み取り
エリアＢの画像がレンズ２により有効画素エリアＡに結
像されてこれを長手方向に一列に配列されている複数ビ
ットの光電変換素子によりそれぞれ電荷に変換して蓄積
し、これらを並列にシフトゲートを介してシフトレジス
タに転送した後に走査クロックによりシフトレジスタか
ら直列に順次に排出する。
と直角な方向へ搬送され、ＣＣＤ１はＣＣＤ駆動回路か
らのクロックにより駆動される。そして、ＣＣＤ１は媒
体５における読み取りライン上の有効な幅方向読み取り
エリアＢの画像がレンズ２により有効画素エリアＡに結
像されてこれを長手方向に一列に配列されている複数ビ
ットの光電変換素子によりそれぞれ電荷に変換して蓄積
し、これらを並列にシフトゲートを介してシフトレジス
タに転送した後に走査クロックによりシフトレジスタか
ら直列に順次に排出する。
【０００４】イメージセンサ４の取り付け位置はＣＣＤ
１の有効画素エリアＡと媒体５の有効な幅方向読み取り
エリアＢとが一致するように人間により機械的に調整さ
れ、ＣＣＤ１から排出される画素信号は有効画素エリア
Ｂ内の複数の光電変換素子、例えば図９に示すように画
素信号排出順に見てｎ番目より（ｎ＋１０２４）番目ま
での光電変換素子からの画素信号が有効となものとして
用いられる。なお、図９，図１０において斜線はシフト
レジスタ内の有効な画素信号を示す。
１の有効画素エリアＡと媒体５の有効な幅方向読み取り
エリアＢとが一致するように人間により機械的に調整さ
れ、ＣＣＤ１から排出される画素信号は有効画素エリア
Ｂ内の複数の光電変換素子、例えば図９に示すように画
素信号排出順に見てｎ番目より（ｎ＋１０２４）番目ま
での光電変換素子からの画素信号が有効となものとして
用いられる。なお、図９，図１０において斜線はシフト
レジスタ内の有効な画素信号を示す。
【０００５】
【発明が解決しようとする課題】上記イメージセンサ４
は、その取り付け位置がＣＣＤ１の有効画素エリアＡと
媒体５の有効な幅方向読み取りエリアＢとが一致するよ
うに人間により機械的に調整されるので、取り付け位置
の調整が面倒である。しかも、正確にＣＣＤ１の有効画
素エリアＡと媒体５の有効な幅方向読み取りエリアＢと
を一致させることが難しくてＣＣＤ１において媒体５の
有効な幅方向読み取りエリアＢに正確に対応した範囲内
の光電変換素子による画素信号を得ることが難しくな
る。
は、その取り付け位置がＣＣＤ１の有効画素エリアＡと
媒体５の有効な幅方向読み取りエリアＢとが一致するよ
うに人間により機械的に調整されるので、取り付け位置
の調整が面倒である。しかも、正確にＣＣＤ１の有効画
素エリアＡと媒体５の有効な幅方向読み取りエリアＢと
を一致させることが難しくてＣＣＤ１において媒体５の
有効な幅方向読み取りエリアＢに正確に対応した範囲内
の光電変換素子による画素信号を得ることが難しくな
る。
【０００６】本発明は上記欠点を改善し、イメージセン
サの面倒で正確を期し難い取り付け位置調整が不要にな
るＣＣＤの開始ビット自動検索装置を提供することを目
的とする。
サの面倒で正確を期し難い取り付け位置調整が不要にな
るＣＣＤの開始ビット自動検索装置を提供することを目
的とする。
【０００７】
【課題を解決するための手段】上記目的を達成するた
め、本発明は、図１に示すようにＣＣＤの有効画素エリ
アの走査開始画素位置情報を記憶する記憶手段６と、走
査開始信号により前記ＣＣＤの画素信号排出を開始させ
前記記憶手段６に記憶されている走査開始画素位置情報
により有効画素エリアの走査開始画素位置より１画素手
前の画素まで走査クロックに従って画素信号を順次に排
出させる第１の画素信号排出手段７と、前記走査クロッ
クを計数してその計数値が設定値に達したことにより前
記ＣＣＤから前記設定画素位置以後の画素信号を順次に
排出させる第２の画素信号排出手段８とを備えたもので
ある。
め、本発明は、図１に示すようにＣＣＤの有効画素エリ
アの走査開始画素位置情報を記憶する記憶手段６と、走
査開始信号により前記ＣＣＤの画素信号排出を開始させ
前記記憶手段６に記憶されている走査開始画素位置情報
により有効画素エリアの走査開始画素位置より１画素手
前の画素まで走査クロックに従って画素信号を順次に排
出させる第１の画素信号排出手段７と、前記走査クロッ
クを計数してその計数値が設定値に達したことにより前
記ＣＣＤから前記設定画素位置以後の画素信号を順次に
排出させる第２の画素信号排出手段８とを備えたもので
ある。
【０００８】
【作用】ＣＣＤの有効画素エリアの走査開始画素位置情
報が記憶手段６により記憶され、第１の画素信号排出手
段７が走査開始信号によりＣＣＤの画素信号排出を開始
させて記憶手段６に記憶されている走査開始画素位置情
報により有効画素エリアの走査開始画素位置より１画素
手前の画素まで走査クロックに従って画素信号を順次に
排出させる。そして、第２の画素信号排出手段８が走査
クロックを計数し、その計数値が設定値に達したことに
よりＣＣＤから設定画素位置以後の画素信号を順次に排
出させる。
報が記憶手段６により記憶され、第１の画素信号排出手
段７が走査開始信号によりＣＣＤの画素信号排出を開始
させて記憶手段６に記憶されている走査開始画素位置情
報により有効画素エリアの走査開始画素位置より１画素
手前の画素まで走査クロックに従って画素信号を順次に
排出させる。そして、第２の画素信号排出手段８が走査
クロックを計数し、その計数値が設定値に達したことに
よりＣＣＤから設定画素位置以後の画素信号を順次に排
出させる。
【０００９】
【実施例】図２は本発明の一実施例を示し、図４はこの
実施例のタイミングチャートを示す。ＣＣＤ１は上記イ
メージセンサ４のＣＣＤであってＣＣＤ駆動回路により
駆動され、長手方向の有効画素エリアＡに媒体５におけ
る読み取りライン上の有効な幅方向読み取りエリアＢの
画像がレンズ２により結像される。このＣＣＤ１は長手
方向に一列に配列されている複数ビットの光電変換素子
がそれぞれ入射光を電荷に変換して蓄積し、これらを並
列にシフトゲートを介してシフトレジスタに転送した後
に走査クロックＩＳＣＫによりシフトレジスタから直列
に順次に画素信号として排出することで主走査が行われ
る。
実施例のタイミングチャートを示す。ＣＣＤ１は上記イ
メージセンサ４のＣＣＤであってＣＣＤ駆動回路により
駆動され、長手方向の有効画素エリアＡに媒体５におけ
る読み取りライン上の有効な幅方向読み取りエリアＢの
画像がレンズ２により結像される。このＣＣＤ１は長手
方向に一列に配列されている複数ビットの光電変換素子
がそれぞれ入射光を電荷に変換して蓄積し、これらを並
列にシフトゲートを介してシフトレジスタに転送した後
に走査クロックＩＳＣＫによりシフトレジスタから直列
に順次に画素信号として排出することで主走査が行われ
る。
【００１０】ＣＣＤ１から排出された画素信号は増幅器
１１により増幅されてＡ／Ｄ変換器１２によりＡ／Ｄ変
換され、ロジック回路１３へ出力される。この実施例は
予めテストモードでＣＣＤ１において媒体５の有効な幅
方向読み取りエリアＢに正確に対応する長手方向の有効
画素エリアＡの走査開始画素位置を測定してＥ2ＰＲＯ
Ｍ１４に書き込んでおく。
１１により増幅されてＡ／Ｄ変換器１２によりＡ／Ｄ変
換され、ロジック回路１３へ出力される。この実施例は
予めテストモードでＣＣＤ１において媒体５の有効な幅
方向読み取りエリアＢに正確に対応する長手方向の有効
画素エリアＡの走査開始画素位置を測定してＥ2ＰＲＯ
Ｍ１４に書き込んでおく。
【００１１】テストモードでは、媒体５として図３
（ａ）に示すような走査開始画素位置測定用媒体１５が
用いられ、この走査開始画素位置測定用媒体１５は有効
な幅方向読み取りエリアＢが黒色であって、有効な幅方
向読み取りエリアＢ以外の領域が白色である。走査開始
画素位置測定用媒体１５は搬送機によりＣＣＤ１の長手
方向と直角な方向へ搬送されて読み取りライン上で光源
により照明され、その反射光像がＣＣＤ１により光電変
換される。
（ａ）に示すような走査開始画素位置測定用媒体１５が
用いられ、この走査開始画素位置測定用媒体１５は有効
な幅方向読み取りエリアＢが黒色であって、有効な幅方
向読み取りエリアＢ以外の領域が白色である。走査開始
画素位置測定用媒体１５は搬送機によりＣＣＤ１の長手
方向と直角な方向へ搬送されて読み取りライン上で光源
により照明され、その反射光像がＣＣＤ１により光電変
換される。
【００１２】ＣＣＤ１はＣＣＤ駆動回路からのクロック
により駆動され、走査開始画素位置測定用媒体１５にお
ける有効な幅方向読み取りエリアＢの画像がレンズ２に
より長手方向の有効画素エリアＡに結像されてこれを長
手方向に一列に配列されている複数ビットの光電変換素
子によりそれぞれ電荷に変換して蓄積し、これらを画素
信号として並列にシフトゲートを介してシフトレジスタ
に転送した後に、ＣＣＤ駆動回路からの走査クロックＩ
ＳＣＫによりシフトレジスタから直列に順次にシフトし
て排出する。ＣＣＤ１がこのような動作を繰り返して行
い、画素信号の排出が走査クロックＩＳＣＫにより１ラ
イン分づつ開始される。
により駆動され、走査開始画素位置測定用媒体１５にお
ける有効な幅方向読み取りエリアＢの画像がレンズ２に
より長手方向の有効画素エリアＡに結像されてこれを長
手方向に一列に配列されている複数ビットの光電変換素
子によりそれぞれ電荷に変換して蓄積し、これらを画素
信号として並列にシフトゲートを介してシフトレジスタ
に転送した後に、ＣＣＤ駆動回路からの走査クロックＩ
ＳＣＫによりシフトレジスタから直列に順次にシフトし
て排出する。ＣＣＤ１がこのような動作を繰り返して行
い、画素信号の排出が走査クロックＩＳＣＫにより１ラ
イン分づつ開始される。
【００１３】走査開始パルス／ＳＴＰ（／は反転を意味
する）及びＣＣＤ１からの画素信号は図３（ｂ）（ｃ）
に示すような波形となり、ＣＣＤ１からの画素信号は増
幅器１１及びＡ／Ｄ変換器１２を介してロジック回路１
３により２値化されてＣＰＵ１６へ出力される。ロジッ
ク回路１３からの２値化データは図３（ｄ）に示すよう
に走査開始画素位置測定用媒体１５の黒色の有効な幅方
向読み取りエリアＢで低レベルになって走査開始画素位
置測定用媒体１５の有効な幅方向読み取りエリアＢ以外
の白色部分で高レベルとなり、走査開始パルス／ＳＴＰ
の立ち下がりよりロジック回路１３からの２値化データ
の立ち下がりまでの時間Ｔは走査開始画素位置測定用媒
体１５の黒色の有効な幅方向読み取りエリアＢに対応し
たＣＣＤ１の長手方向の有効画素エリアＡの走査開始画
素位置により決まる。
する）及びＣＣＤ１からの画素信号は図３（ｂ）（ｃ）
に示すような波形となり、ＣＣＤ１からの画素信号は増
幅器１１及びＡ／Ｄ変換器１２を介してロジック回路１
３により２値化されてＣＰＵ１６へ出力される。ロジッ
ク回路１３からの２値化データは図３（ｄ）に示すよう
に走査開始画素位置測定用媒体１５の黒色の有効な幅方
向読み取りエリアＢで低レベルになって走査開始画素位
置測定用媒体１５の有効な幅方向読み取りエリアＢ以外
の白色部分で高レベルとなり、走査開始パルス／ＳＴＰ
の立ち下がりよりロジック回路１３からの２値化データ
の立ち下がりまでの時間Ｔは走査開始画素位置測定用媒
体１５の黒色の有効な幅方向読み取りエリアＢに対応し
たＣＣＤ１の長手方向の有効画素エリアＡの走査開始画
素位置により決まる。
【００１４】ＣＰＵ１６は走査開始パルス／ＳＴＰ及び
ロジック回路１３からの２値化データにより上記時間Ｔ
を計時することでＣＣＤ１の長手方向の有効画素エリア
Ａの走査開始画素位置を検出してＥ2ＰＲＯＭ１４に書
き込む。
ロジック回路１３からの２値化データにより上記時間Ｔ
を計時することでＣＣＤ１の長手方向の有効画素エリア
Ａの走査開始画素位置を検出してＥ2ＰＲＯＭ１４に書
き込む。
【００１５】図５は上記ロジック回路１３の構成を示
す。上記Ａ／Ｄ変換器１２の出力信号は２値化回路１７
により２値化されてラッチ回路１８に入力され、テスト
モード時にテストモード信号／ＴＳＴ１はラッチ回路１
９及びＣＰＵ１６に入力される。ラッチ回路１９はテス
トモード信号／ＴＳＴ１がアクティブになることにより
イネーブルとなり、上記走査開始パルス／ＳＴＰをラッ
してラッチ回路１８へ出力する。ラッチ回路１８はラッ
チ回路１９の出力信号によりイネーブルとなり、２値化
回路１７からの２値化データをラッチしてＣＰＵ１６へ
出力する。
す。上記Ａ／Ｄ変換器１２の出力信号は２値化回路１７
により２値化されてラッチ回路１８に入力され、テスト
モード時にテストモード信号／ＴＳＴ１はラッチ回路１
９及びＣＰＵ１６に入力される。ラッチ回路１９はテス
トモード信号／ＴＳＴ１がアクティブになることにより
イネーブルとなり、上記走査開始パルス／ＳＴＰをラッ
してラッチ回路１８へ出力する。ラッチ回路１８はラッ
チ回路１９の出力信号によりイネーブルとなり、２値化
回路１７からの２値化データをラッチしてＣＰＵ１６へ
出力する。
【００１６】ＣＰＵ１６は図６に示すように外部からの
テストモード信号／ＴＳＴ１がアクティブになってテス
トモードになったか否かを検知し、テストモード信号／
ＴＳＴ１がアクティブになった場合には上記走査開始パ
ルス／ＳＴＰが立ち下がったか否かを検知する。そし
て、ＣＰＵ１６は走査開始パルス／ＳＴＰが立ち下がっ
た場合にはラッチ回路１８からの２値化データが立ち下
がるまでの時間に走査クロックＩＳＣＫをカウンタでカ
ウントすることによって上記時間Ｔを計時し、このカウ
ンタの値をＣＣＤ１の長手方向の有効画素エリアＡの走
査開始画素位置の画素番号（ＣＣＤ１で画素信号を生成
する各画素の番号は走査順に付けられる）ｎに換算して
Ｅ2ＰＲＯＭ１４に書き込む。
テストモード信号／ＴＳＴ１がアクティブになってテス
トモードになったか否かを検知し、テストモード信号／
ＴＳＴ１がアクティブになった場合には上記走査開始パ
ルス／ＳＴＰが立ち下がったか否かを検知する。そし
て、ＣＰＵ１６は走査開始パルス／ＳＴＰが立ち下がっ
た場合にはラッチ回路１８からの２値化データが立ち下
がるまでの時間に走査クロックＩＳＣＫをカウンタでカ
ウントすることによって上記時間Ｔを計時し、このカウ
ンタの値をＣＣＤ１の長手方向の有効画素エリアＡの走
査開始画素位置の画素番号（ＣＣＤ１で画素信号を生成
する各画素の番号は走査順に付けられる）ｎに換算して
Ｅ2ＰＲＯＭ１４に書き込む。
【００１７】上述のテストモードが終了した後には通常
のモードになり、この通常のモードではＣＰＵ１６が図
７に示すようにＣＣＤ駆動回路を制御してＣＣＤ１をフ
リーランさせる。ＣＣＤ１は走査開始画素位置測定用媒
体１５でない通常の媒体５がレンズ２により結像され
る。ＣＣＤ１の長手方向の有効な画素エリアＡは媒体５
の有効な幅方向読み取りエリアＢに対応したものとな
り、イメージセンサ４の取り付け位置は調整されない。
ユーザはＣＣＤ１において何番目から何番目までの画素
信号を必要とするかを設定部により設定してその設定値
をＣＰＵ１６へ出力し、例えばＣＣＤ１から排出される
１ライン分の画素信号のうちで必要とする画素信号の排
出順の番号をＮ番目から（Ｎ＋１０２４）番目までに設
定してＣＰＵ１６へ出力する。
のモードになり、この通常のモードではＣＰＵ１６が図
７に示すようにＣＣＤ駆動回路を制御してＣＣＤ１をフ
リーランさせる。ＣＣＤ１は走査開始画素位置測定用媒
体１５でない通常の媒体５がレンズ２により結像され
る。ＣＣＤ１の長手方向の有効な画素エリアＡは媒体５
の有効な幅方向読み取りエリアＢに対応したものとな
り、イメージセンサ４の取り付け位置は調整されない。
ユーザはＣＣＤ１において何番目から何番目までの画素
信号を必要とするかを設定部により設定してその設定値
をＣＰＵ１６へ出力し、例えばＣＣＤ１から排出される
１ライン分の画素信号のうちで必要とする画素信号の排
出順の番号をＮ番目から（Ｎ＋１０２４）番目までに設
定してＣＰＵ１６へ出力する。
【００１８】媒体５は搬送器によりＣＣＤ１の長手方向
と直角な方向へ搬送され、ＣＣＤ１はＣＣＤ駆動回路か
らのクロックにより駆動される。そして、ＣＣＤ１は媒
体５における読み取りライン上の有効な幅方向読み取り
エリアＢの画像がレンズ２により有効画素エリアＡに結
像されてこれを長手方向に一列に配列されている複数ビ
ットの光電変換素子によりそれぞれ電荷に変換して蓄積
し、これらを並列にシフトゲートを介してシフトレジス
タに転送した後に走査クロックによりシフトレジスタか
ら直列に順次に排出する。
と直角な方向へ搬送され、ＣＣＤ１はＣＣＤ駆動回路か
らのクロックにより駆動される。そして、ＣＣＤ１は媒
体５における読み取りライン上の有効な幅方向読み取り
エリアＢの画像がレンズ２により有効画素エリアＡに結
像されてこれを長手方向に一列に配列されている複数ビ
ットの光電変換素子によりそれぞれ電荷に変換して蓄積
し、これらを並列にシフトゲートを介してシフトレジス
タに転送した後に走査クロックによりシフトレジスタか
ら直列に順次に排出する。
【００１９】ＣＰＵ１６は図７に示すように上記走査開
始パルスＳＴＰがアクティブになったか否かを検知し、
走査開始パルスＳＴＰがアクティブになった場合にはカ
ウンタのカウント数をリセットする。次に、ＣＰＵ１６
はＣＣＤ駆動回路を制御し、図４に示すように外部から
の走査クロックＳＣＫとは非同期でこれより周波数が高
い走査クロックＩＳＣＫを発生させてＣＣＤ１を駆動さ
せる。
始パルスＳＴＰがアクティブになったか否かを検知し、
走査開始パルスＳＴＰがアクティブになった場合にはカ
ウンタのカウント数をリセットする。次に、ＣＰＵ１６
はＣＣＤ駆動回路を制御し、図４に示すように外部から
の走査クロックＳＣＫとは非同期でこれより周波数が高
い走査クロックＩＳＣＫを発生させてＣＣＤ１を駆動さ
せる。
【００２０】そして、ＣＰＵ１６はカウンタで走査クロ
ックＩＳＣＫをカウントすることによって画素信号の排
出数をカウントし、このカウンタのカウント数が（ｎ−
１）に達したか否かを判断する。ＣＰＵ１６はカウンタ
のカウント数が（ｎ−１）に達した時にはＣＣＤ駆動回
路に走査クロックＩＳＣＫの出力を停止させてＣＣＤ１
の画素信号排出を停止させ、ユーザにより設定部から入
力されたＮによりカウンタのカウント数が（Ｎ−１）に
達したか否かを判断する。
ックＩＳＣＫをカウントすることによって画素信号の排
出数をカウントし、このカウンタのカウント数が（ｎ−
１）に達したか否かを判断する。ＣＰＵ１６はカウンタ
のカウント数が（ｎ−１）に達した時にはＣＣＤ駆動回
路に走査クロックＩＳＣＫの出力を停止させてＣＣＤ１
の画素信号排出を停止させ、ユーザにより設定部から入
力されたＮによりカウンタのカウント数が（Ｎ−１）に
達したか否かを判断する。
【００２１】ここに、ＣＣＤ１から排出される１番目か
ら（ｎ−１）番目までの画素信号は正規の画素信号出力
タイミングよりも早いタイミングで無効な画素信号とし
て排出され、その後で図１０に示すようにＣＣＤ１から
Ｎ番目以後の画素信号を排出する状態で画素信号の排出
が停止される。
ら（ｎ−１）番目までの画素信号は正規の画素信号出力
タイミングよりも早いタイミングで無効な画素信号とし
て排出され、その後で図１０に示すようにＣＣＤ１から
Ｎ番目以後の画素信号を排出する状態で画素信号の排出
が停止される。
【００２２】ＣＰＵ１６はカウンタのカウント数が（Ｎ
−１）に達した時には図４に示すようにＣＣＤ駆動回路
に走査クロックＩＳＣＫを外部からの走査クロックＳＣ
Ｋに同期して生成させてＣＣＤ１へ出力させることによ
ってＣＣＤ１の画素信号排出を再開させる。したがっ
て、ＣＣＤ１からＮ番目以後の画素信号が正規の画素信
号として直ちに排出される。
−１）に達した時には図４に示すようにＣＣＤ駆動回路
に走査クロックＩＳＣＫを外部からの走査クロックＳＣ
Ｋに同期して生成させてＣＣＤ１へ出力させることによ
ってＣＣＤ１の画素信号排出を再開させる。したがっ
て、ＣＣＤ１からＮ番目以後の画素信号が正規の画素信
号として直ちに排出される。
【００２３】以上の動作が繰り返して行われることによ
りＣＣＤ１から１ライン分毎にユーザにより設定された
Ｎ番目以後の画素信号が正規の画素信号として排出され
る。このように、ＣＣＤ１から１ライン分毎に１番目か
ら（ｎ−１）番目までの画素信号を早目に無効な画素信
号として排出し、それから一旦停止してユーザにより設
定されたＮ番目以後の画素信号を正規の画素信号として
排出することにより、イメージセンサ４の面倒で正確を
期し難い取り付け位置調整が不要になる。
りＣＣＤ１から１ライン分毎にユーザにより設定された
Ｎ番目以後の画素信号が正規の画素信号として排出され
る。このように、ＣＣＤ１から１ライン分毎に１番目か
ら（ｎ−１）番目までの画素信号を早目に無効な画素信
号として排出し、それから一旦停止してユーザにより設
定されたＮ番目以後の画素信号を正規の画素信号として
排出することにより、イメージセンサ４の面倒で正確を
期し難い取り付け位置調整が不要になる。
【００２４】
【発明の効果】以上のように本発明によれば、ＣＣＤの
有効画素エリアの走査開始画素位置情報を記憶する記憶
手段と、走査開始信号により前記ＣＣＤの画素信号排出
を開始させ前記記憶手段に記憶されている走査開始画素
位置情報により有効画素エリアの走査開始画素位置より
１画素手前の画素まで走査クロックに従って画素信号を
順次に排出させる第１の画素信号排出手段と、前記走査
クロックを計数してその計数値が設定値に達したことに
より前記ＣＣＤから前記設定画素位置以後の画素信号を
順次に排出させる第２の画素信号排出手段とを備えたの
で、イメージセンサの面倒で正確を期し難い取り付け位
置調整が不要になる。
有効画素エリアの走査開始画素位置情報を記憶する記憶
手段と、走査開始信号により前記ＣＣＤの画素信号排出
を開始させ前記記憶手段に記憶されている走査開始画素
位置情報により有効画素エリアの走査開始画素位置より
１画素手前の画素まで走査クロックに従って画素信号を
順次に排出させる第１の画素信号排出手段と、前記走査
クロックを計数してその計数値が設定値に達したことに
より前記ＣＣＤから前記設定画素位置以後の画素信号を
順次に排出させる第２の画素信号排出手段とを備えたの
で、イメージセンサの面倒で正確を期し難い取り付け位
置調整が不要になる。
【図１】本発明を示すブロック図である。
【図２】本発明の一実施例を示すブロック図である。
【図３】同実施例を説明するための図である。
【図４】同実施例のタイミングチャートである。
【図５】同実施例の一部を示すブロック図である。
【図６】同実施例におけるＣＰＵのテストモード処理ル
ーチンを示すフローチャートである。
ーチンを示すフローチャートである。
【図７】同実施例におけるＣＰＵの通常モード処理ルー
チンを示すフローチャートである。
チンを示すフローチャートである。
【図８】イメージセンサ及び媒体の例を示す概略図であ
る。
る。
【図９】ＣＣＤの画素信号排出前の状態を示す図であ
る。
る。
【図１０】ＣＣＤの画素信号排出開始時の状態を示す図
である。
である。
６ 記憶手段 ７ 第１の画素信号排出手段 ８ 第２の画素信号排出手段
Claims (1)
- 【請求項１】ＣＣＤの有効画素エリアの走査開始画素位
置情報を記憶する記憶手段と、走査開始信号により前記
ＣＣＤの画素信号排出を開始させ前記記憶手段に記憶さ
れている走査開始画素位置情報により有効画素エリアの
走査開始画素位置より１画素手前の画素まで走査クロッ
クに従って画素信号を順次に排出させる第１の画素信号
排出手段と、前記走査クロックを計数してその計数値が
設定値に達したことにより前記ＣＣＤから前記設定画素
位置以後の画素信号を順次に排出させる第２の画素信号
排出手段とを備えたことを特徴とするＣＣＤの開始ビッ
ト自動検索装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3341136A JPH05176111A (ja) | 1991-12-24 | 1991-12-24 | Ｃｃｄの開始ビット自動検索装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3341136A JPH05176111A (ja) | 1991-12-24 | 1991-12-24 | Ｃｃｄの開始ビット自動検索装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH05176111A true JPH05176111A (ja) | 1993-07-13 |
Family
ID=18343593
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3341136A Pending JPH05176111A (ja) | 1991-12-24 | 1991-12-24 | Ｃｃｄの開始ビット自動検索装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH05176111A (ja) |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS57106984A (en) * | 1980-12-24 | 1982-07-03 | Fujitsu Ltd | Picture correction system |
| JPS6118673B2 (ja) * | 1978-07-05 | 1986-05-13 | Toyota Motor Co Ltd |
-
1991
- 1991-12-24 JP JP3341136A patent/JPH05176111A/ja active Pending
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6118673B2 (ja) * | 1978-07-05 | 1986-05-13 | Toyota Motor Co Ltd | |
| JPS57106984A (en) * | 1980-12-24 | 1982-07-03 | Fujitsu Ltd | Picture correction system |
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