JPH05226841A - セラミック多層基板 - Google Patents

セラミック多層基板

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JPH05226841A
JPH05226841A JP4023552A JP2355292A JPH05226841A JP H05226841 A JPH05226841 A JP H05226841A JP 4023552 A JP4023552 A JP 4023552A JP 2355292 A JP2355292 A JP 2355292A JP H05226841 A JPH05226841 A JP H05226841A
Authority
JP
Japan
Prior art keywords
wiring
narrowed
sectional area
width
cross
Prior art date
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Pending
Application number
JP4023552A
Other languages
English (en)
Inventor
Norihiro Ami
徳宏 阿美
Shosaku Ishihara
昌作 石原
Takashi Kuroki
喬 黒木
Seiichi Tsuchida
誠一 槌田
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Hitachi Ltd
Original Assignee
Hitachi Ltd
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Filing date
Publication date
Application filed by Hitachi Ltd filed Critical Hitachi Ltd
Priority to JP4023552A priority Critical patent/JPH05226841A/ja
Publication of JPH05226841A publication Critical patent/JPH05226841A/ja
Pending legal-status Critical Current

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  • Production Of Multi-Layered Print Wiring Board (AREA)

Abstract

(57)【要約】 【目的】セラミック多層基板の配線を高密度に形成しよ
うという要求は年々高まっている。配線密度を高くする
ためには、配線幅を狭くしていく必要があるが、配線幅
を狭くし断面積が減少すると、配線の電気抵抗が高くな
り、電圧降下が大きくなり、ノイズマージンが減少する
という不都合があった。本発明の目的の一つは、配線幅
を狭くしても断面積が狭くならず、従って抵抗が高くな
らない配線を形成する方法及びこの配線を持った基板を
提供することである。 【構成】本発明の一実施例によれば、グリーンシート1
01の裏面に、このシートと重ねられるシートのパター
ンに対応した印刷配線102が提供される。 【効果】表裏の印刷配線102が積層圧着され断面積の
大きい配線を形成する。

Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】本発明は、セラミックスの多層配
線基板とその製造方法に関し、特に、コンピータ用の高
密度配線基板等に関する。
【0002】
【従来の技術】セラミック粉末をバインダ及び溶剤とい
っしょに混合し、ドクターブレード等でグリーンシート
に成形して、このグリーンシートに導体粉末の入ったペ
ーストをスクリーン印刷と同様の方法で印刷し、印刷さ
れたグリーンシートを積層、圧着、焼成して、セラミッ
ク基板の内部に多層の配線を形成する方法が提案されて
いる(小西良弘、辻俊郎「エレクトロセラミックスの基
礎と応用」オーム社(1978年)49ページ)。
【0003】
【発明が解決しようとする課題】配線を高密度に形成し
ようという要求は年々高まっているが、従来技術で配線
密度を高くするためには、配線幅を狭くしていく必要が
あるが、配線幅が狭くなると配線の断面積が減少するた
めに、配線の電気抵抗が高くなる。そのために、配線途
中での電圧降下が大きくなり、ノイズマージンが減少す
るという不都合があった。
【0004】また、上記の幅狭くした配線に、幅を狭く
する前と同等の電流を流すと、配線中の電流密度が高く
なるので、エレクトロマイグレーションや過剰加熱等の
発生確率が高くなるという不都合があった。
【0005】一方、配線の単位断面積当たりの抵抗率を
下げようとして、ペースト中の導体材料を変更しようと
すると、セラミック基板の焼結温度等の変更も必要とな
ってしまう。また、ペースト中の導体充填率を変更しよ
うとすると、ペーストの特性が変わるために印刷条件を
新たに設定しなおさなければならないという不都合が生
じた。
【0006】さらに、広い断面積の配線を形成しようと
して、ペーストを厚く印刷したり、複数回重ねて印刷す
ると、積層圧着時に印刷配線の断面形状が大きく歪むた
めに配線間でショートしてしまうという不都合が起こっ
た。
【0007】本発明の目的の一つは、配線幅を狭くして
も抵抗が高くならない配線を形成する方法及びこの配線
を持った基板を提供することである。
【0008】本発明の他の目的は、配線幅を狭くしても
エレクトロマイグレーションや過剰加熱等の発生確率が
高くならない配線を形成する方法及びこの配線を持った
基板を提供することである。
【0009】本発明のさらに他の目的は、同一のペース
トを用いていながら配線幅を狭くしても抵抗が高くなら
ない配線及びこの配線を持った基板を提供することであ
る。
【0010】本発明のもう一つ別の目的は、狭配線でか
つ断面積の大きい配線で且つ積層圧着時の変形の少ない
ものの形成方法とこの配線を持った基板を提供すること
である。
【0011】
【課題を解決するための手段】本発明の一実施例によれ
ば、配線印刷されたグリーンシートの裏面に、このシー
トと重ねられるシートのパターンに対応した印刷配線が
提供される。
【0012】
【作用】グリーンシートの裏面の配線印刷は、重ねられ
るシートの表の配線印刷と積層圧着時に一体となり、断
面積の広い配線となる。
【0013】
【実施例】図1は本発明による多層配線基板の一実施例
の断面の一部の斜視図である。この基板は、導体ペース
ト102が印刷されたセラミックスグリーンシート10
1が4枚積層されている。図中の線A−A’、B−
B’、C−C’はそれぞれ第1層目と第2層目、第2層
目と第3層目、第3層目と第4層目の界面を示してい
る。
【0014】図2は本実施例の積層前の各グリーンシー
トの層構成を示した図である。第1層目の裏面には、第
2層目の表面の配線パターンに対応した印刷が施されて
いる。第2層の裏面、第3層の裏面にも、それぞれ、第
4層の表面、第5層の表面の配線に対応したパターンで
導体ペーストが印刷されている。この4層を積層圧着す
るとこれら対をなしている表裏面の導体ペーストは一体
化して配線を形成する。
【0015】図3aは本発明による多層配線基板を用い
たLSIモジュールの斜視図である。LSI301とコ
ンデンサ303がセラミック多層基板302の片面にに
接続されていて、他方の面にはこのモジュールへの給電
と信号授受のための端子305が取り付けられている。
図3bは上記モジュールの線A−A’での断面図であ
る。LSI301がはんだバンプ304によって基板3
02に接続されている。基板302の表面及び内部には
配線306が形成されている。
【0016】本実施例では、セラミック基板302の材
質はムライトを主成分とする。ムライトは1600℃で
焼結させるので配線用の金属にはタングステンを使用す
る。したがって、印刷ペースト102にはタングステン
粉末を含むものを用いた。このペーストによって印刷し
た配線は、焼結後12μΩ・cmの比抵抗を示した。ま
た、印刷配線の幅と印刷後のペースト102の厚さとの
関係は図4に示す通りであった。このペーストの幾何学
的形状は積層圧着、焼成後でもほとんど変化しなかっ
た。他方、配線の抵抗率は、最も長い配線における電圧
降下でも信号が確実に送れる値として、0.6Ω/cm
以下にする必要があった。従って、配線の断面積は2.
0×10マイナス5乗cm2以上にする必要があった。
本実施例で用いた印刷機とペーストの組合せでは50μ
mより細い線は印刷できなかった。また、グリーンシー
トの変形及び積層装置の精度から上下間のグリーンシー
トの位置合わせに最大±15μmの誤差が避けられなか
った。
【0017】図5aは、本実施例における印刷後のグリ
ーンシート101の一部の断面図である。第n+1層目
のシートの表面にはペースト102で幅l1=80μ
m、厚さh1=20μmの配線が印刷されている。上の
第n層目のシートの裏面には同じペーストで幅l2=5
0μm、厚さh2=10μmの配線が第n+1層目のシ
ートの配線と同じ位置に印刷されている。図5bは、上
記の表裏の印刷ペーストがe=10μmの合わせ誤差で
圧着されたときの基板302の断面図である。線A−
A’は第n層目と第n+1層目の界面を示す。配線30
6の断面積は2.1×10マイナス5乗cm2となり、
比抵抗率は0.58Ω/cmであった。
【0018】
【発明の効果】本発明の一実施例によれば、従来方法に
おいては線幅が80μmの時断面積1.6×10マイナ
ス5乗cm2しか得られないペーストと印刷機の組合せ
で、断面積2.1×10マイナス5乗cm2の配線を内
部に持つセラミック多層基板が製造できる。
【図面の簡単な説明】
【図1】本発明の一実施例による多層配線基板の断面の
一部の斜視図である。
【図2】本実施例の積層前の各グリーンシートの層構成
を示した図である。
【図3】本発明による多層配線基板を用いたLSIモジ
ュールの斜視および断面を示す図である。
【図4】本実施例で用いたペーストの印刷線幅と印刷厚
の関係を示した図である。
【図5】本実施例における印刷後のグリーンシートの一
部および配線の断面図である。
【符号の説明】
101…セラミックグリーンシート、102…導体ペー
スト、301…LSI、302…セラミック多層基板、
303…コンデンサ、304…はんだ、305…端子、
306…配線
フロントページの続き (72)発明者 槌田 誠一 神奈川県横浜市戸塚区吉田町292番地株式 会社日立製作所生産技術研究所内

Claims (4)

    【特許請求の範囲】
  1. 【請求項1】狭配線でかつ断面積の大きい配線で且つ積
    層圧着時の変形の少ないもので形成したことを特徴とす
    るセラミック多層基板。
  2. 【請求項2】同一のペーストを用いていながら配線幅を
    狭くしても抵抗が高くならない配線からなることを特徴
    とするセラミック多層基板。
  3. 【請求項3】配線幅を狭くしても抵抗が高くならない配
    線を形成することを特徴とするセラミック多層基板。
  4. 【請求項4】配線幅を狭くしてもエレクトロマイグレー
    ションや過剰加熱等の発生確率が高くならない配線を形
    成することを特徴とするセラミック多層基板。
JP4023552A 1992-02-10 1992-02-10 セラミック多層基板 Pending JPH05226841A (ja)

Priority Applications (1)

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JP4023552A JPH05226841A (ja) 1992-02-10 1992-02-10 セラミック多層基板

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JP4023552A JPH05226841A (ja) 1992-02-10 1992-02-10 セラミック多層基板

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JPH05226841A true JPH05226841A (ja) 1993-09-03

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JP4023552A Pending JPH05226841A (ja) 1992-02-10 1992-02-10 セラミック多層基板

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JP (1) JPH05226841A (ja)

Cited By (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
DE3417560A1 (de) * 1983-05-12 1984-11-15 Sumitomo Electric Industries, Ltd., Osaka Optische faser
WO1997050280A1 (fr) * 1996-06-27 1997-12-31 Asahi Kasei Kogyo Kabushiki Kaisha Circuit conducteur a couche epaisse et son procede de fabrication
JP2008263174A (ja) * 2007-03-19 2008-10-30 Kyocera Corp 配線基板
JP2009206199A (ja) * 2008-02-26 2009-09-10 Kyocera Corp セラミック基板の製造方法
JP2016111246A (ja) * 2014-12-09 2016-06-20 Ngkエレクトロデバイス株式会社 電子部品収納用パッケージ

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