JPH05244770A - Ｄｃ−ｄｃコンバータ - Google Patents
Ｄｃ−ｄｃコンバータInfo
- Publication number
- JPH05244770A JPH05244770A JP7627092A JP7627092A JPH05244770A JP H05244770 A JPH05244770 A JP H05244770A JP 7627092 A JP7627092 A JP 7627092A JP 7627092 A JP7627092 A JP 7627092A JP H05244770 A JPH05244770 A JP H05244770A
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- JP
- Japan
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- voltage
- transformer
- transistor
- power
- power supply
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- Pending
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- 238000004804 winding Methods 0.000 description 12
- 239000003990 capacitor Substances 0.000 description 3
- 238000010586 diagram Methods 0.000 description 3
- 238000009499 grossing Methods 0.000 description 3
- 230000000694 effects Effects 0.000 description 1
- 230000007274 generation of a signal involved in cell-cell signaling Effects 0.000 description 1
- 239000004575 stone Substances 0.000 description 1
Landscapes
- Dc-Dc Converters (AREA)
- Power Conversion In General (AREA)
Abstract
(57)【要約】
【目的】 ＤＣ―ＤＣコンバータにおけるスイッチング
制御用電源の消費電力を小さくする。 【構成】 スイッチング制御回路部１０及びトランジス
タ４により、フォトカプラ５をオンせしめ、トランジス
タ２をオン制御する。このオン制御に応答して電源１１
による直流電圧を、パワMOS ＦＥＴ１の電源電圧として
供給する。ＦＥＴ１のオンオフ動作により、トランス１
４の１次側に供給される直流電圧を交流電圧に変換し、
その後２次側で整流する。 【効果】 電源１１をＦＥＴ１の電源電圧として用いる
ため、スイッチング制御用電源１２の消費電力を小さく
できる。
制御用電源の消費電力を小さくする。 【構成】 スイッチング制御回路部１０及びトランジス
タ４により、フォトカプラ５をオンせしめ、トランジス
タ２をオン制御する。このオン制御に応答して電源１１
による直流電圧を、パワMOS ＦＥＴ１の電源電圧として
供給する。ＦＥＴ１のオンオフ動作により、トランス１
４の１次側に供給される直流電圧を交流電圧に変換し、
その後２次側で整流する。 【効果】 電源１１をＦＥＴ１の電源電圧として用いる
ため、スイッチング制御用電源１２の消費電力を小さく
できる。
Description
【０００１】
【技術分野】本発明はＤＣ―ＤＣコンバータに関し、特
にそのドライブ回路に関する。
にそのドライブ回路に関する。
【０００２】
【従来技術】従来この種のＤＣ―ＤＣコンバータにおけ
るドライブ回路は、図２に示されているように、ドライ
ブトランス１３の２次巻線の巻始めとパワMOS ＦＥＴ１
のゲート端子とが接続され、またドライブトランス１３
の２次側の巻終りとパワMOSＦＥＴ１のソース端子とが
接続されて構成されていた。そして、ドライブトランス
１３の２次巻線にパルス電圧を発生させることによりパ
ワMOS ＦＥＴ１のゲート―ソース間に電圧が生じ、パワ
MOS ＦＥＴ１をスイッチング動作させている。これによ
り、入力直流電源１１の出力を交流電圧に変換している
のである。
るドライブ回路は、図２に示されているように、ドライ
ブトランス１３の２次巻線の巻始めとパワMOS ＦＥＴ１
のゲート端子とが接続され、またドライブトランス１３
の２次側の巻終りとパワMOSＦＥＴ１のソース端子とが
接続されて構成されていた。そして、ドライブトランス
１３の２次巻線にパルス電圧を発生させることによりパ
ワMOS ＦＥＴ１のゲート―ソース間に電圧が生じ、パワ
MOS ＦＥＴ１をスイッチング動作させている。これによ
り、入力直流電源１１の出力を交流電圧に変換している
のである。
【０００３】なお、図中のトランス１４の１次側におい
て、４はパルス信号発生用のＮＰＮトランジスタ、１０
はトランジスタ４のスイッチング制御回路部、１２はス
イッチング制御用の電源である。また、トランス１４の
２次側において、１５，１６は整流用ダイオード、１７
は平滑用コンデンサ、１８はチョークコイルである。
て、４はパルス信号発生用のＮＰＮトランジスタ、１０
はトランジスタ４のスイッチング制御回路部、１２はス
イッチング制御用の電源である。また、トランス１４の
２次側において、１５，１６は整流用ダイオード、１７
は平滑用コンデンサ、１８はチョークコイルである。
【０００４】かかる構成により、一次側の電源１１の出
力を一旦交流電圧に変換し、再度直流電圧に変換するの
である。
力を一旦交流電圧に変換し、再度直流電圧に変換するの
である。
【０００５】しかし、この従来のＤＣ―ＤＣコンバータ
ではドライブトランス１３の１次側にパルス信号を加え
ることによってドライブトランス１３の２次側でスイッ
チングパワMOS ＦＥＴをドライブする電圧まで昇圧して
いるため、パワMOS ＦＥＴをドライブするための電力は
全てドライブトランスの１次側より供給しているので、
スイッチング制御用の電源１２の消費電力が増大すると
いう欠点がある。
ではドライブトランス１３の１次側にパルス信号を加え
ることによってドライブトランス１３の２次側でスイッ
チングパワMOS ＦＥＴをドライブする電圧まで昇圧して
いるため、パワMOS ＦＥＴをドライブするための電力は
全てドライブトランスの１次側より供給しているので、
スイッチング制御用の電源１２の消費電力が増大すると
いう欠点がある。
【０００６】
【発明の目的】本発明は上述した従来の欠点を解決する
ためになされたものであり、その目的はスイッチング制
御用の電源の消費電力を小さくすることのできるＤＣ―
ＤＣコンバータを提供することである。
ためになされたものであり、その目的はスイッチング制
御用の電源の消費電力を小さくすることのできるＤＣ―
ＤＣコンバータを提供することである。
【０００７】
【発明の構成】本発明によるＤＣ―ＤＣコンバータは、
トランスと、このトランスの１次側に供給される直流電
圧を交流電圧に変換するためのスイッチングトランジス
タと、このトランジスタをオンオフ制御する制御回路と
を含むＤＣ―ＤＣコンバータであって、前記制御回路に
よるオン制御に応答して前記直流電圧を前記トランジス
タの電源電圧として供給する電圧供給制御回路を有する
ことを特徴とする。
トランスと、このトランスの１次側に供給される直流電
圧を交流電圧に変換するためのスイッチングトランジス
タと、このトランジスタをオンオフ制御する制御回路と
を含むＤＣ―ＤＣコンバータであって、前記制御回路に
よるオン制御に応答して前記直流電圧を前記トランジス
タの電源電圧として供給する電圧供給制御回路を有する
ことを特徴とする。
【０００８】
【実施例】次に、本発明について図面を参照して説明す
る。
る。
【０００９】図１は本発明によるＤＣ―ＤＣコンバータ
の一実施例の構成を示す回路図であり、図２と同等部分
は同一符号により示されている。図には一石フォワード
方式のＤＣ―ＤＣコンバータが示されている。
の一実施例の構成を示す回路図であり、図２と同等部分
は同一符号により示されている。図には一石フォワード
方式のＤＣ―ＤＣコンバータが示されている。
【００１０】まず、トランス１４の１次側の回路につい
て説明する。
て説明する。
【００１１】入力電源１１の＋側は抵抗６の一端及びト
ランス１４の１次巻線の巻始めに接続され、トランス１
４の１次巻線の巻終りは、パワMOS ＦＥＴ１のドレイン
に接続されている。抵抗６の他端は、抵抗７の一端及び
ＰＮＰトランジスタ２のエミッタに接続され、抵抗７の
他端は、ＰＮＰトランジスタ２のベースと抵抗８の一端
とに接続されている。ＰＮＰトランジスタ２のコレクタ
は、パワMOS ＦＥＴ１のゲート及びＮＰＮトランジスタ
３のコレクタに接続され、抵抗９の一端はＮＰＮトラン
ジスタ３のベースに接続されている。
ランス１４の１次巻線の巻始めに接続され、トランス１
４の１次巻線の巻終りは、パワMOS ＦＥＴ１のドレイン
に接続されている。抵抗６の他端は、抵抗７の一端及び
ＰＮＰトランジスタ２のエミッタに接続され、抵抗７の
他端は、ＰＮＰトランジスタ２のベースと抵抗８の一端
とに接続されている。ＰＮＰトランジスタ２のコレクタ
は、パワMOS ＦＥＴ１のゲート及びＮＰＮトランジスタ
３のコレクタに接続され、抵抗９の一端はＮＰＮトラン
ジスタ３のベースに接続されている。
【００１２】フォトカプラ５のコレクタは抵抗８の他端
及び抵抗９の他端に接続され、フォトカプラ５のエミッ
タには入力電源１１の−側及びＮＰＮトランジスタ３の
エミッタ並びにパワMOS ＦＥＴのソースが接続されてい
る。
及び抵抗９の他端に接続され、フォトカプラ５のエミッ
タには入力電源１１の−側及びＮＰＮトランジスタ３の
エミッタ並びにパワMOS ＦＥＴのソースが接続されてい
る。
【００１３】フォトカプラ５のアノードには、制御回路
用電源１２の＋側が接続され、フォトカプラ５のカソー
ドには、ＮＰＮトランジスタ４のコレクタが接続されて
いる。
用電源１２の＋側が接続され、フォトカプラ５のカソー
ドには、ＮＰＮトランジスタ４のコレクタが接続されて
いる。
【００１４】ＮＰＮトランジスタ４のエミッタには、制
御回路用電源１２の−側が接続され、ＮＰＮトランジス
タ４のベースは、スイッチング制御回路部１０に接続さ
れている。
御回路用電源１２の−側が接続され、ＮＰＮトランジス
タ４のベースは、スイッチング制御回路部１０に接続さ
れている。
【００１５】次に、トランス１４の２次側について説明
する。
する。
【００１６】トランス１４の２次巻線の巻始めは、ダイ
オード１５のアノードに接続され、トランス１４の２次
巻線の巻終りは、ダイオード１６のアノード及び平滑用
コンデンサ１７の−側及び出力端子の一方に接続されて
いる。
オード１５のアノードに接続され、トランス１４の２次
巻線の巻終りは、ダイオード１６のアノード及び平滑用
コンデンサ１７の−側及び出力端子の一方に接続されて
いる。
【００１７】ダイオード１５のカソードは、ダイオード
１６のカソード及びチョークコイル１８の一端に接続さ
れ、チョークコイル１８の他端は、平滑用コンデンサ１
７の＋側及び出力端子の他端に接続されている。
１６のカソード及びチョークコイル１８の一端に接続さ
れ、チョークコイル１８の他端は、平滑用コンデンサ１
７の＋側及び出力端子の他端に接続されている。
【００１８】次に、かかる構成とされた本実施例の回路
の動作について説明する。
の動作について説明する。
【００１９】スイッチング制御回路部１０は、トランス
１４の２次側の出力端子の電圧が一定になるようにＮＰ
Ｎトランジスタ４のオン時間を制御する。ＮＰＮトラン
ジスタがオンすると、フォトカプラ５がオンし、抵抗
６、抵抗７及び抵抗８に電流が流れる。これにより、Ｐ
ＮＰトランジスタ２がオンし、パワMOS ＦＥＴがオンす
るための電圧が加えられ、パワMOS ＦＥＴがオンする。
この時、ＮＰＮトランジスタ３はオフしている。
１４の２次側の出力端子の電圧が一定になるようにＮＰ
Ｎトランジスタ４のオン時間を制御する。ＮＰＮトラン
ジスタがオンすると、フォトカプラ５がオンし、抵抗
６、抵抗７及び抵抗８に電流が流れる。これにより、Ｐ
ＮＰトランジスタ２がオンし、パワMOS ＦＥＴがオンす
るための電圧が加えられ、パワMOS ＦＥＴがオンする。
この時、ＮＰＮトランジスタ３はオフしている。
【００２０】次に、スイッチング制御回路部１０により
ＮＰＮトランジスタ４がオフされるとフォトカプラ５が
オフし、ＰＮＰトランジスタ２がオフする。この時、Ｎ
ＰＮトランジスタ３がオンする。これにより、パワMOS
ＦＥＴ１がオフする。
ＮＰＮトランジスタ４がオフされるとフォトカプラ５が
オフし、ＰＮＰトランジスタ２がオフする。この時、Ｎ
ＰＮトランジスタ３がオンする。これにより、パワMOS
ＦＥＴ１がオフする。
【００２１】この動作の繰返しにより、パワMOS ＦＥＴ
１はスイッチングを行い、一定の出力電圧を得る。
１はスイッチングを行い、一定の出力電圧を得る。
【００２２】つまり、本実施例のＤＣ―ＤＣコンバータ
では、ＰＮＰトランジスタ２等の追加により、スイッチ
ング制御回路部１０によるオン制御に応答して電源１２
の直流電圧をＦＥＴ１の電源電圧として供給しているの
である。
では、ＰＮＰトランジスタ２等の追加により、スイッチ
ング制御回路部１０によるオン制御に応答して電源１２
の直流電圧をＦＥＴ１の電源電圧として供給しているの
である。
【００２３】これにより、パワMOS ＦＥＴをドライブす
るための電力を、入力電源から使うため、スイッチング
制御用電源の消費電力を小さくすることができるのであ
る。
るための電力を、入力電源から使うため、スイッチング
制御用電源の消費電力を小さくすることができるのであ
る。
【００２４】
【発明の効果】以上説明したように本発明は、スイッチ
ング用のトランジスタのドライブ回路消費電力を入力電
源より供給することにより、スイッチング制御用電源の
消費電力を小さくすることができるという効果がある。
ング用のトランジスタのドライブ回路消費電力を入力電
源より供給することにより、スイッチング制御用電源の
消費電力を小さくすることができるという効果がある。
【図１】本発明の実施例によるＤＣ―ＤＣコンバータの
構成を示す回路図である。
構成を示す回路図である。
【図２】従来のＤＣ―ＤＣコンバータの構成を示す回路
図である。
図である。
１ パワMOS ＦＥＴ ２ ＰＮＰトランジスタ ３，４ ＮＰＮトランジスタ ５ フォトカプラ ６，７，８，９ 抵抗 １０ スイッチング制御回路部 １１，１２ 電源 １３，１４ トランス
Claims (1)
- 【請求項１】 トランスと、このトランスの１次側に供
給される直流電圧を交流電圧に変換するためのスイッチ
ングトランジスタと、このトランジスタをオンオフ制御
する制御回路とを含むＤＣ―ＤＣコンバータであって、
前記制御回路によるオン制御に応答して前記直流電圧を
前記トランジスタの電源電圧として供給する電圧供給制
御回路を有することを特徴とするＤＣ―ＤＣコンバー
タ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7627092A JPH05244770A (ja) | 1992-02-27 | 1992-02-27 | Ｄｃ−ｄｃコンバータ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7627092A JPH05244770A (ja) | 1992-02-27 | 1992-02-27 | Ｄｃ−ｄｃコンバータ |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH05244770A true JPH05244770A (ja) | 1993-09-21 |
Family
ID=13600549
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7627092A Pending JPH05244770A (ja) | 1992-02-27 | 1992-02-27 | Ｄｃ−ｄｃコンバータ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH05244770A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2022032080A (ja) * | 2020-08-11 | 2022-02-25 | ローム株式会社 | 制御装置及びコンバータ |
-
1992
- 1992-02-27 JP JP7627092A patent/JPH05244770A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2022032080A (ja) * | 2020-08-11 | 2022-02-25 | ローム株式会社 | 制御装置及びコンバータ |
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