JPH0525517U - 初期設定回路 - Google Patents
初期設定回路Info
- Publication number
- JPH0525517U JPH0525517U JP7444391U JP7444391U JPH0525517U JP H0525517 U JPH0525517 U JP H0525517U JP 7444391 U JP7444391 U JP 7444391U JP 7444391 U JP7444391 U JP 7444391U JP H0525517 U JPH0525517 U JP H0525517U
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- JP
- Japan
- Prior art keywords
- initial setting
- switch
- resistor
- information
- setting circuit
- Prior art date
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- Pending
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Abstract
(57)【要約】
【目的】 電力の消費を軽減させる。
【構成】 スイッチ1に設定された情報を読み込む場
合、デコードロジック回路9によりトランジスタ8を導
通させ、トランジスタ8を介して電源からプルアップ抵
抗6に電流を流す。
合、デコードロジック回路9によりトランジスタ8を導
通させ、トランジスタ8を介して電源からプルアップ抵
抗6に電流を流す。
Description
【0001】
本考案は初期設定回路に関するものである。
【0002】
図2は初期設定回路の従来例を示す。
【0003】 スイッチ1は一方の接点がグランドに接続され、他方の接点がプルアップ抵抗 6を介して電池に接続され、スイッチ1には予め情報が設定されている。すなわ ち、情報に応じてスイッチ1がONまたはOFFされ、ゲート7の入力端子がハ イレベルまたはローレベルになっている。この状態で、電源がONされると、マ イクロプロセッサ2によりアドレスバス3とコントロールバス4に情報が出され 、アドレスバス3とコントロールバス4に出された情報に基づき、デコードロジ ック回路10によりゲート7がON状態にされ、スイッチ1に設定された情報が データバス5を介してマイクロプロセッサ2により読み込まれるようになってい た。
【0004】
しかしながら、上記従来例では、初期設定用のスイッチ1のプルアップ抵抗6 に常に電流を流すようにしたので、無駄な電力が消費されるという問題点があっ た。
【0005】 本考案の目的は、上記のような問題点を解決し、無駄な電力の消費を軽減する ことができる初期設定回路を提供することにある。
【0006】
このような目的を達成するため、本考案は、一方の接点をグランドに接続し、 他方の接点をプルアップ抵抗およびスイッチング手段を介して電源に接続した初 期設定をするためのスイッチ群と、該スイッチ群に設定された情報を読み込む場 合、前記スイッチング手段を導通させる制御手段とを備えたことを特徴とする。
【0007】
本考案では、スイッチ群に設定された情報を読み込む場合、制御手段によりス イッチング手段を導通させ、スイッチング手段を介して電源からプルアップ抵抗 に電流を流す。
【0008】
以下、本考案の実施例を図面を参照して詳細に説明する。
【0009】 図1は本考案の一実施例を示す。
【0010】 図において、1〜7は図2と同一部分を示す。9はデコードロジック回路で、 マイクロプロセッサ2によりアドレスバス3とコントロールバス4に出された情 報に基づきゲート7とPNPトランジスタ8を同時にON/OFF制御するもの である。トランジスタ8はベースに入力されるデコードロジック回路9からの信 号に基づき、電源から抵抗6への電力を給電または遮断するものである。
【0011】 次に、動作を説明する。
【0012】 情報に応じてスイッチ1の接点が閉成または解放され、情報が設定されている 。
【0013】 この状態で、電源がONされると、マイクロプロセッサ2によりアドレスバス 3とコントロールバス4に情報が出され、アドレスバス3とコントロールバス4 に出された情報に基づき、デコードロジック回路10によりゲート7およびトラ ンジスタ8がON状態にされる。従って、抵抗6に電池から電力が給電され、接 点が閉成されているスイッチ1のレベルはローレベルになり、接点が解放されて いるスイッチ1のレベルはハイレベルになり、スイッチ1に設定されている情報 に応じて、ゲート1の端子のレベルがハイレベルまたはローレベルになり、スイ ッチ1に設定された情報がデータバス5を介してマイクロプロセッサ2により読 み込まれる。
【0014】
以上説明したように、本考案によれば、スイッチ群に設定された情報を読み込 む場合、スイッチング手段を導通させ、スイッチング手段を介して電源からプル アップ抵抗に電流を流すように構成したので、電力消費が軽減されるという効果 がある。
【図1】本考案の一実施例を示すブロック図である。
【図2】初期設定回路の従来例を示すブロック図であ
る。
る。
1 スイッチ 2 マイクロプロセッサ 6 プルアップ抵抗 7 ゲート 8 トランジスタ 9 デコードロジック回路
Claims (1)
- 【請求項1】 一方の接点をグランドに接続し、他方の
接点をプルアップ抵抗およびスイッチング手段を介して
電源に接続した初期設定をするためのスイッチ群と、該
スイッチ群に設定された情報を読み込む場合、前記スイ
ッチング手段を導通させる制御手段とを備えたことを特
徴とする初期設定回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7444391U JPH0525517U (ja) | 1991-09-17 | 1991-09-17 | 初期設定回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7444391U JPH0525517U (ja) | 1991-09-17 | 1991-09-17 | 初期設定回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0525517U true JPH0525517U (ja) | 1993-04-02 |
Family
ID=13547384
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7444391U Pending JPH0525517U (ja) | 1991-09-17 | 1991-09-17 | 初期設定回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0525517U (ja) |
-
1991
- 1991-09-17 JP JP7444391U patent/JPH0525517U/ja active Pending
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