JPH0527879A - バツクアツプ用電源装置 - Google Patents
バツクアツプ用電源装置Info
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- JPH0527879A JPH0527879A JP3184918A JP18491891A JPH0527879A JP H0527879 A JPH0527879 A JP H0527879A JP 3184918 A JP3184918 A JP 3184918A JP 18491891 A JP18491891 A JP 18491891A JP H0527879 A JPH0527879 A JP H0527879A
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- 230000002401 inhibitory effect Effects 0.000 abstract 1
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- 102100035476 Serum paraoxonase/arylesterase 1 Human genes 0.000 description 9
- 102100022824 Serum paraoxonase/arylesterase 2 Human genes 0.000 description 9
- 238000010586 diagram Methods 0.000 description 5
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Abstract
(57)【要約】
【目的】 本発明はバックアップが必要な回路における
無駄な電力消費を防止することを目的とする。 【構成】 状態レジスタ等のバックアップを必要とする
回路を含むと共に他の回路（５）が動作を開始するとそ
れを示す信号ＲＥＳを出力する第１回路（４）と、少な
くとも上記第１回路（４）を駆動可能な所定電圧値に電
源（１）電圧が達しているか否かを検出する検出部
（２）と、該検出部が上記所定電圧値以上と判定した場
合であっても、上記信号ＲＥＳが出力されていない限り
上記第１回路（４）への駆動電圧の供給を禁止する電源
制御部（９）とを備える。
無駄な電力消費を防止することを目的とする。 【構成】 状態レジスタ等のバックアップを必要とする
回路を含むと共に他の回路（５）が動作を開始するとそ
れを示す信号ＲＥＳを出力する第１回路（４）と、少な
くとも上記第１回路（４）を駆動可能な所定電圧値に電
源（１）電圧が達しているか否かを検出する検出部
（２）と、該検出部が上記所定電圧値以上と判定した場
合であっても、上記信号ＲＥＳが出力されていない限り
上記第１回路（４）への駆動電圧の供給を禁止する電源
制御部（９）とを備える。
Description
【０００１】
【産業上の利用分野】本発明は低消費電力を実現可能な
バックアップ用電源装置に関する。
バックアップ用電源装置に関する。
【０００２】
【従来の技術】現在のパーソナルコンピュータ等の電子
機器においては、実開昭６１−２５６２３号公報等にも
開示されている如くその動作状態毎に必要電圧が異な
る。
機器においては、実開昭６１−２５６２３号公報等にも
開示されている如くその動作状態毎に必要電圧が異な
る。
【０００３】具体的には、通常の処理動作を実行する状
態（通常使用状態）時に必要となる電圧値をｖ２とする
と、単に状態レジスタ等をバックアップしている待機状
態時に必要となる電圧値ｖ１は上記ｖ２に比して小であ
り、また単に電源回路の電圧を監視しているだけの状態
（監視状態）時に必要となる電圧値は上記ｖ１に較べて
小となる。
態（通常使用状態）時に必要となる電圧値をｖ２とする
と、単に状態レジスタ等をバックアップしている待機状
態時に必要となる電圧値ｖ１は上記ｖ２に比して小であ
り、また単に電源回路の電圧を監視しているだけの状態
（監視状態）時に必要となる電圧値は上記ｖ１に較べて
小となる。
【０００４】また、現在の電子機器では駆動電圧Ｖ０が
「Ｖ０≧ｖ２」の条件を満足する際には通常使用状態を
保持可能とし、かつ駆動電圧Ｖ０が「Ｖ０≧ｖ１」を満
足する限り上記待機状態を保持している。
「Ｖ０≧ｖ２」の条件を満足する際には通常使用状態を
保持可能とし、かつ駆動電圧Ｖ０が「Ｖ０≧ｖ１」を満
足する限り上記待機状態を保持している。
【０００５】
【発明が解決しようとする課題】然るに、従来の装置で
は駆動電圧Ｖ０が「Ｖ０≧ｖ１」であると、上記状態レ
ジスタのバックアップの要否に関係なく常に待機状態を
保持する構成となっているため、例えば駆動電圧が、上
記レジスタの内容がクリア状態にあるｖ１値以下である
状態からｖ１値以上となった際には、上記レジスタをバ
ックアップする必要性は全くないにもかかわらず、この
レジスタをバックアップし、無駄に電力を消費すること
となる。更に、駆動電源として電池を使用している場合
には、電池寿命を低下させ、長期使用が不可能となって
しまう。
は駆動電圧Ｖ０が「Ｖ０≧ｖ１」であると、上記状態レ
ジスタのバックアップの要否に関係なく常に待機状態を
保持する構成となっているため、例えば駆動電圧が、上
記レジスタの内容がクリア状態にあるｖ１値以下である
状態からｖ１値以上となった際には、上記レジスタをバ
ックアップする必要性は全くないにもかかわらず、この
レジスタをバックアップし、無駄に電力を消費すること
となる。更に、駆動電源として電池を使用している場合
には、電池寿命を低下させ、長期使用が不可能となって
しまう。
【０００６】
【課題を解決するための手段】本発明は上記課題を解決
するためになされたもので、その構成的特徴は、通常の
使用時以外でもバックアップが必要となると共に他の回
路が動作を開始するとそれを示す信号を出力する第１回
路と、該回路に駆動電圧を供給する電源と、該電源の電
圧値が上記第１回路を駆動するために充分となった時検
出信号を出力する検出部と、上記検出信号が入力された
際でも上記第１回路より上記他の回路が動作を開始した
ことを示す信号が入力されるまでは上記第１回路への駆
動電圧供給を禁止する電源制御部とを備えたことにあ
る。
するためになされたもので、その構成的特徴は、通常の
使用時以外でもバックアップが必要となると共に他の回
路が動作を開始するとそれを示す信号を出力する第１回
路と、該回路に駆動電圧を供給する電源と、該電源の電
圧値が上記第１回路を駆動するために充分となった時検
出信号を出力する検出部と、上記検出信号が入力された
際でも上記第１回路より上記他の回路が動作を開始した
ことを示す信号が入力されるまでは上記第１回路への駆
動電圧供給を禁止する電源制御部とを備えたことにあ
る。
【０００７】
【作用】斯る構成によれば、第１回路のバックアップの
有無によりこの回路への駆動電圧の供給を制御できる。
有無によりこの回路への駆動電圧の供給を制御できる。
【０００８】
【実施例】図１は本発明の実施例を示すブロック図であ
り、図中（１）は例えば二次電池からなる電源、（２）
（３）は該電源の電圧値Ｖ０を検出する第１、第２検出
部であり、上記第１検出部（２）は上記電圧値Ｖ０が後
出する状態レジスタ等のバックアップを行なうために必
要な電圧値Ｖ１以上となったことを検出すると、第１検
出信号ＤＴ１としてハイレベルの信号を出力する。ま
た、第２検出部（３）は上記電圧値Ｖ０が後出する液晶
表示部、ディスク装置等を駆動させるために必要な電圧
値Ｖ２以上となったことを検出すると、第２検出信号Ｄ
Ｔ２としてハイレベルの信号を出力する。尚、上記電圧
値Ｖ１，Ｖ２はＶ１＜Ｖ２の関係にある。
り、図中（１）は例えば二次電池からなる電源、（２）
（３）は該電源の電圧値Ｖ０を検出する第１、第２検出
部であり、上記第１検出部（２）は上記電圧値Ｖ０が後
出する状態レジスタ等のバックアップを行なうために必
要な電圧値Ｖ１以上となったことを検出すると、第１検
出信号ＤＴ１としてハイレベルの信号を出力する。ま
た、第２検出部（３）は上記電圧値Ｖ０が後出する液晶
表示部、ディスク装置等を駆動させるために必要な電圧
値Ｖ２以上となったことを検出すると、第２検出信号Ｄ
Ｔ２としてハイレベルの信号を出力する。尚、上記電圧
値Ｖ１，Ｖ２はＶ１＜Ｖ２の関係にある。
【０００９】（４）は例えば状態レジスタ等のようにデ
ータを保持するための第１回路であり、該第１回路は駆
動電圧Ｖ０がＶ１以上となった時正常に動作可能であ
る。（５）は例えば液晶表示部、ディスク装置の様に通
常の処理動作を行なうために必要な第２回路であり、該
第２回路は駆動電圧Ｖ０がＶ２以上となった時正常に動
作可能である。
ータを保持するための第１回路であり、該第１回路は駆
動電圧Ｖ０がＶ１以上となった時正常に動作可能であ
る。（５）は例えば液晶表示部、ディスク装置の様に通
常の処理動作を行なうために必要な第２回路であり、該
第２回路は駆動電圧Ｖ０がＶ２以上となった時正常に動
作可能である。
【００１０】また、上記第１回路（４）は後述する状態
指示信号ＳＲＯＮの入力に基づいて第２回路（５）の動
作状態を示すリジューム信号ＲＥＳを出力する。具体的
には、信号ＳＲＯＮがハイレベルからローレベルに切替
わる毎に信号ＲＥＳは反転する。更に、上記第１回路
（４）には第２検出部（３）から出力される第２検出信
号ＤＴ２が入力される。この信号ＤＴ２がハイレベルか
らローレベルになると、第１回路（４）は電源（１）の
電圧低下を図示しない報知手段で報知する。
指示信号ＳＲＯＮの入力に基づいて第２回路（５）の動
作状態を示すリジューム信号ＲＥＳを出力する。具体的
には、信号ＳＲＯＮがハイレベルからローレベルに切替
わる毎に信号ＲＥＳは反転する。更に、上記第１回路
（４）には第２検出部（３）から出力される第２検出信
号ＤＴ２が入力される。この信号ＤＴ２がハイレベルか
らローレベルになると、第１回路（４）は電源（１）の
電圧低下を図示しない報知手段で報知する。
【００１１】（６）は常開接点からなる電源スイッチで
あり、電源（１）電圧がＶ１以上であれば、該スイッチ
が閉状態となる度に電源スイッチ信号ＰＳＷとしてハイ
レベル信号を単発的に出力する。
あり、電源（１）電圧がＶ１以上であれば、該スイッチ
が閉状態となる度に電源スイッチ信号ＰＳＷとしてハイ
レベル信号を単発的に出力する。
【００１２】（７）は第１電圧供給部であり、後述する
第１電圧供給指示信号ＰＯＮ１がハイレベルの時、電源
（１）より出力される駆動電圧を第１回路（４）に供給
する。（８）は第２電圧供給部であり、後述する第２電
圧供給指示信号ＰＯＮ２がハイレベルの時、電源（１）
より出力される駆動電圧を第２回路（５）に供給する。
第１電圧供給指示信号ＰＯＮ１がハイレベルの時、電源
（１）より出力される駆動電圧を第１回路（４）に供給
する。（８）は第２電圧供給部であり、後述する第２電
圧供給指示信号ＰＯＮ２がハイレベルの時、電源（１）
より出力される駆動電圧を第２回路（５）に供給する。
【００１３】（９）は電源制御部であり、該制御部は入
力される第１，第２検出信号ＤＴ１，ＤＴ２、電源スイ
ッチ信号ＰＳＷ及びリジューム信号ＲＥＳに基づいて第
１，第２電圧供給指示信号ＰＯＮ１，ＰＯＮ２及び状態
指示信号ＳＲＯＮを出力する。
力される第１，第２検出信号ＤＴ１，ＤＴ２、電源スイ
ッチ信号ＰＳＷ及びリジューム信号ＲＥＳに基づいて第
１，第２電圧供給指示信号ＰＯＮ１，ＰＯＮ２及び状態
指示信号ＳＲＯＮを出力する。
【００１４】図２に上記電源制御部（９）の具体的回路
構成を示す。図中のオアゲート（１０）の一方の入力端
には第２検出信号ＤＴ２が入力され、他方の入力端には
第１アンドゲート（１１）の出力が供給される。尚、こ
の第１アンドゲート（１１）の出力は第２電源供給指示
信号ＰＯＮ２としても出力される。また、オアゲート
（１０）の出力は第２アンドゲート（１２）の一方の入
力端に出力される。この第２アンドゲート（１２）の他
方の入力端には電源スイッチ信号ＰＳＷが入力され、そ
してその出力はそのまま状態指示信号ＳＲＯＮとして出
力されると共に、反転ゲート（１３）を介してＤ型フリ
ップフロップ（Ｄ−ＦＦ）（１４）のクロック端子ＣＬ
Ｋに出力される。
構成を示す。図中のオアゲート（１０）の一方の入力端
には第２検出信号ＤＴ２が入力され、他方の入力端には
第１アンドゲート（１１）の出力が供給される。尚、こ
の第１アンドゲート（１１）の出力は第２電源供給指示
信号ＰＯＮ２としても出力される。また、オアゲート
（１０）の出力は第２アンドゲート（１２）の一方の入
力端に出力される。この第２アンドゲート（１２）の他
方の入力端には電源スイッチ信号ＰＳＷが入力され、そ
してその出力はそのまま状態指示信号ＳＲＯＮとして出
力されると共に、反転ゲート（１３）を介してＤ型フリ
ップフロップ（Ｄ−ＦＦ）（１４）のクロック端子ＣＬ
Ｋに出力される。
【００１５】このＤ−ＦＦ（１４）のクリア端子ＣＬに
は第１検出信号ＤＴ１が入力され、またそのＱ端子出力
は第１電源供給指示信号ＰＯＮ１として出力されると共
に第１アンドゲート（１１）の他方の入力端にも供給さ
れる。尚、Ｄ−ＦＦ（１４）のＤ入力端子及びプリセッ
ト端子ＰＲには電源（１）が接続され、電源電圧が所定
値以上となった時、常にハイレベル信号が入力される。
は第１検出信号ＤＴ１が入力され、またそのＱ端子出力
は第１電源供給指示信号ＰＯＮ１として出力されると共
に第１アンドゲート（１１）の他方の入力端にも供給さ
れる。尚、Ｄ−ＦＦ（１４）のＤ入力端子及びプリセッ
ト端子ＰＲには電源（１）が接続され、電源電圧が所定
値以上となった時、常にハイレベル信号が入力される。
【００１６】図３は、電源（１）の電圧Ｖ０が種々変化
した際の各信号の状態を示す図であり、以下ではこの図
を参考にして図１、図２に示した実施例の詳細な動作を
説明する。
した際の各信号の状態を示す図であり、以下ではこの図
を参考にして図１、図２に示した実施例の詳細な動作を
説明する。
【００１７】図３中、Ｔ１期間は電源電圧Ｖ０が０Ｖの
状態であり、従ってこの期間中には何れの回路も動作不
能である。
状態であり、従ってこの期間中には何れの回路も動作不
能である。
【００１８】Ｔ２期間は電源電圧Ｖ０が「０＜Ｖ０＜Ｖ
１」の状態である。この状態では、第１、第２検出部
（２）（３）及び電源制御部（９）は正常に動作する。
従って、電源スイッチ（６）を押圧し閉状態とすると、
電源スイッチ信号ＰＳＷとして単発的なハイレベル信号
が電源制御部（９）に入力される。しかし、第１，第２
検出信号ＤＴ１，ＤＴ２及びリジューム信号ＲＥＳはロ
ーレベルとなっているので、第１，第２電圧供給指示信
号ＰＯＮ１，ＰＯＮ２及び状態指示信号ＳＲＯＮはロー
レベルのままである。
１」の状態である。この状態では、第１、第２検出部
（２）（３）及び電源制御部（９）は正常に動作する。
従って、電源スイッチ（６）を押圧し閉状態とすると、
電源スイッチ信号ＰＳＷとして単発的なハイレベル信号
が電源制御部（９）に入力される。しかし、第１，第２
検出信号ＤＴ１，ＤＴ２及びリジューム信号ＲＥＳはロ
ーレベルとなっているので、第１，第２電圧供給指示信
号ＰＯＮ１，ＰＯＮ２及び状態指示信号ＳＲＯＮはロー
レベルのままである。
【００１９】Ｔ３期間は電源電圧Ｖ０がＶ１に達した状
態である。このときには、第１検出信号ＤＴ１はハイレ
ベルとなるものの第２検出信号ＤＴ２及びリジューム信
号ＲＥＳはローレベルのままであるので、電源スイッチ
信号ＰＳＷがハイレベルとなっても第１，第２電圧供給
指示信号ＰＯＮ１，ＰＯＮ２及び状態指示信号ＳＲＯＮ
はローレベルのままである。
態である。このときには、第１検出信号ＤＴ１はハイレ
ベルとなるものの第２検出信号ＤＴ２及びリジューム信
号ＲＥＳはローレベルのままであるので、電源スイッチ
信号ＰＳＷがハイレベルとなっても第１，第２電圧供給
指示信号ＰＯＮ１，ＰＯＮ２及び状態指示信号ＳＲＯＮ
はローレベルのままである。
【００２０】従って、この状態では第１電圧供給部
（７）を介して第１回路（４）に駆動電圧を供給するこ
とにより、この回路（４）を正常に動作させることがで
きるにもかかわらず、第１回路（４）には駆動電圧は供
給されない。
（７）を介して第１回路（４）に駆動電圧を供給するこ
とにより、この回路（４）を正常に動作させることがで
きるにもかかわらず、第１回路（４）には駆動電圧は供
給されない。
【００２１】Ｔ４期間は電源電圧Ｖ０がＶ２に達した状
態である。従って第１，第２検出信号ＤＴ１，ＤＴ２共
にハイレベルとなる。またこの時電源スイッチ（６）を
操作すると、この操作に応答して電源スイッチ信号ＰＳ
Ｗが単発的にハイレベルとなる。この結果、第２アンド
ゲート（１２）の出力端からは上記信号ＰＳＷが出力さ
れ、信号ＳＲＯＮとして第１回路（４）に供給されると
共に、反転ゲート（１３）を介してＤ−ＦＦ（１４）の
クロック端子に供給されるのでＤ−ＦＦ（１４）のＱ出
力である第１電圧供給指示信号ＰＯＮ１はハイレベルと
なる。
態である。従って第１，第２検出信号ＤＴ１，ＤＴ２共
にハイレベルとなる。またこの時電源スイッチ（６）を
操作すると、この操作に応答して電源スイッチ信号ＰＳ
Ｗが単発的にハイレベルとなる。この結果、第２アンド
ゲート（１２）の出力端からは上記信号ＰＳＷが出力さ
れ、信号ＳＲＯＮとして第１回路（４）に供給されると
共に、反転ゲート（１３）を介してＤ−ＦＦ（１４）の
クロック端子に供給されるのでＤ−ＦＦ（１４）のＱ出
力である第１電圧供給指示信号ＰＯＮ１はハイレベルと
なる。
【００２２】また、上記信号ＰＯＮ１がハイレベルとな
ることにより第１電圧供給部（７）は第１回路（４）に
駆動電圧を供給する。従って、第１回路（４）は上記信
号ＳＲＯＮがハイレベルとなったことを検出し、ハイレ
ベルのリジューム信号ＲＥＳを出力する。更に、このハ
イレベルの信号ＲＥＳは第１アンドゲート（１１）の一
方の入力端に入力され、かつこのときこのゲート（１
１）の他方の入力端にもＤ−ＦＦ（１４）よりハイレベ
ル信号が入力されているので、第１アンドゲート（１
１）より出力される第２電圧供給指示信号ＰＯＮ２はハ
イレベルとなる。この結果、第２電圧供給部（８）は第
２回路（５）に駆動電圧を供給するので第２回路（５）
は正常に動作する。
ることにより第１電圧供給部（７）は第１回路（４）に
駆動電圧を供給する。従って、第１回路（４）は上記信
号ＳＲＯＮがハイレベルとなったことを検出し、ハイレ
ベルのリジューム信号ＲＥＳを出力する。更に、このハ
イレベルの信号ＲＥＳは第１アンドゲート（１１）の一
方の入力端に入力され、かつこのときこのゲート（１
１）の他方の入力端にもＤ−ＦＦ（１４）よりハイレベ
ル信号が入力されているので、第１アンドゲート（１
１）より出力される第２電圧供給指示信号ＰＯＮ２はハ
イレベルとなる。この結果、第２電圧供給部（８）は第
２回路（５）に駆動電圧を供給するので第２回路（５）
は正常に動作する。
【００２３】Ｔ５期間は、第１，第２検出信号ＤＴ１，
ＤＴ２、リジューム信号ＲＥＳ及び第１，第２電圧供給
指示信号ＰＯＮ１，ＰＯＮ２が全てハイレベルとなって
いる通常の処理動作時に電源電圧Ｖ０がＶ２からＶ１に
瞬間的に落ち込んだ際の状態を示す。
ＤＴ２、リジューム信号ＲＥＳ及び第１，第２電圧供給
指示信号ＰＯＮ１，ＰＯＮ２が全てハイレベルとなって
いる通常の処理動作時に電源電圧Ｖ０がＶ２からＶ１に
瞬間的に落ち込んだ際の状態を示す。
【００２４】このように電源電圧Ｖ０が低下すると第２
検出信号ＤＴ２はローレベルとなるが、その他の信号は
ハイレベルのままであるので、単に第１回路（４）が電
圧低下を報知手段で報知するだけである。
検出信号ＤＴ２はローレベルとなるが、その他の信号は
ハイレベルのままであるので、単に第１回路（４）が電
圧低下を報知手段で報知するだけである。
【００２５】Ｔ６期間は、Ｔ５期間で説明した通常処理
動作時に電源スイッチ（６）が操作された際の状態を示
す。
動作時に電源スイッチ（６）が操作された際の状態を示
す。
【００２６】通常処理動作時、電源スイッチ（６）の操
作に応答して出力されるハイレベルの信号ＰＳＷは第２
アンドゲート（１２）を介して信号ＳＲＯＮとして第１
回路（４）に出力される。従って、第１回路（４）は信
号ＲＥＳをローレベルに切替出力するので第１アンドゲ
ート（１１）は閉状態となり、第２電圧供給指示信号Ｐ
ＯＮ２はローレベルとなる。
作に応答して出力されるハイレベルの信号ＰＳＷは第２
アンドゲート（１２）を介して信号ＳＲＯＮとして第１
回路（４）に出力される。従って、第１回路（４）は信
号ＲＥＳをローレベルに切替出力するので第１アンドゲ
ート（１１）は閉状態となり、第２電圧供給指示信号Ｐ
ＯＮ２はローレベルとなる。
【００２７】この結果、第２電圧供給部（８）は第２回
路（５）への駆動電圧の供給を停止し、この回路（５）
の動作を停止する。尚、このとき第１回路（４）には駆
動電圧が供給され続けるのでデータはバックアップされ
ている。
路（５）への駆動電圧の供給を停止し、この回路（５）
の動作を停止する。尚、このとき第１回路（４）には駆
動電圧が供給され続けるのでデータはバックアップされ
ている。
【００２８】Ｔ７期間は、上記Ｔ６期間の電源スイッチ
（６）操作後、再度電源スイッチ（６）が操作された際
の状態を示す。
（６）操作後、再度電源スイッチ（６）が操作された際
の状態を示す。
【００２９】具体的には、再度電源スイッチ（６）が操
作されると、この時点での第２検出信号ＤＴ２はハイレ
ベルとなっているのでハイレベルの電源スイッチ信号Ｐ
ＳＷは第２アンドゲート（１２）より状態指示信号ＳＲ
ＯＮとして第１回路（４）に出力される。従って、第１
回路（４）はこの信号ＳＲＯＮに基づきリジューム信号
ＲＥＳをハイレベルに反転して出力する。この結果第１
アンドゲート（１１）が開状態となり第２電圧供給指示
信号ＰＯＮ２がハイレベルとなるので、再び第２回路
（５）への駆動電圧の供給が開始され、この第２回路
（５）も再び動作を開始する。
作されると、この時点での第２検出信号ＤＴ２はハイレ
ベルとなっているのでハイレベルの電源スイッチ信号Ｐ
ＳＷは第２アンドゲート（１２）より状態指示信号ＳＲ
ＯＮとして第１回路（４）に出力される。従って、第１
回路（４）はこの信号ＳＲＯＮに基づきリジューム信号
ＲＥＳをハイレベルに反転して出力する。この結果第１
アンドゲート（１１）が開状態となり第２電圧供給指示
信号ＰＯＮ２がハイレベルとなるので、再び第２回路
（５）への駆動電圧の供給が開始され、この第２回路
（５）も再び動作を開始する。
【００３０】Ｔ８期間は、Ｔ６期間と同様に通常の処理
動作中に電源スイッチ（６）が操作された際の状態を示
す。尚、この状態はＴ６期間と全く同一であるので説明
を省略する。
動作中に電源スイッチ（６）が操作された際の状態を示
す。尚、この状態はＴ６期間と全く同一であるので説明
を省略する。
【００３１】Ｔ９期間は、Ｔ８期間における電源スイッ
チ（６）の操作後、電源電圧Ｖ０がＶ１値まで低下した
際の状態を示す。
チ（６）の操作後、電源電圧Ｖ０がＶ１値まで低下した
際の状態を示す。
【００３２】この状態では、第２検出部（３）から出力
される第２検出信号ＤＴ２がローレベルとなり、かつ既
に第２電圧供給信号ＰＯＮ２はローレベルとなっている
ため、電源スイッチ（６）が操作されても、そのハイレ
ベル信号の出力は第２アンドゲート（１２）により阻止
される。従って、第１回路（４）の動作は継続されるも
のの、第２回路（５）は非動作状態のままである。
される第２検出信号ＤＴ２がローレベルとなり、かつ既
に第２電圧供給信号ＰＯＮ２はローレベルとなっている
ため、電源スイッチ（６）が操作されても、そのハイレ
ベル信号の出力は第２アンドゲート（１２）により阻止
される。従って、第１回路（４）の動作は継続されるも
のの、第２回路（５）は非動作状態のままである。
【００３３】Ｔ１０期間は、Ｔ９期間での電源電圧Ｖ０
が更に低下し、「０＜Ｖ０＜Ｖ１」となった際の状態を
示す。
が更に低下し、「０＜Ｖ０＜Ｖ１」となった際の状態を
示す。
【００３４】この状態となると、第１検出信号ＤＴ１も
ローレベルとなり、これに伴なってＤ−ＦＦ（１４）が
クリアされ第１電圧供給信号ＰＯＮ１もローレベルとな
る。従って、Ｔ２期間と同様に電源スイッチ（６）の操
作は受付けられず第１、第２回路（４）（５）ともに非
動作状態となる。
ローレベルとなり、これに伴なってＤ−ＦＦ（１４）が
クリアされ第１電圧供給信号ＰＯＮ１もローレベルとな
る。従って、Ｔ２期間と同様に電源スイッチ（６）の操
作は受付けられず第１、第２回路（４）（５）ともに非
動作状態となる。
【００３５】更にＴ１１期間の如く電源電圧Ｖ０が０と
なるとＴ１期間と同様に何れの回路も動作不可となる。
なるとＴ１期間と同様に何れの回路も動作不可となる。
【００３６】
【発明の効果】本発明によれば、状態レジスタ等のバッ
クアップが必要な回路中にバックアップすべきデータが
存在しない時にはこのバックアップを行わないので無駄
な電力消費を防ぐことができる。
クアップが必要な回路中にバックアップすべきデータが
存在しない時にはこのバックアップを行わないので無駄
な電力消費を防ぐことができる。
【図１】本発明の一実施例を示すブロック図である。
【図２】本実施例の要部回路を示す回路図である。
【図３】本実施例の動作を説明するためのタイムチャー
トである。
トである。
１ 電源 ２ 第１検出回路 ４ 第１回路 ５ 第２回路 ９ 電源制御部 ＲＥＳ リジューム信号 ＳＲＯＮ 状態指示信号
Claims (1)
- 【特許請求の範囲】 【請求項１】 通常の使用時以外でもバックアップが必
要となると共に他の回路が動作を開始するとそれを示す
信号を出力する第１回路と、該回路に駆動電圧を供給す
る電源と、該電源の電圧値が上記第１回路を駆動するた
めに充分となった時検出信号を出力する検出部と、上記
検出信号が入力された際でも上記第１回路より上記他の
回路が動作を開始したことを示す信号が入力されるまで
は上記第１回路への駆動電圧供給を禁止する電源制御部
とを備えたことを特徴とするバックアップ用電源装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3184918A JP2983702B2 (ja) | 1991-07-24 | 1991-07-24 | バックアップ用電源装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3184918A JP2983702B2 (ja) | 1991-07-24 | 1991-07-24 | バックアップ用電源装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0527879A true JPH0527879A (ja) | 1993-02-05 |
| JP2983702B2 JP2983702B2 (ja) | 1999-11-29 |
Family
ID=16161613
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3184918A Expired - Fee Related JP2983702B2 (ja) | 1991-07-24 | 1991-07-24 | バックアップ用電源装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2983702B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2008522258A (ja) * | 2004-11-30 | 2008-06-26 | フリースケール セミコンダクター インコーポレイテッド | 選択的なパワー・ゲーティングを用いて電力消費を低減する装置及び方法 |
-
1991
- 1991-07-24 JP JP3184918A patent/JP2983702B2/ja not_active Expired - Fee Related
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2008522258A (ja) * | 2004-11-30 | 2008-06-26 | フリースケール セミコンダクター インコーポレイテッド | 選択的なパワー・ゲーティングを用いて電力消費を低減する装置及び方法 |
| US8018247B2 (en) | 2004-11-30 | 2011-09-13 | Freescale Semiconductor, Inc. | Apparatus and method for reducing power consumption using selective power gating |
Also Published As
| Publication number | Publication date |
|---|---|
| JP2983702B2 (ja) | 1999-11-29 |
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