JPH0530162Y2 - - Google Patents
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- Publication number
- JPH0530162Y2 JPH0530162Y2 JP1987035133U JP3513387U JPH0530162Y2 JP H0530162 Y2 JPH0530162 Y2 JP H0530162Y2 JP 1987035133 U JP1987035133 U JP 1987035133U JP 3513387 U JP3513387 U JP 3513387U JP H0530162 Y2 JPH0530162 Y2 JP H0530162Y2
- Authority
- JP
- Japan
- Prior art keywords
- input
- circuit
- diode
- terminal
- common
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Lifetime
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- Control By Computers (AREA)
- Programmable Controllers (AREA)
- Electronic Switches (AREA)
Description
【考案の詳細な説明】
（産業上の利用分野）
この考案は例えばプログララマブルコントロー
ラ等の入力回路、特にその回路構成に関する。
ラ等の入力回路、特にその回路構成に関する。
（従来の技術）
従来入力回路は、信号源の構成により絶縁入力
回路（一点独立コモン）、多点コモンソース入力
回路、多点コモンシンク入力回路の３種類に大別
され、その都度いずれの回路方式のものを使うか
外部入力機器の信号源の構成に応じて選択する必
要があつた。また、絶縁入力回路は１点ずつが独
立していることから、シンク入力及びソース入力
のいずれにも使用可能であるが、一般的な共通コ
モン方式で使う場合は各入力の１端子を全て外部
でわたり配線する必要があつた。
回路（一点独立コモン）、多点コモンソース入力
回路、多点コモンシンク入力回路の３種類に大別
され、その都度いずれの回路方式のものを使うか
外部入力機器の信号源の構成に応じて選択する必
要があつた。また、絶縁入力回路は１点ずつが独
立していることから、シンク入力及びソース入力
のいずれにも使用可能であるが、一般的な共通コ
モン方式で使う場合は各入力の１端子を全て外部
でわたり配線する必要があつた。
（考案が解決しようとする問題点）
上記のような従来の入力回路では、外部入力機
器の違いに応じて絶縁入力回路、多点コモンソー
ス入力回路、及び多点コモンシンク入力回の３種
類の入力モジユールを備えなければならないとい
問題点があつた。
器の違いに応じて絶縁入力回路、多点コモンソー
ス入力回路、及び多点コモンシンク入力回の３種
類の入力モジユールを備えなければならないとい
問題点があつた。
この考案は、かかる問題点を解決するためにな
されたもので、絶縁入力方式、多点コモンソース
入力方式、及び多点コモンシンク入力方式の３種
類の入力方式に対応できる入力回路を得ることを
目的とする。
されたもので、絶縁入力方式、多点コモンソース
入力方式、及び多点コモンシンク入力方式の３種
類の入力方式に対応できる入力回路を得ることを
目的とする。
（問題点を解決するための手段）
この考案に係る入力回路は、一対の入力端子が
それぞれ設けられ、一方の入力端子には相対的に
高い電位が印加される複数個の絶縁入力回路と、
一方の入力端子にカソードが接続された第１のダ
イオードと、一対の入力端子の内の他方の入力端
子にアノードが接続された第２のダイオードと、
第１のダイオードのアノードと接続された正極用
共通端子と、第２のダイオードのカソードと接続
された負極用共通端子とを有する。
それぞれ設けられ、一方の入力端子には相対的に
高い電位が印加される複数個の絶縁入力回路と、
一方の入力端子にカソードが接続された第１のダ
イオードと、一対の入力端子の内の他方の入力端
子にアノードが接続された第２のダイオードと、
第１のダイオードのアノードと接続された正極用
共通端子と、第２のダイオードのカソードと接続
された負極用共通端子とを有する。
（作用）
この考案においては、入力が絶縁入力方式の場
合にはそのまま各入力端子に入力される。このと
き第１のダイオード及び第２のダイオードによ
り、入力側電源の各絶縁入力回路への回り込みが
阻止される。
合にはそのまま各入力端子に入力される。このと
き第１のダイオード及び第２のダイオードによ
り、入力側電源の各絶縁入力回路への回り込みが
阻止される。
多点コモンソース入力方式の場合には正極用共
通端子に電源の正極が接続され、各入力が他方の
入力端子に接続される。多点コモンシンク入力方
式の場合には負極用共通端子に電源の負極が接続
され、各入力が一方の入力端子に接続される。こ
れ等の場合においても同様に、第１のダイオード
及び第２のダイオードにより入力側電源の絶縁入
力回路への回り込みが阻止される。
通端子に電源の正極が接続され、各入力が他方の
入力端子に接続される。多点コモンシンク入力方
式の場合には負極用共通端子に電源の負極が接続
され、各入力が一方の入力端子に接続される。こ
れ等の場合においても同様に、第１のダイオード
及び第２のダイオードにより入力側電源の絶縁入
力回路への回り込みが阻止される。
（実施例）
第１図及び第２図はこの考案の一実施例を示す
回路図あり、第１図は絶縁入力回路に適用した例
で、第２図は多点コモンソース入力方式に適用し
た例（実線参照）及び多点コモンシンク入力方式
に適用した例（破線参照）を示す。第１図におい
て、１−２，３−４，５−６はそれぞれ絶縁入力
回路の一対の入力端子、７，８，９はそれぞれ絶
縁入力回路の電流制限抵抗、１０，１１，１２は
それぞれホトカプラであり、これ等により３個の
絶縁入力回路が構成されている。１３は正極共通
端子で、１４，１５，１６はそれぞれ正極用共通
端子１３に接続されたダイオードである。１７は
負極用共通端子で１８，１９，２０はそれぞれ負
極用共通端子１７に接続されたダイオードであ
る。３０，３１，３２はそれぞれ入力側の電源、
３３，３４，３５はそれぞれ入力スイツチであ
る。
回路図あり、第１図は絶縁入力回路に適用した例
で、第２図は多点コモンソース入力方式に適用し
た例（実線参照）及び多点コモンシンク入力方式
に適用した例（破線参照）を示す。第１図におい
て、１−２，３−４，５−６はそれぞれ絶縁入力
回路の一対の入力端子、７，８，９はそれぞれ絶
縁入力回路の電流制限抵抗、１０，１１，１２は
それぞれホトカプラであり、これ等により３個の
絶縁入力回路が構成されている。１３は正極共通
端子で、１４，１５，１６はそれぞれ正極用共通
端子１３に接続されたダイオードである。１７は
負極用共通端子で１８，１９，２０はそれぞれ負
極用共通端子１７に接続されたダイオードであ
る。３０，３１，３２はそれぞれ入力側の電源、
３３，３４，３５はそれぞれ入力スイツチであ
る。
上記のように構成された入力回路を絶縁入力方
式に適用するときは、図示のように、電源スイツ
チで表される外部入力機器が入力端子１−２，３
−４，５−６にそれぞれ接続される。例えばスイ
ツチ３３が投入されると、電源３０の電圧は抵抗
７を介してホトカプラ１０に印加され、ホトカプ
ラ１０の出力は導通状態になつてそれ以降の回路
（図示せず）を作動させる。このとき。入力端子
１の電位はダイオード１４に阻止されて入力端子
３及び入力端子５には回り込まない。スイツチ３
４，３５が投入されたときも同様にしてダイオー
ド１５，１６が回り込みを阻止する。
式に適用するときは、図示のように、電源スイツ
チで表される外部入力機器が入力端子１−２，３
−４，５−６にそれぞれ接続される。例えばスイ
ツチ３３が投入されると、電源３０の電圧は抵抗
７を介してホトカプラ１０に印加され、ホトカプ
ラ１０の出力は導通状態になつてそれ以降の回路
（図示せず）を作動させる。このとき。入力端子
１の電位はダイオード１４に阻止されて入力端子
３及び入力端子５には回り込まない。スイツチ３
４，３５が投入されたときも同様にしてダイオー
ド１５，１６が回り込みを阻止する。
第２図に実線で示した回路は多点コモンソース
入力方式に適用した例であり、図において４０は
入力側の電源、４１，４２，４３はそれぞれ入力
スイツチである。例えば入力スイツチ４１が投入
されると、電源４０の電圧はダイオード１４、抵
抗７及びスイツチ４１を介してホトカプラ１０に
印加され、ホトカプラ１０の出力は導通状態にな
つてそれ以降の回路（図示せず）を作動させる。
このとき、入力端子３，５にもダイオード１５，
１６を介して電源４０の正極電位が印加される
が、負極電位はダイオード１８，１９，２０によ
り阻止されて入力端子４，６には印加されないの
で、電源４０の回り込みは阻止される。
入力方式に適用した例であり、図において４０は
入力側の電源、４１，４２，４３はそれぞれ入力
スイツチである。例えば入力スイツチ４１が投入
されると、電源４０の電圧はダイオード１４、抵
抗７及びスイツチ４１を介してホトカプラ１０に
印加され、ホトカプラ１０の出力は導通状態にな
つてそれ以降の回路（図示せず）を作動させる。
このとき、入力端子３，５にもダイオード１５，
１６を介して電源４０の正極電位が印加される
が、負極電位はダイオード１８，１９，２０によ
り阻止されて入力端子４，６には印加されないの
で、電源４０の回り込みは阻止される。
第２図に破線で示した回路は多点コモンシンク
入力方式に適用した例であり、図において５０は
入力側の電源、５１，５２，５３はそれぞれ入力
スイツチである。例えば入力スイツチ５１が投入
されると、電源５０の電圧はスイツチ５１、抵抗
７、ダイオード１８を介してホトカプラ１０に印
加され、ホトカプラ１０の出力は導通状態になつ
てそれ以降の回路（図示せず）を作動させる。こ
のとき、入力端子４，６にもダイオード１９，２
０を介して電源５０の負極電位が印加されるが、
正極電位はダイオード１４により阻止されて入力
端子３，５には印加されないので、電源５０の回
り込みは阻止される。
入力方式に適用した例であり、図において５０は
入力側の電源、５１，５２，５３はそれぞれ入力
スイツチである。例えば入力スイツチ５１が投入
されると、電源５０の電圧はスイツチ５１、抵抗
７、ダイオード１８を介してホトカプラ１０に印
加され、ホトカプラ１０の出力は導通状態になつ
てそれ以降の回路（図示せず）を作動させる。こ
のとき、入力端子４，６にもダイオード１９，２
０を介して電源５０の負極電位が印加されるが、
正極電位はダイオード１４により阻止されて入力
端子３，５には印加されないので、電源５０の回
り込みは阻止される。
なお、この考案はプログラマブルコントロー
ラ、その他各制御機器の入力回路に適用されるも
のであり、その用途は特に限定されるものではな
い。
ラ、その他各制御機器の入力回路に適用されるも
のであり、その用途は特に限定されるものではな
い。
（考案の効果）
以上のようにこの考案によれば、絶縁入力回路
と正極用共通端子、負極用共通端子との間にダイ
オードを挿入して入力側の電源の回り込みを阻止
するようにしたので、絶縁入力方式、多点コモン
ソース入力方式及び多点コモンシンク入力方式の
いずれにも適用でき、外部入力機器回路の多様性
に対応できる。
と正極用共通端子、負極用共通端子との間にダイ
オードを挿入して入力側の電源の回り込みを阻止
するようにしたので、絶縁入力方式、多点コモン
ソース入力方式及び多点コモンシンク入力方式の
いずれにも適用でき、外部入力機器回路の多様性
に対応できる。
第１図及び第２図はそれぞれこの考案の一実施
例を示す回路図である。 図において、１，２，３，４，５，６は絶縁入
力回路の入力端子、１０，１１，１２はホトカプ
ラ、１３は正極用共通端子、１４，１５，１６，
１８，１９，２０はダイオード、１７は負極用共
通端子である。尚、図中同一符号は同一又は相当
部分を示す。
例を示す回路図である。 図において、１，２，３，４，５，６は絶縁入
力回路の入力端子、１０，１１，１２はホトカプ
ラ、１３は正極用共通端子、１４，１５，１６，
１８，１９，２０はダイオード、１７は負極用共
通端子である。尚、図中同一符号は同一又は相当
部分を示す。
Claims (1)
- 【実用新案登録請求の範囲】 一対の入力端子がそれぞれ設けられ、一方の入
力端子には相対的に高い電位が印加される複数個
の絶縁入力回路と、 前記一方の入力端子にカソードが接続された第
１のダイオードと、 前記一対の入力端子の内の他方の入力端子にア
ノードが接続された複数の第２のダイオードと、 前記第１のダイオードのアノードと接続された
正極用共通端子と、 前記第２のダイオードのカソードと接続された
負極用共通端子と を有する入力回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1987035133U JPH0530162Y2 (ja) | 1987-03-12 | 1987-03-12 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1987035133U JPH0530162Y2 (ja) | 1987-03-12 | 1987-03-12 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS63143904U JPS63143904U (ja) | 1988-09-21 |
| JPH0530162Y2 true JPH0530162Y2 (ja) | 1993-08-02 |
Family
ID=30844345
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1987035133U Expired - Lifetime JPH0530162Y2 (ja) | 1987-03-12 | 1987-03-12 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0530162Y2 (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP5507973B2 (ja) * | 2009-11-17 | 2014-05-28 | 東芝シュネデール・インバータ株式会社 | インバータ装置および制御装置 |
Family Cites Families (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6027235B2 (ja) * | 1976-04-28 | 1985-06-27 | 三菱電機株式会社 | 入力装置 |
| JPS56148704U (ja) * | 1980-04-03 | 1981-11-09 | ||
| JPS56157088A (en) * | 1980-05-07 | 1981-12-04 | Mitsubishi Electric Corp | Input connection system |
| JPS6240602U (ja) * | 1985-08-27 | 1987-03-11 |
-
1987
- 1987-03-12 JP JP1987035133U patent/JPH0530162Y2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPS63143904U (ja) | 1988-09-21 |
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