JPH05304721A - 電源供給回路 - Google Patents
電源供給回路Info
- Publication number
- JPH05304721A JPH05304721A JP8129892A JP8129892A JPH05304721A JP H05304721 A JPH05304721 A JP H05304721A JP 8129892 A JP8129892 A JP 8129892A JP 8129892 A JP8129892 A JP 8129892A JP H05304721 A JPH05304721 A JP H05304721A
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- JP
- Japan
- Prior art keywords
- power supply
- voltage
- relay
- circuit
- electronic circuit
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Abstract
(57)【要約】
【構成】ＣＫＴ４の高電圧電源端子に直列にＲ１を付加
してサージ電流が流れないようにすると共に、ＣＫＴ４
の高電圧電源端子にＤＥＴ６を接続し、規定の電圧にな
ったらＲＬ２のメーク接点２ａによりＲ１の端子を短絡
し、メーク接点２ｂを介してＩＣ用の正の低電圧をＣＫ
Ｔ４に印加する。 【効果】電源投入時のラッシュ電流を抑え、電子回路の
グランドが負側に変化するのを防止すると共に、電子回
路の破壊を防ぐことができる。
してサージ電流が流れないようにすると共に、ＣＫＴ４
の高電圧電源端子にＤＥＴ６を接続し、規定の電圧にな
ったらＲＬ２のメーク接点２ａによりＲ１の端子を短絡
し、メーク接点２ｂを介してＩＣ用の正の低電圧をＣＫ
Ｔ４に印加する。 【効果】電源投入時のラッシュ電流を抑え、電子回路の
グランドが負側に変化するのを防止すると共に、電子回
路の破壊を防ぐことができる。
Description
【０００１】
【産業上の利用分野】本発明は電源供給回路に関し、特
に交換機のような負の高電圧と論理回路用の正の低電圧
とを使用する負荷電子回路への電源供給回路に関する。
に交換機のような負の高電圧と論理回路用の正の低電圧
とを使用する負荷電子回路への電源供給回路に関する。
【０００２】
【従来の技術】図２は従来の電源供給回路の一例を示す
ブロック図である。図２において、本例は負の高電圧電
源と論理回路用の正の低電圧電源を必要とする電子回路
（以下ＣＫＴ）４と、正の低電圧電源のみで動作するイ
ンタフェース回路（以下ＩＮＦ）７と、負の高電圧電源
端子（以下ＶＨ）１０と、グランド端子（以下Ｇ）１１
との間に接続された入力コンデンサ（以下ＣＡ）３と、
正の低電圧電源端子（以下ＶＬ）１３とＧ１１との間に
接続された入力コンデンサ（以下ＣＢ）８とからなり、
ＣＫＴ４にはＶＨ１０，ＶＬ１３を介して外部から負の
高電圧，正の低電圧が供給される。
ブロック図である。図２において、本例は負の高電圧電
源と論理回路用の正の低電圧電源を必要とする電子回路
（以下ＣＫＴ）４と、正の低電圧電源のみで動作するイ
ンタフェース回路（以下ＩＮＦ）７と、負の高電圧電源
端子（以下ＶＨ）１０と、グランド端子（以下Ｇ）１１
との間に接続された入力コンデンサ（以下ＣＡ）３と、
正の低電圧電源端子（以下ＶＬ）１３とＧ１１との間に
接続された入力コンデンサ（以下ＣＢ）８とからなり、
ＣＫＴ４にはＶＨ１０，ＶＬ１３を介して外部から負の
高電圧，正の低電圧が供給される。
【０００３】このような電源供給回路のＶＨ１０，ＶＬ
１３とＧ１１に電源を投入すると、特にＣＡ３には約４
０Ａのチャージ電流が一瞬流れ、これによりＧ１１とＣ
Ａ３のグランド端子間に数Ｖの電位差が発生する。この
電圧はＣＫＴ４またはＩＮＦ７のグランド電位を負側に
数Ｖ変化させたことになる。また、２種類以上の電源を
持っている電子回路においては、先ず負の高電圧を投入
してから正の低電圧を供給しないと、過大電流が一瞬流
れる。
１３とＧ１１に電源を投入すると、特にＣＡ３には約４
０Ａのチャージ電流が一瞬流れ、これによりＧ１１とＣ
Ａ３のグランド端子間に数Ｖの電位差が発生する。この
電圧はＣＫＴ４またはＩＮＦ７のグランド電位を負側に
数Ｖ変化させたことになる。また、２種類以上の電源を
持っている電子回路においては、先ず負の高電圧を投入
してから正の低電圧を供給しないと、過大電流が一瞬流
れる。
【０００４】
【発明が解決しようとする課題】この従来の電源供給回
路では、グランド電位が一瞬負側に数Ｖ変化するため、
インタフェース回路から見ると電源電圧がこのグランド
電位の変化分高くなったことになり、インタフェース回
路が破損するという問題点があった。また、電源投入時
の過大電流により端子部が焼損することがあるという問
題点があった。
路では、グランド電位が一瞬負側に数Ｖ変化するため、
インタフェース回路から見ると電源電圧がこのグランド
電位の変化分高くなったことになり、インタフェース回
路が破損するという問題点があった。また、電源投入時
の過大電流により端子部が焼損することがあるという問
題点があった。
【０００５】
【課題を解決するための手段】本発明の電源供給回路
は、負荷の電子回路に正の低圧電源と負の高圧電源とを
供給する電源供給回路において、前記負の高圧電源投入
時に前記電子回路とその入力コンデンサに流れる電流を
制限する保護抵抗と、前記入力コンデンサの端子電圧が
規定値になった時駆動されてその第１の接点により前記
保護抵抗の両端を短絡させるリレーとを備えている。
は、負荷の電子回路に正の低圧電源と負の高圧電源とを
供給する電源供給回路において、前記負の高圧電源投入
時に前記電子回路とその入力コンデンサに流れる電流を
制限する保護抵抗と、前記入力コンデンサの端子電圧が
規定値になった時駆動されてその第１の接点により前記
保護抵抗の両端を短絡させるリレーとを備えている。
【０００６】そして、前記リレーは駆動された時前記正
の低圧電源を前記電子回路に供給する第２の接点を有し
ている。
の低圧電源を前記電子回路に供給する第２の接点を有し
ている。
【０００７】
【実施例】次に、本発明について図面を参照して説明す
る。図１は本発明の電源供給回路の一実施例を示すブロ
ック図である。
る。図１は本発明の電源供給回路の一実施例を示すブロ
ック図である。
【０００８】本実施例は図２に示した従来例に電流制限
用抵抗（以下Ｒ）１と、ＣＡ３の端子電圧が規定値にな
ったことを検出する電圧検出回路（以下ＤＥＴ）６と、
ＤＥＴ６の検出信号によりリレー（以下ＲＬ）２を駆動
するリレードライバ（以下ＤＲＶ）５とを付加して構成
され、ＶＨ１０とＣＡ３，ＣＫＴ４との間に挿入された
Ｒ１と並列にＲＬ２のメーク接点２ａが接続され、ＶＬ
１３とＣＢ８，ＣＫＴ４との間にメーク接点２ｂが挿入
接続されている。なおＩＮＦ７は論理信号入力端子（以
下ＩＮ）１２に接続されている。
用抵抗（以下Ｒ）１と、ＣＡ３の端子電圧が規定値にな
ったことを検出する電圧検出回路（以下ＤＥＴ）６と、
ＤＥＴ６の検出信号によりリレー（以下ＲＬ）２を駆動
するリレードライバ（以下ＤＲＶ）５とを付加して構成
され、ＶＨ１０とＣＡ３，ＣＫＴ４との間に挿入された
Ｒ１と並列にＲＬ２のメーク接点２ａが接続され、ＶＬ
１３とＣＢ８，ＣＫＴ４との間にメーク接点２ｂが挿入
接続されている。なおＩＮＦ７は論理信号入力端子（以
下ＩＮ）１２に接続されている。
【０００９】続いて本実施例の動作について説明する。
電源が投入されると、ＶＨ１０とＧ１１間およびＶＬ１
３とＧ１１間に負の高電圧および正の低電圧が印加され
る。負の高電圧はＲ１により制限された電流をＣＡ３，
ＣＫＴ４を介してＧ１１に流すが過電流とはならない。
従ってＧ１１とＣＡ３のグランド端子間に電位差は発生
しない。ＣＡ３が充電されてその端子電圧が規定値にな
った時、ＤＥＴ６はこれを検出して検出信号をハイレベ
ルにしてＤＲＶ５に入力する。ＤＲＶ５はＲＬ２を駆動
する。メーク接点２ａはオンしてＲ１の両端を短絡して
電源インピーダンスを零近辺にし、ＣＫＴ４にはＶＨ１
０からの負の高電圧が印加される。一方、メーク接点２
ｂがオンしてＶＬ１３からの正の低電圧はＩＮＦ７，Ｃ
Ｂ８およびＣＫＴ４に印加される。
電源が投入されると、ＶＨ１０とＧ１１間およびＶＬ１
３とＧ１１間に負の高電圧および正の低電圧が印加され
る。負の高電圧はＲ１により制限された電流をＣＡ３，
ＣＫＴ４を介してＧ１１に流すが過電流とはならない。
従ってＧ１１とＣＡ３のグランド端子間に電位差は発生
しない。ＣＡ３が充電されてその端子電圧が規定値にな
った時、ＤＥＴ６はこれを検出して検出信号をハイレベ
ルにしてＤＲＶ５に入力する。ＤＲＶ５はＲＬ２を駆動
する。メーク接点２ａはオンしてＲ１の両端を短絡して
電源インピーダンスを零近辺にし、ＣＫＴ４にはＶＨ１
０からの負の高電圧が印加される。一方、メーク接点２
ｂがオンしてＶＬ１３からの正の低電圧はＩＮＦ７，Ｃ
Ｂ８およびＣＫＴ４に印加される。
【００１０】
【発明の効果】以上説明したように本発明は、電源投入
時に入力コンデンサや電子回路の電源端子に過電流が流
れないようにするとともに、電源が通常の使用電圧にな
った時には電流制限抵抗を短絡して電源のインピーダン
スを低くすることにより、電源投入時のラッシュ電流を
抑え、電子回路のグランドが負側に変化するのを防止す
ると共に、高電圧電源供給が確立されてから低電圧を電
子回路に印加するようにしたので、電子回路の破壊を防
ぐことができるという効果を有する。
時に入力コンデンサや電子回路の電源端子に過電流が流
れないようにするとともに、電源が通常の使用電圧にな
った時には電流制限抵抗を短絡して電源のインピーダン
スを低くすることにより、電源投入時のラッシュ電流を
抑え、電子回路のグランドが負側に変化するのを防止す
ると共に、高電圧電源供給が確立されてから低電圧を電
子回路に印加するようにしたので、電子回路の破壊を防
ぐことができるという効果を有する。
【図１】本発明の電源供給回路の一実施例を示すブロッ
ク図である。
ク図である。
【図２】従来の電源供給回路の一例を示すブロック図で
ある。
ある。
【符号の説明】 １ 電流制限用抵抗（Ｒ） ２ リレー（ＲＬ） ２ａ，２ｂ メーク接点 ３，８ 入力コンデンサ（ＣＡ，ＣＢ） ４ 電子回路（ＣＫＴ） ５ リレードライバ（ＤＲＶ） ６ 電圧検出回路（ＤＥＴ） ７ インタフェース回路（ＩＮＦ） １０ 負の高電圧電源端子（ＶＨ） １１ グランド端子（Ｇ） １２ 論理信号入力端子（ＩＮ） １３ 正の低電圧電源端子（ＶＬ）
Claims (2)
- 【請求項１】 負荷の電子回路に正の低圧電源と負の高
圧電源とを供給する電源供給回路において、前記負の高
圧電源投入時に前記電子回路とその入力コンデンサに流
れる電流を制限する保護抵抗と、前記入力コンデンサの
端子電圧が規定値になった時駆動されてその第１の接点
により前記保護抵抗の両端を短絡させるリレーとを備え
ることを特徴とする電源供給回路。 - 【請求項２】 前記リレーは駆動された時前記正の低圧
電源を前記電子回路に供給する第２の接点を有すること
を特徴とする請求項１記載の電源供給回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8129892A JPH05304721A (ja) | 1992-04-03 | 1992-04-03 | 電源供給回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8129892A JPH05304721A (ja) | 1992-04-03 | 1992-04-03 | 電源供給回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH05304721A true JPH05304721A (ja) | 1993-11-16 |
Family
ID=13742489
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP8129892A Pending JPH05304721A (ja) | 1992-04-03 | 1992-04-03 | 電源供給回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH05304721A (ja) |
-
1992
- 1992-04-03 JP JP8129892A patent/JPH05304721A/ja active Pending
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A02 | Decision of refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A02 Effective date: 19981013 |