JPH05315411A - テストヘッド - Google Patents
テストヘッドInfo
- Publication number
- JPH05315411A JPH05315411A JP11862692A JP11862692A JPH05315411A JP H05315411 A JPH05315411 A JP H05315411A JP 11862692 A JP11862692 A JP 11862692A JP 11862692 A JP11862692 A JP 11862692A JP H05315411 A JPH05315411 A JP H05315411A
- Authority
- JP
- Japan
- Prior art keywords
- terminal
- test head
- wiring
- check
- head
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Withdrawn
Links
- 238000012360 testing method Methods 0.000 title claims abstract description 52
- 238000005259 measurement Methods 0.000 claims abstract description 15
- 239000008188 pellet Substances 0.000 claims description 11
- 239000004065 semiconductor Substances 0.000 claims description 7
- 238000012544 monitoring process Methods 0.000 claims description 2
- RYGMFSIKBFXOCR-UHFFFAOYSA-N Copper Chemical compound [Cu] RYGMFSIKBFXOCR-UHFFFAOYSA-N 0.000 abstract description 3
- 239000000523 sample Substances 0.000 description 8
Landscapes
- Testing Of Individual Semiconductor Devices (AREA)
- Measuring Leads Or Probes (AREA)
- Testing Or Measuring Of Semiconductors Or The Like (AREA)
Abstract
(57)【要約】
【目的】半導体ウェーハの電気的特性試験において、測
定系起因によるテストフェイル時の測定系配線チェック
を容易にすること。 【構成】テストヘッドの外部端子3面以外の面に、ピン
毎のチェック端子1を設け、ピンカード11と外部端子
3との間で分岐させ、銅線10を用いてこのチェック端
子1と接続する。
定系起因によるテストフェイル時の測定系配線チェック
を容易にすること。 【構成】テストヘッドの外部端子3面以外の面に、ピン
毎のチェック端子1を設け、ピンカード11と外部端子
3との間で分岐させ、銅線10を用いてこのチェック端
子1と接続する。
Description
【0001】
【産業上の利用分野】本発明は半導体ウェーハ上に形成
されたペレットを電気的に測定するテストヘッドに関
し、特に測定トラブル時にテストヘッドのピン終端の信
号を確認するチェック端子機能に関する。
されたペレットを電気的に測定するテストヘッドに関
し、特に測定トラブル時にテストヘッドのピン終端の信
号を確認するチェック端子機能に関する。
【0002】
【従来の技術】従来のテストヘッド2は、図3(A),
(B)に示すように、テスタから出力される試料用電源
をケーブル4で供給し、ペレットの入出力に対応するピ
ン毎の情報を受けて測定配線の切替え等を行う箱状のユ
ニットであり、その一面がテストヘッドとペレットとを
接続するための外部端子3を円状に有している。
(B)に示すように、テスタから出力される試料用電源
をケーブル4で供給し、ペレットの入出力に対応するピ
ン毎の情報を受けて測定配線の切替え等を行う箱状のユ
ニットであり、その一面がテストヘッドとペレットとを
接続するための外部端子3を円状に有している。
【0003】ウェーハ8上に形成されたペレットの電気
的測定を行なう時には、図4に示すように、この外部端
子3にデバイス品種固有の負荷回路を配線するためのテ
ストボード5を取付け、リングプレート6を経由し、プ
ローブカード7まで接続される。テストヘッド2は、矢
印方向に開閉される。
的測定を行なう時には、図4に示すように、この外部端
子3にデバイス品種固有の負荷回路を配線するためのテ
ストボード5を取付け、リングプレート6を経由し、プ
ローブカード7まで接続される。テストヘッド2は、矢
印方向に開閉される。
【0004】また、図5は図4のように、治工具類を実
際に接続し、テスト状態にしたときの様子を示す側面図
である。図5において、本テストヘッド2では、外部端
子3とプローバ上面9との間隔が100mmと小さく、
容易にオシロスコープ等のプローブを接続出来ない事が
わかる。
際に接続し、テスト状態にしたときの様子を示す側面図
である。図5において、本テストヘッド2では、外部端
子3とプローバ上面9との間隔が100mmと小さく、
容易にオシロスコープ等のプローブを接続出来ない事が
わかる。
【0005】仮に、テストヘッド2がプローバにセット
された状態からテストヘッド2を開き、プローブを接続
し、再びテスト状態にセットするためには、他の一連の
動作を考慮すると、約5分程の時間を要する。
された状態からテストヘッド2を開き、プローブを接続
し、再びテスト状態にセットするためには、他の一連の
動作を考慮すると、約5分程の時間を要する。
【0006】
【発明が解決しようとする課題】このような従来のテス
トヘッド2では、半導体ウェーハ8上に形成されたペレ
ットの電気的測定をしている状態において、図5のよう
に、テストヘッド2、プローブカード7間のチェック端
子となる部分が隠れてしまい、測定状態のまま測定配線
の数点を電気的チェックする場合、非常に不便であっ
た。
トヘッド2では、半導体ウェーハ8上に形成されたペレ
ットの電気的測定をしている状態において、図5のよう
に、テストヘッド2、プローブカード7間のチェック端
子となる部分が隠れてしまい、測定状態のまま測定配線
の数点を電気的チェックする場合、非常に不便であっ
た。
【0007】つまり、デバイステストがフェイルにな
り、測定系の配線を行う際に、測定点を変更しようとす
る毎にテストヘッド2を開き、テストボード5上にオシ
ロスコープ等のプローブを接続し、再びヘッドを閉じ、
ペレットのボンディングパッドに針を合わせてテスティ
ング状態にし、配線状態をチェックしなければならない
という問題点があった。
り、測定系の配線を行う際に、測定点を変更しようとす
る毎にテストヘッド2を開き、テストボード5上にオシ
ロスコープ等のプローブを接続し、再びヘッドを閉じ、
ペレットのボンディングパッドに針を合わせてテスティ
ング状態にし、配線状態をチェックしなければならない
という問題点があった。
【0008】本発明の目的は、前記問題点を解決し、直
ちに配線状態をチェックできるようにしたテストヘッド
を提供することにある。
ちに配線状態をチェックできるようにしたテストヘッド
を提供することにある。
【0009】
【課題を解決するための手段】本発明のテストヘッドの
構成は、半導体ウェーハ上に形成された多数のペレット
の電気的測定を行う際に、電源を供給し、前記ペレット
の入出力に対応する各ピン毎の情報を受けて測定配線の
切替えを行うテストヘッドにおいて、外部端子の外に、
前記各ピンの信号をモニタするチェック端子を設けたこ
とを特徴とする。
構成は、半導体ウェーハ上に形成された多数のペレット
の電気的測定を行う際に、電源を供給し、前記ペレット
の入出力に対応する各ピン毎の情報を受けて測定配線の
切替えを行うテストヘッドにおいて、外部端子の外に、
前記各ピンの信号をモニタするチェック端子を設けたこ
とを特徴とする。
【0010】
【実施例】図1は本発明の一実施例のテストヘッドを示
す側面図、図2は図1の内部を示す断面図である。
す側面図、図2は図1の内部を示す断面図である。
【0011】図1,図2において、本実施例のテストヘ
ッド2は、テスタ−テストヘッド間ケーブル4で接続さ
れ、底面にテストヘッド外部端子3があり、側面に4行
×9列の個数の接触子を有するチェック端子1がある。
このチェック端子は、銅線10を介して、ピンカード1
1からの配線と各々電気的に接続されている。
ッド2は、テスタ−テストヘッド間ケーブル4で接続さ
れ、底面にテストヘッド外部端子3があり、側面に4行
×9列の個数の接触子を有するチェック端子1がある。
このチェック端子は、銅線10を介して、ピンカード1
1からの配線と各々電気的に接続されている。
【0012】テスタよりテストヘッドに入ってきた配線
12は、ヘッド内ピンカード11に接続され、このピン
カード11からポゴピンを用いた外部端子3に至る。
12は、ヘッド内ピンカード11に接続され、このピン
カード11からポゴピンを用いた外部端子3に至る。
【0013】そこで、その終端であるポゴピンの手前で
端子を分岐し、テストヘッド側面に設けたチェック端子
1とチェック−出力分岐点間の銅線10にて接続する。
尚図2においては、複雑になることを避け、1ピンのみ
の配線例を示した。
端子を分岐し、テストヘッド側面に設けたチェック端子
1とチェック−出力分岐点間の銅線10にて接続する。
尚図2においては、複雑になることを避け、1ピンのみ
の配線例を示した。
【0014】このように、本実施例のテストヘッドは、
半導体ペレットをテストするための専用外部端子以外
に、各ピン毎外部端子を分岐させたチェック端子を備え
ている。
半導体ペレットをテストするための専用外部端子以外
に、各ピン毎外部端子を分岐させたチェック端子を備え
ている。
【0015】
【発明の効果】以上説明したように、本発明のテストヘ
ッドは、テスト状態のまま配線状態を観ることができる
チェック端子を外面に取付けたので、測定系起因のサン
プル測定フェイル時に、ヘッドの開閉操作及びテスティ
ング操作等のくり返し作業をすることなく、配線チェッ
クが行えるという効果を有する。
ッドは、テスト状態のまま配線状態を観ることができる
チェック端子を外面に取付けたので、測定系起因のサン
プル測定フェイル時に、ヘッドの開閉操作及びテスティ
ング操作等のくり返し作業をすることなく、配線チェッ
クが行えるという効果を有する。
【0016】例えば、従来では、1測定点のチェックを
行う場合、時間にして5分程費していたものが、本実施
例のテストヘッドでは30秒程、つまり従来の1/10
と大幅な時間短縮となる。
行う場合、時間にして5分程費していたものが、本実施
例のテストヘッドでは30秒程、つまり従来の1/10
と大幅な時間短縮となる。
【図1】本発明の一実施例のテストヘッドを示す側面図
である。
である。
【図2】図1の一実施例のテストヘッドの内部を示す断
面図である。
面図である。
【図3】(A),(B)は従来のテストヘッドのそれぞ
れ側面図、正面図である。
れ側面図、正面図である。
【図4】従来のテストヘッドから半導体ウェーハまでの
治工具を分解して示した側面図である。
治工具を分解して示した側面図である。
【図5】図4のテストヘッドの組立状態を示す側面図で
ある。
ある。
1 チェック端子 2 テストヘッド(本体) 3 テストヘッド外部端子(ポゴピン) 4 テスタ−テストヘッド間ケーブル 5 テストボード 6 リングプレート 7 プローブカード 8 半導体ウェーハ 9 プローバ上面 10 チェック端子−出力分岐点間の銅線 11 ピンカード 12 テスタからの配線
Claims (1)
- 【請求項1】 半導体ウェーハ上に形成された多数のペ
レットの電気的測定を行う際に、電源を供給し、前記ペ
レットの入出力に対応する各ピン毎の情報を受けて測定
配線の切替えを行うテストヘッドにおいて、外部端子の
外に、前記各ピンの信号をモニタするチェック端子を設
けたことを特徴とするテストヘッド。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11862692A JPH05315411A (ja) | 1992-05-12 | 1992-05-12 | テストヘッド |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11862692A JPH05315411A (ja) | 1992-05-12 | 1992-05-12 | テストヘッド |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH05315411A true JPH05315411A (ja) | 1993-11-26 |
Family
ID=14741193
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP11862692A Withdrawn JPH05315411A (ja) | 1992-05-12 | 1992-05-12 | テストヘッド |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH05315411A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0943304A (ja) * | 1995-07-26 | 1997-02-14 | Nec Corp | 半導体試験装置 |
| CN103323633A (zh) * | 2013-05-30 | 2013-09-25 | 江西洪都航空工业集团有限责任公司 | 一种综合测试系统检测口 |
-
1992
- 1992-05-12 JP JP11862692A patent/JPH05315411A/ja not_active Withdrawn
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0943304A (ja) * | 1995-07-26 | 1997-02-14 | Nec Corp | 半導体試験装置 |
| CN103323633A (zh) * | 2013-05-30 | 2013-09-25 | 江西洪都航空工业集团有限责任公司 | 一种综合测试系统检测口 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A300 | Withdrawal of application because of no request for examination |
Free format text: JAPANESE INTERMEDIATE CODE: A300 Effective date: 19990803 |