JPH05343600A - 半導体装置用スタビライザ/スペーサ - Google Patents

半導体装置用スタビライザ/スペーサ

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JPH05343600A
JPH05343600A JP5000698A JP69893A JPH05343600A JP H05343600 A JPH05343600 A JP H05343600A JP 5000698 A JP5000698 A JP 5000698A JP 69893 A JP69893 A JP 69893A JP H05343600 A JPH05343600 A JP H05343600A
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JP
Japan
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lead
leadframe
stabilizer
spacer
lead frame
Prior art date
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Pending
Application number
JP5000698A
Other languages
English (en)
Inventor
Donald C Abbott
シー アボット ドナルド
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Texas Instruments Inc
Original Assignee
Texas Instruments Inc
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Filing date
Publication date
Application filed by Texas Instruments Inc filed Critical Texas Instruments Inc
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Pending legal-status Critical Current

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    • H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
    • H10W70/00—Package substrates; Interposers; Redistribution layers [RDL]
    • H10W70/01—Manufacture or treatment
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    • H—ELECTRICITY
    • H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
    • H10W70/00—Package substrates; Interposers; Redistribution layers [RDL]
    • H10W70/40—Leadframes
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    • H—ELECTRICITY
    • H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
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    • H10P72/00—Handling or holding of wafers, substrates or devices during manufacture or treatment thereof
    • H10P72/04—Apparatus for manufacture or treatment
    • H10P72/0438—Apparatus for making assemblies not otherwise provided for, e.g. package constructions
    • Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
    • Y10—TECHNICAL SUBJECTS COVERED BY FORMER USPC
    • Y10T—TECHNICAL SUBJECTS COVERED BY FORMER US CLASSIFICATION
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    • Y10T29/49—Method of mechanical manufacture
    • Y10T29/49002—Electrical device making
    • Y10T29/49117—Conductor or circuit manufacturing
    • Y10T29/49121—Beam lead frame or beam lead device

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  • Lead Frames For Integrated Circuits (AREA)
  • Electroplating Methods And Accessories (AREA)
  • Coating By Spraying Or Casting (AREA)

Abstract

(57)【要約】 【目的】 本発明の目的は、リード(15)の選択され
た領域上にセラミックまたはプラスチック材料をプラズ
マスプレーしてリード(15)のためのスタビライザ/
スペーサ(36)を形成させる装置及び方法を提供する
ことである。 【構成】 リードフレームのリード上にスタビライザ/
スペーサを選択的に形成させるために、複数のインデッ
クスホールを有する少なくとも1つのリードフレーム
と、上記少なくとも1つのリードフレーム及びリードフ
レームのストリップを保持し、導くインデックスピンを
有する取付具/ジグと、上記少なくとも1つのリードフ
レーム上の選択された領域を露出させるマスクと、上記
少なくとも1つのリードフレーム上の選択された領域に
スタビライザ/スペーサを付着させるプラズマトーチと
を具備する。

Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】本発明は半導体装置に関し、具体
的にはハイピンカウントリードフレームを有する装置の
ためのセラミックまたプラスチックスタビライザ/スペ
ーサに関する。
【0002】
【発明の背景】密に間隔をおいた内部リードを有する繊
細なハイピンカウントリードフレームを製造する際に、
リード間の間隔を維持し、且つリードチップの平面性を
安定させるためにポリイミドまたはカプトンテープを接
着させることが多い。この操作は、典型的には、リード
フレームのスタンピングまたはエッチングの後に、また
リードフレームをめっきした後に遂行される。これは、
リードフレームユニットを導いて精密に位置決めし、精
密に切断され位置決めされたポリイミドテープの片に熱
及び圧力を加えてそれをリードフレームに接着させるこ
ととを含む。この操作は高価であり、時間を消費し、そ
して高い価値が付加されためっき済リードフレームに付
加的な機械的処理を行うことを含む。ポリイミドテープ
を接着させたリードフレームにはイオンによる汚染が見
出されることが多い。
【0003】
【発明の概要】めっきされているまたはめっきされてい
ない、ある長さに切断されているまたは切断されていな
い、エッチングまたはスタンプされたリードフレームが
ジグ内に固定され、窓を設けた中実マスクがインデック
スピンを使用してリードフレームストリップ上に位置決
めされる。マスクは金属、プラスチック、厚紙、または
他の類似材料であってよい。インデックスピンはマスク
をリードフレームに精密に位置決めし、マスクはリード
と同一平面をなすように定位置に締付けられる。もしリ
ードフレームがオフセットされていれば、オフセットバ
ーパッドを受け入れるためのポケットをジグの中に切
る。マスクには、アルミナまたは類似の高誘電強度材料
のようなプラスチックまたはセラミックをリードフィン
ガー上に、またはそれらの間に沈積させることができる
ような窓が切られている。付着される材料は、リードフ
ィンガーのX、Y及びZ方向の相対位置を固定する。マ
スキング及び安定化材料の沈積は1以上の段階によって
遂行することができ、またリードの何れかの側から、ま
たは両側から遂行することができる。
【0004】もしリードフレームがめっきされてはいる
が切断されていなければ、スタビライザ/スペーサを付
着させれば、オフセット、切断、及び出荷の準備が整
う。もしリードフレームがめっきされ、オフセットさ
れ、そして切断されていれば、スタビライザ/スペーサ
を付着させれば、出荷の準備が整う。もしリードフレー
ムがめっきされておらず、切断されているかまたは切断
されていなければ、セラミックスタビライザ/スペーサ
を付着させる先行または爾後の段階は、標準化ジグ内に
リードフレームを取付け、銀のような金属をプラズマス
プレーによって選択的に沈積させる領域を限定する窓を
有するマスクを配置することになる。この取付けは、セ
ラミックまたは金属プラズマ被膜の何れに対しても同一
である。マスクだけを変化させるのである。
【0005】本発明により提供される技術的進歩及びそ
の目的は、添付図面に基づく本発明の好ましい実施例の
説明及び特許請求の範囲から明白になるであろう。
【0006】
【実施例】図1、2、及び3はハイピンカウントリード
フレーム内にリードフレームリードのためのスタビライ
ザ/スペーサを設ける従来の方法を示す。インデックス
ホール13を有するリードフレーム10は、リードフレ
ームを定位置に保持するインデックスピン12を有する
加熱器ブロック11上に配置される。ダイス穴20を有
するダイス17は、ダイス穴20がリード15にまたが
るようにリードフレーム10上に配置される。ポリイミ
ドのシート18がダイス上に配置され、ダイス17の穴
20に対応するポンチ要素19を有するポンチがポリイ
ミド上に配置される。ポンチ要素19は、シート18か
ら小さいポリイミド材料のストリップをリード15上に
打ち抜く。図2に、シート18から打ち抜かれた後のリ
ード15上のポリイミドのストリップ25を示す。図3
は、ポリイミドストリップ25及びリード15の断面図
である。加熱器ブロックは熱を供給してストリップ25
がリード15へ付着するのを援助する。
【0007】図4は、リードフレームのリード上へセラ
ミックまたはプラスチック材料をプラズマスプレーして
リード上にスタビライザ/スペーサを形成させる本発明
の方法及び装置を示す。図4には、ジグまたは取付具2
1上に取り付けられるリードフレーム10が示されてい
る。リードフレーム10はダイス取付けパッド14と、
ダムバー16によって定位置に保持されているリード1
5とを含む。ダムバー16は半導体装置が完成してカプ
セル封じがなされた後に除去される。リードフレーム1
0はジグまたは取付具21上のインデックスピン12
と、リードフレーム10の縁のインデックスホール13
とによって定位置に保持される。
【0008】マスク30はリードフレーム10上に配置
される。マスク30はセラミックで被膜すべきリード1
5上の領域に対応する開口31のパターンを有してい
る。トーチ33は炎またはプラズマ34を有し、その中
へ粉末材料が管35によってスプレーされる。炎内にス
プレーされた粉末材料は、マスク開口31を通してリー
ド15上に溶融した形状で沈積される。セラミックまた
はプラスチック材料の沈積中に、プラズマトーチ33ま
たはジグまたは取付具21はX−Y方向に運動してマス
ク30内の開口31をプラズマトーチの下に配置し、所
望の場所に充分な被膜が得られるようにする。
【0009】図5は、セラミックスタビライザ/スペー
サ36を沈積させ、サイドレールから取り外した後のリ
ードフレームを示す。スタビライザ/スペーサ36はリ
ード15を橋絡し、またリードの間にあってそれらを互
いに離間した関係に保持している。スタビライザ/スペ
ーサ36は、図示のようにリードの一方の側だけに設け
ても、またはリードの両側に設けてもよい。
【0010】図6は、スタビライザ/スペーサ36及び
リード15の断面図であって、リード間のセラミック材
料の流れを示す。セラミック材料は、例えばアルミナま
たはプラスチック材料でよい。ポリイミドの代わりにセ
ラミック材料を使用すると、プラスチックリードフレー
ムパッケージの気密性が改善される。プラスチックモー
ルド組成は、ポリイミドテープまたはリードフレーム素
地よりもセラミックによりよく接着する。ポリフェニル
スルフォンとして知られるようなプラスチック材料を使
用することもできる。
【0011】セラミックを付着させるのと同じようにし
て、銀のような他の金属をリードフレームの選択された
領域内に選択的に沈積させることができる。金属のこの
選択的沈積は、同一取付具においてセラミックの沈積の
前にでも、または後にでも、異なるマスクを使用し、プ
ラズマ沈積を用いて遂行することができる。図示プロセ
スはリードフレームの切断されたストリップを示してい
るが、連続したリードフレームのストリップを使用する
こともできる。
【0012】リード上のダイスパッドの周囲にセラミッ
ク材料の連続パターンを沈積させることができる。連続
パターンを使用すると、プラスチックカプセル材料とセ
ラミックとの間に連続シールを生じさせ、パッケージの
周囲によりよいシールが得られる。以上の記載に関連し
て、以下の各項を開示する。 1. 複数のリード及び半導体ダイスパッドを有する半
導体装置リードフレームのリードのためのスタビライザ
/スペーサを得る方法であって、リード上の選択された
領域をマスクする段階と、リード上の選択された領域上
に、及びこれらの領域間に安定化材料をプラズマスプレ
ーする段階と、を具備することを特徴とする方法。 2. 安定化材料を付着させる前に、リードを選択的に
めっきする段階を含む請求項1に記載の方法。 3. 安定化材料がセラミック材料である請求項1に記
載の方法。 4. 安定化材料がプラスチック材料である請求項1に
記載の方法。 5. セラミック材料を付着させた後に、リードを選択
的にめっきする段階を含む請求項1に記載の方法。 6. リード上の選択された領域上へのセラミック材料
の沈積中にリードフレームをX−Y方向に運動させて選
択された領域をプラズマトーチの下に配置する段階を含
む請求項1に記載の方法。 7. 上記選択された領域の反対側の上記リード上の第
2の選択された領域上に安定化材料を沈積させる段階を
含む請求項1に記載の方法。 8. ダイスパッドを取り囲む囲いで仕切ったパターン
内のリードフレームの全てのリードにまたがってセラミ
ック材料をプラズマスプレーする段階を含む請求項1に
記載の方法。 9. リードフレームのリード上にスタビライザ/スペ
ーサを選択的に形成させる装置であって、複数のインデ
ックスホールを有する少なくとも1つのリードフレーム
と、上記少なくとも1つのリードフレーム及びリードフ
レームのストリップを保持し、導くインデックスピンを
有する取付具/ジグと、上記少なくとも1つのリードフ
レーム上の選択された領域を露出させるマスクと、上記
少なくとも1つのリードフレーム上の選択された領域に
スタビライザ/スペーサを付着させるプラズマトーチ
と、を具備することを特徴とする装置。 10. スタビライザ/スペーサ材料を上記選択された
領域に付着させる時に上記選択された領域を上記プラズ
マトーチの下に移動させるX−Yテーブルを含む請求項
9に記載の装置。 11. リードフレームの連続ストリップ上の選択され
た領域をマスクするように導かれる連続マスクを含む請
求項9に記載の装置。 12. 上記マスク上で上記プラズマトーチをX−Y方
向に移動させる手段を含む請求項9に記載の装置。 13. 上記スタビライザ/スペーサ材料がセラミック
材料である請求項9に記載の装置。 14. 上記スタビライザ/スペーサ材料がプラスチッ
ク材料である請求項9に記載の装置。 15. 本発明はリード(15)の選択された領域上に
セラミックまたはプラスチック材料をプラズマスプレー
してリード(15)のためのスタビライザ/スペーサ
(36)を形成させる装置及び方法に関する。
【図面の簡単な説明】
【図1】取付具及びリードフレームを示し、従来技術の
ポリイミドテープをリード上に配置するためのポンチ及
びダイスの使用を示す図である。
【図2】定位置にポリイミドスタビライザを有する単一
のリードフレームの斜視図である。
【図3】図2の3−3矢視断面図であって、リード上の
ポリイミドスタビライザ/スペーサを示す図である。
【図4】本発明によりリードフレーム上に材料の被膜を
付着させ、セラミックまたはプラスチックスタビライザ
/スペーサを形成させる装置を示す図である。
【図5】本発明によるセラミックスタビライザ/スペー
サを有する単一のリードフレームの斜視図である。
【図6】図5の6−6矢視断面図であって、リードフレ
ームのリード上のセラミックスタビライザ/スペーサを
示す図である。
【符号の説明】
10 リードフレーム 11 加熱器ブロック 12 インデックスピン 13 インデックスホール 14 ダイス取付けパッド 15 リード 16 ダムバー 17 ダイス 18 ポリイミドシート 19 ポンチ要素 20 ダイス穴 21 ジグ(取付具) 25 ポリイミドストリップ 30 マスク 31 開口 33 トーチ 34 プラズマ(炎) 35 管 36 スタビライザ/スペーサ

Claims (2)

    【特許請求の範囲】
  1. 【請求項1】 複数のリード及び半導体ダイスパッドを
    有する半導体装置リードフレームのリードのためのスタ
    ビライザ/スペーサを得る方法であって、 リード上の選択された領域をマスクする段階と、 リード上の選択された領域上に、及びこれらの領域間に
    安定化材料をプラズマスプレーする段階と、 を具備することを特徴とする方法。
  2. 【請求項2】 リードフレームのリード上にスタビライ
    ザ/スペーサを選択的に形成させる装置であって、 複数のインデックスホールを有する少なくとも1つのリ
    ードフレームと、 上記少なくとも1つのリードフレーム及びリードフレー
    ムのストリップを保持し、導くインデックスピンを有す
    る取付具/ジグと、 上記少なくとも1つのリードフレーム上の選択された領
    域を露出させるマスクと、 上記少なくとも1つのリードフレーム上の選択された領
    域にスタビライザ/スペーサを付着させるプラズマトー
    チと、 を具備することを特徴とする装置。
JP5000698A 1992-01-07 1993-01-06 半導体装置用スタビライザ/スペーサ Pending JPH05343600A (ja)

Applications Claiming Priority (2)

Application Number Priority Date Filing Date Title
US07/817,712 US5268331A (en) 1992-01-07 1992-01-07 Stabilizer/spacer for semiconductor device lead frames
US07/817712 1992-01-07

Publications (1)

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JPH05343600A true JPH05343600A (ja) 1993-12-24

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ID=25223718

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JP5000698A Pending JPH05343600A (ja) 1992-01-07 1993-01-06 半導体装置用スタビライザ/スペーサ

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EP (1) EP0554563B1 (ja)
JP (1) JPH05343600A (ja)
KR (1) KR100287828B1 (ja)
CA (1) CA2086444A1 (ja)
DE (1) DE69226349T2 (ja)
TW (1) TW217466B (ja)

Families Citing this family (18)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5352633A (en) * 1992-06-02 1994-10-04 Texas Instruments Incorporated Semiconductor lead frame lead stabilization
US6613978B2 (en) * 1993-06-18 2003-09-02 Maxwell Technologies, Inc. Radiation shielding of three dimensional multi-chip modules
US5880403A (en) 1994-04-01 1999-03-09 Space Electronics, Inc. Radiation shielding of three dimensional multi-chip modules
US6455864B1 (en) 1994-04-01 2002-09-24 Maxwell Electronic Components Group, Inc. Methods and compositions for ionizing radiation shielding
US6720493B1 (en) 1994-04-01 2004-04-13 Space Electronics, Inc. Radiation shielding of integrated circuits and multi-chip modules in ceramic and metal packages
US6261508B1 (en) 1994-04-01 2001-07-17 Maxwell Electronic Components Group, Inc. Method for making a shielding composition
JP2933554B2 (ja) * 1996-11-28 1999-08-16 九州日本電気株式会社 半導体装置およびその製造方法
US6687980B1 (en) 1997-03-04 2004-02-10 Tessera, Inc. Apparatus for processing flexible tape for microelectronic assemblies
US6049972A (en) 1997-03-04 2000-04-18 Tessera, Inc. Universal unit strip/carrier frame assembly and methods
US6535393B2 (en) * 1998-12-04 2003-03-18 Micron Technology, Inc. Electrical device allowing for increased device densities
US7135335B2 (en) * 1999-05-28 2006-11-14 Stemcell Technologies Inc. Method for separating cells using immunorosettes
US6368899B1 (en) * 2000-03-08 2002-04-09 Maxwell Electronic Components Group, Inc. Electronic device packaging
EP1228836B1 (en) * 2001-02-06 2007-02-07 Yamazaki Mazak Kabushiki Kaisha Method of producing a jig for three dimensional linear cutting machining
US7382043B2 (en) * 2002-09-25 2008-06-03 Maxwell Technologies, Inc. Method and apparatus for shielding an integrated circuit from radiation
US7191516B2 (en) * 2003-07-16 2007-03-20 Maxwell Technologies, Inc. Method for shielding integrated circuit devices
KR100830574B1 (ko) * 2006-09-21 2008-05-21 삼성전자주식회사 반도체 소자 패키지
US9123712B1 (en) 2013-07-24 2015-09-01 Stats Chippac Ltd. Leadframe system with warp control mechanism and method of manufacture thereof
FR3089749B1 (fr) * 2018-12-05 2020-11-27 Valeo Equip Electr Moteur Module électronique

Family Cites Families (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US4320251A (en) * 1980-07-28 1982-03-16 Solamat Inc. Ohmic contacts for solar cells by arc plasma spraying
US5087962A (en) * 1991-02-25 1992-02-11 Motorola Inc. Insulated lead frame using plasma sprayed dielectric

Also Published As

Publication number Publication date
EP0554563B1 (en) 1998-07-22
KR930017161A (ko) 1993-08-30
EP0554563A1 (en) 1993-08-11
US5268331A (en) 1993-12-07
TW217466B (ja) 1993-12-11
DE69226349D1 (de) 1998-08-27
KR100287828B1 (ko) 2001-04-16
DE69226349T2 (de) 1999-02-04
CA2086444A1 (en) 1993-07-08

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