JPH0535667A - サイクリツクデータ送出装置 - Google Patents
サイクリツクデータ送出装置Info
- Publication number
- JPH0535667A JPH0535667A JP21475491A JP21475491A JPH0535667A JP H0535667 A JPH0535667 A JP H0535667A JP 21475491 A JP21475491 A JP 21475491A JP 21475491 A JP21475491 A JP 21475491A JP H0535667 A JPH0535667 A JP H0535667A
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- Pending
Links
- 125000004122 cyclic group Chemical group 0.000 title claims abstract description 5
- 239000000872 buffer Substances 0.000 claims abstract description 30
- 230000005540 biological transmission Effects 0.000 claims description 42
- 101100328887 Caenorhabditis elegans col-34 gene Proteins 0.000 description 4
- 238000010586 diagram Methods 0.000 description 3
- 238000000034 method Methods 0.000 description 3
- 101150065817 ROM2 gene Proteins 0.000 description 1
- RRLHMJHRFMHVNM-BQVXCWBNSA-N [(2s,3r,6r)-6-[5-[5-hydroxy-3-(4-hydroxyphenyl)-4-oxochromen-7-yl]oxypentoxy]-2-methyl-3,6-dihydro-2h-pyran-3-yl] acetate Chemical compound C1=C[C@@H](OC(C)=O)[C@H](C)O[C@H]1OCCCCCOC1=CC(O)=C2C(=O)C(C=3C=CC(O)=CC=3)=COC2=C1 RRLHMJHRFMHVNM-BQVXCWBNSA-N 0.000 description 1
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- Information Transfer Systems (AREA)
Abstract
(57)【要約】
【目的】 データ送信装置における、データ更新時での
データ送出断を防止する。 【構成】 ＣＰＵ３からのデータを送出する２系統の送
信データバッファ５Ａ，５Ｂを並列配置するとともに、
これら送信データバッファのいずれか一方を選択する切
替スイッチ６を設け、かつ切替スイッチは入出力部１へ
の更新入力に基づいてＲＡＭ４に収納されている従前の
データが更新処理された時点にＲＯＭ２の制御プログラ
ムに基づいて切替え動作されるように構成する。
データ送出断を防止する。 【構成】 ＣＰＵ３からのデータを送出する２系統の送
信データバッファ５Ａ，５Ｂを並列配置するとともに、
これら送信データバッファのいずれか一方を選択する切
替スイッチ６を設け、かつ切替スイッチは入出力部１へ
の更新入力に基づいてＲＡＭ４に収納されている従前の
データが更新処理された時点にＲＯＭ２の制御プログラ
ムに基づいて切替え動作されるように構成する。
Description
【０００１】
【産業上の利用分野】本発明はデータ送出装置に関し、
特に外部からの更新データ入力が無い限り同一データを
繰り返し送出するサイクリックデータ送出装置に関す
る。
特に外部からの更新データ入力が無い限り同一データを
繰り返し送出するサイクリックデータ送出装置に関す
る。
【０００２】
【従来の技術】従来のこの種のデータ送出装置は、図２
に示すように、入出力部１、ＲＯＭ２、ＣＰＵ３、ＲＡ
Ｍ４、送信データバッファ５とで構成される。入出力部
１は更新データが入力され、これをＣＰＵ３に出力す
る。ＣＰＵ３はＲＯＭ２に収納されている駆動プログラ
ムに基づいて入出力部１からの信号を処理し、ＲＡＭ４
から更新前のデータを取り出してこれを更新し、更新し
たデータを送信データバッファ５から送出させている。
入出力部１に更新データが入力されないときには、送信
データバッファ５からは、ＲＡＭ４に収納されたデータ
が繰り返し送出される。
に示すように、入出力部１、ＲＯＭ２、ＣＰＵ３、ＲＡ
Ｍ４、送信データバッファ５とで構成される。入出力部
１は更新データが入力され、これをＣＰＵ３に出力す
る。ＣＰＵ３はＲＯＭ２に収納されている駆動プログラ
ムに基づいて入出力部１からの信号を処理し、ＲＡＭ４
から更新前のデータを取り出してこれを更新し、更新し
たデータを送信データバッファ５から送出させている。
入出力部１に更新データが入力されないときには、送信
データバッファ５からは、ＲＡＭ４に収納されたデータ
が繰り返し送出される。
【０００３】
【発明が解決しようとする課題】このような従来のデー
タ送出装置では、入出力部１に更新データが入力された
ときに、ＣＰＵ３が信号の処理を行い、ＲＡＭ４の更新
前のデータを更新して送信データバッファ５にまでデー
タを転送する間は、送信データバッファ５からのデータ
の送出が停止されることになる。このため、この間、デ
ータの送出が断されることになり、このようなデータ送
出断は、データの伝送速度が高速の場合には無視するこ
とができず、データ伝送上の問題となる。本発明の目的
は、データ更新時におけるデータ送出断を防止したデー
タ送出装置を提供することにある。
タ送出装置では、入出力部１に更新データが入力された
ときに、ＣＰＵ３が信号の処理を行い、ＲＡＭ４の更新
前のデータを更新して送信データバッファ５にまでデー
タを転送する間は、送信データバッファ５からのデータ
の送出が停止されることになる。このため、この間、デ
ータの送出が断されることになり、このようなデータ送
出断は、データの伝送速度が高速の場合には無視するこ
とができず、データ伝送上の問題となる。本発明の目的
は、データ更新時におけるデータ送出断を防止したデー
タ送出装置を提供することにある。
【０００４】
【課題を解決するための手段】本発明のデータ送出装置
は、データを送出する送信データバッファを２系統並列
配置するとともに、これら送信データバッファのいずれ
か一方を選択する切替スイッチを設けており、かつこの
切替スイッチは更新入力に基づいて従前のデータが更新
処理された時点で切替え動作されるように構成する。
は、データを送出する送信データバッファを２系統並列
配置するとともに、これら送信データバッファのいずれ
か一方を選択する切替スイッチを設けており、かつこの
切替スイッチは更新入力に基づいて従前のデータが更新
処理された時点で切替え動作されるように構成する。
【０００５】
【作用】本発明によれば、データが更新されるまでの間
は一方の送信データバッファにより従前のデータが送出
され、更新完了後に切替スイッチにより切替えられた他
方のデータバッファにより更新データが送出される。
は一方の送信データバッファにより従前のデータが送出
され、更新完了後に切替スイッチにより切替えられた他
方のデータバッファにより更新データが送出される。
【０００６】
【実施例】次に、本発明について図面を参照して説明す
る。図１は本発明の一実施例のブロック図であり、１は
入出力部、２はＲＯＭ、３はＣＰＵ、４はＲＡＭであ
る。そして、ＣＰＵ３には２つの送信データバッファ５
Ａ，５Ｂを並列に接続し、かつその後段に設けた切替ス
イッチ６により何れか一方の送信データバッファを選択
するように構成している。尚、この切替スイッチ６は、
ＲＯＭ２に収納されている制御プログラムに基づいてＣ
ＰＵ３が切替動作を制御するように構成されている。
る。図１は本発明の一実施例のブロック図であり、１は
入出力部、２はＲＯＭ、３はＣＰＵ、４はＲＡＭであ
る。そして、ＣＰＵ３には２つの送信データバッファ５
Ａ，５Ｂを並列に接続し、かつその後段に設けた切替ス
イッチ６により何れか一方の送信データバッファを選択
するように構成している。尚、この切替スイッチ６は、
ＲＯＭ２に収納されている制御プログラムに基づいてＣ
ＰＵ３が切替動作を制御するように構成されている。
【０００７】この構成において、例えば現在では、送信
データバッファ５Ａが切替スイッチ６により選択され、
送信データは送信データバッファ５Ａから出力されてい
るものとする。外部から更新データが入出力部１に入力
されると、この信号はＣＰＵ３に入力され、ＣＰＵ３で
はＲＯＭ２に収納した駆動プログラムによって信号を処
理する。そして、ＲＡＭ４から更新前のデータを取り出
し、このデータを処理された信号により更新し、これを
送信データバッファ５Ｂに出力する。このデータの更新
を待って、ＣＰＵ３はＲＯＭ２の制御プログラムに基づ
いて切替スイッチ６を送信データバッファ５Ｂ側に切り
替える。これにより、以後は更新されたデータが送信デ
ータバッファ５Ｂを通して出力されることになる。以
後、更新が行われる毎に、切替スイッチ６によって送信
データバッファ５Ａ，５Ｂが交互に切替えられ、順次更
新データを送出することになる。
データバッファ５Ａが切替スイッチ６により選択され、
送信データは送信データバッファ５Ａから出力されてい
るものとする。外部から更新データが入出力部１に入力
されると、この信号はＣＰＵ３に入力され、ＣＰＵ３で
はＲＯＭ２に収納した駆動プログラムによって信号を処
理する。そして、ＲＡＭ４から更新前のデータを取り出
し、このデータを処理された信号により更新し、これを
送信データバッファ５Ｂに出力する。このデータの更新
を待って、ＣＰＵ３はＲＯＭ２の制御プログラムに基づ
いて切替スイッチ６を送信データバッファ５Ｂ側に切り
替える。これにより、以後は更新されたデータが送信デ
ータバッファ５Ｂを通して出力されることになる。以
後、更新が行われる毎に、切替スイッチ６によって送信
データバッファ５Ａ，５Ｂが交互に切替えられ、順次更
新データを送出することになる。
【０００８】したがって、このデータ送信装置では、更
新前データの更新処理が行われる間は、更新前のデータ
が一方の送信データバッファから継続して送出され、Ｃ
ＰＵ３における更新が完了された時点で始めて送信デー
タバッファが切り替えられ、更新データが送出されるこ
とになる。このため、更新時においてもデータの送出が
停止されることはなく、データの送出断が生じることが
ない。
新前データの更新処理が行われる間は、更新前のデータ
が一方の送信データバッファから継続して送出され、Ｃ
ＰＵ３における更新が完了された時点で始めて送信デー
タバッファが切り替えられ、更新データが送出されるこ
とになる。このため、更新時においてもデータの送出が
停止されることはなく、データの送出断が生じることが
ない。
【０００９】
【発明の効果】以上説明したように本発明は、データが
更新されるまでの間は一方の送信データバッファにより
従前のデータが送出され、更新完了後に切替スイッチに
より切替えられた他方のデータバッファにより更新デー
タが送出されるので、更新時においても継続してデータ
送出が行われることになり、データの送出断を防止する
ことができる効果がある。
更新されるまでの間は一方の送信データバッファにより
従前のデータが送出され、更新完了後に切替スイッチに
より切替えられた他方のデータバッファにより更新デー
タが送出されるので、更新時においても継続してデータ
送出が行われることになり、データの送出断を防止する
ことができる効果がある。
【図１】本発明のデータ送出装置の一実施例のブロック
図である。
図である。
【図２】従来のデータ送出装置のブロック図である。
１ 入出力部 ２ ＲＯＭ ３ ＣＰＵ ４ ＲＡＭ ５，５Ａ，５Ｂ 送信データバッファ ６ 切替スイッチ
Claims (1)
- 【特許請求の範囲】 【請求項１】 外部からの更新入力がない限り、従前の
データを送信データバッファを通して送出するサイクリ
ックデータ送出装置において、前記送信データバッファ
を２系統並列配置するとともに、これら送信データバッ
ファのいずれか一方を選択する切替スイッチを設け、こ
の切替スイッチは更新入力に基づいて従前のデータが更
新処理された時点で切替え動作されるように構成したこ
とを特徴とするサイクリックデータ送出装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP21475491A JPH0535667A (ja) | 1991-07-31 | 1991-07-31 | サイクリツクデータ送出装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP21475491A JPH0535667A (ja) | 1991-07-31 | 1991-07-31 | サイクリツクデータ送出装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0535667A true JPH0535667A (ja) | 1993-02-12 |
Family
ID=16661015
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP21475491A Pending JPH0535667A (ja) | 1991-07-31 | 1991-07-31 | サイクリツクデータ送出装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0535667A (ja) |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH01226065A (ja) * | 1988-03-07 | 1989-09-08 | Mitsubishi Electric Corp | マイクロプロセッサシステム |
-
1991
- 1991-07-31 JP JP21475491A patent/JPH0535667A/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH01226065A (ja) * | 1988-03-07 | 1989-09-08 | Mitsubishi Electric Corp | マイクロプロセッサシステム |
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