JPH0547832A - 半導体装置 - Google Patents

半導体装置

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JPH0547832A
JPH0547832A JP20072791A JP20072791A JPH0547832A JP H0547832 A JPH0547832 A JP H0547832A JP 20072791 A JP20072791 A JP 20072791A JP 20072791 A JP20072791 A JP 20072791A JP H0547832 A JPH0547832 A JP H0547832A
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JP
Japan
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semiconductor element
tape carrier
conductive particles
lead
semiconductor device
Prior art date
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Pending
Application number
JP20072791A
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English (en)
Inventor
Michiyoshi Takano
道義 高野
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Seiko Epson Corp
Original Assignee
Seiko Epson Corp
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Publication date
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Abstract

(57)【要約】 【目的】 本発明は、テープキャリアを用いた半導体装
置の構造に関わり、半導体装置の軽薄短小、品質向上を
目的とする。 【構成】 テープキャリアのインナーリードの先端に突
起を設け、該半導体素子のアルミ電極上ににNi、A
u、Sn−Pb等からなる導電粒子を塗布し、前記イン
ナーリードと該半導体素子の電極をNi、Au、Sn−
Pb等の導電粒子を介して接続した事を特徴とする半導
体装置。 【効果】 低重での接続、低温度での接続、接続時に樹
脂封止工程も兼ねるため、樹脂封止工程を別に行わなく
てよい。

Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】本発明は、テープキャリアを用い
た半導体装置に係わり、特にテープキャリアにおける実
装構造に関するものである。
【0002】
【従来の技術】半導体装置は、一般にリードフレームに
設けたダイパッドに半導体素子を取り付け、半導体チッ
プの外部電極とリードフレームの端子とをそれぞれワイ
ヤで接続し、これをエポキシ樹脂等の熱硬化樹脂でパッ
ケージした後、各端子を切断し製造している。
【0003】しかし最近では電子機器の小型化、薄型化
に伴い、これに使用する半導体装置も高密度実装を行う
為、リードを微細化した、薄くかつ小型の半導体装置の
出現が望まれている。このような要求に答えるべく、テ
ープキャリアのデバイスホールに半導体装置を配設し半
導体素子の電極とテープキャリアに設けたリードのイン
ナリードとを直接接続し、これに液状樹脂(例えば、エ
ポキシ樹脂)からなる封止剤を印刷あるいはポッティン
グ、トランスファしてパッケージした方式の半導体装置
が使用されるようになった。
【0004】図3は、テープキャリアを用いた従来の半
導体装置を説明する為の平面図である。図3において、
8は長さ方向に等間隔に、半導体素子6の表面積より大
きい面積のデバイスホール9が設けられた厚さ25〜1
25μm程度のテープキャリアである。10はテープキ
ャリア8に設けられた銅等の導電率の高い厚さ25〜3
5μm、幅30〜500μm程度の金属箔からなる多数
のリードで、その一部はデバイスホール9内に突出して
自由端となっており、インナリード11を形成してい
る。12はテープキャリア8を搬送する為のスプロケッ
ト穴である。6は半導体素子である。図4は図3のA−
A拡大断面図であり、13は半導体素子9上に設けられ
たAuの凸状電極、5は半導体素子6のアルミニウム配
線である。図5は、上記のようなテープキャリア8に半
導体素子6を取り付ける装置の一例を示す説明図で、半
導体素子台15上に搭載された半導体素子6は、位置決
めガイド16、16aにより所定の位置に位置決めされ
る。一方、スプロケットにより送られたテープキャリア
8は、そのデバイスホール9が半導体素子6上に達した
位置で停止し、半導体素子6に設けた多数の凸状電極1
3と、各リード10のインナリード11の先端とをそれ
ぞれ整合させる。ついで450度〜600度程度に加熱
されたボンディングツール17を下降させ各リード10
を50g/リード〜120g/リードで加圧し、所定の
角度にフォーミングして各インナリード11の先端をそ
れぞれ半導体素子6の各凸状電極13に融着させ、接続
する。次に、テープキャリア8を移動してそれぞれリー
ド10を切断し、または、スキージ印刷、ポッティン
グ、トランスファ等により半導体素子6及びリード10
の一部を液状の封止用樹脂で封止した後リード10を切
断して、半導体装置を製造する。
【0005】
【発明が解決しようとする課題】しかし、上記のような
従来の半導体装置においては、近年の半導体素子9の大
型化、インナーリード12のファインピッチ、多ピン化
の要求が強く、半導体素子は10mm×10mm程度、
インナーリードピッチは80μm以下、インナーリード
数は、500ピン以上のものが要求されている。
【0006】上記の様な大型化の半導体素子、多ピン、
ファインピッチなインナーリードを接続する際には、と
てつもない大加重が必要になると共に接続する半導体素
子とボンディングツールとの平行度数をμmに管理する
事が非常に難しくなる。
【0007】現実に大加重を加えた為に半導体素子のク
ラック(ひどい時には破壊)、半導体素子とボンディン
グツールの平行度が維持できない為、破壊試験時のイン
ナーリード剥離破壊、ボンディングツールの加熱、加圧
ムラによる接合強度のバラツキ等が発生し、高品質かつ
高信頼性の半導体装置を製造する事は極めて難しい。
【0008】
【課題を解決するための手段】本発明の半導体装置は、
テープキャリアのインナーリードの先端に突起設け、該
半導体素子のアルミ電極上にNi、Au、Sn−Pb等
からなる粒子を塗布し、前記インナーリードと該半導体
素子の電極をNi、Au、Sn−Pb等の導電粒子を介
して接続を行う。
【0009】
【作用】本発明の上記の構成によれば、テープキャリア
のインナーリードの先端に突起設け、該半導体素子のア
ルミ電極上にNi、Au、Sn−Pb等からなる導電粒
子を塗布し、前記インナーリードと該半導体素子の電極
をNi、Au、Sn−Pb粒子を介して接続する為、半
導体素子とインナーリードを接続する際の大加重、高温
なツール温度、半導体素子とボンディングツールの平行
度維持をシビアに行う必要がない。
【0010】
【実施例】図1は、本発明の一実施例を示す断面図であ
る。図において、1は先端に突起を設けたインナーリー
ド、2は前記インナーリードに例えばAuメッキを施し
たメッキ層、3は例えばNiメッキを施した直径6μm
程度の導電粒子、4は熱により硬化する樹脂、5は半導
体素子のアルミパッド電極、6は半導体素子である。
【0011】実装方法の一例を説明すると、熱硬化樹脂
4に導電粒子3を含有したものを半導体素子6上に塗布
する。次に前記、導電粒子3と熱硬化樹脂4を塗布した
半導体素子6の電極5と、先端に突起を設けたインナー
リード1とをそれぞれ整合させる。ボンディングツール
により、整合したインナーリード1と半導体素子6上に
塗布された導電粒子3とを、ボンディングツールにより
加熱、圧力し接続する。この時ボンディングツールに導
電粒子3と熱硬化樹脂4が付着する事を防ぐ為、ボンデ
ィングツールを下降させる前に例えば耐熱性のテフロン
シート等を敷く。
【0012】この時のボンデキング条件としては、導電
粒子3は非常に低加圧でつぶれるため加重5g/リード
程度、ツール温度は熱硬化樹脂4が硬化する程度の20
0℃〜300℃の条件である。
【0013】図2は本発明のもう一つの実施例を示す断
面図である。この実施例は前記実施例で述べた4の熱硬
化樹脂の代わりに、紫外線硬化の樹脂を用いた例であ
る。他の構成は、図1に示す実施例と同じであるので、
同一符号を付して構成の説明を省略する。
【0014】この実施例では、前述したごとく熱硬化樹
脂4の代わりに紫外線硬化樹脂7を使用しており、実装
方法の一例を説明すると、紫外線硬化樹脂4に導電粒子
3を含有したものを半導体素子6上に塗布する。次に前
記、導電粒子3と紫外線硬化樹脂7を塗布した半導体素
子6の電極5と、先端に突起を設けたインナーリード1
とをそれぞれ整合させる。ボンディングツールにより、
整合したインナーリード1と半導体素子6上に塗布され
た導電粒子3とを、ボンディングツールにより加熱、圧
力し接続する。この時ボンディングツールに導電粒子3
と紫外線硬化樹脂7が付着する事を防ぐ為、ボンディン
グツールを下降させる前に例えば耐熱性のテフロンシー
ト等を敷く。接続が終了しボンディングツール上昇後
は、接合部に紫外線を照射し、紫外線硬化樹脂7を硬化
させる。
【0015】この時のボンデキング条件としては、導電
粒子3は非常に低加圧でつぶれるため加重5g/リード
程度、ボンディングツールの温度は無しでもかまわない
が、紫外線硬化樹脂7の粘土を和らげる為、100℃程
度のツール温度を加える。
【0016】
【発明の効果】本発明は以上説明したように、テープキ
ャリアのインナーリードの先端に突起設け、該半導体素
子のアルミ電極上にNi、Au、Sn−Pb等からなる
導電粒子を塗布し、前記インナーリードと該半導体素子
の電極をNi、Au、Sn−Pb等の導電粒子を介して
接続を行う為、従来技術での半導体素子とインナーリー
ドを接続する為の加重50g/リード〜120g/程度
を5g/リードに低減する事ができる為、大加重による
半導体素子の破壊を防ぐ事ができる。また、導電粒子は
前述のごとく非常に低加重でつぶれる為、半導体素子と
ボンディングツールの平行度管理をシビアに行う必要が
なく、半導体素子の大型化に適している。ボンディング
ツールの温度は、熱硬化樹脂を使用した場合200℃〜
300℃、紫外線硬化樹脂を使用した場合は100℃程
度に抑える事ができる為、半導体素子に余分な熱を加え
ずに接続を行える為、信頼性の高い半導体装置の製造が
可能である。
【0017】半導体素子と先端に突起を設けたインナー
リードを接続する際、一実施例で示した熱硬化樹脂、も
う一つの実施例で示した紫外線硬化樹脂は接続後即座に
硬化する為、半導体素子を保護する役目をも行い、従来
技術で接続後に別工程で行っていた樹脂による半導体素
子の保護工程を行わずにすむ。
【図面の簡単な説明】
【図1】 本発明の一実施例を示す断面図。
【図2】 本発明のもう一つの実施例を示す断面図。
【図3】 テープキャリアを用いた従来の半導体装置を
説明する為の平面図。
【図4】 図3のA−A拡大断面図。
【図5】 従来技術を示す説明図。
【符号の説明】
1 先端に突起を設けたインナーリード 2 Auメッキ層 3 導電粒子 4 熱硬化樹脂 5 半導体素子電極、アルミパッド 6 半導体素子 7 紫外線硬化樹脂 8 テープキャリア 9 デバイスホール 10 リード 11 インナーリード 12 スプロケット 13 Auの凸状電極 14 Snメッキ層 15 半導体素子台 16 位置決めガイド 16a位置決めガイド 17 ボンディングツール

Claims (1)

    【特許請求の範囲】
  1. 【請求項1】テープキャリアに半導体素子を配設し、該
    半導体素子に設けた多数の電極に、前記テープキャリア
    に設けられたリードのインナーリードの先端を圧熱融着
    によりそれぞれ接続し、しかる後に前記テープキャリア
    のリード部の一部を切断し、または前記半導体素子及び
    リードの一部を樹脂等で封止した後に該リードを切断し
    てなる半導体装置において、 前記テープキャリアのインナーリードの先端に突起を設
    け、該半導体素子のアルミ電極上ににNi、Au、Sn
    −Pb等からなる導電粒子を塗布し、前記インナーリー
    ドと該半導体素子の電極をNi、Au、Sn−Pb等の
    導電粒子を介して接続した事を特徴とする半導体装置。
JP20072791A 1991-08-09 1991-08-09 半導体装置 Pending JPH0547832A (ja)

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JP20072791A JPH0547832A (ja) 1991-08-09 1991-08-09 半導体装置

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JP20072791A JPH0547832A (ja) 1991-08-09 1991-08-09 半導体装置

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JPH0547832A true JPH0547832A (ja) 1993-02-26

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JP20072791A Pending JPH0547832A (ja) 1991-08-09 1991-08-09 半導体装置

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