JPH0575800A - 光書き込み制御装置 - Google Patents
光書き込み制御装置Info
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- JPH0575800A JPH0575800A JP3233146A JP23314691A JPH0575800A JP H0575800 A JPH0575800 A JP H0575800A JP 3233146 A JP3233146 A JP 3233146A JP 23314691 A JP23314691 A JP 23314691A JP H0575800 A JPH0575800 A JP H0575800A
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Abstract
(57)【要約】 （修正有）
【目的】 画素密度を変更しても、容易に主走査方向の
画像書き出し位置(横レジスト)を変化させて位置ずれの
ない光書き込み制御装置を提供する。 【構成】 ポリゴンミラーの回転速度を変更して画素密
度を変えるレーザプリンタにおいて、画素密度ごとに分
周比が可変な第１、第２の分周回路30，31と、第１の分
周回路30の出力と主走査書き込み同期信号ＬＳＹＮＣの
位相を一定にした画素周波数ＷＣＬＫを出力する第１の
位相制御回路32と、第２の分周回路31の出力と主走査方
向の同期検知信号ＤＥＴＰの位相を一定にした主走査制
御用の専用基本クロックＬＣＬＫを出力する第２の位相
制御回路33と、前記ＤＥＴＰが入力されたとき前記クロ
ックＬＣＬＫをカウントし、主走査書き込み同期信号Ｌ
ＳＹＮＣの発生タイミングを制御する主走査制御回路28
と、主走査制御回路及び第１、第２の分周回路の動作を
制御する中央処理装置ＣＰＵ29とを有する。
画像書き出し位置(横レジスト)を変化させて位置ずれの
ない光書き込み制御装置を提供する。 【構成】 ポリゴンミラーの回転速度を変更して画素密
度を変えるレーザプリンタにおいて、画素密度ごとに分
周比が可変な第１、第２の分周回路30，31と、第１の分
周回路30の出力と主走査書き込み同期信号ＬＳＹＮＣの
位相を一定にした画素周波数ＷＣＬＫを出力する第１の
位相制御回路32と、第２の分周回路31の出力と主走査方
向の同期検知信号ＤＥＴＰの位相を一定にした主走査制
御用の専用基本クロックＬＣＬＫを出力する第２の位相
制御回路33と、前記ＤＥＴＰが入力されたとき前記クロ
ックＬＣＬＫをカウントし、主走査書き込み同期信号Ｌ
ＳＹＮＣの発生タイミングを制御する主走査制御回路28
と、主走査制御回路及び第１、第２の分周回路の動作を
制御する中央処理装置ＣＰＵ29とを有する。
Description
【０００１】
【産業上の利用分野】本発明は、電子写真プロセス方式
を用いたレーザプリンタ，複写機等の光書き込み制御装
置に関し、特に画素密度を可変としたときの主走査書き
込み同期信号の発生タイミングの調整制御に係る。
を用いたレーザプリンタ，複写機等の光書き込み制御装
置に関し、特に画素密度を可変としたときの主走査書き
込み同期信号の発生タイミングの調整制御に係る。
【０００２】
【従来の技術】レーザプリンタは、マトリクス状に配列
される多数の画素により画像形成されるプリンタ装置で
あり、情報に応じてオンオフするように変調された走査
レーザ光により感光体ドラム上に画素による潜像を形成
し、トナー現像によって可視像を得て普通紙に転写した
後これを定着するようにしたものである。
される多数の画素により画像形成されるプリンタ装置で
あり、情報に応じてオンオフするように変調された走査
レーザ光により感光体ドラム上に画素による潜像を形成
し、トナー現像によって可視像を得て普通紙に転写した
後これを定着するようにしたものである。
【０００３】レーザプリンタは、レーザ光の高速変調が
可能であるため、高速且つ高品位の印字やグラフィック
記録が実現でき、このため、コンピュータを使用した各
種データ処理システムや画像作成システムの出力装置と
して、広い用途を有している。
可能であるため、高速且つ高品位の印字やグラフィック
記録が実現でき、このため、コンピュータを使用した各
種データ処理システムや画像作成システムの出力装置と
して、広い用途を有している。
【０００４】図３はレーザプリンタの概略構成を示す一
例図である。このレーザプリンタは、本体10，第２給紙
部２，第３給紙部３，両面機５から構成されている。本
体10にはスタンダード給紙部１と手差し給紙部４，及び
排紙トレイ６が装着されている。太線で搬送経路11が示
してある。例えば、スタンダード給紙部１から給紙され
た紙は、レジスト部７まで搬送されて、レジストローラ
につきあてられて紙のスキュー(傾き)が補正される。紙
は感光体８の方へ搬送されて感光体上に現像されたトナ
ーが転写され定着部９で紙にトナーが定着される。
例図である。このレーザプリンタは、本体10，第２給紙
部２，第３給紙部３，両面機５から構成されている。本
体10にはスタンダード給紙部１と手差し給紙部４，及び
排紙トレイ６が装着されている。太線で搬送経路11が示
してある。例えば、スタンダード給紙部１から給紙され
た紙は、レジスト部７まで搬送されて、レジストローラ
につきあてられて紙のスキュー(傾き)が補正される。紙
は感光体８の方へ搬送されて感光体上に現像されたトナ
ーが転写され定着部９で紙にトナーが定着される。
【０００５】こうして片面のプリントの終わった紙は両
面機５に入り、搬送方向を反転(スイッチバック)して再
び本体に給紙されレジスト部７に達する。この時、また
紙のスキューが補正される。感光体上のトナーは転写さ
れる面が前回と逆になり裏面に転写される。転写された
紙は定着部９で定着されて、排紙トレー６上に排紙され
て両面のプリントが終了する。
面機５に入り、搬送方向を反転(スイッチバック)して再
び本体に給紙されレジスト部７に達する。この時、また
紙のスキューが補正される。感光体上のトナーは転写さ
れる面が前回と逆になり裏面に転写される。転写された
紙は定着部９で定着されて、排紙トレー６上に排紙され
て両面のプリントが終了する。
【０００６】図４は上記図３に示すレーザプリンタの光
書き込み部の一例を示す概要図である。この光書き込み
部の動作はレーザダイオード(ＬＤ)12から出射されたレ
ーザ光がコリメートレンズ13によって平行光になる。次
に形成するドット(画素密度ＤＰＩ)の大きさに応じたス
リット部をもつアパーチャ14により余分なレーザ光がカ
ットされる。
書き込み部の一例を示す概要図である。この光書き込み
部の動作はレーザダイオード(ＬＤ)12から出射されたレ
ーザ光がコリメートレンズ13によって平行光になる。次
に形成するドット(画素密度ＤＰＩ)の大きさに応じたス
リット部をもつアパーチャ14により余分なレーザ光がカ
ットされる。
【０００７】シリンダレンズ＃115により主走査の画像
形成レーザ光が感光体８上で所定の大きさになるように
集光され、ポリゴンモータ16で回転されるポリゴンミラ
ー17で主走査方向(感光体８の長軸方向)ｘに走査され
る。そして、一対のＦθレンズ18により等角運動を等速
運動にし、また像面湾曲を補正する。
形成レーザ光が感光体８上で所定の大きさになるように
集光され、ポリゴンモータ16で回転されるポリゴンミラ
ー17で主走査方向(感光体８の長軸方向)ｘに走査され
る。そして、一対のＦθレンズ18により等角運動を等速
運動にし、また像面湾曲を補正する。
【０００８】次にミラー＃219により角度を変えてシリ
ンダレンズ＃220により副走査方向(感光体の回転方向)
ｙの集光を行ない、感光体８上に照射する。
ンダレンズ＃220により副走査方向(感光体の回転方向)
ｙの集光を行ない、感光体８上に照射する。
【０００９】ここで、同期検知用のレーザ光は、ポリゴ
ンミラー17で反射した後、ミラー＃321，シリンダレン
ズ＃322を経て光ファイバー23に入った後、エンジンド
ライブボード上のフォトダイオード(ＰＤ)24で検知さ
れ、主走査方向の同期検知信号ＤＥＴＰを得て、１走査
ごとに画像形成用レーザ光の発光開始タイミングを制御
する。
ンミラー17で反射した後、ミラー＃321，シリンダレン
ズ＃322を経て光ファイバー23に入った後、エンジンド
ライブボード上のフォトダイオード(ＰＤ)24で検知さ
れ、主走査方向の同期検知信号ＤＥＴＰを得て、１走査
ごとに画像形成用レーザ光の発光開始タイミングを制御
する。
【００１０】ところで、ホストコンピュータから出力さ
れる画像信号の画素密度ＤＰＩは種々異なったものがあ
り、これらの出力を受けて正常な画像をプリントするに
は、レーザプリンタの画素密度をこれらに合わせて可変
とする必要がある。また、同一の画素構成のキャラクタ
ージェネレータを用いて印字の大きさを変えるために
も、レーザプリンタの画素密度を可変することが必要で
ある。
れる画像信号の画素密度ＤＰＩは種々異なったものがあ
り、これらの出力を受けて正常な画像をプリントするに
は、レーザプリンタの画素密度をこれらに合わせて可変
とする必要がある。また、同一の画素構成のキャラクタ
ージェネレータを用いて印字の大きさを変えるために
も、レーザプリンタの画素密度を可変することが必要で
ある。
【００１１】画素密度を可変にすることのできるレーザ
プリンタにおいては、式１に示す関係から感光体線速
ｖ，ポリゴンミラー回転速度Ｒｍ，画素周波数(クロッ
ク)Ｗの少なくとも２つを変化させなくてはならない。
プリンタにおいては、式１に示す関係から感光体線速
ｖ，ポリゴンミラー回転速度Ｒｍ，画素周波数(クロッ
ク)Ｗの少なくとも２つを変化させなくてはならない。
【００１２】
【数１】
【００１３】図５は上記画素密度を可変としたときの従
来の光書き込み制御回路の一例を示し、これは主走査書
き込み同期信号ＬＳＹＮＣの発生タイミングを制御する
ものである。
来の光書き込み制御回路の一例を示し、これは主走査書
き込み同期信号ＬＳＹＮＣの発生タイミングを制御する
ものである。
【００１４】図５において、25は基準周波数発振器(Ｏ
ＳＣ)、26は基準周波数の分周回路、27は主走査方向の
同期検知信号ＤＥＴＰの位相と一定な関係とする画素周
波数ＷＣＬＫを出力する位相制御回路、28は上記主走査
方向の同期検知信号ＤＥＴＰの位相と一定な関係とする
主走査書き込み同期信号ＬＳＹＮＣを出力する主走査制
御回路、29は上記分周回路26及び主走査制御回路28の動
作を制御する中央処理装置(ＣＰＵ)である。
ＳＣ)、26は基準周波数の分周回路、27は主走査方向の
同期検知信号ＤＥＴＰの位相と一定な関係とする画素周
波数ＷＣＬＫを出力する位相制御回路、28は上記主走査
方向の同期検知信号ＤＥＴＰの位相と一定な関係とする
主走査書き込み同期信号ＬＳＹＮＣを出力する主走査制
御回路、29は上記分周回路26及び主走査制御回路28の動
作を制御する中央処理装置(ＣＰＵ)である。
【００１５】これは、水晶発振器でなる基準周波数発振
器25からの基本周波数ＷＣＬＫ０(図６のタイミングチ
ャート参照、以下同じ)を、分周回路26で分周して主走
査書き込みの基本となる画素周波数ＷＣＬＫを発生させ
る。この画素周波数ＷＣＬＫは、ＣＰＵ29により画素密
度ＤＰＩごとに分周回路26の分周比を可変としている。
器25からの基本周波数ＷＣＬＫ０(図６のタイミングチ
ャート参照、以下同じ)を、分周回路26で分周して主走
査書き込みの基本となる画素周波数ＷＣＬＫを発生させ
る。この画素周波数ＷＣＬＫは、ＣＰＵ29により画素密
度ＤＰＩごとに分周回路26の分周比を可変としている。
【００１６】そして、前記図４で述べたポリゴンミラー
17により走査しているレーザ光がフォトダイオード(Ｐ
Ｄ)24により検知され、主走査方向の同期検知信号ＤＥ
ＴＰとなり、このＤＥＴＰ信号が発光開始タイミングの
基準となる。ここで、上記画素周波数ＷＣＬＫと同期検
知信号ＤＥＴＰの位相を一定にするために位相制御回路
27で調整して正規の画素周波数ＷＣＬＫとなる。これに
ついて、以下、図７及び図８により説明する。
17により走査しているレーザ光がフォトダイオード(Ｐ
Ｄ)24により検知され、主走査方向の同期検知信号ＤＥ
ＴＰとなり、このＤＥＴＰ信号が発光開始タイミングの
基準となる。ここで、上記画素周波数ＷＣＬＫと同期検
知信号ＤＥＴＰの位相を一定にするために位相制御回路
27で調整して正規の画素周波数ＷＣＬＫとなる。これに
ついて、以下、図７及び図８により説明する。
【００１７】上記図５の位相制御回路27の一例を図７に
示し、そのタイミングチャートを図８に示す。ここで、
位相制御前の画像周波数ＷＣＬＫをＷＣＬＫ０とする
と、このＷＣＬＫ０が遅延回路27-1により順次、僅かに
遅延されたＷＣＬＫＡ，ＷＣＬＫＢ・・・が発生する。
これらの画素周波数を、タップセレクタ27-2に入力し、
主走査方向の同期検知信号ＤＥＴＰと近い位相、つま
り、図８の例では、ＤＥＴＰ信号の立上りと、ＷＣＬＫ
の立下りで、ＷＣＬＫを選択し、タップセレクタ27-2よ
り出力する。つまり、これが正規の画素周波数ＷＣＬＫ
となる。
示し、そのタイミングチャートを図８に示す。ここで、
位相制御前の画像周波数ＷＣＬＫをＷＣＬＫ０とする
と、このＷＣＬＫ０が遅延回路27-1により順次、僅かに
遅延されたＷＣＬＫＡ，ＷＣＬＫＢ・・・が発生する。
これらの画素周波数を、タップセレクタ27-2に入力し、
主走査方向の同期検知信号ＤＥＴＰと近い位相、つま
り、図８の例では、ＤＥＴＰ信号の立上りと、ＷＣＬＫ
の立下りで、ＷＣＬＫを選択し、タップセレクタ27-2よ
り出力する。つまり、これが正規の画素周波数ＷＣＬＫ
となる。
【００１８】さて、図５に戻り、主走査制御回路28では
主走査書き込み同期信号ＬＳＹＮＣを発生し、この信号
が実際の画像書き込み位置を制御する。即ち、上記同期
信号ＬＳＹＮＣは同期検知信号ＤＥＴＰが入力される
と、上記画素周波数ＷＣＬＫを主走査制御回路28でもっ
てカウントして発生タイミングを決めている。この発生
タイミングはＣＰＵ29よりカウント値を制御し、カウン
タを大きくしないため、図６に例示するようにＷＣＬＫ
を８分周した８ＷＣＬＫでカウントしている。
主走査書き込み同期信号ＬＳＹＮＣを発生し、この信号
が実際の画像書き込み位置を制御する。即ち、上記同期
信号ＬＳＹＮＣは同期検知信号ＤＥＴＰが入力される
と、上記画素周波数ＷＣＬＫを主走査制御回路28でもっ
てカウントして発生タイミングを決めている。この発生
タイミングはＣＰＵ29よりカウント値を制御し、カウン
タを大きくしないため、図６に例示するようにＷＣＬＫ
を８分周した８ＷＣＬＫでカウントしている。
【００１９】ここで、主走査方向の書き込み位置を変更
したい時には、同期信号ＬＳＹＮＣ発生のカウント値を
増減させることにより、同期信号ＬＳＹＮＣの発生タイ
ミングがずれ、画像の書き込み位置が移動することにな
る。
したい時には、同期信号ＬＳＹＮＣ発生のカウント値を
増減させることにより、同期信号ＬＳＹＮＣの発生タイ
ミングがずれ、画像の書き込み位置が移動することにな
る。
【００２０】
【表１】
【００２１】表１は、上記図６で説明した同期信号ＬＳ
ＹＮＣの発生タイミングを８ＷＣＬＫで制御して主走査
の横レジスト調整長さ(mm)を示す。この表１に示す例で
は画像密度ＤＰＩの切り換えは、240DPI，300DPI及び40
0DPIの３段階にした場合である。また、ポリゴンミラー
17によるレーザ光の走査速度ＶS(mm/sec)を、240DPIで
１ＶS，300DPIで1.25ＶS，400DPIで1.67ＶSとし、感光
体８の線速Ｖは一定としてある。
ＹＮＣの発生タイミングを８ＷＣＬＫで制御して主走査
の横レジスト調整長さ(mm)を示す。この表１に示す例で
は画像密度ＤＰＩの切り換えは、240DPI，300DPI及び40
0DPIの３段階にした場合である。また、ポリゴンミラー
17によるレーザ光の走査速度ＶS(mm/sec)を、240DPIで
１ＶS，300DPIで1.25ＶS，400DPIで1.67ＶSとし、感光
体８の線速Ｖは一定としてある。
【００２２】ここで、画素周波数ＷＣＬＫは、200DPIを
１MHzとしたとき、300DPIでは1.56MHz，400DPIでは2.78
MHzとなることは、画素密度ＤＰＩの２乗に比例してい
る。
１MHzとしたとき、300DPIでは1.56MHz，400DPIでは2.78
MHzとなることは、画素密度ＤＰＩの２乗に比例してい
る。
【００２３】表１からわかるように各画素密度ＤＰＩに
よってその調整段数では横レジスト調整長さが違ってお
り、高画素密度になるほど、横レジスト調整長さが小さ
くなる。
よってその調整段数では横レジスト調整長さが違ってお
り、高画素密度になるほど、横レジスト調整長さが小さ
くなる。
【００２４】
【発明が解決しようとする課題】上述したレーザプリン
タにおいて、図３に示すように感光体８上の正規の位置
に画像を書き込んでも各給紙部１〜３から給紙された紙
の位置がずれると用紙に転写される画像位置がずれてし
まい画像品質が悪化する。
タにおいて、図３に示すように感光体８上の正規の位置
に画像を書き込んでも各給紙部１〜３から給紙された紙
の位置がずれると用紙に転写される画像位置がずれてし
まい画像品質が悪化する。
【００２５】そこで、従来は給紙部の位置合わせや、両
面機５の位置合わせを高精度に調整していたが、給紙部
が複数箇所あったり、両面機があると、その調整箇所が
多く複雑になり調整時間も長くなり、レーザプリンタの
コストアップの要因となる。
面機５の位置合わせを高精度に調整していたが、給紙部
が複数箇所あったり、両面機があると、その調整箇所が
多く複雑になり調整時間も長くなり、レーザプリンタの
コストアップの要因となる。
【００２６】また、画素密度を可変としたときの従来の
光書き込み制御回路(図５)の場合、主走査方向の同期検
知信号ＤＥＴＰを検知してから画像を書き込むまでの時
間を、画素周波数ＷＣＬＫを主走査制御回路28がカウン
トすることによって、主走査方向の画像書き出し位置
(横レジスト)を変化させて位置ずれを補正しているが、
画素密度ＤＰＩを可変としたレーザプリンタにおいて
は、画素密度に応じて補正を行なうための単位時間が変
化するため、画素密度に応じて横レジストの調整が表１
に示すように必要になってしまい、これはまた調整時間
が長くなり、レーザプリンタのコストアップの要因とな
る。
光書き込み制御回路(図５)の場合、主走査方向の同期検
知信号ＤＥＴＰを検知してから画像を書き込むまでの時
間を、画素周波数ＷＣＬＫを主走査制御回路28がカウン
トすることによって、主走査方向の画像書き出し位置
(横レジスト)を変化させて位置ずれを補正しているが、
画素密度ＤＰＩを可変としたレーザプリンタにおいて
は、画素密度に応じて補正を行なうための単位時間が変
化するため、画素密度に応じて横レジストの調整が表１
に示すように必要になってしまい、これはまた調整時間
が長くなり、レーザプリンタのコストアップの要因とな
る。
【００２７】また、表１で説明したように画素密度ＤＰ
Ｉによってその調整段数では横レジスト調整長さが異な
り、しかも高画素密度ほど横レジスト調整長さが小さく
なり、調整が困難で、かつ、時間が長くなるという問題
があった。
Ｉによってその調整段数では横レジスト調整長さが異な
り、しかも高画素密度ほど横レジスト調整長さが小さく
なり、調整が困難で、かつ、時間が長くなるという問題
があった。
【００２８】本発明は、このような事情に鑑み、画素密
度を可変とするレーザプリンタにおいて、画素密度の変
更があっても、容易に主走査方向の画像書き出し位置
(横レジスト)を変化させて位置ずれのない光書き込み制
御装置を提供することを目的とする。
度を可変とするレーザプリンタにおいて、画素密度の変
更があっても、容易に主走査方向の画像書き出し位置
(横レジスト)を変化させて位置ずれのない光書き込み制
御装置を提供することを目的とする。
【００２９】
【課題を解決するための手段】本発明は、レーザ光を走
査させて感光体上に照射すると共にポリゴンミラーの回
転速度を変更して画素密度を可変としたレーザプリンタ
において、基準周波数を画素密度ごとに分周比を可変と
する第１及び第２の分周回路と、該第１の分周回路の出
力と主走査書き込み同期信号ＬＳＹＮＣの位相を一定な
らしめた画素周波数ＷＣＬＫを出力する第１の位相制御
回路と、前記第２の分周回路の出力と主走査方向の同期
検知信号ＤＥＴＰの位相を一定ならしめた主走査制御用
の専用基本クロックＬＣＬＫを出力する第２の位相制御
回路と、前記主走査方向の同期検知信号ＤＥＴＰが入力
されたとき前記主走査制御用の専用基本クロックＬＣＬ
Ｋをカウントし前記主走査書き込み同期信号ＬＳＹＮＣ
の発生タイミングを制御する主走査制御回路と、該主走
査制御回路並びに前記第１及び第２の分周回路の動作を
制御する中央処理装置ＣＰＵとを有することを特徴とす
る。
査させて感光体上に照射すると共にポリゴンミラーの回
転速度を変更して画素密度を可変としたレーザプリンタ
において、基準周波数を画素密度ごとに分周比を可変と
する第１及び第２の分周回路と、該第１の分周回路の出
力と主走査書き込み同期信号ＬＳＹＮＣの位相を一定な
らしめた画素周波数ＷＣＬＫを出力する第１の位相制御
回路と、前記第２の分周回路の出力と主走査方向の同期
検知信号ＤＥＴＰの位相を一定ならしめた主走査制御用
の専用基本クロックＬＣＬＫを出力する第２の位相制御
回路と、前記主走査方向の同期検知信号ＤＥＴＰが入力
されたとき前記主走査制御用の専用基本クロックＬＣＬ
Ｋをカウントし前記主走査書き込み同期信号ＬＳＹＮＣ
の発生タイミングを制御する主走査制御回路と、該主走
査制御回路並びに前記第１及び第２の分周回路の動作を
制御する中央処理装置ＣＰＵとを有することを特徴とす
る。
【００３０】
【作用】本発明によれば、レーザ光の走査速度に比例し
た主走査制御用の専用基本クロックを用いることによ
り、画素密度の変更があっても同一のカウント制御で主
走査のタイミングを制御でき、書き込み位置の精度の向
上、同じ書き込み位置とすることができる。
た主走査制御用の専用基本クロックを用いることによ
り、画素密度の変更があっても同一のカウント制御で主
走査のタイミングを制御でき、書き込み位置の精度の向
上、同じ書き込み位置とすることができる。
【００３１】
【実施例】図１は、本発明の一実施例における光書き込
み制御回路を示し、図２は図１の動作を説明するための
タイミングチャートである。
み制御回路を示し、図２は図１の動作を説明するための
タイミングチャートである。
【００３２】図１において、30は第１の分周回路、31は
第２の分周回路、32は第１の各相制御回路、33は第２の
位相制御回路であり、前記図５と同様の、基準周波発振
器(ＯＳＣ)25、主走査制御回路28及び中央処理装置(Ｃ
ＰＵ)29を備える。
第２の分周回路、32は第１の各相制御回路、33は第２の
位相制御回路であり、前記図５と同様の、基準周波発振
器(ＯＳＣ)25、主走査制御回路28及び中央処理装置(Ｃ
ＰＵ)29を備える。
【００３３】本発明の実施例は主走査制御用の専用基本
クロックＬＣＬＫを発生していることを特徴とする。ま
ず、基準周波数発振器25の基準周波数ＷＣＬＫ０を、画
素密度ＤＰＩごとに分周比を可変させるＣＰＵ29の制御
によって、第１の分周回路30で画素周波数ＷＣＬＫを発
生させる。この画素周波数ＷＣＬＫは主走査書き込み周
期信号ＬＳＹＮＣの位相と一定となるように第１の位相
制御回路32で位相を一定として正規の画素周波数ＷＣＬ
Ｋとする。
クロックＬＣＬＫを発生していることを特徴とする。ま
ず、基準周波数発振器25の基準周波数ＷＣＬＫ０を、画
素密度ＤＰＩごとに分周比を可変させるＣＰＵ29の制御
によって、第１の分周回路30で画素周波数ＷＣＬＫを発
生させる。この画素周波数ＷＣＬＫは主走査書き込み周
期信号ＬＳＹＮＣの位相と一定となるように第１の位相
制御回路32で位相を一定として正規の画素周波数ＷＣＬ
Ｋとする。
【００３４】一方、基準周波数発振器25の基準周波数Ｌ
ＣＬＫ０を第２の分周回路31で、画素密度ごとに分周比
を可変させるＣＰＵ29の制御によって主走査制御用の専
用基本クロックＬＣＬＫ０を発生させる。この専用クロ
ックＬＣＬＫ０と同期検知信号ＤＥＴＰの位相を一定に
するため第２の位相制御回路33で位相を一定とした正規
の主走査制御用の専用基本クロックＬＣＬＫを発生し主
走査制御回路28へ出力する。
ＣＬＫ０を第２の分周回路31で、画素密度ごとに分周比
を可変させるＣＰＵ29の制御によって主走査制御用の専
用基本クロックＬＣＬＫ０を発生させる。この専用クロ
ックＬＣＬＫ０と同期検知信号ＤＥＴＰの位相を一定に
するため第２の位相制御回路33で位相を一定とした正規
の主走査制御用の専用基本クロックＬＣＬＫを発生し主
走査制御回路28へ出力する。
【００３５】また、主走査制御回路28は主走査書き込み
同期信号ＬＳＹＮＣを発生するものであり、このＬＳＹ
ＮＣは同期検知信号ＤＥＴＰが主走査制御回路28に入力
されると、前記主走査制御用の専用基本クロックＬＣＬ
Ｋをカウントして、発生タイミングを決めている。この
発生タイミングはＣＰＵ29より上記カウント値を制御し
ている。
同期信号ＬＳＹＮＣを発生するものであり、このＬＳＹ
ＮＣは同期検知信号ＤＥＴＰが主走査制御回路28に入力
されると、前記主走査制御用の専用基本クロックＬＣＬ
Ｋをカウントして、発生タイミングを決めている。この
発生タイミングはＣＰＵ29より上記カウント値を制御し
ている。
【００３６】したがって、画像の主走査方向の書き込み
位置を変更したい時は、ＬＳＹＮＣ信号発生のカウント
値を増減させることにより、ＬＳＹＮＣ信号の発生タイ
ミングがずれ、画像の書き込み位置を移動することがで
きる。
位置を変更したい時は、ＬＳＹＮＣ信号発生のカウント
値を増減させることにより、ＬＳＹＮＣ信号の発生タイ
ミングがずれ、画像の書き込み位置を移動することがで
きる。
【００３７】本発明の実施例における主走査制御用の専
用基本クロックＬＣＬＫは、走査速度ＶS(mm/sec)、定
数ｋとして、ＶS／ｋ＝ＬＣＬＫを用いる。つまり、走
査速度が1.56倍になった場合は、ＬＣＬＫも1.5倍にな
り比例している。
用基本クロックＬＣＬＫは、走査速度ＶS(mm/sec)、定
数ｋとして、ＶS／ｋ＝ＬＣＬＫを用いる。つまり、走
査速度が1.56倍になった場合は、ＬＣＬＫも1.5倍にな
り比例している。
【００３８】
【表２】
【００３９】表２は、本実施例による横レジスト調整長
さを示し、前出の表１と同様に夫々画素密度ＤＰＩを３
段階(240，300，400)、走査速度ＶSを３段階(１，1.2
5，1.67)、画素周波数ＷＣＬＫ(MHz)を３段階(１，1.5
6，2.78)について示してある。
さを示し、前出の表１と同様に夫々画素密度ＤＰＩを３
段階(240，300，400)、走査速度ＶSを３段階(１，1.2
5，1.67)、画素周波数ＷＣＬＫ(MHz)を３段階(１，1.5
6，2.78)について示してある。
【００４０】いま、主走査制御用の専用基本クロックＬ
ＣＬＫの周波数をＶS／ｋとすると、図２に示すように
主走査書き込み周期信号ＬＳＹＮＣの発生タイミングを
上記ＬＣＬＫで制御しているので、主走査の横レジスト
調整は、画素密度に係らず一定の長さｋとなる。
ＣＬＫの周波数をＶS／ｋとすると、図２に示すように
主走査書き込み周期信号ＬＳＹＮＣの発生タイミングを
上記ＬＣＬＫで制御しているので、主走査の横レジスト
調整は、画素密度に係らず一定の長さｋとなる。
【００４１】これは、前出表１のように画素密度ＤＰＩ
によって調整段数で横レジスト調整長さが違ったり、高
画素密度になるほど、横レジスト調整長さが小さくなっ
たりしないので、調整が容易である。
によって調整段数で横レジスト調整長さが違ったり、高
画素密度になるほど、横レジスト調整長さが小さくなっ
たりしないので、調整が容易である。
【００４２】
【発明の効果】以上説明したように本発明の光書き込み
制御装置は、レーザ光の走査速度に比例した主走査制御
用の専用基本クロックを用いることにより、画素密度の
変更があっても、同一のカウント制御で主走査書き込み
同期信号の発生タイミングを制御でき、書き込み位置の
精度の向上、同じ書き込み位置とすることができる。
制御装置は、レーザ光の走査速度に比例した主走査制御
用の専用基本クロックを用いることにより、画素密度の
変更があっても、同一のカウント制御で主走査書き込み
同期信号の発生タイミングを制御でき、書き込み位置の
精度の向上、同じ書き込み位置とすることができる。
【図１】本発明の一実施例による光書き込み制御回路図
である。
である。
【図２】図１の動作を説明するタイミングチャートであ
る。
る。
【図３】本発明が実施される一例としてのレーザプリン
タの概略構成図である。
タの概略構成図である。
【図４】図３の光書き込み部の一例を示す概要図であ
る。
る。
【図５】従来の光書き込み制御回路の一例を示す図であ
る。
る。
【図６】図５の動作を説明するタイミングチャートであ
る。
る。
【図７】図５の位相制御回路の一例を示す図である。
【図８】図７の動作を説明するタイミングチャートであ
る。
る。
８…感光体、 17…ポリゴンミラー、 24…フォトダイ
オード(ＰＤ)、 25…基準周波数発振器(ＯＳＣ)、 28
…主走査制御回路、 29…中央処理装置(ＣＰＵ)、 30
…第１の分周回路、 31…第２の分周回路、 32…第１
の位相制御回路、33…第２の位相制御回路、 ＷＣＬＫ
…画素周波数、 ＬＣＬＫ…主走査制御用の専用基本ク
ロック、 ＤＥＴＰ…主走査方向の同期検知信号。
オード(ＰＤ)、 25…基準周波数発振器(ＯＳＣ)、 28
…主走査制御回路、 29…中央処理装置(ＣＰＵ)、 30
…第１の分周回路、 31…第２の分周回路、 32…第１
の位相制御回路、33…第２の位相制御回路、 ＷＣＬＫ
…画素周波数、 ＬＣＬＫ…主走査制御用の専用基本ク
ロック、 ＤＥＴＰ…主走査方向の同期検知信号。
フロントページの続き (51)Int.Cl.5 識別記号 庁内整理番号 ＦＩ 技術表示箇所 Ｈ０４Ｎ 1/23 １０３ Ｚ 9186−5Ｃ 1/387 １０１ 8839−5Ｃ
Claims (1)
- 【請求項１】 レーザ光を走査させて感光体上に照射す
ると共にポリゴンミラーの回転速度を変更して画素密度
を可変としたレーザプリンタにおいて、基準周波数を画
素密度ごとに分周比を可変とする第１及び第２の分周回
路と、該第１の分周回路の出力と主走査書き込み同期信
号ＬＳＹＮＣの位相を一定ならしめた画素周波数ＷＣＬ
Ｋを出力する第１の位相制御回路と、前記第２の分周回
路の出力と主走査方向の同期検知信号ＤＥＴＰの位相を
一定ならしめた主走査制御用の専用基本クロックＬＣＬ
Ｋを出力する第２の位相制御回路と、前記主走査方向の
同期検知信号ＤＥＴＰが入力されたとき前記主走査制御
用の専用基本クロックＬＣＬＫをカウントし前記主走査
書き込み同期信号ＬＳＹＮＣの発生タイミングを制御す
る主走査制御回路と、該主走査制御回路並びに前記第１
及び第２の分周回路の動作を制御する中央処理装置ＣＰ
Ｕとを有することを特徴とする光書き込み制御装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3233146A JPH0575800A (ja) | 1991-09-12 | 1991-09-12 | 光書き込み制御装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3233146A JPH0575800A (ja) | 1991-09-12 | 1991-09-12 | 光書き込み制御装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0575800A true JPH0575800A (ja) | 1993-03-26 |
Family
ID=16950446
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3233146A Pending JPH0575800A (ja) | 1991-09-12 | 1991-09-12 | 光書き込み制御装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0575800A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2015127108A (ja) * | 2013-12-27 | 2015-07-09 | 株式会社リコー | 画像クロック生成装置及び画像形成装置 |
| JP2018043392A (ja) * | 2016-09-13 | 2018-03-22 | コニカミノルタ株式会社 | 画像形成装置 |
-
1991
- 1991-09-12 JP JP3233146A patent/JPH0575800A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2015127108A (ja) * | 2013-12-27 | 2015-07-09 | 株式会社リコー | 画像クロック生成装置及び画像形成装置 |
| JP2018043392A (ja) * | 2016-09-13 | 2018-03-22 | コニカミノルタ株式会社 | 画像形成装置 |
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