JPH0578103B2 - - Google Patents
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- Publication number
- JPH0578103B2 JPH0578103B2 JP31481787A JP31481787A JPH0578103B2 JP H0578103 B2 JPH0578103 B2 JP H0578103B2 JP 31481787 A JP31481787 A JP 31481787A JP 31481787 A JP31481787 A JP 31481787A JP H0578103 B2 JPH0578103 B2 JP H0578103B2
- Authority
- JP
- Japan
- Prior art keywords
- disk
- memory
- channel
- data
- address
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Lifetime
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- Signal Processing For Digital Recording And Reproducing (AREA)
Description
【発明の詳細な説明】
〔産業上の利用分野〕
本発明はデイスクレコーダーに関するものであ
る。
る。
ハードデイスク装置を記憶媒体に使用し、ラン
ダムにアクセスするようにしたデイジタルデイス
クレコーダーでは、複数のチヤンネルの音声を録
音／再生しようとした時、デイスクの転送速度に
よつてチヤンネル数は制限を受ける。
ダムにアクセスするようにしたデイジタルデイス
クレコーダーでは、複数のチヤンネルの音声を録
音／再生しようとした時、デイスクの転送速度に
よつてチヤンネル数は制限を受ける。
それは再生あるいは録音する際、デイドタル化
された音声をデイスクから読む、または書く速度
が標本化する速度より遅いと、録音／再生を継続
させるのが不可能となる。
された音声をデイスクから読む、または書く速度
が標本化する速度より遅いと、録音／再生を継続
させるのが不可能となる。
例えば、標本化周波数50KHz、量子化ビツト数
16ビツトでデイジタル化した場合、データの量は
100Kバイト／秒となり、これが４チヤンネルあ
ると400Kバイト／秒の速度でデイスクに読み書
きしなければならない。第３図に従来の２チヤン
ネル装置を４チヤンネルに拡張した場合を説明す
ると、書くチヤンネルに２個のメモリーを有し書
き込み、読み出しを順次実行させる。仮にデイス
クの回転数を3482rpm、１トラツクの容量を
16384バイト、最大シーク時間50mS、一度に読み
書きするデータの量を32768バイト（２トラツク）
とするとこのデイスクをランダムにアクセスして
得られる転送速度は次の式によつて得られる。転
送速度Ｓは Ｓ＝32768／（３×Ｔ＋0.05） …ここでＴは１回転に要する時間でこの例で
は0.017秒である。
16ビツトでデイジタル化した場合、データの量は
100Kバイト／秒となり、これが４チヤンネルあ
ると400Kバイト／秒の速度でデイスクに読み書
きしなければならない。第３図に従来の２チヤン
ネル装置を４チヤンネルに拡張した場合を説明す
ると、書くチヤンネルに２個のメモリーを有し書
き込み、読み出しを順次実行させる。仮にデイス
クの回転数を3482rpm、１トラツクの容量を
16384バイト、最大シーク時間50mS、一度に読み
書きするデータの量を32768バイト（２トラツク）
とするとこのデイスクをランダムにアクセスして
得られる転送速度は次の式によつて得られる。転
送速度Ｓは Ｓ＝32768／（３×Ｔ＋0.05） …ここでＴは１回転に要する時間でこの例で
は0.017秒である。
なぜＴ×３なのかというとデータを読み出すた
めの２回転と、データを読み出しにかかつた時、
ヘツドがトラツクのどこにあるか分らない為、最
大１回転待つ必要があるからである。
めの２回転と、データを読み出しにかかつた時、
ヘツドがトラツクのどこにあるか分らない為、最
大１回転待つ必要があるからである。
こうしてＳ（転送速度）を求めると、約322Kバ
イト／秒となり、４チヤンネルの音声をとぎれず
に録音／再生することは不可能である。（場合に
よつては間に合わないことがある。） 〔発明が解決しようとする問題点〕 一度に読み書きするデータのブロツクをクラス
ターと呼ぶことにすると通常は２クラスター分の
メモリーをチヤンネル毎に設け、片側を再生中、
反対側にデイスクからデータを読込み、片側の再
生が終わるとメモリーを交換し、同様の動作を繰
返す。これでは前述のように転送速度が上げられ
ない。
イト／秒となり、４チヤンネルの音声をとぎれず
に録音／再生することは不可能である。（場合に
よつては間に合わないことがある。） 〔発明が解決しようとする問題点〕 一度に読み書きするデータのブロツクをクラス
ターと呼ぶことにすると通常は２クラスター分の
メモリーをチヤンネル毎に設け、片側を再生中、
反対側にデイスクからデータを読込み、片側の再
生が終わるとメモリーを交換し、同様の動作を繰
返す。これでは前述のように転送速度が上げられ
ない。
そこで３クラスター以上（３以上なら幾つでも
構わない）のメモリーを設け、次にデイスクをア
クセスする各チヤンネルのデータのアドレスを昇
順に並べ換え先にアクセスしたアドレスに近い順
に順次アクセスし、各チヤンネルのメモリーにメ
モリーしピツクアツプヘツドのシーク時間が最小
で済むようなアクセス順序でデイスク内のデータ
を読み出すようにするものである。
構わない）のメモリーを設け、次にデイスクをア
クセスする各チヤンネルのデータのアドレスを昇
順に並べ換え先にアクセスしたアドレスに近い順
に順次アクセスし、各チヤンネルのメモリーにメ
モリーしピツクアツプヘツドのシーク時間が最小
で済むようなアクセス順序でデイスク内のデータ
を読み出すようにするものである。
仮にメモリーの容量を３クラスターとして説明
すると再生の場合、第２図に示すように各チヤン
ネルはメモリーに１クラスターの空きができる毎
に、リクエストカウンターをインクリメントす
る。即ちリクエストカウンターの値はメモリー内
の空き領域の数となる。デイスクをアクセスする
ルーチンは常にリクエストカウンターを監視して
おり、どれかが２（残り１クラスター）となると
アドレスを昇順に並べ換えるために他のリクエス
トカウンターを調べ、OKでないチヤンネル（１
クラスター以上の空きがある）が要求しているデ
イスク内のアドレスを小さい順に並べ替える。先
にアクセスしたトラツクのアドレスが一番大きな
アドレスより一番小さなアドレスに近ければ小さ
い順に、そうでなければ大きい順にデイスクをア
クセスする。デイスクをアクセスしたチヤンネル
のリクエストカウンターはデイクリメントするよ
うにする。この様な方法でデイスクのアクセス順
序を制御すると、各回のアクセスに対して常に最
大のシーク時間を考慮する必要がなくなり、最悪
の状態でも最大シークは一回だけで残りは平均シ
ーク時間以下で済むための転送速度を上げること
ができる。
すると再生の場合、第２図に示すように各チヤン
ネルはメモリーに１クラスターの空きができる毎
に、リクエストカウンターをインクリメントす
る。即ちリクエストカウンターの値はメモリー内
の空き領域の数となる。デイスクをアクセスする
ルーチンは常にリクエストカウンターを監視して
おり、どれかが２（残り１クラスター）となると
アドレスを昇順に並べ換えるために他のリクエス
トカウンターを調べ、OKでないチヤンネル（１
クラスター以上の空きがある）が要求しているデ
イスク内のアドレスを小さい順に並べ替える。先
にアクセスしたトラツクのアドレスが一番大きな
アドレスより一番小さなアドレスに近ければ小さ
い順に、そうでなければ大きい順にデイスクをア
クセスする。デイスクをアクセスしたチヤンネル
のリクエストカウンターはデイクリメントするよ
うにする。この様な方法でデイスクのアクセス順
序を制御すると、各回のアクセスに対して常に最
大のシーク時間を考慮する必要がなくなり、最悪
の状態でも最大シークは一回だけで残りは平均シ
ーク時間以下で済むための転送速度を上げること
ができる。
Ｓ＝Ｃ×32768／（（３×Ｔ＋0.05）
＋（Ｃ−１）×（３×Ｔ＋0.023）） ……(1)
ここでＣはチヤンネル数，0.05は最大シーク
時間，0.023は平均シーク時間，Ｔは一回転
に要する時間である。
時間，0.023は平均シーク時間，Ｔは一回転
に要する時間である。
この方法で４チヤンネルを処理するものとする
と、転送速度は約402.8Kバイト／秒となり、４
チヤンネル分のデータを賄うことができる。
と、転送速度は約402.8Kバイト／秒となり、４
チヤンネル分のデータを賄うことができる。
本発明を図面により説明する。第１図は本発明
のデイスクレコーダーのブロツクダイヤグラムで
ある。これは外部記憶装置２にデイスク２ａを使
用したコンピユーター制御システム１にＡ／Ｄ，
Ｄ／Ａコンバータ３を加えたものである。
のデイスクレコーダーのブロツクダイヤグラムで
ある。これは外部記憶装置２にデイスク２ａを使
用したコンピユーター制御システム１にＡ／Ｄ，
Ｄ／Ａコンバータ３を加えたものである。
図は再生時のデータパスを示しているが録音時
はこの方向が逆になるだけでシーク処理自体は同
じである。
はこの方向が逆になるだけでシーク処理自体は同
じである。
Ｄ／Ａコンバータはサンプリング周波数に同期
してメモリー４の各チヤンネル（図の場合４チヤ
ンネル）のメモリー（Ａ，Ｂ，Ｃ）からデータを
読み出す。メモリー４は各チヤンネル３つのブロ
ツクからなつており、それらをＡ，Ｂ，Ｃと呼ぶ
とＤ／ＡコンバータがＡ，Ｂ，Ｃのメモリーブロ
ツクからデータを読みだしている間に、CPU１
ａはデイスクインターフエイス６を通してデイス
クから次に続くデータを次のメモリーブロツクに
読み込む準備をする。
してメモリー４の各チヤンネル（図の場合４チヤ
ンネル）のメモリー（Ａ，Ｂ，Ｃ）からデータを
読み出す。メモリー４は各チヤンネル３つのブロ
ツクからなつており、それらをＡ，Ｂ，Ｃと呼ぶ
とＤ／ＡコンバータがＡ，Ｂ，Ｃのメモリーブロ
ツクからデータを読みだしている間に、CPU１
ａはデイスクインターフエイス６を通してデイス
クから次に続くデータを次のメモリーブロツクに
読み込む準備をする。
この転送レートを上げ、４チヤンネルのランダ
ムアクセスを可能にするもので、まず、メモリー
４の３つのブロツクのメモリー（Ａ，Ｂ，Ｃ）
と、更にメモリーの幾つが空いているかを示すカ
ウンター５を設ける。このカウンター５はリセツ
ト時には３つまり空いているメモリー（Ａ，Ｂ，
Ｃ）の数に設定する。そして再生を始めるにあた
つて、デイスク２ａ１からデータを読む度にデイ
クリメントされ、Ｄ／Ａコンバータによつて１ブ
ロツク（１クラスターとも言う）読み出され、メ
モリー４をスイツチSnbで切り替える度にインク
リメントされる。
ムアクセスを可能にするもので、まず、メモリー
４の３つのブロツクのメモリー（Ａ，Ｂ，Ｃ）
と、更にメモリーの幾つが空いているかを示すカ
ウンター５を設ける。このカウンター５はリセツ
ト時には３つまり空いているメモリー（Ａ，Ｂ，
Ｃ）の数に設定する。そして再生を始めるにあた
つて、デイスク２ａ１からデータを読む度にデイ
クリメントされ、Ｄ／Ａコンバータによつて１ブ
ロツク（１クラスターとも言う）読み出され、メ
モリー４をスイツチSnbで切り替える度にインク
リメントされる。
従来の方法ではメモリーの片方が空いた時、デ
イスクから次のデータを読んでくるというだけの
もので、これをチヤンネル毎に独立して行なうの
ではなく、各チヤンネルのデータの量をカウンタ
ー５により監視しつつ同時に次に読み出すアドレ
スを昇順に並べておき、どれかカウンター５が２
以上になつた時、即ちどこかのチヤンネルのメモ
リー４が残り１つになつた時、アドレス順にまと
めてデイスク装置２ａのデイスク２ａ１から読み
出し（あるいは書き込み）動作を起こすようにす
る。
イスクから次のデータを読んでくるというだけの
もので、これをチヤンネル毎に独立して行なうの
ではなく、各チヤンネルのデータの量をカウンタ
ー５により監視しつつ同時に次に読み出すアドレ
スを昇順に並べておき、どれかカウンター５が２
以上になつた時、即ちどこかのチヤンネルのメモ
リー４が残り１つになつた時、アドレス順にまと
めてデイスク装置２ａのデイスク２ａ１から読み
出し（あるいは書き込み）動作を起こすようにす
る。
例えば各チヤンネルで再生するデイスクのアド
レスが次のようになつていたとすると、 CH1：１−２−３−４−５−６−７−８−９−
10 CH2：1000−1001−1002−1003−1004−1005 CH3：11−12−13−14−15−16−17−18 CH4：1006−1007−1008−1009−1010−1011 この様な音声を1CHから4CHの順に通常の各
チヤンネルの２つのメモリーで再生をすると、ア
クセスされるデイスクアドレスは次のようにな
る。
レスが次のようになつていたとすると、 CH1：１−２−３−４−５−６−７−８−９−
10 CH2：1000−1001−1002−1003−1004−1005 CH3：11−12−13−14−15−16−17−18 CH4：1006−1007−1008−1009−1010−1011 この様な音声を1CHから4CHの順に通常の各
チヤンネルの２つのメモリーで再生をすると、ア
クセスされるデイスクアドレスは次のようにな
る。
１，２，1000，1001，11，12，1006，1007，
３，1002， 13，1008，４，1003，14，1009…… この場合、読み書きする度に非常に遠い場所を
交互にシークしなければならないため、転送レー
トが上げられない。
３，1002， 13，1008，４，1003，14，1009…… この場合、読み書きする度に非常に遠い場所を
交互にシークしなければならないため、転送レー
トが上げられない。
これを読み書きの前に昇順に並べ換えてまとめ
てアクセスするようにすると、交互に遠い場所を
シークしないで済み、また先にアクセスしたアド
レスを記憶しておき、昇順に並べ換えたアドレス
の近い方から順にアクセスすればトータルのシー
クタイムを最少にすることができる。
てアクセスするようにすると、交互に遠い場所を
シークしないで済み、また先にアクセスしたアド
レスを記憶しておき、昇順に並べ換えたアドレス
の近い方から順にアクセスすればトータルのシー
クタイムを最少にすることができる。
上記の例で見れば次のようにアクセスされる。
１，２，３，1000，1001，1002，11，12，13，
1006，10 07，1008， ここまでは空きメモリー４に１チヤンネルから
順次読み込み、次に読むべきアドレスを並べる
と、４，1003，14，1009で、これを昇順に並べ換
え、４，14，1003，1009とし先にアクセスしたア
ドレスの1008と比べ、これに近い1009から大きい
順にアクセスし、1009，1003，14，４のデータを
メモリー４の４Ａ，２Ａ，３Ａ，１Ａに順に記憶
する。次は先にアクセスした４に近い方からデイ
スク２ａ１のデータを５，15，1004，1010のアド
レス順にアクセスしメモリー４の１Ｂ，３Ｂ，２
Ｂ，４Ｂに順にデータを記憶する。
1006，10 07，1008， ここまでは空きメモリー４に１チヤンネルから
順次読み込み、次に読むべきアドレスを並べる
と、４，1003，14，1009で、これを昇順に並べ換
え、４，14，1003，1009とし先にアクセスしたア
ドレスの1008と比べ、これに近い1009から大きい
順にアクセスし、1009，1003，14，４のデータを
メモリー４の４Ａ，２Ａ，３Ａ，１Ａに順に記憶
する。次は先にアクセスした４に近い方からデイ
スク２ａ１のデータを５，15，1004，1010のアド
レス順にアクセスしメモリー４の１Ｂ，３Ｂ，２
Ｂ，４Ｂに順にデータを記憶する。
上記のようにアクセスする順序をアドレスの昇
順に並び換え先にアクセスしたアドレスに近い順
にアクセスすることにより、最悪でも最大シーク
は１回だけで、後はそれよりずつと短い平均シー
クタイム以下で済むことになるので転送レートを
上げることができる。
順に並び換え先にアクセスしたアドレスに近い順
にアクセスすることにより、最悪でも最大シーク
は１回だけで、後はそれよりずつと短い平均シー
クタイム以下で済むことになるので転送レートを
上げることができる。
(1)式により、Ｃ＝４，T3＝0.023とするとＳ＝
約402.8Kバイト／秒で、従来の1.25倍となり、４
チヤンネルのランダムアクセスに対応することが
可能となる。
約402.8Kバイト／秒で、従来の1.25倍となり、４
チヤンネルのランダムアクセスに対応することが
可能となる。
各チヤンネルのメモリーを３つにしたのは、ア
ドレセの並べ替えをするために複数のチヤンネル
が読み込みの要求を出す必要があるためである。
メモリーが２つでは、複数チヤンネルが読み込み
要求を出す前に最初に要求を出したチヤンネルの
メモリーが空になつてしまうからで、メモリーは
３つ以上なら幾つでも良いわけであるが、少なく
て済むならそれに越したことはない。
ドレセの並べ替えをするために複数のチヤンネル
が読み込みの要求を出す必要があるためである。
メモリーが２つでは、複数チヤンネルが読み込み
要求を出す前に最初に要求を出したチヤンネルの
メモリーが空になつてしまうからで、メモリーは
３つ以上なら幾つでも良いわけであるが、少なく
て済むならそれに越したことはない。
本発明によると各チヤンネルのメモリーを３つ
に成すので各チヤンネルに必ず空メモリーを設け
ることができるのでアドレスの昇順に並べ換え先
のアドレスに近い順にデータをアクセスできシー
クタイムを短くすることができる。
に成すので各チヤンネルに必ず空メモリーを設け
ることができるのでアドレスの昇順に並べ換え先
のアドレスに近い順にデータをアクセスできシー
クタイムを短くすることができる。
第１図は本発明のブロツク図、第２図はデータ
読み込みルーチンの一実施例、第３図は従来例を
示すブロツク図である。
読み込みルーチンの一実施例、第３図は従来例を
示すブロツク図である。
Claims (1)
- １ ４チヤンネル以上の記録・再生するデイスク
レコーダーに於て、デイスクを再生するデイスク
装置と、デイスクのデータを順次アクセスし各チ
ヤンネルに少なくとも３クラスターのメモリーに
順次メモリーするメモリー手段と、上記メモリー
手段に次に各チヤンネルのメモリーにメモリーす
るデータのアドレスを昇順に並べ換える手段と、
先にアクセスしたアドレスに近い方からアドレス
順にデイスクのデータをアクセスするアクセス手
段と、前記各チヤンネルのメモリー手段にそれぞ
れメモリーされたデータを順次各チヤンネルの音
声信号とするDAコンバータとを具備しシーク時
間を短縮し複数のチヤンネルの音声信号を連続し
て再生することを特徴とするデイスクレコーダ
ー。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP31481787A JPH01155555A (ja) | 1987-12-11 | 1987-12-11 | デイスクレコーダー |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP31481787A JPH01155555A (ja) | 1987-12-11 | 1987-12-11 | デイスクレコーダー |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH01155555A JPH01155555A (ja) | 1989-06-19 |
| JPH0578103B2 true JPH0578103B2 (ja) | 1993-10-28 |
Family
ID=18057960
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP31481787A Granted JPH01155555A (ja) | 1987-12-11 | 1987-12-11 | デイスクレコーダー |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH01155555A (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP4240300B2 (ja) | 2003-08-20 | 2009-03-18 | ソニー株式会社 | 再生装置及び再生方法、並びに記録装置及び記録方法 |
-
1987
- 1987-12-11 JP JP31481787A patent/JPH01155555A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPH01155555A (ja) | 1989-06-19 |
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