JPH057904B2 - - Google Patents
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- Publication number
- JPH057904B2 JPH057904B2 JP16901882A JP16901882A JPH057904B2 JP H057904 B2 JPH057904 B2 JP H057904B2 JP 16901882 A JP16901882 A JP 16901882A JP 16901882 A JP16901882 A JP 16901882A JP H057904 B2 JPH057904 B2 JP H057904B2
- Authority
- JP
- Japan
- Prior art keywords
- circuit
- transmission
- period
- peak value
- burst signal
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Lifetime
Links
- 230000005540 biological transmission Effects 0.000 claims description 40
- 230000002457 bidirectional effect Effects 0.000 claims description 5
- 238000010586 diagram Methods 0.000 description 7
- 230000002250 progressing effect Effects 0.000 description 1
- 238000012827 research and development Methods 0.000 description 1
Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L5/00—Arrangements affording multiple use of the transmission path
- H04L5/14—Two-way operation using the same type of signal, i.e. duplex
- H04L5/16—Half-duplex systems; Simplex/duplex switching; Transmission of break signals non-automatically inverting the direction of transmission
Landscapes
- Engineering & Computer Science (AREA)
- Signal Processing (AREA)
- Computer Networks & Wireless Communication (AREA)
- Bidirectional Digital Transmission (AREA)
- Time-Division Multiplex Systems (AREA)
Description
【発明の詳細な説明】
本発明は双方向時間分割デイジタル伝送の受信
回路に関する。
回路に関する。
通信システムのデイジタル比は拡大の方向にあ
り加入者線のデイジタル化に関しても研究開発が
進められており、その方式の１つとして例えば、
特許出願番号昭和53−72667号記載の双方向時間
分割デイジタル伝送方式がある。かかる伝送方式
における伝送路インタフエイス回路の従来例を第
１図に、その動作タイミングを第２図に示す。第
１図の伝送路インタフエイス回路は送信回路１、
識別回路２、バツフア増幅器５及び伝送路４につ
ながれたスイツチ３より構成されている。送信回
路１においてブロツク化された送信バースト信号
Ｓは第２図ａに示す送信期間、スイツチ３が送信
回路１側にオンすることにより伝送路４に送出さ
れ、第２図ｃに示す受信期間バツフア増幅器５側
にオンすることより伝送路４からの受信バースト
信号Ｒはバツフア増幅器５に供給される。この時
の伝送路４上の信号を第２図ｂに示す。バツフア
増幅器５は第２図ｄに示すように受信バースト信
号Ｒを増幅し識別回路２に出力するが、同時にス
イツチ３のスイツチ雑音（斜線で示す）も増幅す
る。伝送路４の距離が長いとこの雑音のレベルは
受信バースト信号Ｒのレベルと同程度となり誤受
信の原因となる。従つてスイツチ雑音の小さい高
価なスイツチを必要とし、通信装置の経済性の点
で問題となる。
り加入者線のデイジタル化に関しても研究開発が
進められており、その方式の１つとして例えば、
特許出願番号昭和53−72667号記載の双方向時間
分割デイジタル伝送方式がある。かかる伝送方式
における伝送路インタフエイス回路の従来例を第
１図に、その動作タイミングを第２図に示す。第
１図の伝送路インタフエイス回路は送信回路１、
識別回路２、バツフア増幅器５及び伝送路４につ
ながれたスイツチ３より構成されている。送信回
路１においてブロツク化された送信バースト信号
Ｓは第２図ａに示す送信期間、スイツチ３が送信
回路１側にオンすることにより伝送路４に送出さ
れ、第２図ｃに示す受信期間バツフア増幅器５側
にオンすることより伝送路４からの受信バースト
信号Ｒはバツフア増幅器５に供給される。この時
の伝送路４上の信号を第２図ｂに示す。バツフア
増幅器５は第２図ｄに示すように受信バースト信
号Ｒを増幅し識別回路２に出力するが、同時にス
イツチ３のスイツチ雑音（斜線で示す）も増幅す
る。伝送路４の距離が長いとこの雑音のレベルは
受信バースト信号Ｒのレベルと同程度となり誤受
信の原因となる。従つてスイツチ雑音の小さい高
価なスイツチを必要とし、通信装置の経済性の点
で問題となる。
本発明の目的は、個々のスイツチのスイツチ雑
音が受信信号レベルに比べ無視できぬほど大きく
とも受信信号への影響を小さくし、より経済的な
通信装置を供給することにある。
音が受信信号レベルに比べ無視できぬほど大きく
とも受信信号への影響を小さくし、より経済的な
通信装置を供給することにある。
本発明の双方向時間分割デイジタル伝送の受信
回路は、２つの通信装置が一定周期の間隔で送信
期間及び非送信期間と同一伝送路を時間的に分け
て通信する双方向時間分割デイジタル伝送システ
ムに用いられる受信回路であつて、 受信バースト信号を増幅するバツフア増幅器
と、識別しきい値を生成するためのピーク値保持
部とスイツチ回路とを有して、バツフア増幅器の
出力と前記ピーク値回路出力を比較し前記非送信
期間よりも短い第１の受信期間でのみ識別を行う
識別回路とから構成され、前記スイツチ回路は前
記第１の受信期間でのみあるいは前記第１の受信
期間よりも受信開始の位相がはやくかつ前記受信
バースト信号のバースト長以上の長さを有する第
２の受信期間でのみ前記バツフア増幅器の出力を
前記ピーク値保持回路に供給することを特徴とす
る。
回路は、２つの通信装置が一定周期の間隔で送信
期間及び非送信期間と同一伝送路を時間的に分け
て通信する双方向時間分割デイジタル伝送システ
ムに用いられる受信回路であつて、 受信バースト信号を増幅するバツフア増幅器
と、識別しきい値を生成するためのピーク値保持
部とスイツチ回路とを有して、バツフア増幅器の
出力と前記ピーク値回路出力を比較し前記非送信
期間よりも短い第１の受信期間でのみ識別を行う
識別回路とから構成され、前記スイツチ回路は前
記第１の受信期間でのみあるいは前記第１の受信
期間よりも受信開始の位相がはやくかつ前記受信
バースト信号のバースト長以上の長さを有する第
２の受信期間でのみ前記バツフア増幅器の出力を
前記ピーク値保持回路に供給することを特徴とす
る。
次に図面を参照しながら本発明を詳細に説明す
る。第３図に本発明による受信回路を有する伝送
路インタフエイス回路の実施例を示し、第６図の
タイミング図を用いてその動作を説明する。送信
回路７においてブロツク化された送信バースト信
号Ｓはドライバ６に供給され、ドライバ６は第６
図ａに示す制御信号１０のハイレベルの送信期間
において送信バースト信号Ｓをトランス９を介し
伝送路８に送出する。同時に、送信バースト信号
Ｓは受信回路１１にも供給される。一方、伝送路
Ｓからの受信バースト信号Ｒはトランス９を介し
受信回路１１に供給される。この時の伝送路８上
の信号を第６図ｂに示す。受信回路１１では、バ
ツフア増幅器１３は第６図ｃに示すように送信バ
ースト信号Ｓ及び受信バースト信号Ｒを増幅し、
識別回路１２に供給する。識別回路１２における
動作を、識別回路１２の１構成例を示す第４図を
参照して説明する。バツフア増幅器１３の出力は
スイツチ１７及び比較器１９の正入力に供給され
る。スイツチ１７は第６図ｄに示す制御信号１５
のハイレベルの受信期間で導通し、第６図ｅに示
すように増幅された受信バースト信号Ｒのみピー
ク値保持回路１８に供給する。この時、同時に斜
線で示すようにスイツチ雑音がわずかに生じる
が、増幅された受信バースト信号Ｒのレベルに比
べ十分小さいので、ピーク値保持回路１８はこの
スイツチ雑音に対し応答しない。ピーク値保持回
路１８は得られたピーク値より識別のためのしき
い値を生成し比較器１９の負入力に供給する。比
較器１９は正入力に供給された送信バースト信号
Ｓ及び受信バースト信号Ｒを識別し、第６図ｆに
示すようにデイジタル信号S′及びデイジタル信号
R′を出力する。ANDゲート２０は、制御信号１
５の与える受信期間即ち、スイツチ１７が導通す
る期間と同じ受信期間のみ比較器１９の出力を識
別結果として出力する。
る。第３図に本発明による受信回路を有する伝送
路インタフエイス回路の実施例を示し、第６図の
タイミング図を用いてその動作を説明する。送信
回路７においてブロツク化された送信バースト信
号Ｓはドライバ６に供給され、ドライバ６は第６
図ａに示す制御信号１０のハイレベルの送信期間
において送信バースト信号Ｓをトランス９を介し
伝送路８に送出する。同時に、送信バースト信号
Ｓは受信回路１１にも供給される。一方、伝送路
Ｓからの受信バースト信号Ｒはトランス９を介し
受信回路１１に供給される。この時の伝送路８上
の信号を第６図ｂに示す。受信回路１１では、バ
ツフア増幅器１３は第６図ｃに示すように送信バ
ースト信号Ｓ及び受信バースト信号Ｒを増幅し、
識別回路１２に供給する。識別回路１２における
動作を、識別回路１２の１構成例を示す第４図を
参照して説明する。バツフア増幅器１３の出力は
スイツチ１７及び比較器１９の正入力に供給され
る。スイツチ１７は第６図ｄに示す制御信号１５
のハイレベルの受信期間で導通し、第６図ｅに示
すように増幅された受信バースト信号Ｒのみピー
ク値保持回路１８に供給する。この時、同時に斜
線で示すようにスイツチ雑音がわずかに生じる
が、増幅された受信バースト信号Ｒのレベルに比
べ十分小さいので、ピーク値保持回路１８はこの
スイツチ雑音に対し応答しない。ピーク値保持回
路１８は得られたピーク値より識別のためのしき
い値を生成し比較器１９の負入力に供給する。比
較器１９は正入力に供給された送信バースト信号
Ｓ及び受信バースト信号Ｒを識別し、第６図ｆに
示すようにデイジタル信号S′及びデイジタル信号
R′を出力する。ANDゲート２０は、制御信号１
５の与える受信期間即ち、スイツチ１７が導通す
る期間と同じ受信期間のみ比較器１９の出力を識
別結果として出力する。
従つて、第６図ｈに示すように受信バースト信
号Ｒの識別されたデイジタル信号R′のみ識別回
路１２の識別結果として出力される。
号Ｒの識別されたデイジタル信号R′のみ識別回
路１２の識別結果として出力される。
識別回路１２の別の構成例を第５図に示す。本
構成例は、ANDゲート２０に供給される制御信
号１６を除き第４図の構成例と同じである。第５
図の識別回路では、第６図ｄで示すスイツチ１７
の制御信号１５の与える導通開始の位相は、第６
図ｇで示すANDゲート２０の制御信号の与える
識別開始の位相よりもはやくなつている。従つ
て、第６図ｅに斜線で示すスイツチ雑音の影響を
より低減することができる。
構成例は、ANDゲート２０に供給される制御信
号１６を除き第４図の構成例と同じである。第５
図の識別回路では、第６図ｄで示すスイツチ１７
の制御信号１５の与える導通開始の位相は、第６
図ｇで示すANDゲート２０の制御信号の与える
識別開始の位相よりもはやくなつている。従つ
て、第６図ｅに斜線で示すスイツチ雑音の影響を
より低減することができる。
なお、受信バースト信号が複流符号の場合は、
第４図及び第５図の識別回路１２の入力段に破線
で示す全波整流回路１４をそれぞれ設ける。
第４図及び第５図の識別回路１２の入力段に破線
で示す全波整流回路１４をそれぞれ設ける。
このように本発明よりば、スイツチ雑音の小さ
いスイツチを用いることなくスイツチ雑音の影響
を低減することができ、通信品質が良くかつ経済
的な双方向時間分割デイジタル伝送の受信回路を
提供することができる。
いスイツチを用いることなくスイツチ雑音の影響
を低減することができ、通信品質が良くかつ経済
的な双方向時間分割デイジタル伝送の受信回路を
提供することができる。
第１図は伝送路インタフエイス回路の従来例の
ブロツク図、第２図ａ〜ｄは第１図の伝送路イン
タフエイス回路の動作を示すタイミング図、第３
図は本発明の受信回路を用いた伝送路インタフエ
イス回路の１実施例を示すブロツク図、第４図は
第３図の受信回路に用いる識別回路の構成例のブ
ロツク図、第５図は第３図の受信回路に用いる識
別回路の別の構成例のブロツク図、第６図ａ〜ｈ
は第３図の実施例の動作を示すタイミング図であ
る。 図において、１，７は送信回路、２，１２は識
別回路、３，１７はスイツチ、４，８は伝送路、
６はドライバ、９はトランス、１１は受信回路、
５，１３はバツフア増幅器、１８はピーク値保持
回路、１９は比較器、２０はANDゲート、２４
は整流回路を示す。
ブロツク図、第２図ａ〜ｄは第１図の伝送路イン
タフエイス回路の動作を示すタイミング図、第３
図は本発明の受信回路を用いた伝送路インタフエ
イス回路の１実施例を示すブロツク図、第４図は
第３図の受信回路に用いる識別回路の構成例のブ
ロツク図、第５図は第３図の受信回路に用いる識
別回路の別の構成例のブロツク図、第６図ａ〜ｈ
は第３図の実施例の動作を示すタイミング図であ
る。 図において、１，７は送信回路、２，１２は識
別回路、３，１７はスイツチ、４，８は伝送路、
６はドライバ、９はトランス、１１は受信回路、
５，１３はバツフア増幅器、１８はピーク値保持
回路、１９は比較器、２０はANDゲート、２４
は整流回路を示す。
Claims (1)
- 【特許請求の範囲】 １ ２つの通信装置が一定周期の間隔で送信期間
及び非送信期間と同一伝送路を時間的に分けて通
信する双方向時間分割デイジタル伝送システムに
用いられる受信回路であつて、 受信バースト信号を増幅するバツフア増幅器
と、識別しきい値を生成するためのピーク値保持
部とスイツチ回路とを有して、バツフア増幅器の
出力と前記ピーク値回路出力を比較し前記非送信
期間よりも短い第１の受信期間でのみ識別を行う
識別回路とから構成され、前記スイツチ回路は前
記第１の受信期間でのみあるいは前記第１の受信
期間よりも受信開始の位相がはやくかつ前記受信
バースト信号のバースト長以上の長さを有する第
２の受信期間でのみ前記バツフア増幅器の出力を
前記ピーク値保持回路に供給することを特徴とす
る双方向時間分割デイジタル伝送の受信回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16901882A JPS5958934A (ja) | 1982-09-28 | 1982-09-28 | 双方向時間分割ディジタル伝送の受信回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16901882A JPS5958934A (ja) | 1982-09-28 | 1982-09-28 | 双方向時間分割ディジタル伝送の受信回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5958934A JPS5958934A (ja) | 1984-04-04 |
| JPH057904B2 true JPH057904B2 (ja) | 1993-01-29 |
Family
ID=15878801
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP16901882A Granted JPS5958934A (ja) | 1982-09-28 | 1982-09-28 | 双方向時間分割ディジタル伝送の受信回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5958934A (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP3489087B2 (ja) * | 1995-07-06 | 2004-01-19 | 富士通株式会社 | 光バースト伝送における反射認識方法および装置 |
-
1982
- 1982-09-28 JP JP16901882A patent/JPS5958934A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5958934A (ja) | 1984-04-04 |
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