JPH06189259A - 画像処理装置 - Google Patents
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- JPH06189259A JPH06189259A JP43A JP35669992A JPH06189259A JP H06189259 A JPH06189259 A JP H06189259A JP 43 A JP43 A JP 43A JP 35669992 A JP35669992 A JP 35669992A JP H06189259 A JPH06189259 A JP H06189259A
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- Japan
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- overlap
- memory
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- circuit
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Abstract
(57)【要約】
【目的】 限られたメモリ容量で最大限の画質を使った
オーバラップ処理が可能な画像処理装置を提供する。 【構成】 指示手段１５により選択的に指示されるオー
バラップ時間（Ｔ）に応じて、変化手段１７によりメモ
リ回路１３への画像データの取り込み時における該画像
データの圧縮率（β）が変化する。
オーバラップ処理が可能な画像処理装置を提供する。 【構成】 指示手段１５により選択的に指示されるオー
バラップ時間（Ｔ）に応じて、変化手段１７によりメモ
リ回路１３への画像データの取り込み時における該画像
データの圧縮率（β）が変化する。
Description
【０００１】
【産業上の利用分野】本発明は、カメラ一体型ＶＴＲ
（ビデオテープレコーダ）や、画像編集装置等に搭載さ
れて動画像を処理する画像処理装置に関する。
（ビデオテープレコーダ）や、画像編集装置等に搭載さ
れて動画像を処理する画像処理装置に関する。
【０００２】
【従来の技術】一般に、画像編集装置には、画像のシー
ンチェンジの際に前のシーンが徐々に消失すると共に、
後のシーンが徐々に浮かび上がる所謂オーバラップ処理
を行なう画像処理装置が搭載され、従来のこの種の画像
処理装置は、例えば図５に示すように構成されている。
ンチェンジの際に前のシーンが徐々に消失すると共に、
後のシーンが徐々に浮かび上がる所謂オーバラップ処理
を行なう画像処理装置が搭載され、従来のこの種の画像
処理装置は、例えば図５に示すように構成されている。
【０００３】同図において、第１，第２の入力端子１０
１，１０３に入力した映像信号は、それぞれ第１，第２
のアナログ・ディジタル変換器（以下、Ａ／Ｄ変換器と
いう。）１０２，１０４によりディジタル信号に変換さ
れる。第１，第２の乗算器１０５，１０６は共に、中央
演算処理装置（以下、ＣＰＵという。）１０７により同
期してそれぞれの係数α、（１−α）の値が制御され、
第１，第２のＡ／Ｄ変換器１０２，１０４の各出力値に
対して、それぞれの係数α、（１−α）の値を乗算す
る。そして、第１，第２の乗算器１０５，１０６の出力
値が加算器１０８により加算された後、ディジタル・ア
ナログ変換器（以下、Ｄ／Ａ変換器という。）によりア
ナログ映像信号に変換され、出力端子１１０から外部へ
出力される。
１，１０３に入力した映像信号は、それぞれ第１，第２
のアナログ・ディジタル変換器（以下、Ａ／Ｄ変換器と
いう。）１０２，１０４によりディジタル信号に変換さ
れる。第１，第２の乗算器１０５，１０６は共に、中央
演算処理装置（以下、ＣＰＵという。）１０７により同
期してそれぞれの係数α、（１−α）の値が制御され、
第１，第２のＡ／Ｄ変換器１０２，１０４の各出力値に
対して、それぞれの係数α、（１−α）の値を乗算す
る。そして、第１，第２の乗算器１０５，１０６の出力
値が加算器１０８により加算された後、ディジタル・ア
ナログ変換器（以下、Ｄ／Ａ変換器という。）によりア
ナログ映像信号に変換され、出力端子１１０から外部へ
出力される。
【０００４】１１１はトリガスイッチ（ＳＷ）であり、
該トリガスイッチ１１１が押されたことをＣＰＵ１０７
が検知すると、該ＣＰＵ１０７が上記係数αを例えば
「１」から「０」に徐々に変化させる。すると、第１の
入力端子１０１に入力した前のシーンの映像信号が徐々
に消失し、第２の入力端子１０３に入力した後のシーン
の映像信号が徐々に浮かび上がるようなオーバラップ処
理を行なうことができる。１１２はオーバラップ時間設
定スイッチであり、場面に応じてオーバラップ時間を切
り換える。
該トリガスイッチ１１１が押されたことをＣＰＵ１０７
が検知すると、該ＣＰＵ１０７が上記係数αを例えば
「１」から「０」に徐々に変化させる。すると、第１の
入力端子１０１に入力した前のシーンの映像信号が徐々
に消失し、第２の入力端子１０３に入力した後のシーン
の映像信号が徐々に浮かび上がるようなオーバラップ処
理を行なうことができる。１１２はオーバラップ時間設
定スイッチであり、場面に応じてオーバラップ時間を切
り換える。
【０００５】また、上記従来例では、２つの入力端子１
０１，１０３相互間のオーバラップ処理を行なうように
構成されているが、カメラ一体型ＶＴＲのように一つの
カメラ出力の画像のみを用いたつなぎ撮り時にオーバラ
ップ処理を行なうため、前のシーンの終了部の画像をメ
モリに取り込み、後のシーンと、前記メモリから読み出
された画像とをオーバラップ処理する方法も考えられ
る。
０１，１０３相互間のオーバラップ処理を行なうように
構成されているが、カメラ一体型ＶＴＲのように一つの
カメラ出力の画像のみを用いたつなぎ撮り時にオーバラ
ップ処理を行なうため、前のシーンの終了部の画像をメ
モリに取り込み、後のシーンと、前記メモリから読み出
された画像とをオーバラップ処理する方法も考えられ
る。
【０００６】このような方法の場合、動画像信号をディ
ジタル信号に変換して前記メモリに記憶するには、例え
ば、１秒〜４秒のオーバラップに必要なメモリ容量は膨
大になる。
ジタル信号に変換して前記メモリに記憶するには、例え
ば、１秒〜４秒のオーバラップに必要なメモリ容量は膨
大になる。
【０００７】ＮＴＳＣテレビジョン方式で１フレーム当
り６Ｍｂｉｔの画像のデータの場合、６Ｍｂｉｔ×３０
フレーム／秒＝１８０Ｍｂｉｔ／秒となり、４秒分に必
要なメモリ容量は１８０Ｍｂｉｔ／秒×４秒＝７２０Ｍ
ｂｉｔにもなる。
り６Ｍｂｉｔの画像のデータの場合、６Ｍｂｉｔ×３０
フレーム／秒＝１８０Ｍｂｉｔ／秒となり、４秒分に必
要なメモリ容量は１８０Ｍｂｉｔ／秒×４秒＝７２０Ｍ
ｂｉｔにもなる。
【０００８】このような機能をカメラ一体型ＶＴＲに搭
載するとなると、メモリだけで大きな体積を占めてしま
い、また価格も高価なものになってしまう。
載するとなると、メモリだけで大きな体積を占めてしま
い、また価格も高価なものになってしまう。
【０００９】そこで、オーバラツプに必要な前のシーン
の終了部の画像データは、量子化数や１秒当りの取り込
みフレーム数を減らす等のデータ圧縮を行なってメモリ
に取り込むことになる。
の終了部の画像データは、量子化数や１秒当りの取り込
みフレーム数を減らす等のデータ圧縮を行なってメモリ
に取り込むことになる。
【００１０】例えば４秒のオーバラップに必要な前のシ
ーンの終了部の画像データを１／１００に圧縮してメモ
リに取り込む。この取り込んだデータをオーバラップ時
に伸長して、４秒のオーバラップに使用する。必要なデ
ータ量は７２０Ｍｂｉｔ×１／１００＝７．２Ｍｂｉｔ
となり、比較的小容量で安価なメモリを採用できる。
ーンの終了部の画像データを１／１００に圧縮してメモ
リに取り込む。この取り込んだデータをオーバラップ時
に伸長して、４秒のオーバラップに使用する。必要なデ
ータ量は７２０Ｍｂｉｔ×１／１００＝７．２Ｍｂｉｔ
となり、比較的小容量で安価なメモリを採用できる。
【００１１】
【発明が解決しようとする課題】しかしながら、前記画
像データ圧縮時における圧縮率（β）が一定の場合、最
長のオーバラップ時間（ＴMAX）の設定で必要な容量の
メモリが最短のオーバラップ時間（ＴMIN）の設定時に
ＴMIN／ＴMAXしか使われないことになり、メモリ容量を
減らすために画質を多少犠牲にして画像データを圧縮し
ているにも拘らず、メモリの有効利用が図られていない
という欠点が生じる。
像データ圧縮時における圧縮率（β）が一定の場合、最
長のオーバラップ時間（ＴMAX）の設定で必要な容量の
メモリが最短のオーバラップ時間（ＴMIN）の設定時に
ＴMIN／ＴMAXしか使われないことになり、メモリ容量を
減らすために画質を多少犠牲にして画像データを圧縮し
ているにも拘らず、メモリの有効利用が図られていない
という欠点が生じる。
【００１２】本発明は上記事情に鑑みてなされたもの
で、限られたメモリ容量で最大限の画質を使ったオーバ
ラップ処理が可能な画像処理装置を提供することを目的
とするものである。
で、限られたメモリ容量で最大限の画質を使ったオーバ
ラップ処理が可能な画像処理装置を提供することを目的
とするものである。
【００１３】
【課題を解決するための手段】斯かる目的を達成するた
め本発明は、入力される動画像の前のシーンと後のシー
ンとのつなぎの部分で前記前のシーンの終了部の画像信
号をディジタル信号に変換して圧縮した画像データをメ
モリに取り込み、前記後のシーンの画像と前記メモリか
ら読み出された画像とをオーバラップ処理する画像処理
装置において、オーバラップ時間（Ｔ）を選択的に指示
する指示手段と、該指示手段により選択的に指示される
前記オーバラップ時間（Ｔ）に応じて前記メモリへの前
記画像データの取り込み時における該画像データの圧縮
率（β）を変化させる圧縮率変化手段を備えたことを特
徴とするものである。
め本発明は、入力される動画像の前のシーンと後のシー
ンとのつなぎの部分で前記前のシーンの終了部の画像信
号をディジタル信号に変換して圧縮した画像データをメ
モリに取り込み、前記後のシーンの画像と前記メモリか
ら読み出された画像とをオーバラップ処理する画像処理
装置において、オーバラップ時間（Ｔ）を選択的に指示
する指示手段と、該指示手段により選択的に指示される
前記オーバラップ時間（Ｔ）に応じて前記メモリへの前
記画像データの取り込み時における該画像データの圧縮
率（β）を変化させる圧縮率変化手段を備えたことを特
徴とするものである。
【００１４】また、同じ目的を達成する上で、前記オー
バラップ時間（Ｔ）と圧縮率（β）との関係がＴ×β＝
略一定となるようにすることが望ましい。
バラップ時間（Ｔ）と圧縮率（β）との関係がＴ×β＝
略一定となるようにすることが望ましい。
【００１５】更に、同じ目的を達成する上で、前記メモ
リへの前記画像データの取り込み時に前記指示手段によ
り選択的に指示される前記オーバラップ時間（Ｔ）の画
像データを記憶する記憶手段を備えるとよい。
リへの前記画像データの取り込み時に前記指示手段によ
り選択的に指示される前記オーバラップ時間（Ｔ）の画
像データを記憶する記憶手段を備えるとよい。
【００１６】
【作用】本発明によれば、指示手段により選択的に指示
されるオーバラップ時間（Ｔ）に応じて、オーバラップ
に使用される画像データのメモリへの取り込み時におけ
る圧縮率（β）を変化させる。これにより、限られたメ
モリ容量で最大限の画質を使ったオーバラップ処理が可
能になる。
されるオーバラップ時間（Ｔ）に応じて、オーバラップ
に使用される画像データのメモリへの取り込み時におけ
る圧縮率（β）を変化させる。これにより、限られたメ
モリ容量で最大限の画質を使ったオーバラップ処理が可
能になる。
【００１７】
【実施例】以下、本発明の実施例を図１〜図４に基づき
説明する。
説明する。
【００１８】［第１実施例］図１は本発明の第１実施例
に係る画像処理装置を搭載したカメラ一体型ＶＴＲ（ビ
デオテープレコーダ）の構成を示すブロック図である。
同図において、１はレンズ、２はＣＣＤ等の撮像素子で
あり、レンズ１で結像された像が撮像素子２で光電変換
される。この撮像素子２の出力は、アナログ・ディジタ
ル変換器（以下、Ａ／Ｄ変換器という。）３によりディ
ジタル信号に変換される。Ａ／Ｄ変換器３の出力は、カ
メラプロセス回路４に入力され、該カメラプロセス回路
４によって輝度信号（Ｙ信号）及び色信号（Ｃ信号）が
それぞれ生成され、ｒ処理等が行なわれる。
に係る画像処理装置を搭載したカメラ一体型ＶＴＲ（ビ
デオテープレコーダ）の構成を示すブロック図である。
同図において、１はレンズ、２はＣＣＤ等の撮像素子で
あり、レンズ１で結像された像が撮像素子２で光電変換
される。この撮像素子２の出力は、アナログ・ディジタ
ル変換器（以下、Ａ／Ｄ変換器という。）３によりディ
ジタル信号に変換される。Ａ／Ｄ変換器３の出力は、カ
メラプロセス回路４に入力され、該カメラプロセス回路
４によって輝度信号（Ｙ信号）及び色信号（Ｃ信号）が
それぞれ生成され、ｒ処理等が行なわれる。
【００１９】カメラプロセス回路４のＹ信号とＣ信号の
出力は、オーバラップ乗算回路５、Ｙ信号加算器６及び
Ｃ信号加算器７をそれぞれ通って第１，第２のディジタ
ル・アナログ変換器（以下、Ｄ／Ａ変換器という。）
８，９に送られる。ＶＴＲが通常記録中において、オー
バラップ乗算回路５の第１の乗算器５１は、信号がスル
ーされる状態となっており、カメラプロセス回路４から
の信号がそのままアナログ信号に変換されてレコーダ部
１０に入力されて記録される。
出力は、オーバラップ乗算回路５、Ｙ信号加算器６及び
Ｃ信号加算器７をそれぞれ通って第１，第２のディジタ
ル・アナログ変換器（以下、Ｄ／Ａ変換器という。）
８，９に送られる。ＶＴＲが通常記録中において、オー
バラップ乗算回路５の第１の乗算器５１は、信号がスル
ーされる状態となっており、カメラプロセス回路４から
の信号がそのままアナログ信号に変換されてレコーダ部
１０に入力されて記録される。
【００２０】１１は前のシーンの終了部の画像データを
圧縮率βで圧縮する圧縮回路であり、量子化数を減らし
たり、取り込みフレーム数を減らして圧縮するものであ
る。１３は画像データを記憶するメモリ回路、１４はメ
モリ回路１３へのデータの取り込みと、読み出しとを切
り換える切換回路、１２はメモリ回路１３から画像デー
タを読み出し、圧縮回路１１により圧縮された画像デー
タを伸長する伸長回路である。オーバラップ乗算回路５
の第２の乗算器５２は、前のシーンの終了部の画像デー
タを徐々に減少する回路である。１７はカメラ一体型Ｖ
ＴＲ全体を制御する中央演算処理装置（ＣＰＵ）、１５
はオーバラップ時間（Ｔ）を設定するＴスイッチ、１６
は記録（ＲＥＣ）と記録一時停止（ＲＥＣ／ＰＡＵＳ
Ｅ）を交互にとるトグル動作を行なわせるトリガスイッ
チである。
圧縮率βで圧縮する圧縮回路であり、量子化数を減らし
たり、取り込みフレーム数を減らして圧縮するものであ
る。１３は画像データを記憶するメモリ回路、１４はメ
モリ回路１３へのデータの取り込みと、読み出しとを切
り換える切換回路、１２はメモリ回路１３から画像デー
タを読み出し、圧縮回路１１により圧縮された画像デー
タを伸長する伸長回路である。オーバラップ乗算回路５
の第２の乗算器５２は、前のシーンの終了部の画像デー
タを徐々に減少する回路である。１７はカメラ一体型Ｖ
ＴＲ全体を制御する中央演算処理装置（ＣＰＵ）、１５
はオーバラップ時間（Ｔ）を設定するＴスイッチ、１６
は記録（ＲＥＣ）と記録一時停止（ＲＥＣ／ＰＡＵＳ
Ｅ）を交互にとるトグル動作を行なわせるトリガスイッ
チである。
【００２１】次に、図１と共に図２のオーバラップタイ
ミング図を用いて、つなぎ撮り部のオーバラップ処理機
能について説明する。
ミング図を用いて、つなぎ撮り部のオーバラップ処理機
能について説明する。
【００２２】図２において、シーンＮを記録中の時間ｔ
1にトリガスイッチ１６が押されるとＶＴＲをＲＥＣ／
ＰＡＵＳＥ状態にする。ｔ1からｔ2までの時間のカメラ
プロセス回路４の出力は、圧縮回路１１で圧縮率βで圧
縮された後、メモリ回路１３に取り込まれる。ここで
（ｔ2−ｔ1）はＴスイッチ１５で設定されたオーバラッ
プ時間Ｔとなる。
1にトリガスイッチ１６が押されるとＶＴＲをＲＥＣ／
ＰＡＵＳＥ状態にする。ｔ1からｔ2までの時間のカメラ
プロセス回路４の出力は、圧縮回路１１で圧縮率βで圧
縮された後、メモリ回路１３に取り込まれる。ここで
（ｔ2−ｔ1）はＴスイッチ１５で設定されたオーバラッ
プ時間Ｔとなる。
【００２３】時間ｔ1から時間ｔ2までの間にメモリ回路
１３に取り込まれたシーンＮの終了部の画像データは、
次のシーン（Ｎ＋１）の記録が開始されるまで保持され
る。
１３に取り込まれたシーンＮの終了部の画像データは、
次のシーン（Ｎ＋１）の記録が開始されるまで保持され
る。
【００２４】図２ｂの斜線部分は、ビューファインダ等
ではモニタできるが、記録はされないシーンを表わして
いる。
ではモニタできるが、記録はされないシーンを表わして
いる。
【００２５】次にシーン（Ｎ＋１）の記録開始の動作を
説明する。
説明する。
【００２６】時間ｔ3にトリガスイッチ１６を押すと、
シーン（Ｎ＋１）の時間ｔ3から時間ｔ4までは、オーバ
ラップ乗算回路５の第１の乗算器５１の係数αは「０」
から「１」に徐々に変化し、メモリ回路１３から読み出
され且つ伸長回路１２により伸長されたシーンＮの終了
部の画像データと、カメラプロセス回路４からのシーン
（Ｎ＋１）の開始部の画像データとが第１，第２の乗算
器６，７で合成されてオーバラップ画像となってレコー
ダ部１０に入力されて記録される。ここで（ｔ4−ｔ3）
は、Ｔスイッチ１５で設定されたオーバラップ時間Ｔと
なる。
シーン（Ｎ＋１）の時間ｔ3から時間ｔ4までは、オーバ
ラップ乗算回路５の第１の乗算器５１の係数αは「０」
から「１」に徐々に変化し、メモリ回路１３から読み出
され且つ伸長回路１２により伸長されたシーンＮの終了
部の画像データと、カメラプロセス回路４からのシーン
（Ｎ＋１）の開始部の画像データとが第１，第２の乗算
器６，７で合成されてオーバラップ画像となってレコー
ダ部１０に入力されて記録される。ここで（ｔ4−ｔ3）
は、Ｔスイッチ１５で設定されたオーバラップ時間Ｔと
なる。
【００２７】この一連の動作は、シーン（Ｎ＋１）とシ
ーン（Ｎ＋２）でも同様に行なわれる。
ーン（Ｎ＋２）でも同様に行なわれる。
【００２８】次にオーバラップ時間の選択動作を図３に
基づき説明する。
基づき説明する。
【００２９】図３はＴスイッチ１５によってオーバラッ
プ時間（Ｔ）を１秒、２秒、４秒にそれぞれ選択する処
理手順を示すフローチャートである。
プ時間（Ｔ）を１秒、２秒、４秒にそれぞれ選択する処
理手順を示すフローチャートである。
【００３０】同図において、ステップ３０１でＶＴＲを
ＲＥＣ／ＰＡＵＳＥ状態に設定し、次のステップ３０２
でトリガスイッチ１６がオン（ＯＮ）されたか否かを判
別する。オンされなければステップ３０３に進んで、終
了の指示があったか否かを判別し、指示があれば本処理
動作を終了し、前記指示がなければ前記ステップ３０２
に戻る。
ＲＥＣ／ＰＡＵＳＥ状態に設定し、次のステップ３０２
でトリガスイッチ１６がオン（ＯＮ）されたか否かを判
別する。オンされなければステップ３０３に進んで、終
了の指示があったか否かを判別し、指示があれば本処理
動作を終了し、前記指示がなければ前記ステップ３０２
に戻る。
【００３１】前記ステップ３０２でトリガスイッチ１６
がオンされれば、次のステップ３０４に進んでＶＴＲを
記録モードにして記録（ＲＥＣ）動作を開始する。次い
でステップ３０５に進んで、トリガスイッチ１６がオン
されたか否かを、オンされるまで繰り返して判別し、オ
ンされればステップ３０６でＶＴＲの記録動作を停止さ
せた後、ＲＥＣ／ＰＡＵＳＥ状態に設定する。
がオンされれば、次のステップ３０４に進んでＶＴＲを
記録モードにして記録（ＲＥＣ）動作を開始する。次い
でステップ３０５に進んで、トリガスイッチ１６がオン
されたか否かを、オンされるまで繰り返して判別し、オ
ンされればステップ３０６でＶＴＲの記録動作を停止さ
せた後、ＲＥＣ／ＰＡＵＳＥ状態に設定する。
【００３２】この後、ステップ３０７に進んでオーバラ
ップ時間（Ｔ）が何秒に選択されたかを判別する。
ップ時間（Ｔ）が何秒に選択されたかを判別する。
【００３３】まず、Ｔ＝１に選択された場合、圧縮回路
１１の圧縮率βは１／２５に設定され（ステップ３０
８）、シーンＮの終了部の画像データを１秒間メモリ回
路１３に取り込む（ステップ３１１）。
１１の圧縮率βは１／２５に設定され（ステップ３０
８）、シーンＮの終了部の画像データを１秒間メモリ回
路１３に取り込む（ステップ３１１）。
【００３４】また、Ｔ＝２に選択された場合、圧縮率β
は１／５０に設定され（ステップ３０９）、前記画像デ
ータを２秒間メモリ回路１３に取り込む（ステップ３１
２）。
は１／５０に設定され（ステップ３０９）、前記画像デ
ータを２秒間メモリ回路１３に取り込む（ステップ３１
２）。
【００３５】更に、Ｔ＝４に選択された場合、圧縮率β
は１／１００に設定され（ステップ３１０）、前記画像
データを４秒間メモリ回路１３に取り込む（ステップ３
１３）。
は１／１００に設定され（ステップ３１０）、前記画像
データを４秒間メモリ回路１３に取り込む（ステップ３
１３）。
【００３６】従って、オーバラップ時間Ｔが、１秒、２
秒及び４秒のどれを選択されても、メモリ回路１３に取
り込まれる情報量は等しくなる。
秒及び４秒のどれを選択されても、メモリ回路１３に取
り込まれる情報量は等しくなる。
【００３７】次のトリガスイッチ１６でそれぞれのオー
バラップ時間Ｔに応じたオーバラップ処理が行なわれる
（ステップ３１４〜ステップ３１７、ステップ３１８〜
ステップ３２１、ステップ３２２〜ステップ３２５）。
バラップ時間Ｔに応じたオーバラップ処理が行なわれる
（ステップ３１４〜ステップ３１７、ステップ３１８〜
ステップ３２１、ステップ３２２〜ステップ３２５）。
【００３８】各ステップ３１７，３２１，３２５を実行
後は、それぞれ前記ステップ３０５に戻って、トリガス
イッチ１６がオンか否かの判別処理を行なう。
後は、それぞれ前記ステップ３０５に戻って、トリガス
イッチ１６がオンか否かの判別処理を行なう。
【００３９】［第２実施例］次に本発明の第２実施例を
図４に基づき説明する。本実施例は、上述した第１実施
例の構成において、シーンＮの終了部の画像データと共
に、その際のオーバラップ時間Ｔが何秒であったかの情
報をもメモリ回路１３に取り込むようにしたものであ
る。
図４に基づき説明する。本実施例は、上述した第１実施
例の構成において、シーンＮの終了部の画像データと共
に、その際のオーバラップ時間Ｔが何秒であったかの情
報をもメモリ回路１３に取り込むようにしたものであ
る。
【００４０】図４は本実施例においてオーバラップ時間
Ｔの情報をメモリ回路１３に取り込む場合の処理手順を
示すフローチャートである。
Ｔの情報をメモリ回路１３に取り込む場合の処理手順を
示すフローチャートである。
【００４１】なお、図４におけるステップ４０１〜ステ
ップ４１０は、上述した第１実施例の図３におけるステ
ップ３０１〜ステップ３１０と同一であるから、その説
明を省略する。
ップ４１０は、上述した第１実施例の図３におけるステ
ップ３０１〜ステップ３１０と同一であるから、その説
明を省略する。
【００４２】図４において、ステップ４０８で圧縮率β
を１／２５に設定後は、次のステップ４１１で画像デー
タを１秒間メモリ回路１３に取り込むと共に、オーバラ
ップ時間Ｔが１秒であることをメモリ回路１３に取り込
んだ後、ステップ４１４に進む。
を１／２５に設定後は、次のステップ４１１で画像デー
タを１秒間メモリ回路１３に取り込むと共に、オーバラ
ップ時間Ｔが１秒であることをメモリ回路１３に取り込
んだ後、ステップ４１４に進む。
【００４３】また、ステップ４０９で圧縮率βを１／５
０に設定後は、次のステップ４１２で画像データを２秒
間メモリ回路１３に取り込むと共に、オーバラップ時間
Ｔが２秒であることをメモリ回路１３に取り込んだ後、
ステップ４１４に進む。
０に設定後は、次のステップ４１２で画像データを２秒
間メモリ回路１３に取り込むと共に、オーバラップ時間
Ｔが２秒であることをメモリ回路１３に取り込んだ後、
ステップ４１４に進む。
【００４４】更に、ステップ４１０で、画像データを１
／１００に設定後は、次のステップ４１３で、画像デー
タを４秒間メモリ回路１３に取り込むと共に、オーバラ
ップ時間Ｔが４秒であることをメモリ回路１３に取り込
んだ後、ステップ４１４に進む。
／１００に設定後は、次のステップ４１３で、画像デー
タを４秒間メモリ回路１３に取り込むと共に、オーバラ
ップ時間Ｔが４秒であることをメモリ回路１３に取り込
んだ後、ステップ４１４に進む。
【００４５】このステップ４１４では、トリガスイッチ
１６がオンか否かを判別し、オンでなければステップ４
１５で終了の指示があったか否かを判別する。指示があ
れば本処理動作を終了し、指示がなければ前記ステップ
４１４に戻る。
１６がオンか否かを判別し、オンでなければステップ４
１５で終了の指示があったか否かを判別する。指示があ
れば本処理動作を終了し、指示がなければ前記ステップ
４１４に戻る。
【００４６】また、前記ステップ４１４でトリガスイッ
チ１６がオンであれば次のステップ４１６に進んで、メ
モリ回路１３からオーバラップ時間Ｔを読み取った後、
ステップ４１７でＶＴＲの記録を開始し、次のステップ
４１８で前記ステップ４１６において読み取ったオーバ
ラップ時間Ｔに対応るオーバラップ処理を行なった後、
前記ステップ４０５に戻ってトリガスイッチ１６がオン
であるか否かを判別する。
チ１６がオンであれば次のステップ４１６に進んで、メ
モリ回路１３からオーバラップ時間Ｔを読み取った後、
ステップ４１７でＶＴＲの記録を開始し、次のステップ
４１８で前記ステップ４１６において読み取ったオーバ
ラップ時間Ｔに対応るオーバラップ処理を行なった後、
前記ステップ４０５に戻ってトリガスイッチ１６がオン
であるか否かを判別する。
【００４７】即ち、本実施例では、トリガスイッチ１６
の操作により、シーン（Ｎ＋１）の記録を開始する前に
メモリ回路１３からオーバラップ時間Ｔを読み取り、該
オーバラップ時間Ｔの値に合ったオーバラップ処理を行
なうものである。
の操作により、シーン（Ｎ＋１）の記録を開始する前に
メモリ回路１３からオーバラップ時間Ｔを読み取り、該
オーバラップ時間Ｔの値に合ったオーバラップ処理を行
なうものである。
【００４８】従って、シーンＮの終了部の画像データを
メモリ回路１３に取り込んだ後に誤ってＴスイッチ１５
を切り換えても、メモリ回路１３に入っているデータに
合った伸長とオーバラップ時間に対応するオーバラップ
が実現できる。
メモリ回路１３に取り込んだ後に誤ってＴスイッチ１５
を切り換えても、メモリ回路１３に入っているデータに
合った伸長とオーバラップ時間に対応するオーバラップ
が実現できる。
【００４９】オーバラップ時間Ｔの情報を記憶するメモ
リは、画像データ記憶用のメモリ回路１３と別にして
も、同様の効果が得られることは言うまでもない。
リは、画像データ記憶用のメモリ回路１３と別にして
も、同様の効果が得られることは言うまでもない。
【００５０】
【発明の効果】以上詳述した如く本発明の画像処理装置
によれば、指示手段により選択的に指示されるオーバラ
ップ時間Ｔに応じて、Ｔ×β＝略一定となるように画像
データのメモリ回路への取り込み時における圧縮率βを
設定することにより、メモリ回路に記憶されるデータ量
が一定となり、限られたメモリ容量で最大限の画質を使
ったオーバラップ処理が可能になる。
によれば、指示手段により選択的に指示されるオーバラ
ップ時間Ｔに応じて、Ｔ×β＝略一定となるように画像
データのメモリ回路への取り込み時における圧縮率βを
設定することにより、メモリ回路に記憶されるデータ量
が一定となり、限られたメモリ容量で最大限の画質を使
ったオーバラップ処理が可能になる。
【００５１】また、画像データをメモリ回路に取り込む
と同時にオーバラップ時間Ｔをもメモリ回路に記憶する
ことにより、誤ってＴスイッチを切り換えても良好なオ
ーバラップが実現できる。
と同時にオーバラップ時間Ｔをもメモリ回路に記憶する
ことにより、誤ってＴスイッチを切り換えても良好なオ
ーバラップが実現できる。
【図１】本発明の第１実施例に係る画像処理装置を搭載
したカメラ一体型ＶＴＲの構成を示すブロック図であ
る。
したカメラ一体型ＶＴＲの構成を示すブロック図であ
る。
【図２】同ＶＴＲにおける画像処理装置のつなぎ撮り時
のオーバラップタイミング図である。
のオーバラップタイミング図である。
【図３】同装置の動作を示すフローチャートである。
【図４】本発明の第２実施例に係る画像処理装置の動作
を示すフローチャートである。
を示すフローチャートである。
【図５】従来の画像処理装置の構成を示すブロック図で
ある。
ある。
１３ メモリ回路（メモリ記憶手段） １５ Ｔスイッチ（指示手段） １７ ＣＰＵ（変化手段）
───────────────────────────────────────────────────── フロントページの続き (72)発明者 菊池 孝之 東京都大田区下丸子３丁目30番２号 キヤ ノン株式会社内 (72)発明者 浜中 章佳 東京都大田区下丸子３丁目30番２号 キヤ ノン株式会社内
Claims (3)
- 【請求項１】 入力される動画像の前のシーンと後のシ
ーンとのつなぎの部分で前記前のシーンの終了部の画像
信号をディジタル信号に変換して圧縮した画像データを
メモリに取り込み、前記後のシーンの画像と前記メモリ
から読み出された画像とをオーバラップ処理する画像処
理装置において、オーバラップ時間（Ｔ）を選択的に指
示する指示手段と、該指示手段により選択的に指示され
る前記オーバラップ時間（Ｔ）に応じて前記メモリへの
前記画像データの取り込み時における該画像データの圧
縮率（β）を変化させる圧縮率変化手段を備えたことを
特徴とする画像処理装置。 - 【請求項２】 前記オーバラップ時間（Ｔ）と圧縮率
（β）との関係は、Ｔ×β＝略一定となることを特徴と
する請求項１記載の画像処理装置。 - 【請求項３】 前記メモリへの前記画像データの取り込
み時に前記指示手段により選択的に指示される前記オー
バラッブ時間（Ｔ）の画像データを記憶する記憶手段を
備えたことを特徴とする請求項１記載の画像処理装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP43A JPH06189259A (ja) | 1992-12-22 | 1992-12-22 | 画像処理装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP43A JPH06189259A (ja) | 1992-12-22 | 1992-12-22 | 画像処理装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH06189259A true JPH06189259A (ja) | 1994-07-08 |
Family
ID=18450341
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP43A Pending JPH06189259A (ja) | 1992-12-22 | 1992-12-22 | 画像処理装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH06189259A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR101602425B1 (ko) * | 2015-03-27 | 2016-03-11 | 주식회사 아트필 | 무대용 다채널 영상 제어장치 |
-
1992
- 1992-12-22 JP JP43A patent/JPH06189259A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR101602425B1 (ko) * | 2015-03-27 | 2016-03-11 | 주식회사 아트필 | 무대용 다채널 영상 제어장치 |
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