JPH06196454A - レジスト膜の除去方法及び除去装置 - Google Patents

レジスト膜の除去方法及び除去装置

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JPH06196454A
JPH06196454A JP4357680A JP35768092A JPH06196454A JP H06196454 A JPH06196454 A JP H06196454A JP 4357680 A JP4357680 A JP 4357680A JP 35768092 A JP35768092 A JP 35768092A JP H06196454 A JPH06196454 A JP H06196454A
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gas
fluorine
based gas
hardened layer
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JP4357680A
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Yasuhiro Suzuki
康浩 鈴木
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Abstract

(57)【要約】 【目的】 ドライエッチング処理等によりレジスト膜に
生成する変質硬化層を容易にすることにより、スループ
ット及び歩留りの向上を図る。 【構成】 半導体装置の製造工程においてエッチング処
理等のマスクに用いられたレジスト膜1を、Fラジカル
に曝して灰化させる。レジスト膜1の表面には難気化性
の変質硬化層1aが生成されている。変質硬化層1a
と、マイクロ波放電によりNF3 ガスをプラズマ状態に
して解離させたFラジカルとが反応し、変質硬化層1a
が気化性に変質する。これにより変質硬化層1a及びレ
ジスト膜1は灰化して消滅する。その灰化速度を上昇さ
せるために、O3 ガスを導入してプラズマ状態にし、O
ラジカルを生成させる。 【効果】 変質硬化層を含むレジスト膜を一工程で除去
することができ、スループットの向上並びに歩留りの向
上を図ることができる。

Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】本発明は、レジスト膜の除去技術
に関し、特に半導体装置の製造工程におけるイオン注入
処理やエッチング処理等のマスクとして用いられるレジ
スト膜の除去方法及び除去装置に関する。
【0002】
【従来の技術】近時、半導体装置の製造工程におけるイ
オン注入処理やエッチング処理等のマスクとして使用さ
れた後に、半導体基板上に残在するレジスト膜を除去す
る場合、湿式による除去方法に代わって、酸素プラズマ
を用いてレジスト膜を灰化(アッシング)させるアッシ
ング法が採用されるようになってきている。アッシング
法によれば、プロセスの簡易化,清浄化を図ることがで
きると共に、自動化が容易である等の種々の利点があ
る。
【0003】この方法によれば、大部分のレジストは気
化して基板上から消滅するが、イオン注入処理やドライ
エッチング処理等によりレジスト膜の表面に生じた難気
化性の変質硬化層は気化せずに残留する。この変質硬化
層を除去するため、例えば特開平4−28219号公報
に記載されているようなレジスト膜の剥離方法が提案さ
れている。
【0004】この剥離方法は、そのプロセスを3工程に
分けて行うものであり、レジスト膜を被着させた半導体
基板を液体窒素中に浸漬させながら、その基板に超音波
を照射する急冷工程と、酸素プラズマによりレジスト膜
を灰化させるアッシング工程と、基板にエアガン等を用
いて圧搾空気を吹き付けるエア洗浄工程とにより構成さ
れる。そして、その作用は以下の通りである。即ち、先
ず急冷工程により変質硬化層及びレジスト膜に亀裂が生
じ、この亀裂を介して、アッシング工程時に酸素プラズ
マ中の原子状酸素がレジスト膜内の奥方まで浸透する。
これによりレジスト膜の変質していない部分が速やかに
気化して、残った変質硬化層と基板との接着力が低下す
る。そして、その変質硬化層を圧搾空気で吹き飛ばすこ
とにより、清浄な表面の基板が得られる。
【0005】
【発明が解決しようとする課題】しかしながら、上述し
た特開平4−28219号公報に記載の方法では、レジ
スト膜の除去に要する工程数が多くなる。このためスル
ープットの低下を招くだけでなく、例えば臭化水素(H
Br)ガスを用いて多結晶シリコンをドライエッチング
処理した際に、レジスト膜の表面に生成されるSix
y X (x,yは任意の整数)で表される変質硬化層
については除去することができない。そしてこの変質硬
化層が基板表面に残存して異物となり、歩留りの低下を
招くという問題点が本発明者によって明らかにされた。
【0006】本発明はかかる事情に鑑みてなされたもの
であり、レジスト膜の除去に要する工程数を削除してス
ループットの向上を図ると共に、例えばHBrガスを用
いたドライエッチング処理によりレジスト膜に生成する
難気化性の変質硬化層を容易に除去することができ、歩
留りの向上を図り得るレジスト膜の除去方法及び除去装
置を提供することを主たる目的としている。
【0007】
【課題を解決するための手段】本発明に係るレジスト膜
の除去方法は、フッ化系ガスをプラズマ状態にし、その
プラズマ中に生成したフッ素ラジカルに基板表面を曝し
て、その基板表面に残存するレジスト膜を除去するよう
にしたものである。
【0008】具体的には、前記フッ素ガスは三フッ化窒
素ガスであり、該フッ素ガスを含んで成る混合ガスに対
して最大10体積百分率を占める。そしてフッ素系ガス
を、マイクロ波放電を生起可能なチャンバー内に導入し
て、そのマイクロ波放電によりプラズマ状態にすること
により、前記チャンバー内で前記レジスト膜を灰化させ
て除去する。そのレジスト膜は、前記基板の主面に形成
した酸化シリコン膜上に積層させた多結晶シリコン(も
しくは高融点金属又はそれらの金属間化合物)を、臭化
水素ガス(もしくはハロゲンガス又はそれらの混合ガ
ス)を用いたドライエッチング処理により所望の形状に
成形する際のエッチングマスクとして使用され、このエ
ッチング処理によりレジスト膜の表面に変質硬化層が形
成されている。
【0009】本発明に係るレジスト膜の除去装置は、フ
ッ素系ガスを導入可能なフッ素導入手段と、該フッ素系
ガスからフッ素ラジカルを生成可能なプラズマ発生手段
とを備えている。
【0010】
【作用】本発明に係るレジスト膜の除去方法によれば、
レジスト膜を除去する際に、フッ素系ガスをプラズマ状
態にして、極めて反応性に富んだフッ素ラジカル(Fラ
ジカル)を生成させ、そのFラジカルに基板表面を曝す
ようにしたため、このFラジカルと、レジスト膜の表面
に生じたシリコン(Si)を含む化合物より成る変質硬
化層のSiとが、化学的に反応を起す。そしてその化合
物からSiが引き離されるので、変質硬化層が更に変質
し、アッシング処理により除去可能となる。
【0011】上記の場合、フッ素系ガスとして、三フッ
化窒素(NF3 )ガスを用いるのが望ましい。またフッ
素系ガスと、酸素(O2 )ガス又はオゾン(O3 )ガス
等の酸素系ガスとを混合した混合ガスを用いることによ
り、Fラジカルに加えて活性な酸素ラジカル(Oラジカ
ル)が生成され、そのOラジカルによりアッシング処理
時のレジスト灰化速度が上昇する。この際、混合ガスに
占めるフッ素系ガスの割合が最大10体積百分率であれ
ば、実際の生産工程に十分適用可能な程度のレジスト灰
化速度が得られる。
【0012】さらに本発明に係るレジスト膜の除去装置
によれば、フッ素系ガスを導入可能なフッ素導入手段
と、該フッ素系ガスからFラジカルを生成可能なプラズ
マ発生手段とを備えているため、フッ素ガスの導入を容
易に行い得ると共に、そのフッ素系ガスを容易にプラズ
マ状態にすることができ、Fラジカルの生成が容易とな
る。
【0013】
【実施例】本発明に係るレジスト膜の除去方法を、例え
ばMOS(Metal Oxide Semiconductor )構造の半導体
装置におけるゲート電極の形成時にエッチングマスクと
して用い、基板表面に残存するレジスト膜を除去する場
合の適用例について説明する。
【0014】図1には、本発明のレジスト膜の除去方法
を適用して、レジスト膜を除去する工程が順に模式的に
示されている。この除去方法は、図1(a)〜(c)に
示すように、半導体装置の製造工程においてエッチング
処理(又はイオン注入処理等)の際に、マスクとして用
いられたレジスト膜1を、NF3 ガス等のフッ素系ガス
のプラズマ中に生成するFラジカル(図中には、単に
「F」と記載する)に曝すことにより除去するようにし
たものである。ここでフッ素系ガスとは、フッ素化合
物、フッ素単体(F2 )或いは、それらを混合して成る
ガスを意味する。以下、詳細に説明する。
【0015】図1(a)に示すように、MOS構造の半
導体装置においては、例えばSi等から成る半導体基板
2の表面に、半導体基板2を熱酸化して得られるSiO
2 等の絶縁膜3が形成され、その絶縁膜3の上に多結晶
シリコンもしくは高融点金属又はそれらの金属間化合物
(シリサイド)から成るゲート電極4が形成されてい
る。このゲート電極4は、次の工程を経ることにより形
成される。即ち、 (1)絶縁膜3の全面に多結晶シリコン等から成る導電
性の膜をCVD(Chemical Vaper Deposition ;気相成
長)法等により積層させる。 (2)その上の全面にレジストを回転塗布し、それをフ
ォトリソグラフィ技術により所望のパターンに成形して
レジスト膜1とする。 (3)それをマスクとしてHBrガス(又はハロゲンガ
ス、或いはHBrガスとハロゲンガスとの混合ガス)等
により前記導電性の膜をドライエッチング処理する。従
って、ゲート電極4を形成した直後には、基板上にはレ
ジスト膜1が残存している。
【0016】このレジスト膜1の表面には、例えばSi
x Bry X (x,yは任意の整数)で表される難気化
性の変質硬化層1aが生成されている。この変質硬化層
1aは、上記エッチング処理の際に、未エッチング部分
が残るのを防ぐためにエッチングの終了時点から20〜
30%程度エッチング処理を過剰に行う、所謂オーバー
エッチングにより生じる。
【0017】そして、例えばマイクロ波放電等によりプ
ラズマ状態にしたNF3 ガスから解離したFラジカルに
より、変質硬化層1aのSix Bry X からSiが引
き抜かれ、変質硬化層1aが気化性に変質する。それに
より、変質硬化層1aは灰化して消滅する。この状態が
図1(b)に示されている。この際、NF3 ガスとO3
ガスとを混合した混合ガスを用いることにより、Fラジ
カルに加えて活性なOラジカル(図中には、単に「O」
と記載する)を生成し、これにより変質硬化層1aの灰
化速度が上昇する。具体的には、混合ガスに占めるNF
3 ガスの割合が最大10体積百分率(vol%)であれ
ば、実際の生産工程に十分適用可能な程度の灰化速度が
得られる。
【0018】さらに、そのままFラジカルおよびOラジ
カルを生成させ続けることにより、図1(c)に示すよ
うに、レジスト膜1が灰化して消滅し、清浄な状態の基
板が得られる。
【0019】次に、上述した除去方法に用いられる除去
装置について説明する。図2には、その除去装置の模式
断面が示されている。この除去装置50は、基板にプラ
ズマを直接曝すことなくレジスト膜1を灰化させる所謂
ダウンストリーム型のプラズマアッシング装置であり、
アッシング室60にNF3 ガスを導入するフッ素導入手
段70と、NF3 ガス等をプラズマ状態にするプラズマ
発生手段80とを備えている。更に、アッシング室60
にO3ガスを導入するオゾン導入手段90を備えてい
る。
【0020】具体的には、アッシング室60は装置本体
51と石英等から成るチャンバー52によって囲まれて
おり、その中央下部には半導体ウェハ100を載置する
アルミニウム等から成るステージ53が設けられてい
る。このステージ53には、ヒーター54が内蔵されて
いる共に、半導体ウェハ100を回転させるモーター等
の駆動源55が連結されている。このヒーター54によ
りステージ53は例えば200℃に保たれる。また装置
本体51には、アッシング室60内のNF3 ガス及びO
3 ガスを排気する排気口56が設けられている。そし
て、その排気口56には図示しない圧力調整弁等が連結
され、アッシング室60内の圧力を調整し得るようにな
っている。具体的にその圧力を例示すると、0.8To
rr(約107Pa)程度である。また、この排気口5
6は図示しない真空ポンプ等が連結されている。
【0021】前記フッ素導入手段70は、アッシング室
60に連通接続された配管71とNF3 ガスを充填した
高圧ガスボンベ72とを備えており、その配管71には
流量を調節する図示しないマスフローコントローラー等
が連結されている。具体的にその流量を例示すると10
SCCM(ml/分)程度である。前記オゾン導入手段
90は、アッシング室60に連通接続された配管91と
3 ガスを生成するオゾン発生装置92とを備えてお
り、その配管91には流量を調節する図示しないマスフ
ローコントローラー等が連結されている。具体的にその
流量を例示すると200SCCM程度である。なお配管
91と配管71とを共通にして、NF3 ガスとO3 ガス
とを予め混合させてからアッシング室60に導入するよ
うにしてもよい。
【0022】前記プラズマ発生手段80は、例えばマイ
クロ波放電によりプラズマを発生させるものであり、マ
イクロ波を伝送する導波管81に図示しないマイクロ波
を発生する発生装置が連結されている。例えば、使用さ
れるマイクロ波の周波数は2.45GHzであり、マイ
クロ波パワーは1.0kWである。プラズマはアッシン
グ室60の上部(その発生領域を符号85で示す。)に
発生する。
【0023】以上の構成による除去装置50によれば、
半導体ウェハ100上のレジスト膜の除去方法において
は、導波管81にマイクロ波を発生させ、マイクロ波放
電によりプラズマを発生させ、アッシング室60内をプ
ラズマ状態とする。この際、上述したように、高圧ガス
ボンベ72から配管71を通って流出されるNF3 ガス
とオゾン発生装置92から配管91を通って流出される
3 ガスとをアッシング室60内で混合させる。そし
て、プラズマ状態にしたNF3 ガスとO3 ガスとの混合
ガスにより前記半導体ウェハ100上のレジスト膜が灰
化して消滅し、除去される。これにより、清浄な半導体
ウェハ100が得られる。
【0024】以上、詳述したように上記実施例によれ
ば、レジスト膜1及び変質硬化層1aが灰化される際
に、NF3 ガス及びO3 ガスをプラズマ状態にすること
により生成されたFラジカル及びOラジカルを用いるよ
うにしたため、変質硬化層1aがアッシング処理により
灰化されて除去可能になる。また実際の生産工程に十分
適用可能な程度のレジスト灰化速度が得られる。従っ
て、アッシング処理時にフッ素系ガスを導入することに
より、変質硬化層を含むレジスト膜等から成るレジスト
膜を一工程で完全に除去することができ、スループット
の向上並びに歩留りの向上を図ることができる。
【0025】以上、本発明者によってなされた発明を実
施例に基づき具体的に説明したが、本発明は上記実施例
に限定されるものではなく、その要旨を逸脱しない範囲
で種々変更可能である。例えば上記実施例において、フ
ッ素系ガスとしてNF3 ガスを用いているが、例えばC
4 ガスやSF6 ガス等のFラジカルを生成可能であれ
ば如何なるガスを用いてもよい。但し、Fラジカルによ
り絶縁膜3からSiが引き離されることに起因する絶縁
膜3の減少量は、他のガスに比べてNF3 ガスを用いる
場合が最も少ないので、ゲート酸化膜の更なる薄膜化に
対応するためには、NF3 ガスを用いるのが望ましい。
また上記実施例においては、O3 ガスを用いているが、
例えばO2 ガス等のOラジカルを生成可能なものであれ
ば如何なるガスを用いてもよい。
【0026】さらにプラズマ発生手段80として、マイ
クロ波放電に代えて高周波電界を印加することにより発
生するグロー放電等を用いてもよい。この場合には、除
去装置50にRFアンプ等を連結して高周波電界を発生
させる。除去装置50の各構成要素については、種々設
計変更可能である。また変質硬化層1aが除去された直
後に、NF3 ガスの供給を停止してO3 ガスのみを供給
し、レジスト膜1がOラジカルのみで灰化されるように
してもよい。このようにすれば、Fラジカルによる絶縁
膜3の減少量を最小限に抑えることができる。
【0027】なお上記実施例においては、本発明に係る
除去方法をゲート電極4の形成時にエッチングマスクと
して用いたレジスト膜1を除去する場合に適用した例に
ついて説明したが、本発明方法は、例えばイオン注入時
のマスクやコンタクト孔の形成時のマスク等、半導体装
置の製造に用いられる種々のマスクとなるレジスト膜の
除去に適用可能である。以上の説明では主として本発明
者によってなされた発明をその背景となった利用分野で
ある半導体装置の製造工程におけるレジスト膜の除去に
適用した場合について説明したが、この発明はそれに限
定されるものではなく、被着対象物に被着させたレジス
ト膜などの有機膜を除去する場合にも有効に利用するこ
とができる。
【0028】
【発明の効果】本発明に係るレジスト膜の除去方法によ
れば、フッ素系ガスをプラズマ状態にして生成させた極
めて反応性に富んだFラジカルに基板表面を曝すように
したため、このFラジカルと、レジスト膜の表面に生じ
たSiを含む化合物より成る変質硬化層のSiとが、科
学的に反応を起こし、これによりその化合物からSiが
引き離されるので、変質孔硬化層が更に変質し、アッシ
ング処理により除去可能となる。従って、アッシング処
理時にフッ素系ガスを導入することにより、変質硬化層
を含むレジスト膜を容易に除去することができ、スルー
プットの向上並びに歩留りの向上を図ることができる。
この際、フッ素系ガスとしてNF3 ガスを用いることに
より、基板の主面に形成したSiO2 より成る薄い熱酸
化膜からSiが引き離されることに起因する熱酸化膜の
減少量を最も少なくすることができ、ゲート酸化膜の更
なる薄膜化にも対応することができる。
【0029】また最大10体積百分率を占めるフッ素系
ガスと、酸素系ガスとを混合した混合ガスを用いること
により、Fラジカルに加えて活性なOラジカルが生成さ
れ、そのOラジカルによりアッシング処理時のレジスト
灰化速度が上昇し、実際の生産工程に十分適応可能な程
度のレジスト灰化速度が得られる。また本発明に係るレ
ジスト膜の除去装置によれば、フッ素系ガスを導入可能
なフッ素導入手段と、該フッ素系ガスからFラジカルを
生成可能なプラズマ発生手段とを備えているため、フッ
素系ガスの導入を容易に行い得ると共に、そのフッ素系
ガスを容易にプラズマ状態にすることができ、従って、
Fラジカルを容易生成させることができる。
【0030】実際にはレジスト膜を被着させた基板を、
マイクロ波放電を生起可能なチャンバー内に置き、その
チャンバー内に、フッ素系ガスを導入すると共に、導波
管を介してマイクロ波を導くことにより、フッ素系ガス
がプラズマ状態となってFラジカルが生成され、そのF
ラジカルによりレジスト膜及びその表面の変質硬化層を
灰化させることができる。特に、HBrガス等を用いた
多結晶シリコン等のドライエッチング処理により生成す
るSix Bry x で表される難気化性の変質硬化層を
除去する場合に有効である。
【図面の簡単な説明】
【図1】本発明のレジスト膜の除去方法によるMOS構
造の半導体装置におけるゲート電極形成用のエッチング
マスクとして用いたレジスト膜除去工程を順に示す模式
断面図である。
【図2】本発明のレジスト膜除去装置の構成例を示す概
略断面図である。
【符号の説明】
1 レジスト膜 1a変質硬化層 2 半導体基板(基板) 3 絶縁膜(酸化シリコン膜) 4 ゲート電極 50 除去装置 52 チャンバー 70 フッ素導入手段 80 プラズマ発生手段

Claims (6)

    【特許請求の範囲】
  1. 【請求項1】 フッ素系ガスをプラズマ状態にし、その
    プラズマ中に生成したフッ素ラジカルに基板表面を曝し
    て、その基板表面上のレジスト膜を除去することを特徴
    とするレジスト膜の除去方法。
  2. 【請求項2】 前記フッ素系ガスは三フッ化窒素ガスで
    あることを特徴とする請求項1に記載のレジスト膜の除
    去方法。
  3. 【請求項3】 前記フッ素系ガスは、該フッ素系ガスを
    含んで成る混合ガスに対して最大10体積百分率を占め
    ることを特徴とする請求項1又は2に記載のレジスト膜
    の除去方法。
  4. 【請求項4】 前記フッ素系ガスを、マイクロ波放電を
    生起可能なチャンバー内に導入して、そのマイクロ波放
    電によりプラズマ状態にすることにより、前記チャンバ
    ー内で前記レジスト膜を灰化させて除去するようにした
    ことを特徴とする請求項1,2又は3に記載のレジスト
    膜の除去方法。
  5. 【請求項5】 前記基板の主面に形成した酸化シリコン
    膜上に積層させた多結晶シリコンもしくは高融点金属又
    はそれらの金属間化合物を、臭化水素ガスもしくはハロ
    ゲンガス又はそれらの混合ガスを用いたドライエッチン
    グ処理することにより、前記レジスト膜の表面に変質硬
    化層が形成されていることを特徴とする請求項1,2,
    3又は4に記載のレジスト膜の除去方法。
  6. 【請求項6】 フッ素系ガスを導入可能なフッ素導入手
    段と、該フッ素系ガスからフッ素ラジカルを生成可能な
    プラズマ発生手段とを備えていることを特徴とするレジ
    スト膜の除去装置。
JP4357680A 1992-12-24 1992-12-24 レジスト膜の除去方法及び除去装置 Withdrawn JPH06196454A (ja)

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Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR100458081B1 (ko) * 1997-06-26 2005-02-23 주식회사 하이닉스반도체 반도체장치의비아홀형성방법
JP2006528418A (ja) * 2003-06-17 2006-12-14 ラム リサーチ コーポレーション 基板からフォトレジストを除去する方法

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