JPH06208452A - 圧縮・伸長バッファの共通化回路 - Google Patents
圧縮・伸長バッファの共通化回路Info
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- JPH06208452A JPH06208452A JP181093A JP181093A JPH06208452A JP H06208452 A JPH06208452 A JP H06208452A JP 181093 A JP181093 A JP 181093A JP 181093 A JP181093 A JP 181093A JP H06208452 A JPH06208452 A JP H06208452A
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Abstract
(57)【要約】
【目的】 データの圧縮と伸長バッファの共通化回路に
関し、複数系統データの多重・分離を行う圧縮・伸長バ
ッファを共通化することを目的とする。 【構成】 複数系統の伝送路から送られてくるデータに
対して、同等のデータ圧縮を行う圧縮バッファ２と同等
のデータ伸長を行う伸長バッファ５を備えたものにおい
て、該圧縮バッファ２の入力側で前記複数系統のデータ
の多重を行う多重部１と、前記圧縮バッファ２の出力側
で前記複数系統のデータの分離を行う分離部３とを備
え、また、前記伸長バッファ５の入力側で前記複数系統
のデータの多重を行う多重部４と、前記伸長バッファ５
の出力側で前記複数系統のデータの分離を行う分離部６
とを設けるように構成する。
関し、複数系統データの多重・分離を行う圧縮・伸長バ
ッファを共通化することを目的とする。 【構成】 複数系統の伝送路から送られてくるデータに
対して、同等のデータ圧縮を行う圧縮バッファ２と同等
のデータ伸長を行う伸長バッファ５を備えたものにおい
て、該圧縮バッファ２の入力側で前記複数系統のデータ
の多重を行う多重部１と、前記圧縮バッファ２の出力側
で前記複数系統のデータの分離を行う分離部３とを備
え、また、前記伸長バッファ５の入力側で前記複数系統
のデータの多重を行う多重部４と、前記伸長バッファ５
の出力側で前記複数系統のデータの分離を行う分離部６
とを設けるように構成する。
Description
【０００１】
【産業上の利用分野】本発明は、連続データおよびバー
ストデータのフレーム変換を有する装置に係り、特にデ
ータの圧縮と伸長バッファの共通化回路に関するもので
ある。
ストデータのフレーム変換を有する装置に係り、特にデ
ータの圧縮と伸長バッファの共通化回路に関するもので
ある。
【０００２】現在、データの送受信を行う装置では伝送
路の効率を向上させるため、データ圧縮とデータ伸長を
行うことは必要不可欠である。また、データ圧縮とデー
タ伸長を行う回路の規模縮小もまた必要不可欠である。
路の効率を向上させるため、データ圧縮とデータ伸長を
行うことは必要不可欠である。また、データ圧縮とデー
タ伸長を行う回路の規模縮小もまた必要不可欠である。
【０００３】
【従来の技術】データの圧縮と伸長を行うために、それ
ぞれ圧縮バッファと伸長バッファが必要になる。以下、
図９を用いて当該圧縮バッファと伸長バッファの回路を
説明する。
ぞれ圧縮バッファと伸長バッファが必要になる。以下、
図９を用いて当該圧縮バッファと伸長バッファの回路を
説明する。
【０００４】図９は従来の一実施例の回路を示す図であ
り、データ圧縮とデータ伸長を取り扱うため、例えば２
系統の伝送路が２系統ある場合である。図中、31は第１
圧縮バッファ、32は第２圧縮バッファである。また、33
は第１伸長バッファ、34は第２伸長バッファである。
り、データ圧縮とデータ伸長を取り扱うため、例えば２
系統の伝送路が２系統ある場合である。図中、31は第１
圧縮バッファ、32は第２圧縮バッファである。また、33
は第１伸長バッファ、34は第２伸長バッファである。
【０００５】図９の例において、２系統の伝送路が２系
統ある場合にデータの圧縮・伸長を行う時は、２系統そ
れぞれに第１圧縮バッファ31と第２圧縮バッファ32およ
び第１伸長バッファ33と第２伸長バッファ34が必要にな
る。
統ある場合にデータの圧縮・伸長を行う時は、２系統そ
れぞれに第１圧縮バッファ31と第２圧縮バッファ32およ
び第１伸長バッファ33と第２伸長バッファ34が必要にな
る。
【０００６】図９に示す回路において、連続データであ
る２系統データの送信を行う場合、２系統ある送信デー
タの中の一つの第１送信入力データ（ＴｘＩＮ１）につ
いては、送信書き込みクロック（ＴｘＷＣＫ）を用いて
該ＴｘＩＮ１を第１圧縮バッファ31に書き込み、該Ｔｘ
ＩＮ１を送信読み出しクロック（ＴｘＲＣＫ）を用いて
第１圧縮バッファ31からバーストデータである第１送信
出力データ（ＴｘＯＵＴ１）として読み出している。
る２系統データの送信を行う場合、２系統ある送信デー
タの中の一つの第１送信入力データ（ＴｘＩＮ１）につ
いては、送信書き込みクロック（ＴｘＷＣＫ）を用いて
該ＴｘＩＮ１を第１圧縮バッファ31に書き込み、該Ｔｘ
ＩＮ１を送信読み出しクロック（ＴｘＲＣＫ）を用いて
第１圧縮バッファ31からバーストデータである第１送信
出力データ（ＴｘＯＵＴ１）として読み出している。
【０００７】また、連続データである他の第２送信入力
データ（ＴｘＩＮ２）については、前記ＴｘＷＣＫを用
いて該ＴｘＩＮ２を第２圧縮バッファ32に書き込み、該
ＴｘＩＮ２を前記ＴｘＲＣＫを用いて第２圧縮バッファ
32からバーストデータである第２送信出力データ（Ｔｘ
ＯＵＴ２）として読み出している。
データ（ＴｘＩＮ２）については、前記ＴｘＷＣＫを用
いて該ＴｘＩＮ２を第２圧縮バッファ32に書き込み、該
ＴｘＩＮ２を前記ＴｘＲＣＫを用いて第２圧縮バッファ
32からバーストデータである第２送信出力データ（Ｔｘ
ＯＵＴ２）として読み出している。
【０００８】同様に、２系統データの受信を行う場合、
バーストデータである２系統受信データ中の一つの第１
受信入力データ（ＲｘＩＮ１）については、受信書き込
みクロック（ＲｘＷＣＫ）を用いて第１伸長バッファ33
に書き込み、受信読み出しクロック（ＲｘＲＣＫ）を用
いて第１伸長バッファ33から連続データである第１受信
出力データ（ＲｘＯＵＴ１）として読み出している。
バーストデータである２系統受信データ中の一つの第１
受信入力データ（ＲｘＩＮ１）については、受信書き込
みクロック（ＲｘＷＣＫ）を用いて第１伸長バッファ33
に書き込み、受信読み出しクロック（ＲｘＲＣＫ）を用
いて第１伸長バッファ33から連続データである第１受信
出力データ（ＲｘＯＵＴ１）として読み出している。
【０００９】また、他の第２受信入力データ（ＲｘＩＮ
２）については、前記ＲｘＷＣＫを用いて第２伸長バッ
ファ34に書き込み、前記ＲｘＲＣＫを用いて第２伸長ッ
ファ34から第２受信出力データ（ＲｘＯＵＴ２）として
読み出している。
２）については、前記ＲｘＷＣＫを用いて第２伸長バッ
ファ34に書き込み、前記ＲｘＲＣＫを用いて第２伸長ッ
ファ34から第２受信出力データ（ＲｘＯＵＴ２）として
読み出している。
【００１０】
【発明が解決しようとする課題】従って、従来技術にお
いては、例えば同一構成の回路を２つ持つことになり、
回路規模が２倍になるという課題がある。
いては、例えば同一構成の回路を２つ持つことになり、
回路規模が２倍になるという課題がある。
【００１１】本発明は、例えば２系統の伝送路のデータ
の圧縮・伸長を行う場合において、データの多重・分離
を行うことで圧縮・伸長バッファを共通化し、回路規模
の縮小を図ることを目的とする。
の圧縮・伸長を行う場合において、データの多重・分離
を行うことで圧縮・伸長バッファを共通化し、回路規模
の縮小を図ることを目的とする。
【００１２】
【課題を解決するための手段】上記の目的を達成するた
め、図１に示すごとく、複数系統の伝送路から送られて
くるデータに対して、同等のデータ圧縮を行う圧縮バッ
ファ２と同等のデータ伸長を行う伸長バッファ５を備え
たものにおいて、該圧縮バッファ２の入力側に接続され
ていて前記複数系統のデータの多重を行う多重部１と、
前記圧縮バッファ２の出力側に接続されていて前記複数
系統のデータの分離を行う分離部３を備え、また、前記
伸長バッファ５の入力側に接続されていて前記複数系統
のデータの多重を行う多重部４と、前記伸長バッファ５
の出力側に接続されていて前記複数系統のデータの分離
を行う分離部６を設けるように構成する。
め、図１に示すごとく、複数系統の伝送路から送られて
くるデータに対して、同等のデータ圧縮を行う圧縮バッ
ファ２と同等のデータ伸長を行う伸長バッファ５を備え
たものにおいて、該圧縮バッファ２の入力側に接続され
ていて前記複数系統のデータの多重を行う多重部１と、
前記圧縮バッファ２の出力側に接続されていて前記複数
系統のデータの分離を行う分離部３を備え、また、前記
伸長バッファ５の入力側に接続されていて前記複数系統
のデータの多重を行う多重部４と、前記伸長バッファ５
の出力側に接続されていて前記複数系統のデータの分離
を行う分離部６を設けるように構成する。
【００１３】
【作用】本発明は図１〜図３に示すように、データの圧
縮を行う場合は、連続データである２系統のＴｘＩＮ１
(a) とＴｘＩＮ２(b) を多重部１に加え、ＴｘＷＣＫを
用いて多重化した多重データ(c) をつくり、圧縮バッフ
ァ２に前記ＴｘＷＣＫを加えて該多重データ(c) から圧
縮データ(d) をつくり、該圧縮データ(d) を圧縮バッフ
ァ２に書き込む。
縮を行う場合は、連続データである２系統のＴｘＩＮ１
(a) とＴｘＩＮ２(b) を多重部１に加え、ＴｘＷＣＫを
用いて多重化した多重データ(c) をつくり、圧縮バッフ
ァ２に前記ＴｘＷＣＫを加えて該多重データ(c) から圧
縮データ(d) をつくり、該圧縮データ(d) を圧縮バッフ
ァ２に書き込む。
【００１４】そして、該圧縮バッファ２に書き込まれた
圧縮データ(d) をＴｘＲＣＫを用いて分離部３に読み出
し、該分離部３において前記ＴｘＲＣＫを用いてデータ
分離されたバーストデータであるＴｘＯＵＴ１(e) とＴ
ｘＯＵＴ２(f) をつくり出力する。
圧縮データ(d) をＴｘＲＣＫを用いて分離部３に読み出
し、該分離部３において前記ＴｘＲＣＫを用いてデータ
分離されたバーストデータであるＴｘＯＵＴ１(e) とＴ
ｘＯＵＴ２(f) をつくり出力する。
【００１５】また、データの伸長の場合には、連続デー
タである２系統のＲｘＩＮ１(g) とＲｘＩＮ２(h) を多
重部４に加え、ＲｘＷＣＫを用いて多重化された多重デ
ータ(i) をつくり、伸長バッファ５に前記ＲｘＷＣＫを
加えて該多重データ(i) の伸長を行って伸長データ(j)
をつくり、該伸長データ(j) を伸長バッファ５に書き込
む。
タである２系統のＲｘＩＮ１(g) とＲｘＩＮ２(h) を多
重部４に加え、ＲｘＷＣＫを用いて多重化された多重デ
ータ(i) をつくり、伸長バッファ５に前記ＲｘＷＣＫを
加えて該多重データ(i) の伸長を行って伸長データ(j)
をつくり、該伸長データ(j) を伸長バッファ５に書き込
む。
【００１６】そして、該伸長バッファ５に書き込まれた
伸長データ(j) をＲｘＲＣＫを用いて分離部６に読み出
し、該分離部６において前記ＲｘＲＣＫを用いてデータ
分離したバーストデータであるＲｘＯＵＴ１(k) とＲｘ
ＯＵＴ２(l) をつくり出力する。
伸長データ(j) をＲｘＲＣＫを用いて分離部６に読み出
し、該分離部６において前記ＲｘＲＣＫを用いてデータ
分離したバーストデータであるＲｘＯＵＴ１(k) とＲｘ
ＯＵＴ２(l) をつくり出力する。
【００１７】従って、２系統の伝送路の圧縮バッファと
伸長バッファの回路についての共通化ができ、当該回路
規模の削減を図ることができる。
伸長バッファの回路についての共通化ができ、当該回路
規模の削減を図ることができる。
【００１８】
【実施例】以下、図４と図５〜図８により本発明の実施
例を説明する。図４は本発明の一実施例の圧縮バッファ
と伸長バッファの回路を示す図であり、（Ａ）は圧縮バ
ッファの部分を示し、（Ｂ）は伸長バッファの部分を示
す。
例を説明する。図４は本発明の一実施例の圧縮バッファ
と伸長バッファの回路を示す図であり、（Ａ）は圧縮バ
ッファの部分を示し、（Ｂ）は伸長バッファの部分を示
す。
【００１９】図４において、11,12,14,16 〜20および2
1,22,24,26 〜30はフリップフロップ回路（ＦＦ）であ
る。また、13と23は２つの信号より１つの信号を選択す
る２−１セレクタであり、そして、15は圧縮バッファ、
25は伸長バッファである。
1,22,24,26 〜30はフリップフロップ回路（ＦＦ）であ
る。また、13と23は２つの信号より１つの信号を選択す
る２−１セレクタであり、そして、15は圧縮バッファ、
25は伸長バッファである。
【００２０】また、図５〜図８は本発明のタイミングを
示す図であり、図５は本発明の一実施例の圧縮バッファ
のタイミングを示す図（その１）であり、図６は本発明
の一実施例の圧縮バッファのタイミングを示す図（その
２）である。
示す図であり、図５は本発明の一実施例の圧縮バッファ
のタイミングを示す図（その１）であり、図６は本発明
の一実施例の圧縮バッファのタイミングを示す図（その
２）である。
【００２１】そして、図７は本発明の一実施例の伸長バ
ッファのタイミングを示す図（その１）であり、図８は
本発明の一実施例の伸長バッファのタイミングを示す図
（その２）である。
ッファのタイミングを示す図（その１）であり、図８は
本発明の一実施例の伸長バッファのタイミングを示す図
（その２）である。
【００２２】また、(a1)〜(a16) は該圧縮バッファの各
部位のデータを示し、(b1)〜(b16)は該伸長バッファの
各部位のデータを示す。圧縮バッファについて、図４
（Ａ）と図５と図６を用いて説明する。
部位のデータを示し、(b1)〜(b16)は該伸長バッファの
各部位のデータを示す。圧縮バッファについて、図４
（Ａ）と図５と図６を用いて説明する。
【００２３】２つのＴｘＩＮ１(a1)とＴｘＩＮ２(a2)
の例えば0.4Kビット／秒(bps) の速度をもつ連続データ
を、それぞれのＦＦ11とＦＦ12において同一速度の送信
クロックである0.4KＴＷＣＫ(a3)で叩いて同一速度をも
つ連続データ(a4)と連続データ(a5)をつくる。
の例えば0.4Kビット／秒(bps) の速度をもつ連続データ
を、それぞれのＦＦ11とＦＦ12において同一速度の送信
クロックである0.4KＴＷＣＫ(a3)で叩いて同一速度をも
つ連続データ(a4)と連続データ(a5)をつくる。
【００２４】２−１セレクタ13において、前記0.4KＴ
ＷＣＫ(a3)で２者択一して２多重された連続データ(a6)
をつくり、ＦＦ14において0.8Kbps 速度をもつ0.8KＴＷ
ＣＫ(a7)で叩き直して同一速度の連続データ(a8)をつく
り、該データ(a8)を0.8KＴＷＣＫ(a7)を用いて圧縮バッ
ファ15に書き込む。
ＷＣＫ(a3)で２者択一して２多重された連続データ(a6)
をつくり、ＦＦ14において0.8Kbps 速度をもつ0.8KＴＷ
ＣＫ(a7)で叩き直して同一速度の連続データ(a8)をつく
り、該データ(a8)を0.8KＴＷＣＫ(a7)を用いて圧縮バッ
ファ15に書き込む。
【００２５】圧縮バッファ15から8Kbps の速度をもつ
8KＴＲＣＫ(a9)を用いて同一速度のバーストデータ(a1
0) を読み出し、ＦＦ16において8KＴＲＣＫ(a9)で該バ
ーストデータ(a10) を叩き直して同一速度のバーストデ
ータ(a11) をつくる。
8KＴＲＣＫ(a9)を用いて同一速度のバーストデータ(a1
0) を読み出し、ＦＦ16において8KＴＲＣＫ(a9)で該バ
ーストデータ(a10) を叩き直して同一速度のバーストデ
ータ(a11) をつくる。
【００２６】4Kbps の速度をもつ4KＴＲＣＫ(a12) の
立ち上がりと立ち下がりを用いてＦＦ17とＦＦ18から同
一速度のバーストデータ(a13),(a14) に分離する。そし
て、ＦＦ19とＦＦ20において4KＴＲＣＫ(a12) で叩き直
し、同一速度のバーストデータであるＴｘＯＵＴ１(a1
5) とＴｘＯＵＴ２(a16) を出力する。
立ち上がりと立ち下がりを用いてＦＦ17とＦＦ18から同
一速度のバーストデータ(a13),(a14) に分離する。そし
て、ＦＦ19とＦＦ20において4KＴＲＣＫ(a12) で叩き直
し、同一速度のバーストデータであるＴｘＯＵＴ１(a1
5) とＴｘＯＵＴ２(a16) を出力する。
【００２７】次に、伸長バッファについて、図４（Ｂ）
と図７と図８を用いて説明する。 ２つのＲｘＩＮ１(b1)とＲｘＩＮ２(b2)の例えば4Kbp
s の速度（前記ＴｘＩＮ１(a1)とＴｘＩＮ２(a2)と同一
速度）をもつバーストデータを、それぞれのＦＦ21とＦ
Ｆ22において同一速度の受信クロックである4KＲＷＣＫ
(b3)で叩いて同一速度をもつバーストデータ(b4)とバー
ストデータ(b5)をつくる。
と図７と図８を用いて説明する。 ２つのＲｘＩＮ１(b1)とＲｘＩＮ２(b2)の例えば4Kbp
s の速度（前記ＴｘＩＮ１(a1)とＴｘＩＮ２(a2)と同一
速度）をもつバーストデータを、それぞれのＦＦ21とＦ
Ｆ22において同一速度の受信クロックである4KＲＷＣＫ
(b3)で叩いて同一速度をもつバーストデータ(b4)とバー
ストデータ(b5)をつくる。
【００２８】２−１セレクタ23において、前記4KＲＷ
ＣＫ(b3)で２者択一して２多重されたバーストデータ(b
6)をつくり、ＦＦ24において8Kbps 速度の8KＲＷＣＫ(b
7)で叩き直して同一速度のバーストデータ(b8)をつく
り、該データ(b8)を8KＲＷＣＫ(b7)を用いて伸長バッフ
ァ25に書き込む。
ＣＫ(b3)で２者択一して２多重されたバーストデータ(b
6)をつくり、ＦＦ24において8Kbps 速度の8KＲＷＣＫ(b
7)で叩き直して同一速度のバーストデータ(b8)をつく
り、該データ(b8)を8KＲＷＣＫ(b7)を用いて伸長バッフ
ァ25に書き込む。
【００２９】伸長バッファ25から0.8Kbps の速度をも
つ0.8KＲＲＣＫ(b9)を用いて同一速度の連続データ(b1
0) を読み出し、ＦＦ26において0.8KＲＲＣＫ(b9)で該
連続データ(b10) を叩き直して同一速度の連続データ(b
11) をつくる。
つ0.8KＲＲＣＫ(b9)を用いて同一速度の連続データ(b1
0) を読み出し、ＦＦ26において0.8KＲＲＣＫ(b9)で該
連続データ(b10) を叩き直して同一速度の連続データ(b
11) をつくる。
【００３０】0.4Kbps の速度をもつ0.4KＲＲＣＫ(b1
2) の立ち上がりと立ち下がりを用いてＦＦ27とＦＦ28
から同一速度の連続データ(b13),(b14) に分離する。そ
して、ＦＦ29とＦＦ30において0.4KＲＲＣＫ(b12) で叩
き直し、同一速度の連続データであるＲｘＯＵＴ１(b1
5) とＲｘＯＵＴ２(b16) を出力する。
2) の立ち上がりと立ち下がりを用いてＦＦ27とＦＦ28
から同一速度の連続データ(b13),(b14) に分離する。そ
して、ＦＦ29とＦＦ30において0.4KＲＲＣＫ(b12) で叩
き直し、同一速度の連続データであるＲｘＯＵＴ１(b1
5) とＲｘＯＵＴ２(b16) を出力する。
【００３１】
【発明の効果】以上の説明から明らかなように本発明に
よれば、２系統のデータの圧縮・伸長を行う場合、従来
の回路規模より削減して実現することが可能になるとい
う効果を奏する。
よれば、２系統のデータの圧縮・伸長を行う場合、従来
の回路規模より削減して実現することが可能になるとい
う効果を奏する。
【図１】 本発明の原理構成の回路を示す図である。
【図２】 本発明におけるデータの圧縮タイミングの原
理を示す図である。
理を示す図である。
【図３】 本発明におけるデータの伸長タイミングの原
理を示す図である。
理を示す図である。
【図４】 本発明の一実施例の圧縮バッファと伸長バッ
ファの回路を示す図である。
ファの回路を示す図である。
【図５】 本発明の一実施例の圧縮バッファのタイミン
グを示す図（その１）である。
グを示す図（その１）である。
【図６】 本発明の一実施例の圧縮バッファのタイミン
グを示す図（その２）である。
グを示す図（その２）である。
【図７】 本発明の一実施例の伸長バッファのタイミン
グを示す図（その１）である。
グを示す図（その１）である。
【図８】 本発明の一実施例の伸長バッファのタイミン
グを示す図（その２）である。
グを示す図（その２）である。
【図９】 従来の一実施例の回路を示す図である。
１、４は多重部 ３、６は分離部 ２は圧縮バッファ ５は伸長バッファ
Claims (1)
- 【請求項１】 複数系統の伝送路から送られてくるデー
タに対して、同等のデータ圧縮を行う圧縮バッファ(2)
と同等のデータ伸長を行う伸長バッファ(5)を備えた回
路において、 該圧縮バッファ(2) の入力側に接続されていて前記複数
系統のデータの多重を行う多重部(1) と、 前記圧縮バッファ(2) の出力側に接続されていて前記複
数系統のデータの分離を行う分離部(3) を備え、 また、前記伸長バッファ(5) の入力側に接続されていて
前記複数系統のデータの多重を行う多重部(4) と、前記
伸長バッファ(5) の出力側に接続されていて前記複数系
統のデータの分離を行う分離部(6) を設けたことを特徴
とする圧縮・伸長バッファの共通化回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP181093A JPH06208452A (ja) | 1993-01-08 | 1993-01-08 | 圧縮・伸長バッファの共通化回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP181093A JPH06208452A (ja) | 1993-01-08 | 1993-01-08 | 圧縮・伸長バッファの共通化回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH06208452A true JPH06208452A (ja) | 1994-07-26 |
Family
ID=11511934
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP181093A Withdrawn JPH06208452A (ja) | 1993-01-08 | 1993-01-08 | 圧縮・伸長バッファの共通化回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH06208452A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2012085081A (ja) * | 2010-10-12 | 2012-04-26 | Nippon Telegr & Teleph Corp <Ntt> | 制御フレーム処理回路 |
-
1993
- 1993-01-08 JP JP181093A patent/JPH06208452A/ja not_active Withdrawn
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2012085081A (ja) * | 2010-10-12 | 2012-04-26 | Nippon Telegr & Teleph Corp <Ntt> | 制御フレーム処理回路 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A300 | Withdrawal of application because of no request for examination |
Free format text: JAPANESE INTERMEDIATE CODE: A300 Effective date: 20000404 |