JPH06245500A - 高圧電源回路 - Google Patents
高圧電源回路Info
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- JPH06245500A JPH06245500A JP5030070A JP3007093A JPH06245500A JP H06245500 A JPH06245500 A JP H06245500A JP 5030070 A JP5030070 A JP 5030070A JP 3007093 A JP3007093 A JP 3007093A JP H06245500 A JPH06245500 A JP H06245500A
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- 238000004804 winding Methods 0.000 description 19
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- 230000004048 modification Effects 0.000 description 2
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Landscapes
- Dc-Dc Converters (AREA)
- Inverter Devices (AREA)
- Microwave Tubes (AREA)
Abstract
(57)【要約】
【目的】 小規模で低損失でありながら，出力電圧の負
荷変動を容易に抑圧できる高圧電源回路を提供し，この
高圧電源回路を進行波管に適用すること。 【構成】 高圧電源回路は，帰還電圧制御手段を備えて
いる。この帰還電圧制御手段は，一端がブリーダ抵抗１
８に接続されたブリーダ回路８と，ピークチャージ用の
コンデンサ７とを備えている。ブリーダ抵抗１８に接続
されたブリーダ回路８は，アノード電源４のオン・オフ
動作に連動してオン・オフし，アノード電源４がオンの
際にブリーダ抵抗１８に通電して帰還電圧を低減させ
る。また，ピークチャージ用のコンデンサ７は，アノー
ド電源４のオフの際に，前記帰還電圧よりも高い電圧を
帰還させる。
荷変動を容易に抑圧できる高圧電源回路を提供し，この
高圧電源回路を進行波管に適用すること。 【構成】 高圧電源回路は，帰還電圧制御手段を備えて
いる。この帰還電圧制御手段は，一端がブリーダ抵抗１
８に接続されたブリーダ回路８と，ピークチャージ用の
コンデンサ７とを備えている。ブリーダ抵抗１８に接続
されたブリーダ回路８は，アノード電源４のオン・オフ
動作に連動してオン・オフし，アノード電源４がオンの
際にブリーダ抵抗１８に通電して帰還電圧を低減させ
る。また，ピークチャージ用のコンデンサ７は，アノー
ド電源４のオフの際に，前記帰還電圧よりも高い電圧を
帰還させる。
Description
【０００１】
【産業上の利用分野】本発明は，スイッチング・レギュ
レータを使用した高圧電源回路に関し，特に，高圧トラ
ンスの巻線による負帰還閉ループを有する進行波管用電
源回路に関する。
レータを使用した高圧電源回路に関し，特に，高圧トラ
ンスの巻線による負帰還閉ループを有する進行波管用電
源回路に関する。
【０００２】
【従来の技術】図４は，従来例に係る進行波管用電源回
路を示すブロック図である。一般に進行波管はアノード
電極，カソード電極，及びヘリックス電極を備えてお
り，図示された高圧電源回路は，進行波管の各電極に電
源を供給するのに使用される。この種の電源回路は，１
次巻線側と２次巻線側とを備えた高圧トランス２を有
し，その１次巻線側に負帰還用巻線５が配置されてい
る。また，この巻線５に並列に接続された電流回路を経
て，パルス幅変調回路６に接続され，パルス幅変調回路
６の出力は，１次巻線側に接続された高圧インバータ１
に入力されている。
路を示すブロック図である。一般に進行波管はアノード
電極，カソード電極，及びヘリックス電極を備えてお
り，図示された高圧電源回路は，進行波管の各電極に電
源を供給するのに使用される。この種の電源回路は，１
次巻線側と２次巻線側とを備えた高圧トランス２を有
し，その１次巻線側に負帰還用巻線５が配置されてい
る。また，この巻線５に並列に接続された電流回路を経
て，パルス幅変調回路６に接続され，パルス幅変調回路
６の出力は，１次巻線側に接続された高圧インバータ１
に入力されている。
【０００３】一方，２次巻線側には，第１及び第２の巻
線が設けられており，これら巻線の夫々は，整流回路及
び平滑コンデンサを備えた第１及び第２の整流・平滑回
路３ａ，３ｂに接続されている。
線が設けられており，これら巻線の夫々は，整流回路及
び平滑コンデンサを備えた第１及び第２の整流・平滑回
路３ａ，３ｂに接続されている。
【０００４】一方，第１の整流・平滑回路３ａの一端
は，シリーズレギュレータ１５を経て，ヘリックス電極
用端子１０に接続されている。また，第１の整流・平滑
回路３ａの他端は，第２の整流・平滑回路３ｂの一端と
共通に，コレクタ電極用端子１１に接続されている。一
方，第２の整流・平滑回路３ｂの他端は，ヒータ／カソ
ード電極用端子１３に接続されている。
は，シリーズレギュレータ１５を経て，ヘリックス電極
用端子１０に接続されている。また，第１の整流・平滑
回路３ａの他端は，第２の整流・平滑回路３ｂの一端と
共通に，コレクタ電極用端子１１に接続されている。一
方，第２の整流・平滑回路３ｂの他端は，ヒータ／カソ
ード電極用端子１３に接続されている。
【０００５】第１の整流・平滑回路３ａの一端と第２の
整流・平滑回路３ｂの他端間に，アノード電源４が接続
され，第１の整流・平滑回路３ａの一端は接地されてい
る。
整流・平滑回路３ｂの他端間に，アノード電源４が接続
され，第１の整流・平滑回路３ａの一端は接地されてい
る。
【０００６】尚，第１の整流・平滑回路３ａ及び第２の
整流・平滑回路３ｂには，並列に夫々ダミー付加１４
ａ，１４ｂが接続されている。
整流・平滑回路３ｂには，並列に夫々ダミー付加１４
ａ，１４ｂが接続されている。
【０００７】このような構成の従来の進行波管用高圧電
源においては，図４に示すように，高圧トランス２の２
次側出力電圧は，１次側の高圧用インバータ１によるパ
ルス幅を制御するため負帰還用巻線５の出力電圧をパル
ス幅変調回路６により検出して，高圧用インバータ１の
スイッチング駆動パルスのデューティレシオを制御する
ことにより，安定化される。
源においては，図４に示すように，高圧トランス２の２
次側出力電圧は，１次側の高圧用インバータ１によるパ
ルス幅を制御するため負帰還用巻線５の出力電圧をパル
ス幅変調回路６により検出して，高圧用インバータ１の
スイッチング駆動パルスのデューティレシオを制御する
ことにより，安定化される。
【０００８】この制御方式は，２次側と絶縁された負帰
還閉ループを容易に実現できる利点がある。その半面，
２次側高圧回路から直接制御される形式ではないため，
アノード電源４の投入前の軽負荷状態では，出力電圧が
急激に上昇する。
還閉ループを容易に実現できる利点がある。その半面，
２次側高圧回路から直接制御される形式ではないため，
アノード電源４の投入前の軽負荷状態では，出力電圧が
急激に上昇する。
【０００９】
【発明が解決しようとする課題】このように，従来の電
源回路では，軽負荷時に高圧トランス２の立上り応答に
おける制動が不足し，結果的にトランス出力電圧にオー
バーシュートが生じるのを避けることができない。
源回路では，軽負荷時に高圧トランス２の立上り応答に
おける制動が不足し，結果的にトランス出力電圧にオー
バーシュートが生じるのを避けることができない。
【００１０】更には，付加電流が少ないために，第１及
び第２の整流・平滑回路３ａ，３ｂがコンデンサインプ
ット型として動作し，トランス出力電圧のオーバーシュ
ート分をピークチャージすることになり，２次側高圧回
路の出力電圧は，定常負荷時の１．５倍近くまで上昇す
る。ところが，１次側の負帰還回路の制御は，定常負荷
時の入力電圧変動分しか抑圧できない。
び第２の整流・平滑回路３ａ，３ｂがコンデンサインプ
ット型として動作し，トランス出力電圧のオーバーシュ
ート分をピークチャージすることになり，２次側高圧回
路の出力電圧は，定常負荷時の１．５倍近くまで上昇す
る。ところが，１次側の負帰還回路の制御は，定常負荷
時の入力電圧変動分しか抑圧できない。
【００１１】従って，図４に示すように，整流・平滑回
路３ａ，３ｂの夫々の出力端子間にダミー負荷１４を接
続し，ブリーダ電流を流してピークチャージを抑えた
り，シリーズレギュレータ１５により出力電圧の上昇分
を低下させていた。
路３ａ，３ｂの夫々の出力端子間にダミー負荷１４を接
続し，ブリーダ電流を流してピークチャージを抑えた
り，シリーズレギュレータ１５により出力電圧の上昇分
を低下させていた。
【００１２】しかしながら，これらの方法では，回路規
模が大きくなるという問題があった。また，出力電圧が
高電圧であるため，少量のブリーダ電流を流しても，ダ
ミー負荷１４やシリーズレギュレータ１５で数ワットの
内部損失を生じ，電力効率の低下を招くという欠点があ
った。
模が大きくなるという問題があった。また，出力電圧が
高電圧であるため，少量のブリーダ電流を流しても，ダ
ミー負荷１４やシリーズレギュレータ１５で数ワットの
内部損失を生じ，電力効率の低下を招くという欠点があ
った。
【００１３】そこで，本発明の第１の技術的課題は，小
規模で低損失でありながら，出力電圧の負荷変動を容易
に抑圧できる高圧電源回路を提供することにある。
規模で低損失でありながら，出力電圧の負荷変動を容易
に抑圧できる高圧電源回路を提供することにある。
【００１４】また，本発明の第２の技術的課題は，前記
高圧電源回路を進行波管に適用することにある。
高圧電源回路を進行波管に適用することにある。
【００１５】
【課題を解決するための手段】本発明によれば，１次側
及び２次側を備えた高圧トランスと，前記１次側に設け
られた負帰還回路及び前記２次側に設けられた所定の電
圧を供給する電源を備え，前記電源はオン・オフ動作を
行うことができる高圧電源回路において，前記電源のオ
ン動作の際に前記負帰還回路に帰還される帰還電圧を低
減させ，且つ前記電源のオフの際に，前記帰還電圧を上
昇させる帰還電圧制御手段とを備えたことを特徴とする
高圧電源回路が得られる。
及び２次側を備えた高圧トランスと，前記１次側に設け
られた負帰還回路及び前記２次側に設けられた所定の電
圧を供給する電源を備え，前記電源はオン・オフ動作を
行うことができる高圧電源回路において，前記電源のオ
ン動作の際に前記負帰還回路に帰還される帰還電圧を低
減させ，且つ前記電源のオフの際に，前記帰還電圧を上
昇させる帰還電圧制御手段とを備えたことを特徴とする
高圧電源回路が得られる。
【００１６】本発明によれば，前記高圧電源回路におい
て，前記負帰還回路は，前記帰還電圧のパルス幅を前記
帰還電圧に応じて変調するパルス幅変調手段と，前記パ
ルス幅変調手段からの入力に基づいて前記帰還電圧とは
逆極性の電圧を出力する電圧極性逆転手段とを備えてい
ることを特徴とする高圧電源回路が得られる。
て，前記負帰還回路は，前記帰還電圧のパルス幅を前記
帰還電圧に応じて変調するパルス幅変調手段と，前記パ
ルス幅変調手段からの入力に基づいて前記帰還電圧とは
逆極性の電圧を出力する電圧極性逆転手段とを備えてい
ることを特徴とする高圧電源回路が得られる。
【００１７】本発明によれば，前記高圧電源回路におい
て，前記２次側には，整流平滑回路を備えていることを
特徴とする高圧電源回路が得られる。
て，前記２次側には，整流平滑回路を備えていることを
特徴とする高圧電源回路が得られる。
【００１８】本発明によれば，前記高圧電源回路におい
て，前記高圧トランスの２次側には，前記整流平滑回路
の直列に接続されたレギュレータ手段を備えていること
を特徴とする高圧電源回路が得られる。
て，前記高圧トランスの２次側には，前記整流平滑回路
の直列に接続されたレギュレータ手段を備えていること
を特徴とする高圧電源回路が得られる。
【００１９】本発明によれば，前記高圧電源回路におい
て，前記帰還制御手段は，前記帰還電圧を上昇させるた
めのピークチャージコンデンサを有する一方，ブリーダ
抵抗と，前記ブリーダ抵抗に接続され，前記ブリーダ抵
抗をオン・オフ動作をするブリーダ回路とを備え，前記
ブリーダ抵抗及びブリーダ回路により，前記帰還電圧を
低減させる構成を有し，且つ前記ブリーダ回路に接続さ
れ，前記電源のオン・オフ動作に連動して前記ブリーダ
回路をオン・オフさせるオン・オフ制御を行うシーケン
ス回路とを有していることを特徴とする高圧電源回路が
得られる。
て，前記帰還制御手段は，前記帰還電圧を上昇させるた
めのピークチャージコンデンサを有する一方，ブリーダ
抵抗と，前記ブリーダ抵抗に接続され，前記ブリーダ抵
抗をオン・オフ動作をするブリーダ回路とを備え，前記
ブリーダ抵抗及びブリーダ回路により，前記帰還電圧を
低減させる構成を有し，且つ前記ブリーダ回路に接続さ
れ，前記電源のオン・オフ動作に連動して前記ブリーダ
回路をオン・オフさせるオン・オフ制御を行うシーケン
ス回路とを有していることを特徴とする高圧電源回路が
得られる。
【００２０】本発明によれば，前記したいずれか記載の
電源回路において，前記電源はアノード電源であり，前
記高圧トランスの２次側が，進行波管に接続されている
ことを特徴とする進行波管用電源回路が得られる。
電源回路において，前記電源はアノード電源であり，前
記高圧トランスの２次側が，進行波管に接続されている
ことを特徴とする進行波管用電源回路が得られる。
【００２１】
【作用】本発明において，帰還電圧低減手段は，高圧ト
ランスの２次側に備えられた所定の電圧を供給する電源
のオン・オフ動作に連動して帰還電圧を低減させる。一
方，帰還電圧上昇手段は，アノード電源のオフの際に，
前記帰還電圧を上昇させる。
ランスの２次側に備えられた所定の電圧を供給する電源
のオン・オフ動作に連動して帰還電圧を低減させる。一
方，帰還電圧上昇手段は，アノード電源のオフの際に，
前記帰還電圧を上昇させる。
【００２２】
【実施例】以下，本発明の実施例を図面を参照して説明
する。
する。
【００２３】図１は，本発明の実施例に係る進行波管用
電源回路を示すブロック図である。
電源回路を示すブロック図である。
【００２４】図１で示すように，高圧トランス２の一つ
の１次巻線に高圧用インバータ１が接続されている。ま
た，もう一つの１次巻線（帰還巻線５）は，電圧を帰還
させるためのもので，整流回路，これに並列に接続され
帰還した電圧をピークチャージして上昇させる帰還電圧
上昇手段として設けられたコンデンサ７，及び，一端に
ブリーダ抵抗１８を有するブリーダ回路８を介して，パ
ルス幅変調手段であるパルス幅変調回路６に接続されて
いる。パルス幅変調回路６の出力は，その出力の極性，
即ち，帰還電圧の極性を逆転させる電圧逆転手段である
高圧用インバータ１に入力される。
の１次巻線に高圧用インバータ１が接続されている。ま
た，もう一つの１次巻線（帰還巻線５）は，電圧を帰還
させるためのもので，整流回路，これに並列に接続され
帰還した電圧をピークチャージして上昇させる帰還電圧
上昇手段として設けられたコンデンサ７，及び，一端に
ブリーダ抵抗１８を有するブリーダ回路８を介して，パ
ルス幅変調手段であるパルス幅変調回路６に接続されて
いる。パルス幅変調回路６の出力は，その出力の極性，
即ち，帰還電圧の極性を逆転させる電圧逆転手段である
高圧用インバータ１に入力される。
【００２５】一方，高圧トランス２の第１の２次巻線の
両端は，第１の整流・平滑回路３ａを経て，夫々ヘリッ
クス電極用端子１０及びコレクタ電極用端子１１に接続
されている。また，高圧トランス２の第２の２次巻線の
両端は，第２の整流・平滑回路３ｂに接続され，第２の
整流・平滑回路３ｂの一端は，第１の整流・平滑回路３
ａの一端に共通に接続され，他方，第２の整流・平滑回
路３ｂの他端は，オン・オフ動作を行うアノード電源４
の一端に接続されている。アノード電源４の他端は，第
１の整流・平滑回路３ａの一端とともに接地されてい
る。更に，アノード電源４とブリーダ回路８との間に
は，シーケンス回路９が接続されている。
両端は，第１の整流・平滑回路３ａを経て，夫々ヘリッ
クス電極用端子１０及びコレクタ電極用端子１１に接続
されている。また，高圧トランス２の第２の２次巻線の
両端は，第２の整流・平滑回路３ｂに接続され，第２の
整流・平滑回路３ｂの一端は，第１の整流・平滑回路３
ａの一端に共通に接続され，他方，第２の整流・平滑回
路３ｂの他端は，オン・オフ動作を行うアノード電源４
の一端に接続されている。アノード電源４の他端は，第
１の整流・平滑回路３ａの一端とともに接地されてい
る。更に，アノード電源４とブリーダ回路８との間に
は，シーケンス回路９が接続されている。
【００２６】シーケンス回路９は，アノード電源４のオ
ン制御同時に，ブリーダ回路８をオンさせるもので，フ
ォトカプラ，リレー等により構成される。ブリーダ抵抗
１８及びブリーダ回路８はシーケンス回路９と協力して
帰還電圧を低減させる動作を行う。ここで，ブリーダ回
路８及びコンデンサ７は，帰還電圧制御手段として動作
する。
ン制御同時に，ブリーダ回路８をオンさせるもので，フ
ォトカプラ，リレー等により構成される。ブリーダ抵抗
１８及びブリーダ回路８はシーケンス回路９と協力して
帰還電圧を低減させる動作を行う。ここで，ブリーダ回
路８及びコンデンサ７は，帰還電圧制御手段として動作
する。
【００２７】次に図１の回路の動作について説明する。
【００２８】高圧投入時，アノード電源４は，シーケン
ス制御上オフとなっている。従って，電源から見た進行
波管は，軽負荷状態であるため，出力電圧は，整流・平
滑回路３ａ，３ｂのコンデンサによってピークチャージ
され上昇する。ところが，この時，１次側の帰還回路に
おいても，帰還用巻線５の整流後の電圧をコンデンサ７
のピークチャージにより上昇させて，定常負荷時の帰還
電圧よりも高電圧を帰還することにより，高圧用インバ
ータ１の動作デューティレシオを小さくする。従って，
２次側の第１及び第２の整流・平滑回路３ａ及び３ｂの
コンデンサのピークチャージによる出力電圧の上昇を抑
圧することができる。アノード電源４の投入後の定常負
荷時は，シーケンス回路９によりアノード電源４のオン
制御と同時に，帰還回路に設けたブリーダ回路８を動作
させ，ブリーダ抵抗に電流を流し，帰還電圧を低下させ
て２次側の定常負荷状態に応じたパルス幅制御が行える
ようにする。
ス制御上オフとなっている。従って，電源から見た進行
波管は，軽負荷状態であるため，出力電圧は，整流・平
滑回路３ａ，３ｂのコンデンサによってピークチャージ
され上昇する。ところが，この時，１次側の帰還回路に
おいても，帰還用巻線５の整流後の電圧をコンデンサ７
のピークチャージにより上昇させて，定常負荷時の帰還
電圧よりも高電圧を帰還することにより，高圧用インバ
ータ１の動作デューティレシオを小さくする。従って，
２次側の第１及び第２の整流・平滑回路３ａ及び３ｂの
コンデンサのピークチャージによる出力電圧の上昇を抑
圧することができる。アノード電源４の投入後の定常負
荷時は，シーケンス回路９によりアノード電源４のオン
制御と同時に，帰還回路に設けたブリーダ回路８を動作
させ，ブリーダ抵抗に電流を流し，帰還電圧を低下させ
て２次側の定常負荷状態に応じたパルス幅制御が行える
ようにする。
【００２９】図２は図１の回路の要部を示す図である。
図２で示されたブリーダ回路８は，発光ダイオード及び
フォトトランジスタとを組み合わせることによって構成
されたフォトカプラを備え，このうちフォトトランジス
タは，ブリーダ回路に接続されている。一方，シーケン
ス回路９は，リレーの電磁コイル２１を備えており，こ
の電磁コイイル２１は，電源４に設けられたリレー接点
２５と，フォトカプラの発光ダイオードに接続されたリ
レー接点２２をオン・オフ駆動させる。リレー接点２２
に接続されている。その結果，電磁コイル２１に電流が
流れると，リレー接点２２がオンすると共に，発光ダイ
オードが発光して，フォトトランジスタをオンさせる。
電磁コイル２１に電流がながれなくなるとフォトトラン
ジスタはオフとなる。尚，符号２６は電流制限用の抵抗
で，符号２７及び２８は分圧抵抗である。
図２で示されたブリーダ回路８は，発光ダイオード及び
フォトトランジスタとを組み合わせることによって構成
されたフォトカプラを備え，このうちフォトトランジス
タは，ブリーダ回路に接続されている。一方，シーケン
ス回路９は，リレーの電磁コイル２１を備えており，こ
の電磁コイイル２１は，電源４に設けられたリレー接点
２５と，フォトカプラの発光ダイオードに接続されたリ
レー接点２２をオン・オフ駆動させる。リレー接点２２
に接続されている。その結果，電磁コイル２１に電流が
流れると，リレー接点２２がオンすると共に，発光ダイ
オードが発光して，フォトトランジスタをオンさせる。
電磁コイル２１に電流がながれなくなるとフォトトラン
ジスタはオフとなる。尚，符号２６は電流制限用の抵抗
で，符号２７及び２８は分圧抵抗である。
【００３０】図３は図２の回路の変形例を示す図であ
る。図３のように，リレーを使用する場合においては，
シーケンス回路９は，電源４に設けられたリレー接点２
５を駆動する電磁コイル２１を含み，且つブリーダ回路
８は，電磁コイル２１に連動するリレーの接点として構
成される。シーケンス回路９の電磁コイル２１に通電さ
れると，両リレー接点は同時にオンされる。
る。図３のように，リレーを使用する場合においては，
シーケンス回路９は，電源４に設けられたリレー接点２
５を駆動する電磁コイル２１を含み，且つブリーダ回路
８は，電磁コイル２１に連動するリレーの接点として構
成される。シーケンス回路９の電磁コイル２１に通電さ
れると，両リレー接点は同時にオンされる。
【００３１】
【発明の効果】以上説明したように，本発明は，高圧ト
ランスの巻線による負帰還回路を有し，且つ前記負帰還
回路の閉ループ内に帰還電圧上昇手段を備え，さらに電
源のオン・オフに連動してオン・オフする帰還電圧低減
手段とを備えることによって，小規模，低損失でありな
がら，出力電圧の負荷変動を容易に抑圧することができ
る高圧電源回路を提供することができる。
ランスの巻線による負帰還回路を有し，且つ前記負帰還
回路の閉ループ内に帰還電圧上昇手段を備え，さらに電
源のオン・オフに連動してオン・オフする帰還電圧低減
手段とを備えることによって，小規模，低損失でありな
がら，出力電圧の負荷変動を容易に抑圧することができ
る高圧電源回路を提供することができる。
【００３２】また，本発明による高圧電源回路は，スイ
ッチングレギュレータを使用した進行波管用電源に最適
である。
ッチングレギュレータを使用した進行波管用電源に最適
である。
【図１】本発明の実施例に係る進行波管用電源回路を示
すブロック図である。
すブロック図である。
【図２】図１の回路の要部を示す図である。
【図３】図２の回路の変形例を示す図である。
【図４】従来例に係る進行波管用電源回路を示すブロッ
ク図である。
ク図である。
１ 高圧用インバータ ２ 高圧トランス ３ａ，３ｂ 整流・平滑回路 ４ アノード電源 ５ 帰還用巻線 ６ パルス幅変調回路 ７ コンデンサ ８ ブリーダ回路 ９ シーケンス １０ ヘリックス電極用端子 １１ コレクタ電極用端子 １２ アノード電極用端子 １３ ヒータ／カソード電極用端子 １４ａ，１４ｂ ダミー負荷 １５ シリーズレギュレータ １８ ブリーダ抵抗 ２１ 電磁コイル
Claims (6)
- 【請求項１】 １次側及び２次側を備えた高圧トランス
と，前記１次側に設けられた負帰還回路及び前記２次側
に設けられた所定の電圧を供給する電源を備え，前記電
源はオン・オフ動作を行うことができる高圧電源回路に
おいて， 前記電源のオン動作の際に前記負帰還回路に帰還される
帰還電圧を低減させ，且つ前記電源のオフの際に，前記
帰還電圧を上昇させる帰還電圧制御手段とを備えたこと
を特徴とする高圧電源回路。 - 【請求項２】 請求項１記載の高圧電源回路において，
前記負帰還回路は，前記帰還電圧のパルス幅を前記帰還
電圧に応じて変調するパルス幅変調手段と，前記パルス
幅変調手段からの入力に基づいて前記帰還電圧とは逆極
性の電圧を出力する電圧極性逆転手段とを備えているこ
とを特徴とする高圧電源回路。 - 【請求項３】 請求項２記載の高圧電源回路において，
前記２次側には，整流平滑回路を備えていることを特徴
とする高圧電源回路。 - 【請求項４】 請求項３記載の高圧電源回路において， 前記高圧トランスの２次側には，前記整流平滑回路の直
列に接続されたレギュレータ手段を備えていることを特
徴とする高圧電源回路。 - 【請求項５】 請求項４記載の高圧電源回路において，
前記帰還制御手段は，前記帰還電圧を上昇させるための
ピークチャージコンデンサを有する一方，ブリーダ抵抗
と，前記ブリーダ抵抗に接続され，前記ブリーダ抵抗を
オン・オフ動作をするブリーダ回路とを備え，前記ブリ
ーダ抵抗及びブリーダ回路により，前記帰還電圧を低減
させる構成を有し，且つ前記ブリーダ回路に接続され，
前記電源のオン・オフ動作に連動して前記ブリーダ回路
をオン・オフさせるオン・オフ制御を行うシーケンス回
路とを有していることを特徴とする高圧電源回路。 - 【請求項６】 請求項１乃至５のいずれか記載の電源回
路において，前記電源はアノード電源であり，前記高圧
トランスの２次側が，進行波管に接続されていることを
特徴とする進行波管用電源回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5030070A JPH06245500A (ja) | 1993-02-19 | 1993-02-19 | 高圧電源回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5030070A JPH06245500A (ja) | 1993-02-19 | 1993-02-19 | 高圧電源回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH06245500A true JPH06245500A (ja) | 1994-09-02 |
Family
ID=12293556
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP5030070A Pending JPH06245500A (ja) | 1993-02-19 | 1993-02-19 | 高圧電源回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH06245500A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100669952B1 (ko) * | 1998-08-07 | 2007-01-18 | 톰슨 콘슈머 일렉트로닉스, 인코포레이티드 | 영상 표시 장치용 고전압 전원 |
Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS52111647A (en) * | 1976-03-15 | 1977-09-19 | Matsushita Electric Ind Co Ltd | Multioutput switching regulator circuit |
| JPS6127491B2 (ja) * | 1982-06-11 | 1986-06-25 | Toyoda Jido Shotsuki Seisakusho Kk | |
| JP3113988B2 (ja) * | 1991-10-21 | 2000-12-04 | アンリツ株式会社 | 硬貨判別装置 |
-
1993
- 1993-02-19 JP JP5030070A patent/JPH06245500A/ja active Pending
Patent Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS52111647A (en) * | 1976-03-15 | 1977-09-19 | Matsushita Electric Ind Co Ltd | Multioutput switching regulator circuit |
| JPS6127491B2 (ja) * | 1982-06-11 | 1986-06-25 | Toyoda Jido Shotsuki Seisakusho Kk | |
| JP3113988B2 (ja) * | 1991-10-21 | 2000-12-04 | アンリツ株式会社 | 硬貨判別装置 |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100669952B1 (ko) * | 1998-08-07 | 2007-01-18 | 톰슨 콘슈머 일렉트로닉스, 인코포레이티드 | 영상 표시 장치용 고전압 전원 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A02 | Decision of refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A02 Effective date: 19960709 |