JPH06324302A - 液晶ディスプレイパネル - Google Patents
液晶ディスプレイパネルInfo
- Publication number
- JPH06324302A JPH06324302A JP5112853A JP11285393A JPH06324302A JP H06324302 A JPH06324302 A JP H06324302A JP 5112853 A JP5112853 A JP 5112853A JP 11285393 A JP11285393 A JP 11285393A JP H06324302 A JPH06324302 A JP H06324302A
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- JP
- Japan
- Prior art keywords
- signal wiring
- resistance
- driving
- liquid crystal
- crystal display
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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Abstract
(57)【要約】
【目的】 表示画素がマトリクス状に配置された液晶デ
ィスプレイパネルにおいて、画素表示部と駆動ＩＣとの
間の信号配線に抵抗分布を挿入して駆動ＩＣの出力抵抗
分布を補正し、均一表示特性を改善する。 【構成】 駆動ＩＣ２の出力抵抗分布を補正するため、
画素表示部１５と駆動ＩＣとの間の信号配線３の長さ，
厚さ，幅および形状を変えて抵抗分布を挿入する。ま
た、この分布抵抗は信号配線と同一材料により形成する
ものとする。 【効果】 駆動ＩＣの出力抵抗分布が補正されることに
より、印加される画素電位が端子位置によらず一定とな
り、均一表示特性が優れた良質の画質を得ることができ
る。また、分布抵抗は信号配線と同一材料により形成す
るため、製造工程が増加しない利点を有する。
ィスプレイパネルにおいて、画素表示部と駆動ＩＣとの
間の信号配線に抵抗分布を挿入して駆動ＩＣの出力抵抗
分布を補正し、均一表示特性を改善する。 【構成】 駆動ＩＣ２の出力抵抗分布を補正するため、
画素表示部１５と駆動ＩＣとの間の信号配線３の長さ，
厚さ，幅および形状を変えて抵抗分布を挿入する。ま
た、この分布抵抗は信号配線と同一材料により形成する
ものとする。 【効果】 駆動ＩＣの出力抵抗分布が補正されることに
より、印加される画素電位が端子位置によらず一定とな
り、均一表示特性が優れた良質の画質を得ることができ
る。また、分布抵抗は信号配線と同一材料により形成す
るため、製造工程が増加しない利点を有する。
Description
【０００１】
【産業上の利用分野】本発明は、液晶ディスプレイパネ
ルに係り、特に液晶ディスプレイパネルの駆動に使用さ
れる信号配線に関するものである。
ルに係り、特に液晶ディスプレイパネルの駆動に使用さ
れる信号配線に関するものである。
【０００２】
【従来の技術】液晶を用いて文字や画像を表示する方式
として、垂直に交わる走査信号配線と画素信号配線との
間に液晶をはさみ、配線の交差部に印加する電圧を制御
して画素を表示する単純マトリクス方式と、表示単位毎
にスイッチング素子を備えたアクティブマトリクス方式
が知られている。それぞれの方式のパネル構造を図３
（ａ），（ｂ）に示す。図において、絶縁性基板１１上
に、走査信号配線１２および画素信号配線１３が選択的
に形成され、互いに垂直に交差している。そして、単純
マトリクス方式（同図（ａ））では、２本の信号配線の
間に液晶が挟み込まれ、配線の交差部を画素表示部とし
て用いる。一方アクティブマトリクス方式（同図
（ｂ））では、配線の交差部に、複数の層から形成され
る、ダイオードやトランジスタに代表されるスイッチン
グ素子１４が形成され、スイッチング素子に隣接して画
素表示部１５が形成される。
として、垂直に交わる走査信号配線と画素信号配線との
間に液晶をはさみ、配線の交差部に印加する電圧を制御
して画素を表示する単純マトリクス方式と、表示単位毎
にスイッチング素子を備えたアクティブマトリクス方式
が知られている。それぞれの方式のパネル構造を図３
（ａ），（ｂ）に示す。図において、絶縁性基板１１上
に、走査信号配線１２および画素信号配線１３が選択的
に形成され、互いに垂直に交差している。そして、単純
マトリクス方式（同図（ａ））では、２本の信号配線の
間に液晶が挟み込まれ、配線の交差部を画素表示部とし
て用いる。一方アクティブマトリクス方式（同図
（ｂ））では、配線の交差部に、複数の層から形成され
る、ダイオードやトランジスタに代表されるスイッチン
グ素子１４が形成され、スイッチング素子に隣接して画
素表示部１５が形成される。
【０００３】いずれの方式においても、パネル駆動信号
を走査信号配線または画素信号配線に印加する方法とし
て、絶縁性基板１１上において、走査信号配線１２およ
び画素信号配線１３を画素表示部の外側に引き出し、そ
れぞれの信号を発生する駆動ＩＣ１６に接続する方式を
採用している。
を走査信号配線または画素信号配線に印加する方法とし
て、絶縁性基板１１上において、走査信号配線１２およ
び画素信号配線１３を画素表示部の外側に引き出し、そ
れぞれの信号を発生する駆動ＩＣ１６に接続する方式を
採用している。
【０００４】絶縁性基板１１としては、一般的にガラス
基板が用いられる。走査信号配線１２および画素信号配
線１３の材料としては、単純マトリクス方式においては
透明なＩＴＯ（Ｉｎｄｉｕｍ Ｔｉｎ Ｏｘｉｄｅ）
膜、アクティブマトリクス方式においてはＡｌ，Ｃｒ，
Ｔａ等が用いられる。スイッチング素子１４の材料とし
てはＳｉなどが用いられる。
基板が用いられる。走査信号配線１２および画素信号配
線１３の材料としては、単純マトリクス方式においては
透明なＩＴＯ（Ｉｎｄｉｕｍ Ｔｉｎ Ｏｘｉｄｅ）
膜、アクティブマトリクス方式においてはＡｌ，Ｃｒ，
Ｔａ等が用いられる。スイッチング素子１４の材料とし
てはＳｉなどが用いられる。
【０００５】
【発明が解決しようとする課題】この種の液晶ディスプ
レイパネルで単色表示を行う場合、走査信号配線または
画素信号配線ごとに全ての端子に同じ信号電圧を印加す
るが、駆動ＩＣの出力抵抗が端子間で異なると、隣接す
る画素間において印加される電位が異なり、均一表示特
性が低下する。
レイパネルで単色表示を行う場合、走査信号配線または
画素信号配線ごとに全ての端子に同じ信号電圧を印加す
るが、駆動ＩＣの出力抵抗が端子間で異なると、隣接す
る画素間において印加される電位が異なり、均一表示特
性が低下する。
【０００６】ここで駆動ＩＣの内部回路の一例を図４に
示す。全ての端子に同一電圧を出力する場合、１つの定
電圧源１７から共通の内部配線１８を通って各出力端子
２０に電圧が供給される。電圧を出力するタイミング
は、各出力端子に設けられた出力スイＴッチ１９によっ
て制御する。この場合、定電圧源と各出力端子の間の内
部配線長、内部抵抗の有無が異なるため、各出力端子に
おける出力抵抗が異なる。図４の駆動ＩＣにおける出力
抵抗と端子位置の関係を図５に示す。
示す。全ての端子に同一電圧を出力する場合、１つの定
電圧源１７から共通の内部配線１８を通って各出力端子
２０に電圧が供給される。電圧を出力するタイミング
は、各出力端子に設けられた出力スイＴッチ１９によっ
て制御する。この場合、定電圧源と各出力端子の間の内
部配線長、内部抵抗の有無が異なるため、各出力端子に
おける出力抵抗が異なる。図４の駆動ＩＣにおける出力
抵抗と端子位置の関係を図５に示す。
【０００７】
【課題を解決するための手段】上記課題を解決するため
に本発明の液晶ディスプレイパネルは、画素表示部と駆
動ＩＣとの間の信号配線に抵抗分布を挿入するものであ
る。
に本発明の液晶ディスプレイパネルは、画素表示部と駆
動ＩＣとの間の信号配線に抵抗分布を挿入するものであ
る。
【０００８】
【作用】上記構成により、例えば、駆動ＩＣの出力抵抗
が高い端子には、接続する配線を太く，短く，厚くして
信号配線抵抗を下げ、駆動ＩＣの出力抵抗Ｒｏと信号配
線抵抗Ｒａの和（Ｒｏ＋Ｒａ）を駆動ＩＣの端子位置に
よらず一定値にする。
が高い端子には、接続する配線を太く，短く，厚くして
信号配線抵抗を下げ、駆動ＩＣの出力抵抗Ｒｏと信号配
線抵抗Ｒａの和（Ｒｏ＋Ｒａ）を駆動ＩＣの端子位置に
よらず一定値にする。
【０００９】また、この信号配線抵抗は信号配線と同一
材料により形成されるため、製造工程が増加しない利点
を有する。
材料により形成されるため、製造工程が増加しない利点
を有する。
【００１０】
【実施例】図１は本発明の一実施例を示す部分平面図で
ある。図において画素線駆動ＩＣ１の出力抵抗は、端子
位置によらず一定であり、走査線駆動ＩＣ２の出力抵抗
は下の端子になるほど単調増加しているとする。このと
き走査信号配線３の抵抗は配線幅を変更することにより
形成するものとする。図２（ａ）は走査駆動ＩＣの出力
抵抗Ｒｏであり、下の端子になるほど抵抗が増加する。
これに対応して、画素表示部と駆動ＩＣとの間の走査信
号配線３の幅を太くし、図２（ｂ）に示すように信号配
線抵抗Ｒａを減少させる。すると２つの抵抗の和、すな
わち（Ｒｏ＋Ｒａ）は図２（ｃ）に示すように端子の位
置によらず一定値となり、画素に印加される電圧が均一
化され、液晶ディスプレイパネルの均一表示特性が改善
できる。例えばシート抵抗が０．１Ω／cm2の材料を信
号配線として用い、１５Ωと２０Ωの駆動ＩＣ出力抵抗
Ｒｏを持つ端子に信号配線抵抗を接続してＲｏ＋Ｒａ＝
２５Ωとする場合、Ｒｏ＝１５Ωの端子に配線幅１００
μｍ，長さ１cm，抵抗Ｒａ＝１０Ωの信号配線抵抗を接
続し、Ｒｏ＝２０Ωの端子に配線幅２００μｍ，長さ１
cm，抵抗Ｒａ＝５Ωの信号配線抵抗を接続すればよい。
ある。図において画素線駆動ＩＣ１の出力抵抗は、端子
位置によらず一定であり、走査線駆動ＩＣ２の出力抵抗
は下の端子になるほど単調増加しているとする。このと
き走査信号配線３の抵抗は配線幅を変更することにより
形成するものとする。図２（ａ）は走査駆動ＩＣの出力
抵抗Ｒｏであり、下の端子になるほど抵抗が増加する。
これに対応して、画素表示部と駆動ＩＣとの間の走査信
号配線３の幅を太くし、図２（ｂ）に示すように信号配
線抵抗Ｒａを減少させる。すると２つの抵抗の和、すな
わち（Ｒｏ＋Ｒａ）は図２（ｃ）に示すように端子の位
置によらず一定値となり、画素に印加される電圧が均一
化され、液晶ディスプレイパネルの均一表示特性が改善
できる。例えばシート抵抗が０．１Ω／cm2の材料を信
号配線として用い、１５Ωと２０Ωの駆動ＩＣ出力抵抗
Ｒｏを持つ端子に信号配線抵抗を接続してＲｏ＋Ｒａ＝
２５Ωとする場合、Ｒｏ＝１５Ωの端子に配線幅１００
μｍ，長さ１cm，抵抗Ｒａ＝１０Ωの信号配線抵抗を接
続し、Ｒｏ＝２０Ωの端子に配線幅２００μｍ，長さ１
cm，抵抗Ｒａ＝５Ωの信号配線抵抗を接続すればよい。
【００１１】なお、同実施例では配線幅を変更すること
により抵抗分布を変えたがこれに限らず、長さ，厚さあ
るいは形状を変えることでも同様の効果が得られること
はいうまでもない。
により抵抗分布を変えたがこれに限らず、長さ，厚さあ
るいは形状を変えることでも同様の効果が得られること
はいうまでもない。
【００１２】
【発明の効果】以上説明したように、本発明の液晶ディ
スプレイパネルでは、画素表示部と駆動ＩＣの間の信号
配線に抵抗分布を挿入し、駆動ＩＣの出力抵抗分布を補
正することにより、均一表示特性が改善され、輝度ムラ
のない、良質の画像を得ることができる利点を有する。
スプレイパネルでは、画素表示部と駆動ＩＣの間の信号
配線に抵抗分布を挿入し、駆動ＩＣの出力抵抗分布を補
正することにより、均一表示特性が改善され、輝度ムラ
のない、良質の画像を得ることができる利点を有する。
【図１】本発明の一実施例における画素表示部と駆動Ｉ
Ｃとの間の信号配線の形状を示す部分平面図
Ｃとの間の信号配線の形状を示す部分平面図
【図２】同実施例における各部分の抵抗値を示す特性図
【図３】マトリクス型液晶ディスプレイパネルのパネル
構造図
構造図
【図４】駆動ＩＣの内部構成を示す回路図
【図５】駆動ＩＣの出力抵抗分布を示す特性図
１ 画素線駆動ＩＣ ２ 走査線駆動ＩＣ ３，１２ 走査信号配線 １３ 画素信号配線
Claims (3)
- 【請求項１】 表示画素がマトリクス状に配置された液
晶ディスプレイパネルであって、画素表示部と駆動ＩＣ
との間の信号配線に抵抗分布を挿入した液晶ディスプレ
イパネル。 - 【請求項２】 駆動ＩＣの出力抵抗Ｒｏと信号配線抵抗
Ｒａとの和（Ｒｏ＋Ｒａ）が、前記駆動ＩＣの端子位置
によらず一定値となることを特徴とする請求項１記載の
液晶ディスプレイパネル。 - 【請求項３】 信号配線に挿入する抵抗分布が前記信号
配線と同材料により形成されることを特徴とする請求項
１記載の液晶ディスプレイパネル。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5112853A JPH06324302A (ja) | 1993-05-14 | 1993-05-14 | 液晶ディスプレイパネル |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5112853A JPH06324302A (ja) | 1993-05-14 | 1993-05-14 | 液晶ディスプレイパネル |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH06324302A true JPH06324302A (ja) | 1994-11-25 |
Family
ID=14597172
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP5112853A Pending JPH06324302A (ja) | 1993-05-14 | 1993-05-14 | 液晶ディスプレイパネル |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH06324302A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6683669B1 (en) | 1999-08-06 | 2004-01-27 | Sharp Kabushiki Kaisha | Apparatus and method for fabricating substrate of a liquid crystal display device and interconnects therein |
-
1993
- 1993-05-14 JP JP5112853A patent/JPH06324302A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6683669B1 (en) | 1999-08-06 | 2004-01-27 | Sharp Kabushiki Kaisha | Apparatus and method for fabricating substrate of a liquid crystal display device and interconnects therein |
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