JPH0633136U - 液晶表示素子の構造 - Google Patents

液晶表示素子の構造

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JPH0633136U
JPH0633136U JP072589U JP7258992U JPH0633136U JP H0633136 U JPH0633136 U JP H0633136U JP 072589 U JP072589 U JP 072589U JP 7258992 U JP7258992 U JP 7258992U JP H0633136 U JPH0633136 U JP H0633136U
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JP
Japan
Prior art keywords
dummy
electrode side
electrode
side substrate
substrate
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Pending
Application number
JP072589U
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English (en)
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敏信 鹿島
正俊 堀井
貴 杉山
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Stanley Electric Co Ltd
Original Assignee
Stanley Electric Co Ltd
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Publication date
Application filed by Stanley Electric Co Ltd filed Critical Stanley Electric Co Ltd
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Publication of JPH0633136U publication Critical patent/JPH0633136U/ja
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Abstract

(57)【要約】 【目的】この考案は、設計が容易にでき、かつセルに形
成した時、ダミー電極を目立たなくでき、かつ対向基板
内（走査電極同士）でのショート発生を防止する液晶表
示素子の構造を目的とする。 【構成】共通電極側基板３１と走査電極側基板１１とを
重ね合わせてセルに形成する際に、前記両基板３１、１
１のダミー電極２、４を対向基板側へのＩＴＯ電極への
引回し部とほぼ同一パターンに形成すると共に、該ダミ
ー電極２、４は、短絡されないパターンにパターニング
を施してなる。

Description

【考案の詳細な説明】
【０００１】
【産業上の利用分野】
この考案は、ギャップ精度、均一性が厳格に求められる液晶表示素子に利用さ れる液晶表示素子の構造に関するものである。
【０００２】
【従来の技術】
従来、ギャップ精度、均一性が厳格に求められる液晶表示素子においては、本 来の電極としてのＩＴＯパターンの他に、ダミー電極が設けられる。
【０００３】 すなわち、図３は走査電極側基板１１のＩＴＯパターン図、図４は共通電極側 基板３１のＩＴＯパターン図であり、走査電極側基板１１には走査電極側ＩＴＯ パターン１、ダミー電極２を形成し、共通電極側基板３１には共通電極側ＩＴＯ パターン３、ダミー電極４が形成されている。
【０００４】 また、図５は、図３、４の共通電極側基板３１と走査電極側基板１１とを重ね 合わせた時のＩＴＯパターン図、図６は、図５のＣ部の拡大図で実線は共通電極 側ＩＴＯパターン３、点線は走査電極側ＩＴＯパターン１をあらわしている。更 に、ダミー電極２、４はパターンを切らず、該ダミー電極部全部にＩＴＯを形成 している。
【０００５】
【考案が解決しようとする課題】
しかし、前記従来の技術では、Ａ．ダミー電極が目視により容易に確認される ため、製品価値を損なうという問題点がある。
【０００６】 Ｂ．ダミー電極部２ヵ所で対向基板とのショートが生じた場合、ダミー電極を 介して走査電極同士でショートが発生するという問題点がある。
【０００７】 そこで、本考案は上記従来の技術の問題点に鑑み案出されたもので、設計が容 易にでき、かつセルに形成した時ダミー電極を目立たなくでき、かつ対向基板内 （走査電極同士）でのショート発生を防止する液晶表示素子の構造の提供を目的 としている。
【０００８】
【課題を解決するための手段】
上記目的を達成するために、本考案における液晶表示素子の構造においては、 共通電極側基板と走査電極側基板とを重ね合わせてセルに形成する際に、前記両 基板のダミー電極を対向基板側へのＩＴＯ電極への引回し部とほぼ同一パターン に形成すると共に、該ダミー電極は、短絡されないパターンにパターニングを施 してなる。
【０００９】
【作用】
ダミー電極を対向基板側におけるＩＴＯ電極への引回し部とほぼ同一パターン に形成したため、ダミー電極を目立たない状態に設計可能である。
【００１０】 また、ダミー電極にはパターニングが施され、かつ短絡部が無いため、ダミー 電極部で対向基板とのショートがあっても、対向基板内（走査電極同士）でショ ートが発生する可能性及び干渉縞（モアレ）の発生が無くなる。
【００１１】
【実施例】
実施例について図１から図２を参照して説明すると、図１は、共通電極側基板 ３１と走査電極側基板１１を重ね合わせた時のＩＴＯパターン図、図２は、図１ 中のＡ部の拡大図である。図２において実線は共通電極側ＩＴＯパターン３、点 線は走査電極側ＩＴＯパターン１をあらわしている。
【００１２】 走査電極側基板１１には、図３と同様に走査電極側パターン１、ダミー電極２ が形成され、共通電極側基板３１には、図４と同様に共通電極側パターン３、ダ ミー電極４が形成されている（図３、４参照）。
【００１３】 次に、図１、２のように共通電極側基板３１と走査電極側基板１１とを重ね合 わせた時、前記ダミー電極２、４を対向基板におけるＩＴＯ電極の引回し部とほ ぼ同一パターンに設計作製されている。
【００１４】 また、両基板３１、１１のダミー電極２、４にはパターニングを施し、短絡さ れていないパターンに形成されている。
【００１５】
【考案の効果】
本考案は上述の通り構成されているので、次に記載する効果を奏する。 Ａ．ダミー電極が対向基板におけるＩＴＯ電極への引回し部とほぼ同一パター ンに形成されているため、設計が容易にでき、かつセルに形成した時、ダミー電 極は目立たない状態に製作でき、製品品位を向上させることができる。
【００１６】 Ｂ．ダミー電極には、パターニングが施され、かつ短絡部が無いため、ダミー 電極部で対向基板とのショートがあっても、対向基板内（走査電極同士）でショ ート発生を防止できる。
【００１７】 Ｃ．ダミー電極が対向基板におけるＩＴＯ電極への引回し部とほぼ同一パター ンで設計しているため、干渉縞（モアレ）の発生を防止できる。
【図面の簡単な説明】
【図１】本考案の共通電極側基板と走査電極側基板を重
ね合わせた時のＩＴＯパターン図である。
【図２】図１中のＡ部の拡大図である。
【図３】従来の走査電極側基板ＩＴＯパターン図であ
る。
【図４】従来の共通電極側基板ＩＴＯパターン図であ
る。
【図５】共通電極側基板と走査電極側基板を重ね合わせ
た時のＩＴＯパターン図。
【図６】図５のＣ部の拡大図である。
【符号の説明】
１ 走査電極パターン ２ ダミー電極 ３ 共通電極パターン ４ ダミー電極 １１ 走査電極側基板 ３１ 共通電極側基板

Claims (1)

    【実用新案登録請求の範囲】
  1. 【請求項１】共通電極側基板と走査電極側基板とを重ね
    合わせてセルに形成する際に、前記両基板のダミー電極
    を対向基板側へのＩＴＯ電極への引回し部とほぼ同一パ
    ターンに形成すると共に、該ダミー電極は、短絡されな
    いパターンにパターニングを施してなる液晶表示素子の
    構造。
JP072589U 1992-09-24 1992-09-24 液晶表示素子の構造 Pending JPH0633136U (ja)

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Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH0470815A (ja) * 1990-07-12 1992-03-05 Seiko Epson Corp 液晶表示装置及びその製造方法

Patent Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH0470815A (ja) * 1990-07-12 1992-03-05 Seiko Epson Corp 液晶表示装置及びその製造方法

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