JPH06347484A - ランダムサンプリング記憶回路 - Google Patents
ランダムサンプリング記憶回路Info
- Publication number
- JPH06347484A JPH06347484A JP5166078A JP16607893A JPH06347484A JP H06347484 A JPH06347484 A JP H06347484A JP 5166078 A JP5166078 A JP 5166078A JP 16607893 A JP16607893 A JP 16607893A JP H06347484 A JPH06347484 A JP H06347484A
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Abstract
(57)【要約】
【目的】 デジタルオシロスコープにおいて、ランダム
サンプルを行うと、トリガ許可までの時間がかかり、波
形の更新に時間がかかるという欠点があった。このた
め、データ取込み手段を改良し、ランダムサンプル時の
波形データ更新を早くすることを目的とする。 【構成】 メモリにシリアルアクセスメモリ部とロウア
ドレスとカラムアドレスからアドレス設定可能なダイナ
ミックＲＡＭ部からなるＲＡＭを使用し、Ａ／Ｄの処理
データを最初にシリアルアクセスメモリ部に格納し、格
納が終了したら次にダイナミックＲＡＭ部に転送するよ
うにする。
サンプルを行うと、トリガ許可までの時間がかかり、波
形の更新に時間がかかるという欠点があった。このた
め、データ取込み手段を改良し、ランダムサンプル時の
波形データ更新を早くすることを目的とする。 【構成】 メモリにシリアルアクセスメモリ部とロウア
ドレスとカラムアドレスからアドレス設定可能なダイナ
ミックＲＡＭ部からなるＲＡＭを使用し、Ａ／Ｄの処理
データを最初にシリアルアクセスメモリ部に格納し、格
納が終了したら次にダイナミックＲＡＭ部に転送するよ
うにする。
Description
【０００１】
【産業上の利用分野】本発明は、ランダムサンプリング
方式のデジタルオシロスコープにおけるデータ取込み記
憶回路の改良に関するものである。
方式のデジタルオシロスコープにおけるデータ取込み記
憶回路の改良に関するものである。
【０００２】
【従来の技術】従来の技術を図２、図３、図４、図５を
使って説明する。被観測信号の周期よりも遅いサンプル
クロックで被観測信号をサンプリング、記憶し、この波
形表示を行う場合、何らかの方法でサンプル時間と被観
信号のデータ（トリガ点とサンプルクロックとの時間
差）を保持しておかなければならない。この一つの方式
として、ランダムサンプル方式がある。
使って説明する。被観測信号の周期よりも遅いサンプル
クロックで被観測信号をサンプリング、記憶し、この波
形表示を行う場合、何らかの方法でサンプル時間と被観
信号のデータ（トリガ点とサンプルクロックとの時間
差）を保持しておかなければならない。この一つの方式
として、ランダムサンプル方式がある。
【０００３】ランダムサンプル方式では、サンプルクロ
ックとトリガは非同期である。このため、波形データを
メモリに取込む場合は、入力信号がトリガレベルを過ぎ
た点から次のサンプルクロックまでの時間を計ってお
く。同様に次のサンプルクロックでサンプリングされた
入力信号の場合も同様にその時間差を計り、何波形かの
データをトリガ点を基準に重ねて入力波形を記憶表示す
る。このランダムサンプルを行う場合の動作について、
図３、図４、図５を用いて説明する。図３はブロック分
けされたデータの格納状態を示し、図４は観測信号Ａと
再生波形ポイントＢを示す。図５はトリガ信号とサンプ
ルクロックの時間関係を示す。図３においてＡ／Ｄ変換
器でアナログからディジタルに処理されたデータは、Ａ
／Ｄしたデータの時間的順序８のようにトリガとサンプ
ルクロックの時間の長さ△ｔｎによってブロック分けさ
れ、一定周期ｔｓでサンプリングされたデータ（図５参
照）はブロック３、ブロック２、ブロック４、ブロック
１といったように、ランダムに取込まれる。これをデー
タの並べかえ９を行い、矢印のように読み出せば、図４
に示すように観測信号のデータ再生が行われる。さて上
記のような動作を実行するために、従来技術では、図２
に示すよう最初にＡ／Ｄ変換器１でアナログからディジ
タルに処理されたデータ、例えばデータブロック３は、
一担スタティックＲＡＭ６に格納される。次にスタティ
ックＲＡＭ６に格納されたデータは、μコン２により最
初データ３−１が読み出され、トリガとサンプルクロッ
クの時間の長さ△ｔ3分のアドレス（先頭アドレス演
算）を飛ばし、スタティックＲＡＭ７に書き込まれる。
次にデータ３−２が読み出され、サンプルクロックの一
定周期ｔｓ分のアドレス（飛ばしアドレス演算）を飛ば
し、スタティックＲＡＭ７に書き込まれ、この作業が次
々と繰り返される。データの最後が、スタティックＲＡ
Ｍ７に書き込まれてはじめて、次のトリガが許可され、
ブロック２のデータが取込まれ、同様にブロック４、ブ
ロック１と続けられる。スタティックＲＡＭＢ７のデー
タは矢印の読み出し順序でＩ／Ｏポートに転送される。
ックとトリガは非同期である。このため、波形データを
メモリに取込む場合は、入力信号がトリガレベルを過ぎ
た点から次のサンプルクロックまでの時間を計ってお
く。同様に次のサンプルクロックでサンプリングされた
入力信号の場合も同様にその時間差を計り、何波形かの
データをトリガ点を基準に重ねて入力波形を記憶表示す
る。このランダムサンプルを行う場合の動作について、
図３、図４、図５を用いて説明する。図３はブロック分
けされたデータの格納状態を示し、図４は観測信号Ａと
再生波形ポイントＢを示す。図５はトリガ信号とサンプ
ルクロックの時間関係を示す。図３においてＡ／Ｄ変換
器でアナログからディジタルに処理されたデータは、Ａ
／Ｄしたデータの時間的順序８のようにトリガとサンプ
ルクロックの時間の長さ△ｔｎによってブロック分けさ
れ、一定周期ｔｓでサンプリングされたデータ（図５参
照）はブロック３、ブロック２、ブロック４、ブロック
１といったように、ランダムに取込まれる。これをデー
タの並べかえ９を行い、矢印のように読み出せば、図４
に示すように観測信号のデータ再生が行われる。さて上
記のような動作を実行するために、従来技術では、図２
に示すよう最初にＡ／Ｄ変換器１でアナログからディジ
タルに処理されたデータ、例えばデータブロック３は、
一担スタティックＲＡＭ６に格納される。次にスタティ
ックＲＡＭ６に格納されたデータは、μコン２により最
初データ３−１が読み出され、トリガとサンプルクロッ
クの時間の長さ△ｔ3分のアドレス（先頭アドレス演
算）を飛ばし、スタティックＲＡＭ７に書き込まれる。
次にデータ３−２が読み出され、サンプルクロックの一
定周期ｔｓ分のアドレス（飛ばしアドレス演算）を飛ば
し、スタティックＲＡＭ７に書き込まれ、この作業が次
々と繰り返される。データの最後が、スタティックＲＡ
Ｍ７に書き込まれてはじめて、次のトリガが許可され、
ブロック２のデータが取込まれ、同様にブロック４、ブ
ロック１と続けられる。スタティックＲＡＭＢ７のデー
タは矢印の読み出し順序でＩ／Ｏポートに転送される。
【０００４】
【発明が解決しようとする課題】このように、取得デー
タの先頭アドレス演算及び、飛ばしアドレス演算等のデ
ータ並べかえのための全アドレス管理がμコン処理によ
ってしまうため、前述の従来技術では、トリガの許可ま
でに時間がかかり、表示波形の更新が遅くなるという欠
点があった。本発明は、データ取込み手段を改良し、ラ
ンダムサンプル時の波形データ更新を早くすることを目
的とする。
タの先頭アドレス演算及び、飛ばしアドレス演算等のデ
ータ並べかえのための全アドレス管理がμコン処理によ
ってしまうため、前述の従来技術では、トリガの許可ま
でに時間がかかり、表示波形の更新が遅くなるという欠
点があった。本発明は、データ取込み手段を改良し、ラ
ンダムサンプル時の波形データ更新を早くすることを目
的とする。
【０００５】
【課題を解決するための手段】本発明は、上記の目的を
達成するため、Ａ／Ｄ変換器のあとに、シリアルアクセ
スメモリ部と、ロウアドレスとカラムアドレスからアド
レス設定可能なダイナミックＲＡＭ（例えばビデオＲＡ
Ｍ）部から構成されるＲＡＭを接続したものである。
達成するため、Ａ／Ｄ変換器のあとに、シリアルアクセ
スメモリ部と、ロウアドレスとカラムアドレスからアド
レス設定可能なダイナミックＲＡＭ（例えばビデオＲＡ
Ｍ）部から構成されるＲＡＭを接続したものである。
【０００６】
【作用】このような接続により、最初Ａ／Ｄ変換された
データをシリアルアクセスメモリ部に格納し、次にシリ
アルアクセスメモリ部からダイナミックＲＡＭ部にデー
タを転送するようにしたものである。その結果、データ
が並べかえなしで一括でシリアルアクセスメモリ部から
ダイナミックＲＡＭ部に転送され、データ更新に時間が
かからない。
データをシリアルアクセスメモリ部に格納し、次にシリ
アルアクセスメモリ部からダイナミックＲＡＭ部にデー
タを転送するようにしたものである。その結果、データ
が並べかえなしで一括でシリアルアクセスメモリ部から
ダイナミックＲＡＭ部に転送され、データ更新に時間が
かからない。
【０００７】
【実施例】以下、この発明の一実施例を図１により説明
する。Ａ／Ｄ変換器１の出力は、シリアルアクセスメモ
リ部４とダイナミックＲＡＭ部５から構成されるＲＡＭ
８のシリアルアクセスメモリ部４のデータ入力部に接続
され、前記ＲＡＭ８のコントロール入力は、μコン２の
ＡＢ、ＲＤ、ＷＲに接続されている。前記ダイナミック
ＲＡＭ部５の出力は、Ｉ／Ｏポートに接続されている。
Ａ／Ｄ変換器１でデジタル処理されたデータブロック３
は、シリアルアクセスメモリ部４と、ダイナミックＲＡ
Ｍ部５から構成されるＲＡＭ３のシリアルアクセスメモ
リ部４に、３−１、３−２、・・・・３−ｎと次々に格
納される。シリアルアクセスメモリ部４に、格納が終了
したら、その格納されたデータをμコン２により、ダイ
ナミックＲＡＭ部５のロウアドレス３を指定すると、３
−１から３−ｎまでの１バイトのデータｎ個を１回でダ
イナミックＲＡＭ部５に格納する。続いて次のトリガが
許可され、ブロック２のデータが取込まれる。ブロック
３と同様に、ブロック２が終了すれば、ブロック４、ブ
ロック１と続けられる。Ｉ／Ｏポートへの読み出しは、
矢印のようにアドレスをかえてゆけば、ランダムサンプ
ルによる波形再生が実行できる。
する。Ａ／Ｄ変換器１の出力は、シリアルアクセスメモ
リ部４とダイナミックＲＡＭ部５から構成されるＲＡＭ
８のシリアルアクセスメモリ部４のデータ入力部に接続
され、前記ＲＡＭ８のコントロール入力は、μコン２の
ＡＢ、ＲＤ、ＷＲに接続されている。前記ダイナミック
ＲＡＭ部５の出力は、Ｉ／Ｏポートに接続されている。
Ａ／Ｄ変換器１でデジタル処理されたデータブロック３
は、シリアルアクセスメモリ部４と、ダイナミックＲＡ
Ｍ部５から構成されるＲＡＭ３のシリアルアクセスメモ
リ部４に、３−１、３−２、・・・・３−ｎと次々に格
納される。シリアルアクセスメモリ部４に、格納が終了
したら、その格納されたデータをμコン２により、ダイ
ナミックＲＡＭ部５のロウアドレス３を指定すると、３
−１から３−ｎまでの１バイトのデータｎ個を１回でダ
イナミックＲＡＭ部５に格納する。続いて次のトリガが
許可され、ブロック２のデータが取込まれる。ブロック
３と同様に、ブロック２が終了すれば、ブロック４、ブ
ロック１と続けられる。Ｉ／Ｏポートへの読み出しは、
矢印のようにアドレスをかえてゆけば、ランダムサンプ
ルによる波形再生が実行できる。
【０００８】
【発明の効果】本発明によれば、ランダムサンプル方式
でもアドレス管理が単純化されるため、データ更新時間
が短かくなり、リアルタイム感覚の表示画面となり、高
品位のディジタルオシロスコープが実現できる。
でもアドレス管理が単純化されるため、データ更新時間
が短かくなり、リアルタイム感覚の表示画面となり、高
品位のディジタルオシロスコープが実現できる。
【図１】本発明の構成を示すブロック図。
【図２】従来の構成を示すブロック図。
【図３】ランダムサンプル時のデータの格納状態を説明
するブロック図。
するブロック図。
【図４】観測波形と再生波形の関係を示す説明図。
【図５】サンプルクロックとトリガ信号の関係を示す波
形図。
形図。
１ Ａ／Ｄ ２ μコン ４ シリアルアクセスメモリ ５ ダイナミックＲＡＭ ６ スタティックＲＡＭＡ ７ スタティックＲＡＭＢ ８ ＲＡＭ
Claims (1)
- 【請求項１】 Ａ／Ｄ変換器と、該Ａ／Ｄ変換器の後段
のシリアルアクセスメモリ部とロウアドレスとカラムア
ドレスからアドレス設定可能なダイナミックＲＡＭ部か
ら成るＲＡＭ部と、該ＲＡＭ部内の前記シリアルアクセ
スメモリ部と前記ダイナミックＲＡＭ部を制御するマイ
クロコンピュータにより構成する一括転送可能なランダ
ムサンプリング記憶回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16607893A JP3267393B2 (ja) | 1993-06-11 | 1993-06-11 | ランダムサンプリング記憶回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16607893A JP3267393B2 (ja) | 1993-06-11 | 1993-06-11 | ランダムサンプリング記憶回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH06347484A true JPH06347484A (ja) | 1994-12-22 |
| JP3267393B2 JP3267393B2 (ja) | 2002-03-18 |
Family
ID=15824578
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP16607893A Expired - Fee Related JP3267393B2 (ja) | 1993-06-11 | 1993-06-11 | ランダムサンプリング記憶回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3267393B2 (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100518661B1 (ko) * | 1997-04-04 | 2005-12-07 | 텍트로닉스 인코포레이티드 | 전기파형의디지털샘플링방법 |
| JP2009531742A (ja) * | 2006-03-29 | 2009-09-03 | テクトロニクス・インコーポレイテッド | 高速ラスタライザ |
-
1993
- 1993-06-11 JP JP16607893A patent/JP3267393B2/ja not_active Expired - Fee Related
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100518661B1 (ko) * | 1997-04-04 | 2005-12-07 | 텍트로닉스 인코포레이티드 | 전기파형의디지털샘플링방법 |
| JP2009531742A (ja) * | 2006-03-29 | 2009-09-03 | テクトロニクス・インコーポレイテッド | 高速ラスタライザ |
Also Published As
| Publication number | Publication date |
|---|---|
| JP3267393B2 (ja) | 2002-03-18 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| LAPS | Cancellation because of no payment of annual fees |