JPH06349666A - 積層セラミックコンデンサ - Google Patents
積層セラミックコンデンサInfo
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- JPH06349666A JPH06349666A JP5157874A JP15787493A JPH06349666A JP H06349666 A JPH06349666 A JP H06349666A JP 5157874 A JP5157874 A JP 5157874A JP 15787493 A JP15787493 A JP 15787493A JP H06349666 A JPH06349666 A JP H06349666A
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- 239000003985 ceramic capacitor Substances 0.000 title description 6
- 239000004020 conductor Substances 0.000 claims abstract description 27
- 239000003990 capacitor Substances 0.000 abstract description 22
- 239000000919 ceramic Substances 0.000 abstract description 5
- 239000003989 dielectric material Substances 0.000 abstract 1
- 238000005259 measurement Methods 0.000 description 4
- 230000000694 effects Effects 0.000 description 3
- KDLHZDBZIXYQEI-UHFFFAOYSA-N Palladium Chemical compound [Pd] KDLHZDBZIXYQEI-UHFFFAOYSA-N 0.000 description 2
- 230000006698 induction Effects 0.000 description 1
- 239000000463 material Substances 0.000 description 1
- 229910052763 palladium Inorganic materials 0.000 description 1
- 230000002093 peripheral effect Effects 0.000 description 1
- 229910052573 porcelain Inorganic materials 0.000 description 1
- 239000000758 substrate Substances 0.000 description 1
Landscapes
- Ceramic Capacitors (AREA)
Abstract
(57)【要約】
【目的】 積層コンデンサに対する外部回路の影響を防
ぐ。 【構成】 セラミック誘電体１に第１及び第２の内部電
極２、３が埋設されている。第１及び第２の内部電極
２、３は第１及び第２の外部電極４、５に接続されてい
る。第１及び第２の内部電極２、３は複数の導体層から
成る。複数の導体層は隣接する２つの導体層毎に同一の
外部電極に接続されている。
ぐ。 【構成】 セラミック誘電体１に第１及び第２の内部電
極２、３が埋設されている。第１及び第２の内部電極
２、３は第１及び第２の外部電極４、５に接続されてい
る。第１及び第２の内部電極２、３は複数の導体層から
成る。複数の導体層は隣接する２つの導体層毎に同一の
外部電極に接続されている。
Description
【０００１】
【産業上の利用分野】本発明は、高周波領域で使用する
ことが可能な積層セラミックコンデンサに関する。
ことが可能な積層セラミックコンデンサに関する。
【０００２】
【従来の技術】従来の典型的な積層セラミックコンデン
サは、図５に示すようにセラミック誘電体１と、この中
に交互に埋設された第１及び第２の内部電極２、３と、
第１及び第２の内部電極２、３に接続された第１及び第
２の外部電極４、５とから成る。この積層コンデンサで
は、第１及び第２の内部電極２、３の対向によって容量
が得られる。別の従来の積層コンデンサとして図６に示
す構造のものが知られている。図６の積層コンデンサで
は、第１の内部電極２の相互間に２つの第２の内部電極
３が配置され、また第２の内部電極３の相互間に２つの
第１の内部電極２が配置されている。この様に構成する
と、最も下側及び最も上側を除いた内部電極２、３に流
れる電流が図５の場合の１／２になるので、品質係数Ｑ
を高めることができる。
サは、図５に示すようにセラミック誘電体１と、この中
に交互に埋設された第１及び第２の内部電極２、３と、
第１及び第２の内部電極２、３に接続された第１及び第
２の外部電極４、５とから成る。この積層コンデンサで
は、第１及び第２の内部電極２、３の対向によって容量
が得られる。別の従来の積層コンデンサとして図６に示
す構造のものが知られている。図６の積層コンデンサで
は、第１の内部電極２の相互間に２つの第２の内部電極
３が配置され、また第２の内部電極３の相互間に２つの
第１の内部電極２が配置されている。この様に構成する
と、最も下側及び最も上側を除いた内部電極２、３に流
れる電流が図５の場合の１／２になるので、品質係数Ｑ
を高めることができる。
【０００３】
【発明が解決しようとする課題】ところで、最近の電子
回路装置では電子部品が回路基板上に高密度実装されて
いる。このため回路基板上の配線導体を積層コンデンサ
の下を通さなければならないことがある。この様な場合
には積層コンデンサの内部電極と回路基板上の配線導体
との間の浮遊容量（ストレーキャパシタンス）に基づく
電流が内部電極に流れ、Ｑを低下させる。また、回路基
板上の配線導体からノイズ成分が積層コンデンサを含む
回路に入り込む恐れがある。
回路装置では電子部品が回路基板上に高密度実装されて
いる。このため回路基板上の配線導体を積層コンデンサ
の下を通さなければならないことがある。この様な場合
には積層コンデンサの内部電極と回路基板上の配線導体
との間の浮遊容量（ストレーキャパシタンス）に基づく
電流が内部電極に流れ、Ｑを低下させる。また、回路基
板上の配線導体からノイズ成分が積層コンデンサを含む
回路に入り込む恐れがある。
【０００４】そこで、本発明の目的は、内部電極の電流
密度を低くしてＱを高めることができると共に、外部回
路の影響を低減することができる積層セラミックコンデ
ンサを提供することにある。
密度を低くしてＱを高めることができると共に、外部回
路の影響を低減することができる積層セラミックコンデ
ンサを提供することにある。
【０００５】
【課題を解決するための手段】上記目的を達成するため
の本発明は、第１及び第２の主面と側面とを有する誘電
体と、前記誘電体に埋設された複数の導体層からなる第
１及び第２の内部電極と、前記誘電体の外周面に設けら
れ且つ前記第１及び第２の内部電極に接続された第１及
び第２の外部電極とを有する積層セラミックコンデンサ
において、前記第１の内部電極が複数の導体層毎に複数
のグループに分割され、前記第２の内部電極も複数の導
体層毎に複数のグループに分割され、前記第１の内部電
極の前記複数のグループが交互に配置されていることを
特徴とする積層セラミックコンデンサに係わるものであ
る。
の本発明は、第１及び第２の主面と側面とを有する誘電
体と、前記誘電体に埋設された複数の導体層からなる第
１及び第２の内部電極と、前記誘電体の外周面に設けら
れ且つ前記第１及び第２の内部電極に接続された第１及
び第２の外部電極とを有する積層セラミックコンデンサ
において、前記第１の内部電極が複数の導体層毎に複数
のグループに分割され、前記第２の内部電極も複数の導
体層毎に複数のグループに分割され、前記第１の内部電
極の前記複数のグループが交互に配置されていることを
特徴とする積層セラミックコンデンサに係わるものであ
る。
【０００６】
【発明の作用及び効果】本発明では第１及び第２の内部
電極の複数の導体層がグループ化され、グループ毎に交
互に配置されている。第１及び第２の内部電極の導体層
の最も上の導体層と最も下の導体層は、所望の静電容量
を得るために直接に寄与しないが、静電容量を得るため
に使用される中間の導電層に浮遊容量に基づく電流が流
れることを阻止するために寄与し、更に電磁的シールド
効果を発揮する。また、内部電極の導体層は中央領域に
おいてもグループ化され、複数（好ましくは２枚）の導
体層が同一方向に導出されているので、静電容量に基づ
いて１つの導電層に流れる電流を１／２に低減すること
ができ、Ｑを高めること即ち信号ロスを低減することが
できる。
電極の複数の導体層がグループ化され、グループ毎に交
互に配置されている。第１及び第２の内部電極の導体層
の最も上の導体層と最も下の導体層は、所望の静電容量
を得るために直接に寄与しないが、静電容量を得るため
に使用される中間の導電層に浮遊容量に基づく電流が流
れることを阻止するために寄与し、更に電磁的シールド
効果を発揮する。また、内部電極の導体層は中央領域に
おいてもグループ化され、複数（好ましくは２枚）の導
体層が同一方向に導出されているので、静電容量に基づ
いて１つの導電層に流れる電流を１／２に低減すること
ができ、Ｑを高めること即ち信号ロスを低減することが
できる。
【０００７】
【実施例】次に、図１〜図３を参照して本発明の実施例
の積層コンデンサ１０を説明する。この積層コンデンサ
１０は、１ＭＨｚにおいて容量値Ｃが５．０ｐＦ、Ｑが
２０００の材料から成るセラミック（磁器）誘電体１
と、第１及び第２の内部電極２、３と、第１及び第２の
外部電極４、５とを有する。
の積層コンデンサ１０を説明する。この積層コンデンサ
１０は、１ＭＨｚにおいて容量値Ｃが５．０ｐＦ、Ｑが
２０００の材料から成るセラミック（磁器）誘電体１
と、第１及び第２の内部電極２、３と、第１及び第２の
外部電極４、５とを有する。
【０００８】外部電極４、５の厚みが省略されて示され
ている図１から明らかなように、誘電体１は第１の主面
（上面）８ａとこれに対向する第２の主面（下面）８ｂ
と第１〜第４の側面９ａ、９ｂ、９ｃ、９ｄを有して全
体として直方体に形成されている。
ている図１から明らかなように、誘電体１は第１の主面
（上面）８ａとこれに対向する第２の主面（下面）８ｂ
と第１〜第４の側面９ａ、９ｂ、９ｃ、９ｄを有して全
体として直方体に形成されている。
【０００９】第１及び第２の内部電極２、３が埋設され
た誘電体１は温度補償用誘電体磁器組成物から成るグリ
ーンシート（セラミック生シート）に導電性ペースト
（パラジウムペースト）を塗布したものを積層し、圧着
し、焼成することによって形成されている。図３に示す
ように幅広の帯状導体層から成る第１及び第２の内部電
極２、３は誘電体１の第１及び第２の第２の主面８ａ、
８ｂに対して平行に配置されている。
た誘電体１は温度補償用誘電体磁器組成物から成るグリ
ーンシート（セラミック生シート）に導電性ペースト
（パラジウムペースト）を塗布したものを積層し、圧着
し、焼成することによって形成されている。図３に示す
ように幅広の帯状導体層から成る第１及び第２の内部電
極２、３は誘電体１の第１及び第２の第２の主面８ａ、
８ｂに対して平行に配置されている。
【００１０】第１及び第２の内部電極２、３はそれぞれ
複数の導体層から成り、これ等は隣り合う２層が同一側
面に導出されるようにグループ化されている。即ち第１
及び第２の内部電極２、３が２層ずつ交互に第１の側面
９ｃと第２の側面９ｄとに導出されている。第１の外部
電極４は第１の側面９ａにて第１の内部電極２に接続さ
れ、誘電体１の左端部において第１、第３及び第４の側
面９ａ、９ｃ、９ｄと第１及び第２の主面８ａ、８ｂと
を覆うように導体膜で形成されている。第２の外部電極
５は誘電体１の右端部において第２、第３及び第４の側
面９ｂ、９ｃ、９ｄと第１及び第２の主面８ａ、８ｂと
を覆うように導体膜で形成されている。
複数の導体層から成り、これ等は隣り合う２層が同一側
面に導出されるようにグループ化されている。即ち第１
及び第２の内部電極２、３が２層ずつ交互に第１の側面
９ｃと第２の側面９ｄとに導出されている。第１の外部
電極４は第１の側面９ａにて第１の内部電極２に接続さ
れ、誘電体１の左端部において第１、第３及び第４の側
面９ａ、９ｃ、９ｄと第１及び第２の主面８ａ、８ｂと
を覆うように導体膜で形成されている。第２の外部電極
５は誘電体１の右端部において第２、第３及び第４の側
面９ｂ、９ｃ、９ｄと第１及び第２の主面８ａ、８ｂと
を覆うように導体膜で形成されている。
【００１１】第１及び第２の内部電極２、３を２つの導
体層毎にグループ化した効果を調べるために、積層コン
デンサ１０の第１及び第２の外部電極４、５を図４に示
すように測定用基板２０の配線導体２１、２２に半田付
けし、更に積層コンデンサ１０の下にグランド配線導体
２３を通し、ネットワークアナライザから成る測定器２
４を接続し、積層コンデンサ１０の外部電極４，５間に
１GHz の交流信号を流して積層コンデンサ１０のインピ
−ダンスＺ＝Ｒ＋jXc （但し、Ｒは実数部、Ｘc は虚数
部）を測定し、Ｑ即ち−Ｘc ／Ｒを求めたところ、Ｑは
５８であった。
体層毎にグループ化した効果を調べるために、積層コン
デンサ１０の第１及び第２の外部電極４、５を図４に示
すように測定用基板２０の配線導体２１、２２に半田付
けし、更に積層コンデンサ１０の下にグランド配線導体
２３を通し、ネットワークアナライザから成る測定器２
４を接続し、積層コンデンサ１０の外部電極４，５間に
１GHz の交流信号を流して積層コンデンサ１０のインピ
−ダンスＺ＝Ｒ＋jXc （但し、Ｒは実数部、Ｘc は虚数
部）を測定し、Ｑ即ち−Ｘc ／Ｒを求めたところ、Ｑは
５８であった。
【００１２】比較のために図５の従来の積層コンデンサ
においても、実施例の積層コンデンサ１０と同様な測定
を行ったところ、Ｑは４０であった。また、図６の従来
の積層コンデンサにおいても実施例と同様な測定を行っ
たところ、Ｑは５５であった。以上の測定結果から明ら
かなように、本実施例の構造とすることによって、図６
の構造と同様に内部電極２、３の電流密度を低減させる
効果を得ることができるのみでなく、グランド配線導体
２３等の外部回路の影響を最も上及び最も下の内部電極
によって防ぎ、Ｑを高めることができる。
においても、実施例の積層コンデンサ１０と同様な測定
を行ったところ、Ｑは４０であった。また、図６の従来
の積層コンデンサにおいても実施例と同様な測定を行っ
たところ、Ｑは５５であった。以上の測定結果から明ら
かなように、本実施例の構造とすることによって、図６
の構造と同様に内部電極２、３の電流密度を低減させる
効果を得ることができるのみでなく、グランド配線導体
２３等の外部回路の影響を最も上及び最も下の内部電極
によって防ぎ、Ｑを高めることができる。
【００１３】また、内部電極２、３の最も上及び最も下
の導体層は、Ｑの低下（信号ロスの増大）を防ぐのみで
なく、ノイズ成分のコンデンサへの入り込みを防ぐこと
ができる。
の導体層は、Ｑの低下（信号ロスの増大）を防ぐのみで
なく、ノイズ成分のコンデンサへの入り込みを防ぐこと
ができる。
【図１】本発明の実施例の積層コンデンサを概略的に示
す斜視図である。
す斜視図である。
【図２】図１のＡ−Ａ線に相当する部分を示す積層コン
デンサの断面図である。
デンサの断面図である。
【図３】図２のＢ−Ｂ線の断面図である。
【図４】積層コンデンサの特性測定装置を示す平面図で
ある。
ある。
【図５】従来の積層コンデンサを示す断面図である。
【図６】別の従来の積層コンデンサを示す断面図であ
る。
る。
１ 誘電体 ２、３ 内部電極 ４、５ 外部電極
フロントページの続き (72)発明者 増田 淳 東京都台東区上野６丁目16番20号 太陽誘 電株式会社内 (72)発明者 鳥羽 利一 東京都台東区上野６丁目16番20号 太陽誘 電株式会社内
Claims (1)
- 【請求項１】 第１及び第２の主面と側面とを有する誘
電体と、前記誘電体に埋設された複数の導体層からなる
第１及び第２の内部電極と、前記誘電体の外周面に設け
られ且つ前記第１及び第２の内部電極に接続された第１
及び第２の外部電極とを有する積層セラミックコンデン
サにおいて、 前記第１の内部電極が複数の導体層毎に複数のグループ
に分割され、前記第２の内部電極も複数の導体層毎に複
数のグループに分割され、前記第１の内部電極の前記複
数のグループが交互に配置されていることを特徴とする
積層セラミックコンデンサ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5157874A JPH06349666A (ja) | 1993-06-02 | 1993-06-02 | 積層セラミックコンデンサ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5157874A JPH06349666A (ja) | 1993-06-02 | 1993-06-02 | 積層セラミックコンデンサ |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH06349666A true JPH06349666A (ja) | 1994-12-22 |
Family
ID=15659301
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP5157874A Withdrawn JPH06349666A (ja) | 1993-06-02 | 1993-06-02 | 積層セラミックコンデンサ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH06349666A (ja) |
Cited By (12)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2004509451A (ja) * | 2000-04-28 | 2004-03-25 | エクストゥーワイ、アテニュエイタズ、エル、エル、シー | 遮蔽電極および被遮蔽電極を備えた相補的な対の部分と対称的に均衡のとれた相補的なエネルギー部コンディショニング用の他の所定の要素部分とを有する所定の対称的に均衡のとれた混合物 |
| JP2007005501A (ja) * | 2005-06-22 | 2007-01-11 | Tdk Corp | コンデンサ素子および非可逆回路素子 |
| JP2007043001A (ja) * | 2005-08-05 | 2007-02-15 | Tdk Corp | 積層コンデンサの製造方法 |
| US7239500B2 (en) | 2005-09-30 | 2007-07-03 | Tdk Corporation | Multilayer capacitor |
| US7688567B2 (en) | 2005-08-05 | 2010-03-30 | Tdk Corporation | Method of manufacturing multilayer capacitor and multilayer capacitor |
| JP2011040581A (ja) * | 2009-08-11 | 2011-02-24 | Sony Corp | 静電容量素子及び共振回路 |
| US20110149466A1 (en) * | 2009-12-22 | 2011-06-23 | Samsung Electro-Mechanics Co., Ltd. | Multilayer ceramic capacitor |
| US8116064B2 (en) | 2008-07-29 | 2012-02-14 | Tdk Corporation | Multilayer capacitor |
| JP2016111248A (ja) * | 2014-12-09 | 2016-06-20 | Tdk株式会社 | 積層セラミックコンデンサ |
| CN114078634A (zh) * | 2020-08-20 | 2022-02-22 | 株式会社村田制作所 | 层叠陶瓷电容器 |
| KR20220168548A (ko) * | 2021-06-16 | 2022-12-23 | 가부시키가이샤 무라타 세이사쿠쇼 | 적층 세라믹 콘덴서 |
| JP2023542495A (ja) * | 2020-09-10 | 2023-10-10 | ケメット エレクトロニクス コーポレーション | 共振積層セラミックコンデンサ |
-
1993
- 1993-06-02 JP JP5157874A patent/JPH06349666A/ja not_active Withdrawn
Cited By (19)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2004509451A (ja) * | 2000-04-28 | 2004-03-25 | エクストゥーワイ、アテニュエイタズ、エル、エル、シー | 遮蔽電極および被遮蔽電極を備えた相補的な対の部分と対称的に均衡のとれた相補的なエネルギー部コンディショニング用の他の所定の要素部分とを有する所定の対称的に均衡のとれた混合物 |
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| CN114078634A (zh) * | 2020-08-20 | 2022-02-22 | 株式会社村田制作所 | 层叠陶瓷电容器 |
| KR20220023291A (ko) * | 2020-08-20 | 2022-03-02 | 가부시키가이샤 무라타 세이사쿠쇼 | 적층 세라믹 콘덴서 |
| JP2022035385A (ja) * | 2020-08-20 | 2022-03-04 | 株式会社村田製作所 | 積層セラミックコンデンサ |
| US11972903B2 (en) | 2020-08-20 | 2024-04-30 | Murata Manufacturing Co., Ltd. | Multilayer ceramic capacitor |
| CN114078634B (zh) * | 2020-08-20 | 2024-05-07 | 株式会社村田制作所 | 层叠陶瓷电容器 |
| JP2023542495A (ja) * | 2020-09-10 | 2023-10-10 | ケメット エレクトロニクス コーポレーション | 共振積層セラミックコンデンサ |
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| US12073997B2 (en) | 2021-06-16 | 2024-08-27 | Murata Manufacturing Co., Ltd. | Multilayer ceramic capacitor |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A300 | Application deemed to be withdrawn because no request for examination was validly filed |
Free format text: JAPANESE INTERMEDIATE CODE: A300 Effective date: 20000905 |