JPH0636667B2 - 表示制御兼用半導体スイッチ素子制御回路 - Google Patents
表示制御兼用半導体スイッチ素子制御回路Info
- Publication number
- JPH0636667B2 JPH0636667B2 JP57160167A JP16016782A JPH0636667B2 JP H0636667 B2 JPH0636667 B2 JP H0636667B2 JP 57160167 A JP57160167 A JP 57160167A JP 16016782 A JP16016782 A JP 16016782A JP H0636667 B2 JPH0636667 B2 JP H0636667B2
- Authority
- JP
- Japan
- Prior art keywords
- output
- counter
- power supply
- switch element
- semiconductor switch
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Lifetime
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Classifications
-
- H—ELECTRICITY
- H02—GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
- H02M—APPARATUS FOR CONVERSION BETWEEN AC AND AC, BETWEEN AC AND DC, OR BETWEEN DC AND DC, AND FOR USE WITH MAINS OR SIMILAR POWER SUPPLY SYSTEMS; CONVERSION OF DC OR AC INPUT POWER INTO SURGE OUTPUT POWER; CONTROL OR REGULATION THEREOF
- H02M1/00—Details of apparatus for conversion
- H02M1/08—Circuits specially adapted for the generation of control voltages for semiconductor devices incorporated in static converters
Landscapes
- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
- Ac-Ac Conversion (AREA)
- Control Of Electrical Variables (AREA)
- Continuous-Control Power Sources That Use Transistors (AREA)
- Power Conversion In General (AREA)
Description
【発明の詳細な説明】 産業上の利用分野 この発明は、洗濯機用モータ等の負荷への給電路に設け
る半導体スイッチ素子を制御するとともに、それに関連
する表示器の点灯状態を制御する表示制御兼用半導体ス
イッチ素子制御回路に関するものである。
る半導体スイッチ素子を制御するとともに、それに関連
する表示器の点灯状態を制御する表示制御兼用半導体ス
イッチ素子制御回路に関するものである。
従来例の構成とその問題点 モータ等の負荷への給電を断続する両方向性半導体スイ
ッチ素子を点弧する方法として、従来より電源電圧の零
位相近傍もしくは直流点弧またはパルス点弧する方法が
知られているが、いずれも点弧回路が高価であるという
欠点を有していた。
ッチ素子を点弧する方法として、従来より電源電圧の零
位相近傍もしくは直流点弧またはパルス点弧する方法が
知られているが、いずれも点弧回路が高価であるという
欠点を有していた。
また、瞬時停電が起きたときに表示器を消灯させるとと
もに負荷への給電を停止するために、従来は外部に設け
た瞬時停電検知回路により瞬時停電を検知するようにし
ていた。そのため、回路構成が複雑で高価であるという
問題があった。
もに負荷への給電を停止するために、従来は外部に設け
た瞬時停電検知回路により瞬時停電を検知するようにし
ていた。そのため、回路構成が複雑で高価であるという
問題があった。
発明の目的 この発明の目的は、半導体スイッチ素子の点弧を簡単な
回路構成で安価に行うとともに、少ない消費電力で表示
器を点灯させて電源部の負担を軽減することができ、さ
らに瞬時停電検知も簡単な回路構成を行うことができる
表示制御兼用半導体スイッチ素子制御回路を提供するこ
とである。
回路構成で安価に行うとともに、少ない消費電力で表示
器を点灯させて電源部の負担を軽減することができ、さ
らに瞬時停電検知も簡単な回路構成を行うことができる
表示制御兼用半導体スイッチ素子制御回路を提供するこ
とである。
発明の構成 この発明の表示制御兼用半導体スイッチ素子制御回路
は、電源同期パルスを発生する電源同期パルス発生回路
と、この電源同期パルスより周波数の高いクロックパル
スを発生するクロックパルス発生回路と、前記電源同期
パルスでセット・リセットされて前記クロックパルスを
一定数カウントする毎に出力を発生するカウンタと、こ
のカウンタの出力に応じて点灯する表示器と、前記カウ
ンタの出力に応じて点弧されて導通する半導体スイッチ
素子と、前記カウンタの出力をカウントし、このカウン
ト値が所定値を越えたときに出力を発生する瞬時停電検
出用カウンタと、この瞬時停電検出用カウンタの出力に
応答して前記カウンタの出力が前記表示器および半導体
スイッチ素子に供給されるのを遮断する遮断手段とを備
える構成にしたものである。
は、電源同期パルスを発生する電源同期パルス発生回路
と、この電源同期パルスより周波数の高いクロックパル
スを発生するクロックパルス発生回路と、前記電源同期
パルスでセット・リセットされて前記クロックパルスを
一定数カウントする毎に出力を発生するカウンタと、こ
のカウンタの出力に応じて点灯する表示器と、前記カウ
ンタの出力に応じて点弧されて導通する半導体スイッチ
素子と、前記カウンタの出力をカウントし、このカウン
ト値が所定値を越えたときに出力を発生する瞬時停電検
出用カウンタと、この瞬時停電検出用カウンタの出力に
応答して前記カウンタの出力が前記表示器および半導体
スイッチ素子に供給されるのを遮断する遮断手段とを備
える構成にしたものである。
実施例の説明 第１図はこの発明の一実施例の表示制御兼用半導体スイ
ッチ素子制御回路の回路図を示している。１は商用電源
に同期した電源同期パルスP1を発生する電源同期パルス
発生回路、２は電源同期パルスP1より十分周波数の高い
クロックパルスP2を発生するクロックパルス発生回路で
ある。３は順次動作を記憶する記憶部であり、電源同期
パルスP1およびクロックパルスP2が入力されていること
により記憶内容に応じて表示器制御用端子Ｔ11〜Ｔ13，
Ｔ21〜Ｔ23およびスイッチ制御用端子Ｔ31〜Ｔ33の出力
状態を順次変化させる。４は記憶部３を通して加えられ
る電源同期パルスP1によりセット・リセットされてクロ
ックパルスP2をカウントする３進カウンタであり、カウ
ント値に応じて出力端子Ｔ41〜Ｔ43よりパルスを発生す
る。５は記憶部３を通して加えられる電源同期パルスP1
によりセット・リセットされて３進カウンタ４の特定の
出力端子、例えばＴ41からのパルスをカウントするカウ
ンタで、カウント値が電源同期パルスP1の１周期内に入
るパルス数を越えたときに出力が高レベルから低レベル
に変化する。６は記憶部３の表示器制御用端子Ｔ11〜Ｔ
13・Ｔ21〜Ｔ23の出力がそれぞれ一方の入力端子に加え
られるとともにカウンタ５の出力が他方の入力端子に共
通に加えられる６個のアンドゲートAN11〜AN13，AN21〜
AN23からなるゲート群である。７は記憶部３のスイッチ
制御用端子Ｔ31〜Ｔ33の出力がそれぞれ第１の入力端子
に加えられ３進カウンタ４の出力端子Ｔ41の出力パルス
が第２の入力端子に共通に加えられカウンタ５の出力が
第３の入力端子に共通に加えられるアンドゲートAN31〜
AN33からなるゲート群である。８はアンドゲートAN11〜
AN13，AN21〜AN23の出力が一方の入力端子にそれぞれ加
えられ３進カウンタの出力端子Ｔ41〜Ｔ43からのパルス
が他方の入力端に加えられるナンドゲートNA11〜NA13，
NA21〜NA23からなるゲート群である。９はアンドゲート
AN31〜AN33の出力がそれぞれ加えられるインバータIN１
〜IN３からなるドライバ群である。１０はナンドゲート
NA11〜NA13，NA21〜NA23の出力に応じて点灯する発光ダ
イオードLED1〜LED6からなる表示器群である。１１はイ
ンバータIN１〜IN３の出力でそれぞれ点弧される両方向
性３端子サイリスタSCR１〜SCR3からなる半導体スイッ
チ素子群である。１２は発光ダイオードLED1〜LED６の
限流抵抗Ｒ1〜Ｒ6からなる抵抗群、１３は両方向性３端
子サイリスタSCR1〜SCR３のゲート抵抗Ｒ7〜Ｒ9からな
る抵抗群である。
ッチ素子制御回路の回路図を示している。１は商用電源
に同期した電源同期パルスP1を発生する電源同期パルス
発生回路、２は電源同期パルスP1より十分周波数の高い
クロックパルスP2を発生するクロックパルス発生回路で
ある。３は順次動作を記憶する記憶部であり、電源同期
パルスP1およびクロックパルスP2が入力されていること
により記憶内容に応じて表示器制御用端子Ｔ11〜Ｔ13，
Ｔ21〜Ｔ23およびスイッチ制御用端子Ｔ31〜Ｔ33の出力
状態を順次変化させる。４は記憶部３を通して加えられ
る電源同期パルスP1によりセット・リセットされてクロ
ックパルスP2をカウントする３進カウンタであり、カウ
ント値に応じて出力端子Ｔ41〜Ｔ43よりパルスを発生す
る。５は記憶部３を通して加えられる電源同期パルスP1
によりセット・リセットされて３進カウンタ４の特定の
出力端子、例えばＴ41からのパルスをカウントするカウ
ンタで、カウント値が電源同期パルスP1の１周期内に入
るパルス数を越えたときに出力が高レベルから低レベル
に変化する。６は記憶部３の表示器制御用端子Ｔ11〜Ｔ
13・Ｔ21〜Ｔ23の出力がそれぞれ一方の入力端子に加え
られるとともにカウンタ５の出力が他方の入力端子に共
通に加えられる６個のアンドゲートAN11〜AN13，AN21〜
AN23からなるゲート群である。７は記憶部３のスイッチ
制御用端子Ｔ31〜Ｔ33の出力がそれぞれ第１の入力端子
に加えられ３進カウンタ４の出力端子Ｔ41の出力パルス
が第２の入力端子に共通に加えられカウンタ５の出力が
第３の入力端子に共通に加えられるアンドゲートAN31〜
AN33からなるゲート群である。８はアンドゲートAN11〜
AN13，AN21〜AN23の出力が一方の入力端子にそれぞれ加
えられ３進カウンタの出力端子Ｔ41〜Ｔ43からのパルス
が他方の入力端に加えられるナンドゲートNA11〜NA13，
NA21〜NA23からなるゲート群である。９はアンドゲート
AN31〜AN33の出力がそれぞれ加えられるインバータIN１
〜IN３からなるドライバ群である。１０はナンドゲート
NA11〜NA13，NA21〜NA23の出力に応じて点灯する発光ダ
イオードLED1〜LED6からなる表示器群である。１１はイ
ンバータIN１〜IN３の出力でそれぞれ点弧される両方向
性３端子サイリスタSCR１〜SCR3からなる半導体スイッ
チ素子群である。１２は発光ダイオードLED1〜LED６の
限流抵抗Ｒ1〜Ｒ6からなる抵抗群、１３は両方向性３端
子サイリスタSCR1〜SCR３のゲート抵抗Ｒ7〜Ｒ9からな
る抵抗群である。
第２図は電源同期パルス発生回路１の具体回路図を示し
ている。図において、Ｅは商用電源であり、トランスＴ
Ｒが接続される。トランスＴＲの２次出力は抵抗Ｒ10〜
Ｒ11により分割されるとともにダイオードＤおよびコン
デンサＣにより平滑され、抵抗Ｒ10，Ｒ11の分割電圧は
トランジスタＱのベースに印加され、コンデンサＣの両
端電圧は抵抗Ｒ12を介してトランジスタＱのコレクタ・
エミッタ間に印加される。したがって、トランジスタＱ
のコレクタより商用電源Ｅに同期した電源同期パルスP1
が出力されることになる。
ている。図において、Ｅは商用電源であり、トランスＴ
Ｒが接続される。トランスＴＲの２次出力は抵抗Ｒ10〜
Ｒ11により分割されるとともにダイオードＤおよびコン
デンサＣにより平滑され、抵抗Ｒ10，Ｒ11の分割電圧は
トランジスタＱのベースに印加され、コンデンサＣの両
端電圧は抵抗Ｒ12を介してトランジスタＱのコレクタ・
エミッタ間に印加される。したがって、トランジスタＱ
のコレクタより商用電源Ｅに同期した電源同期パルスP1
が出力されることになる。
なお、第１図において、破線で囲んだ部分はマイクロコ
ンピュータで構成した場合、記憶部３はリードオンリメ
モリで、３進カウンタ４およびカウンタ５はランダムア
クセスメモリに設けたソフトカウンタで、ゲート群６〜
８は内部の論理回路部，リードオンリメモリおよび出力
ポートでそれぞれ実現できる。
ンピュータで構成した場合、記憶部３はリードオンリメ
モリで、３進カウンタ４およびカウンタ５はランダムア
クセスメモリに設けたソフトカウンタで、ゲート群６〜
８は内部の論理回路部，リードオンリメモリおよび出力
ポートでそれぞれ実現できる。
つぎに、動作について第３図および第４図を参照して詳
しく説明する。電源同期パルス発生回路１より第３図
(A)に示すような電源同期パルスP1が出力され、この電
源同期パルスP1によりカウンタ２がセット・リセットさ
れてクロックパルス発生回路２からの第３図(B)に示す
ようなクロックパルスP2をカウントし、各カウント値の
出力端子Ｔ41〜Ｔ43より第３図(C)，(D)，(E)に示すよ
うな順次1/3周期ずつ位相のずれた1/3デューティのパル
スをそれぞれ出力する。これらのパルスにより発光ダイ
オードLED1〜LED６は時分割給電されて1/3周期で順次間
欠点灯可能な状態となる。このときの３進カウンタ４の
周期、すなわち例えば第３図(C)のパルスの周期は電源
同期パルスP1の周期に比べて十分小さく、電源同期パル
スP1の１周期の中で３進カウンタ４が複数回動作し、発
光ダイオードLED1〜LED6の各々は電源同期パルスP1の１
周期中に複数回点灯可能な状態となる。
しく説明する。電源同期パルス発生回路１より第３図
(A)に示すような電源同期パルスP1が出力され、この電
源同期パルスP1によりカウンタ２がセット・リセットさ
れてクロックパルス発生回路２からの第３図(B)に示す
ようなクロックパルスP2をカウントし、各カウント値の
出力端子Ｔ41〜Ｔ43より第３図(C)，(D)，(E)に示すよ
うな順次1/3周期ずつ位相のずれた1/3デューティのパル
スをそれぞれ出力する。これらのパルスにより発光ダイ
オードLED1〜LED６は時分割給電されて1/3周期で順次間
欠点灯可能な状態となる。このときの３進カウンタ４の
周期、すなわち例えば第３図(C)のパルスの周期は電源
同期パルスP1の周期に比べて十分小さく、電源同期パル
スP1の１周期の中で３進カウンタ４が複数回動作し、発
光ダイオードLED1〜LED6の各々は電源同期パルスP1の１
周期中に複数回点灯可能な状態となる。
一方、記憶部３は、記憶内容に応じて表示器制御用出力
端子Ｔ11〜Ｔ13，Ｔ21〜Ｔ23の出力状態を変化させ、例
えば表示器制御用端子Ｔ11の出力が高レベルのときは発
光ダイオードLED1が第３図(C)のパルスのタイミングで
間欠点灯し、同様に他の表示器制御用端子Ｔ12，Ｔ13，
Ｔ21〜Ｔ23のいずれかが高レベルのときは発光ダイオー
ドLED2〜LFD6が第３図(C)〜(E)のパルスのいずれかのタ
イミングで間欠点灯する。なお、間欠点灯するとはいっ
ても、その周期は非常に短いため、肉眼で見た場合連続
点灯しているように見える。
端子Ｔ11〜Ｔ13，Ｔ21〜Ｔ23の出力状態を変化させ、例
えば表示器制御用端子Ｔ11の出力が高レベルのときは発
光ダイオードLED1が第３図(C)のパルスのタイミングで
間欠点灯し、同様に他の表示器制御用端子Ｔ12，Ｔ13，
Ｔ21〜Ｔ23のいずれかが高レベルのときは発光ダイオー
ドLED2〜LFD6が第３図(C)〜(E)のパルスのいずれかのタ
イミングで間欠点灯する。なお、間欠点灯するとはいっ
ても、その周期は非常に短いため、肉眼で見た場合連続
点灯しているように見える。
また、記憶部３は、記憶内容に応じてスイッチ制御用端
子Ｔ31〜Ｔ33の出力状態を変化させ、例えばスイッチ制
御用端子Ｔ31の出力が高レベルのときは３進カウンタ４
の出力端子Ｔ41のパルスがアンドゲートAN31，インバー
タIN１および抵抗R7を介して両方向性３端子サイリスタ
CSR1のゲートに入力され、両方向性３端子サイリスタSC
R1がパルス点弧されて導通する。他のスイッチ制御用端
子Ｔ32，Ｔ33が高レベルのときも同様である。
子Ｔ31〜Ｔ33の出力状態を変化させ、例えばスイッチ制
御用端子Ｔ31の出力が高レベルのときは３進カウンタ４
の出力端子Ｔ41のパルスがアンドゲートAN31，インバー
タIN１および抵抗R7を介して両方向性３端子サイリスタ
CSR1のゲートに入力され、両方向性３端子サイリスタSC
R1がパルス点弧されて導通する。他のスイッチ制御用端
子Ｔ32，Ｔ33が高レベルのときも同様である。
ところが、商用電源Ｅが瞬時停電すると、正常時は第４
図(A)に示すような波形であった電源同期パルスP1が第
４図(B)に示すように立下がらず高レベル出力状態のま
まとなる。その結果、３進カウンタ４およびカウンタ５
はセット・リセットされなくなり、例えば３進カウンタ
４の出力端子Ｔ41のパルスは第４図(C)に示すように電
源同期パルスＰ1の１周期以上にわたって連続し、この
出力端子Ｔ41のパルスをカウンタ５が同じく１周期以上
にわたってカウントすることになり、カウンタ５はカウ
ント値が一定値以上となり、出力が高レベル状態から低
レベル状態となる。その結果、ゲート群６，７の出力が
低レベル状態となり、記憶部３からの制御信号は遮断さ
れ、発光ダイオードLED1〜LED６および両方向性３端子
サイリスタCSR１〜SCR3のゲートへの通電が停止され、
発光ダイオードLED1〜LED６が消灯するとともに両方向
性３端子サイリスタSCR1〜SCR３が遮断する。
図(A)に示すような波形であった電源同期パルスP1が第
４図(B)に示すように立下がらず高レベル出力状態のま
まとなる。その結果、３進カウンタ４およびカウンタ５
はセット・リセットされなくなり、例えば３進カウンタ
４の出力端子Ｔ41のパルスは第４図(C)に示すように電
源同期パルスＰ1の１周期以上にわたって連続し、この
出力端子Ｔ41のパルスをカウンタ５が同じく１周期以上
にわたってカウントすることになり、カウンタ５はカウ
ント値が一定値以上となり、出力が高レベル状態から低
レベル状態となる。その結果、ゲート群６，７の出力が
低レベル状態となり、記憶部３からの制御信号は遮断さ
れ、発光ダイオードLED1〜LED６および両方向性３端子
サイリスタCSR１〜SCR3のゲートへの通電が停止され、
発光ダイオードLED1〜LED６が消灯するとともに両方向
性３端子サイリスタSCR1〜SCR３が遮断する。
上記両方向性３端子サイリスタSCR1〜SCR３の導通・遮
断によりモータ等の負荷への給電が制御される。
断によりモータ等の負荷への給電が制御される。
このように、この実施例は、６個の発光ダイオードLED1
〜LED６に時分割給電できるようにし、記憶部３からの
制御信号に応じて発光ダイオードLED1〜LED６のいずれ
かを周期的に間欠点灯させるようにしたため、発光ダイ
オードLED1〜LED６の消費電力を低減させることがで
き、電源部の負担を軽減できる。また、発光ダイオード
LED1〜LED６を時分割点灯させるための３進カウンタ４
の出力端子Ｔ41のパルスを両方向性３端子サイリスタSC
R1〜SCR３の点弧パルスとするようにしたため、別の点
弧回路が不要となり、点弧のための回路構成が簡素化さ
れ、コストダウンを達成できる。さらに、電源同期パル
スP1によりセット・リセットされるカウンタ５が３進カ
ウンタ４の出力を一定値以上カウントしたときに出力を
発生させるようにしたため、簡単で安価に瞬時停電を検
知できる。また、電源同期パルスの幅が一定以上である
ことを検出して瞬時停電と見なすことも考えられるが、
このような構成と比べても構成が簡単である。
〜LED６に時分割給電できるようにし、記憶部３からの
制御信号に応じて発光ダイオードLED1〜LED６のいずれ
かを周期的に間欠点灯させるようにしたため、発光ダイ
オードLED1〜LED６の消費電力を低減させることがで
き、電源部の負担を軽減できる。また、発光ダイオード
LED1〜LED６を時分割点灯させるための３進カウンタ４
の出力端子Ｔ41のパルスを両方向性３端子サイリスタSC
R1〜SCR３の点弧パルスとするようにしたため、別の点
弧回路が不要となり、点弧のための回路構成が簡素化さ
れ、コストダウンを達成できる。さらに、電源同期パル
スP1によりセット・リセットされるカウンタ５が３進カ
ウンタ４の出力を一定値以上カウントしたときに出力を
発生させるようにしたため、簡単で安価に瞬時停電を検
知できる。また、電源同期パルスの幅が一定以上である
ことを検出して瞬時停電と見なすことも考えられるが、
このような構成と比べても構成が簡単である。
なお、上記実施例では３進カウンタ４を用いたが、発光
ダイオードLED1〜LED６の１個数に応じてｎ進カウンタ
（ｎは整数）を用いてもよい。また、実施例では３進カ
ウンタ４の出力端子Ｔ41のパルスをゲート群７に入力す
るようにしたが、クロックパルスP2を入力してもよい。
ダイオードLED1〜LED６の１個数に応じてｎ進カウンタ
（ｎは整数）を用いてもよい。また、実施例では３進カ
ウンタ４の出力端子Ｔ41のパルスをゲート群７に入力す
るようにしたが、クロックパルスP2を入力してもよい。
発明の効果 この発明によれば、表示器を間欠点灯させて表示器の消
費電力を低減して電源部の負担を軽減することができる
とともに、表示器を間欠点灯させるその回路を半導体ス
イッチ素子の点弧に共用することができ、特別な点弧回
路は不要で、点弧のための回路構成が簡素化され、コス
トダウンを図ることができる。しかも、瞬時停電検出用
カウンタでカウンタの出力をカウントする構成により、
瞬時停電を簡単で安価な構成で検出することができる。
費電力を低減して電源部の負担を軽減することができる
とともに、表示器を間欠点灯させるその回路を半導体ス
イッチ素子の点弧に共用することができ、特別な点弧回
路は不要で、点弧のための回路構成が簡素化され、コス
トダウンを図ることができる。しかも、瞬時停電検出用
カウンタでカウンタの出力をカウントする構成により、
瞬時停電を簡単で安価な構成で検出することができる。
第１図はこの発明の一実施例の表示制御兼用半導体スイ
ッチ素子制御回路のブロック図、第２図はその要部具体
回路図、第３図(A)〜(E)および第４図(A)〜(C)は同じく
その各部の波形図である。 １……電源同期パルス発生回路、２……クロックパルス
発生回路、３……記憶部、４……３進カウンタ、５……
カウンタ、６〜８……ゲート群、１０……表示器群、１
１……半導体スイッチ素子群
ッチ素子制御回路のブロック図、第２図はその要部具体
回路図、第３図(A)〜(E)および第４図(A)〜(C)は同じく
その各部の波形図である。 １……電源同期パルス発生回路、２……クロックパルス
発生回路、３……記憶部、４……３進カウンタ、５……
カウンタ、６〜８……ゲート群、１０……表示器群、１
１……半導体スイッチ素子群
───────────────────────────────────────────────────── フロントページの続き (72)発明者 玉江 貞之 大阪府門真市大字門真1006番地 松下電器 産業株式会社内 (56)参考文献 特開 昭58−89064（ＪＰ，Ａ)
Claims (1)
- 【請求項１】電源同期パルスを発生する電源同期パルス
発生回路と、この電源同期パルスより周波数の高いクロ
ックパルスを発生するクロックパルス発生回路と、前記
電源同期パルスでセット・リセットされて前記クロック
パルスを一定数カウントする毎に出力を発生するカウン
タと、このカウンタの出力に応じて点灯する表示器と、
前記カウンタの出力に応じて点弧されて導通する半導体
スイッチ素子と、前記カウンタの出力をカウントし、こ
のカウント値が所定値を越えたときに出力を発生する瞬
時停電検出用カウンタと、この瞬時停電検出用カウンタ
の出力に応答して前記カウンタの出力が前記表示器およ
び半導体スイッチ素子に供給されるのを遮断する遮断手
段とを備えた表示制御兼用半導体スイッチ素子制御回
路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57160167A JPH0636667B2 (ja) | 1982-09-14 | 1982-09-14 | 表示制御兼用半導体スイッチ素子制御回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57160167A JPH0636667B2 (ja) | 1982-09-14 | 1982-09-14 | 表示制御兼用半導体スイッチ素子制御回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5950770A JPS5950770A (ja) | 1984-03-23 |
| JPH0636667B2 true JPH0636667B2 (ja) | 1994-05-11 |
Family
ID=15709298
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP57160167A Expired - Lifetime JPH0636667B2 (ja) | 1982-09-14 | 1982-09-14 | 表示制御兼用半導体スイッチ素子制御回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0636667B2 (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS635797A (ja) * | 1986-06-27 | 1988-01-11 | 日本建鐵株式会社 | 洗たく機の運転制御方法 |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5889064A (ja) * | 1981-11-19 | 1983-05-27 | Matsushita Electric Works Ltd | 制御位相の表示回路 |
-
1982
- 1982-09-14 JP JP57160167A patent/JPH0636667B2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5950770A (ja) | 1984-03-23 |
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