JPH0640264B2 - エンベロ−プジエネレ−タ - Google Patents
エンベロ−プジエネレ−タInfo
- Publication number
- JPH0640264B2 JPH0640264B2 JP60080918A JP8091885A JPH0640264B2 JP H0640264 B2 JPH0640264 B2 JP H0640264B2 JP 60080918 A JP60080918 A JP 60080918A JP 8091885 A JP8091885 A JP 8091885A JP H0640264 B2 JPH0640264 B2 JP H0640264B2
- Authority
- JP
- Japan
- Prior art keywords
- sample
- output
- envelope
- hold circuit
- voltage
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
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- Electrophonic Musical Instruments (AREA)
Description
【発明の詳細な説明】 産業上の利用分野 本発明は電子楽器の楽音エンベロープを発生するエンベ
ロープジエネレータに関するものである。
ロープジエネレータに関するものである。
従来技術 従来エンベロープジエネレータを実現する手段として、
時定数回路の放電特性を利用したものがある。これは時
定数回路を定電圧で充電する際の電圧変化を楽音のアタ
ツクエンベロープとして、また放電する際の電圧変化を
楽音のデイケイエンベロープとして利用するものであ
る。
時定数回路の放電特性を利用したものがある。これは時
定数回路を定電圧で充電する際の電圧変化を楽音のアタ
ツクエンベロープとして、また放電する際の電圧変化を
楽音のデイケイエンベロープとして利用するものであ
る。
発明が解決しようとする問題点 しかし、上記のようなエンベロープジエネレータでは、
時定数回路を形成する抵抗やコンデンサの精度がそのま
まエンベロープ曲線に反映されてしまう。すなわち、周
囲の温度変化や定数のバラツキにより異なるエンベロー
プ曲線が発生されてしまう。また、複雑なエンベロープ
曲線を得るためには、複数の時定数回路を用意し遂時切
換えるというような手段をとる必要があり、複雑な回路
構成となつてしまう。さらに、エンベロープ曲線をデイ
ジタル値に変換してメモリへ格納しておきこれを随時読
み出してはアナログ電圧に変換してエンベロープ曲線を
得る方法，あるいは楽音形成もデイジタル信号である場
合は、前記メモリから読み出したエンベロープのデイジ
タル信号と楽音のデイジタル信号とをデイジタル乗算す
る方法等もある。いずれの場合もエンベロープのデイジ
タル信号を格納するための大容量なメモリが必要である
し、特に後者ではデイジタル乗算器が必要となり、高価
なものとなつてしまう。
時定数回路を形成する抵抗やコンデンサの精度がそのま
まエンベロープ曲線に反映されてしまう。すなわち、周
囲の温度変化や定数のバラツキにより異なるエンベロー
プ曲線が発生されてしまう。また、複雑なエンベロープ
曲線を得るためには、複数の時定数回路を用意し遂時切
換えるというような手段をとる必要があり、複雑な回路
構成となつてしまう。さらに、エンベロープ曲線をデイ
ジタル値に変換してメモリへ格納しておきこれを随時読
み出してはアナログ電圧に変換してエンベロープ曲線を
得る方法，あるいは楽音形成もデイジタル信号である場
合は、前記メモリから読み出したエンベロープのデイジ
タル信号と楽音のデイジタル信号とをデイジタル乗算す
る方法等もある。いずれの場合もエンベロープのデイジ
タル信号を格納するための大容量なメモリが必要である
し、特に後者ではデイジタル乗算器が必要となり、高価
なものとなつてしまう。
本発明は抵抗やコンデンサより成る時定数回路の不安定
性や、デイジタル方式の大規模かつ高価であるという欠
点を改善し、簡易な回路構成によるエンベロープジエネ
レータの提供を目的とするものである。
性や、デイジタル方式の大規模かつ高価であるという欠
点を改善し、簡易な回路構成によるエンベロープジエネ
レータの提供を目的とするものである。
問題点を解決するための手段 本発明は、上記の目的を達成するために、アナログ処理
とデイジタル処理のそれぞれのメリツトを効果的に利用
したものである。すなわち、時間軸方向のみ離散化し、
振幅方向は乗算形Ｄ／Ａコンバータのリフアレンス電圧
としてアナログ信号に変換された信号をサンプルアンド
ホールド回路を介し遅延して入力する回路構成により、
デイジタル乗算器を用いずにアナログ処理で振幅の制御
が可能となり、また信号の巡回処理手段により回路を小
規模にまとめることができるものである。
とデイジタル処理のそれぞれのメリツトを効果的に利用
したものである。すなわち、時間軸方向のみ離散化し、
振幅方向は乗算形Ｄ／Ａコンバータのリフアレンス電圧
としてアナログ信号に変換された信号をサンプルアンド
ホールド回路を介し遅延して入力する回路構成により、
デイジタル乗算器を用いずにアナログ処理で振幅の制御
が可能となり、また信号の巡回処理手段により回路を小
規模にまとめることができるものである。
実施例 本発明の一実施例を説明する。第１図は本発明のエンベ
ロープジエネレータの一実施例の要部を示す回路図であ
る。また第２図はこの実施例の回路動作を示すタイミン
グチヤートである。ピアノ，ギター等の減衰音系楽器の
エンベロープを発生するように成した実施例を示したも
ので、第１図におけるクロツクコントローラ１は、マス
タークロツク1aと、発音のONあるいはOFFを指示するス
イツチ1bよりのON／▲▼信号とを入力とし、S
H1，SH2，▲▼の各信号を出力するもので、これ
らの信号間のタイミングは第２図に示す。このようなタ
イミングを制御する具体的な回路としては第１図(b)の
ようなものが考えられる。この回路の構成は一般的なも
のであり、容易に理解できるものなので説明は省略す
る。次にセレクタ４はセレクト信号Ｓが“H"の時に入力
端子Ａに入力される値を、セレクト信号Ｓが“L"の時に
入力端子Ｂに入力される値を出力端子Ｙに出力するもの
である。この出力端子Ｙに表われる信号をＮビツトのデ
イジタル値Ｋとする。Ｋは乗算形D/Aコンバータ５の入
力となる。２のレジスタＡにはＮビツトのデイジタル値
K1が、３のレジスタＢには同じくＮビツトのデイジタル
値K2が格納されている。乗算形D/Aコンバータ５の出力
電圧は、スイツチSW1，コンデンサＣ１およびバツフア
Ａ１よりなる第１のサンプル アンド ホールド回路に
入力される。この第１のサンプル アンド ホールド回
路の出力Voutと定電圧源６の出力電圧Vrは、オルタネー
テイブに動作する２つのスイツチSW3およびSW4によつて
選択されスイツチSW2、コンデンサC2およびバツフアA2
よりなる第２のサンプル アンド ホールド回路に入力
される。この第２のサンプル アンド ホールド回路の
出力は乗算形D/Aコンバータ５のリフアレンス電圧Vref
となる。さて、いま全くの初期状態にあるものとする。
すなわち、Vout＝０〔Ｖ〕であり、発音のONあるいはOF
Fを指示するON／▲▼信号も“L"である。そのた
め、Ｋ＝K2となつている。また、▲▼信号は“H"
であるためスイツチSW3は開放、スイツチSW4は導通とな
り第２のサンプル アンド ホールド回路にはVoutすな
わち０〔Ｖ〕がサンプルされホールドされている。つま
りVref＝０〔Ｖ〕である。乗算形D/Aコンバータ５の出
力電圧は、リフアレンス電圧入力VrefとＮビツトのデイ
ジタル入力Ｋとにより と表わされるのでVref＝０〔Ｖ〕である現時点では０
〔Ｖ〕である。次に第２図に示したように、時刻t1にお
いてON／▲▼信号が“H"となり発音が指示された
ものとする。するとセレクタ４のセレクト信号Ｓが“H"
となるのであるからＫ＝K1となる。また、時刻t2からt6
までの間▲▼信号が発生し、スイツチSW3が導
通、スイツチSW4が解放となるので定電圧源６の出力電
圧Vr〔Ｖ〕が第２のサンプル アンド ホールド回路で
時刻t2からt3の間サンプルされ、時刻t3からt6の間ホー
ルされる。したがつてこの時、乗算形D/Aコンバータ５
の出力電圧は となる。そして第１のサンプル アンド ホールド回路
で時刻t4からt5の間サンプルされ、時刻t5からt8の間ホ
ールドされる。この時の出力をVout（１）とすると である。さて時刻t6で▲▼信号は再び“H"に戻る
ので、スイツチSW3が解放、スイツチSW4が導通となり、
Vout（１）が第２のサンプル アンド ホールド回路で
時刻t6からt7の間サンプルれ、時刻t7からt10の間ホー
ルドされる。したがつてこの時、乗算形D/Aコンバータ
５の出力電圧は となる。これは第１のサンプル アンド ホールド回路
で時刻t8からt9の間サンプルされ時刻t9からt12の間ホ
ールドされる。この時の出力をＶout（２）とすると である。このように、ON／▲▼信号が“H"になつ
て以後SHZ信号毎に出力電圧Voutは更新されてゆき、ｉ
番目のSHZ信号が発生した時点での出力電圧Vout（ｉ）
は となる。ここで2N−１＞K1＞０の範囲でデイジタル値K1
が設定されていれば であるから Vr＞Vout(1)＞Vout(2)＞…＞Vout(i-1)＞Vout(i)… となる。すなわち、出力電圧Voutは単調減少をしている
ことになる。しかも であるから、出力電圧Voutを時系列に並べると時間軸方
向に離散化した指数関数と一致し自然な減衰特性が得ら
れることがわかる。
ロープジエネレータの一実施例の要部を示す回路図であ
る。また第２図はこの実施例の回路動作を示すタイミン
グチヤートである。ピアノ，ギター等の減衰音系楽器の
エンベロープを発生するように成した実施例を示したも
ので、第１図におけるクロツクコントローラ１は、マス
タークロツク1aと、発音のONあるいはOFFを指示するス
イツチ1bよりのON／▲▼信号とを入力とし、S
H1，SH2，▲▼の各信号を出力するもので、これ
らの信号間のタイミングは第２図に示す。このようなタ
イミングを制御する具体的な回路としては第１図(b)の
ようなものが考えられる。この回路の構成は一般的なも
のであり、容易に理解できるものなので説明は省略す
る。次にセレクタ４はセレクト信号Ｓが“H"の時に入力
端子Ａに入力される値を、セレクト信号Ｓが“L"の時に
入力端子Ｂに入力される値を出力端子Ｙに出力するもの
である。この出力端子Ｙに表われる信号をＮビツトのデ
イジタル値Ｋとする。Ｋは乗算形D/Aコンバータ５の入
力となる。２のレジスタＡにはＮビツトのデイジタル値
K1が、３のレジスタＢには同じくＮビツトのデイジタル
値K2が格納されている。乗算形D/Aコンバータ５の出力
電圧は、スイツチSW1，コンデンサＣ１およびバツフア
Ａ１よりなる第１のサンプル アンド ホールド回路に
入力される。この第１のサンプル アンド ホールド回
路の出力Voutと定電圧源６の出力電圧Vrは、オルタネー
テイブに動作する２つのスイツチSW3およびSW4によつて
選択されスイツチSW2、コンデンサC2およびバツフアA2
よりなる第２のサンプル アンド ホールド回路に入力
される。この第２のサンプル アンド ホールド回路の
出力は乗算形D/Aコンバータ５のリフアレンス電圧Vref
となる。さて、いま全くの初期状態にあるものとする。
すなわち、Vout＝０〔Ｖ〕であり、発音のONあるいはOF
Fを指示するON／▲▼信号も“L"である。そのた
め、Ｋ＝K2となつている。また、▲▼信号は“H"
であるためスイツチSW3は開放、スイツチSW4は導通とな
り第２のサンプル アンド ホールド回路にはVoutすな
わち０〔Ｖ〕がサンプルされホールドされている。つま
りVref＝０〔Ｖ〕である。乗算形D/Aコンバータ５の出
力電圧は、リフアレンス電圧入力VrefとＮビツトのデイ
ジタル入力Ｋとにより と表わされるのでVref＝０〔Ｖ〕である現時点では０
〔Ｖ〕である。次に第２図に示したように、時刻t1にお
いてON／▲▼信号が“H"となり発音が指示された
ものとする。するとセレクタ４のセレクト信号Ｓが“H"
となるのであるからＫ＝K1となる。また、時刻t2からt6
までの間▲▼信号が発生し、スイツチSW3が導
通、スイツチSW4が解放となるので定電圧源６の出力電
圧Vr〔Ｖ〕が第２のサンプル アンド ホールド回路で
時刻t2からt3の間サンプルされ、時刻t3からt6の間ホー
ルされる。したがつてこの時、乗算形D/Aコンバータ５
の出力電圧は となる。そして第１のサンプル アンド ホールド回路
で時刻t4からt5の間サンプルされ、時刻t5からt8の間ホ
ールドされる。この時の出力をVout（１）とすると である。さて時刻t6で▲▼信号は再び“H"に戻る
ので、スイツチSW3が解放、スイツチSW4が導通となり、
Vout（１）が第２のサンプル アンド ホールド回路で
時刻t6からt7の間サンプルれ、時刻t7からt10の間ホー
ルドされる。したがつてこの時、乗算形D/Aコンバータ
５の出力電圧は となる。これは第１のサンプル アンド ホールド回路
で時刻t8からt9の間サンプルされ時刻t9からt12の間ホ
ールドされる。この時の出力をＶout（２）とすると である。このように、ON／▲▼信号が“H"になつ
て以後SHZ信号毎に出力電圧Voutは更新されてゆき、ｉ
番目のSHZ信号が発生した時点での出力電圧Vout（ｉ）
は となる。ここで2N−１＞K1＞０の範囲でデイジタル値K1
が設定されていれば であるから Vr＞Vout(1)＞Vout(2)＞…＞Vout(i-1)＞Vout(i)… となる。すなわち、出力電圧Voutは単調減少をしている
ことになる。しかも であるから、出力電圧Voutを時系列に並べると時間軸方
向に離散化した指数関数と一致し自然な減衰特性が得ら
れることがわかる。
ここで、デイジタル値Ｋは減衰の速さを決定する定数で
あることもわかる。したがつてK2としてK1と異なるデイ
ジタル値をレジスタＢ３に格納しておけば、ON／▲
▼信号が“L"になつた時、すなわちリリース時のエン
ベロープを形成することができる。
あることもわかる。したがつてK2としてK1と異なるデイ
ジタル値をレジスタＢ３に格納しておけば、ON／▲
▼信号が“L"になつた時、すなわちリリース時のエン
ベロープを形成することができる。
以上が本発明の基本的な動作例である。自然楽器のエン
ベロープは必ずしも指数曲線と一致するとは限らない
が、減衰率の異なる複数の曲線を時間的に切り換えるこ
とで近似することができる。そのためにはデイジタル値
Ｋを格納するレジスタを複数設けておき、デイケイ中任
意の時点でこれを切り換えればよい。また、第２のサン
プル アンド ホールド回路の出力電圧を適当に増幅し
てやれば となり、任意の増加率を持つ増加特性を得ることもでき
る。
ベロープは必ずしも指数曲線と一致するとは限らない
が、減衰率の異なる複数の曲線を時間的に切り換えるこ
とで近似することができる。そのためにはデイジタル値
Ｋを格納するレジスタを複数設けておき、デイケイ中任
意の時点でこれを切り換えればよい。また、第２のサン
プル アンド ホールド回路の出力電圧を適当に増幅し
てやれば となり、任意の増加率を持つ増加特性を得ることもでき
る。
発明の効果 上記のようにリフアレンス電圧が出力電圧に応じて変化
するので、あたかも圧縮あるいは伸張のような効果も得
られ、ビツト数の少ない構成でも充分な分解能が得られ
る。
するので、あたかも圧縮あるいは伸張のような効果も得
られ、ビツト数の少ない構成でも充分な分解能が得られ
る。
第１図(a)は本発明の一実施例を示すブロツク図、第１
図(b)はクロツクコントローラ１の回路例で、第２図は
タイミングチヤートを示す図である。 １……クロツクコントローラ、２……レジスタＡ、３…
…レジスタＢ、４……セレクタ、５……乗算形D/Aコン
バータ、６……定電圧源、SW1，C1，A1……第１のサン
プル アンド ホールド回路、SW1……アナログスイツ
チ、C1……コンデンサ、A2……バツフア、SW2，C2，A2
……第２のサンプル アンド ホールド回路、SW2……
アナログスイツチ、C2……コンデンサ、A2……バツフ
ア、SW3，SW4……アナログスイツチ、７……シフトレジ
スタ、８，９……Ｄ-FlipFlopである。
図(b)はクロツクコントローラ１の回路例で、第２図は
タイミングチヤートを示す図である。 １……クロツクコントローラ、２……レジスタＡ、３…
…レジスタＢ、４……セレクタ、５……乗算形D/Aコン
バータ、６……定電圧源、SW1，C1，A1……第１のサン
プル アンド ホールド回路、SW1……アナログスイツ
チ、C1……コンデンサ、A2……バツフア、SW2，C2，A2
……第２のサンプル アンド ホールド回路、SW2……
アナログスイツチ、C2……コンデンサ、A2……バツフ
ア、SW3，SW4……アナログスイツチ、７……シフトレジ
スタ、８，９……Ｄ-FlipFlopである。
Claims (3)
- 【請求項１】連続的な音源波形の振幅をエンベロープ信
号で制御することにより楽音を形成する電子楽器の音源
回路に於いて、所定のデイジタル値を格納しておく記憶
装置と、格納されたデイジタル値を読み出しリフアレン
ス電圧と比較してアナログ電圧に変換する乗算形Ｄ／Ａ
コンバータと、アナログ電圧に変換された上記Ｄ／Ａコ
ンバータの出力電圧を一定周期毎にサンプルアンドホー
ルドし出力する第１のサンプルアンドホールド回路と、
ある一定電圧を出力する定電圧源と、上記第１のサンプ
ルアンドホールド回路の出力と上記定電圧源の出力とを
所定のタイミングで切り換えてこれをサンプルアンドホ
ールドする第２のサンプルアンドホールド回路を具備
し、上記第２のサンプルアンドホールド回路の出力を上
記リフアレンス電圧とすることを特徴とするエンベロー
プジエネレータ。 - 【請求項２】記憶装置に格納した複数のデイジタル値を
所定のタイミングで切り換えて乗算形Ｄ／Ａコンバータ
に読み出し、出力されるエンベロープを変形させること
を特徴とする特許請求の範囲第（１）項記載のエンベロ
ープジエネレータ。 - 【請求項３】第２のサンプルアンドホールド回路の出力
を増幅しエンベロープが増加特性となる値にリフアレン
ス電圧をしてなることを特徴とする特許請求の範囲第
（１）項記載のエンベロープジエネレータ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60080918A JPH0640264B2 (ja) | 1985-04-16 | 1985-04-16 | エンベロ−プジエネレ−タ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60080918A JPH0640264B2 (ja) | 1985-04-16 | 1985-04-16 | エンベロ−プジエネレ−タ |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS61239297A JPS61239297A (ja) | 1986-10-24 |
| JPH0640264B2 true JPH0640264B2 (ja) | 1994-05-25 |
Family
ID=13731786
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60080918A Expired - Lifetime JPH0640264B2 (ja) | 1985-04-16 | 1985-04-16 | エンベロ−プジエネレ−タ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0640264B2 (ja) |
-
1985
- 1985-04-16 JP JP60080918A patent/JPH0640264B2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPS61239297A (ja) | 1986-10-24 |
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