JPH064397Y2 - 自動伴奏装置 - Google Patents
自動伴奏装置Info
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- JPH064397Y2 JPH064397Y2 JP8213786U JP8213786U JPH064397Y2 JP H064397 Y2 JPH064397 Y2 JP H064397Y2 JP 8213786 U JP8213786 U JP 8213786U JP 8213786 U JP8213786 U JP 8213786U JP H064397 Y2 JPH064397 Y2 JP H064397Y2
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- data
- chord
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- signal
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Description
【考案の詳細な説明】 〔考案の技術分野〕 本考案は、コードを指定してアルペジオ音又はベース音
を発生させる自動伴奏装置に関する。
を発生させる自動伴奏装置に関する。
従来、コードを指定してコードの根音及び種類に対応し
たアルペジオ音又はベース音を発生させるのに必要なパ
ターンデータを記憶している記憶手段にはＣメジャーに
対応するパターンデータのみが通常記憶されている。そ
して、この記憶手段から読出したパターンデータに対し
て、まずコードの種類に対応して上記パターンデータを
変化させる。例えば、マイナーのコードが指定されてい
れば、音名Ｅに対応する音高データに対し、半音下げる
演算を行う。又、オーギュメントのコードが指定されて
いれば、音名Ｇに対応する音高データに対し半音上げる
演算を行う。そして、コードの種類に対応して変化させ
たパターンデータに対し、コードの根音に対応する音高
データを加算して、この加算して得られた音高データに
基づいて伴奏音を放音していた。
たアルペジオ音又はベース音を発生させるのに必要なパ
ターンデータを記憶している記憶手段にはＣメジャーに
対応するパターンデータのみが通常記憶されている。そ
して、この記憶手段から読出したパターンデータに対し
て、まずコードの種類に対応して上記パターンデータを
変化させる。例えば、マイナーのコードが指定されてい
れば、音名Ｅに対応する音高データに対し、半音下げる
演算を行う。又、オーギュメントのコードが指定されて
いれば、音名Ｇに対応する音高データに対し半音上げる
演算を行う。そして、コードの種類に対応して変化させ
たパターンデータに対し、コードの根音に対応する音高
データを加算して、この加算して得られた音高データに
基づいて伴奏音を放音していた。
しかしながら従来の自動伴奏装置はコードの種類に対応
してパターンデータ内のコードの構成音のみの音高デー
タが変化するだけであったため、Ｃメジャーにおけるア
ルペジオパターンが第３図のように構成されていた場
合、Ｃマイナーを指定すると第７図のようになる。ここ
において、第２音と第３音とが同じ音高となり本来意図
していた半音進行が実現されないという問題があった。
同様にＣメジャーに対応するベースパターンが第５図の
ように構成されていた場合、Ｃディミニッシュを指定す
ると第８図のようになる。ここにおいて、第３音と第４
音とが同じ音高となり上述同様の問題が生じてしまう。
してパターンデータ内のコードの構成音のみの音高デー
タが変化するだけであったため、Ｃメジャーにおけるア
ルペジオパターンが第３図のように構成されていた場
合、Ｃマイナーを指定すると第７図のようになる。ここ
において、第２音と第３音とが同じ音高となり本来意図
していた半音進行が実現されないという問題があった。
同様にＣメジャーに対応するベースパターンが第５図の
ように構成されていた場合、Ｃディミニッシュを指定す
ると第８図のようになる。ここにおいて、第３音と第４
音とが同じ音高となり上述同様の問題が生じてしまう。
本考案は上記の実情に鑑みてなされたもので、その目的
はコードの種類によらず、半音進行が確実に実現できる
自動伴奏装置を提供することにある。
はコードの種類によらず、半音進行が確実に実現できる
自動伴奏装置を提供することにある。
本考案はこのような目的を達成するため、記憶手段から
読出されたパターンデータに対し、コードの構成音だけ
でなく、コードの構成音以外の音に対応する音高データ
に対してもコードの種類に対応して値を変更する手段を
設け、この変更した音高データとコードの種類に対応し
て変化したコードの構成音に対応する音高データとが一
致しないようにしたことを特徴とする。
読出されたパターンデータに対し、コードの構成音だけ
でなく、コードの構成音以外の音に対応する音高データ
に対してもコードの種類に対応して値を変更する手段を
設け、この変更した音高データとコードの種類に対応し
て変化したコードの構成音に対応する音高データとが一
致しないようにしたことを特徴とする。
以下本考案の一実施例につき図面を参照して詳述する。
第１図は自動伴奏装置の全体回路図であり、図中１は複
数の鍵からなる鍵盤部である。この鍵盤部１からの出力
はコード検出部２に入力しコードの根音種類の検出を行
う。リズムカウンタ３は、クロック部４からのクロック
信号に基づいて計数動作を行い、出力信号は伴奏パター
ンデータが記憶されているＲＯＭ（リードオンリメモ
リ）５に入力し、パターンデータを順次出力させる。こ
のＲＯＭ５からのパターンデータは除算器６に入力する
と共に加算器７に入力する。上記除算器６は、上記パタ
ーンデータを１２で除算した余りをデコーダ８に送出す
る。ここにおいて、上記ＲＯＭ５内のパターンデータは
「１２×オクターブ情報＋音名情報」の形式で構成され
ている。そして、除算器６から出力するデータは「０〜
１１」のＣ〜Ｂの音名に対応したデータとなる。
第１図は自動伴奏装置の全体回路図であり、図中１は複
数の鍵からなる鍵盤部である。この鍵盤部１からの出力
はコード検出部２に入力しコードの根音種類の検出を行
う。リズムカウンタ３は、クロック部４からのクロック
信号に基づいて計数動作を行い、出力信号は伴奏パター
ンデータが記憶されているＲＯＭ（リードオンリメモ
リ）５に入力し、パターンデータを順次出力させる。こ
のＲＯＭ５からのパターンデータは除算器６に入力する
と共に加算器７に入力する。上記除算器６は、上記パタ
ーンデータを１２で除算した余りをデコーダ８に送出す
る。ここにおいて、上記ＲＯＭ５内のパターンデータは
「１２×オクターブ情報＋音名情報」の形式で構成され
ている。そして、除算器６から出力するデータは「０〜
１１」のＣ〜Ｂの音名に対応したデータとなる。
デコーダ８の詳細を第２図に示す。アンド回路Eb-は除
算器６からの１ビット目、２ビット目の信号を直接に、
３ビット目、４ビット目からの信号を夫々インバータＩ
３、Ｉ４を介して入力すると共に、コード検出部２から
のマイナー、マイナーセブンス及びディミニッシュを示
す信号をオア回路Ｏ１を介して入力している。アンド回
路G#+は除算器６からの４ビット目の信号を直接に、１
ビット目、２ビット目、３ビット目からの信号を夫々イ
ンバータＩ１、Ｉ２、Ｉ３を介して入力すると共に、コ
ード検出部２からのオーギュメントを示す信号を入力し
ている。アンド回路Gb-は除算器６からの２ビット目、
３ビット目の信号を直接に、１ビット目、４ビット目か
らの信号を夫々インバータＩ１、Ｉ４を介して入力する
と共に、コード検出部２からのディミニッシュを示す信
号を入力している。アンド回路E-は除算器６からの３ビ
ット目の信号を直接に、１ビット目、２ビット目、４ビ
ット目の信号を夫々インバータＩ１Ｉ２、Ｉ４を介して
入力すると共に、コード検出部２からのマイナー、マイ
ナーセブンス、ディミニッシュを示す信号をオア回路Ｏ
２を介して入力している。アンド回路G-は除算器６から
の１ビット目、２ビット目、３ビット目の信号を直接
に、４ビット目の信号をインバータＩ４を介して入力す
ると共に、コード検出部２からのディミニッシュを示す
信号を入力している。アンド回路G+は除算器６からの１
ビット目、２ビット目、３ビット目の信号を直接に、４
ビット目からの信号をインバータＩ４を介して入力する
と共に、コード検出部２からのオーギュメントを示す信
号を入力している。上記アンド回路Eb-、Gb-、E-、G-の
出力はオア回路Ｏ３を介し、オア回路群Ｏ５に入力す
る。一方、アンド回路G#+、G+の出力はオア回路Ｏ４を
介し、オア回路群Ｏ６に入力する。ここにおいてアンド
回路Eb-は、除算器６から音名Ebに対応するデータ"3"が
出力し、かつコード検出部２からマイナー又はマイナセ
ブンス又はディミニッシュいずれかに対応する信号が出
力した時開成し、信号を出力する。アンド回路G#+は、
除算器６から音名G#に対応するデータ"8"が出力し、か
つコード検出部２からオーギュメントに対応する信号が
出力した時開成し、信号を出力する。アンド回路G
b-は、除算器６から音名Gbに対応するデータ"6"が出力
し、かつコード検出部２からディミニッシュに対応する
信号が出力した時開成し、信号を出力する。アンド回路
E-は、除算器６から音名Ｅに対応するデータ"4"が出力
し、かつコード検出部２からマイナー又はマイナセブン
ス又はディミニッシュいずれかに対応する信号が出力し
た時開成し、信号を出力する。アンド回路G-は、除算器
６から音名Ｇに対応するデータ"7"が出力し、かつコー
ド検出部２からディミニッシュに対応する信号が出力し
た時開成し、信号を出力する。アンド回路G+は、除算器
６から音名Ｇに対応するデータ"7"が出力し、かつコー
ド検出部２からオーギュメントに対応する信号が出力し
た時開成し、信号を出力する。
算器６からの１ビット目、２ビット目の信号を直接に、
３ビット目、４ビット目からの信号を夫々インバータＩ
３、Ｉ４を介して入力すると共に、コード検出部２から
のマイナー、マイナーセブンス及びディミニッシュを示
す信号をオア回路Ｏ１を介して入力している。アンド回
路G#+は除算器６からの４ビット目の信号を直接に、１
ビット目、２ビット目、３ビット目からの信号を夫々イ
ンバータＩ１、Ｉ２、Ｉ３を介して入力すると共に、コ
ード検出部２からのオーギュメントを示す信号を入力し
ている。アンド回路Gb-は除算器６からの２ビット目、
３ビット目の信号を直接に、１ビット目、４ビット目か
らの信号を夫々インバータＩ１、Ｉ４を介して入力する
と共に、コード検出部２からのディミニッシュを示す信
号を入力している。アンド回路E-は除算器６からの３ビ
ット目の信号を直接に、１ビット目、２ビット目、４ビ
ット目の信号を夫々インバータＩ１Ｉ２、Ｉ４を介して
入力すると共に、コード検出部２からのマイナー、マイ
ナーセブンス、ディミニッシュを示す信号をオア回路Ｏ
２を介して入力している。アンド回路G-は除算器６から
の１ビット目、２ビット目、３ビット目の信号を直接
に、４ビット目の信号をインバータＩ４を介して入力す
ると共に、コード検出部２からのディミニッシュを示す
信号を入力している。アンド回路G+は除算器６からの１
ビット目、２ビット目、３ビット目の信号を直接に、４
ビット目からの信号をインバータＩ４を介して入力する
と共に、コード検出部２からのオーギュメントを示す信
号を入力している。上記アンド回路Eb-、Gb-、E-、G-の
出力はオア回路Ｏ３を介し、オア回路群Ｏ５に入力す
る。一方、アンド回路G#+、G+の出力はオア回路Ｏ４を
介し、オア回路群Ｏ６に入力する。ここにおいてアンド
回路Eb-は、除算器６から音名Ebに対応するデータ"3"が
出力し、かつコード検出部２からマイナー又はマイナセ
ブンス又はディミニッシュいずれかに対応する信号が出
力した時開成し、信号を出力する。アンド回路G#+は、
除算器６から音名G#に対応するデータ"8"が出力し、か
つコード検出部２からオーギュメントに対応する信号が
出力した時開成し、信号を出力する。アンド回路G
b-は、除算器６から音名Gbに対応するデータ"6"が出力
し、かつコード検出部２からディミニッシュに対応する
信号が出力した時開成し、信号を出力する。アンド回路
E-は、除算器６から音名Ｅに対応するデータ"4"が出力
し、かつコード検出部２からマイナー又はマイナセブン
ス又はディミニッシュいずれかに対応する信号が出力し
た時開成し、信号を出力する。アンド回路G-は、除算器
６から音名Ｇに対応するデータ"7"が出力し、かつコー
ド検出部２からディミニッシュに対応する信号が出力し
た時開成し、信号を出力する。アンド回路G+は、除算器
６から音名Ｇに対応するデータ"7"が出力し、かつコー
ド検出部２からオーギュメントに対応する信号が出力し
た時開成し、信号を出力する。
上記デコーダ８からのデータ「００００００００」、
「１１１１１１１１」、「０００００００１」と上記Ｒ
ＯＭ５からのパターンデータは加算器７にて加算され、
その加算値は加算器９に入力する。この加算器９の一方
の入力端は、上記コード検出部２にて検出されたコード
の根音を示すデータが入力し、コードの根音データと加
算器７からのデータが加算される。この加算器９の出力
信号は音源部１０に入力し、上記リズムカウンタ３から
の立上り信号を受けて対応する音高の伴奏音の作成を開
始する。この音源部１０の出力信号はＤ／Ａ変換器１
１、増幅器１２、スピーカ１３を介して放音される。
「１１１１１１１１」、「０００００００１」と上記Ｒ
ＯＭ５からのパターンデータは加算器７にて加算され、
その加算値は加算器９に入力する。この加算器９の一方
の入力端は、上記コード検出部２にて検出されたコード
の根音を示すデータが入力し、コードの根音データと加
算器７からのデータが加算される。この加算器９の出力
信号は音源部１０に入力し、上記リズムカウンタ３から
の立上り信号を受けて対応する音高の伴奏音の作成を開
始する。この音源部１０の出力信号はＤ／Ａ変換器１
１、増幅器１２、スピーカ１３を介して放音される。
次に実施例の動作を説明する。図示しないスイッチ操作
にてアルベジオ音の放音を選択し、そしてリズムの種類
を指定し、これに対応するアルペジオパターンとして第
３図に示すパターンが選択されたとする。そして、小節
の頭のタイミングで鍵盤部１を操作してＣマイナーを指
定すると、コード検出部２は、根音を示す信号"C"を加
算器９に、種類を示す信号“マイナー”をデコーダ８に
出力する。一方、第３図の第１音Ｃ５を示すデータが除
算器６に入力し、その結果データ"0"が得られ、デコー
ダ８に入力する。このデコーダ８において、アンド回路
Eb-、G#+、Gb-、E-、G-、G+からは出力は生じず、デコ
ーダ８からはデータ「００００００００」が出力し、加
算器７に入力し、Ｃ５を示すデータと加算される。従っ
て加算器７の出力はＣ５を示すデータとなる。このＣ５
を示すデータは更に加算器９にて根音Ｃを示すデータ
"0"と加算される。従って加算器９の出力はＣ５を示す
データのままである。このＣ５を示すデータは音源部１
０に入力し、リズムカウンタ３からの立上り信号にてＣ
５に対応したアルペジオ音が作成され、Ｄ／Ａ変換器１
１、増幅器１２、スピーカ１３を介して放音される。
にてアルベジオ音の放音を選択し、そしてリズムの種類
を指定し、これに対応するアルペジオパターンとして第
３図に示すパターンが選択されたとする。そして、小節
の頭のタイミングで鍵盤部１を操作してＣマイナーを指
定すると、コード検出部２は、根音を示す信号"C"を加
算器９に、種類を示す信号“マイナー”をデコーダ８に
出力する。一方、第３図の第１音Ｃ５を示すデータが除
算器６に入力し、その結果データ"0"が得られ、デコー
ダ８に入力する。このデコーダ８において、アンド回路
Eb-、G#+、Gb-、E-、G-、G+からは出力は生じず、デコ
ーダ８からはデータ「００００００００」が出力し、加
算器７に入力し、Ｃ５を示すデータと加算される。従っ
て加算器７の出力はＣ５を示すデータとなる。このＣ５
を示すデータは更に加算器９にて根音Ｃを示すデータ
"0"と加算される。従って加算器９の出力はＣ５を示す
データのままである。このＣ５を示すデータは音源部１
０に入力し、リズムカウンタ３からの立上り信号にてＣ
５に対応したアルペジオ音が作成され、Ｄ／Ａ変換器１
１、増幅器１２、スピーカ１３を介して放音される。
次に第３図の第２音Ｄ４＃を示すデータがＲＯＭ５から
読出されると除算器６からはデータ"3"が得られ、デコ
ータ８に入力する。このデコーダ８においてアンド回路
Eb-から出力信号が得られ、更にオア回路Ｏ３から信号
が出力し、オア回路群Ｏ５に入力する。従って、デコー
ダ８からはデータ「１１１１１１１１」が出力し、加算
器７に入力し、ＲＯＭ５からのＤ４＃を示すデータと加
算される。ここにおいて、Ｄ４＃を示すデータは「１」
減算されて、Ｄ４を示すデータが加算器７から出力す
る。このＤ４を示すデータは更に加算器９にて根音Ｃを
示すデータ"0"と加算され、加算器９からはＤ４を示す
データが出力する。
読出されると除算器６からはデータ"3"が得られ、デコ
ータ８に入力する。このデコーダ８においてアンド回路
Eb-から出力信号が得られ、更にオア回路Ｏ３から信号
が出力し、オア回路群Ｏ５に入力する。従って、デコー
ダ８からはデータ「１１１１１１１１」が出力し、加算
器７に入力し、ＲＯＭ５からのＤ４＃を示すデータと加
算される。ここにおいて、Ｄ４＃を示すデータは「１」
減算されて、Ｄ４を示すデータが加算器７から出力す
る。このＤ４を示すデータは更に加算器９にて根音Ｃを
示すデータ"0"と加算され、加算器９からはＤ４を示す
データが出力する。
次に第３図の第３音Ｅ４を示すデータがＲＯＭ５から読
出されると除算器６からはデータ"4"が得られ、デコー
ダ８に入力する。このデコーダ８においてアンド回路E-
から出力信号が得られ、更に、オア回路Ｏ３から信号が
出力し、オア回路群Ｏ５に入力する。従って、デコーダ
８からはデータ「１１１１１１１１」が出力し、加算器
７に入力し、ＲＯＭ５からのＥ４を示すデータと加算さ
れる。そして、加算器７からはＤ４＃を示すデータが出
力し、更にこのＥ４を示すデータは加算器９にて根音Ｃ
を示すデータ"0"と加算され、加算器９からはＤ４＃を
示すデータが出力する。
出されると除算器６からはデータ"4"が得られ、デコー
ダ８に入力する。このデコーダ８においてアンド回路E-
から出力信号が得られ、更に、オア回路Ｏ３から信号が
出力し、オア回路群Ｏ５に入力する。従って、デコーダ
８からはデータ「１１１１１１１１」が出力し、加算器
７に入力し、ＲＯＭ５からのＥ４を示すデータと加算さ
れる。そして、加算器７からはＤ４＃を示すデータが出
力し、更にこのＥ４を示すデータは加算器９にて根音Ｃ
を示すデータ"0"と加算され、加算器９からはＤ４＃を
示すデータが出力する。
次に第３図の第４音Ｇ４を示すデータがＲＯＭ５から読
出され、デコーダ８に入力する。このデコーダ８におい
て、アンド回路Eb-、G#+、Gb-、E-、G-、G+のいずれか
らも出力は生じず、従って、デコーダ８からはデータ
「００００００００」が出力する。そして、加算器７か
らはＧ４を示すデータが出力し、加算器９に入力する。
この加算器９からもＧ４を示すデータが出力する。
出され、デコーダ８に入力する。このデコーダ８におい
て、アンド回路Eb-、G#+、Gb-、E-、G-、G+のいずれか
らも出力は生じず、従って、デコーダ８からはデータ
「００００００００」が出力する。そして、加算器７か
らはＧ４を示すデータが出力し、加算器９に入力する。
この加算器９からもＧ４を示すデータが出力する。
次に第３図の第５音Ｃ５がＲＯＭ５から読出されるが、
上述の説明のように加算器９からはＣ５を示すデータが
出力する。
上述の説明のように加算器９からはＣ５を示すデータが
出力する。
従って、鍵盤部１にてＣマイナーを指定すると第４図に
示すアルペジオ音が放音され、本来意図していた第２
音、第３音の半音進行が実現される。
示すアルペジオ音が放音され、本来意図していた第２
音、第３音の半音進行が実現される。
次に、ベース音の放音を選択して、現在指定されている
リズムに対応するベースパターンとして第５図に示すパ
ターンが選択されたとする。そして、小節の頭のタイミ
ングで鍵盤部１を操作してＣディミニッシュを指定す
る。第５図の第１音Ｃ３を示すデータが除算器６に入力
し、その結果データ"0"が得られ、デコーダ８に入力す
る。このデコーダ８において、オア回路Ｏ３及びオア回
路Ｏ４からは出力信号は得られず、このデコーダ８から
はデータ「００００００００」が出力する。従って加算
器７からはＣ３を示すデータが出力し、加算器９に入力
する。この加算器９からもＣ３を示すデータが出力す
る。次に第５図の第２音Ｃ３を示すデータがＲＯＭ５か
ら読出されるが、第１音と同様に加算器９からはＣ３を
示すデータが出力する。
リズムに対応するベースパターンとして第５図に示すパ
ターンが選択されたとする。そして、小節の頭のタイミ
ングで鍵盤部１を操作してＣディミニッシュを指定す
る。第５図の第１音Ｃ３を示すデータが除算器６に入力
し、その結果データ"0"が得られ、デコーダ８に入力す
る。このデコーダ８において、オア回路Ｏ３及びオア回
路Ｏ４からは出力信号は得られず、このデコーダ８から
はデータ「００００００００」が出力する。従って加算
器７からはＣ３を示すデータが出力し、加算器９に入力
する。この加算器９からもＣ３を示すデータが出力す
る。次に第５図の第２音Ｃ３を示すデータがＲＯＭ５か
ら読出されるが、第１音と同様に加算器９からはＣ３を
示すデータが出力する。
次に第５図の第３音Ｆ２＃を示すデータがＲＯＭ５から
読出されると除算器６からはデータ"6"が得られ、デコ
ーダ８に入力する。このデコーダ８においてアンド回路
Gb-から出力信号が得られ、更にオア回路Ｏ３から信号
が出力し、オア回路群Ｏ５に入力する。従ってデコーダ
８からはデータ「１１１１１１１１」が出力し、加算器
７に入力し、ＲＯＭ５からのＦ２＃を示すデータと加算
される。そして、加算器７からはＦ２を示すデータが出
力する。更にこのＦ２を示すデータは加算器９にて根音
Ｃを示すデータ"0"と加算され、加算器９からはＦ２を
示すデータが出力する。
読出されると除算器６からはデータ"6"が得られ、デコ
ーダ８に入力する。このデコーダ８においてアンド回路
Gb-から出力信号が得られ、更にオア回路Ｏ３から信号
が出力し、オア回路群Ｏ５に入力する。従ってデコーダ
８からはデータ「１１１１１１１１」が出力し、加算器
７に入力し、ＲＯＭ５からのＦ２＃を示すデータと加算
される。そして、加算器７からはＦ２を示すデータが出
力する。更にこのＦ２を示すデータは加算器９にて根音
Ｃを示すデータ"0"と加算され、加算器９からはＦ２を
示すデータが出力する。
次に第５図の第４音Ｇ２を示すデータがＲＯＭ５から読
出されると除算器６からはデータ"7"が得られ、デコー
ダ８に入力する。このデコーダ８においてアンド回路G-
から信号が出力し、オア回路Ｏ３を介し、オア回路群Ｏ
５に入力する。従って、デコーダ８からはデータ「１１
１１１１１１」が出力し、加算器７に入力しＲＯＭ５か
らのＧ２を示すデータと加算される。そして、加算器７
からはＦ２＃を示すデータが出力し、更に加算器９から
もＦ２＃を示すデータが出力する。
出されると除算器６からはデータ"7"が得られ、デコー
ダ８に入力する。このデコーダ８においてアンド回路G-
から信号が出力し、オア回路Ｏ３を介し、オア回路群Ｏ
５に入力する。従って、デコーダ８からはデータ「１１
１１１１１１」が出力し、加算器７に入力しＲＯＭ５か
らのＧ２を示すデータと加算される。そして、加算器７
からはＦ２＃を示すデータが出力し、更に加算器９から
もＦ２＃を示すデータが出力する。
次に第５図の第５音Ｃ３がＲＯＭ５から読出されるが、
上述の説明のように加算器９からはＣ３を示すデータが
出力する。
上述の説明のように加算器９からはＣ３を示すデータが
出力する。
従って、鍵盤部１にてＣディミニッシュを指定すると第
６図に示すベース音が放音され、本来意図していた第３
音、第４音の半音進行が実現される。
６図に示すベース音が放音され、本来意図していた第３
音、第４音の半音進行が実現される。
なお、上記実施例ではコード検出部２にて検出されるコ
ードの種類数を５としたがこれに限定されず何種類でも
よい。又、コードの構成音以外の音名として、Ｃを根音
とするコードに対してのEb、G#、Gbの３つを用いたが、
もちろんこれら以外の音名に対して実現しても差しつか
えない。
ードの種類数を５としたがこれに限定されず何種類でも
よい。又、コードの構成音以外の音名として、Ｃを根音
とするコードに対してのEb、G#、Gbの３つを用いたが、
もちろんこれら以外の音名に対して実現しても差しつか
えない。
本考案は、記憶手段から読出されたパターンデータに対
し、コードの構成音だけではなく、コードの構成音以外
の音に対応する音高データに対してもコードの種類に対
応して値を変更する手段を設けて、この変更した音高デ
ータとコードの種類に対応して変化したコードの構成音
に対応する音高データと一致しないようにしたので、本
来意図しているパターンがコードの種類に応じて損なわ
れることがなくなるという効果を得ることができる。
し、コードの構成音だけではなく、コードの構成音以外
の音に対応する音高データに対してもコードの種類に対
応して値を変更する手段を設けて、この変更した音高デ
ータとコードの種類に対応して変化したコードの構成音
に対応する音高データと一致しないようにしたので、本
来意図しているパターンがコードの種類に応じて損なわ
れることがなくなるという効果を得ることができる。
第１図は本考案を適用した自動伴奏装置の全体回路図、
第２図はデコーダ８の詳細図、第３図はＲＯＭ５に記憶
されているアルペジオパターンを示す楽譜、第４図はＣ
マイナーを指定した時の放音例を示す楽譜、第５図はＲ
ＯＭ５に記憶されているベースパターンを示す楽譜、第
６図はＣディミニッシュを指定した時の放音例を示す楽
譜、第７図は従来におけるＣマイナーを指定した時の放
音例を示す楽譜、第８図は従来におけるＣディミニッシ
ュを指定した時の放音例を示す楽譜である。 ２……コード検出部、５……ＲＯＭ ６……除算器、８……デコーダ Eb-、G#+、Gb-、E-、G-、G+……アンド回路 Ｏ５、Ｏ６……オア回路群
第２図はデコーダ８の詳細図、第３図はＲＯＭ５に記憶
されているアルペジオパターンを示す楽譜、第４図はＣ
マイナーを指定した時の放音例を示す楽譜、第５図はＲ
ＯＭ５に記憶されているベースパターンを示す楽譜、第
６図はＣディミニッシュを指定した時の放音例を示す楽
譜、第７図は従来におけるＣマイナーを指定した時の放
音例を示す楽譜、第８図は従来におけるＣディミニッシ
ュを指定した時の放音例を示す楽譜である。 ２……コード検出部、５……ＲＯＭ ６……除算器、８……デコーダ Eb-、G#+、Gb-、E-、G-、G+……アンド回路 Ｏ５、Ｏ６……オア回路群
Claims (1)
- 【請求項１】伴奏パターンデータを記憶する記憶手段
と、 この記憶手段に記憶されている伴奏パターンデータを読
出す読出手段と、 コードを指定するコード指定手段と、 このコード指定手段により指定されたコードの種類に基
づいて、上記読出手段により読み出された伴奏パターン
データのうち、一部の伴奏パターンデータを変更する第
１の変更手段と、 上記読出手段により読み出された伴奏パターンデータの
中の、上記第１の変更手段により変更された伴奏パター
ンデータに一致する伴奏パターンデータを、上記変更さ
れた伴奏パターンデータが変更されたのと同一の量だけ
同一の方向に変更する第２の変更手段と、 上記第１の変更手段及び上記第２の変更手段により変更
された変更後の伴奏パターンデータに基づいて自動伴奏
を行なう自動伴奏手段と、 を具備したことを特徴とする自動伴奏装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8213786U JPH064397Y2 (ja) | 1986-05-30 | 1986-05-30 | 自動伴奏装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8213786U JPH064397Y2 (ja) | 1986-05-30 | 1986-05-30 | 自動伴奏装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS62193299U JPS62193299U (ja) | 1987-12-08 |
| JPH064397Y2 true JPH064397Y2 (ja) | 1994-02-02 |
Family
ID=30934514
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP8213786U Expired - Lifetime JPH064397Y2 (ja) | 1986-05-30 | 1986-05-30 | 自動伴奏装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH064397Y2 (ja) |
-
1986
- 1986-05-30 JP JP8213786U patent/JPH064397Y2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPS62193299U (ja) | 1987-12-08 |
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