JPH0654335U - ベクトル変調器 - Google Patents

ベクトル変調器

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Publication number
JPH0654335U
JPH0654335U JP28193U JP28193U JPH0654335U JP H0654335 U JPH0654335 U JP H0654335U JP 28193 U JP28193 U JP 28193U JP 28193 U JP28193 U JP 28193U JP H0654335 U JPH0654335 U JP H0654335U
Authority
JP
Japan
Prior art keywords
signal
memory
carrier
carrier wave
converter
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Pending
Application number
JP28193U
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English (en)
Inventor
新悟 西谷
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Advantest Corp
Original Assignee
Advantest Corp
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Publication date
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Publication of JPH0654335U publication Critical patent/JPH0654335U/ja
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Abstract

(57)【要約】 【目的】 回路規模が小さく、直交変調信号の誤差の補
正を容易に行なうことができる直交変調器を提供する。 【構成】 メモリ１には、Ｉ信号の搬送波のデータが格
納されている。メモリ２には、Ｑ信号の搬送波のデータ
が格納されている。メモリ３には、Ｉ信号の搬送波に対
して２２５°位相が進んだＯ信号の搬送波のデータが格
納されている。カウンタ４はメモリ１〜３にアドレス信
号を供給する。Ｄ／Ａコンバータ５は１象限乗算型で、
メモリ１から読出された搬送波のデータとＩ信号を乗算
する。Ｄ／Ａコンバータ６も１象限乗算型で、メモリ２
から読出された搬送波のデータとＱ信号を乗算する。Ｄ
／Ａコンバータ７も１象限乗算型で、メモリ３から読出
された搬送波のデータとＯ信号を乗算する。加算器８は
Ｄ／Ａコンバータ５〜７の各出力を加算し、直交変調信
号を出力する。

Description

【考案の詳細な説明】
【０００１】
【産業上の利用分野】
本考案は、デジタル無線通信で利用でれるπ／４シフトＤＱＰＳＫ変調方式に 代表されるベクトル変調器に関する。
【０００２】
【従来の技術】
図４はこの種のベクトル変調器の従来例のブロック図である。発振器２１で発 生された搬送波はミキサー２２によりＩ信号と乗算され、変調される。また、こ の搬送波は、移相器２３により位相が９０°進められた後、ミキサー２４により Ｑ信号と乗算され、変調される。Ｉ信号の変調信号とＱ信号の変調信号は加算器 ２５で加算され、直交変調信号が得られる。
【０００３】
【考案が解決しようとする課題】
上述した従来の直交変調器は、全てアナログ回路で構成されているので、回路 規模が大きく、また誤差が大きく調整精度もある程度までしか望めないという欠 点があった。
【０００４】 本考案の目的は、回路規模が小さく、また直交変調信号の誤差（キャリア漏れ 、振幅不均衡、直交位相誤差）に対する補正を容易に行なうことができる直交変 調器を提供することにある。
【０００５】
【課題を解決するための手段】
本考案の第１の直交変調器は、 Ｉ信号の搬送波のデータが格納されている第１のメモリと、 Ｉ信号の搬送波に対して９０°位相が進んだ、Ｑ信号の搬送波のデータが格納 されている第２のメモリと、 Ｉ信号の搬送波に対して２２５°位相が進んだ、Ｏ信号の搬送波のデータが格 納されている第３のメモリと、 第１〜第３のメモリに対するアドレス信号を発生するカウンタと、 Ｉ信号と第１のメモリから出力された搬送波を乗算する第１の１象限乗算型Ｄ ／Ａコンバータと、 Ｑ信号と第２のメモリから出力された搬送波を乗算する第２の１象限乗算型Ｄ ／Ａコンバータと、 Ｏ信号と第３のメモリから出力された搬送波を乗算する第３の１象限乗算型Ｄ ／Ａコンバータと、 第１，第２，第３の１象限乗算型Ｄ／Ａコンバータの各出力を加算する加算器 とを有する。
【０００６】 本考案の第２の直交変調器は、 Ｉ信号の搬送波のデータが格納されている第１のメモリと、 Ｉ信号の搬送波に対して９０°位相が進んだ、Ｑ信号の搬送波のデータが格納 されている第２のメモリと、 第１，第２のメモリに対するアドレス信号を発生するカウンタと、 Ｉ信号と第１のメモリから出力された搬送波を乗算する第１の４象限乗算型Ｄ ／Ａコンバータと、 Ｑ信号と第２のメモリから出力された搬送波を乗算する第２の４象限乗算型Ｄ ／Ａコンバータと、 第１の４象限乗算型Ｄ／Ａコンバータの出力と第２の４象限乗算型Ｄ／Ａコン バータの出力を加算する加算器とを有する。
【０００７】
【作用】
本考案は、搬送波をメモリに記憶しておき、搬送波と各信号の変調を乗算型Ｄ ／Ａコンバータで行なうものである。
【０００８】 第１の直交変調器では、乗算型Ｄ／Ａコンバータとして高速な第１象限型を用 いるので、Ｉ信号に対して２２５°位相が進んだ搬送波をメモリに記憶しておき 、これとＯ（オフセット）信号を第１象限乗算型Ｄ／Ａコンバータで乗算し、３ つの第１象限乗算型Ｄ／Ａコンバータの出力を加算している。第２の直交変調器 では、乗算型Ｄ／Ａコンバータとして４象限型を用いる。
【０００９】 このように、本考案は、搬送波をデジタル信号で発生するので、直交変調信号 のキャリア漏れ、振幅不均衡、直交位相誤差に対する補正は、メモリに格納され ている搬送波のデータの振幅と位相を変えることにより、容易に行なうことがで きる。
【００１０】
【実施例】
次に、本考案の実施例について図面を参照して説明する。
【００１１】 図１は本考案の第１の実施例の直交変調器のブロック図、図２（１）はＩ信号 の搬送波とＱ信号の搬送波の位相を示す図、図２（２）はＯ信号の搬送波の位相 を示す図、図２（３）はＩ信号の搬送波とＯ信号の搬送波の合成された搬送波の 位相と、Ｑ信号の搬送波とＯ信号の搬送波の合成された搬送波の位相を示す図で ある。
【００１２】 メモリ１には、Ｉ信号の搬送波のデータが格納されている。メモリ２には、Ｉ 信号の搬送波に対して９０°位相が進んだ（図２（１））、Ｑ信号のデータが格 納されている。メモリ３には、Ｉ信号の搬送波に対して２２５°位相が進んだ（ 図２（２））Ｏ信号の搬送波のデータが格納されている。カウンタ４はメモリ１ 〜３にアドレス信号を供給し、これによりメモリ１〜３から搬送波のデータが連 続的に出力される。Ｄ／Ａコンバータ５は１象限乗算型で、メモリ１から読出さ れた搬送波のデータとＩ信号を乗算し、Ｉ信号を変調する。Ｄ／Ａコンバータ６ も１象限乗算型で、メモリ２から読出された搬送波のデータとＱ信号を乗算し、 Ｑ信号を変調する。Ｄ／Ａコンバータ７も１象限乗算型で、メモリ３から読出さ れた搬送波のデータとＯ信号を乗算し、Ｏ信号を変調する。加算器８はＤ／Ａコ ンバータ５〜７の各出力を加算し、直交変調信号を出力する。
【００１３】 図３は本考案の第２の実施例の直交変調器のブロック図である。本実施例は、 図１の１象限乗算型Ｄ／Ａコンバータ５，６の代りに４象限乗算型Ｄ／Ａコンバ ータ９，１０を用いたものである。したがって、メモリ３およびＤ／Ａコンバー タ７は不要となる。
【００１４】
【考案の効果】
以上説明したように本考案は、メモリと乗算型Ｄ／Ａコンバータを組合せて搬 送波と信号（Ｉ信号，Ｑ信号）の変調を行なうことにより、回路規模が小さくな り、かつ直交変調信号の誤差の補正を容易に行なうことができる効果がある。
【図面の簡単な説明】
【図１】本考案の第１の実施例の直交変調器のブロック
図である。
【図２】Ｉ信号の搬送波とＱ信号の搬送波の位相関係
（図２（１））、Ｏ信号の搬送波の位相関係（図２
（２））、Ｉ信号とＯ信号の搬送波の合成された搬送波
の位相と、Ｑ信号とＯ信号の搬送波の合成された搬送波
の位相（図２（３））を示す図である。
【図３】本考案の第２の実施例の直交変調器のブロック
図である。
【図４】直交変調器の従来例のブロック図である。
【符号の説明】
１〜３ メモリ ４ カウンタ ５〜７ Ｄ／Ａコンバータ（第１象限乗算型） ９，１０ Ｄ／Ａコンバータ（第４象限乗算型） ８ 加算器

Claims (2)

    【実用新案登録請求の範囲】
  1. 【請求項１】 Ｉ信号の搬送波のデータが格納されてい
    る第１のメモリと、 Ｉ信号の搬送波に対して９０°位相が進んだ、Ｑ信号の
    搬送波のデータが格納されている第２のメモリと、 Ｉ信号の搬送波に対して２２５°位相が進んだ、Ｏ信号
    の搬送波のデータが格納されている第３のメモリと、 第１〜第３のメモリに対するアドレス信号を発生するカ
    ウンタと、 Ｉ信号と第１のメモリから出力された搬送波を乗算する
    第１の１象限乗算型Ｄ／Ａコンバータと、 Ｑ信号と第２のメモリから出力された搬送波を乗算する
    第２の１象限乗算型Ｄ／Ａコンバータと、 Ｏ信号と第３のメモリから出力された搬送波を乗算する
    第３の１象限乗算型Ｄ／Ａコンバータと、 第１，第２，第３の１象限乗算型Ｄ／Ａコンバータの各
    出力を加算する加算器とを有するベクトル変調器。
  2. 【請求項２】 Ｉ信号の搬送波のデータが格納されてい
    る第１のメモリと、 Ｉ信号の搬送波に対して９０°位相が進んだ、Ｑ信号の
    搬送波のデータが格納されている第２のメモリと、 第１，第２のメモリに対するアドレス信号を発生するカ
    ウンタと、 Ｉ信号と第１のメモリから出力された搬送波を乗算する
    第１の４象限乗算型Ｄ／Ａコンバータと、 Ｑ信号と第２のメモリから出力された搬送波を乗算する
    第２の４象限乗算型Ｄ／Ａコンバータと、 第１の４象限乗算型Ｄ／Ａコンバータの出力と第２の４
    象限乗算型Ｄ／Ａコンバータの出力を加算する加算器と
    を有するベクトル変調器。
JP28193U 1993-01-08 1993-01-08 ベクトル変調器 Pending JPH0654335U (ja)

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JP28193U JPH0654335U (ja) 1993-01-08 1993-01-08 ベクトル変調器

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JP28193U JPH0654335U (ja) 1993-01-08 1993-01-08 ベクトル変調器

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JPH0654335U true JPH0654335U (ja) 1994-07-22

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Legal Events

Date Code Title Description
A02 Decision of refusal

Free format text: JAPANESE INTERMEDIATE CODE: A02

Effective date: 19990525