JPH0680664B2 - 半導体装置の配線形成方法 - Google Patents
半導体装置の配線形成方法Info
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- JPH0680664B2 JPH0680664B2 JP7578186A JP7578186A JPH0680664B2 JP H0680664 B2 JPH0680664 B2 JP H0680664B2 JP 7578186 A JP7578186 A JP 7578186A JP 7578186 A JP7578186 A JP 7578186A JP H0680664 B2 JPH0680664 B2 JP H0680664B2
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- wiring electrode
- wiring
- ion implantation
- etching
- implantation mask
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Landscapes
- Internal Circuitry In Semiconductor Integrated Circuit Devices (AREA)
Description
【発明の詳細な説明】 〔産業上の利用分野〕 本発明は、半導体装置の配線電極形成方法に関し、特に
高配線寿命を有する配線電極形成方法に関する。
高配線寿命を有する配線電極形成方法に関する。
配線電極金属は、高温,高電流密度になるほど、いわゆ
るエレクトロマイグレーションにより配線寿命が低下す
る。エレクトロマイグレーション耐性を高め、配線を高
寿命化させた構造として、配線電極金属に不純物を添加
させた構造が使用されている。よく知られた例として
は、不純物として銅を含んだアルミニウムを配線電極に
用いたものがある。
るエレクトロマイグレーションにより配線寿命が低下す
る。エレクトロマイグレーション耐性を高め、配線を高
寿命化させた構造として、配線電極金属に不純物を添加
させた構造が使用されている。よく知られた例として
は、不純物として銅を含んだアルミニウムを配線電極に
用いたものがある。
従来、このような配線電極の形成方法は、第4図(a)
に示すように不純物を全面に含む配線電極にフォトレジ
ストを施し、第4図(b)の如く異方性エッチングによ
るか第4図(c)の如く等方性エッチングによりおこな
っていた。
に示すように不純物を全面に含む配線電極にフォトレジ
ストを施し、第4図(b)の如く異方性エッチングによ
るか第4図(c)の如く等方性エッチングによりおこな
っていた。
上述した従来の配線電極形成方法は、配線電極金属に不
純物を含むため、以下のような問題点があった。配線電
極をプラズマ状ガスを用いて異方性エッチングした場
合、不純物の添加される割合によりエッチングの状態が
変化するので、各々の割合により適当なエッチング条件
を見いださねばならなかった。例えばアルミニウムに銅
を添加した場合、通常のアルミニウムのエッチング条件
では銅が残りやすく、高々数パーセントの銅を添加して
も異方性エッチングが非常に困難となる。また、液体に
よる等方性エッチングを行った場合、数パーセントの銅
の添加をおこなっても問題なくエッチングができるが、
同時に横方向のエッチングも進行するため、設計上配線
幅を広くとらなければならないという問題があり、微細
加工に不向きであった。さらに、不純物によってはエッ
チング装置を汚染するという欠点もあった。
純物を含むため、以下のような問題点があった。配線電
極をプラズマ状ガスを用いて異方性エッチングした場
合、不純物の添加される割合によりエッチングの状態が
変化するので、各々の割合により適当なエッチング条件
を見いださねばならなかった。例えばアルミニウムに銅
を添加した場合、通常のアルミニウムのエッチング条件
では銅が残りやすく、高々数パーセントの銅を添加して
も異方性エッチングが非常に困難となる。また、液体に
よる等方性エッチングを行った場合、数パーセントの銅
の添加をおこなっても問題なくエッチングができるが、
同時に横方向のエッチングも進行するため、設計上配線
幅を広くとらなければならないという問題があり、微細
加工に不向きであった。さらに、不純物によってはエッ
チング装置を汚染するという欠点もあった。
本発明の配線電極形成方法は不純物を含まない配線電極
被膜上にイオン注入マスク材料を被着し不純物導入孔を
形成する工程と、不純物をイオン注入する工程と、平担
化材料を塗布したのちイオン注入マスク材料が露出する
まで平担化材料をエッチングする工程と、イオン注入マ
スク材料を除去したのち平担化材料をマスクにし配線金
属材料を異方性エッチングする工程とを有する。
被膜上にイオン注入マスク材料を被着し不純物導入孔を
形成する工程と、不純物をイオン注入する工程と、平担
化材料を塗布したのちイオン注入マスク材料が露出する
まで平担化材料をエッチングする工程と、イオン注入マ
スク材料を除去したのち平担化材料をマスクにし配線金
属材料を異方性エッチングする工程とを有する。
次に本発明について図面を参照して説明する。
第1図(a)から(d)は、本発明の一実施例を示す断
面図である。
面図である。
第1図(a)は、所望の導電領域及び絶縁領域を有する
半導体基板11の一主面を覆う絶縁膜12に開口13を設け、
配線電極被膜14を形成した図である。配線電極被膜14は
単層又は必要により多層とする。配線電極被膜14上にイ
オン注入マスク材料15を被着し、配線領域に不純物導入
孔16を形成する。
半導体基板11の一主面を覆う絶縁膜12に開口13を設け、
配線電極被膜14を形成した図である。配線電極被膜14は
単層又は必要により多層とする。配線電極被膜14上にイ
オン注入マスク材料15を被着し、配線領域に不純物導入
孔16を形成する。
第1図(b)は、第1図(a)以降イオン注入により不
純物導入領域17を形成し平担化材料18により、基板表面
を平担化した図である。平担化材料18はイオン注入マス
ク材料15と配線電極被膜14をエッチングするときのマス
クともなるので、これらに対し選択性のよいものを選
ぶ。
純物導入領域17を形成し平担化材料18により、基板表面
を平担化した図である。平担化材料18はイオン注入マス
ク材料15と配線電極被膜14をエッチングするときのマス
クともなるので、これらに対し選択性のよいものを選
ぶ。
第1図(c)は、第1図(b)以降平担化材料18をイオ
ン注入マスク材料15が露出するまでエッチングし、その
後イオン注入マスク材料15を選択的にエッチングし、次
いで配線電極被膜14を平担化材料18をマスクとして異方
性エッチングした図である。
ン注入マスク材料15が露出するまでエッチングし、その
後イオン注入マスク材料15を選択的にエッチングし、次
いで配線電極被膜14を平担化材料18をマスクとして異方
性エッチングした図である。
第1図(d)では、第1図(c)以降平担化材料18を除
去したのちアニールを行い配線電極材料と不純物とを合
金化する。
去したのちアニールを行い配線電極材料と不純物とを合
金化する。
第2図は、本発明の第2の実施例である。本実施例で
は、半導体基板21と配線電極22との間に電気的導電性の
ある拡散防止膜23を設けた例である。これにより配線電
極22に添加した不純物が半導体基板に拡散して素子特性
を劣化させるのを防止することができる。
は、半導体基板21と配線電極22との間に電気的導電性の
ある拡散防止膜23を設けた例である。これにより配線電
極22に添加した不純物が半導体基板に拡散して素子特性
を劣化させるのを防止することができる。
第3図(a)と(b)は、本発明の第3の実施例であ
る。
る。
第3図(a)は第1図(a)に対応する図である。この
図ではイオン注入マスク材料31を等方性エッチングと異
方性エッチングを併用して加工している。
図ではイオン注入マスク材料31を等方性エッチングと異
方性エッチングを併用して加工している。
第3図(b)は第1図(c)に対応する図である。この
図では平担化材料32の上部がイオン注入マスク材料31の
エッチング領域の形状に応じて横広がりをしている。こ
のため、不純物導入領域33を全くエッチングせずに配線
電極被膜34を異方性エッチングすることができる。この
方法により、配線電極のエッチングの際に不純物がエッ
チング装置を汚染するおそれがなくなる。
図では平担化材料32の上部がイオン注入マスク材料31の
エッチング領域の形状に応じて横広がりをしている。こ
のため、不純物導入領域33を全くエッチングせずに配線
電極被膜34を異方性エッチングすることができる。この
方法により、配線電極のエッチングの際に不純物がエッ
チング装置を汚染するおそれがなくなる。
以上説明したように本発明では配線電極被膜の配線領域
に選択的に不純物を添加することにより、エッチング領
域に不純物を含まない構造にすることができ、このため
不純物の種類,濃度によらず自己整合により不純物を含
まない配線電極の加工技術で配線電極の微細加工を可能
とする効果がある。
に選択的に不純物を添加することにより、エッチング領
域に不純物を含まない構造にすることができ、このため
不純物の種類,濃度によらず自己整合により不純物を含
まない配線電極の加工技術で配線電極の微細加工を可能
とする効果がある。
第1図(a)乃至(d)は、本発明の第一の実施例を、
第2図は、本発明の第二の実施例を、第3図(a),
(b)は、本発明の第三の実施例を説明する断面図であ
る。第4図(a)乃至(c)は、従来の方法を説明する
ための断面図である。 11……半導体基板、12……絶縁膜、13……開口、14……
配線電極被膜、15……イオン注入マスク材料、16……不
純物導入孔、17……不純物導入領域、18……平担化材
料、19……配線電極、21……半導体基板、22……配線電
極、23……拡散防止膜、31……イオン注入マスク材料、
32……平担化材料、33……不純物導入領域、34……配線
電極被膜、41……半導体基板、42……絶縁膜、43……開
口、44……不純物を含む配線電極被膜、45……フォトレ
ジスト。
第2図は、本発明の第二の実施例を、第3図(a),
(b)は、本発明の第三の実施例を説明する断面図であ
る。第4図(a)乃至(c)は、従来の方法を説明する
ための断面図である。 11……半導体基板、12……絶縁膜、13……開口、14……
配線電極被膜、15……イオン注入マスク材料、16……不
純物導入孔、17……不純物導入領域、18……平担化材
料、19……配線電極、21……半導体基板、22……配線電
極、23……拡散防止膜、31……イオン注入マスク材料、
32……平担化材料、33……不純物導入領域、34……配線
電極被膜、41……半導体基板、42……絶縁膜、43……開
口、44……不純物を含む配線電極被膜、45……フォトレ
ジスト。
Claims (1)
- 【請求項1】配線電極被膜上にイオン注入のマスクとな
る材料を選択的に形成し、該配線電極被膜に不純物をイ
オン注入する工程と、平担化材料を塗布したのち上記イ
オン注入のマスクとなる材料が露出するまで平担化材料
をエッチングする工程と、上記イオン注入のマスクとな
る材料を除去したのち平担化材料をマスクにし配線金属
材料を異方性エッチングする工程とを有することを特徴
とする半導体装置の配線形成方法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7578186A JPH0680664B2 (ja) | 1986-04-01 | 1986-04-01 | 半導体装置の配線形成方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7578186A JPH0680664B2 (ja) | 1986-04-01 | 1986-04-01 | 半導体装置の配線形成方法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS62232146A JPS62232146A (ja) | 1987-10-12 |
| JPH0680664B2 true JPH0680664B2 (ja) | 1994-10-12 |
Family
ID=13586100
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7578186A Expired - Lifetime JPH0680664B2 (ja) | 1986-04-01 | 1986-04-01 | 半導体装置の配線形成方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0680664B2 (ja) |
-
1986
- 1986-04-01 JP JP7578186A patent/JPH0680664B2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPS62232146A (ja) | 1987-10-12 |
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