JPH0690211A - 信号処理装置 - Google Patents
信号処理装置Info
- Publication number
- JPH0690211A JPH0690211A JP24058392A JP24058392A JPH0690211A JP H0690211 A JPH0690211 A JP H0690211A JP 24058392 A JP24058392 A JP 24058392A JP 24058392 A JP24058392 A JP 24058392A JP H0690211 A JPH0690211 A JP H0690211A
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- JP
- Japan
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- signal
- output
- signal processing
- inputs
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- Signal Processing Not Specific To The Method Of Recording And Reproducing (AREA)
Abstract
(57)【要約】
【目的】複数チャネルから所定チャネルを選択しそのチ
ャネルの信号を加算して出力する信号処理装置におい
て、加算出力がオーバーフローまたはクリップすること
なく、しかも出力レベルの低下が顕著とならないように
する。 【構成】Ｎ個の入力ｉｎ1〜ｉｎNを入力バッファ４-1〜
４-Nを介して信号処理回路５の入力端子ＩＮに供給す
る。この信号処理回路５より出力されるＭ個の出力ｏｕ
ｔ1〜ｏｕｔMを出力バッファ６-1〜６-Mを介して導出す
る。コントローラ７よりプロセッサ８に加算情報を供給
し、このプロセッサ８ではその加算情報に基づいて係数
を計算し、その係数を信号処理回路５に送る。この場
合、プロセッサ８は判別回路９-1〜９-Nの出力に基づき
加算すべき入力のうち実際に信号のある入力の個数ｊを
認識し、加算すべき入力の係数を１／ｊにする。加算出
力がオーバーフローまたはクリップすることなく、また
そのレベル低下も顕著とならない。
ャネルの信号を加算して出力する信号処理装置におい
て、加算出力がオーバーフローまたはクリップすること
なく、しかも出力レベルの低下が顕著とならないように
する。 【構成】Ｎ個の入力ｉｎ1〜ｉｎNを入力バッファ４-1〜
４-Nを介して信号処理回路５の入力端子ＩＮに供給す
る。この信号処理回路５より出力されるＭ個の出力ｏｕ
ｔ1〜ｏｕｔMを出力バッファ６-1〜６-Mを介して導出す
る。コントローラ７よりプロセッサ８に加算情報を供給
し、このプロセッサ８ではその加算情報に基づいて係数
を計算し、その係数を信号処理回路５に送る。この場
合、プロセッサ８は判別回路９-1〜９-Nの出力に基づき
加算すべき入力のうち実際に信号のある入力の個数ｊを
認識し、加算すべき入力の係数を１／ｊにする。加算出
力がオーバーフローまたはクリップすることなく、また
そのレベル低下も顕著とならない。
Description
【０００１】
【産業上の利用分野】この発明は、例えば放送局の音声
系統内のアウトプットマトリックスに適用して好適な信
号処理装置に関する。
系統内のアウトプットマトリックスに適用して好適な信
号処理装置に関する。
【０００２】
【従来の技術】図５は、従来周知の放送局の音声系統を
示している。図において、１はインプットマトリックス
であり、このマトリックス１は複数の入力音声信号を切
り換えて後述するミキシングコンソールの任意のチャネ
ルに送る働きをする。これは番組によって使用するマイ
クや機器が変わるがそのたびにミキシングコンソールの
配線を変更せずに運用するために使われる。
示している。図において、１はインプットマトリックス
であり、このマトリックス１は複数の入力音声信号を切
り換えて後述するミキシングコンソールの任意のチャネ
ルに送る働きをする。これは番組によって使用するマイ
クや機器が変わるがそのたびにミキシングコンソールの
配線を変更せずに運用するために使われる。
【０００３】マトリックス１の入力端子ＩＮに供給され
る音声信号としては、例えば司会者や演奏者等のマイク
の出力音声信号、ＤＡＴ等のオーディオテープレコーダ
の再生音声信号、ＶＴＲの再生音声信号、ＣＤプレーヤ
の再生音声信号、中継先から送られてくる電話回線から
の音声信号等がある。
る音声信号としては、例えば司会者や演奏者等のマイク
の出力音声信号、ＤＡＴ等のオーディオテープレコーダ
の再生音声信号、ＶＴＲの再生音声信号、ＣＤプレーヤ
の再生音声信号、中継先から送られてくる電話回線から
の音声信号等がある。
【０００４】２はミキシングコンソールであり、このコ
ンソール２は多数の入力音声信号のそれぞれについてイ
コライザ、フィルタ、レベル調整を施し、最終的にオン
エアーに使う音声信号（ＭＡＳＴＥＲ）をつくる働きを
する。このコンソール２の入力端子ＣＨＩＮにはマトリ
ックス１の出力端子ＯＵＴに得られる音声信号が供給さ
れる。
ンソール２は多数の入力音声信号のそれぞれについてイ
コライザ、フィルタ、レベル調整を施し、最終的にオン
エアーに使う音声信号（ＭＡＳＴＥＲ）をつくる働きを
する。このコンソール２の入力端子ＣＨＩＮにはマトリ
ックス１の出力端子ＯＵＴに得られる音声信号が供給さ
れる。
【０００５】また、コンソール２の出力端子ＣＨＯＵＴ
には入力端子ＣＨＩＮに供給される音声信号がそのま出
力されると共に、その出力端子ＧＰＯＵＴには入力端子
ＣＨＩＮに供給される音声信号を混合処理した音声信号
が出力される。
には入力端子ＣＨＩＮに供給される音声信号がそのま出
力されると共に、その出力端子ＧＰＯＵＴには入力端子
ＣＨＩＮに供給される音声信号を混合処理した音声信号
が出力される。
【０００６】３はアウトプットマトリックス（加算型マ
トリックススイッチャ）である。このマトリックス３の
入力端子ＩＮにはコンソール２の出力端子ＣＨＯＵＴ，
ＧＰＯＵＴに得られる音声信号が供給され、それらを加
算（ミックス）した音声信号が出力端子ＯＵＴに出力さ
れる。すなわち、マトリックス３の出力端子ＯＵＴに
は、スタジオのモニタ用の音声信号、ＰＡ用の音声信
号、録音用のＤＡＴ等のオーディオテープレコーダのた
めの音声信号、記録用のＶＴＲのための音声信号、中継
先への音声の返しのための電話回線用の音声信号等が出
力される。
トリックススイッチャ）である。このマトリックス３の
入力端子ＩＮにはコンソール２の出力端子ＣＨＯＵＴ，
ＧＰＯＵＴに得られる音声信号が供給され、それらを加
算（ミックス）した音声信号が出力端子ＯＵＴに出力さ
れる。すなわち、マトリックス３の出力端子ＯＵＴに
は、スタジオのモニタ用の音声信号、ＰＡ用の音声信
号、録音用のＤＡＴ等のオーディオテープレコーダのた
めの音声信号、記録用のＶＴＲのための音声信号、中継
先への音声の返しのための電話回線用の音声信号等が出
力される。
【０００７】図６は、アウトプットマトリックス３の具
体構成を示したものである。図において、Ｎ個の入力ｉ
ｎ1〜ｉｎNはそれぞれ入力バッファ４-1〜４-Nを介して
信号処理回路５の入力端子ＩＮに供給される。そして、
この信号処理回路５より出力されるＭ個の出力ｏｕｔ1
〜ｏｕｔMは出力バッファ６-1〜６-Mを介して導出され
る。
体構成を示したものである。図において、Ｎ個の入力ｉ
ｎ1〜ｉｎNはそれぞれ入力バッファ４-1〜４-Nを介して
信号処理回路５の入力端子ＩＮに供給される。そして、
この信号処理回路５より出力されるＭ個の出力ｏｕｔ1
〜ｏｕｔMは出力バッファ６-1〜６-Mを介して導出され
る。
【０００８】また、７は加算情報（どの入力を加算して
出力するのかという情報）をマイクロプロセッサ８に供
給するコントローラである。マイクロプロセッサ８では
コントローラ７からの加算情報に基づいて信号処理回路
５に供給する係数が計算され、その係数が信号処理回路
５に供給される。
出力するのかという情報）をマイクロプロセッサ８に供
給するコントローラである。マイクロプロセッサ８では
コントローラ７からの加算情報に基づいて信号処理回路
５に供給する係数が計算され、その係数が信号処理回路
５に供給される。
【０００９】信号処理回路５では、数１に示す演算が行
なわれて、出力ｏｕｔ1〜ｏｕｔMが得られる。ここで、
ｋmn（ｍ＝１〜Ｍ，ｎ＝１〜Ｎ）は加算情報に応じてマ
イクロプロセッサ８で計算される係数である。
なわれて、出力ｏｕｔ1〜ｏｕｔMが得られる。ここで、
ｋmn（ｍ＝１〜Ｍ，ｎ＝１〜Ｎ）は加算情報に応じてマ
イクロプロセッサ８で計算される係数である。
【００１０】
【数１】
【００１１】
【発明が解決しようとする課題】ここで、コントローラ
７より入力ｉｎ1〜ｉｎ4を加算して出力ｏｕｔ1を得る
という加算情報がマイクロプロセッサ８に供給される場
合、マイクロプロセッサ８より信号処理回路５に送る係
数の値によって、出力ｏｕｔ1は以下のように変わる。 加算係数を１にした場合 マイクロプロセッサ８より信号処理回路５に送る係数を
加算すべき入力に対してすべて「１」を送り、加算しな
い入力に対してすべて「０」を送った場合、出力ｏｕｔ
1は、数２に示すようになる。
７より入力ｉｎ1〜ｉｎ4を加算して出力ｏｕｔ1を得る
という加算情報がマイクロプロセッサ８に供給される場
合、マイクロプロセッサ８より信号処理回路５に送る係
数の値によって、出力ｏｕｔ1は以下のように変わる。 加算係数を１にした場合 マイクロプロセッサ８より信号処理回路５に送る係数を
加算すべき入力に対してすべて「１」を送り、加算しな
い入力に対してすべて「０」を送った場合、出力ｏｕｔ
1は、数２に示すようになる。
【００１２】
【数２】
【００１３】この場合、マイクロプロセッサ８から信号
処理回路５に送る係数は、「１」または「０」であり、
係数を求める処理は容易となるるが、出力ｏｕｔ1は加
算すべき入力が増えるとオーバーフローまたはクリップ
するおそれが高くなる。 加算係数を１／ｎにした場合 マイクロプロセッサ８より信号処理回路５に送る係数を
加算すべき入力音声信号に対してすべて「１／ｎ」（ｎ
は加算すべき入力の個数）を送り、加算しない入力に対
してすべて「０」を送った場合、本例においては１／ｎ
＝１／４となり、出力ｏｕｔ1は、数３に示すようにな
る。
処理回路５に送る係数は、「１」または「０」であり、
係数を求める処理は容易となるるが、出力ｏｕｔ1は加
算すべき入力が増えるとオーバーフローまたはクリップ
するおそれが高くなる。 加算係数を１／ｎにした場合 マイクロプロセッサ８より信号処理回路５に送る係数を
加算すべき入力音声信号に対してすべて「１／ｎ」（ｎ
は加算すべき入力の個数）を送り、加算しない入力に対
してすべて「０」を送った場合、本例においては１／ｎ
＝１／４となり、出力ｏｕｔ1は、数３に示すようにな
る。
【００１４】
【数３】
【００１５】この場合、出力ｏｕｔ1はオーバーフロー
またはクリップすることなく得られる。そして、入力ｉ
ｎ1〜ｉｎ4に実際に信号が有る場合には、出力ｏｕｔ1
のレベルは最適なものとなる。しかし、例えば入力ｉｎ
2〜ｉｎ4に信号が無い場合には、出力ｏｕｔ1は入力ｉ
ｎ1の１／４のレベルとなる。つまり、加算すべき入力
が多く、その入力のうち信号のない入力が多くなる程レ
ベル低下は顕著となる。
またはクリップすることなく得られる。そして、入力ｉ
ｎ1〜ｉｎ4に実際に信号が有る場合には、出力ｏｕｔ1
のレベルは最適なものとなる。しかし、例えば入力ｉｎ
2〜ｉｎ4に信号が無い場合には、出力ｏｕｔ1は入力ｉ
ｎ1の１／４のレベルとなる。つまり、加算すべき入力
が多く、その入力のうち信号のない入力が多くなる程レ
ベル低下は顕著となる。
【００１６】そこで、この発明では、加算出力がオーバ
ーフローまたはクリップすることなく、しかも出力レベ
ルの低下が顕著とならないようにしたものである。
ーフローまたはクリップすることなく、しかも出力レベ
ルの低下が顕著とならないようにしたものである。
【００１７】
【課題を解決するための手段】この発明は、複数チャネ
ルから所定チャネルを選択し、そのチャネルの信号を加
算して出力する信号処理装置において、選択されたチャ
ネルの信号の有無を判別する判別回路を設け、この判別
回路で信号があると判別されたチャネルの個数に応じて
加算出力レベルを制御するものである。
ルから所定チャネルを選択し、そのチャネルの信号を加
算して出力する信号処理装置において、選択されたチャ
ネルの信号の有無を判別する判別回路を設け、この判別
回路で信号があると判別されたチャネルの個数に応じて
加算出力レベルを制御するものである。
【００１８】例えば、判別回路で信号があると判別され
たチャネルの個数をｊ個とするとき、加算出力レベルを
１／ｊにするものである。
たチャネルの個数をｊ個とするとき、加算出力レベルを
１／ｊにするものである。
【００１９】
【作用】この発明においては、加算すべきチャネルの信
号の有無を判別して、信号があると判別されたチャネル
の個数に応じて加算出力レベルを制御するものであるた
め、加算出力がオーバーフローまたはクリップすること
なく、またそのレベル低下が顕著となることもない。
号の有無を判別して、信号があると判別されたチャネル
の個数に応じて加算出力レベルを制御するものであるた
め、加算出力がオーバーフローまたはクリップすること
なく、またそのレベル低下が顕著となることもない。
【００２０】
【実施例】以下、図１を参照しながら、この発明の一実
施例について説明する。本例は放送局の音声系統におけ
るアウトプットマトリックス（加算型マトリックススイ
ッチャ）に適用した例である。図１において、図６と対
応する部分には同一符号を付し、その詳細説明は省略す
る。
施例について説明する。本例は放送局の音声系統におけ
るアウトプットマトリックス（加算型マトリックススイ
ッチャ）に適用した例である。図１において、図６と対
応する部分には同一符号を付し、その詳細説明は省略す
る。
【００２１】本例において、入力ｉｎ1〜ｉｎNは入力バ
ッファ４-1〜４-Nを介して判別回路９-1〜９-Nに供給さ
れる。この判別回路９-1〜９-Nでは入力ｉｎ1〜ｉｎNに
実際に信号があるか否かが判別され、その判別情報はそ
れぞれマイクロプロセッサ８に供給される。
ッファ４-1〜４-Nを介して判別回路９-1〜９-Nに供給さ
れる。この判別回路９-1〜９-Nでは入力ｉｎ1〜ｉｎNに
実際に信号があるか否かが判別され、その判別情報はそ
れぞれマイクロプロセッサ８に供給される。
【００２２】ここで、入力ｉｎ1〜ｉｎNにおける音声信
号がＡＥＳ／ＥＢＵ（Audio Engineering Society／Eur
opean Broadcasting Union）フォーマットのディジタル
オーディオデータであるとき、判別回路９-1〜９-Nでは
プリアンブルを検出することで信号の有無の判別を行な
うことができる。図３および図４は、それぞれＡＥＳ／
ＥＢＵフォーマットのディジタルオーディオデータのサ
ブフレームフォーマットおよびフレームフォーマットを
示している。
号がＡＥＳ／ＥＢＵ（Audio Engineering Society／Eur
opean Broadcasting Union）フォーマットのディジタル
オーディオデータであるとき、判別回路９-1〜９-Nでは
プリアンブルを検出することで信号の有無の判別を行な
うことができる。図３および図４は、それぞれＡＥＳ／
ＥＢＵフォーマットのディジタルオーディオデータのサ
ブフレームフォーマットおよびフレームフォーマットを
示している。
【００２３】また、マイクロプロセッサ８では、図２の
フローチャートに沿って信号処理回路５に送る係数ｋmn
が計算される。
フローチャートに沿って信号処理回路５に送る係数ｋmn
が計算される。
【００２４】まず、コントローラ７からの加算情報に基
づいて、ｏｕｔm（ｍ＝１〜Ｍ）に対してどの入力を加
算するか認識する。これにより係数ｋm1〜ｋmN（数１参
照）が「０」であるか「１」であるかが決定される（ス
テップ１１）。
づいて、ｏｕｔm（ｍ＝１〜Ｍ）に対してどの入力を加
算するか認識する。これにより係数ｋm1〜ｋmN（数１参
照）が「０」であるか「１」であるかが決定される（ス
テップ１１）。
【００２５】次に、判別回路９-1〜９-Nのうち加算する
入力に対応する判別回路の情報を読み、信号があると判
別された入力の個数ｊを認識する（ステップ１２）。
入力に対応する判別回路の情報を読み、信号があると判
別された入力の個数ｊを認識する（ステップ１２）。
【００２６】次に、ステップ１１で決定された係数ｋm1
〜ｋmNの値を１／ｊにして信号処理回路５に供給する
（ステップ１３）。
〜ｋmNの値を１／ｊにして信号処理回路５に供給する
（ステップ１３）。
【００２７】本例は以上のように構成され、その他は図
６の例と同様に構成される。本例において、コントロー
ラ７より入力ｉｎ1〜ｉｎ4を加算して出力ｏｕｔ1を得
るという加算情報がマイクロプロセッサ８に供給される
場合を考えて見る。
６の例と同様に構成される。本例において、コントロー
ラ７より入力ｉｎ1〜ｉｎ4を加算して出力ｏｕｔ1を得
るという加算情報がマイクロプロセッサ８に供給される
場合を考えて見る。
【００２８】入力ｉｎ1〜ｉｎ4に信号がある場合、ｊ＝
４となり、マイクロプロセッサ８より信号処理回路５に
送る係数は入力ｉｎ1〜ｉｎ4に対してすべて「１／４」
が送られ、その他の入力ｉｎ5〜ｉｎNに対して「０」が
送られ、出力ｏｕｔ１は上述した数３と同じ結果とな
る。これにより、出力ｏｕｔ1はオーバーフローまたは
クリップすることなく、最適なレベルとなる。
４となり、マイクロプロセッサ８より信号処理回路５に
送る係数は入力ｉｎ1〜ｉｎ4に対してすべて「１／４」
が送られ、その他の入力ｉｎ5〜ｉｎNに対して「０」が
送られ、出力ｏｕｔ１は上述した数３と同じ結果とな
る。これにより、出力ｏｕｔ1はオーバーフローまたは
クリップすることなく、最適なレベルとなる。
【００２９】一方、例えば入力ｉｎ2〜ｉｎ4に信号がな
い場合、ｊ＝１となり、マイクロプロセッサ８より信号
処理回路５に送る係数は入力ｉｎ1〜ｉｎ4に対してすべ
て「１」が送られ、その他の入力ｉｎ5〜ｉｎNに対して
「０」が送られ、出力ｏｕｔ1は、数４に示すようにな
り、最適なレベルとなる。これにより、加算すべき入力
に実際に信号がなくても出力のレベル低下が顕著となる
ことはない。
い場合、ｊ＝１となり、マイクロプロセッサ８より信号
処理回路５に送る係数は入力ｉｎ1〜ｉｎ4に対してすべ
て「１」が送られ、その他の入力ｉｎ5〜ｉｎNに対して
「０」が送られ、出力ｏｕｔ1は、数４に示すようにな
り、最適なレベルとなる。これにより、加算すべき入力
に実際に信号がなくても出力のレベル低下が顕著となる
ことはない。
【００３０】
【数４】
【００３１】なお、上述実施例においては、係数を１／
ｊにするものを示したが、これよりも若干小さくあるい
は大きくしても、同様の効果を得ることができる。要
は、加算すべき入力のうち実際に信号のある入力の個数
ｊに応じて出力レベルを制御することになる。
ｊにするものを示したが、これよりも若干小さくあるい
は大きくしても、同様の効果を得ることができる。要
は、加算すべき入力のうち実際に信号のある入力の個数
ｊに応じて出力レベルを制御することになる。
【００３２】また、上述実施例は放送局の音声系統にお
けるアウトプットマトリックスに適用した例であるが、
この発明は複数チャネルから所定チャネルを選択し、そ
のチャネルの信号を加算して出力する信号処理装置に同
様に適用できることは勿論である。
けるアウトプットマトリックスに適用した例であるが、
この発明は複数チャネルから所定チャネルを選択し、そ
のチャネルの信号を加算して出力する信号処理装置に同
様に適用できることは勿論である。
【００３３】
【発明の効果】この発明によれば、加算すべきチャネル
の信号の有無を判別して、信号があると判別されたチャ
ネルの個数に応じて加算出力レベルを制御するため、加
算出力がオーバーフローまたはクリップすることなく、
またそのレベル低下が顕著となることもない。
の信号の有無を判別して、信号があると判別されたチャ
ネルの個数に応じて加算出力レベルを制御するため、加
算出力がオーバーフローまたはクリップすることなく、
またそのレベル低下が顕著となることもない。
【図１】この発明の一実施例の構成を示すブロック図で
ある。
ある。
【図２】マイクロプロセッサにおける係数の計算動作を
示すフローチャートである。
示すフローチャートである。
【図３】ＡＥＳ／ＥＢＵフォーマットのディジタルオー
ディオデータのサブフレームフォーマットを示す図であ
る。
ディオデータのサブフレームフォーマットを示す図であ
る。
【図４】ＡＥＳ／ＥＢＵフォーマットのディジタルオー
ディオデータのフレームフォーマットを示す図である。
ディオデータのフレームフォーマットを示す図である。
【図５】放送局の音声系統の構成を示す図である。
【図６】アウトプットマトリックス（加算型マトリック
ススイッチャ）の構成を示すブロック図である。
ススイッチャ）の構成を示すブロック図である。
１ インプットマトリックス ２ ミキシングコンソール ３ アウトプットマトリックス（加算型マトリックスス
イッチャ） ４-1〜４-N 入力バッファ ５ 信号処理回路 ６-1〜６-M 出力バッファ ７ コントローラ ８ マイクロプロセッサ ９-1〜９-N 判別回路
イッチャ） ４-1〜４-N 入力バッファ ５ 信号処理回路 ６-1〜６-M 出力バッファ ７ コントローラ ８ マイクロプロセッサ ９-1〜９-N 判別回路
Claims (3)
- 【請求項１】 複数チャネルから所定チャネルを選択
し、そのチャネルの信号を加算して出力する信号処理装
置において、 上記選択されたチャネルの信号の有無を判別する判別回
路を設け、 この判別回路で信号があると判別されたチャネルの個数
に応じて上記加算出力レベルを制御することを特徴とす
る信号処理装置。 - 【請求項２】 上記複数チャネルの信号はＡＥＳ／ＥＢ
Ｕフォーマットのディジタルオーディオデータであり、
上記判別回路ではプリアンブルを検出して信号の有無を
判別することを特徴とする請求項１記載の信号処理装
置。 - 【請求項３】 上記判別回路で信号があると判別された
チャネルの個数をｊ個とするとき、上記加算出力レベル
を１／ｊにすることを特徴とする請求項１記載の信号処
理装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP24058392A JPH0690211A (ja) | 1992-09-09 | 1992-09-09 | 信号処理装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP24058392A JPH0690211A (ja) | 1992-09-09 | 1992-09-09 | 信号処理装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0690211A true JPH0690211A (ja) | 1994-03-29 |
Family
ID=17061679
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP24058392A Pending JPH0690211A (ja) | 1992-09-09 | 1992-09-09 | 信号処理装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0690211A (ja) |
-
1992
- 1992-09-09 JP JP24058392A patent/JPH0690211A/ja active Pending
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