JPH0695628B2 - Digital filter - Google Patents

Digital filter

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JPH0695628B2
JPH0695628B2 JP62036397A JP3639787A JPH0695628B2 JP H0695628 B2 JPH0695628 B2 JP H0695628B2 JP 62036397 A JP62036397 A JP 62036397A JP 3639787 A JP3639787 A JP 3639787A JP H0695628 B2 JPH0695628 B2 JP H0695628B2
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filter
fir
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output
type filter
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吉田  隆
彰 一瀬
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Yokogawa Electric Corp
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Yokogawa Electric Corp
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Description

【発明の詳細な説明】 〈産業上の利用分野〉 この発明はフィルタリングと間引き処理を行うデジタル
フィルタに関し、特にFFT(fast fourier transform)
アナライザのズーミング装置に用いて好適なデジタルフ
ィルタに関するものである。
DETAILED DESCRIPTION OF THE INVENTION <Industrial field of application> The present invention relates to a digital filter that performs filtering and thinning processing, and in particular, FFT (fast fourier transform).
The present invention relates to a digital filter suitable for use in an analyzer zooming device.

〈従来技術〉 FFTアナライザは時系列データにフーリエ演算処理を施
してこの時系列データのスペクトルを求めるものであ
り、より詳細なスペクトルを求めるために周波数軸を拡
大するズーミング装置が必要になる。この様なズーミン
グ装置は高ズーミング率とズーミング率の可変性が必要
であり、時系列データの間引きとフィルタリングを行う
デジタルフィルタが用いられている。第6図にこの様な
デジタルフィルタの構成を示す。第6図において、1は
IIR(infinite impluse filter)形フィルタであり、時
系列データが入力され、フィルタ演算が施される。この
IIR形フィルタ1の出力はその一部が間引かれ、再びIIR
形フィルタ1に帰還されフィルタ演算が施される。必要
な回数だけ演算が施されるとFFTアナライザ2に出力さ
れ、フーリエ演算が行なわれる。すなわちIIR形フィル
タはマルチステージで使用される。この様なデジタルフ
ィルタにおいて、間引き率をm、演算回数をnとすると
mnのスーミング率が得られる。m、nを可変することに
よってズーミング率を可変することができる。
<Prior Art> The FFT analyzer obtains the spectrum of this time-series data by subjecting the time-series data to a Fourier calculation process, and a zooming device for expanding the frequency axis is required to obtain a more detailed spectrum. Such a zooming device requires a high zooming ratio and variability of the zooming ratio, and a digital filter for thinning and filtering time series data is used. FIG. 6 shows the structure of such a digital filter. In FIG. 6, 1 is
It is an IIR (infinite impluse filter) type filter in which time series data is input and a filter operation is performed. this
Part of the output of the IIR filter 1 is thinned out and the
It is fed back to the shape filter 1 and subjected to filter calculation. When the calculation is performed the required number of times, it is output to the FFT analyzer 2 and the Fourier calculation is performed. That is, the IIR filter is used in multiple stages. In such a digital filter, if the thinning rate is m and the number of calculations is n.
A zooming rate of m n is obtained. The zooming rate can be changed by changing m and n.

次にIIR形フィルタについて説明する。IIR形フィルタは
時系列入力データをx(n)、時系列出力データをy
(n)とすると、 で表わされる。すなわち出力が入力に帰還する再帰型の
フィルタである。この様な演算を実行する装置の構成を
第7図に示す。第7図において、時系列データx(n)
は加算器3に入力される。加算器3の出力はレジスタ4
に入力され、シフトされる。このレジスタ4の出力は乗
算器5に入力され、前記(1)式の係数であるa1〜aN-1
との積がとられて加算器3に入力され、それらの和がと
られる。レジスタ4の出力はまた乗算器6で係数b1〜b
N-1との積がとられ、加算器7に入力されて加算され
る。また加算器3の出力は乗算器8で係数b0との積が演
算され、加算器7に入力される。加算器7の出力がフィ
ルタ演算結果になる。この様にして前記(1)式の演算
が実行される。なお、デジタルフィルタとしては前記の
IIR形の外にFIR(finite impluse filter)形がある。
しかしながら乗算回数およびデータの保存の点で不利で
あり、あまり使用されていない。
Next, the IIR filter will be described. The IIR filter has time series input data x (n) and time series output data y.
(N) It is represented by. That is, it is a recursive filter in which the output returns to the input. FIG. 7 shows the configuration of a device that executes such calculations. In FIG. 7, time series data x (n)
Is input to the adder 3. The output of the adder 3 is the register 4
Is input and shifted. The output of the register 4 is input to the multiplier 5, and the coefficients a 1 to a N-1 of the equation (1) are used.
And are input to the adder 3, and their sum is calculated. The output of the register 4 is also output by the multiplier 6 to the coefficients b 1 to b.
The product of N-1 and N-1 is input to the adder 7 and added. The output of the adder 3 is multiplied by the coefficient b 0 in the multiplier 8 and input to the adder 7. The output of the adder 7 becomes the filter calculation result. In this way, the calculation of the equation (1) is executed. As a digital filter,
In addition to the IIR type, there is the FIR (finite impluse filter) type.
However, it is disadvantageous in terms of the number of multiplications and the storage of data, and is rarely used.

〈発明が解決すべき問題点〉 しかしながら、この様なデジタルフィルタには次のよう
な問題点がある。前記(1)式からわかるようにIIR形
フィルタはその出力が入力に再帰される構成のため、そ
の出力の一部を捨てる間引きを行うにもかかわらず、す
べての時系列データについてフィルタ演算を実行しなけ
ればならない。
<Problems to be Solved by the Invention> However, such a digital filter has the following problems. As can be seen from the equation (1), since the output of the IIR filter is recursive to the input, the filter operation is executed for all the time-series data even though the output is partly discarded. Must.

また1つのフィルタをマルチステージで使用しているの
で、時系列データのサンプリング周波数を倍にするとフ
ィルタの動作速度も倍にしなければならない。そのため
ハードウェアが大きくなる。
Further, since one filter is used in multiple stages, doubling the sampling frequency of time series data also requires doubling the operating speed of the filter. Therefore, the hardware becomes large.

さらに第7図からわかるように、IIR形フィルタは構成
が複雑であるという欠点もある。
Further, as can be seen from FIG. 7, the IIR type filter has a drawback that the structure is complicated.

〈発明の目的〉 この発明の目的は、構成が簡単でかつ高速化が可能なデ
ジタルフィルタを提供することにある。
<Object of the Invention> An object of the present invention is to provide a digital filter which has a simple structure and can be speeded up.

〈問題点を解決するための手段〉 前記問題点を解決するために、本発明では時系列データ
にデジタル演算処理を施しこの時系列データのサンプリ
ングレートを下げるデジタルフィルタにおいて、 前記時系列データが入力される第1のFIR形フィルタ
と、 第1のマルチプレクサの出力が入力される第2のFIR形
フィルタと、 第2のマルチプレクサの出力が入力される第3のFIR形
フィルタと、 前記第1及び前記第2のFIR形フィルタの出力が入力さ
れる前記第1のマルチプレクサと、 前記時系列データ、前記第1及び前記第2のFIR形フィ
ルタの出力が入力される前記第2のマルチプレクサと を具備したことを特徴とするものである。
<Means for Solving Problems> In order to solve the above problems, in the present invention, the time series data is input in a digital filter that performs digital arithmetic processing on the time series data to reduce the sampling rate of the time series data. A first FIR type filter, a second FIR type filter to which the output of the first multiplexer is input, a third FIR type filter to which the output of the second multiplexer is input, the first and second The first multiplexer to which the output of the second FIR filter is input; and the second multiplexer to which the time series data and the outputs of the first and second FIR filters are input. It is characterized by having done.

また、前記第2のFIR形フィルタと前記第3のFIR形フィ
ルタを共用することを特徴とするものである。
The second FIR type filter and the third FIR type filter are commonly used.

〈実施例〉 第1図に本発明に係るデジタルフィルタの一実施例を示
す。第1図において、10は第1のFIR(finite impluse
filter)形フィルタであり、時系列データが入力され
る。この第1のFIR形フィルタ10の出力はマルチプレク
サ11および12に入力される。13は第2のFIR形フィルタ
であり、マルチプレクサ11の出力が入力され、その出力
はマルチプレクサ11および12に入力される。14は第3の
FIR形フィルタであり、マルチプレクサ12の出力が入力
され、その出力は外部に出力される。マルチプレクサ1
1、12は図示しないコントローラにより制御される。
<Embodiment> FIG. 1 shows an embodiment of a digital filter according to the present invention. In FIG. 1, 10 is the first FIR (finite impluse
time-series data is input. The output of the first FIR filter 10 is input to multiplexers 11 and 12. Reference numeral 13 is a second FIR type filter, the output of the multiplexer 11 is input, and the output is input to the multiplexers 11 and 12. 14 is the third
This is a FIR type filter, the output of the multiplexer 12 is input, and the output is output to the outside. Multiplexer 1
1, 12 are controlled by a controller (not shown).

次にFIR形フィルタについて説明する。FIR形フィルタは
その時系列入力をx(n)、時系列出力をy(n)とす
ると、 で表わされる。すなわち出力が入力に再帰しない非再帰
形フィルタである。第2図にFIR形フィルタの基本構成
を示す。第2図において、16はレジスタであり縦接続さ
れる。時系列データx(n)はこのレジスタ16の端のレ
ジスタに入力され、順にシフトされる。17は乗算器であ
り、レジスタ16の各々に入力される時系列データが入力
され、このデータにインパルス応答関数h(0)〜h
(N−1)を乗算して出力する。18は加算器であり、こ
れら乗算器17の出力が入力され加算される。この加算器
18の出力が時系列出力y(n)となる。このようにして
前記(2)式の演算が実行される。レジスタ16、乗算器
17は基本的にはフィルタの次数Nと同じ個数必要であ
る。
Next, the FIR filter will be described. The FIR type filter has x (n) as its time series input and y (n) as its time series output. It is represented by. That is, it is a non-recursive filter in which the output does not recurs to the input. Figure 2 shows the basic structure of a FIR filter. In FIG. 2, 16 is a register, which is vertically connected. The time series data x (n) is input to the register at the end of the register 16 and sequentially shifted. Reference numeral 17 denotes a multiplier, to which the time series data input to each of the registers 16 is input, and the impulse response functions h (0) to h (h) are input to this data.
Multiply (N-1) and output. Reference numeral 18 is an adder, and the outputs of these multipliers 17 are input and added. This adder
The output of 18 becomes the time series output y (n). In this way, the calculation of the equation (2) is executed. Register 16, multiplier
Basically, 17 must be the same number as the filter order N.

次に第1図実施例の動作を説明する。最初に第1〜第3
のFIR形フィルタ10、13、14のすべてを使用し、かつ各
々のフィルタの間引き率をMとして説明する。M個の時
系列データは先ず第1のFIR形フィルタ10に入力され、
前記(2)式に基づいてフィルタ演算が1度実行されて
1個の出力が出力される。すなわち入力時系列データの
サンプリング周波数をfsとすると、この第1のFIR形フ
ィルタの出力の周波数はfs/Mとなる。このことは第1の
FIR形フィルタがfs/Mの周波数で動作すれば良いことを
示す。この出力データはマルチプレクサ11を介して第2
のFIR形フィルタ13に入力される。このフィルタ13は第
1のFIR形フィルタ10からM個のデータを得てフィルタ
演算および間引き処理を行う。またこのフィルタ13はマ
ルチステージで用いられる。すなわち第2のFIR形フィ
ルタ13の出力はマルチプレクサ11により再度このフィル
タ13に入力され処理される。この処理(ステージ)は必
要な回数だけ繰返される。各ステージは時分割で行なわ
れる。一般にフィルタ演算は間引き率Mより多くの時系
列データを用いてなされるから、このフィルタの内部に
各ステージのデータを保持し、ステージによって保持さ
れたデータを切換える。時系列データのサンプリング周
波数fsは第1のFIR形フィルタ10で1/Mにされるので、第
2のFIR形フィルタの動作周波数はfs/Mであればよい。
また第2のFIR形フィルタのステージ数をnとすると、
このフィルタの出力のサンプリング周波数はfs/(M)n+1
となる。第2のFIR形フィルタ13の出力はマルチプレク
サ12を介して第3のFIR形フィルタ14に入力され、フィ
ルタ演算および間引き処理が行なわれる。このフィルタ
の出力が最終的な出力となる。これによりMn+2のズーミ
ング率が得られる。なお、ズーミング率がM2のときは入
力時系列データを第1のFIR形フィルタ10に通し、この
出力を第3のFIR形フィルタ14でフィルタリング、間引
き処理を行って出力する。また、ズーミング率がMのと
きは第3のFIR形フィルタ14のみを使用する。これらの
選択はマルチプレクサ11、12によって各フィルタに入力
されるデータを切換えることによって行う。さらに第1
のFIR形フィルタ10、第2のFIR形フィルタ13は最終段に
なることはないので、これらのフィルタの特性は緩かで
よい。すなわち次数を高くする必要がないので構成を簡
単にすることができる。
Next, the operation of the embodiment shown in FIG. 1 will be described. First to third
All FIR type filters 10, 13 and 14 in FIG. 3 are used, and the decimation rate of each filter is referred to as M. The M time series data are first input to the first FIR type filter 10,
The filter operation is executed once based on the equation (2), and one output is output. That is, assuming that the sampling frequency of the input time series data is f s, the frequency of the output of this first FIR filter is f s / M. This is the first
We show that the FIR filter should operate at a frequency of f s / M. This output data is sent to the second via the multiplexer 11.
Is input to the FIR filter 13 of. The filter 13 obtains M pieces of data from the first FIR type filter 10 and performs filter calculation and thinning processing. The filter 13 is used in multiple stages. That is, the output of the second FIR type filter 13 is input to the filter 13 again by the multiplexer 11 and processed. This process (stage) is repeated as many times as necessary. Each stage is time-shared. In general, the filter operation is performed using time series data with a larger number than the thinning rate M, so that the data of each stage is held inside this filter and the data held by the stage is switched. Since the sampling frequency f s of the time series data is set to 1 / M by the first FIR type filter 10, the operating frequency of the second FIR type filter may be f s / M.
If the number of stages of the second FIR filter is n,
The sampling frequency of the output of this filter is f s / (M) n + 1
Becomes The output of the second FIR type filter 13 is input to the third FIR type filter 14 via the multiplexer 12, and filter calculation and thinning processing are performed. The output of this filter is the final output. This gives a zooming rate of Mn + 2 . When the zooming rate is M 2 , the input time series data is passed through the first FIR type filter 10, and the output is filtered by the third FIR type filter 14 and thinned out before being output. When the zooming ratio is M, only the third FIR type filter 14 is used. These selections are made by switching the data input to each filter by multiplexers 11 and 12. Furthermore the first
Since the FIR type filter 10 and the second FIR type filter 13 of FIG. 3 do not form the final stage, the characteristics of these filters may be gentle. That is, since it is not necessary to increase the order, the structure can be simplified.

第3図にステージ当たりの間引き率M=2、フィルタ全
体のステージ数を5(第2のFIR形フィルタ13のステー
ジ数=3)の場合の各ステージの動作タイミングを示
す。この図において、(1)は第3図のFIR形フィルタ1
4、(2)〜(4)は第2のFIR形フィルタ13の第3〜第
1ステージ、(5)は第1のFIR形フィルタ10の動作タ
イミングを示す。図中→は動作している時間を示す。
(6)は入力時系列データのサンプリング周期(1/fs
を表わす。各フィルタは入力データが2個得られた段階
で動作される。この図からわかるように、第1のFIR形
フィルタの動作は入力時系列データのサンプリング周期
の2倍(一般的にはM倍)になり、かつ第2、第3のFI
R形フィルタ13、14の動作タイミングが重ならないよう
にできる。
FIG. 3 shows the operation timing of each stage when the thinning rate per stage is M = 2 and the number of stages of the entire filter is 5 (the number of stages of the second FIR filter 13 = 3). In this figure, (1) is the FIR type filter 1 of FIG.
4, (2) to (4) show the third to first stages of the second FIR type filter 13, and (5) shows the operation timing of the first FIR type filter 10. In the figure → indicates the operating time.
(6) is the sampling period (1 / f s ) of the input time series data
Represents Each filter is operated when two pieces of input data are obtained. As can be seen from this figure, the operation of the first FIR type filter is twice the sampling period of the input time series data (generally M times), and the operation of the second and third FI
The operation timings of the R-type filters 13 and 14 can be prevented from overlapping.

第4図に本発明の他の実施例を示す。なお、第1図と同
じ要素には同一符号を付し、説明を省略する。この図に
おいて、19はメモリであり第1のFIR形フィルタ10の出
力および第2のFIR形フィルタ13の各ステージの出力が
入力され、格納される。各ステージはMワードの格納領
域を有しそのアドレスがあらかじめ決められている。20
はマルチプレクサであり、入力時系列データおよびメモ
リ19に格納されたデータが入力され、選択されて第3の
FIR形フィルタ14に出力する。21はコントローラであ
り、第2のFIR形フィルタ13、メモリ19、マルチプレク
サ20を制御する。動作は第1図実施例と同じなので省略
する。この実施例では各フィルタの出力を1つのメモリ
の対応するアドレスに格納することによって構成を簡略
化している。
FIG. 4 shows another embodiment of the present invention. The same elements as those in FIG. 1 are designated by the same reference numerals and the description thereof will be omitted. In the figure, reference numeral 19 is a memory to which the output of the first FIR type filter 10 and the output of each stage of the second FIR type filter 13 are input and stored. Each stage has a storage area of M words and its address is predetermined. 20
Is a multiplexer, which receives the input time-series data and the data stored in the memory 19 and selects the third time
Output to FIR filter 14. A controller 21 controls the second FIR filter 13, the memory 19, and the multiplexer 20. The operation is the same as that of the embodiment shown in FIG. In this embodiment, the configuration is simplified by storing the output of each filter in the corresponding address of one memory.

第5図にさらに他の実施例を示す。なお第4図と同じ要
素には同一符号を付し、説明を省略する。第3図からわ
かるように、第2のFIR形フィルタ13と第3のFIR形フィ
ルタ14の動作タイミングは重複しないようにできる。こ
の実施例は第2のFIR形フィルタ13と第3のFIR形フィル
タ14を共用して構成の簡略化を計ったものである。第5
図において、22はFIR形フィルタであり、第2、第3のF
IR形フィルタ13、14と同様な構成をしている。23、24は
それぞれ第2、第3のFIR形フィルタ用係数格納部であ
り、各フィルタのインパルス応答係数が格納されてい
る。25はマルチプレクサであり、これら第2、第3のFI
R形フィルタ用係数格納部23、24に格納された係数を洗
濯してFIR形フィルタ22に出力する。26はコントローラ
であり、メモリ19、マルチプレクサ20、25、FIR形フィ
ルタ22を制御する。すなわちFIR形フィルタを第2のFIR
形フィルタとして使用するときは第2のFIR形フィルタ
用係数格納部23を選び、第3のFIR形フィルタとして使
用するときは第3のフィルタ用係数格納部24を選択す
る。その他の動作は第4図実施例と同じなので省略す
る。
FIG. 5 shows still another embodiment. The same elements as those in FIG. 4 are designated by the same reference numerals and the description thereof will be omitted. As can be seen from FIG. 3, the operation timings of the second FIR type filter 13 and the third FIR type filter 14 can be made not to overlap. In this embodiment, the second FIR type filter 13 and the third FIR type filter 14 are shared to simplify the structure. Fifth
In the figure, 22 is an FIR type filter, and the second and third F
It has the same structure as the IR filters 13 and 14. Reference numerals 23 and 24 denote second and third FIR filter coefficient storage units, respectively, which store impulse response coefficients of the respective filters. 25 is a multiplexer, and these are the second and third FI
The coefficients stored in the R-type filter coefficient storage units 23 and 24 are washed and output to the FIR filter 22. A controller 26 controls the memory 19, the multiplexers 20 and 25, and the FIR type filter 22. That is, the FIR filter is used as the second FIR
When used as a third filter, the second FIR type filter coefficient storage unit 23 is selected, and when used as a third FIR type filter, the third filter coefficient storage unit 24 is selected. The other operations are the same as those in the embodiment shown in FIG.

なお、これらの実施例では第1〜第3のFIR形フィルタ1
0、13、14の間引き率を同じ数としたが異なるようにし
てもよい。
In these embodiments, the first to third FIR type filters 1
Although the thinning rates of 0, 13, and 14 are the same, they may be different.

〈発明の効果〉 以上実施例に基づいて具体的に説明したように、この発
明ではフィルタとしてFIR形のフィルタを用い、かつ初
段の第1のFIR形フィルタ、マルチステージで用いる第
2のFIR形フィルタ、最終段の第3のFIR形フィルタにわ
けて構成するようにした。そのため、第1、第2のFIR
形フィルタは最終段にならないので次数を大きくしなく
てもよく、構成を簡単にすることができ、また乗算回数
を減らすことができる。
<Effects of the Invention> As specifically described above based on the embodiments, in the present invention, the FIR type filter is used as the filter, and the first FIR type filter in the first stage and the second FIR type used in the multistage are used. The filter is divided into the third stage FIR filter at the final stage. Therefore, the first and second FIR
Since the shape filter does not become the final stage, it is not necessary to increase the order, the configuration can be simplified, and the number of multiplications can be reduced.

また第1のFIR形フィルタを別に設け、初段専用とし
た。そのため第2、第3のFIR形フィルタのサンプリン
グ周波数は初段の入力周波数に比べて1/Mになるので、
動作速度の遅いフィルタが使用できる。また、第1のフ
ィルタもFIR形であるため、現実の動作速度は入力周波
数の1/Mになる。
In addition, the first FIR type filter was installed separately to make it the first stage only. Therefore, the sampling frequency of the second and third FIR filters is 1 / M compared to the input frequency of the first stage.
A filter with a slow operation speed can be used. Also, since the first filter is also of FIR type, the actual operating speed is 1 / M of the input frequency.

【図面の簡単な説明】[Brief description of drawings]

第1図は本発明に係るデジタルフィルタの一実施例を示
すブロック図、第2図はFIR形フィルタの構成を示すブ
ロック図、第3図は動作タイミングを示す図、第4図、
第5図は他の実施例を示すブロック図、第6図は従来の
デジタルフィルタの構成を示すブロック図、第7図はII
R形フィルタの構成を示すブロック図である。 10……第1のFIR形フィルタ、11,12,20,25……マルチプ
レクサ、13……第2のFIR形フィルタ、14……第3のFIR
形フィルタ、19……メモリ、21,26……コントローラ。2
2……FIR形フィルタ、23……第2のFIR形フィルタ用係
数格納部、24……第3のFIR形フィルタ用係数格納部。
FIG. 1 is a block diagram showing an embodiment of a digital filter according to the present invention, FIG. 2 is a block diagram showing the configuration of a FIR filter, FIG. 3 is a diagram showing operation timing, FIG.
FIG. 5 is a block diagram showing another embodiment, FIG. 6 is a block diagram showing the configuration of a conventional digital filter, and FIG. 7 is II.
It is a block diagram showing a configuration of an R-type filter. 10 …… First FIR type filter, 11,12,20,25 …… Multiplexer, 13 …… Second FIR type filter, 14 …… Third FIR
Shape filter, 19 ... Memory, 21,26 ... Controller. 2
2 ... FIR type filter, 23 ... Second FIR type filter coefficient storing section, 24 ... Third FIR type filter coefficient storing section.

Claims (2)

【特許請求の範囲】[Claims] 【請求項1】時系列データにデジタル演算処理を施しこ
の時系列データのサンプリングレートを下げるデジタル
フィルタにおいて、 前記時系列データが入力される第1のFIR形フィルタ
と、 第1のマルチプレクサの出力が入力される第2のFIR形
フィルタと、 第2のマルチプレクサの出力が入力される第3のFIR形
フィルタと、 前記第1及び前記第2のFIR形フィルタの出力が入力さ
れる前記第1のマルチプレクサと、 前記時系列データ、前記第1及び前記第2のFIR形フィ
ルタの出力が入力される前記第2のマルチプレクサと を有することを特徴とするデジタルフィルタ。
1. A digital filter for subjecting time-series data to a digital operation process to reduce the sampling rate of the time-series data, wherein a first FIR filter to which the time-series data is input and an output of a first multiplexer are provided. A second FIR filter to be input, a third FIR filter to which the output of the second multiplexer is input, and a first FIR filter to which outputs of the first and second FIR filters are input A digital filter comprising: a multiplexer; and the second multiplexer to which the time series data and the outputs of the first and second FIR filters are input.
【請求項2】前記第2のFIR形フィルタと前記第3のFIR
形フィルタを共用することを特徴とする特許請求の範囲
第1項記載のデジタルフィルタ。
2. The second FIR type filter and the third FIR type filter.
The digital filter according to claim 1, wherein the digital filter shares a common type filter.
JP62036397A 1987-02-19 1987-02-19 Digital filter Expired - Lifetime JPH0695628B2 (en)

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Application Number Priority Date Filing Date Title
JP62036397A JPH0695628B2 (en) 1987-02-19 1987-02-19 Digital filter

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JPS61100015A (en) * 1984-10-22 1986-05-19 Nippon Precision Saakitsutsu Kk Digital filter for sampling frequency conversion
JPS61192113A (en) * 1985-02-20 1986-08-26 Nec Home Electronics Ltd Rate conversion digital filter

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