JPH0710095B2 - Luminance circuit - Google Patents
Luminance circuitInfo
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- JPH0710095B2 JPH0710095B2 JP60284898A JP28489885A JPH0710095B2 JP H0710095 B2 JPH0710095 B2 JP H0710095B2 JP 60284898 A JP60284898 A JP 60284898A JP 28489885 A JP28489885 A JP 28489885A JP H0710095 B2 JPH0710095 B2 JP H0710095B2
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Description
【発明の詳細な説明】 産業上の利用分野 本発明は、カラー陰極線管CRTディスプレイの映像回路
に使用される輝度回路に関するものである。Description: TECHNICAL FIELD The present invention relates to a luminance circuit used in a video circuit of a color cathode ray tube CRT display.
従来の技術 近年、ブランキングパルスを用いたキードクランプ方式
の直流再生回路が、主にカラーCRTディスプレイの映像
出力を容量結合したCRTカソード電圧の直流分を再生す
る回路として利用されている。2. Description of the Related Art In recent years, a keyed clamp type DC reproducing circuit using a blanking pulse has been mainly used as a circuit for reproducing a DC component of a CRT cathode voltage which is capacitively coupled with a video output of a color CRT display.
以下、図面を参照しながら、従来の直流再生回路の一例
について説明する。Hereinafter, an example of a conventional DC regenerating circuit will be described with reference to the drawings.
第４図は従来のキードクランプ方式の直流再生回路の回
路図で、第６図は従来の直流再生回路の入，出力特性を
示すものである。FIG. 4 is a circuit diagram of a conventional DC regeneration circuit of the keyed clamp system, and FIG. 6 shows input / output characteristics of the conventional DC regeneration circuit.
第４図において、１は映像出力回路、２は出力結合コン
デンサで、直流分をカットする。３はCRT、４は第１の
抵抗、５はダイオード、６はクランプ用トランジスタ、
７は第２の抵抗、９は可変抵抗である。映像出力回路１
の出力端に出力結合コンデンサ２が接続されている。ク
ランプ用トランジスタ６のエミッタは第２の抵抗７を経
て接地されており、ダイドード５は、CRT3のカソードか
ら可変抵抗９の摺動端子にCRT3のカソードから電流が流
入する向きで接続されている。In FIG. 4, 1 is a video output circuit, and 2 is an output coupling capacitor, which cuts a direct current component. 3 is a CRT, 4 is a first resistor, 5 is a diode, 6 is a transistor for clamping,
Reference numeral 7 is a second resistance, and 9 is a variable resistance. Video output circuit 1
The output coupling capacitor 2 is connected to the output terminal of the. The emitter of the clamping transistor 6 is grounded via the second resistor 7, and the diode 5 is connected in such a direction that current flows from the cathode of CRT3 to the sliding terminal of the variable resistor 9 from the cathode of CRT3.
以上のように構成された直流再生回路において、まず映
像出力回路１の入力端には第５図（ａ）の様な信号が加
えられる。映像出力回路１の出力は出力結合コンデンサ
２によりCRT3のカソードに供給されるが、直流分は伝達
されず、第５図（ｂ）のような電圧になる為、CRT3のカ
ソードに直流分を供給する回路が必要になる。In the DC reproducing circuit configured as described above, first, a signal as shown in FIG. 5A is applied to the input terminal of the video output circuit 1. The output of the video output circuit 1 is supplied to the cathode of CRT3 by the output coupling capacitor 2, but the DC component is not transmitted and the voltage becomes as shown in FIG. 5 (b), so the DC component is supplied to the cathode of CRT3. Circuit is required.
従来の直流再生回路では、電源から第１の抵抗４と可変
抵抗９の直列回路を通してクランプ用トランジスタ６の
コレクタに電力を供給する。このクランプ用トランジス
タ６のベースに映像のブランキング期間に正のパルスを
加えると、第６図に示す様にそのパルス期間だけ電流が
流れてコレクタ電圧がE0迄下がる。CRT3のカソードにダ
イオード５のアノードを接続し、カソードをクランプ用
トランジスタ６のコレクタに接続するので、パルスを加
えた期間にダイオード電流が流れ、カソード電圧はE0に
る。クランプ用トランジスタ６が遮断されるとその期間
にはコレクタ電圧が電源電圧迄下がる為ダイオードが逆
バイアスとなり、出力結合コンデンサ２の放電電流が流
れない。従ってブランキング期間の映像出力は一定E0に
保たれる。そこで、CRTカソード電圧は第５図（ｃ）に
示すように信号が変わっても直流分が保持される。In the conventional DC regeneration circuit, power is supplied from the power supply to the collector of the clamping transistor 6 through the series circuit of the first resistor 4 and the variable resistor 9. When a positive pulse is applied to the base of the clamp transistor 6 during the blanking period of the image, a current flows only during the pulse period and the collector voltage drops to E 0 as shown in FIG. Since the anode of the diode 5 is connected to the cathode of the CRT3 and the cathode is connected to the collector of the clamping transistor 6, the diode current flows during the pulse application period and the cathode voltage becomes E 0 . When the clamping transistor 6 is cut off, the collector voltage drops to the power supply voltage during that period, so that the diode is reverse biased and the discharge current of the output coupling capacitor 2 does not flow. Therefore, the video output during the blanking period is kept constant E 0 . Therefore, the CRT cathode voltage holds the DC component even if the signal changes as shown in FIG. 5 (c).
発明が解決しようとする問題点 しかしながら上記のような回路では、輝度がG1電圧（CR
Tカットオフ電圧）で決まってしまうので、輝度を可変
させることができない。また、パルス電圧の平均値を可
変させることができないので、明るさ（ブライトネス）
の調整ができない。Problems to be Solved by the Invention However, in the circuit as described above, the luminance is the G1 voltage (CR
The brightness cannot be varied because it is determined by the T cutoff voltage. Also, since the average value of the pulse voltage cannot be changed, brightness (brightness)
Cannot be adjusted.
本発明は上記問題点に鑑み、輝度を任意に変えることが
でき、その時の平均値を可変することで明るさ（ブライ
トネス）の調整ができる輝度回路を提供することを目的
とする。In view of the above problems, it is an object of the present invention to provide a luminance circuit that can arbitrarily change the luminance and can change the average value at that time to adjust the brightness (brightness).
問題点を解決するための手段 上記目的を達するために本発明の輝度回路は、クランプ
用トランジスタのベースに、パルス電圧の波高値を可変
するための第１の可変抵抗を有するパルスアンプを接続
するとともに、電源とクランプ用トランジスタのベース
の間に抵抗を接続し、ベースとアース間に第２の可変抵
抗を接続して、バイアス電圧を加える構成となってい
る。Means for Solving the Problems To achieve the above object, in the luminance circuit of the present invention, a pulse amplifier having a first variable resistor for varying the peak value of the pulse voltage is connected to the base of the clamping transistor. At the same time, a resistor is connected between the power supply and the base of the clamping transistor, and a second variable resistor is connected between the base and ground to apply a bias voltage.
作用 本発明は、上記した構成によって、可変抵抗を用いたパ
ルスアンプを接続したことにより、パルスアンプで増幅
されたパルスの波高値を任意に可変させることができ
る。すなわち輝度を任意に可変させることができること
になる。又、その平均値は可変抵抗により、バイアス電
圧として任意に可変させることができることとなる。Effect The present invention can arbitrarily change the crest value of the pulse amplified by the pulse amplifier by connecting the pulse amplifier using the variable resistor with the above-described configuration. That is, the brightness can be arbitrarily changed. Further, the average value can be arbitrarily changed as the bias voltage by the variable resistor.
実施例 以下、本発明の一実施例の輝度回路について、図面を参
照しながら説明する。第１図は本発明の一実施例におけ
る輝度回路の回路図である。Embodiment Hereinafter, a luminance circuit according to an embodiment of the present invention will be described with reference to the drawings. FIG. 1 is a circuit diagram of a luminance circuit in an embodiment of the present invention.
第１図において、１は映像出力回路、２は出力結合コン
デンサ、３はCRT、４は抵抗、５はダイオード、６はク
ランプ用トランジスタ、７は抵抗、８は抵抗、９は可変
抵抗、10はコンデンサ、11は抵抗、12はトランジスタ、
13は抵抗、14は可変抵抗、15は抵抗で、16はコンデンサ
である。映像出力回路１、出力結合コンデンサ２、CRT3
の構成及び、クランプ用トランジスタ６、抵抗4,7、ダ
イオード５から成る直流再生回路30の基本的な構成は従
来例のものと同じである。In FIG. 1, 1 is a video output circuit, 2 is an output coupling capacitor, 3 is a CRT, 4 is a resistor, 5 is a diode, 6 is a clamping transistor, 7 is a resistor, 8 is a resistor, 9 is a variable resistor, and 10 is a variable resistor. Capacitor, 11 is resistor, 12 is transistor,
Reference numeral 13 is a resistor, 14 is a variable resistor, 15 is a resistor, and 16 is a capacitor. Video output circuit 1, output coupling capacitor 2, CRT3
The basic configuration of the DC regeneration circuit 30 including the clamping transistor 6, the resistors 4, 7 and the diode 5 is the same as that of the conventional example.
クランプ用トランジスタ６のベースに、可変抵抗14、コ
ンデンサ16、抵抗15、トランジスタ12、抵抗11,13、コ
ンデンサ10から成るパルスアンプ回路40を接続し、それ
に重畳させる様に抵抗８、可変抵抗９によりバイアス電
圧を加える。A pulse amplifier circuit 40 composed of a variable resistor 14, a capacitor 16, a resistor 15, a transistor 12, resistors 11, 13 and a capacitor 10 is connected to the base of the clamp transistor 6, and a resistor 8 and a variable resistor 9 are used so as to be superposed on it. Apply bias voltage.
以上の様に構成された輝度回路について、第１図、第２
図を用いてその動作を説明する。Regarding the luminance circuit configured as described above, FIG.
The operation will be described with reference to the drawings.
トランジスタ12のベースに第２図の（ａ）の様なパルス
が入力されると、トランジスタ12のベースには、バイア
ス電圧が重畳されているので、高い方は導通し低い方は
遮断されトランジスタ12のエミッタ出力は第２図（ｂ）
の様な波形が出る。ここで、トランジスタ12のベースに
加わるバイアス電圧は可変抵抗14によって任意に可変す
ることができるので、可変抵抗14を大きくするとバイア
ス電圧も上がりトランジスタ12のベースのパルス波形は
第２図（ｃ）の波形21の様になり、可変抵抗14を小さく
するとバイアス電圧も下がりトランジスタ12のベースの
パルス波形は第２図（ｃ）の波形22の様になる。前記し
た様にトランジスタ12は、高い方を導通し、低い方を遮
断するので、トランジスタ12のエミッタ出力は第２図
（ｄ）の様になり、可変抵抗14でバイアス電圧を可変す
ることにより、波高値を任意に変えることができるので
ある。すなわち、波高値を高くすると輝度は明るくな
り、波高値を低くすると輝度は暗くなるので、可変抵抗
14は輝度ボリウムとして使用することができる。When a pulse as shown in FIG. 2A is input to the base of the transistor 12, a bias voltage is superimposed on the base of the transistor 12, so that the higher one is conductive and the lower one is cut off. The emitter output of Fig. 2 (b)
The waveform looks like. Since the bias voltage applied to the base of the transistor 12 can be arbitrarily changed by the variable resistor 14, increasing the variable resistor 14 raises the bias voltage, and the pulse waveform of the base of the transistor 12 is as shown in FIG. The waveform 21 is obtained, and when the variable resistor 14 is made smaller, the bias voltage is also lowered, and the pulse waveform of the base of the transistor 12 becomes the waveform 22 of FIG. 2 (c). As described above, since the transistor 12 conducts the higher one and shuts off the lower one, the emitter output of the transistor 12 becomes as shown in FIG. 2 (d), and by varying the bias voltage with the variable resistor 14, The peak value can be changed arbitrarily. That is, the higher the peak value, the brighter the brightness, and the lower the peak value, the darker the brightness.
14 can be used as a brightness adjuster.
トランジスタ12のエミッタ出力は、電源から接続された
抵抗８、可変抵抗９によりバイアス電圧VBが重畳され、
クランプ用トランジスタ６のベースには第３図（ａ）の
ような波形が入力される。クランプ用トランジスタ６の
コレクタ抵抗４とエミッタ抵抗７の比が電圧増幅率が定
まる為、可変抵抗９の値を変えてもコレクタ出力のパル
スの波高値は変わらない。従って、コレクタ出力のパル
ス電圧は第３図（ｂ）のようになり可変抵抗９を可変さ
せることにより、バイアス電圧を変化させその平均値E0
を任意に可変させることができる。A bias voltage V B is superposed on the emitter output of the transistor 12 by a resistor 8 and a variable resistor 9 connected from a power source,
A waveform as shown in FIG. 3A is input to the base of the clamping transistor 6. Since the voltage amplification factor is determined by the ratio between the collector resistance 4 and the emitter resistance 7 of the clamping transistor 6, the peak value of the pulse of the collector output does not change even if the value of the variable resistance 9 is changed. Therefore, the pulse voltage of the collector output becomes as shown in FIG. 3 (b), and by changing the variable resistor 9, the bias voltage is changed and its average value E 0
Can be changed arbitrarily.
以上のように本実施例によれば、直流再生回路30の入力
端にパルスアンプ回路40を接続することにより、その入
力端のパルス電圧は増幅され、可変抵抗14で任意に波高
値を可変することができる。また、その入力端にバイア
ス電圧を加えることにより、パルス電圧の平均値は可変
抵抗９で任意に可変することができる。As described above, according to the present embodiment, by connecting the pulse amplifier circuit 40 to the input end of the direct current regeneration circuit 30, the pulse voltage at the input end is amplified and the peak value is arbitrarily changed by the variable resistor 14. be able to. Further, by applying a bias voltage to the input terminal, the average value of the pulse voltage can be arbitrarily changed by the variable resistor 9.
尚、第１図でR,G,Bの３チャンネル回路を組めば、３色
の輝度を揃えることができる。If three R, G, and B channel circuits are assembled in FIG. 1, the brightness of the three colors can be made uniform.
発明の効果 以上のように本発明によれば、直流再生回路の入力端に
加わるパルス電圧を増幅するパルスアンプ回路と、バイ
アス電圧をその入力端に重畳させる、抵抗と可変抵抗を
設けることにより、パルス電圧の波高値、平均値を可変
抵抗でおのおの任意に変えることができる。As described above, according to the present invention, by providing the pulse amplifier circuit that amplifies the pulse voltage applied to the input terminal of the direct current reproduction circuit, and the resistor and the variable resistor that superimpose the bias voltage on the input terminal, The peak value and average value of the pulse voltage can be arbitrarily changed with a variable resistor.
第１図は本発明の一実施例における輝度回路の回路図、
第２図は同パルスアンプの入出力波形図、第３図は同ク
ランプ用トランジスタの入出力波形図、第４図は従来例
の輝度回路の回路図、第５図はその各部の電圧波形図、
第６図はその入出力特性を示す特性図である。 １……映像出力回路、２……出力結合コンデンサ、３…
…CRT、4,7,8,11,13,15……抵抗、５……ダイオード、
6,12……トランジスタ、9,14……可変抵抗、10,16……
コンデンサ、30……直流再生回路、40……パルスアンプ
回路。FIG. 1 is a circuit diagram of a luminance circuit in one embodiment of the present invention,
2 is an input / output waveform diagram of the same pulse amplifier, FIG. 3 is an input / output waveform diagram of the same clamping transistor, FIG. 4 is a circuit diagram of a luminance circuit of a conventional example, and FIG. 5 is a voltage waveform diagram of each part thereof. ,
FIG. 6 is a characteristic diagram showing the input / output characteristics. 1 ... Video output circuit, 2 ... Output coupling capacitor, 3 ...
… CRT, 4,7,8,11,13,15 …… Resistance, 5 …… Diode,
6,12 …… Transistor, 9,14 …… Variable resistance, 10,16 ……
Capacitor, 30 ... DC regeneration circuit, 40 ... Pulse amplifier circuit.
Claims (1)
ド電圧の直流分を再生するために、ブランキングパルス
を用いてキードクランプする様に構成された直流再生回
路と、前記直流再生回路の入力端に加わるパルス電圧を
増幅するように構成するとともに、前記パルス電圧の波
高値を任意に可変する第１の可変抵抗を有するパルスア
ンプ回路と、電気直流再生回路の入力端に加えられるパ
ルスアンプ回路のパルスの平均値をバイアス電圧として
加えるための抵抗と第２の可変抵抗とを有し、前記のパ
ルスの平均値を第２の可変抵抗で任意に可変するように
構成してなる輝度回路。1. A direct current regeneration circuit configured to perform keyed clamp using a blanking pulse to regenerate a direct current component of a cathode voltage of a cathode ray tube in which a video output is capacitively coupled, and a direct current regeneration circuit of the direct current regeneration circuit. A pulse amplifier circuit configured to amplify a pulse voltage applied to an input terminal and having a first variable resistor that arbitrarily changes the peak value of the pulse voltage, and a pulse amplifier applied to the input terminal of the electric DC regeneration circuit Luminance circuit having a resistor for adding the average value of the pulse of the circuit as a bias voltage and a second variable resistor, and configured to arbitrarily change the average value of the pulse by the second variable resistor. .
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60284898A JPH0710095B2 (en) | 1985-12-18 | 1985-12-18 | Luminance circuit |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60284898A JPH0710095B2 (en) | 1985-12-18 | 1985-12-18 | Luminance circuit |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS62143566A JPS62143566A (en) | 1987-06-26 |
| JPH0710095B2 true JPH0710095B2 (en) | 1995-02-01 |
Family
ID=17684473
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60284898A Expired - Lifetime JPH0710095B2 (en) | 1985-12-18 | 1985-12-18 | Luminance circuit |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0710095B2 (en) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2632071B2 (en) * | 1990-06-20 | 1997-07-16 | 三洋電機株式会社 | Liquid crystal display panel drive device |
-
1985
- 1985-12-18 JP JP60284898A patent/JPH0710095B2/en not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPS62143566A (en) | 1987-06-26 |
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