JPH07203205A - パルス幅及び位置変調システムにおけるピクセルのアドレス付け機能強化装置 - Google Patents
パルス幅及び位置変調システムにおけるピクセルのアドレス付け機能強化装置Info
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- JPH07203205A JPH07203205A JP6213712A JP21371294A JPH07203205A JP H07203205 A JPH07203205 A JP H07203205A JP 6213712 A JP6213712 A JP 6213712A JP 21371294 A JP21371294 A JP 21371294A JP H07203205 A JPH07203205 A JP H07203205A
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-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N1/00—Scanning, transmission or reproduction of documents or the like, e.g. facsimile transmission; Details thereof
- H04N1/40—Picture signal circuits
- H04N1/405—Halftoning, i.e. converting the picture signal of a continuous-tone original into a corresponding signal showing only two levels
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- G09G1/002—Intensity circuits
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Abstract
(57)【要約】
【目的】 パルス生成に用いるハードウェアの速度を上
げる必要なしに、あらかじめ定めたピクセル・クロック
周期内で多重パルスを選択的に生成する能力を有するパ
ルス幅及び位置変調システムを提供する。 【構成】 選択したクロック周期の間に発生されるべき
第一のパルスの先端エッジ遅延を規定する手段１２１
と、選択したクロック周期の間に発生されるべき第一の
パルスの尾端エッジ遅延を規定する手段１２３と、選択
したクロック周期の、先端エッジ遅延と尾端エッジ遅延
の間の部分に、第一のパルスを発生する手段１３１と、
クロック単位ごとに選択でき、第一のパルスを反転させ
て、選択したクロック周期の中で逆位相のパルスを生成
するための手段１４５とを含む、選択したクロック周期
の中で多重パルスを発生する装置。
げる必要なしに、あらかじめ定めたピクセル・クロック
周期内で多重パルスを選択的に生成する能力を有するパ
ルス幅及び位置変調システムを提供する。 【構成】 選択したクロック周期の間に発生されるべき
第一のパルスの先端エッジ遅延を規定する手段１２１
と、選択したクロック周期の間に発生されるべき第一の
パルスの尾端エッジ遅延を規定する手段１２３と、選択
したクロック周期の、先端エッジ遅延と尾端エッジ遅延
の間の部分に、第一のパルスを発生する手段１３１と、
クロック単位ごとに選択でき、第一のパルスを反転させ
て、選択したクロック周期の中で逆位相のパルスを生成
するための手段１４５とを含む、選択したクロック周期
の中で多重パルスを発生する装置。
Description
【０００１】
【産業上の利用分野】本発明は、一般にはディジタル画
像システムにおけるピクセルのアドレス付け機能を強化
する装置、さらに詳述すれば、逆位相ビデオ・パルスを
発生するディジタル・パルス幅及び位置変調器に関する
ものである。
像システムにおけるピクセルのアドレス付け機能を強化
する装置、さらに詳述すれば、逆位相ビデオ・パルスを
発生するディジタル・パルス幅及び位置変調器に関する
ものである。
【０００２】
【従来の技術】本発明は、情報を生成するのにビームを
用いる走査型出力システムにおいて、さらに特定すれ
ば、走査ビームを制御するのにディジタル・パルス生成
回路が用いられる場合に、使用することを目的とする。
このビームは、ビーム制御用のパルスに従って強度と持
続時間が変動し得るものである。例えばプリンタでは、
感光体上の諸領域を選択的に露光するのにレーザ・ビー
ムが用いられることがある。ビームの露光により感光体
上に形成された静電的潜像は、潜像の荷電レベルに比例
して現像用のトナーを吸着し、画像を現像する。もう一
つの例では、陰極線管は燐光スクリーンを走査するのに
電子線ビームを用いる。この電子線ビームは、燐光スク
リーン上に情報を正確に表示するために、強度と持続時
間を変化させられる。どちらの例でも、それぞれのビー
ムの強度と作用時間を制御するビデオ・パルスを生成す
るのに、パルス生成回路が用いられるであろう。
用いる走査型出力システムにおいて、さらに特定すれ
ば、走査ビームを制御するのにディジタル・パルス生成
回路が用いられる場合に、使用することを目的とする。
このビームは、ビーム制御用のパルスに従って強度と持
続時間が変動し得るものである。例えばプリンタでは、
感光体上の諸領域を選択的に露光するのにレーザ・ビー
ムが用いられることがある。ビームの露光により感光体
上に形成された静電的潜像は、潜像の荷電レベルに比例
して現像用のトナーを吸着し、画像を現像する。もう一
つの例では、陰極線管は燐光スクリーンを走査するのに
電子線ビームを用いる。この電子線ビームは、燐光スク
リーン上に情報を正確に表示するために、強度と持続時
間を変化させられる。どちらの例でも、それぞれのビー
ムの強度と作用時間を制御するビデオ・パルスを生成す
るのに、パルス生成回路が用いられるであろう。
【０００３】従来、レーザあるいはＣＲＴビームを制御
するためにパルスの位置及び幅を変化させるのには、種
々の方法と装置が用いられてきた。以下の特許明細書が
これに関連するものであろう。
するためにパルスの位置及び幅を変化させるのには、種
々の方法と装置が用いられてきた。以下の特許明細書が
これに関連するものであろう。
【０００４】オハラ（Ｏｈａｒａ）を権利者とする米国
特許第４，３４７，５２３号明細書は、入力信号を用い
て、対応するパルス幅選択番号をもってパルス番号にア
ドレス付けをするという全般的に関係がある装置を記述
している。
特許第４，３４７，５２３号明細書は、入力信号を用い
て、対応するパルス幅選択番号をもってパルス番号にア
ドレス付けをするという全般的に関係がある装置を記述
している。
【０００５】同じくオハラ（Ｏｈａｒａ）を権利者とす
る米国特許第４，３７５，０６５号明細書は、パルス番
号とパルス位置変調を用いてレーザ・ビームを制御する
という全般的に関係がある装置を記述している。
る米国特許第４，３７５，０６５号明細書は、パルス番
号とパルス位置変調を用いてレーザ・ビームを制御する
という全般的に関係がある装置を記述している。
【０００６】いずれもバセッティ（Ｂａｓｓｅｔｔｉ）
らを権利者として発行された米国特許第４，５４４，２
６４、米国特許第４，６２５，２２２号明細書は、レー
ザによる電子写真プリンタに用いるのに適した強化回路
を記述している。
らを権利者として発行された米国特許第４，５４４，２
６４、米国特許第４，６２５，２２２号明細書は、レー
ザによる電子写真プリンタに用いるのに適した強化回路
を記述している。
【０００７】ヨシダ（Ｙｏｓｈｉｄａ）を権利者とする
米国特許第４，６２６，９２３号明細書は、レーザの作
動時間が画像入力データとパルス幅変調回路の両方で制
御されるハーフトーン画像生成用画像処理装置を説明し
ている。
米国特許第４，６２６，９２３号明細書は、レーザの作
動時間が画像入力データとパルス幅変調回路の両方で制
御されるハーフトーン画像生成用画像処理装置を説明し
ている。
【０００８】スズキ（Ｓｕｚｕｋｉ）を権利者とする米
国特許第４，９０５，０２３号明細書は、パルスを発生
するのに入力ビデオ画像信号によりアドレス付けされる
複数の変換テーブルを用いる画像生成装置を記述してい
る。
国特許第４，９０５，０２３号明細書は、パルスを発生
するのに入力ビデオ画像信号によりアドレス付けされる
複数の変換テーブルを用いる画像生成装置を記述してい
る。
【０００９】デューク（Ｄｕｋｅ）らを権利者とする米
国特許第４，９６５，６７２号明細書は、レーザ・ビー
ムを制御するのに用いられるパルスの幅及び位置を変化
させる装置を記述している。
国特許第４，９６５，６７２号明細書は、レーザ・ビー
ムを制御するのに用いられるパルスの幅及び位置を変化
させる装置を記述している。
【００１０】サカノ（Ｓａｋａｎｏ）を権利者とする米
国特許第５，１４４，３３８号明細書は、光導電性ドラ
ム上の記録位置を制御するのにパルス幅変調レーザ・ビ
ームを使用する画像記録装置を記述している。
国特許第５，１４４，３３８号明細書は、光導電性ドラ
ム上の記録位置を制御するのにパルス幅変調レーザ・ビ
ームを使用する画像記録装置を記述している。
【００１１】チアンチオシ（Ｃｉａｎｃｉｏｓｉ）を権
利者とする米国特許第５，１８４，２２６号明細書は、
一連のデータワードからパルスを発生するディジタルシ
ステムを記述しており、その関係部分はここに参考とし
て取入れられている。
利者とする米国特許第５，１８４，２２６号明細書は、
一連のデータワードからパルスを発生するディジタルシ
ステムを記述しており、その関係部分はここに参考とし
て取入れられている。
【００１２】
【発明が解決しようとする課題】本発明の一つの目的
は、パルス生成に用いるハードウェアの速度を上げる必
要なしに、あらかじめ定めたピクセル・クロック周期内
で多重パルスを選択的に生成する能力を有するパルス幅
及び位置変調システムを提供することである。
は、パルス生成に用いるハードウェアの速度を上げる必
要なしに、あらかじめ定めたピクセル・クロック周期内
で多重パルスを選択的に生成する能力を有するパルス幅
及び位置変調システムを提供することである。
【００１３】本発明のもう一つの目的は、パルス幅及び
位置変調システムが、直前又は直後のクロック周期の中
で生成される隣接のパルスの延長を可能にするように、
あらかじめ定めたピクセル・クロック周期の始点と終点
にエッジを合せたパルスを選択的に生成できるようにす
ることである。
位置変調システムが、直前又は直後のクロック周期の中
で生成される隣接のパルスの延長を可能にするように、
あらかじめ定めたピクセル・クロック周期の始点と終点
にエッジを合せたパルスを選択的に生成できるようにす
ることである。
【００１４】
【課題を解決するための手段】本発明によれば、あらか
じめ定めたクロック周期内に多重パルスを発生する装置
が提供される。この装置は、あらかじめ定めたクロック
周期内に発生されるべき第一のパルスの先端エッジ遅延
を規定する手段、あらかじめ定めたクロック周期内に発
生されるべき第一のパルスの尾端エッジ遅延を規定する
手段、そのクロック周期の先端エッジ遅延と尾端エッジ
遅延の間の部分に第一のパルスを発生させる手段、及び
クロック周期単位に選択でき、選択したクロック周期の
中で第一のパルスを反転させて一対の逆位相にあるパル
スを生成する手段を包含する。
じめ定めたクロック周期内に多重パルスを発生する装置
が提供される。この装置は、あらかじめ定めたクロック
周期内に発生されるべき第一のパルスの先端エッジ遅延
を規定する手段、あらかじめ定めたクロック周期内に発
生されるべき第一のパルスの尾端エッジ遅延を規定する
手段、そのクロック周期の先端エッジ遅延と尾端エッジ
遅延の間の部分に第一のパルスを発生させる手段、及び
クロック周期単位に選択でき、選択したクロック周期の
中で第一のパルスを反転させて一対の逆位相にあるパル
スを生成する手段を包含する。
【００１５】本発明のもう一つの特長によれば、ピクセ
ルの境界を限定するあらかじめ定めたクロック周期の中
で複数のパルスを発生できるディジタル電子システムが
提供される。このシステムは、ピクセルの境界を超えて
パルスを延長する装置を含むもので、あらかじめ定めた
クロック周期の中で発生されるべき第一のパルスの先端
エッジ遅延を規定する手段、あらかじめ定めたクロック
周期の中で発生されるべき第一のパルスの尾端エッジ遅
延を規定する手段、そのクロック周期の先端エッジ遅延
と尾端エッジ遅延の間の部分に第一のパルスを発生させ
る手段、及びクロック周期単位に選択でき、選択したク
ロック周期の中で第一のパルスを反転させて、境界にエ
ッジを合せた一対の逆位相パルスを生成し、上記の境界
にエッジを合せたパルスがそれによって直前及び直後の
クロック周期に発生されたパルスを延長するものである
手段を包含する。
ルの境界を限定するあらかじめ定めたクロック周期の中
で複数のパルスを発生できるディジタル電子システムが
提供される。このシステムは、ピクセルの境界を超えて
パルスを延長する装置を含むもので、あらかじめ定めた
クロック周期の中で発生されるべき第一のパルスの先端
エッジ遅延を規定する手段、あらかじめ定めたクロック
周期の中で発生されるべき第一のパルスの尾端エッジ遅
延を規定する手段、そのクロック周期の先端エッジ遅延
と尾端エッジ遅延の間の部分に第一のパルスを発生させ
る手段、及びクロック周期単位に選択でき、選択したク
ロック周期の中で第一のパルスを反転させて、境界にエ
ッジを合せた一対の逆位相パルスを生成し、上記の境界
にエッジを合せたパルスがそれによって直前及び直後の
クロック周期に発生されたパルスを延長するものである
手段を包含する。
【００１６】本発明のさらにもう一つの特長によれば、
一連のデータワードからパルスを発生するディジタル電
子システムで、その一連のデータワードを一連のパルス
属性ワード(pulse attribute word)に変換し、ここにそ
れぞれのパルス属性ワードが一つのクロック周期内での
対応するパルスの形成を制御する情報を含むものである
手段、この一連のパルス属性ワードを二つのチャネルに
分割する手段、それぞれのチャネルからパルス属性ワー
ドを受け取り、パルス属性ワードの中のパルスの形成を
制御する情報を用いてパルスを形成する各チャネルに対
応する手段、第二のパルス形成手段からのパルスが形成
されている間に第一のパルス形成手段からのパルスが発
生されるパルス発生の手段、及び選択したクロック周期
の間に発生されたパルスを反転させて、選択した周期の
中で一対の逆位相にあるパルスを生成する手段を包含す
るものが提供される。
一連のデータワードからパルスを発生するディジタル電
子システムで、その一連のデータワードを一連のパルス
属性ワード(pulse attribute word)に変換し、ここにそ
れぞれのパルス属性ワードが一つのクロック周期内での
対応するパルスの形成を制御する情報を含むものである
手段、この一連のパルス属性ワードを二つのチャネルに
分割する手段、それぞれのチャネルからパルス属性ワー
ドを受け取り、パルス属性ワードの中のパルスの形成を
制御する情報を用いてパルスを形成する各チャネルに対
応する手段、第二のパルス形成手段からのパルスが形成
されている間に第一のパルス形成手段からのパルスが発
生されるパルス発生の手段、及び選択したクロック周期
の間に発生されたパルスを反転させて、選択した周期の
中で一対の逆位相にあるパルスを生成する手段を包含す
るものが提供される。
【００１７】
【実施例】図１は、出力源（図示せず）により生成され
たビデオ信号をプリントするのに使用されるであろうラ
スタ出力スキャナ(Raster Output Scanner) （ＲＯＳ）
を示す。ＲＯＳ１８には、よく使われる２種類の型、フ
ライイング・スポットＲＯＳとパルス画像生成ＲＯＳが
ある。どちらの場合も、レーザ２２から放射されるレー
ザ・ビーム２０は、変調器２５を有する整調用(conditi
oning)光学系２４に入る。変調器２５は、ＲＯＳ１８に
供給されるビデオ信号に応じて定まる正確な長さの時間
の間、レーザ・ビームを遮ったり、そらせたりするか、
あるいはビームが整調用光学系を通り抜けて回転する多
面鏡２８の面２６を照射するようにする。レーザ２２
は、ヘリウム／ネオン・レーザでもレーザ・ダイオード
でもよい。後者の場合、変調器２５によるよりもむしろ
ビデオ・データが直接レーザを変調することとなろう。
また、本発明の実施には、一つ以上のレーザ源２２すな
わちビーム２０を使用することもできる。
たビデオ信号をプリントするのに使用されるであろうラ
スタ出力スキャナ(Raster Output Scanner) （ＲＯＳ）
を示す。ＲＯＳ１８には、よく使われる２種類の型、フ
ライイング・スポットＲＯＳとパルス画像生成ＲＯＳが
ある。どちらの場合も、レーザ２２から放射されるレー
ザ・ビーム２０は、変調器２５を有する整調用(conditi
oning)光学系２４に入る。変調器２５は、ＲＯＳ１８に
供給されるビデオ信号に応じて定まる正確な長さの時間
の間、レーザ・ビームを遮ったり、そらせたりするか、
あるいはビームが整調用光学系を通り抜けて回転する多
面鏡２８の面２６を照射するようにする。レーザ２２
は、ヘリウム／ネオン・レーザでもレーザ・ダイオード
でもよい。後者の場合、変調器２５によるよりもむしろ
ビデオ・データが直接レーザを変調することとなろう。
また、本発明の実施には、一つ以上のレーザ源２２すな
わちビーム２０を使用することもできる。
【００１８】レーザ・ビーム２０は、面２６から反射し
た後、整調用光学系３０を通過して感光性画像面３２上
にスポット２１を形成する。鏡面が回転するので、レー
ザ・スポット２１は、線３４に沿って画像面を横切って
走査する。線３４は、矢印３６で示す一般に高速走査方
向と呼ばれる方向にある。さらに、鏡面２６が回転する
に従い、画像面３２は、矢印３８で示すように高速走査
方向に事実上直角の低速走査方向に移動する。低速走査
方向への移動は、多面鏡の順次現れる回転面を低速走査
方向に互いにずれて順次並ぶ走査線３４に対応させるも
のである。
た後、整調用光学系３０を通過して感光性画像面３２上
にスポット２１を形成する。鏡面が回転するので、レー
ザ・スポット２１は、線３４に沿って画像面を横切って
走査する。線３４は、矢印３６で示す一般に高速走査方
向と呼ばれる方向にある。さらに、鏡面２６が回転する
に従い、画像面３２は、矢印３８で示すように高速走査
方向に事実上直角の低速走査方向に移動する。低速走査
方向への移動は、多面鏡の順次現れる回転面を低速走査
方向に互いにずれて順次並ぶ走査線３４に対応させるも
のである。
【００１９】それぞれの走査線３４は、ピクセル４０の
列から成り、これらのピクセルは、レーザ・スポット２
１が画像面を横切って走査するのに従って、レーザ・ビ
ームの変調により生成される。ビーム２０が走査線を横
切って走査すると、ピクセル・スポット２１は、ＲＯＳ
に供給されたビデオ信号に従って個々のピクセルを照射
したり、照射しなかったりする。一般に、ビデオ信号は
バイナリ・パルスの直列の流れという性質のものであっ
て、論理１すなわちパルスはビームが表面を照射するこ
とを意味し、論理０すなわちパルスなしは照射なしとい
うことになる。
列から成り、これらのピクセルは、レーザ・スポット２
１が画像面を横切って走査するのに従って、レーザ・ビ
ームの変調により生成される。ビーム２０が走査線を横
切って走査すると、ピクセル・スポット２１は、ＲＯＳ
に供給されたビデオ信号に従って個々のピクセルを照射
したり、照射しなかったりする。一般に、ビデオ信号は
バイナリ・パルスの直列の流れという性質のものであっ
て、論理１すなわちパルスはビームが表面を照射するこ
とを意味し、論理０すなわちパルスなしは照射なしとい
うことになる。
【００２０】どちらの型のＲＯＳでも、ピクセル４０の
幅はＲＯＳ１８に供給されるビデオ信号の中の対応する
論理１パルスの期間すなわち持続時間により定まる。走
査スポット型ＲＯＳでは、パルスの先端エッジ、例えば
図２Ａのエッジ５０において、変調器２５がレーザ・ビ
ーム２０を画像面上に向け通過させる。パルスの持続す
る間、楕円形のレーザ・スポット２１が画像面３２を横
切って走査し、走査線３４の中に少なくも１個のアドレ
ス付けされたピクセル４０を照射する。高速走査方向の
中で照射される領域の幅は、従って、ビデオ・パルスの
持続時間とともにレーザ・スポット２１の幅と走査速度
にも依存する。普通、レーザ・スポットの形状は、低速
走査方向の高さが高速走査方向の幅に対して２−３倍に
なっている。例えば、６００ｓｐｉ、１３５ｐｐｍのデ
ュアル・ビーム・プリンタでは、レーザ・スポットはお
およそ高さ４３μｍ、幅２０μｍで、１個のピクセル４
０の幅を横切って走査するのに要する時間の長さは約１
５ナノ秒である。
幅はＲＯＳ１８に供給されるビデオ信号の中の対応する
論理１パルスの期間すなわち持続時間により定まる。走
査スポット型ＲＯＳでは、パルスの先端エッジ、例えば
図２Ａのエッジ５０において、変調器２５がレーザ・ビ
ーム２０を画像面上に向け通過させる。パルスの持続す
る間、楕円形のレーザ・スポット２１が画像面３２を横
切って走査し、走査線３４の中に少なくも１個のアドレ
ス付けされたピクセル４０を照射する。高速走査方向の
中で照射される領域の幅は、従って、ビデオ・パルスの
持続時間とともにレーザ・スポット２１の幅と走査速度
にも依存する。普通、レーザ・スポットの形状は、低速
走査方向の高さが高速走査方向の幅に対して２−３倍に
なっている。例えば、６００ｓｐｉ、１３５ｐｐｍのデ
ュアル・ビーム・プリンタでは、レーザ・スポットはお
およそ高さ４３μｍ、幅２０μｍで、１個のピクセル４
０の幅を横切って走査するのに要する時間の長さは約１
５ナノ秒である。
【００２１】普通は、ＲＯＳを駆動するのに用いるビデ
オ・データは、各ピクセルが露光される時間（以下ピク
セル・クロック周期という）が同一となるようクロック
同調されている。さらに、変調器を駆動するビデオ信号
パルスを発生するビデオ・データも、ＲＯＳ１８と画像
面３２の低速走査方向への移動に同調されており、それ
によってビデオ・データの特定のビットを画像面３２の
適切な部分にアドレス付けできるようにしている。ビデ
オ・データ、それから生成されるビデオ信号パルス、Ｒ
ＯＳ及び画像面の同調は、ピクセルが画像面に露光され
るべき速度に相当するシステム・クロックを用いて達成
される。より速いクロックならビデオ・パルスの流れの
中でよりよい解像度が得られるが、周波数が高くなるの
でビデオ処理経路の中でのハードウェアをより高速にす
るためにコストが増加する。
オ・データは、各ピクセルが露光される時間（以下ピク
セル・クロック周期という）が同一となるようクロック
同調されている。さらに、変調器を駆動するビデオ信号
パルスを発生するビデオ・データも、ＲＯＳ１８と画像
面３２の低速走査方向への移動に同調されており、それ
によってビデオ・データの特定のビットを画像面３２の
適切な部分にアドレス付けできるようにしている。ビデ
オ・データ、それから生成されるビデオ信号パルス、Ｒ
ＯＳ及び画像面の同調は、ピクセルが画像面に露光され
るべき速度に相当するシステム・クロックを用いて達成
される。より速いクロックならビデオ・パルスの流れの
中でよりよい解像度が得られるが、周波数が高くなるの
でビデオ処理経路の中でのハードウェアをより高速にす
るためにコストが増加する。
【００２２】本実施例においては、プリントすべき画像
を表すビデオ・データに対応するビデオ信号パルスを形
成するのに、パルス幅・位置・振幅変調器（パルス変調
器）が用いられる。図２Ａ〜図５を参照すると、以下の
パルス変調器の説明は単色出力についてのものである
が、本発明をそのような方式への適用に限る意図はない
ものであることを特記する。
を表すビデオ・データに対応するビデオ信号パルスを形
成するのに、パルス幅・位置・振幅変調器（パルス変調
器）が用いられる。図２Ａ〜図５を参照すると、以下の
パルス変調器の説明は単色出力についてのものである
が、本発明をそのような方式への適用に限る意図はない
ものであることを特記する。
【００２３】図２Ａ、図３Ａは、パルス変調器のパルス
形成の全般的な仕組みを示す。図２Ａ、図３Ａは、さら
に、本発明により発生される第一のすなわち一次のビデ
オ・パルス信号のパルス特性の例を示す。これらの図に
描かれた二つのパルスに示されるように、ピクセル・ク
ロック周期５４の中のパルス５２の幅と位置は、個別
に、独立して変化させ得るパルス５２の先端エッジ遅延
５６とトレイリング・エッジ遅延５８によって変えるこ
とができる。先端エッジ遅延５６は、ピクセル周期６０
の始点からパルスの先端エッジ５０までと定義される。
トレイリング・エッジ遅延５８は、ピクセル周期６０の
始点からパルスの尾端エッジ６２までと定義される。通
常の操作モードでは、パルス５２は、チアンチオシ（Ｃ
ｉａｎｃｉｏｓｉ）を権利者として１９９３年２月２日
に発行され、その関係部分がここに参考として取入れら
れている米国特許第５，１８４，２２６号明細書に記述
されているように、対応するデータワードの中の情報に
対応して発生されることになる。
形成の全般的な仕組みを示す。図２Ａ、図３Ａは、さら
に、本発明により発生される第一のすなわち一次のビデ
オ・パルス信号のパルス特性の例を示す。これらの図に
描かれた二つのパルスに示されるように、ピクセル・ク
ロック周期５４の中のパルス５２の幅と位置は、個別
に、独立して変化させ得るパルス５２の先端エッジ遅延
５６とトレイリング・エッジ遅延５８によって変えるこ
とができる。先端エッジ遅延５６は、ピクセル周期６０
の始点からパルスの先端エッジ５０までと定義される。
トレイリング・エッジ遅延５８は、ピクセル周期６０の
始点からパルスの尾端エッジ６２までと定義される。通
常の操作モードでは、パルス５２は、チアンチオシ（Ｃ
ｉａｎｃｉｏｓｉ）を権利者として１９９３年２月２日
に発行され、その関係部分がここに参考として取入れら
れている米国特許第５，１８４，２２６号明細書に記述
されているように、対応するデータワードの中の情報に
対応して発生されることになる。
【００２４】一般に、それぞれのパルス５２は、対応す
るデータワードの中の情報に従って形成される。パルス
変調器（図示せず）に一連のデータワードが入力され、
それぞれのデータワードは、逐次、一組のパルス属性ワ
ードに変換される。それぞれのパルス属性ワードは、パ
ルス変調器によって形成されるべき対応するパルスの特
性に対応する。このように、それぞれのデータワードが
パルスを形成する情報を含む。
るデータワードの中の情報に従って形成される。パルス
変調器（図示せず）に一連のデータワードが入力され、
それぞれのデータワードは、逐次、一組のパルス属性ワ
ードに変換される。それぞれのパルス属性ワードは、パ
ルス変調器によって形成されるべき対応するパルスの特
性に対応する。このように、それぞれのデータワードが
パルスを形成する情報を含む。
【００２５】次に、図４を参照して、パルス変調器の構
成を説明する。一つのピクセル当りそれぞれｎビットで
本実施例ではｎが８である一連のデータワードが、ビデ
オ又はコンピュータのメモリや画像スキャナなどの画像
源１０１からパルス変調器に入力される。この一連のデ
ータワードは、別々の色について同様のビデオ情報処理
が行われるカラー・プリントの場合などの並行処理のた
めには、ビデオ拡張(expansion) ポート１０３を通して
もう一つのパルス変調器（図示せず）に送られることも
ある。
成を説明する。一つのピクセル当りそれぞれｎビットで
本実施例ではｎが８である一連のデータワードが、ビデ
オ又はコンピュータのメモリや画像スキャナなどの画像
源１０１からパルス変調器に入力される。この一連のデ
ータワードは、別々の色について同様のビデオ情報処理
が行われるカラー・プリントの場合などの並行処理のた
めには、ビデオ拡張(expansion) ポート１０３を通して
もう一つのパルス変調器（図示せず）に送られることも
ある。
【００２６】本発明はさらに、変換手段、分割手段、パ
ルス形成手段及び発生手段を含む。図４のパルス変調器
においては、一連のデータワードの中の一つがＲＡＭア
ドレス・マルチプレクサ１０５を通して変換手段に送ら
れる。この実施例に見られるように、変換手段は、四つ
のＲＡＭルックアップテーブル１０７、１０９、１１１
及び１１３を包含する。それぞれのデータワードは、四
つのＲＡＭルックアップテーブル１０７、１０９、１１
１及び１１３の中の一つのアドレスを表す。望ましい実
施例においては、制御しようとするそれぞれのパルス特
性に対し一つのパルス属性ワードを発生するのに、一対
の２５６×４ＥＣＬ ＲＡＭが使用される。
ルス形成手段及び発生手段を含む。図４のパルス変調器
においては、一連のデータワードの中の一つがＲＡＭア
ドレス・マルチプレクサ１０５を通して変換手段に送ら
れる。この実施例に見られるように、変換手段は、四つ
のＲＡＭルックアップテーブル１０７、１０９、１１１
及び１１３を包含する。それぞれのデータワードは、四
つのＲＡＭルックアップテーブル１０７、１０９、１１
１及び１１３の中の一つのアドレスを表す。望ましい実
施例においては、制御しようとするそれぞれのパルス特
性に対し一つのパルス属性ワードを発生するのに、一対
の２５６×４ＥＣＬ ＲＡＭが使用される。
【００２７】パルス属性は、形成すべきパルスの先端エ
ッジ遅延、尾端エッジ遅延、振幅、及び本発明に関連し
て説明されるように、選択したピクセルの反転又は多重
パルスなど、その他の特徴を含む。別法として、それぞ
れのパルス属性ワードを発生するのに、一つの２５６×
８ＥＣＬ ＲＡＭルックアップテーブルを用いることも
できる。図４の実施例は、先端エッジ遅延と尾端エッジ
遅延の二つのパルス属性に対応する二対の２５６×４Ｅ
ＣＬ ＲＡＭルックアップテーブル１０７、１０９、１
１１及び１１３を示す。パルス変調器は、所望のパルス
属性があるだけの数の対の２５６×４ＲＡＭルックアッ
プテーブルを備えるものである。例えば、形成すべきパ
ルスの振幅を制御するには、第三の対の２５６×４ＲＡ
Ｍルックアップテーブルが使用されることになろう。別
法として、反転パルスを生成するのに、ルックアップテ
ーブルの中の一連のＲＡＭアドレスを割当てることがで
きる。例えば、アドレス６４−１２７は、テーブルのこ
れらの位置からのデータ出力に対応して生成されるパル
スは反転されたものになるというように復号(decode)さ
れるであろう。あるいはまた、反転パルスの生成には、
もっと大きなあるいは小さなアドレス番号が用いられす
なわち割当てられることもある。
ッジ遅延、尾端エッジ遅延、振幅、及び本発明に関連し
て説明されるように、選択したピクセルの反転又は多重
パルスなど、その他の特徴を含む。別法として、それぞ
れのパルス属性ワードを発生するのに、一つの２５６×
８ＥＣＬ ＲＡＭルックアップテーブルを用いることも
できる。図４の実施例は、先端エッジ遅延と尾端エッジ
遅延の二つのパルス属性に対応する二対の２５６×４Ｅ
ＣＬ ＲＡＭルックアップテーブル１０７、１０９、１
１１及び１１３を示す。パルス変調器は、所望のパルス
属性があるだけの数の対の２５６×４ＲＡＭルックアッ
プテーブルを備えるものである。例えば、形成すべきパ
ルスの振幅を制御するには、第三の対の２５６×４ＲＡ
Ｍルックアップテーブルが使用されることになろう。別
法として、反転パルスを生成するのに、ルックアップテ
ーブルの中の一連のＲＡＭアドレスを割当てることがで
きる。例えば、アドレス６４−１２７は、テーブルのこ
れらの位置からのデータ出力に対応して生成されるパル
スは反転されたものになるというように復号(decode)さ
れるであろう。あるいはまた、反転パルスの生成には、
もっと大きなあるいは小さなアドレス番号が用いられす
なわち割当てられることもある。
【００２８】それぞれのＲＡＭルックアップテーブルの
一つのアドレスがデータワードによりアクセスされる
と、それぞれのＲＡＭルックアップテーブルは一塊（４
ビット）の情報を発生する。こうして、各対のＲＡＭル
ックアップテーブルは、制御すべきパルス属性に対応す
るパルス属性ワード（８ビット）を発生する。８ビット
での実施が望ましいが、これは制約ではなく、パルス属
性ワードはどんなビット数（すなわち、４、６、８、１
０、１２など）でもよい。
一つのアドレスがデータワードによりアクセスされる
と、それぞれのＲＡＭルックアップテーブルは一塊（４
ビット）の情報を発生する。こうして、各対のＲＡＭル
ックアップテーブルは、制御すべきパルス属性に対応す
るパルス属性ワード（８ビット）を発生する。８ビット
での実施が望ましいが、これは制約ではなく、パルス属
性ワードはどんなビット数（すなわち、４、６、８、１
０、１２など）でもよい。
【００２９】パルス変調器の中で制御すべきパルス属性
データを表す特性データは、ルックアップテーブルダウ
ンロード・インタフェース１１５からＲＡＭルックアッ
プテーブル１０７、１０９、１１１及び１１３にダウン
ロードされることとなろう。ルックアップテーブルダウ
ンロード・インタフェース１１５がＲＡＭルックアップ
テーブルのあるアドレスにアクセスすると、パルス属性
データの塊がルックアップテーブルダウンロード・イン
タフェース１１５からルックアップテーブルデータ・バ
ス１１７を通りＲＡＭルックアップテーブルにロードさ
れることとなろう。これにより、同一のパルス変調器の
中で異なるプリンティング特性（例えば、フォントのス
ムージング、グラフィックスなど）に対して異なるマッ
ピング機能を果たさせることができ、また、システムの
構成部品が老化してもプリントの品質維持を容易にす
る。ＲＡＭルックアップテーブル１０７、１０９、１１
１及び１１３がロードされたら、ルックアップテーブル
ダウンロード・インタフェース１１５は、ＲＡＭアドレ
ス・マルチプレクサ１０５にビデオ・データ・バス１１
９からデータを受けるように指示する。
データを表す特性データは、ルックアップテーブルダウ
ンロード・インタフェース１１５からＲＡＭルックアッ
プテーブル１０７、１０９、１１１及び１１３にダウン
ロードされることとなろう。ルックアップテーブルダウ
ンロード・インタフェース１１５がＲＡＭルックアップ
テーブルのあるアドレスにアクセスすると、パルス属性
データの塊がルックアップテーブルダウンロード・イン
タフェース１１５からルックアップテーブルデータ・バ
ス１１７を通りＲＡＭルックアップテーブルにロードさ
れることとなろう。これにより、同一のパルス変調器の
中で異なるプリンティング特性（例えば、フォントのス
ムージング、グラフィックスなど）に対して異なるマッ
ピング機能を果たさせることができ、また、システムの
構成部品が老化してもプリントの品質維持を容易にす
る。ＲＡＭルックアップテーブル１０７、１０９、１１
１及び１１３がロードされたら、ルックアップテーブル
ダウンロード・インタフェース１１５は、ＲＡＭアドレ
ス・マルチプレクサ１０５にビデオ・データ・バス１１
９からデータを受けるように指示する。
【００３０】図４の実施例においては、四つのＲＡＭル
ックアップテーブル１０７、１０９、１１１及び１１３
が論理的マッピング機能を果たしており、この機能が入
ってくるデータワードをパルスの形成を制御するための
二つのパルス属性ワードに変換する。図４では、上の二
つのＲＡＭルックアップテーブル１０７と１０９が別々
のパルス属性情報の塊を発生し、これらが結合して形成
すべきパルスの先端エッジ遅延に関するパルス属性ワー
ドを形成する。下の二つのＲＡＭルックアップテーブル
１１１と１１３は別々のパルス属性情報の塊を発生し、
これらが結合して、形成すべきパルスの尾端エッジ遅延
に関するパルス属性ワードを形成する。
ックアップテーブル１０７、１０９、１１１及び１１３
が論理的マッピング機能を果たしており、この機能が入
ってくるデータワードをパルスの形成を制御するための
二つのパルス属性ワードに変換する。図４では、上の二
つのＲＡＭルックアップテーブル１０７と１０９が別々
のパルス属性情報の塊を発生し、これらが結合して形成
すべきパルスの先端エッジ遅延に関するパルス属性ワー
ドを形成する。下の二つのＲＡＭルックアップテーブル
１１１と１１３は別々のパルス属性情報の塊を発生し、
これらが結合して、形成すべきパルスの尾端エッジ遅延
に関するパルス属性ワードを形成する。
【００３１】それぞれのパルス属性ワードは、ラッチ付
きマルチプレクサのブロック１２１、１２３を包含する
それぞれの分割手段に送入される。望ましい実施例で
は、それぞれのラッチ付きマルチプレクサのブロック
は、フェーズ１とフェーズ２のバスのそれぞれに一つず
つ、二つのラッチを有する。ＲＡＭルックアップテーブ
ル１０７、１０９、１１１及び１１３でデータワードか
ら発生された二つのパルス属性ワードは、フェーズ１ビ
デオ・クロック１３５からのパルスの先端エッジの所
で、それぞれのマルチプレクサ１２１、１２３によって
フェーズ１バス上に、ラッチされる。
きマルチプレクサのブロック１２１、１２３を包含する
それぞれの分割手段に送入される。望ましい実施例で
は、それぞれのラッチ付きマルチプレクサのブロック
は、フェーズ１とフェーズ２のバスのそれぞれに一つず
つ、二つのラッチを有する。ＲＡＭルックアップテーブ
ル１０７、１０９、１１１及び１１３でデータワードか
ら発生された二つのパルス属性ワードは、フェーズ１ビ
デオ・クロック１３５からのパルスの先端エッジの所
で、それぞれのマルチプレクサ１２１、１２３によって
フェーズ１バス上に、ラッチされる。
【００３２】それぞれのフェーズ１バス１２５、１２７
上にラッチされた二つのデータワードは、次いで、別々
のチャネルで、それぞれのチャネルに対応するパルス形
成手段により処理される。ここに示すように、パルス形
成手段は、個別の先端エッジ遅延パルスと尾端エッジ遅
延パルスを形成する遅延論理ブロック１２９とビデオ・
パルス形成論理ブロック１３１を包含する。ビデオ・パ
ルス形成論理ブロック１３１は、発生手段を包含し、先
端エッジ遅延パルスと尾端エッジ遅延パルスから一つの
パルスを形成する。ビデオ・パルス形成論理ブロック１
３１内での第一のすなわち通常のパルス発生の後、その
パルスは結合論理ブロック１４９の制御のもとに反転さ
れることもある。
上にラッチされた二つのデータワードは、次いで、別々
のチャネルで、それぞれのチャネルに対応するパルス形
成手段により処理される。ここに示すように、パルス形
成手段は、個別の先端エッジ遅延パルスと尾端エッジ遅
延パルスを形成する遅延論理ブロック１２９とビデオ・
パルス形成論理ブロック１３１を包含する。ビデオ・パ
ルス形成論理ブロック１３１は、発生手段を包含し、先
端エッジ遅延パルスと尾端エッジ遅延パルスから一つの
パルスを形成する。ビデオ・パルス形成論理ブロック１
３１内での第一のすなわち通常のパルス発生の後、その
パルスは結合論理ブロック１４９の制御のもとに反転さ
れることもある。
【００３３】図５に記載した望ましい実施例に示すよう
に、結合論理ブロック１４９はＸＯＲゲートであっても
よい。ビデオ結合論理ブロック１４９は、反転制御ライ
ンに論理０が存在すれば、ビデオ・パルス形成論理ブロ
ック１３１からのビデオ信号を変化させずに通過させ
る。反対に、ビデオ・パルス反転制御ブロック１４５が
反転制御ラインに論理１を生成させたときはいつでも、
ブロック１３１からのビデオ・パルス信号は反転され、
一対のビデオ・パルスを形成する。
に、結合論理ブロック１４９はＸＯＲゲートであっても
よい。ビデオ結合論理ブロック１４９は、反転制御ライ
ンに論理０が存在すれば、ビデオ・パルス形成論理ブロ
ック１３１からのビデオ信号を変化させずに通過させ
る。反対に、ビデオ・パルス反転制御ブロック１４５が
反転制御ラインに論理１を生成させたときはいつでも、
ブロック１３１からのビデオ・パルス信号は反転され、
一対のビデオ・パルスを形成する。
【００３４】単一相のビデオ・クロックとそれにフェー
ズ合せした対応するバスの組だけを有する典型的な走査
システムの速度は、その遅延及びパルス形成論理１２
９、１３１がパルス属性ワードを受けて作動し、次ぎに
新しいパルス属性ワードを受けるようリセットされるこ
とができる速度に制約されることに注目されたい。フェ
ーズ１ビデオ・クロック１３５とフェーズ１バス１２
５、１２７だけを有する図４に示す実施例では、遅延及
びパルス形成論理ブロック１２９、１３１がパルス変調
器の処理速度を制約するであろう。詳述すれば、第一の
データワードに対応する二つのパルス属性ワードが遅延
及びパルス形成論理ブロック１２９、１３１で処理され
ている間に、第二のデータワードに対応する第二の組の
パルス属性ワードがすでに形成されて、それぞれのラッ
チ付きマルチプレクサのブロック１２１、１２３で、フ
ェーズ１バス１２５、１２７にラッチされ、遅延及びパ
ルス形成論理１２９、１３１で処理されるのを待ってい
ることになろう。
ズ合せした対応するバスの組だけを有する典型的な走査
システムの速度は、その遅延及びパルス形成論理１２
９、１３１がパルス属性ワードを受けて作動し、次ぎに
新しいパルス属性ワードを受けるようリセットされるこ
とができる速度に制約されることに注目されたい。フェ
ーズ１ビデオ・クロック１３５とフェーズ１バス１２
５、１２７だけを有する図４に示す実施例では、遅延及
びパルス形成論理ブロック１２９、１３１がパルス変調
器の処理速度を制約するであろう。詳述すれば、第一の
データワードに対応する二つのパルス属性ワードが遅延
及びパルス形成論理ブロック１２９、１３１で処理され
ている間に、第二のデータワードに対応する第二の組の
パルス属性ワードがすでに形成されて、それぞれのラッ
チ付きマルチプレクサのブロック１２１、１２３で、フ
ェーズ１バス１２５、１２７にラッチされ、遅延及びパ
ルス形成論理１２９、１３１で処理されるのを待ってい
ることになろう。
【００３５】代表的な信号を図示した図２Ａ、Ｂ、図３
Ａ、Ｂを再び参照すると、図２Ａ、図３Ａは、ビデオ・
パルス形成論理ブロック１３１からの第一のすなわち通
常のビデオ・パルス信号出力を表すことを目的とする。
前述したように、パルス５２は、ＲＡＭルックアップテ
ーブルに記憶した先端及び尾端エッジ遅延により定義さ
れる位置と幅を有している。図２Ａ、図２Ｂは、完全に
クロック周期５４の中にあるパルス５２を示している
が、パルスは、クロック周期の境界にエッジを合せるよ
うに延長されることもできる。さらに、同じ「通常の」
ビデオ・パルスが、図２Ｂ、図３Ｂに６０、６１として
示したピクセル・クロックのそれぞれの境界にエッジを
合せた一つ又は二つの逆位相すなわち反転パルス７０、
７２を生成するのに用いられることもある。これらは同
じピクセル周期５４上で定義してあるので、逆位相パル
ス７０、７２の特性も前述したパルス属性ワードで直接
制御することができる。
Ａ、Ｂを再び参照すると、図２Ａ、図３Ａは、ビデオ・
パルス形成論理ブロック１３１からの第一のすなわち通
常のビデオ・パルス信号出力を表すことを目的とする。
前述したように、パルス５２は、ＲＡＭルックアップテ
ーブルに記憶した先端及び尾端エッジ遅延により定義さ
れる位置と幅を有している。図２Ａ、図２Ｂは、完全に
クロック周期５４の中にあるパルス５２を示している
が、パルスは、クロック周期の境界にエッジを合せるよ
うに延長されることもできる。さらに、同じ「通常の」
ビデオ・パルスが、図２Ｂ、図３Ｂに６０、６１として
示したピクセル・クロックのそれぞれの境界にエッジを
合せた一つ又は二つの逆位相すなわち反転パルス７０、
７２を生成するのに用いられることもある。これらは同
じピクセル周期５４上で定義してあるので、逆位相パル
ス７０、７２の特性も前述したパルス属性ワードで直接
制御することができる。
【００３６】ビデオ反転手段の詳細が図示されている図
７〜図９とともに、図６も参照すれば、反転論理ブロッ
ク１４５が、ライン２１０上の反転制御信号のタイミン
グをビデオ・パルス形成論理ブロック１３１によるビデ
オ・パルス信号出力と正確に同調させるように設計され
ていることを見て取ることができる。さらに詳述すれ
ば、ビデオ出力信号をピクセル境界に合せるよう正確な
制御を確実に行うためには、反転制御ライン２１０に提
供される選択信号がビデオ信号に同調して生成されるこ
とが必要である。図示のように、ビデオ・パルス反転論
理ブロック１４５は、パルス復号ブロック２１２、一対
のパルスずれ調整ブロック２１４、２１６、及び対応す
る一対の反転ブロック２１８、２２０から成る。パルス
復号ブロック２１２は、所望の逆位相パルスを生成する
のにどのパルスを選択的に反転すべきかを判断するため
に、ＲＡＭアドレス・バスからのビデオ・データ信号を
検出し復号するためのものである。さらに詳述すれば、
必要な同調は、ブロック２１２に入力されるＡラッチ・
クロツクとＢラッチ・クロックの信号を用い、反転論理
ブロック内でのタイミング遅延を開始させることで達成
される。反転ブロックを始動させるのには、復号１と復
号２の信号が使われる。一つの実施例では、ＲＯＭルッ
クアップテーブルに入力されている８ビット・ビデオ・
アドレスの二つの最上位ビット（Ａ６とＡ７）が、復号
１と復号２として用いられるであろう。このようにし
て、ルックアップテーブルの上位１２８個のアドレスが
アクセスされたときはいつでも、反転ブロックが始動さ
れる。次いで、Ａ及びＢフェーズのパルスは、ゲート遅
延など、反転パルス経路と非反転パルス経路との間のタ
イミングのずれを補償するために、ずれ調整ブロック２
１４、２１６（例えば、プログラマブル遅延回路）を通
される。ずれ調整ブロック２１４、２１６はいずれも、
本実施例におけるパルス幅及び位置変調チャネル（Ａと
Ｂ）の間のいかなるタイミングのずれをも調整するため
のものである。遅延機構２１７、２１９で遅延（図８、
９のＤ１、Ｄ２）を作るには、プログラマブル・ヘクス
・スイッチ(programable hex switch)が用いられる。ず
れ調整ブロックはいずれも、反転ビデオ出力パルスを非
反転ビデオ出力パルスと適切な位置関係に揃える回路を
有する。さらに詳述すれば、反転パルスの立上りエッジ
はプログラムされた遅延が０である非反転パルスのエッ
ジに揃えられる。最後に、反転ブロック２１８、２２０
は、ブロック２１４、２１６でそれぞれ生成された復号
パルス信号とずれ調整信号を捕らえて、ずれ調整済みの
反転制御信号を生成し、これが、逆位相デュアル・パル
ス・ビデオ出力を選択的に生成するために、結合論理ブ
ロック１４９でビデオ・パルスと結合されるであろう。
７〜図９とともに、図６も参照すれば、反転論理ブロッ
ク１４５が、ライン２１０上の反転制御信号のタイミン
グをビデオ・パルス形成論理ブロック１３１によるビデ
オ・パルス信号出力と正確に同調させるように設計され
ていることを見て取ることができる。さらに詳述すれ
ば、ビデオ出力信号をピクセル境界に合せるよう正確な
制御を確実に行うためには、反転制御ライン２１０に提
供される選択信号がビデオ信号に同調して生成されるこ
とが必要である。図示のように、ビデオ・パルス反転論
理ブロック１４５は、パルス復号ブロック２１２、一対
のパルスずれ調整ブロック２１４、２１６、及び対応す
る一対の反転ブロック２１８、２２０から成る。パルス
復号ブロック２１２は、所望の逆位相パルスを生成する
のにどのパルスを選択的に反転すべきかを判断するため
に、ＲＡＭアドレス・バスからのビデオ・データ信号を
検出し復号するためのものである。さらに詳述すれば、
必要な同調は、ブロック２１２に入力されるＡラッチ・
クロツクとＢラッチ・クロックの信号を用い、反転論理
ブロック内でのタイミング遅延を開始させることで達成
される。反転ブロックを始動させるのには、復号１と復
号２の信号が使われる。一つの実施例では、ＲＯＭルッ
クアップテーブルに入力されている８ビット・ビデオ・
アドレスの二つの最上位ビット（Ａ６とＡ７）が、復号
１と復号２として用いられるであろう。このようにし
て、ルックアップテーブルの上位１２８個のアドレスが
アクセスされたときはいつでも、反転ブロックが始動さ
れる。次いで、Ａ及びＢフェーズのパルスは、ゲート遅
延など、反転パルス経路と非反転パルス経路との間のタ
イミングのずれを補償するために、ずれ調整ブロック２
１４、２１６（例えば、プログラマブル遅延回路）を通
される。ずれ調整ブロック２１４、２１６はいずれも、
本実施例におけるパルス幅及び位置変調チャネル（Ａと
Ｂ）の間のいかなるタイミングのずれをも調整するため
のものである。遅延機構２１７、２１９で遅延（図８、
９のＤ１、Ｄ２）を作るには、プログラマブル・ヘクス
・スイッチ(programable hex switch)が用いられる。ず
れ調整ブロックはいずれも、反転ビデオ出力パルスを非
反転ビデオ出力パルスと適切な位置関係に揃える回路を
有する。さらに詳述すれば、反転パルスの立上りエッジ
はプログラムされた遅延が０である非反転パルスのエッ
ジに揃えられる。最後に、反転ブロック２１８、２２０
は、ブロック２１４、２１６でそれぞれ生成された復号
パルス信号とずれ調整信号を捕らえて、ずれ調整済みの
反転制御信号を生成し、これが、逆位相デュアル・パル
ス・ビデオ出力を選択的に生成するために、結合論理ブ
ロック１４９でビデオ・パルスと結合されるであろう。
【００３７】
【発明の効果】概括すれば、本発明は、パルス幅及び位
置の変調信号を用いるシステムのアドレス付け機能を改
善する装置である。本発明は、クロック制御したピクセ
ルの境界を超えて延長するパルスを有するビデオ信号の
選択的発生を可能にする。通常のパルス幅及び位置変調
ビデオ・パルスに対する逆位相成分を発生することによ
って、ピクセル・クロックの境界にエッジを合せた一対
のパルスが生成される。
置の変調信号を用いるシステムのアドレス付け機能を改
善する装置である。本発明は、クロック制御したピクセ
ルの境界を超えて延長するパルスを有するビデオ信号の
選択的発生を可能にする。通常のパルス幅及び位置変調
ビデオ・パルスに対する逆位相成分を発生することによ
って、ピクセル・クロックの境界にエッジを合せた一対
のパルスが生成される。
【図１】 ラスタ出力スキャナ(Raster Output Scanne
r) （ＲＯＳ）の模式図で、感光性画像面の一部を示
す。
r) （ＲＯＳ）の模式図で、感光性画像面の一部を示
す。
【図２】 Ａは幅と位置を変化させ得るパルスの例を示
す模式図、Ｂは本発明の実施例によって、Ａのパルスを
用いて生成される逆位相パルスの模式図である。
す模式図、Ｂは本発明の実施例によって、Ａのパルスを
用いて生成される逆位相パルスの模式図である。
【図３】 Ａは幅と位置を変化させ得るパルスの例を示
す概略図、Ｂは本発明の実施例によって、Ａのパルスを
用いて生成される逆位相パルスの模式図である。
す概略図、Ｂは本発明の実施例によって、Ａのパルスを
用いて生成される逆位相パルスの模式図である。
【図４】 本発明の実施例によるパルス変調器の模式的
ブロック・ダイヤグラムである。
ブロック・ダイヤグラムである。
【図５】 本発明の実施例によるパルス変調器の模式的
ブロック・ダイヤグラムである。
ブロック・ダイヤグラムである。
【図６】 図５に記載したビデオ・パルスの反転及び結
合論理ブロックの細部を示す模式図である。
合論理ブロックの細部を示す模式図である。
【図７】 図６に詳細を示したビデオ・パルスの反転及
び結合論理ブロックに用いられる各種信号のタイミング
・ダイヤグラムを示すものである。
び結合論理ブロックに用いられる各種信号のタイミング
・ダイヤグラムを示すものである。
【図８】 図６に詳細を示したビデオ・パルスの反転及
び結合論理ブロックに用いられる各種信号のタイミング
・ダイヤグラムを示すものである。
び結合論理ブロックに用いられる各種信号のタイミング
・ダイヤグラムを示すものである。
【図９】 図６に詳細を示したビデオ・パルスの反転及
び結合論理ブロックに用いられる各種信号のタイミング
・ダイヤグラムを示すものである。
び結合論理ブロックに用いられる各種信号のタイミング
・ダイヤグラムを示すものである。
１８ ＲＯＳ、２０ レーザ・ビーム、２１ スポッ
ト、２２ レーザ、２４整調用光学系、２５ 変調器、
２６ 鏡面、２８ 多面鏡、３０ 整調用光学系、３２
感光性画像面、３４ 走査線、４０ ピクセル、１０
１ 画像源、１０３ ビデオ拡張ポート、１０５ ＲＡ
Ｍアドレスマルチプレクサ、１０７，１０９，１１１，
１１３ ＲＡＭルックアップテーブル、１１５ ルック
アップテーブル・ダウンロード・インターフェース、１
１７ ルックアップテーブルデータバス、１１８ ルッ
クアップテーブルアドレスバス、１１９ ビデオデータ
バス、１２１，１２３ ラッチ付きマルチプレクサ、１
２９ 遅延ロジック、１３１ビデオパルス形成論理ブロ
ック、１３３ タイミング・制御回路、１４５ ビデオ
パルス反転論理ブロック、１４９ ビデオ結合論理ブロ
ック
ト、２２ レーザ、２４整調用光学系、２５ 変調器、
２６ 鏡面、２８ 多面鏡、３０ 整調用光学系、３２
感光性画像面、３４ 走査線、４０ ピクセル、１０
１ 画像源、１０３ ビデオ拡張ポート、１０５ ＲＡ
Ｍアドレスマルチプレクサ、１０７，１０９，１１１，
１１３ ＲＡＭルックアップテーブル、１１５ ルック
アップテーブル・ダウンロード・インターフェース、１
１７ ルックアップテーブルデータバス、１１８ ルッ
クアップテーブルアドレスバス、１１９ ビデオデータ
バス、１２１，１２３ ラッチ付きマルチプレクサ、１
２９ 遅延ロジック、１３１ビデオパルス形成論理ブロ
ック、１３３ タイミング・制御回路、１４５ ビデオ
パルス反転論理ブロック、１４９ ビデオ結合論理ブロ
ック
Claims (3)
- 【請求項１】 下記のものを含む、選択したクロック周
期の中で多重パルスを発生する装置：選択したクロック
周期の間に発生されるべき第一のパルスの先端エッジ遅
延を規定する手段；選択したクロック周期の間に発生さ
れるべき第一のパルスの尾端エッジ遅延を規定する手
段；選択したクロック周期の、先端エッジ遅延と尾端エ
ッジ遅延の間の部分に、第一のパルスを発生する手段；
及びクロック単位ごとに選択でき、第一のパルスを反転
させて、選択したクロック周期の中で逆位相のパルスを
生成するための手段。 - 【請求項２】 前記反転手段が下記のものを含む、請求
項１記載の装置：作動可とする反転制御信号を、選択し
たクロック周期の間にのみ生成するための反転選択手
段；及び上記の反転選択手段に対応するもので、反転制
御信号が作動可とするものであればいつでも、逆位相の
パルスを生成するために反転制御信号と第一のパルスを
結合する手段。 - 【請求項３】 ピクセルの境界を限定するあらかじめ定
めたピクセル・クロック周期の中でパルスを発生するこ
とができるディジタル電子システムにおいて、ピクセル
境界を超えてパルスを延長するための、下記のものを含
む装置：選択したピクセル・クロック周期の間に発生さ
れるべき第一のパルスの先端エッジ遅延を規定する手
段；選択したピクセル・クロック周期の間に発生される
べき第一のパルスの尾端エッジ遅延を規定する手段；選
択したピクセル・クロック周期の、先端エッジ遅延と尾
端エッジ遅延の間の部分に、第一のパルスを発生する手
段；及びピクセル・クロック周期単位に選択でき、第一
のパルスを反転させて、選択したクロック周期の中で第
一の逆位相のパルスを生成し、上記の第一の逆位相のパ
ルスが選択したピクセル・クロック周期の始点にエッジ
を合せられており、それにより直前のピクセル・クロッ
ク周期の間に発生されたパルスを延長する手段。
Applications Claiming Priority (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| US118858 | 1993-09-10 | ||
| US08/118,858 US5504462A (en) | 1993-09-10 | 1993-09-10 | Apparatus for enhancing pixel addressability in a pulse width and position modulated system |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH07203205A true JPH07203205A (ja) | 1995-08-04 |
Family
ID=22381165
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP6213712A Pending JPH07203205A (ja) | 1993-09-10 | 1994-09-07 | パルス幅及び位置変調システムにおけるピクセルのアドレス付け機能強化装置 |
Country Status (2)
| Country | Link |
|---|---|
| US (1) | US5504462A (ja) |
| JP (1) | JPH07203205A (ja) |
Families Citing this family (15)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US5586145A (en) * | 1993-01-11 | 1996-12-17 | Morgan; Harry C. | Transmission of electronic information by pulse position modulation utilizing low average power |
| EP0851316B1 (en) | 1996-12-23 | 2002-03-27 | Agfa-Gevaert | Printer and printing method |
| US5920683A (en) * | 1997-06-27 | 1999-07-06 | Xerox Corporation | Image enhancement system for high addressability printing |
| US5790166A (en) * | 1997-07-17 | 1998-08-04 | Xerox Corporation | Modulator for doubling resolution in the fast-scan direction for a laser imager in an electrophotographic printer |
| US6252675B1 (en) | 1998-05-08 | 2001-06-26 | Xerox Corporation | Apparatus and method for halftone hybrid screen generation |
| US6266154B1 (en) * | 1998-05-21 | 2001-07-24 | Oak Technology, Inc. | Grayscale enhancement system and method |
| US6285463B1 (en) | 1998-12-22 | 2001-09-04 | Xerox Corporation | Method and apparatus for image compensation of blooming artifacts |
| US6731320B1 (en) * | 1999-03-19 | 2004-05-04 | Applied Materials, Inc. | Laser pattern generator |
| US6919973B1 (en) | 1999-07-27 | 2005-07-19 | Xerox Corporation | Auxiliary pixel patterns for improving print quality |
| US7016073B1 (en) | 1999-07-27 | 2006-03-21 | Xerox Corporation | Digital halftone with auxiliary pixels |
| US6970258B1 (en) | 1999-07-27 | 2005-11-29 | Xerox Corporation | Non-printing patterns for improving font print quality |
| JP4508478B2 (ja) * | 2001-06-27 | 2010-07-21 | キヤノン株式会社 | 画像記録装置 |
| US7536052B2 (en) * | 2003-12-15 | 2009-05-19 | Xerox Corporation | Corner sharpening of text and line art in a super resolution anti-aliasing image path |
| US8208175B2 (en) * | 2005-04-13 | 2012-06-26 | Xerox Corporation | Blended error diffusion and adaptive quantization |
| JP4196996B2 (ja) * | 2006-02-15 | 2008-12-17 | 村田機械株式会社 | 画像形成装置及び画像形成装置の濃度制御方法 |
Family Cites Families (17)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS56152373A (en) * | 1980-04-24 | 1981-11-25 | Fuji Photo Film Co Ltd | Laser recording device |
| JPS56153333A (en) * | 1980-04-30 | 1981-11-27 | Fuji Photo Film Co Ltd | Laser recorder |
| JPS5782057A (en) * | 1980-11-11 | 1982-05-22 | Fuji Photo Film Co Ltd | Density adjusting method in recording of picture |
| US4661859A (en) * | 1981-06-03 | 1987-04-28 | Xerox Corporation | Pulse width modulation greyscale system for halftone printer |
| JPS5875192A (ja) * | 1981-10-29 | 1983-05-06 | 日本電信電話株式会社 | 表示装置のスム−ジング回路 |
| JPS59163952A (ja) * | 1983-03-08 | 1984-09-17 | Canon Inc | 画像処理装置 |
| US4544264A (en) * | 1984-05-17 | 1985-10-01 | International Business Machines Corporation | Fine line print enhancement |
| US4625222A (en) * | 1984-05-17 | 1986-11-25 | International Business Machines Corporation | Interacting print enhancement techniques |
| DE3752315T2 (de) * | 1986-02-14 | 2000-10-26 | Canon K.K., Tokio/Tokyo | Bildverarbeitungsgerät |
| JP2589295B2 (ja) * | 1986-11-14 | 1997-03-12 | キヤノン株式会社 | 画像形成装置 |
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| JP3050880B2 (ja) * | 1989-04-28 | 2000-06-12 | 株式会社リコー | 画像形成装置 |
| JPH03126053A (ja) * | 1989-10-12 | 1991-05-29 | Ricoh Co Ltd | 画像形成装置 |
| US4933689A (en) * | 1989-10-25 | 1990-06-12 | Hewlett-Packard Company | Method and apparatus for print image enhancement |
| US5193011A (en) * | 1990-10-03 | 1993-03-09 | Xerox Corporation | Method and apparatus for producing variable width pulses to produce an image having gray levels |
| US5184226A (en) * | 1991-10-25 | 1993-02-02 | Xerox Corporation | Digital video pulse width and position modulator |
| US5198785A (en) * | 1992-05-29 | 1993-03-30 | Analog Devices, Inc. | Dual edge pulse width modulation system |
-
1993
- 1993-09-10 US US08/118,858 patent/US5504462A/en not_active Expired - Fee Related
-
1994
- 1994-09-07 JP JP6213712A patent/JPH07203205A/ja active Pending
Also Published As
| Publication number | Publication date |
|---|---|
| US5504462A (en) | 1996-04-02 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20040820 |
|
| A02 | Decision of refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A02 Effective date: 20050204 |