JPH07239363A - 集積回路の試験アセンブリ、導電性ブリッジ装置および集積回路の試験方法 - Google Patents
集積回路の試験アセンブリ、導電性ブリッジ装置および集積回路の試験方法Info
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Abstract
種々の効果を奏する回路試験アセンブリを提供する。 【構成】 集積回路パッケージ14のリード18を試験
するアセンブリにおいて、複数個の導電性部分42から
なり、試験プローブと連携して使用する試験用基板40
と、前記リードと前記導電性部分との間を電気的に接触
させる導電性ブリッジ手段20であって、その内部に埋
設された複数本の導電性ワイヤ30を有する少なくとも
一つの圧縮性のブリッジ部材(22,24,26,2
8)からなり、前記導電性ワイヤの各々が前記ブリッジ
部材内で互いに平行であり、互いに間隔を隔ててある構
成の導電性ブリッジ手段と、前記導電性ブリッジ手段を
内部に保持し、前記導電性ブリッジ手段による前記集積
回路パッケージの前記リードと前記試験用基板の前記導
電性部分との電気的接触を維持するためのロケータ手段
50、とから構成したことを特徴とする。
Description
リ、導電性ブリッジ装置および集積回路の試験方法に関
し、特に集積回路パッケージのリードに電気的に接触す
る上記アセンブリ、上記ブリッジ装置および上記試験方
法に関する。
ングから外側に延びた複数の薄い、平行な電気的リード
を有する絶縁ハウジング内に実装された集積回路からな
っている。集積回路パッケージのリードは本願発明に係
る技術分野で公知の“カモメ翼”(Gull−Win
g)形を含むが、これに限定されるものではない種々の
構造に曲げることができる。
点検、電圧出力の測定等の種々の項目の試験に使用され
る。このような試験は各リードを試験プローブと電気的
に接触させることによって、集積回路パッケージの個々
のリードで行われることが多い。
通常は、集積回路パッケージのアレーを含む、種々の電
気部品が密集している。回路板上の部品の間隔が狭く、
すなわち“回路板の密度”が高く、また、各集積回路パ
ッケージのリードのサイズ、およびピッチ(すなわち間
隔)が小さいので、試験目的で試験プローブで各リード
を処理することが困難な場合が多い。従って、例えばピ
ンのような、装置に対して、各集積回路パッケージのリ
ードを電気的に接続する、試験プローブで処理すること
がより容易である回路試験素子が開発されている。特
に、“試験用クリップ”と呼ばれる回路試験装置は、典
型的には、回路試験装置のリードを集積回路パッケージ
のリードに対してしっかりと保持するために、集積回路
パッケージへと“クリップ”するばね付勢されたリード
部分を備えている。集積回路パッケージのリードに対し
て試験用クリップを所定位置に保持するには、相当の大
きさの横力が必要である。そのため、試験用クリップの
中心部分、すなわち“ボディー”はこの横力を維持する
ために充分にしっかりしていなければならない。更に、
回路試験装置のリードと、集積回路パッケージのリード
との間の比率は基本的に1:1であり、双方の装置のリ
ードはほぼ同じサイズである。従って、回路試験装置の
リードを集積回路パッケージのリードと正確に位置合わ
せすることが極めて重要である。試験用クリップ内の個
々の回路試験装置のリードは通常は互いに絶縁されてお
らず、従ってわずかな位置合わせ誤差が、回路試験装置
のリード間での短絡を生じさせることがある。更に、試
験用クリップは、これがクリップされる集積回路パッケ
ージよりも全体のサイズ(フットプリント)が大きくな
る場合が多い。従って、回路板の密度が高まると、試験
用クリップが隣接する部品と干渉する危険がある。
細書に参考文献として引用されている1993年度のポ
モナ表面実装&IC試験付属品カタログ(カリフォルニ
ア州91769,ポモナ、E.6番街1500 ITT
ポモナ・エレクトロニクス社)に記載されている。カタ
ログに示すように、適正な試験用クリップを選択するに
は、試験される集積回路パッケージの下記の特性が判定
されなければならない。すなわち、リードの数、パッケ
ージの構造(面の数)、リードのパターン(例えば4×
4、7×7、16×24等)、リード間隔、パッケージ
タイプ(例えば、DIP、PLCC、SOIC、QFD
等)、規格(EIAJまたはJEDEC)、フットプリ
ント、およびインターフェース(上面の相互接続方法)
である。集積回路パッケージの特性と正確に一致しない
特性を有する試験用クリップを使用すると、電気的な短
絡または開路が生ずることがある。従って、産業規格
(すなわち、EIAJまたはJEDEC)の特性を有し
ていないある種の集積回路パッケージ用には試験用クリ
ップを使用できない。更に、市販製品の許容公差は非常
に大きいので、メーカーが異なると、また、同じメーカ
ーでも工場が異なると、同じ部品番号の装置でも異なる
試験用クリップが必要な場合がある。例えば、集積回路
パッケージのリードが異なった態様で曲がったり、パッ
ケージが英国規格、またはメートル法規格で製造された
り、パッケージのハウジング部分のサイズおよび形状の
双方または一方が異なったりする場合がある。従って、
特殊な集積回路パッケージ用の試験用クリップを発見す
ることは困難であるか、または不可能である。同様に、
特定の集積回路パッケージの特性と適合する試験用クリ
ップは、特性が僅かに異なる別の集積回路パッケージに
は使用できないことがある。
ジに使用できる回路試験アセンブリを提供することにあ
る。
ドと、集積回路パッケージのリードとの間の電気的接触
を保持するために横力を加える必要がない回路試験アセ
ンブリを提供することにある。
センブリと比較して、横サイズが比較的小型である回路
試験アセンブリを提供することにある。
ドと、集積回路パッケージのリードとの位置合わせ誤差
による影響を最小限にする回路試験アセンブリを提供す
ることにある。
ード間の開路の問題を最小限に抑えるように、個別に絶
縁された回路試験アセンブリを提供することにある。
っている場合でも、同じリード数と同じリード間隔の集
積回路パッケージで使用できる回路試験アセンブリを提
供することにある。
パッケージのリード毎に複数のリードを備えることによ
って、回路試験アセンブリと集積回路パッケージの双方
の間の接触を保証する回路試験アセンブリを提供するこ
とにある。
徴および利点は下記の発明の概要と、実施例で明らかに
される。
試験するためのアセンブリからなっている。このアセン
ブリは、試験プローブと連携して使用する試験用基板を
備えており、該試験用基板は複数個の導電性部分を有し
ている。前記の導電性部分は、試験用基板に固定され、
そこから外側に延びた複数の細長い導電性ピンからなっ
ている。アセンブリは更に、集積回路パッケージのリー
ドと、試験用基板の導電性部分との間を電気的に接触さ
せる導電性ブリッジ手段を備えている。この導電性ブリ
ッジ手段は、その内部に埋設された、またはこれに固定
された複数本の導電性ワイヤを有する少なくとも一つの
圧縮性ブリッジ部材からなっている。上記ワイヤの各々
が互いに平行であり、互いに間隔を隔ててある。アセン
ブリは更に、導電性ブリッジ手段を内部に保持し、導電
性ブリッジ手段による集積回路パッケージのリードと試
験用基板の導電性部分との電気的接触を維持するための
ロケータ手段を備えている。ロケータ手段はアセンブリ
を回路板に取り付けるための実装手段を備えている。ロ
ケータ手段は更に、少なくとも一つの細長い貫通する開
口部を備え、この開口部の内部に前記ブリッジ部材が配
置されている。
ドと、試験用基板の導電性部分とを電気的に接触させる
ための導電性ブリッジ装置を備えている。この導電性ブ
リッジ装置は、圧縮性材料製の細長い絶縁部材からなっ
ている。複数本の導電性ワイヤが絶縁部材内に埋設さ
れ、これらのワイヤは絶縁部材内で互いに平行であり、
且つ互いに間隔を隔ててある。
ージのリードを試験する方法にも関している。この方法
は、a)回路試験アセンブリを備えるステップと、b)
前記回路試験アセンブリを前記回路板上に、かつ前記集
積回路パッケージ上方に配置するステップと、c)前記
導電性ブリッジ手段を前記集積回路パッケージの前記リ
ードと位置合わせして、前記導電性ブリッジ手段の前記
ブリッジ部材内の前記導電性ワイヤの少なくとも一本が
前記集積回路パッケージの前記リードのそれぞれと接触
するようにするステップとから構成されている。
している。集積回路パッケージ14とともに、プリント
回路板12の一部が図示されている。集積回路パッケー
ジ14は絶縁ハウジング16内部に実装された集積回路
(図示せず)からなっており、複数の薄い、平行の電気
的リード18がハウジング16から外側に延びている。
集積回路パッケージ14は例えば、セラミック・クワッ
ド・フラットパック(CQFP)、プラスチック・クワ
ッド・フラットパック(PQFP)、薄クワッド・フラ
ットパック(TQFP)、微細ピッチ・クワッド・フラ
ットパック(FQFP)または金属およびセラミック・
クワッド・フラットパック(MQFP)のような公知の
種類のパッケージでよい。集積回路パッケージ14は典
型的には集積回路パッケージ14のリード18を従来の
方法で回路板12にはんだ付けすることによって回路板
12上に実装される。中心縦軸CCは図1に示すよう
に、集積回路パッケージ14の幾何学的中心と、回路試
験アセンブリ10の幾何学的中心とを通っている。
回路パッケージのリード18と試験用基板40との間を
電気的に接触させるための導電性ブリッジ手段20を備
えている。導電性ブリッジ手段20は少なくとも一つ
の、好ましくは4つの圧縮性ブリッジ部材22,24,
26,28を含んでいる。各ブリッジ部材22,24,
26,28は圧縮性の絶縁部材32内に埋設された平行
な、複数の導電性ワイヤ30を備えている。ワイヤ30
はそれぞれ互いに、また、中心縦軸CCに対して平行に
位置関係にあり、好ましくは金メッキ真鍮製である。更
に、ワイヤ30は図1のように互いに間隔を隔ててあ
り、絶縁部材32の製造中にこの絶縁部材内に直接型成
形することができる。絶縁部材32はシリコン・ゴムの
ような可撓性の変形可能な弾性材料製であることが好ま
しい。
チック製であるフレーム状のロケータ手段50が備えら
れ、これに導電性ブリッジ手段20が収容され、集積回
路パッケージのリード18と試験用基板40との電気的
接触は、導電性ブリッジ手段20によってなされる。よ
り詳細に説明すると、ロケータ手段50は図1に示すよ
うに、ロケータ手段50の周囲に配置された保持部分5
2,54,56,58を備えている。各ブリッジ部材2
2,24,26,28はロケータ手段50の保持部分5
2,54,56,58内にそれぞれ配置される。各保持
部分52,54,56,58は、ロケータ手段50を完
全に貫通する細長い、スロット状の開口部を有する線形
の棒状部材の形状であることが好ましい。プラスチック
製であることが好ましい試験用基板40は、導電性ブリ
ッジ手段20の真上に、これと隣接してロケータ手段5
0内に配置され、この試験用基板は底面40から試験用
基板40を経て、試験用基板40の上面48から外側に
延びた複数個の導電性部分42を備えている。(図1お
よび図3)導電性部分42は図2および図3に示すよう
に、座部分46内に配置できる公知のピンまたはその類
似物である。導電性部分42は最終的には、集積回路パ
ッケージのリード18と比較して、上記使用用基板部分
40のサイズが大きいので、試験プローブ(図示せず)
との接触状態にし易い電気端子として使用できる。図2
には2列の周辺ピン配列が示されているが、領域配列
(二次元配列)や種々のその他のピン配列パターンも可
能である。
2,24,26,28は保持部分52,54,56,5
8に配置されると、ブリッジ部材22,24,26,2
8は集積回路パッケージ18の真上でこれと隣接した位
置に、また試験用基板40の導電性部分42の真下でこ
れと隣接した位置に配置される。このように、図1のシ
ステム全体を組立てると、導電性ブリッジ手段20は集
積回路パッケージのリード18と、試験用基板40の導
電性部分42との電気的接触を保持する。
合で試験用基板40のコーナー部分41,43,45,
47に対して接合するポスト70,72,74,76
(図1)またはその類似物を備えることができる。これ
らのポスト70,72,74,76は試験用基板40が
ブリッジ手段20に対して圧縮的に保持されるように、
試験用基板40をロケータ手段50内に位置合わせする
補助手段となる。ロケータ装置50は更に、試験用基板
40を適切な向きにしっかりと保持する、ブリッジ手段
20に対して圧縮的に保持された複数のプレーナ部材6
2,64,66,68を備えることができる。これらの
プレーナ部材62,64,66,68はタブ(図示せ
ず)またはその類似物を備えることができ、このタブに
よって試験用基板40が所定位置にスナップ嵌合され、
且つその位置に保持されて基板40の圧縮状態を保持
し、ひいてはブリッジ手段20を基板40と回路パッケ
ージのリード18との間で圧縮する。圧縮状態で保持す
るため、クランプ部材、ねじ等の種々のその他の保持装
置を使用してもよい。プレーナ部材62,64,66,
68は更にブリッジ部材22,24,26,28に対し
て隣接し、ブリッジ部材22,24,26,28をロケ
ータ手段50内の適切な向きに固定的に保持することを
補助するので、ワイヤ30は中心縦軸CC内に平行な向
きで保持される。
来の方法で回路板12に一時的に、または永久的に取り
付けられる。図1に示した実施例では、ロケータ手段5
0は更に、回路試験アセンブリ10を回路板12に取り
付けるための環状のタブ状実装手段80を備えている。
このタブ状の実装手段80は更に、図1に示すようにロ
ケータ手段50のコーナーに配置された実装部分82,
84,86,88からなる。これらの実装部分82,8
4,86,88は、図示のようにねじまたはその類似物
を受容する穴を備えており、これらのねじは回路板12
内の対応する穴、もしくはボス(図示せず)にねじ込ま
れる。ロケータ手段50を回路板12上に取り付ける一
手順では、ロケータ手段50が先ず、集積回路パッケー
ジ14と外接するように回路板12上に配設される。フ
レーム状のロケータ手段50は内部に集積回路パッケー
ジ14を密接して受容するような構造にされている。次
に実装部分82,84,86,88内の穴が(または事
前穿孔されたボスの位置決めおよび接合等のための)テ
ンプレートとして利用される。最後に、ねじ(図示せ
ず)を利用してロケータ手段50が回路板12に固定さ
れる。あるいは、ロケータ手段50を回路板12に永久
的に接合(接着)してもよい。
メ翼”形リードのような公知のリードでよい。図2に示
すように、各“カモメ翼”形リードは集積回路パッケー
ジ18のハウジング16を出る第1部分100と、リー
ド18が下方に曲折する第2部分102(通常“膝部
分”と呼ばれる)と、該膝部分のすぐ下の第3部分10
4と、リード18が回路板(例えば図1の素子12)と
接触する第4部分(通常は“足部分”と呼ばれる)とか
らなっている。図2に示した実施例では、ブリッジ部材
22の各ワイヤ30はリード18の一本の第1部分10
0と接触する。別の実施例(図示せず)では、ワイヤ3
0は足106のようなリード19の別の部分と接触して
もよい。図2および図3に示すように、ブリッジ部材2
2の各ワイヤ30は更に導電性部分42の底面143と
も接触する。
試験用クリップのリードと、集積回路パッケージのリー
ドとの接触を保持するために横力を利用するばね付勢さ
れたリード部分を備えている。このようなばね付勢され
たリードは曲げや、位置合わせ誤差を生じ易く、また、
比較的大きい横スペースを占める。これに対して、本発
明の導電性ブリッジ手段は、集積回路パッケージのリー
ド18との接触を保つために圧縮力を利用するものであ
る。図1を参照して前述したように、試験用基板40が
ロケータ手段(図を明解にするため、図2および図3で
は省略してある)内に固定的に、圧縮的に保持されてい
るとき、図2および図3に示すように、前記圧縮力の一
部は弾性の導電性ブリッジ手段20に試験用基板40を
押下することによって得られる。この圧縮力は更に、ロ
ケータ手段50(図1)を前述のように回路板12に取
り付けることによっても得られる。このように、本発明
は導電性ブリッジ手段20と試験用基板40との接触を
保持するために横力を必要とせず、リード部分にばね付
勢する必要がなくなる。更に、導電性ブリッジ手段20
内のワイヤ30は横方向に突起していないので、横方向
にコンパクトな試験アセンブリ10が得られる。
リップの中心部分、すなわち“ボディー”は必要な横力
を保持するために充分な剛性を備えていなければならな
い。本発明の回路試験アセンブリ10は電気的接触を保
持するために横力を必要としないので、試験用基板40
(図1)の中央部分44は剛体として構成する必要がな
い。例えば、試験用基板40の中央部分44には試験プ
ローブを受容するための複数個の穴(図示せず)を備え
ることができる。あるいは、試験用基板40の中心部分
44に能動部品、ヒート・シンク、またはその他の要素
を備えてもよい。更に、試験用基板40の中心部分44
を完全に除去してもよい。
ワイヤ30は、ワイヤ30を圧縮性の、変形可能な絶縁
部材32内に埋設することによって互いに間隔を隔て、
且つ電気的に絶縁されている。ワイヤ30相互間の中心
間間隔、すなわち距離“p”は集積回路のリード18相
互間の距離“q”よりも大幅に短い。すなわち、“p”
は“q”の約1/10であることが好ましい。このよう
に、複数のワイヤ30が各個の集積回路パッケージ・リ
ード18と接触する。その結果、各リード18間と、少
なくとも一本のワイヤ30との電気的接触が確保され
る。更に、ブリッジ部材22の位置合わせ誤差があって
も、少なくとも一本のワイヤ30が依然として選択され
たリード18と接触しているので、集積回路パッケージ
のリード18と試験用基板40との電気的接触が壊され
ることがない。
ッケージ・リードとの電気的接触を保持するため、各ブ
リッジ部材22,24,26,28の長さ“l”は、こ
れらと関連する集積回路パッケージ・リード18の特定
の列の間隔“d”と等しいか、それ以上でなければなら
ない。従って、特定の集積回路パッケージ14に対して
回路試験装置を適正にサイズ合わせするため、集積回路
パッケージ14用のリード間隔とリード数を定めなけれ
ばならない。しかし、本発明の回路試験装置10は例え
ばパッケージの高さ、規格(EIAJまたはJEDE
C)、離隔高さ、または嵩のようなその他の集積回路パ
ッケージの特性には左右されない。従って、他の特性が
異なっていても、特定の回路の試験用装置14をリード
数とリード間隔が同じならば任意の集積回路パッケージ
14に使用できる。
0の別の実施例を示している。以後、別途に指摘する場
合を除いて、図4の発明は図1〜図3を参照して前述し
たものと同一である。図4に示すように、導電性ブリッ
ジ手段20は少なくとも一つの圧縮性ブリッジ部材12
2を備えている。各ブリッジ部材122は、断面がほぼ
U形であってよい圧縮性絶縁部材152からなっている
ことが好ましい。絶縁部材152は複数の平行な、間隔
を隔てた導電性ワイヤ130(一本だけを図示)を有す
る表面部分124を備えている。ワイヤ130は接着剤
等で表面部分124に固着することができる。例えば、
表面部分124に接着層(図示せず)を塗布し、次にワ
イヤ130が図4に示すように表面部分124の断面形
状と一致するように、ワイヤ130を接着層上に載置す
る。各ワイヤ130の第1部分150は各導電性部分4
2の底面143と接触でき、各ワイヤ130の第2部分
152は集積回路パッケージ・リード18の第1部分1
00と接触できる。あるいは、図1−図3を参照して前
述したように、第2部分152は集積回路パッケージ・
リード18の別の部分(例えば部分104または10
6)と接触することもできる。導電性部分42と集積回
路パッケージ18との電気的な接触は、図1−図3を参
照して前述したように、圧縮力を利用することによって
保持される。
説明してきたが、以下に述べるように、本発明思想はそ
の他の多様な態様で実施でき、かつ利用でき、特許請求
の範囲は、従来技術で限定されていることを除いて、前
記の多様性を含むことが理解されよう。
リは、〔1〕集積回路パッケージのリードを試験するア
センブリにおいて、複数個の導電性部分からなり、試験
プローブと連携して使用する試験用基板と、前記集積回
路パッケージの前記リードと、前記試験用基板の前記導
電性部分との間を電気的に接触させる導電性ブリッジ手
段であって、その内部に埋設された複数本の導電性ワイ
ヤを有する少なくとも一つの圧縮性のブリッジ部材から
なり、前記導電性ワイヤの各々が前記ブリッジ部材内で
互いに平行であり、互いに間隔を隔ててある構成の導電
性ブリッジ手段と、前記導電性ブリッジ手段を内部に保
持し、前記導電性ブリッジ手段による前記集積回路パッ
ケージの前記リードと前記試験用基板の前記導電性部分
との電気的接触を維持するためのロケータ手段と、から
構成したことを特徴とし、〔2〕〜〔5〕に記載の好適
な実施態様を有している。
リを回路板に取り付ける実装手段からなることを特徴と
する〔1〕に記載の集積回路の試験アセンブリ。
に固定され、そこから外側に延びた複数個の細長い導電
性ピンであることを特徴とする〔1〕または〔2〕に記
載の集積回路の試験アセンブリ。
つの細長い貫通する開口部を備え、この開口部の内部に
前記ブリッジ部材が配置されたことを特徴とする〔1〕
〜〔3〕に記載の集積回路の試験アセンブリ。
板と前記導電性ブリッジ手段の圧縮的な結合を保持する
ための手段を備えたことを特徴とする〔1〕〜〔4〕に
記載の集積回路の試験アセンブリ。
〔6〕集積回路パッケージの前記リードと、試験用基板
の導電性部分との間を電気的に接触させる導電性ブリッ
ジ装置において、圧縮性材料からなる細長い絶縁部材
と、前記絶縁部材内に埋設され、各々が前記絶縁部材内
で互いに平行であり、且つ互いに間隔を隔ててある複数
本の導電性ワイヤとから構成したことを特徴とするもの
で、〔7〕に記載の好適な実施態様を有している。
間隔で前記導電性ワイヤの隣接する一本から隔てられ、
前記集積回路パッケージの前記リードがそれぞれ第2の
間隔で前記リードの隣接する一本から隔てられ、前記第
1の間隔が前記第2の間隔の約1/10であることを特
徴とする〔6〕に記載の導電性ブリッジ装置。
リは、〔8〕集積回路パッケージのリードを試験するア
センブリにおいて、複数個の導電性部分からなり、試験
プローブと連携して使用する試験用基板と、前記集積回
路パッケージの前記リードと、前記試験用基板の前記導
電性部分との間を電気的に接触させる導電性ブリッジ手
段であって、その内部に埋設された複数本の導電性ワイ
ヤを有する少なくとも一つの圧縮性のブリッジ部材から
なり、前記導電性ワイヤの各々が前記ブリッジ部材内で
互いに平行であり、互いに間隔を隔ててある構成の導電
性ブリッジ手段と、前記導電性ブリッジ手段を内部に保
持し、前記導電性ブリッジ手段による前記集積回路パッ
ケージの前記リードと前記試験用基板の前記導電性部分
との電気的接触を維持するためのロケータ手段であっ
て、前記アセンブリを回路板に取り付ける実装手段を備
え、更に、前記ブリッジ部材を内部に配置する、少なく
とも一つの貫通する開口部を備えたロケータ手段とから
構成したことを特徴とするもので、
な実施態様を有している。
間隔で前記導電性ワイヤの隣接する一本から隔てられ、
前記集積回路パッケージの前記リードがそれぞれ第2の
間隔で前記リードの隣接する一本から隔てられ、前記第
1の間隔が前記第2の間隔の約1/10であることを特
徴とする〔8〕に記載の集積回路の試験アセンブリ。
集積回路パッケージのリードを試験する方法において、 a)回路試験アセンブリを備えるステップであって、こ
の回路試験アセンブリを、 i)複数個の導電性部分からなる試験用基板と、 ii)内部に埋設された複数本の導電性ワイヤを有する
少なくとも一つの圧縮性のブリッジ部材からなり、前記
集積回路パッケージの前記リードと、前記試験用基板の
前記導電性部分との間を電気的に接触させる導電性ブリ
ッジ手段と、 iii)前記導電性ブリッジ手段を内部に保持し、前記
導電性ブリッジ手段による前記集積回路パッケージの前
記リードと前記試験用基板の前記導電性部分との電気的
接触を維持するためのロケータ手段であって、前記導電
性ブリッジ手段と前記ロケータ装置とが前記ロケータ手
段に固定的に取り付けられ、前記ブリッジ部材内の前記
導電性ワイヤの少なくとも一本が、前記基板の前記導電
性部分のそれぞれと接触するようにされたロケータ手段
と、から構成した前記ステップと、 b)前記回路試験アセンブリを前記回路板上に、また、
前記集積回路パッケージ上方に配置するステップと、 c)前記導電性ブリッジ手段を前記集積回路パッケージ
の前記リードと位置合わせして、前記導電性ブリッジ手
段の前記ブリッジ部材内の前記導電性ワイヤの少なくと
も一本が前記集積回路パッケージの前記リードのそれぞ
れと接触するようにするステップとから構成したことを
特徴とし、〔11〕および〔12〕に記載の好適な実施
態様を有している。
路板に取り付けるステップを更に含んだことを特徴とす
る〔10〕に記載の集積回路の試験方法。
の少なくとも一つを試験プローブと接触させるステップ
を更に含んだことを特徴とする〔11〕に記載の集積回
路の試験方法。
リは、〔13〕集積回路パッケージのリードを試験する
アセンブリにおいて、複数個の導電性部分からなり、試
験プローブと連携して使用する試験用基板と、前記集積
回路パッケージの前記リードと、前記試験用基板の前記
導電性部分との間を電気的に接触させる導電性ブリッジ
手段であって、これに固定された複数本の導電性ワイヤ
を有する少なくとも一つの圧縮性のブリッジ部材からな
り、前記導電性ワイヤの各々が前記ブリッジ部材上で互
いに平行であり、互いに間隔を隔ててある構成の導電性
ブリッジ手段と、前記導電性ブリッジ手段を内部に保持
し、前記導電性ブリッジ手段による前記集積回路パッケ
ージの前記リードと前記試験用基板の前記導電性部分と
の電気的接触を維持するためのロケータ手段と、から構
成したことを特徴とするもので、〔14〕〜〔17〕に
記載の好適な実施態様を有している。
リを回路板に取り付ける実装手段からなることを特徴と
する〔13〕に記載の集積回路の試験アセンブリ。
板に固定され、そこから外側に延びた複数個の細長い導
電性ピンであることを特徴とする〔13〕または〔1
4〕に記載の集積回路の試験アセンブリ。
一つの細長い貫通する開口部を備え、この開口部の内部
に前記ブリッジ部材が配置されたことを特徴とする〔1
3〕〜〔15〕に記載の集積回路の試験アセンブリ。
用基板と前記導電性ブリッジ手段の圧縮的な結合を保持
するための手段を備えたことを特徴とする〔13〕〜
〔16〕に記載の集積回路の試験アセンブリ。
な効果を奏することができる。 (1)広範な集積回路パッケージに使用できる。すなわ
ち、産業規格の特性を有していない特殊な規格や、各国
規格の相違等に影響されることのない集積回路の試験ア
センブリを提供することができる。
パッケージのリードとの間の電気的接触を保持するため
に横力を加える必要がない回路試験アセンブリを提供す
ることができる。
して、横サイズが比較的小型である回路試験アセンブリ
を提供することができる。
パッケージのリードとの位置合わせ誤差による影響を最
小限にする回路試験アセンブリを提供することができ
る。
を最小限に抑えるように、個別に絶縁された回路試験ア
センブリを提供することができる。
同じリード数と同じリード間隔の集積回路パッケージで
使用できる回路試験アセンブリを提供することができ
る。
毎に複数のリードを備えることによって、回路試験アセ
ンブリと集積回路パッケージの双方の間の接触を保証す
る回路試験アセンブリを提供することができる。
ッケージと回路板の例と関連した本発明の回路試験アセ
ンブリの分解透視図である。
パッケージ・リードの側部の拡大断面図である。
ンブリと関連する2本の集積回路パッケージ・リードの
前部の拡大断面図である。
する集積回路パッケージ・リードの側部の拡大断面図で
ある。
Claims (5)
- 【請求項1】 集積回路パッケージのリードを試験する
アセンブリにおいて、 複数個の導電性部分からなり、試験プローブと連携して
使用する試験用基板と、 前記集積回路パッケージの前記リードと、前記試験用基
板の前記導電性部分との間を電気的に接触させる導電性
ブリッジ手段であって、その内部に埋設された複数本の
導電性ワイヤを有する少なくとも一つの圧縮性のブリッ
ジ部材からなり、前記導電性ワイヤの各々が前記ブリッ
ジ部材内で互いに平行であり、互いに間隔を隔ててある
構成の導電性ブリッジ手段と、 前記導電性ブリッジ手段を内部に保持し、前記導電性ブ
リッジ手段による前記集積回路パッケージの前記リード
と前記試験用基板の前記導電性部分との電気的接触を維
持するためのロケータ手段と、から構成したことを特徴
とする集積回路の試験アセンブリ。 - 【請求項2】 集積回路パッケージのリードを試験する
アセンブリにおいて、 複数個の導電性部分からなり、試験プローブと連携して
使用する試験用基板と、 前記集積回路パッケージの前記リードと、前記試験用基
板の前記導電性部分との間を電気的に接触させる導電性
ブリッジ手段であって、その内部に埋設された複数本の
導電性ワイヤを有する少なくとも一つの圧縮性のブリッ
ジ部材からなり、前記導電性ワイヤの各々が前記ブリッ
ジ部材内で互いに平行であり、互いに間隔を隔ててある
構成の導電性ブリッジ手段と、 前記導電性ブリッジ手段を内部に保持し、前記導電性ブ
リッジ手段による前記集積回路パッケージの前記リード
と前記試験用基板の前記導電性部分との電気的接触を維
持するためのロケータ手段であって、前記アセンブリを
回路板に取り付ける実装手段を備え、更に、前記ブリッ
ジ部材を内部に配置する、少なくとも一つの貫通する開
口部を備えたロケータ手段とから構成したことを特徴と
する集積回路の試験アセンブリ。 - 【請求項3】 集積回路パッケージのリードを試験する
アセンブリにおいて、 複数個の導電性部分からなり、試験プローブと連携して
使用する試験用基板と、 前記集積回路パッケージの前記リードと、前記試験用基
板の前記導電性部分との間を電気的に接触させる導電性
ブリッジ手段であって、その内部に埋設された複数本の
導電性ワイヤを有する少なくとも一つの圧縮性のブリッ
ジ部材からなり、前記導電性ワイヤの各々が前記ブリッ
ジ部材内で互いに平行であり、互いに間隔を隔ててある
構成の導電性ブリッジ手段と、 前記導電性ブリッジ手段を内部に保持し、前記導電性ブ
リッジ手段による前記集積回路パッケージの前記リード
と前記試験用基板の前記導電性部分との電気的接触を維
持するためのロケータ手段であって、前記アセンブリを
回路板に取り付ける実装手段を備え、更に、前記ブリッ
ジ部材を内部に配置する、少なくとも一つの貫通する開
口部を備えたロケータ手段とから構成したことを特徴と
する集積回路の試験アセンブリ。 - 【請求項4】 集積回路パッケージのリードを試験する
方法において、 a)回路試験アセンブリを備えるステップであって、こ
の回路試験アセンブリを、 i)複数個の導電性部分からなる試験用基板と、 ii)内部に埋設された複数本の導電性ワイヤを有する
少なくとも一つの圧縮性のブリッジ部材からなり、前記
集積回路パッケージの前記リードと、前記試験用基板の
前記導電性部分との間を電気的に接触させる導電性ブリ
ッジ手段と、 iii)前記導電性ブリッジ手段を内部に保持し、前記
導電性ブリッジ手段による前記集積回路パッケージの前
記リードと前記試験用基板の前記導電性部分との電気的
接触を維持するためのロケータ手段であって、前記導電
性ブリッジ手段と前記ロケータ装置とが前記ロケータ手
段に固定的に取り付けられ、前記ブリッジ部材内の前記
導電性ワイヤの少なくとも一本が、前記基板の前記導電
性部分のそれぞれと接触するようにされたロケータ手段
と、から構成した前記ステップと、 b)前記回路試験アセンブリを前記回路板上に、また、
前記集積回路パッケージ上方に配置するステップと、 c)前記導電性ブリッジ手段を前記集積回路パッケージ
の前記リードと位置合わせして、前記導電性ブリッジ手
段の前記ブリッジ部材内の前記導電性ワイヤの少なくと
も一本が前記集積回路パッケージの前記リードのそれぞ
れと接触するようにするステップとから構成したことを
特徴とする集積回路の試験方法。 - 【請求項5】 集積回路パッケージのリードを試験する
アセンブリにおいて、 複数個の導電性部分からなり、試験プローブと連携して
使用する試験用基板と、 前記集積回路パッケージの前記リードと、前記試験用基
板の前記導電性部分との間を電気的に接触させる導電性
ブリッジ手段であって、これに固定された複数本の導電
性ワイヤを有する少なくとも一つの圧縮性のブリッジ部
材からなり、前記導電性ワイヤの各々が前記ブリッジ部
材上で互いに平行であり、互いに間隔を隔ててある構成
の導電性ブリッジ手段と、 前記導電性ブリッジ手段を内部に保持し、前記導電性ブ
リッジ手段による前記集積回路パッケージの前記リード
と前記試験用基板の前記導電性部分との電気的接触を維
持するためのロケータ手段と、から構成したことを特徴
とする集積回路の試験アセンブリ。
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|---|---|---|---|
| US17818794A | 1994-01-06 | 1994-01-06 | |
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|---|---|
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Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2012022815A (ja) * | 2010-07-12 | 2012-02-02 | Enplas Corp | 電気部品用ソケット |
Families Citing this family (23)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| DE19528011A1 (de) * | 1995-07-31 | 1997-02-06 | Kontron Elektronik | Adapter mit einem eine Kontaktierungsvorrichtung aufweisenden Träger |
| KR100268460B1 (ko) * | 1996-12-07 | 2000-10-16 | 윤종용 | 표면실장용 반도체ic의 위치결정장치 |
| US5879172A (en) * | 1997-04-03 | 1999-03-09 | Emulation Technology, Inc. | Surface mounted adapter using elastomeric conductors |
| US6064214A (en) * | 1997-12-19 | 2000-05-16 | Hewlett-Packard Company | Perimeter trace probe for plastic ball grid arrays |
| US6107812A (en) * | 1998-03-05 | 2000-08-22 | International Business Machines Corporation | Apparatus and method for testing integrated circuit components of a multi-component card |
| US5936849A (en) * | 1998-07-27 | 1999-08-10 | Lucent Technologies Inc. | Text fixture retainer for an integrated circuit package |
| US6535393B2 (en) * | 1998-12-04 | 2003-03-18 | Micron Technology, Inc. | Electrical device allowing for increased device densities |
| US20070245553A1 (en) * | 1999-05-27 | 2007-10-25 | Chong Fu C | Fine pitch microfabricated spring contact structure & method |
| US7349223B2 (en) | 2000-05-23 | 2008-03-25 | Nanonexus, Inc. | Enhanced compliant probe card systems having improved planarity |
| US6799976B1 (en) * | 1999-07-28 | 2004-10-05 | Nanonexus, Inc. | Construction structures and manufacturing processes for integrated circuit wafer probe card assemblies |
| US6812718B1 (en) * | 1999-05-27 | 2004-11-02 | Nanonexus, Inc. | Massively parallel interface for electronic circuits |
| US7247035B2 (en) * | 2000-06-20 | 2007-07-24 | Nanonexus, Inc. | Enhanced stress metal spring contactor |
| US6710609B2 (en) * | 2002-07-15 | 2004-03-23 | Nanonexus, Inc. | Mosaic decal probe |
| US7382142B2 (en) | 2000-05-23 | 2008-06-03 | Nanonexus, Inc. | High density interconnect system having rapid fabrication cycle |
| US6390475B1 (en) * | 1999-08-31 | 2002-05-21 | Intel Corporation | Electro-mechanical heat sink gasket for shock and vibration protection and EMI suppression on an exposed die |
| US7579848B2 (en) * | 2000-05-23 | 2009-08-25 | Nanonexus, Inc. | High density interconnect system for IC packages and interconnect assemblies |
| US7952373B2 (en) | 2000-05-23 | 2011-05-31 | Verigy (Singapore) Pte. Ltd. | Construction structures and manufacturing processes for integrated circuit wafer probe card assemblies |
| US20050068054A1 (en) * | 2000-05-23 | 2005-03-31 | Sammy Mok | Standardized layout patterns and routing structures for integrated circuit wafer probe card assemblies |
| EP1419285A4 (en) * | 2001-08-24 | 2009-08-19 | Nanonexus Inc | METHOD AND DEVICE FOR GENERATING UNIFORM ISOTROPIC VOLTAGES IN A SPOTTED FILM |
| US20040032271A1 (en) * | 2002-08-19 | 2004-02-19 | Blackwood Jeffrey E. | Anisotropic probing contactor |
| US20060074836A1 (en) * | 2004-09-03 | 2006-04-06 | Biowisdom Limited | System and method for graphically displaying ontology data |
| US7218128B2 (en) * | 2005-02-14 | 2007-05-15 | International Business Machines Corporation | Method and apparatus for locating and testing a chip |
| KR101488616B1 (ko) * | 2013-09-06 | 2015-02-06 | (주) 아이씨티케이 | 식별키 생성 장치 및 방법 |
Family Cites Families (23)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| GB1387587A (en) * | 1971-07-22 | 1975-03-19 | Plessey Co Ltd | Electrical interconnectors and connector assemblies |
| US4003621A (en) * | 1975-06-16 | 1977-01-18 | Technical Wire Products, Inc. | Electrical connector employing conductive rectilinear elements |
| US4766371A (en) * | 1982-07-24 | 1988-08-23 | Risho Kogyo Co., Ltd. | Test board for semiconductor packages |
| US4504783A (en) * | 1982-09-30 | 1985-03-12 | Storage Technology Partners | Test fixture for providing electrical access to each I/O pin of a VLSI chip having a large number of I/O pins |
| US4593961A (en) * | 1984-12-20 | 1986-06-10 | Amp Incorporated | Electrical compression connector |
| US4843313A (en) * | 1984-12-26 | 1989-06-27 | Hughes Aircraft Company | Integrated circuit package carrier and test device |
| US5014161A (en) * | 1985-07-22 | 1991-05-07 | Digital Equipment Corporation | System for detachably mounting semiconductors on conductor substrate |
| US4783719A (en) * | 1987-01-20 | 1988-11-08 | Hughes Aircraft Company | Test connector for electrical devices |
| EP0307425B1 (en) * | 1987-03-31 | 1991-09-25 | Varelco Limited | Mounting arrangement for a chip carrier |
| US5247246A (en) * | 1987-04-17 | 1993-09-21 | Everett Charles Technologies, Inc. | Testing of integrated circuit devices on loaded printed circuit boards |
| US5049813A (en) * | 1987-04-17 | 1991-09-17 | Everett/Charles Contact Products, Inc. | Testing of integrated circuit devices on loaded printed circuit boards |
| US5005070A (en) * | 1988-12-19 | 1991-04-02 | Hewlett-Packard Company | Soldering interconnect method and apparatus for semiconductor packages |
| US5092034A (en) * | 1988-12-19 | 1992-03-03 | Hewlett-Packard Company | Soldering interconnect method for semiconductor packages |
| US4954878A (en) * | 1989-06-29 | 1990-09-04 | Digital Equipment Corp. | Method of packaging and powering integrated circuit chips and the chip assembly formed thereby |
| US5015946A (en) * | 1990-02-26 | 1991-05-14 | Tektronix, Inc. | High density probe |
| US5140405A (en) * | 1990-08-30 | 1992-08-18 | Micron Technology, Inc. | Semiconductor assembly utilizing elastomeric single axis conductive interconnect |
| US5124660A (en) * | 1990-12-20 | 1992-06-23 | Hewlett-Packard Company | Identification of pin-open faults by capacitive coupling through the integrated circuit package |
| US5109320A (en) * | 1990-12-24 | 1992-04-28 | Westinghouse Electric Corp. | System for connecting integrated circuit dies to a printed wiring board |
| US5155302A (en) * | 1991-06-24 | 1992-10-13 | At&T Bell Laboratories | Electronic device interconnection techniques |
| US5156649A (en) * | 1991-11-27 | 1992-10-20 | Tektronix, Inc. | Test clip adapter for integrated circuit device |
| US5206585A (en) * | 1991-12-02 | 1993-04-27 | At&T Bell Laboratories | Methods for testing integrated circuit devices |
| US5247250A (en) * | 1992-03-27 | 1993-09-21 | Minnesota Mining And Manufacturing Company | Integrated circuit test socket |
| DE69224473T2 (de) * | 1992-06-03 | 1998-10-08 | Itt Mfg Enterprises Inc | IC Testklemme mit federnden Kontakten |
-
1995
- 1995-01-04 JP JP7015556A patent/JPH07239363A/ja active Pending
-
1996
- 1996-01-26 US US08/592,468 patent/US5680057A/en not_active Expired - Fee Related
-
1997
- 1997-06-02 US US08/867,379 patent/US6169411B1/en not_active Expired - Fee Related
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2012022815A (ja) * | 2010-07-12 | 2012-02-02 | Enplas Corp | 電気部品用ソケット |
Also Published As
| Publication number | Publication date |
|---|---|
| US6169411B1 (en) | 2001-01-02 |
| US5680057A (en) | 1997-10-21 |
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