JPH07261922A - タッチパッド、入力装置及びコンピュータ・システム - Google Patents
タッチパッド、入力装置及びコンピュータ・システムInfo
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- JPH07261922A JPH07261922A JP31796094A JP31796094A JPH07261922A JP H07261922 A JPH07261922 A JP H07261922A JP 31796094 A JP31796094 A JP 31796094A JP 31796094 A JP31796094 A JP 31796094A JP H07261922 A JPH07261922 A JP H07261922A
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- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F3/00—Input arrangements for transferring data to be processed into a form capable of being handled by the computer; Output arrangements for transferring data from processing unit to output unit, e.g. interface arrangements
- G06F3/01—Input arrangements or combined input and output arrangements for interaction between user and computer
- G06F3/03—Arrangements for converting the position or the displacement of a member into a coded form
- G06F3/033—Pointing devices displaced or positioned by the user, e.g. mice, trackballs, pens or joysticks; Accessories therefor
- G06F3/038—Control and interface arrangements therefor, e.g. drivers or device-embedded control circuitry
-
- G—PHYSICS
- G05—CONTROLLING; REGULATING
- G05G—CONTROL DEVICES OR SYSTEMS INSOFAR AS CHARACTERISED BY MECHANICAL FEATURES ONLY
- G05G9/00—Manually-actuated control mechanisms provided with one single controlling member co-operating with two or more controlled members, e.g. selectively, simultaneously
- G05G9/02—Manually-actuated control mechanisms provided with one single controlling member co-operating with two or more controlled members, e.g. selectively, simultaneously the controlling member being movable in different independent ways, movement in each individual way actuating one controlled member only
- G05G9/04—Manually-actuated control mechanisms provided with one single controlling member co-operating with two or more controlled members, e.g. selectively, simultaneously the controlling member being movable in different independent ways, movement in each individual way actuating one controlled member only in which movement in two or more ways can occur simultaneously
- G05G9/047—Manually-actuated control mechanisms provided with one single controlling member co-operating with two or more controlled members, e.g. selectively, simultaneously the controlling member being movable in different independent ways, movement in each individual way actuating one controlled member only in which movement in two or more ways can occur simultaneously the controlling member being movable by hand about orthogonal axes, e.g. joysticks
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- G06F3/03—Arrangements for converting the position or the displacement of a member into a coded form
- G06F3/033—Pointing devices displaced or positioned by the user, e.g. mice, trackballs, pens or joysticks; Accessories therefor
- G06F3/0354—Pointing devices displaced or positioned by the user, e.g. mice, trackballs, pens or joysticks; Accessories therefor with detection of two-dimensional [2D] relative movements between the device, or an operating part thereof, and a plane or surface, e.g. 2D mice, trackballs, pens or pucks
- G06F3/03547—Touch pads, in which fingers can move on a surface
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- A63—SPORTS; GAMES; AMUSEMENTS
- A63F—CARD, BOARD, OR ROULETTE GAMES; INDOOR GAMES USING SMALL MOVING PLAYING BODIES; VIDEO GAMES; GAMES NOT OTHERWISE PROVIDED FOR
- A63F2300/00—Features of games using an electronically generated display having two or more dimensions, e.g. on a television screen, showing representations related to the game
- A63F2300/10—Features of games using an electronically generated display having two or more dimensions, e.g. on a television screen, showing representations related to the game characterized by input arrangements for converting player-generated signals into game device control signals
- A63F2300/1068—Features of games using an electronically generated display having two or more dimensions, e.g. on a television screen, showing representations related to the game characterized by input arrangements for converting player-generated signals into game device control signals being specially adapted to detect the point of contact of the player on a surface, e.g. floor mat, touch pad
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Abstract
(57)【要約】
【目的】 中央演算処理装置（ＣＰＵ）と、メモリ回路
と、入出力共用プロセッサと、入力装置とを含むコンピ
ュータ・システムであって、その入力装置が、タッチパ
ッドと、タッチパッドの両側に１本ずつ配置された２本
のジョイスティックとを含むコンピュータ・システムを
提供する。 【構成】 入力装置は、入出力共用プロセッサへのシリ
アル・データ・リンクを介してＣＰＵとのインタフェー
スを取る。タッチパッドは、タッチパッド表面の表面上
または表面内に記入されたデフォルト・テンプレート・
グラフィック・イメージを有し、デフォルト・テンプレ
ートの代わりにタッチパッドとともに使用されるテンプ
レート・オーバレイを脱着式に固定するためのリテーナ
を有する。
と、入出力共用プロセッサと、入力装置とを含むコンピ
ュータ・システムであって、その入力装置が、タッチパ
ッドと、タッチパッドの両側に１本ずつ配置された２本
のジョイスティックとを含むコンピュータ・システムを
提供する。 【構成】 入力装置は、入出力共用プロセッサへのシリ
アル・データ・リンクを介してＣＰＵとのインタフェー
スを取る。タッチパッドは、タッチパッド表面の表面上
または表面内に記入されたデフォルト・テンプレート・
グラフィック・イメージを有し、デフォルト・テンプレ
ートの代わりにタッチパッドとともに使用されるテンプ
レート・オーバレイを脱着式に固定するためのリテーナ
を有する。
Description
【０００１】
【産業上の利用分野】本発明は、一般的には、ディジタ
ル・システムで使用するための座標式ポインティング・
デバイスに関し、より具体的には、それに関連する記入
済みデフォルト・テンプレートを備えたタッチパッド
と、タッチパッド表面にテンプレート・オーバレイを脱
着式に固定するためのリテーナと、タッチパッドの両側
に１本ずつ配置された１対のジョイスティックとを有す
る入力装置に関する。
ル・システムで使用するための座標式ポインティング・
デバイスに関し、より具体的には、それに関連する記入
済みデフォルト・テンプレートを備えたタッチパッド
と、タッチパッド表面にテンプレート・オーバレイを脱
着式に固定するためのリテーナと、タッチパッドの両側
に１本ずつ配置された１対のジョイスティックとを有す
る入力装置に関する。
【０００２】
【従来の技術】ビデオ・グラフィック・コンピュータ・
システムは、周知かつ人気のある消費者製品である。典
型的なシステムは、ゲームまたはその他のアプリケーシ
ョンの画像を表示するために普通のテレビ受像機に接続
するデータ処理装置を含んでいる。このデータ処理装置
は、通常、カートリッジの形でパッケージされている読
取り専用メモリ（ＲＯＭ）から制御用ソフトウェアを受
け取る。このカートリッジは、データ処理装置に脱着式
に差し込まれている。アプリケーションを実行するため
に制御用ソフトウェアが使用する位置情報をプレーヤが
入力できるようにするために、マウス、ジョイスティッ
ク、タッチパッド、タッチ画面、スイッチ・パッド、ま
たはライト・ガンなどの少なくとも１つのポインティン
グ・デバイスもデータ処理装置に接続されている。
システムは、周知かつ人気のある消費者製品である。典
型的なシステムは、ゲームまたはその他のアプリケーシ
ョンの画像を表示するために普通のテレビ受像機に接続
するデータ処理装置を含んでいる。このデータ処理装置
は、通常、カートリッジの形でパッケージされている読
取り専用メモリ（ＲＯＭ）から制御用ソフトウェアを受
け取る。このカートリッジは、データ処理装置に脱着式
に差し込まれている。アプリケーションを実行するため
に制御用ソフトウェアが使用する位置情報をプレーヤが
入力できるようにするために、マウス、ジョイスティッ
ク、タッチパッド、タッチ画面、スイッチ・パッド、ま
たはライト・ガンなどの少なくとも１つのポインティン
グ・デバイスもデータ処理装置に接続されている。
【０００３】一般に、データ処理装置は、１つの中央演
算処理装置（ＣＰＵ）と、すべてのランダム・アクセス
・メモリ（ＲＡＭ）およびブートストラップ読取り専用
メモリ（ブートＲＯＭ）を含む関連の揮発性および不揮
発性メモリと、テレビ（ＲＦビデオ）信号発生器と、様
々なポインティング・デバイスとのインタフェースを取
るための入出力（Ｉ／Ｏ）プロセッサとを有する。これ
らの装置は回路連絡している。このようなシステム特有
の特徴の１つは、これらの構成要素をひとまとめに電気
接続するためにマザーボードまたはシステム・プレーナ
を使用している点である。
算処理装置（ＣＰＵ）と、すべてのランダム・アクセス
・メモリ（ＲＡＭ）およびブートストラップ読取り専用
メモリ（ブートＲＯＭ）を含む関連の揮発性および不揮
発性メモリと、テレビ（ＲＦビデオ）信号発生器と、様
々なポインティング・デバイスとのインタフェースを取
るための入出力（Ｉ／Ｏ）プロセッサとを有する。これ
らの装置は回路連絡している。このようなシステム特有
の特徴の１つは、これらの構成要素をひとまとめに電気
接続するためにマザーボードまたはシステム・プレーナ
を使用している点である。
【０００４】ジョイスティックは、方向データをコンピ
ュータ・システムに入力するのに使用する方向性ポイン
ティング・デバイスである。通常、ジョイスティック
は、ベースと、一般にユーザの手に握られる細長い「ス
ティック」とで構成される。この「スティック」は、通
常、ベースの１点を支点として旋回し、ベースに垂直な
デフォルト位置を有する。デフォルトの垂直位置からス
ティックが旋回する運動は、デフォルトの垂直位置から
スティックを転置するのに必要な方向におけるベースに
平行な方向入力として解釈される。通常、スティックの
先端にはボタンが配置されている。このボタン・スイッ
チの閉止事象は、このようなコンピュータ・システムで
実行されるアプリケーションの制御入力として使用され
る。
ュータ・システムに入力するのに使用する方向性ポイン
ティング・デバイスである。通常、ジョイスティック
は、ベースと、一般にユーザの手に握られる細長い「ス
ティック」とで構成される。この「スティック」は、通
常、ベースの１点を支点として旋回し、ベースに垂直な
デフォルト位置を有する。デフォルトの垂直位置からス
ティックが旋回する運動は、デフォルトの垂直位置から
スティックを転置するのに必要な方向におけるベースに
平行な方向入力として解釈される。通常、スティックの
先端にはボタンが配置されている。このボタン・スイッ
チの閉止事象は、このようなコンピュータ・システムで
実行されるアプリケーションの制御入力として使用され
る。
【０００５】タッチパッドは、コンピュータ・システム
に座標式データを入力するのに使用する座標式ポインテ
ィング・デバイスである。通常、タッチパッドは、その
表面で局部圧力を検出できる感圧式有界平面である。ユ
ーザが指またはスタイラスなどで表面に接触すると、タ
ッチパッドは、接触位置の座標を接続されたコンピュー
タ・システムに報告する。これに対する応答として、コ
ンピュータは、押された位置に関連する機能があれば、
その機能を実行する。
に座標式データを入力するのに使用する座標式ポインテ
ィング・デバイスである。通常、タッチパッドは、その
表面で局部圧力を検出できる感圧式有界平面である。ユ
ーザが指またはスタイラスなどで表面に接触すると、タ
ッチパッドは、接触位置の座標を接続されたコンピュー
タ・システムに報告する。これに対する応答として、コ
ンピュータは、押された位置に関連する機能があれば、
その機能を実行する。
【０００６】通常、タッチパッドの１つまたは複数の領
域は、システム内の所与の機能に割り当てられている。
ユーザは、各領域にどの機能が関連付けられているかを
テンプレートによって知ることができる。テンプレート
とは、グラフィック・デザインを備えたシートで、タッ
チパッド表面上に乗せられ、その表面に接している。こ
のグラフィック・デザインは、通常、タッチパッド表面
の諸領域をマッピングするもので、各領域には、マッピ
ングされた各種領域に関連付けられた機能をユーザに思
い出させるために、通常、ラベルが付けられている。
域は、システム内の所与の機能に割り当てられている。
ユーザは、各領域にどの機能が関連付けられているかを
テンプレートによって知ることができる。テンプレート
とは、グラフィック・デザインを備えたシートで、タッ
チパッド表面上に乗せられ、その表面に接している。こ
のグラフィック・デザインは、通常、タッチパッド表面
の諸領域をマッピングするもので、各領域には、マッピ
ングされた各種領域に関連付けられた機能をユーザに思
い出させるために、通常、ラベルが付けられている。
【０００７】一般に、タッチパッド・システムは、
（１）タッチパッド表面上または表面内に永続テンプレ
ートが記入されているために、テンプレート・オーバレ
イを受け入れることができないか、または（２）記入済
み永続テンプレートを持たないが、テンプレート・オー
バレイを受け入れるための手段を有しているかのいずれ
かである。このため、入力装置としてタッチパッドを使
用する各アプリケーションは、記入済み永続テンプレー
トを排他的に使用するか、またはテンプレート・オーバ
レイを提供する必要がある。したがって、一般的なシス
テムの場合、ソフトウェア・アプリケーション設計者
は、（永続テンプレートのみを使用することで）タッチ
パッドから行われる可能性のある入力を制限するか、ま
たは特定のソフトウェア・アプリケーションで使用する
ために１つまたは複数のカスタム・テンプレートを設計
し定義しなければならない。
（１）タッチパッド表面上または表面内に永続テンプレ
ートが記入されているために、テンプレート・オーバレ
イを受け入れることができないか、または（２）記入済
み永続テンプレートを持たないが、テンプレート・オー
バレイを受け入れるための手段を有しているかのいずれ
かである。このため、入力装置としてタッチパッドを使
用する各アプリケーションは、記入済み永続テンプレー
トを排他的に使用するか、またはテンプレート・オーバ
レイを提供する必要がある。したがって、一般的なシス
テムの場合、ソフトウェア・アプリケーション設計者
は、（永続テンプレートのみを使用することで）タッチ
パッドから行われる可能性のある入力を制限するか、ま
たは特定のソフトウェア・アプリケーションで使用する
ために１つまたは複数のカスタム・テンプレートを設計
し定義しなければならない。
【０００８】さらに、ジョイスティックは、通常、スイ
ッチや、その他の閉止式入力装置のみと組み合わせて使
用される。このため、ジョイスティックは、座標式の他
の入力装置と併用されないのが一般的である。
ッチや、その他の閉止式入力装置のみと組み合わせて使
用される。このため、ジョイスティックは、座標式の他
の入力装置と併用されないのが一般的である。
【０００９】
【発明が解決しようとする課題】本発明の目的は、タッ
チパッドと、タッチパッドの両側に１本ずつ配置された
１対のジョイスティックとを有する入力装置と、コンピ
ュータ・システムを提供することにある。
チパッドと、タッチパッドの両側に１本ずつ配置された
１対のジョイスティックとを有する入力装置と、コンピ
ュータ・システムを提供することにある。
【００１０】
【課題を解決するための手段】このジョイスティック
は、大人と子供のように、２人の人が同時にしかも互い
に助け合うようにしてコンピュータ・システムに位置入
力を提供できるような位置に配置されている。
は、大人と子供のように、２人の人が同時にしかも互い
に助け合うようにしてコンピュータ・システムに位置入
力を提供できるような位置に配置されている。
【００１１】タッチパッドは、記入済みデフォルト・テ
ンプレート・グラフィック・デザインと、デフォルト・
テンプレート・グラフィック・デザインの代わりにタッ
チパッドとともに使用する他のテンプレート・オーバレ
イを脱着式に固定するためのリテーナとを有する。記入
済みデフォルト・テンプレートは、多くのソフトウェア
・アプリケーションで使用可能な１組のコマンドを有す
る。また、テンプレート・オーバレイは、１つまたは複
数の具体的なソフトウェア・アプリケーション用の複数
のコマンド・セットを有する。
ンプレート・グラフィック・デザインと、デフォルト・
テンプレート・グラフィック・デザインの代わりにタッ
チパッドとともに使用する他のテンプレート・オーバレ
イを脱着式に固定するためのリテーナとを有する。記入
済みデフォルト・テンプレートは、多くのソフトウェア
・アプリケーションで使用可能な１組のコマンドを有す
る。また、テンプレート・オーバレイは、１つまたは複
数の具体的なソフトウェア・アプリケーション用の複数
のコマンド・セットを有する。
【００１２】
【実施例】図１および図２を参照して説明すると、同図
には、本発明のコンピュータ・システム１０が示されて
いる。図１に示す通り、システム１０は、プログラム・
カートリッジ１４がそれに脱着式に接続されているデー
タ処理装置１２で構成されている。データ処理装置１２
には、標準のテレビ受像機（ＴＶ）１６と、タッチパッ
ド１９および２本のジョイスティック２０ａ、２０ｂを
有する入力装置１８も接続されている。入力装置１８
は、指またはスタイラス２１などによるタッチパッド１
９上での接触位置に対応する座標式データをデータ処理
装置１２に送るものである。また、入力装置１８は、ジ
ョイスティック２０ａ、２０ｂの動きに対応する方向デ
ータをデータ処理装置１２に送る。図１には示されてい
ないが、標準のＴＶ１６は、１対のスピーカと、複合ビ
デオ信号を受け入れる表示装置とで置き換えることがで
きる。入力装置１８は、シリアル・データ・リンク２２
を介してデータ処理装置１２に接続する。ＴＶ１６は、
ＲＦビデオ・ライン２４を介してデータ処理装置１２に
接続する。
には、本発明のコンピュータ・システム１０が示されて
いる。図１に示す通り、システム１０は、プログラム・
カートリッジ１４がそれに脱着式に接続されているデー
タ処理装置１２で構成されている。データ処理装置１２
には、標準のテレビ受像機（ＴＶ）１６と、タッチパッ
ド１９および２本のジョイスティック２０ａ、２０ｂを
有する入力装置１８も接続されている。入力装置１８
は、指またはスタイラス２１などによるタッチパッド１
９上での接触位置に対応する座標式データをデータ処理
装置１２に送るものである。また、入力装置１８は、ジ
ョイスティック２０ａ、２０ｂの動きに対応する方向デ
ータをデータ処理装置１２に送る。図１には示されてい
ないが、標準のＴＶ１６は、１対のスピーカと、複合ビ
デオ信号を受け入れる表示装置とで置き換えることがで
きる。入力装置１８は、シリアル・データ・リンク２２
を介してデータ処理装置１２に接続する。ＴＶ１６は、
ＲＦビデオ・ライン２４を介してデータ処理装置１２に
接続する。
【００１３】カートリッジ１４は、エッジ・カード・コ
ネクタ（全体を２６で示す）を有し、このコネクタがカ
ートリッジ・コネクタ２８に接続し、それにより、カー
トリッジ１４内の装置をデータ処理装置１２内の装置に
電気接続する。
ネクタ（全体を２６で示す）を有し、このコネクタがカ
ートリッジ・コネクタ２８に接続し、それにより、カー
トリッジ１４内の装置をデータ処理装置１２内の装置に
電気接続する。
【００１４】データ処理装置１２は、ＳＹＳＴＥＭバス
３１がそれに関連付けられている中央演算処理装置（Ｃ
ＰＵ）３０と、音声／ビデオ（Ａ／Ｖ）コントローラ／
共用プロセッサ３２と、ＳＹＳＴＥＭバス３１からＡ／
Ｖコントローラ／共用プロセッサ３２によって生成され
たＳＹＳＴＥＭ’バス３４に接続されているシステム・
メモリ３３と、第一および第二のデコーダ（図示せず）
と、入出力共用プロセッサ３６と、２つのカートリッジ
・コネクタ（一方は２８で示すが、もう一方は図示せ
ず）と、音声信号およびビデオ信号の生成に必要な追加
回路３８と、拡張コネクタ３９とを含む。これらの装置
は、図１および図２に示すように、回路連絡状態に接続
されている。追加回路３８については、図２に示し、図
２に関連する説明で詳述する。
３１がそれに関連付けられている中央演算処理装置（Ｃ
ＰＵ）３０と、音声／ビデオ（Ａ／Ｖ）コントローラ／
共用プロセッサ３２と、ＳＹＳＴＥＭバス３１からＡ／
Ｖコントローラ／共用プロセッサ３２によって生成され
たＳＹＳＴＥＭ’バス３４に接続されているシステム・
メモリ３３と、第一および第二のデコーダ（図示せず）
と、入出力共用プロセッサ３６と、２つのカートリッジ
・コネクタ（一方は２８で示すが、もう一方は図示せ
ず）と、音声信号およびビデオ信号の生成に必要な追加
回路３８と、拡張コネクタ３９とを含む。これらの装置
は、図１および図２に示すように、回路連絡状態に接続
されている。追加回路３８については、図２に示し、図
２に関連する説明で詳述する。
【００１５】当技術分野で周知の通り、ＣＰＵ３０は、
ＤＡＴＡバス、ＡＤＤＲＥＳＳバス、およびＣＯＮＴＲ
ＯＬバスという複数のバスを生成する。これらの３つの
バスをまとめてＳＹＳＴＥＭバス３１と呼ぶ。実施例で
は、ＣＰＵ３０は、インテル社（3065 Bowers Ave., Sa
nta Clara, California, 95051）製の８０３７６であ
る。この８０３７６は、当技術分野で周知であり、同じ
くインテル社から販売されている周知の８０３８６ＳＸ
のバリエーションの１つである。８０３７６が８０３８
６ＳＸと異なる点は、８０３７６の始動時のモードが１
６ビット・モードではなく、３２ビット・モードである
ことである。具体的には、ＣＲ０レジスタが強制的に０
０１１Ｈ（００１１の１６進表記）状態になり、ビット
０が強制的に論理１になるため、３７６が効果的に３２
ビット・メモリ・モードで動作する。また、仮想３８６
動作を可能にするため、ページングが使用可能になって
いる。
ＤＡＴＡバス、ＡＤＤＲＥＳＳバス、およびＣＯＮＴＲ
ＯＬバスという複数のバスを生成する。これらの３つの
バスをまとめてＳＹＳＴＥＭバス３１と呼ぶ。実施例で
は、ＣＰＵ３０は、インテル社（3065 Bowers Ave., Sa
nta Clara, California, 95051）製の８０３７６であ
る。この８０３７６は、当技術分野で周知であり、同じ
くインテル社から販売されている周知の８０３８６ＳＸ
のバリエーションの１つである。８０３７６が８０３８
６ＳＸと異なる点は、８０３７６の始動時のモードが１
６ビット・モードではなく、３２ビット・モードである
ことである。具体的には、ＣＲ０レジスタが強制的に０
０１１Ｈ（００１１の１６進表記）状態になり、ビット
０が強制的に論理１になるため、３７６が効果的に３２
ビット・メモリ・モードで動作する。また、仮想３８６
動作を可能にするため、ページングが使用可能になって
いる。
【００１６】Ａ／Ｖコントローラ／共用プロセッサ３２
は、ＳＹＳＴＥＭバス３１から３本の予備の汎用入出力
デコーダ・ライン（ＧＰＩＯ１、ＧＰＩＯ２、およびＧ
ＰＩＯ３）を生成し、それぞれのラインが３２ビットの
入出力アドレス範囲を提供する。この汎用デコーダは、
Ａ／Ｖコントローラ／共用プロセッサ３２の外部にある
装置に対して３通りのアクティブ・ロー・チップ・イネ
ーブルを提供するのに使用できる。データ処理装置１２
では、この汎用デコーダを使用して、入出力共用プロセ
ッサ３６（ＧＰＩＯ１）および２つのカートリッジ・コ
ネクタ（ＧＰＩＯ２およびＧＰＩＯ３）へのアドレス範
囲を復号する。Ａ／Ｖコントローラ／共用プロセッサ３
２の残りの回路については、後述する。
は、ＳＹＳＴＥＭバス３１から３本の予備の汎用入出力
デコーダ・ライン（ＧＰＩＯ１、ＧＰＩＯ２、およびＧ
ＰＩＯ３）を生成し、それぞれのラインが３２ビットの
入出力アドレス範囲を提供する。この汎用デコーダは、
Ａ／Ｖコントローラ／共用プロセッサ３２の外部にある
装置に対して３通りのアクティブ・ロー・チップ・イネ
ーブルを提供するのに使用できる。データ処理装置１２
では、この汎用デコーダを使用して、入出力共用プロセ
ッサ３６（ＧＰＩＯ１）および２つのカートリッジ・コ
ネクタ（ＧＰＩＯ２およびＧＰＩＯ３）へのアドレス範
囲を復号する。Ａ／Ｖコントローラ／共用プロセッサ３
２の残りの回路については、後述する。
【００１７】システム・メモリ３３は、画面ＲＡＭ、シ
ステムＲＡＭ、およびブートストラップＲＯＭ（いずれ
も図示せず）で構成されている。オンボードの画面ＲＡ
ＭとシステムＲＡＭは、１メガバイトの３２ビットＤＲ
ＡＭである。適当なＤＲＡＭとしては、東芝が製造し、
３２ビット・メモリを提供するよう構成された、１対の
ＴＣＳ１４１７０ＢＪメモリ・チップ（２５６キロバイ
ト×１６ビット）がある。ＣＰＵ３０のアドレス空間の
一部は、Ａ／Ｖコントローラ／共用プロセッサ３２内部
で複数の８ビット・レジスタに復号される。内部の記憶
場所はすべて偶数アドレス境界上にあり、適切な場所で
ワード単位の入出力読み書きを実行することができる。
この特定の実施例では、ワード単位のレジスタ上でバイ
ト単位の書込みを行うことができず、入出力サイクルを
使用して奇数アドレスにアクセスすることもできない。
ステムＲＡＭ、およびブートストラップＲＯＭ（いずれ
も図示せず）で構成されている。オンボードの画面ＲＡ
ＭとシステムＲＡＭは、１メガバイトの３２ビットＤＲ
ＡＭである。適当なＤＲＡＭとしては、東芝が製造し、
３２ビット・メモリを提供するよう構成された、１対の
ＴＣＳ１４１７０ＢＪメモリ・チップ（２５６キロバイ
ト×１６ビット）がある。ＣＰＵ３０のアドレス空間の
一部は、Ａ／Ｖコントローラ／共用プロセッサ３２内部
で複数の８ビット・レジスタに復号される。内部の記憶
場所はすべて偶数アドレス境界上にあり、適切な場所で
ワード単位の入出力読み書きを実行することができる。
この特定の実施例では、ワード単位のレジスタ上でバイ
ト単位の書込みを行うことができず、入出力サイクルを
使用して奇数アドレスにアクセスすることもできない。
【００１８】ブートストラップＲＯＭはいつでも１６ビ
ット長である。このブートストラップＲＯＭは、多くの
メーカが製造している２つの２７Ｃ５１２消去・プログ
ラム可能読取り専用メモリで構成され、それにより、１
２８ＫのブートストラップＲＯＭが提供される。リセッ
ト後、ＲＯＭと内部メモリを収容するＦ２００００Ｈ〜
ＦＦＦＦＦＦＨの１メガバイトのウィンドウが１６メガ
バイトのアドレス範囲全体にわたって繰り返し生成され
る。
ット長である。このブートストラップＲＯＭは、多くの
メーカが製造している２つの２７Ｃ５１２消去・プログ
ラム可能読取り専用メモリで構成され、それにより、１
２８ＫのブートストラップＲＯＭが提供される。リセッ
ト後、ＲＯＭと内部メモリを収容するＦ２００００Ｈ〜
ＦＦＦＦＦＦＨの１メガバイトのウィンドウが１６メガ
バイトのアドレス範囲全体にわたって繰り返し生成され
る。
【００１９】システム・メモリ３３は、複数の装置間で
共用される。Ａ／Ｖコントローラ／共用プロセッサ３２
はシステム・メモリ３３のアービトレータであるため、
ＳＹＳＴＥＭバス３１はＡ／Ｖコントローラ／共用プロ
セッサ３２によってＳＹＳＴＥＭ’バス３４（ＤＡＴ
Ａ’バス、ＡＤＤＲＥＳＳ’バス、およびＣＯＮＴＲＯ
Ｌ’バスで構成されるが、いずれも図示せず）に変更さ
れる。したがって、システム・メモリ３３はＳＹＳＴＥ
Ｍ’バス３４を介してアクセスされる。
共用される。Ａ／Ｖコントローラ／共用プロセッサ３２
はシステム・メモリ３３のアービトレータであるため、
ＳＹＳＴＥＭバス３１はＡ／Ｖコントローラ／共用プロ
セッサ３２によってＳＹＳＴＥＭ’バス３４（ＤＡＴ
Ａ’バス、ＡＤＤＲＥＳＳ’バス、およびＣＯＮＴＲＯ
Ｌ’バスで構成されるが、いずれも図示せず）に変更さ
れる。したがって、システム・メモリ３３はＳＹＳＴＥ
Ｍ’バス３４を介してアクセスされる。
【００２０】入出力共用プロセッサ３６は、入力装置１
８や、キーボード（図示せず）、各種コントローラ（図
示せず）、マウス（図示せず）、およびプリンタ（図示
せず）などの任意選択装置などの多くの入力装置とＣＰ
Ｕ３０とのインタフェースを取る。実施例では、入出力
共用プロセッサ３６は、２ＭＨｚで動作する、モトロー
ラ社製の事前プログラム式ＭＣ６８ＨＣ７０５Ｃ８（以
下「６８ＨＣ７０５」という）である。この６８ＨＣ７
０５入出力共用プロセッサ３６とＣＰＵ３０とのインタ
フェースは、（１）ＰＡ０〜ＰＡ７をＤＡＴＡバスのＤ
０〜Ｄ７に接続し、（２）ＰＢ７、ＰＢ１、およびＰＢ
２をＣＯＮＴＲＯＬバスおよびＡＤＤＲＥＳＳバスのＧ
ＰＩＯ１（前述の通り、Ａ／Ｖコントローラ／共用プロ
セッサ３２によって復号された３２バイトのアドレス範
囲）、Ａ１、およびＡ２にそれぞれ接続し、（３）ＰＢ
３、ＰＢ４、およびＰＢ５をＣＯＮＴＲＯＬバスのＡＤ
Ｓ、ＲＥＡＤＹ、およびＷ／Ｒにそれぞれ接続し、６８
ＨＣ７０５を周辺装置として構成することで実現され
る。入出力共用プロセッサ３６は、入出力空間に４つの
１６ビット・アドレス（ここではＡＳ０、ＡＳ２、ＡＳ
４、およびＡＳ６という）を持つようにＡ／Ｖコントロ
ーラ／共用プロセッサによって復号される。
８や、キーボード（図示せず）、各種コントローラ（図
示せず）、マウス（図示せず）、およびプリンタ（図示
せず）などの任意選択装置などの多くの入力装置とＣＰ
Ｕ３０とのインタフェースを取る。実施例では、入出力
共用プロセッサ３６は、２ＭＨｚで動作する、モトロー
ラ社製の事前プログラム式ＭＣ６８ＨＣ７０５Ｃ８（以
下「６８ＨＣ７０５」という）である。この６８ＨＣ７
０５入出力共用プロセッサ３６とＣＰＵ３０とのインタ
フェースは、（１）ＰＡ０〜ＰＡ７をＤＡＴＡバスのＤ
０〜Ｄ７に接続し、（２）ＰＢ７、ＰＢ１、およびＰＢ
２をＣＯＮＴＲＯＬバスおよびＡＤＤＲＥＳＳバスのＧ
ＰＩＯ１（前述の通り、Ａ／Ｖコントローラ／共用プロ
セッサ３２によって復号された３２バイトのアドレス範
囲）、Ａ１、およびＡ２にそれぞれ接続し、（３）ＰＢ
３、ＰＢ４、およびＰＢ５をＣＯＮＴＲＯＬバスのＡＤ
Ｓ、ＲＥＡＤＹ、およびＷ／Ｒにそれぞれ接続し、６８
ＨＣ７０５を周辺装置として構成することで実現され
る。入出力共用プロセッサ３６は、入出力空間に４つの
１６ビット・アドレス（ここではＡＳ０、ＡＳ２、ＡＳ
４、およびＡＳ６という）を持つようにＡ／Ｖコントロ
ーラ／共用プロセッサによって復号される。
【００２１】６８ＨＣ７０５内のプログラムは、次のよ
うにＣＰＵ３０とのインタフェースを取る。６８ＨＣ７
０５は、プロセッサのバスに直接接続して、ＣＰＵ３０
への入出力ポートとして機能するように設計されてい
る。それぞれのプロセッサとの間で行うデータのやりと
りは、他のすべてのプロセッサがそのデータを受け取れ
る状態になるまで、１対の内部ラッチによって保持され
る。各プロセッサへの状況ビットは、データ・ラッチの
状態を示している。各状況ビットは、前のデータが読み
取られたかどうか、および新しいデータが状況ビットを
検査することにより読み取られるのを待っているかどう
かを示すことができる。
うにＣＰＵ３０とのインタフェースを取る。６８ＨＣ７
０５は、プロセッサのバスに直接接続して、ＣＰＵ３０
への入出力ポートとして機能するように設計されてい
る。それぞれのプロセッサとの間で行うデータのやりと
りは、他のすべてのプロセッサがそのデータを受け取れ
る状態になるまで、１対の内部ラッチによって保持され
る。各プロセッサへの状況ビットは、データ・ラッチの
状態を示している。各状況ビットは、前のデータが読み
取られたかどうか、および新しいデータが状況ビットを
検査することにより読み取られるのを待っているかどう
かを示すことができる。
【００２２】入出力共用プロセッサ３６は、とりわけ、
（１）５０ｍｓタイマ、（２）入力装置から通信パケッ
トを受け取るためのシリアル・コントローラ・リンク、
（３）各カートリッジ・コネクタ内のカートリッジ１４
の有無および拡張コネクタ内の拡張装置またはＣＤドラ
イブの有無を判定するためのカートリッジ／拡張セン
ス、（４）システム・リセット、および（５）Ｉ2Ｃ不
揮発性ＲＡＭ（ＮＶＲＡＭ）インタフェースなどの諸機
能を実現する。また、入出力共用プロセッサ３６は、任
意選択のＣＤ装置とのやりとりを可能にするための任意
選択のＤＳＡコンパクト・ディスク制御用シリアル・ラ
インも実現する。
（１）５０ｍｓタイマ、（２）入力装置から通信パケッ
トを受け取るためのシリアル・コントローラ・リンク、
（３）各カートリッジ・コネクタ内のカートリッジ１４
の有無および拡張コネクタ内の拡張装置またはＣＤドラ
イブの有無を判定するためのカートリッジ／拡張セン
ス、（４）システム・リセット、および（５）Ｉ2Ｃ不
揮発性ＲＡＭ（ＮＶＲＡＭ）インタフェースなどの諸機
能を実現する。また、入出力共用プロセッサ３６は、任
意選択のＣＤ装置とのやりとりを可能にするための任意
選択のＤＳＡコンパクト・ディスク制御用シリアル・ラ
インも実現する。
【００２３】５０ｍｓタイマは、５０ミリ秒の一定間隔
で時間切れになるように６８ＨＣ７０５入出力共用プロ
セッサ３６のウォッチドッグ・タイマを構成することで
実現される。ウォッチドッグ・タイマが時間切れになる
たびに、入出力共用プロセッサ３６は、Ａ／Ｖコントロ
ーラ／共用プロセッサ３２のアナログ割込み０（ＡＩ
０）を使用してＣＰＵ３０に割り込む（Ａ／Ｖコントロ
ーラ／共用プロセッサは、入出力共用プロセッサがＡＩ
０をローにしたのに対する応答として、ＩＲＱラインを
介してＣＰＵに割り込む）。ＣＰＵは、入出力ポートＡ
Ｓ０にバイト０Ｆ０Ｈまたはバイト００Ｈのいずれかを
書き込むことで、５０ｍｓタイマの使用可能および使用
不能を切り替える。デフォルトの場合、タイマは使用可
能になっている。
で時間切れになるように６８ＨＣ７０５入出力共用プロ
セッサ３６のウォッチドッグ・タイマを構成することで
実現される。ウォッチドッグ・タイマが時間切れになる
たびに、入出力共用プロセッサ３６は、Ａ／Ｖコントロ
ーラ／共用プロセッサ３２のアナログ割込み０（ＡＩ
０）を使用してＣＰＵ３０に割り込む（Ａ／Ｖコントロ
ーラ／共用プロセッサは、入出力共用プロセッサがＡＩ
０をローにしたのに対する応答として、ＩＲＱラインを
介してＣＰＵに割り込む）。ＣＰＵは、入出力ポートＡ
Ｓ０にバイト０Ｆ０Ｈまたはバイト００Ｈのいずれかを
書き込むことで、５０ｍｓタイマの使用可能および使用
不能を切り替える。デフォルトの場合、タイマは使用可
能になっている。
【００２４】ＣＰＵの割込み応答サイクル中に、Ａ／Ｖ
コントローラ／共用プロセッサは割込み処理ルーチンの
アドレスをアサートする。この割込み処理ルーチンによ
って、ＣＰＵ３０は、入出力共用プロセッサに対応する
１６ビットの入出力ポートＡＳ０から１バイトまたは複
数バイトを読み取る。入出力ポートＡＳ０を読み取るた
びに、その読取り中、Ａ／Ｖコントローラ／共用プロセ
ッサ３２は入出力共用プロセッサ３６を選択し、それに
より、ＣＰＵ３０と入出力共用プロセッサ３６との間の
データ転送を可能にする。
コントローラ／共用プロセッサは割込み処理ルーチンの
アドレスをアサートする。この割込み処理ルーチンによ
って、ＣＰＵ３０は、入出力共用プロセッサに対応する
１６ビットの入出力ポートＡＳ０から１バイトまたは複
数バイトを読み取る。入出力ポートＡＳ０を読み取るた
びに、その読取り中、Ａ／Ｖコントローラ／共用プロセ
ッサ３２は入出力共用プロセッサ３６を選択し、それに
より、ＣＰＵ３０と入出力共用プロセッサ３６との間の
データ転送を可能にする。
【００２５】入出力共用プロセッサ３６は、５０ｍｓの
割込みに応じてＣＰＵに転送するバイトとして、必ず１
バイトを持っている。このバイトの下位ニブルには、最
後の割込み応答サイクル以降の５０ｍｓタイマの時間切
れ回数が収容され、このバイトの上位ニブルには、ＣＰ
Ｕに転送する入出力装置メッセージの数が収容されてい
る。５０ｍｓタイマが使用不能になっている場合、この
バイトの下位ニブルはゼロになる。１５個を超えるメッ
セージを受け取った場合は、上位ニブルで１５が送ら
れ、残りのメッセージは次の転送時に送られる。この１
バイト目の内容に応じて、ＣＰＵは入出力共用プロセッ
サ３６から後続バイトを読み取る場合もあるが、これら
のバイトは大体、入力装置からのデータのパケットにな
る。通常、入力装置は、それぞれの状態が変化したとき
だけメッセージを送るので、それにより、メッセージ送
信の頻度が非常に低いレベルに維持される。
割込みに応じてＣＰＵに転送するバイトとして、必ず１
バイトを持っている。このバイトの下位ニブルには、最
後の割込み応答サイクル以降の５０ｍｓタイマの時間切
れ回数が収容され、このバイトの上位ニブルには、ＣＰ
Ｕに転送する入出力装置メッセージの数が収容されてい
る。５０ｍｓタイマが使用不能になっている場合、この
バイトの下位ニブルはゼロになる。１５個を超えるメッ
セージを受け取った場合は、上位ニブルで１５が送ら
れ、残りのメッセージは次の転送時に送られる。この１
バイト目の内容に応じて、ＣＰＵは入出力共用プロセッ
サ３６から後続バイトを読み取る場合もあるが、これら
のバイトは大体、入力装置からのデータのパケットにな
る。通常、入力装置は、それぞれの状態が変化したとき
だけメッセージを送るので、それにより、メッセージ送
信の頻度が非常に低いレベルに維持される。
【００２６】入力装置１８およびその他のすべての入力
装置は、シリアル・データ・リンク２２を介して入出力
共用プロセッサ３６に接続されている。個々の入力装置
（たとえば、入力装置１８）は、制御装置の動きをシリ
アル・リンク２２上の伝送に適した形式に変換する。入
力装置１８は、シリアル・データ・ライン２２を介して
データ処理装置１２にデータ・パケットを送る。後述す
るように、データ・パケットの構造は、入力装置のタイ
プに応じて異なる。座標式装置（マウス、アナログ・ジ
ョイスティック、タッチパッドなど）は、スイッチ閉止
式装置（キーボード、ディジタル・ジョイスティック、
スイッチ・パッドなど）とは異なるデータ・パケット構
造を有する。
装置は、シリアル・データ・リンク２２を介して入出力
共用プロセッサ３６に接続されている。個々の入力装置
（たとえば、入力装置１８）は、制御装置の動きをシリ
アル・リンク２２上の伝送に適した形式に変換する。入
力装置１８は、シリアル・データ・ライン２２を介して
データ処理装置１２にデータ・パケットを送る。後述す
るように、データ・パケットの構造は、入力装置のタイ
プに応じて異なる。座標式装置（マウス、アナログ・ジ
ョイスティック、タッチパッドなど）は、スイッチ閉止
式装置（キーボード、ディジタル・ジョイスティック、
スイッチ・パッドなど）とは異なるデータ・パケット構
造を有する。
【００２７】シリアル・コントローラ・リンク２２は、
データ受信ライン、ＶＣＣ（＋５ＶＤＣ）ライン、およ
びアース・ラインという３本のラインで構成されてい
る。シリアル・コントローラ・リンクのデータ受信ライ
ンは、６８ＨＣ７０５のＰＤ０／ＰＤＩピンを使用する
ことで、６８ＨＣ７０５によって実現される。このピン
は、周知の非同期形式を使用するシリアル装置へのイン
タフェースとして使用されるよう設計されている。シリ
アル伝送は、４８００ビット／秒、パリティなし、８つ
のデータ・ビット、および１つのストップ・ビットとい
う形式を有する。代替態様として、クロック式同期形式
も使用できる。シリアル・コントローラ・リンク２２
は、６線式ミニＤＩＮプラグ・コネクタ（図示せず）に
よって、当技術分野で周知の外部装置に接続されてい
る。入力装置はデイジー・チェーン接続になっているた
め、物理的には１つの装置がデータ処理装置１２に接続
されていることになる。たとえば、いわゆるマウス・ポ
インティング・デバイスをシステム１０に追加する場
合、このマウスは入力装置１８に接続され、その入力装
置１８がデータ処理装置１２に接続されるのである。
データ受信ライン、ＶＣＣ（＋５ＶＤＣ）ライン、およ
びアース・ラインという３本のラインで構成されてい
る。シリアル・コントローラ・リンクのデータ受信ライ
ンは、６８ＨＣ７０５のＰＤ０／ＰＤＩピンを使用する
ことで、６８ＨＣ７０５によって実現される。このピン
は、周知の非同期形式を使用するシリアル装置へのイン
タフェースとして使用されるよう設計されている。シリ
アル伝送は、４８００ビット／秒、パリティなし、８つ
のデータ・ビット、および１つのストップ・ビットとい
う形式を有する。代替態様として、クロック式同期形式
も使用できる。シリアル・コントローラ・リンク２２
は、６線式ミニＤＩＮプラグ・コネクタ（図示せず）に
よって、当技術分野で周知の外部装置に接続されてい
る。入力装置はデイジー・チェーン接続になっているた
め、物理的には１つの装置がデータ処理装置１２に接続
されていることになる。たとえば、いわゆるマウス・ポ
インティング・デバイスをシステム１０に追加する場
合、このマウスは入力装置１８に接続され、その入力装
置１８がデータ処理装置１２に接続されるのである。
【００２８】カートリッジ・センスと拡張センスは、そ
れぞれのカートリッジ・コネクタまたは拡張コネクタに
おけるカートリッジ１４の有無を判定するためのもの
で、入出力共用プロセッサ３６によってカートリッジ・
コネクタ２８のピンをポーリングすることで実現され
る。このピンは、システム・プレーナ上の適当なプルア
ップ抵抗（図示せず）によって論理１に引き上げられ、
カートリッジ１４が正しく接続されている場合、このカ
ートリッジ１４によって論理０に引き下げられる。した
がって、それぞれのカートリッジ・センスに１があれ
ば、カートリッジ１４が存在しないことを意味し、０が
あれば、カートリッジ１４が存在することを意味する。
同様に、拡張センスに１があれば、任意選択のＣＤドラ
イブなどの拡張装置が存在しないことを意味し、０があ
れば、拡張装置が存在することを意味する。
れぞれのカートリッジ・コネクタまたは拡張コネクタに
おけるカートリッジ１４の有無を判定するためのもの
で、入出力共用プロセッサ３６によってカートリッジ・
コネクタ２８のピンをポーリングすることで実現され
る。このピンは、システム・プレーナ上の適当なプルア
ップ抵抗（図示せず）によって論理１に引き上げられ、
カートリッジ１４が正しく接続されている場合、このカ
ートリッジ１４によって論理０に引き下げられる。した
がって、それぞれのカートリッジ・センスに１があれ
ば、カートリッジ１４が存在しないことを意味し、０が
あれば、カートリッジ１４が存在することを意味する。
同様に、拡張センスに１があれば、任意選択のＣＤドラ
イブなどの拡張装置が存在しないことを意味し、０があ
れば、拡張装置が存在することを意味する。
【００２９】リセットは、Ａ／Ｖコントローラ／共用プ
ロセッサ３２のリセット信号に関する制御権を入出力共
用プロセッサ３６に与えることで実現され、その後、Ａ
／Ｖコントローラ／共用プロセッサ３２がＣＰＵ３０の
リセット信号を制御する。ＣＰＵ３０は、入出力共用プ
ロセッサ３６によってＡ／Ｖコントローラ／共用プロセ
ッサをリセットすることによりシステム１０をリセット
するよう入出力共用プロセッサ３６に指示することがで
き、その後、Ａ／Ｖコントローラ／共用プロセッサがＣ
ＰＵ３０をリセットする。ＣＰＵは、入出力ポートＡＳ
０にバイト０ＦＦＨを書き込むことで、入出力共用プロ
セッサにシステム・リセットを発生させる。さらに、入
出力共用プロセッサ３６は、システム用の任意選択のリ
セット・スイッチ（図示せず）を監視し、スイッチの閉
止を検出するとシステムをリセットする。
ロセッサ３２のリセット信号に関する制御権を入出力共
用プロセッサ３６に与えることで実現され、その後、Ａ
／Ｖコントローラ／共用プロセッサ３２がＣＰＵ３０の
リセット信号を制御する。ＣＰＵ３０は、入出力共用プ
ロセッサ３６によってＡ／Ｖコントローラ／共用プロセ
ッサをリセットすることによりシステム１０をリセット
するよう入出力共用プロセッサ３６に指示することがで
き、その後、Ａ／Ｖコントローラ／共用プロセッサがＣ
ＰＵ３０をリセットする。ＣＰＵは、入出力ポートＡＳ
０にバイト０ＦＦＨを書き込むことで、入出力共用プロ
セッサにシステム・リセットを発生させる。さらに、入
出力共用プロセッサ３６は、システム用の任意選択のリ
セット・スイッチ（図示せず）を監視し、スイッチの閉
止を検出するとシステムをリセットする。
【００３０】最後に、入出力共用プロセッサは、不揮発
性システムＲＡＭの５１２バイト分の内容の読取り、書
込み、および検査を行うために、Ｉ2Ｃ不揮発性ＲＡＭ
（ＮＶＲＡＭ）インタフェースを実現する。このＮＶＲ
ＡＭ（図示せず）は、フィリップス・セミコンダクタ社
製のＰＣＦ８５９４で構成され、Ｉ2Ｃインタフェース
を介して入出力共用プロセッサと回路連絡状態になって
いる。提供するＮＶＲＡＭ機能を高めるために、複数の
ＰＣＦ８５９４をカスケード接続することができる。Ｎ
ＶＲＡＭにアクセスするには、３バイトのシーケンスを
使用する。これらの３バイトはいずれも入出力ポートＡ
Ｓ０を介してアクセスされる。ＣＰＵによって入出力共
用プロセッサに最初に書き込まれる１バイトは、その転
送が読取りか書込みかを示すもので、入出力共用プロセ
ッサにセグメント・アドレスを示す。このバイトの下位
ニブルは転送のタイプを示し、０１ＨはＮＶＲＡＭへの
書込み、０２ＨはＮＶＲＡＭからの読取りを意味する。
このバイトの上位ニブルは、ＮＶＲＡＭの２５６バイト
のセグメントに対応する４ビットのセグメント番号であ
る。５１２バイトのＮＶＲＡＭの場合は、下から２つの
セグメント（０と１）だけを使用する。読取りの場合も
書込みの場合も、その次のバイトは同じになる。すなわ
ち、次のバイトがＣＰＵによって書き込まれ、そのセグ
メント内でアクセス中のバイトのアドレスになる。最後
のバイトは、ＣＰＵによって入出力共用プロセッサに書
き込まれるか、入出力共用プロセッサから読み取られる
もので、ＮＶＲＡＭから読み取られるか、ＮＶＲＡＭに
書き込まれるデータ・バイトになる。
性システムＲＡＭの５１２バイト分の内容の読取り、書
込み、および検査を行うために、Ｉ2Ｃ不揮発性ＲＡＭ
（ＮＶＲＡＭ）インタフェースを実現する。このＮＶＲ
ＡＭ（図示せず）は、フィリップス・セミコンダクタ社
製のＰＣＦ８５９４で構成され、Ｉ2Ｃインタフェース
を介して入出力共用プロセッサと回路連絡状態になって
いる。提供するＮＶＲＡＭ機能を高めるために、複数の
ＰＣＦ８５９４をカスケード接続することができる。Ｎ
ＶＲＡＭにアクセスするには、３バイトのシーケンスを
使用する。これらの３バイトはいずれも入出力ポートＡ
Ｓ０を介してアクセスされる。ＣＰＵによって入出力共
用プロセッサに最初に書き込まれる１バイトは、その転
送が読取りか書込みかを示すもので、入出力共用プロセ
ッサにセグメント・アドレスを示す。このバイトの下位
ニブルは転送のタイプを示し、０１ＨはＮＶＲＡＭへの
書込み、０２ＨはＮＶＲＡＭからの読取りを意味する。
このバイトの上位ニブルは、ＮＶＲＡＭの２５６バイト
のセグメントに対応する４ビットのセグメント番号であ
る。５１２バイトのＮＶＲＡＭの場合は、下から２つの
セグメント（０と１）だけを使用する。読取りの場合も
書込みの場合も、その次のバイトは同じになる。すなわ
ち、次のバイトがＣＰＵによって書き込まれ、そのセグ
メント内でアクセス中のバイトのアドレスになる。最後
のバイトは、ＣＰＵによって入出力共用プロセッサに書
き込まれるか、入出力共用プロセッサから読み取られる
もので、ＮＶＲＡＭから読み取られるか、ＮＶＲＡＭに
書き込まれるデータ・バイトになる。
【００３１】代替態様として、入出力共用プロセッサを
他の方法で実現することもできる。たとえば、３状態読
取り可能シフト・レジスタは、シリアル・データ・リン
ク２２から情報を受け取るのに適している可能性があ
る。この場合、ＣＰＵ３０は、入力装置からのデータ・
パケットにアクセスするために、シフト・レジスタの内
容を定期的に読み取る。
他の方法で実現することもできる。たとえば、３状態読
取り可能シフト・レジスタは、シリアル・データ・リン
ク２２から情報を受け取るのに適している可能性があ
る。この場合、ＣＰＵ３０は、入力装置からのデータ・
パケットにアクセスするために、シフト・レジスタの内
容を定期的に読み取る。
【００３２】第一のデコーダ・チップ（図示せず）は、
ＣＰＵ３０、Ａ／Ｖコントローラ／共用プロセッサ３
２、および２つのカートリッジ・コネクタ２８（一方は
図示せず）と電気回路連絡状態になっている。第一のデ
コーダ・チップは、ＳＹＳＴＥＭバス３１の上位２本の
アドレス・ラインを入力として受け入れ、８０３７６Ｃ
ＰＵ３０の１６メガバイトのアドレス空間を３本のチッ
プ選択ラインによって表される４つの４メガバイトの領
域に復号する。その３本のうち２本はカートリッジ・コ
ネクタ２８（一方は図示せず）用であり、１本はＡ／Ｖ
コントローラ／共用プロセッサ３２用である。上位の４
メガバイトの領域と下位の４メガバイトの領域はＡ／Ｖ
コントローラ／共用プロセッサのチップ選択に復号さ
れ、残りの２つの４メガバイトの領域は２つのカートリ
ッジ・コネクタ・チップ選択に復号される。
ＣＰＵ３０、Ａ／Ｖコントローラ／共用プロセッサ３
２、および２つのカートリッジ・コネクタ２８（一方は
図示せず）と電気回路連絡状態になっている。第一のデ
コーダ・チップは、ＳＹＳＴＥＭバス３１の上位２本の
アドレス・ラインを入力として受け入れ、８０３７６Ｃ
ＰＵ３０の１６メガバイトのアドレス空間を３本のチッ
プ選択ラインによって表される４つの４メガバイトの領
域に復号する。その３本のうち２本はカートリッジ・コ
ネクタ２８（一方は図示せず）用であり、１本はＡ／Ｖ
コントローラ／共用プロセッサ３２用である。上位の４
メガバイトの領域と下位の４メガバイトの領域はＡ／Ｖ
コントローラ／共用プロセッサのチップ選択に復号さ
れ、残りの２つの４メガバイトの領域は２つのカートリ
ッジ・コネクタ・チップ選択に復号される。
【００３３】第二のデコーダ・チップ（図示せず）は、
拡張コネクタ３９用のチップ選択を実現するために使用
される。この第二のデコーダ・チップは、ＳＹＳＴＥ
Ｍ’バス３４に沿ってＡ／Ｖコントローラ／共用プロセ
ッサ３２および拡張コネクタ３９と回路連絡状態になっ
ている。第二のデコーダ・チップにより、Ａ／Ｖコント
ローラ／共用プロセッサ３２は、Ｆ２００００Ｈから始
まるシステムＲＯＭの１２８Ｋのブロックを復号するこ
とができる。Ｆ４００００Ｈ〜ＦＦＦＦＦＦＨの範囲
は、拡張コネクタ３９が使用するために、第二のデコー
ダ・チップによって復号される。第二のデコーダ・チッ
プによって復号されるこのブロックのＲＯＭは、拡張コ
ネクタ３９を介してシステム１０にＲＯＭを追加する場
合に使用する。
拡張コネクタ３９用のチップ選択を実現するために使用
される。この第二のデコーダ・チップは、ＳＹＳＴＥ
Ｍ’バス３４に沿ってＡ／Ｖコントローラ／共用プロセ
ッサ３２および拡張コネクタ３９と回路連絡状態になっ
ている。第二のデコーダ・チップにより、Ａ／Ｖコント
ローラ／共用プロセッサ３２は、Ｆ２００００Ｈから始
まるシステムＲＯＭの１２８Ｋのブロックを復号するこ
とができる。Ｆ４００００Ｈ〜ＦＦＦＦＦＦＨの範囲
は、拡張コネクタ３９が使用するために、第二のデコー
ダ・チップによって復号される。第二のデコーダ・チッ
プによって復号されるこのブロックのＲＯＭは、拡張コ
ネクタ３９を介してシステム１０にＲＯＭを追加する場
合に使用する。
【００３４】データ処理装置１２は、カートリッジ１４
をＣＰＵ３０および他のシステム構成要素と回路連絡状
態にするために１対のカートリッジ・コネクタ（一方は
２８で示し、もう一方は図示せず）も有する。カートリ
ッジ１４は、金メッキを施した６２ピン（３１本の導線
が２列になっている）のエッジ・カード・コネクタ２６
を介してデータ処理装置１２のコネクタ２８に接続して
いる。データ処理装置１２は、エッジ・カード・コネク
タ２６のエッジ・カード接続部を受け入れるために２つ
のカートリッジ・コネクタ２８を有する。カートリッジ
１４は、コネクタ２８の導線を突き合わせるために金メ
ッキを施したカード・エッジ接続部を有し、カートリッ
ジ１４をデータ処理装置１２にプラグ式に接続できるよ
うになっている。カートリッジ・コネクタ２８（もう一
方は図示せず）では、ＳＹＳＴＥＭバス３１信号、カー
トリッジ・センス・ライン、電源、アース、アナログ割
込み１または２（それぞれのカートリッジが固有の割込
みを１つずつ持っている）、ＧＰＩＯ２または３（それ
ぞれのカートリッジが固有のチップ選択を１つずつ持っ
ている）、ロック・ライン（８０３７６および８０３８
６ＳＸのＳＹＳＴＥＭバス３１の典型的な信号であ
る）、および第一のデコーダ・チップによって生成され
るカートリッジ選択などの信号が外部装置に送られる。
代替態様として、任意選択のＣＤドライブを接続するの
に必要な信号も、カートリッジ・コネクタ２８を介して
外部装置に接続することができる。
をＣＰＵ３０および他のシステム構成要素と回路連絡状
態にするために１対のカートリッジ・コネクタ（一方は
２８で示し、もう一方は図示せず）も有する。カートリ
ッジ１４は、金メッキを施した６２ピン（３１本の導線
が２列になっている）のエッジ・カード・コネクタ２６
を介してデータ処理装置１２のコネクタ２８に接続して
いる。データ処理装置１２は、エッジ・カード・コネク
タ２６のエッジ・カード接続部を受け入れるために２つ
のカートリッジ・コネクタ２８を有する。カートリッジ
１４は、コネクタ２８の導線を突き合わせるために金メ
ッキを施したカード・エッジ接続部を有し、カートリッ
ジ１４をデータ処理装置１２にプラグ式に接続できるよ
うになっている。カートリッジ・コネクタ２８（もう一
方は図示せず）では、ＳＹＳＴＥＭバス３１信号、カー
トリッジ・センス・ライン、電源、アース、アナログ割
込み１または２（それぞれのカートリッジが固有の割込
みを１つずつ持っている）、ＧＰＩＯ２または３（それ
ぞれのカートリッジが固有のチップ選択を１つずつ持っ
ている）、ロック・ライン（８０３７６および８０３８
６ＳＸのＳＹＳＴＥＭバス３１の典型的な信号であ
る）、および第一のデコーダ・チップによって生成され
るカートリッジ選択などの信号が外部装置に送られる。
代替態様として、任意選択のＣＤドライブを接続するの
に必要な信号も、カートリッジ・コネクタ２８を介して
外部装置に接続することができる。
【００３５】さらに、データ処理装置１２は、単一の１
１２ピン（５６ピンずつ２列）のエッジ・カード拡張コ
ネクタ３９を有する。この拡張コネクタ３９によって、
各種装置はシステム・メモリ３３にさらにメモリを追加
することができ、その他の様々な機構を追加することが
できる。拡張コネクタ３９に接続されている装置は、拡
張コネクタと突き合わせるために金メッキを施したカー
ド・エッジを有し、装置をデータ処理装置１２にプラグ
式に接続することができるようになっている。拡張コネ
クタ３９では、ＳＹＳＴＥＭ’バス信号、拡張コネクタ
３９センス・ライン、電源、アース、ＣＡＳおよびＲＡ
Ｓライン、および第二のデコーダ・チップによって生成
される拡張コネクタ３９選択などの信号が外部装置に送
られる。代替態様として、任意選択のＣＤドライブを接
続するのに必要な信号も、拡張コネクタ３９を介して外
部装置に接続することができる。
１２ピン（５６ピンずつ２列）のエッジ・カード拡張コ
ネクタ３９を有する。この拡張コネクタ３９によって、
各種装置はシステム・メモリ３３にさらにメモリを追加
することができ、その他の様々な機構を追加することが
できる。拡張コネクタ３９に接続されている装置は、拡
張コネクタと突き合わせるために金メッキを施したカー
ド・エッジを有し、装置をデータ処理装置１２にプラグ
式に接続することができるようになっている。拡張コネ
クタ３９では、ＳＹＳＴＥＭ’バス信号、拡張コネクタ
３９センス・ライン、電源、アース、ＣＡＳおよびＲＡ
Ｓライン、および第二のデコーダ・チップによって生成
される拡張コネクタ３９選択などの信号が外部装置に送
られる。代替態様として、任意選択のＣＤドライブを接
続するのに必要な信号も、拡張コネクタ３９を介して外
部装置に接続することができる。
【００３６】プログラム・カートリッジ１４は、プログ
ラムＲＯＭ４０とデコーダ４２で構成されている。代替
態様として、デコーダ４２をデータ処理装置１２内に設
計することもできる。プログラムＲＯＭ４０には、ＣＰ
Ｕ３０上で実行するのに適したコードが読取り専用メモ
リ形式で収容されている。代替態様として、バッテリ・
バックアップ式ＲＡＭなどのその他のメモリ・タイプ
を、カートリッジ１４内の記憶装置として使用すること
もできる。プログラムＲＯＭ４０は、図１に示すように
ＣＰＵ３０と回路連絡状態になっている。
ラムＲＯＭ４０とデコーダ４２で構成されている。代替
態様として、デコーダ４２をデータ処理装置１２内に設
計することもできる。プログラムＲＯＭ４０には、ＣＰ
Ｕ３０上で実行するのに適したコードが読取り専用メモ
リ形式で収容されている。代替態様として、バッテリ・
バックアップ式ＲＡＭなどのその他のメモリ・タイプ
を、カートリッジ１４内の記憶装置として使用すること
もできる。プログラムＲＯＭ４０は、図１に示すように
ＣＰＵ３０と回路連絡状態になっている。
【００３７】カートリッジ１４内部のアドレス・デコー
ダ４２は、プログラムＲＯＭ４０に適したメモリ範囲に
応じて、ＡＤＤＲＥＳＳバスの幅全体を復号し、当技術
分野で周知の通り、ＲＯＭ４０が要求するチップ選択信
号４４を生成する。アドレス・デコーダ４２は、当技術
分野で周知であり、ＡＭＤ社などの多くのメーカが製造
する、１６Ｖ８プログラマブル・アレイ・ロジック（Ｐ
ＡＬ）内に実現されている。デコーダ４２がデータ処理
装置１２内に設計されている場合、選択信号４４がコネ
クタ２６によってＲＯＭ４０に電気的に送られる。
ダ４２は、プログラムＲＯＭ４０に適したメモリ範囲に
応じて、ＡＤＤＲＥＳＳバスの幅全体を復号し、当技術
分野で周知の通り、ＲＯＭ４０が要求するチップ選択信
号４４を生成する。アドレス・デコーダ４２は、当技術
分野で周知であり、ＡＭＤ社などの多くのメーカが製造
する、１６Ｖ８プログラマブル・アレイ・ロジック（Ｐ
ＡＬ）内に実現されている。デコーダ４２がデータ処理
装置１２内に設計されている場合、選択信号４４がコネ
クタ２６によってＲＯＭ４０に電気的に送られる。
【００３８】次に図２を参照して説明すると、同図に
は、図１の追加回路３８がＡ／Ｖコントローラ／共用プ
ロセッサ３２に接続された状態で示されている。この追
加回路３８は、ビデオ・ディジタル・アナログ変換器
（ビデオＤＡＣ）５０、ＮＴＳＣ／ＰＡＬ（”ＰＡＬ”
は周知の欧州テレビ信号規格を指す）エンコーダ５２、
音声ディジタル・アナログ変換器／アナログ・ディジタ
ル変換器／圧縮器／圧縮解除器（ＡＤＣ／ＤＡＣ／ＣＯ
ＤＥＣ）５４、およびＲＦ変調装置５６という４つの装
置で構成されている。それぞれの装置は図に示す通りに
接続されている。
は、図１の追加回路３８がＡ／Ｖコントローラ／共用プ
ロセッサ３２に接続された状態で示されている。この追
加回路３８は、ビデオ・ディジタル・アナログ変換器
（ビデオＤＡＣ）５０、ＮＴＳＣ／ＰＡＬ（”ＰＡＬ”
は周知の欧州テレビ信号規格を指す）エンコーダ５２、
音声ディジタル・アナログ変換器／アナログ・ディジタ
ル変換器／圧縮器／圧縮解除器（ＡＤＣ／ＤＡＣ／ＣＯ
ＤＥＣ）５４、およびＲＦ変調装置５６という４つの装
置で構成されている。それぞれの装置は図に示す通りに
接続されている。
【００３９】音声／ビデオ・コントローラ／共用プロセ
ッサ（Ａ／Ｖコントローラ／共用プロセッサ）３２とい
う電子回路は、たいていＡＳＩＣ（特定用途向けＩＣ）
と呼ばれる１つの大規模カスタム論理チップ内に収容さ
れている。本明細書の説明に適合するＡ／Ｖコントロー
ラ／共用プロセッサ３２は、ＭＳＵ社（270 Upper 4th
Street, Witan Gate West, Central Milton Keynes, MK
9 1DP England）から購入することができる。Ａ／Ｖコ
ントローラ／共用プロセッサ３２には、プロセッサ・イ
ンタフェース６０、プロセッサ・キャッシュ６２、メモ
リ・インタフェース／リフレッシュ６４、ビデオ・コン
トローラ６６、割込みコントローラ６８、ビデオ・ブリ
ッタ７０、任意選択のＣＤブロック・デコーダ、ディジ
タル信号プロセッサ（ＤＳＰ）７４、およびＤＳＰメモ
リ７６が含まれている。プロセッサ・インタフェース６
０、メモリ・インタフェース／リフレッシュ６４、およ
びビデオ・コントローラ６６をまとめてビデオ／メモリ
・コントローラ６７と呼ぶ。システム・メモリ３３、中
央演算処理装置３０、およびその他の装置は、Ａ／Ｖコ
ントローラ／共用プロセッサ３２の外側に位置する。
ッサ（Ａ／Ｖコントローラ／共用プロセッサ）３２とい
う電子回路は、たいていＡＳＩＣ（特定用途向けＩＣ）
と呼ばれる１つの大規模カスタム論理チップ内に収容さ
れている。本明細書の説明に適合するＡ／Ｖコントロー
ラ／共用プロセッサ３２は、ＭＳＵ社（270 Upper 4th
Street, Witan Gate West, Central Milton Keynes, MK
9 1DP England）から購入することができる。Ａ／Ｖコ
ントローラ／共用プロセッサ３２には、プロセッサ・イ
ンタフェース６０、プロセッサ・キャッシュ６２、メモ
リ・インタフェース／リフレッシュ６４、ビデオ・コン
トローラ６６、割込みコントローラ６８、ビデオ・ブリ
ッタ７０、任意選択のＣＤブロック・デコーダ、ディジ
タル信号プロセッサ（ＤＳＰ）７４、およびＤＳＰメモ
リ７６が含まれている。プロセッサ・インタフェース６
０、メモリ・インタフェース／リフレッシュ６４、およ
びビデオ・コントローラ６６をまとめてビデオ／メモリ
・コントローラ６７と呼ぶ。システム・メモリ３３、中
央演算処理装置３０、およびその他の装置は、Ａ／Ｖコ
ントローラ／共用プロセッサ３２の外側に位置する。
【００４０】Ａ／Ｖコントローラ／共用プロセッサ３２
は、ＳＹＳＴＥＭバス３１からＳＹＳＴＥＭ’バス３４
を生成し、それにより、システム・メモリ３３からＣＰ
Ｕ３０を分離している。このため、ＳＹＳＴＥＭ’バス
３４は、システム・メモリ３３に様々な装置を接続す
る。ＳＹＳＴＥＭ’バス３４を共用するものとしては、
メモリ・リフレッシュ６４、ビデオ・コントローラ６
６、任意選択のＣＤブロック・デコーダ（図示せず）、
ＤＳＰ７４、ブリッタ７０、およびＣＰＵ３０（プロセ
ッサ・インタフェース６０による）という６通りのバス
・マスタ（優先順位が最高のものから最低のものへの順
に示す）が考えられる。ＳＹＳＴＥＭ’バス３４を制御
できるのは、一度に１つのバス・マスタだけである。ビ
デオ／メモリ・コントローラ６７は、ここで説明するよ
うに各種装置の様々な優先順位を制御するもので、Ａ／
Ｖコントローラ／共用プロセッサ３２内のすべての装置
と電気回路連絡状態になっている。たとえば、ＣＰＵ３
０は、割込みが発生するまではすべてのバス・マスタの
うちで優先順位が最低になる。このため、アービトレー
タがＣＰＵインタフェース６０と割込みコントローラ６
８の両方に回路連絡状態になっている。
は、ＳＹＳＴＥＭバス３１からＳＹＳＴＥＭ’バス３４
を生成し、それにより、システム・メモリ３３からＣＰ
Ｕ３０を分離している。このため、ＳＹＳＴＥＭ’バス
３４は、システム・メモリ３３に様々な装置を接続す
る。ＳＹＳＴＥＭ’バス３４を共用するものとしては、
メモリ・リフレッシュ６４、ビデオ・コントローラ６
６、任意選択のＣＤブロック・デコーダ（図示せず）、
ＤＳＰ７４、ブリッタ７０、およびＣＰＵ３０（プロセ
ッサ・インタフェース６０による）という６通りのバス
・マスタ（優先順位が最高のものから最低のものへの順
に示す）が考えられる。ＳＹＳＴＥＭ’バス３４を制御
できるのは、一度に１つのバス・マスタだけである。ビ
デオ／メモリ・コントローラ６７は、ここで説明するよ
うに各種装置の様々な優先順位を制御するもので、Ａ／
Ｖコントローラ／共用プロセッサ３２内のすべての装置
と電気回路連絡状態になっている。たとえば、ＣＰＵ３
０は、割込みが発生するまではすべてのバス・マスタの
うちで優先順位が最低になる。このため、アービトレー
タがＣＰＵインタフェース６０と割込みコントローラ６
８の両方に回路連絡状態になっている。
【００４１】キャッシュ６２は、ＣＰＵ３０用の命令を
先取りするという意味でのキャッシュではない。むし
ろ、キャッシュ６２は、プログラムの実行を高速化する
ためのプログラム・コード、スタック、または変数用と
してＣＰＵ３０が使用できる、Ｆ１４０００Ｈ〜Ｆ１４
３ＦＦＨに位置する５１２×１６ビットのスタティック
ＲＡＭである。
先取りするという意味でのキャッシュではない。むし
ろ、キャッシュ６２は、プログラムの実行を高速化する
ためのプログラム・コード、スタック、または変数用と
してＣＰＵ３０が使用できる、Ｆ１４０００Ｈ〜Ｆ１４
３ＦＦＨに位置する５１２×１６ビットのスタティック
ＲＡＭである。
【００４２】ビデオ／メモリ・コントローラ６７（プロ
セッサ・インタフェース６０、メモリ・インタフェース
／リフレッシュ６４、およびビデオ・コントローラ６
６）は、ＳＹＳＴＥＭ’バス３４を制御し、当技術分野
で周知の通り、ＳＹＳＴＥＭ’バス３４に接続されたメ
モリ装置にメモリ・タイミング信号（たとえば、ＣＡ
Ｓ、ＲＡＳ、書込み可能など）を提供する。このコント
ローラは、ビデオ表示データを取り出し、ダイナミック
ＲＡＭ（ＤＲＡＭ）をリフレッシュするために、ビデオ
・ライン中のバス・マスタ操作を短期間の間、中断す
る。また、このコントローラは、ＣＰＵ３０とのインタ
フェースも制御する。
セッサ・インタフェース６０、メモリ・インタフェース
／リフレッシュ６４、およびビデオ・コントローラ６
６）は、ＳＹＳＴＥＭ’バス３４を制御し、当技術分野
で周知の通り、ＳＹＳＴＥＭ’バス３４に接続されたメ
モリ装置にメモリ・タイミング信号（たとえば、ＣＡ
Ｓ、ＲＡＳ、書込み可能など）を提供する。このコント
ローラは、ビデオ表示データを取り出し、ダイナミック
ＲＡＭ（ＤＲＡＭ）をリフレッシュするために、ビデオ
・ライン中のバス・マスタ操作を短期間の間、中断す
る。また、このコントローラは、ＣＰＵ３０とのインタ
フェースも制御する。
【００４３】ビデオ・コントローラ６６は、様々なＴＶ
規格に適合するようにプログラミング可能なフレキシブ
ル・ビデオ・タイミング発生器を有し、最高６４０×４
８０までのＶＧＡ規格を監視する。正確なビデオ形式
は、水平周期、水平同期、水平帰線消去終了、水平帰線
消去開始、水平表示開始、水平表示終了、水平取出し開
始、水平取出し終了、水平垂直同期、垂直周期、垂直同
期、垂直帰線消去終了、垂直帰線消去開始、垂直表示開
始、垂直表示終了、ビデオ割込み、およびライト・ペン
というＡ／Ｖコントローラ／共用プロセッサ内の様々な
レジスタを設定することによって制御される。また、ビ
デオ・コントローラ６６には、４ビット／ピクセル、８
ビット／ピクセル、および１６ビット／ピクセルという
３通りのカラー解像度が用意されている。画面のメモリ
・マップは、表示装置の幅に拘束されるわけではない
が、独立して定義される。
規格に適合するようにプログラミング可能なフレキシブ
ル・ビデオ・タイミング発生器を有し、最高６４０×４
８０までのＶＧＡ規格を監視する。正確なビデオ形式
は、水平周期、水平同期、水平帰線消去終了、水平帰線
消去開始、水平表示開始、水平表示終了、水平取出し開
始、水平取出し終了、水平垂直同期、垂直周期、垂直同
期、垂直帰線消去終了、垂直帰線消去開始、垂直表示開
始、垂直表示終了、ビデオ割込み、およびライト・ペン
というＡ／Ｖコントローラ／共用プロセッサ内の様々な
レジスタを設定することによって制御される。また、ビ
デオ・コントローラ６６には、４ビット／ピクセル、８
ビット／ピクセル、および１６ビット／ピクセルという
３通りのカラー解像度が用意されている。画面のメモリ
・マップは、表示装置の幅に拘束されるわけではない
が、独立して定義される。
【００４４】ビデオ／メモリ・コントローラ６７は、８
０３７６ ＣＰＵ３０の１６メガバイトのアドレス範囲
を、１ＭＢのシステムＲＡＭ（００００００Ｈ〜０ＦＦ
ＦＦＦＨ）、第一のカートリッジＲＯＭ用の４ＭＢ（４
０００００〜７ＦＦＦＦＦＨ）、第二のカートリッジＲ
ＯＭ用の４ＭＢ（８０００００〜ＢＦＦＦＦＦＨ）、６
４ＫＢの音声／ビデオ・コントローラ／共用プロセッサ
用内部メモリ（Ｆ１００００Ｈ〜Ｆ１ＦＦＦＦＨ）、お
よび１２８ＫＢブロックのシステムＲＯＭ（ＦＥ０００
０Ｈ〜ＦＦＦＦＦＦＨ）というメモリ・マップに復号す
る。６４ＫＢの内部メモリは、パレットＲＡＭ、ブリッ
タ・レジスタ、およびＤＳＰレジスタとＤＳＰメモリで
構成されている。パレットのアドレス範囲については前
述の通りである。ブリッタ・レジスタは、Ｆ１０４００
Ｈ〜Ｆ１０７ＦＦＨの範囲に及ぶ。また、ＤＳＰメモリ
は、Ｆ１０８００Ｈ〜Ｆ１８０００Ｈの範囲に及ぶ。
０３７６ ＣＰＵ３０の１６メガバイトのアドレス範囲
を、１ＭＢのシステムＲＡＭ（００００００Ｈ〜０ＦＦ
ＦＦＦＨ）、第一のカートリッジＲＯＭ用の４ＭＢ（４
０００００〜７ＦＦＦＦＦＨ）、第二のカートリッジＲ
ＯＭ用の４ＭＢ（８０００００〜ＢＦＦＦＦＦＨ）、６
４ＫＢの音声／ビデオ・コントローラ／共用プロセッサ
用内部メモリ（Ｆ１００００Ｈ〜Ｆ１ＦＦＦＦＨ）、お
よび１２８ＫＢブロックのシステムＲＯＭ（ＦＥ０００
０Ｈ〜ＦＦＦＦＦＦＨ）というメモリ・マップに復号す
る。６４ＫＢの内部メモリは、パレットＲＡＭ、ブリッ
タ・レジスタ、およびＤＳＰレジスタとＤＳＰメモリで
構成されている。パレットのアドレス範囲については前
述の通りである。ブリッタ・レジスタは、Ｆ１０４００
Ｈ〜Ｆ１０７ＦＦＨの範囲に及ぶ。また、ＤＳＰメモリ
は、Ｆ１０８００Ｈ〜Ｆ１８０００Ｈの範囲に及ぶ。
【００４５】任意選択のＣＤドライブをシステムに追加
する場合は、さらに１ＭＢのシステムＲＡＭ（１０００
００Ｈ〜１ＦＦＦＦＦＨ）と、ＣＤドライブ用の１２８
ＫＢ（ＦＣ００００Ｈ〜ＦＤＦＦＦＦＨ）の領域がメモ
リ・マップに追加される。
する場合は、さらに１ＭＢのシステムＲＡＭ（１０００
００Ｈ〜１ＦＦＦＦＦＨ）と、ＣＤドライブ用の１２８
ＫＢ（ＦＣ００００Ｈ〜ＦＤＦＦＦＦＨ）の領域がメモ
リ・マップに追加される。
【００４６】割込みコントローラ６８は、ビデオ割込み
（優先順位最高）、アナログ割込み０（ＡＩ０）、アナ
ログ割込み１（ＡＩ１）、アナログ割込み２（ＡＩ
２）、ＣＤブロック・デコーダ割込み、およびＤＳＰ割
込み（優先順位最低）の６つの内部割込みとＣＰＵ３０
とのインタフェースを取る。ＣＰＵ３０が割込み応答サ
イクルを実行すると、この割込みコントローラが自動的
に割込みをクリアする。それぞれの割込み用として、マ
スク・ビットが１つずつ用意されている。
（優先順位最高）、アナログ割込み０（ＡＩ０）、アナ
ログ割込み１（ＡＩ１）、アナログ割込み２（ＡＩ
２）、ＣＤブロック・デコーダ割込み、およびＤＳＰ割
込み（優先順位最低）の６つの内部割込みとＣＰＵ３０
とのインタフェースを取る。ＣＰＵ３０が割込み応答サ
イクルを実行すると、この割込みコントローラが自動的
に割込みをクリアする。それぞれの割込み用として、マ
スク・ビットが１つずつ用意されている。
【００４７】ブリッタ７０は、高速画面更新およびアニ
メーション用のグラフィック・プロセッサであり、ＣＰ
Ｕ３０またはＤＳＰ７４用のハードウェア・グラフィッ
ク・サブルーチンとして機能する。このブリッタは、Ｃ
ＰＵ３０とＤＳＰ７４がメモリに書き込んだコマンドを
実行する。ブリッタは、システム・メモリ３３から新し
いコマンド・セットを読み取ることで、長く続く一連の
グラフィック操作を任意に実行することができる。ま
た、ブリッタは、ブリッタ・プログラムの操作によって
バス・マスタになるので、長期間にわたってＳＹＳＴＥ
Ｍ’バス３４を排他的に制御することができる。しか
し、ＣＰＵ３０に対するブリッタの優先順位は絶対的な
ものではないので、割込みが発生すると、ＳＹＳＴＥ
Ｍ’バス３４をＣＰＵ３０に引き渡すよう要求される場
合もある。ＣＰＵ３０のバス・マスタに対する優先順位
はシステム・レベルでは最低であるが、他のハードウェ
アを完全に制御しているため、ＳＹＳＴＥＭ’バス３４
の使用はＣＰＵ３０のプログラムによって完全に制御さ
れる。
メーション用のグラフィック・プロセッサであり、ＣＰ
Ｕ３０またはＤＳＰ７４用のハードウェア・グラフィッ
ク・サブルーチンとして機能する。このブリッタは、Ｃ
ＰＵ３０とＤＳＰ７４がメモリに書き込んだコマンドを
実行する。ブリッタは、システム・メモリ３３から新し
いコマンド・セットを読み取ることで、長く続く一連の
グラフィック操作を任意に実行することができる。ま
た、ブリッタは、ブリッタ・プログラムの操作によって
バス・マスタになるので、長期間にわたってＳＹＳＴＥ
Ｍ’バス３４を排他的に制御することができる。しか
し、ＣＰＵ３０に対するブリッタの優先順位は絶対的な
ものではないので、割込みが発生すると、ＳＹＳＴＥ
Ｍ’バス３４をＣＰＵ３０に引き渡すよう要求される場
合もある。ＣＰＵ３０のバス・マスタに対する優先順位
はシステム・レベルでは最低であるが、他のハードウェ
アを完全に制御しているため、ＳＹＳＴＥＭ’バス３４
の使用はＣＰＵ３０のプログラムによって完全に制御さ
れる。
【００４８】ブリッタ７０は、インテリジェント・ブリ
ット操作を可能にするための汎用比較器と、出力データ
を生成するための論理関数ユニット（ＬＦＵ）とを有す
る。この論理関数ユニットは複数の有益な方法でデータ
・レジスタの内容を組み合わせて出力データを生成する
ことができ、比較器はそのデータに対して所与の比較を
実行して書込み操作を禁止し、任意でブリッタ操作を停
止することができる。
ット操作を可能にするための汎用比較器と、出力データ
を生成するための論理関数ユニット（ＬＦＵ）とを有す
る。この論理関数ユニットは複数の有益な方法でデータ
・レジスタの内容を組み合わせて出力データを生成する
ことができ、比較器はそのデータに対して所与の比較を
実行して書込み操作を禁止し、任意でブリッタ操作を停
止することができる。
【００４９】論理関数ユニットは出力データを生成する
が、このデータはシステム・メモリ３３内の宛先に書き
込まれる。このユニットは、ソースおよび宛先の各レジ
スタ・ピクセルのあらゆる論理結合を実行することがで
きる。「ソース・データ・ピクセル」は、ソース・デー
タ・レジスタまたはデータ・パターン・データ・レジス
タのいずれかから選択することができる。ＬＦＵは、デ
ータ・レジスタからの２組の入力データからなる４通り
のブール・ミンターム（Ａ＆Ｂ、Ａバー＆Ｂ、Ａ＆Ｂバ
ー、およびＡバー＆Ｂバー）のいずれかを選択し、選択
した２つの小名辞の論理ＯＲを生成する。このため、入
力データのあらゆる論理結合が可能になり、機能的に１
６通りの可能性が存在することになる。
が、このデータはシステム・メモリ３３内の宛先に書き
込まれる。このユニットは、ソースおよび宛先の各レジ
スタ・ピクセルのあらゆる論理結合を実行することがで
きる。「ソース・データ・ピクセル」は、ソース・デー
タ・レジスタまたはデータ・パターン・データ・レジス
タのいずれかから選択することができる。ＬＦＵは、デ
ータ・レジスタからの２組の入力データからなる４通り
のブール・ミンターム（Ａ＆Ｂ、Ａバー＆Ｂ、Ａ＆Ｂバ
ー、およびＡバー＆Ｂバー）のいずれかを選択し、選択
した２つの小名辞の論理ＯＲを生成する。このため、入
力データのあらゆる論理結合が可能になり、機能的に１
６通りの可能性が存在することになる。
【００５０】比較器は、ソース、宛先、およびパターン
の各データ・レジスタ内のデータに対して様々な比較を
実行することができる。その比較条件が満たされると、
比較器は禁止信号を生成する。この禁止信号は、書込み
操作を禁止し、任意でブリット操作を停止する場合に使
用する。また、比較器は、衝突検出およびシステム・メ
モリ３３の探索操作に対して、透明カラーを与えるため
のピクセル・プレーン効果を提供する場合にも使用する
ことができ、さらに文字ペイントの補助機能としても使
用することができる。
の各データ・レジスタ内のデータに対して様々な比較を
実行することができる。その比較条件が満たされると、
比較器は禁止信号を生成する。この禁止信号は、書込み
操作を禁止し、任意でブリット操作を停止する場合に使
用する。また、比較器は、衝突検出およびシステム・メ
モリ３３の探索操作に対して、透明カラーを与えるため
のピクセル・プレーン効果を提供する場合にも使用する
ことができ、さらに文字ペイントの補助機能としても使
用することができる。
【００５１】ＤＳＰ７４は、最高３３００万命令／秒
（ＭＩＰＳ）で動作する、音声合成用の単純な高速プロ
セッサである。ＤＳＰは、ＤＳＰ ＤＭＡコントローラ
（図示せず）を介してＳＹＳＴＥＭ’バス３４にアクセ
スできるため、システム・メモリ３３に対して複数バイ
トまたは複数ワードの読み書きを実行することができ
る。このような転送はショート・バーストで行われ、Ｄ
ＳＰのプログラムによって制御される。ＤＳＰ７４は実
際には、各種プログラムを実行し、専用の高速メモリ７
６にデータを格納する。
（ＭＩＰＳ）で動作する、音声合成用の単純な高速プロ
セッサである。ＤＳＰは、ＤＳＰ ＤＭＡコントローラ
（図示せず）を介してＳＹＳＴＥＭ’バス３４にアクセ
スできるため、システム・メモリ３３に対して複数バイ
トまたは複数ワードの読み書きを実行することができ
る。このような転送はショート・バーストで行われ、Ｄ
ＳＰのプログラムによって制御される。ＤＳＰ７４は実
際には、各種プログラムを実行し、専用の高速メモリ７
６にデータを格納する。
【００５２】ＤＳＰ７４音声共用プロセッサは、高性能
ミュージック・シンセサイザを実現するのに十分な能力
を備えた汎用演算共用プロセッサである。１６ビットの
精度のステレオ音声信号を生成するために同期直列出力
を提供し、通常、コンパクト・ディスク技術に付随する
音声品質を提供する。ＤＳＰ７４は、ホストＣＰＵ３０
からマイクロプログラム可能で、その命令セットは、
「ミュージック・シンセサイザ」とはまったく異なる多
くの様々な機能を達成できるようにユーザがＤＳＰをプ
ログラムできるほど、十分なフレキシビリティを備えて
いる。このような応用例としては、アルゴリズム式音声
生成、高速フーリエ変換技術を使用する音声分析、およ
び３次元図形回転などが考えられる。ＤＳＰ７４では、
最大データ・スループットを得るためにＨａｒｖａｒｄ
アーキテクチャ（個別のプログラム・バスとデータ・バ
ス）を使用している。ＤＳＰ７４は演算論理機構（ＡＬ
Ｕ）を有するが、この機構は、ハードウェア１６ビット
×１６ビット・ハードウェアの乗算／累算とともに加
算、減算、各種論理関数を特徴とする。さらに、個別の
シリアル除算ユニットも含まれ、これが目盛りごとに１
つずつ商ビットを生成する。
ミュージック・シンセサイザを実現するのに十分な能力
を備えた汎用演算共用プロセッサである。１６ビットの
精度のステレオ音声信号を生成するために同期直列出力
を提供し、通常、コンパクト・ディスク技術に付随する
音声品質を提供する。ＤＳＰ７４は、ホストＣＰＵ３０
からマイクロプログラム可能で、その命令セットは、
「ミュージック・シンセサイザ」とはまったく異なる多
くの様々な機能を達成できるようにユーザがＤＳＰをプ
ログラムできるほど、十分なフレキシビリティを備えて
いる。このような応用例としては、アルゴリズム式音声
生成、高速フーリエ変換技術を使用する音声分析、およ
び３次元図形回転などが考えられる。ＤＳＰ７４では、
最大データ・スループットを得るためにＨａｒｖａｒｄ
アーキテクチャ（個別のプログラム・バスとデータ・バ
ス）を使用している。ＤＳＰ７４は演算論理機構（ＡＬ
Ｕ）を有するが、この機構は、ハードウェア１６ビット
×１６ビット・ハードウェアの乗算／累算とともに加
算、減算、各種論理関数を特徴とする。さらに、個別の
シリアル除算ユニットも含まれ、これが目盛りごとに１
つずつ商ビットを生成する。
【００５３】ＤＳＰ７４内のＡＬＵは、当技術分野では
周知のテキサス・インスツルメンツ社製７４１８１と同
じ機能を備えた、１６ビットの演算論理機構である。一
般的な演算操作は命令として符号化され、一般的ではな
い命令は、汎用演算命令（ＧＡＩ）でＡＬＵモード・ビ
ットを直接セット・アップすることで実行できる。
周知のテキサス・インスツルメンツ社製７４１８１と同
じ機能を備えた、１６ビットの演算論理機構である。一
般的な演算操作は命令として符号化され、一般的ではな
い命令は、汎用演算命令（ＧＡＩ）でＡＬＵモード・ビ
ットを直接セット・アップすることで実行できる。
【００５４】ＤＳＰ７４は、それに関連するＤＳＰメモ
リ７６を有する。ＤＳＰメモリ７６は、プログラムＲＡ
Ｍ、データＲＡＭ、レジスタ／定数テーブル、および正
弦ＲＯＭ（いずれも図示せず）で構成されている。一般
に、ＤＳＰメモリ７６は、ＤＳＰの内部アドレス空間と
システム・メモリ３３のアドレス空間のいずれでもアク
セス可能である。ＤＳＰのプログラムＲＡＭは、５１２
個の１８ビット・ワードである。これらの記憶場所に書
込みを行えるのはＣＰＵ３０だけなので、ＤＳＰ７４に
関する限り、これらの記憶場所はプログラム読取り専用
である。プログラムＲＡＭはＤＳＰの内部アドレス空間
には現れない。プログラムＲＡＭは、ＤＳＰ７４が動作
中の場合はホストからアクセスできないが、ＤＳＰが停
止中の場合はアクセス可能である。
リ７６を有する。ＤＳＰメモリ７６は、プログラムＲＡ
Ｍ、データＲＡＭ、レジスタ／定数テーブル、および正
弦ＲＯＭ（いずれも図示せず）で構成されている。一般
に、ＤＳＰメモリ７６は、ＤＳＰの内部アドレス空間と
システム・メモリ３３のアドレス空間のいずれでもアク
セス可能である。ＤＳＰのプログラムＲＡＭは、５１２
個の１８ビット・ワードである。これらの記憶場所に書
込みを行えるのはＣＰＵ３０だけなので、ＤＳＰ７４に
関する限り、これらの記憶場所はプログラム読取り専用
である。プログラムＲＡＭはＤＳＰの内部アドレス空間
には現れない。プログラムＲＡＭは、ＤＳＰ７４が動作
中の場合はホストからアクセスできないが、ＤＳＰが停
止中の場合はアクセス可能である。
【００５５】ＤＳＰ７４は、シリアル音声ディジタル・
アナログ変換器（ＤＡＣ）インタフェースも有する。こ
のシリアルＤＡＣインタフェースにより、ＤＳＰ７４
は、同期直列（Ｉ2Ｓなど）ＤＡＣの駆動と、ＣＤドラ
イブなどの同期直列データ・ソースからのデータ入力の
両方を実行することができる。
アナログ変換器（ＤＡＣ）インタフェースも有する。こ
のシリアルＤＡＣインタフェースにより、ＤＳＰ７４
は、同期直列（Ｉ2Ｓなど）ＤＡＣの駆動と、ＣＤドラ
イブなどの同期直列データ・ソースからのデータ入力の
両方を実行することができる。
【００５６】Ａ／Ｖコントローラ／共用プロセッサ３２
のビデオ・コントローラ６６は、外部のビデオＤＡＣ５
０に接続しているが、このビデオＤＡＣは、当技術分野
で周知のように、ビデオ・コントローラ６６からの１８
ビットのピクセル情報７８（赤、緑、青のそれぞれに６
ビットずつ）をＲＧＢ信号８０に変換する。ビデオＤＡ
Ｃ５０のそれぞれのカラー・チャネル（Ｒ ８０ａ、Ｇ
８０ｂ、およびＢ８０ｃ）は、図３に示すように、Ｒ
２Ｒ抵抗ツリーと２Ｎ２２２２トランジスタで実現され
ている。図３の素子は、図示の通り、回路連絡状態にな
っている。図３の抵抗８６ａ〜８６ｊはいずれも、許容
差５％以内で図示の値を持つ０．２５ワットの抵抗であ
る。トランジスタ８８は２Ｎ２２２２である。
のビデオ・コントローラ６６は、外部のビデオＤＡＣ５
０に接続しているが、このビデオＤＡＣは、当技術分野
で周知のように、ビデオ・コントローラ６６からの１８
ビットのピクセル情報７８（赤、緑、青のそれぞれに６
ビットずつ）をＲＧＢ信号８０に変換する。ビデオＤＡ
Ｃ５０のそれぞれのカラー・チャネル（Ｒ ８０ａ、Ｇ
８０ｂ、およびＢ８０ｃ）は、図３に示すように、Ｒ
２Ｒ抵抗ツリーと２Ｎ２２２２トランジスタで実現され
ている。図３の素子は、図示の通り、回路連絡状態にな
っている。図３の抵抗８６ａ〜８６ｊはいずれも、許容
差５％以内で図示の値を持つ０．２５ワットの抵抗であ
る。トランジスタ８８は２Ｎ２２２２である。
【００５７】もう一度図２を参照して説明すると、ＲＧ
Ｂ信号８０は、ＮＴＳＣ／ＰＡＬエンコーダ５２によっ
てＮＴＳＣ複合ビデオ信号９０に変換される。ＮＴＳＣ
／ＰＡＬエンコーダ５２は、クロマ・クロック９２と、
Ａ／Ｖコントローラ／共用プロセッサ３２のビデオ・コ
ントローラ６６によって生成されるＨＳＹＮＣ信号およ
びＶＳＹＮＣ信号９４と、ビデオＤＡＣ５０によって生
成される赤８０ａ、緑８０ｂ、青８０ｃの各ビデオ出力
とを受け入れ、周知のＮＴＳＣまたはベースバンド・ビ
デオ形式の複合ビデオ信号９０を生成する。代替態様と
して、周知のＰＡＬ（欧州テレビ信号規格）形式を生成
することもできる。複合ビデオ信号９０は、当技術分野
で周知の通り、単一の雌型ＲＣＡ式フォン・ジャック
（図示せず）によって外部装置に接続される。実施例で
は、ＮＴＳＣ／ＰＡＬエンコーダ５２はソニー製造のＣ
ＸＡ１１４５である。代替態様として、モトローラ社製
のＭＣ１３７７を使用することもできる。
Ｂ信号８０は、ＮＴＳＣ／ＰＡＬエンコーダ５２によっ
てＮＴＳＣ複合ビデオ信号９０に変換される。ＮＴＳＣ
／ＰＡＬエンコーダ５２は、クロマ・クロック９２と、
Ａ／Ｖコントローラ／共用プロセッサ３２のビデオ・コ
ントローラ６６によって生成されるＨＳＹＮＣ信号およ
びＶＳＹＮＣ信号９４と、ビデオＤＡＣ５０によって生
成される赤８０ａ、緑８０ｂ、青８０ｃの各ビデオ出力
とを受け入れ、周知のＮＴＳＣまたはベースバンド・ビ
デオ形式の複合ビデオ信号９０を生成する。代替態様と
して、周知のＰＡＬ（欧州テレビ信号規格）形式を生成
することもできる。複合ビデオ信号９０は、当技術分野
で周知の通り、単一の雌型ＲＣＡ式フォン・ジャック
（図示せず）によって外部装置に接続される。実施例で
は、ＮＴＳＣ／ＰＡＬエンコーダ５２はソニー製造のＣ
ＸＡ１１４５である。代替態様として、モトローラ社製
のＭＣ１３７７を使用することもできる。
【００５８】音声ＡＤＣ／ＤＡＣ／ＣＯＤＥＣ５４は、
周知のフィリップスＩ2Ｓプロトコルに適合するシリア
ル・リンク９６によってＤＳＰ７４にリンクされてい
る。このＡＤＣ／ＤＡＣ／ＣＯＤＥＣ５４は、アナログ
・データからディジタル・データの変換、およびその反
対の変換を行い、デジタル・データの圧縮および圧縮解
除を行う。ＡＤＣ／ＤＡＣ／ＣＯＤＥＣ５４は、任意選
択のマイクからＡ／Ｖコントローラ／共用プロセッサ３
２への外部ステレオ・アナログ・データ９７ａ〜９７ｂ
のインタフェースを取る。音声入力９７ａ〜９７ｂは、
標準の１／４インチ・ステレオ・コネクタによって外部
装置に接続されている。音声ＡＤＣ／ＤＡＣ／ＣＯＤＥ
Ｃ５４は、左右の音声ライン・アウト信号９８ａ〜９８
ｂを生成することにより、Ａ／Ｖコントローラ／共用プ
ロセッサから外部装置へのディジタル・データのインタ
フェースも取る。これらの信号９８ａ〜９８ｂは、当技
術分野で周知の通り、２つの雌型ＲＣＡフォン・ジャッ
クを備えた任意選択のスピーカ（図示せず）などの外部
装置に接続される。前述の通り、音声ライン信号９８ａ
〜９８ｂもＲＦビデオ信号２２に追加される。
周知のフィリップスＩ2Ｓプロトコルに適合するシリア
ル・リンク９６によってＤＳＰ７４にリンクされてい
る。このＡＤＣ／ＤＡＣ／ＣＯＤＥＣ５４は、アナログ
・データからディジタル・データの変換、およびその反
対の変換を行い、デジタル・データの圧縮および圧縮解
除を行う。ＡＤＣ／ＤＡＣ／ＣＯＤＥＣ５４は、任意選
択のマイクからＡ／Ｖコントローラ／共用プロセッサ３
２への外部ステレオ・アナログ・データ９７ａ〜９７ｂ
のインタフェースを取る。音声入力９７ａ〜９７ｂは、
標準の１／４インチ・ステレオ・コネクタによって外部
装置に接続されている。音声ＡＤＣ／ＤＡＣ／ＣＯＤＥ
Ｃ５４は、左右の音声ライン・アウト信号９８ａ〜９８
ｂを生成することにより、Ａ／Ｖコントローラ／共用プ
ロセッサから外部装置へのディジタル・データのインタ
フェースも取る。これらの信号９８ａ〜９８ｂは、当技
術分野で周知の通り、２つの雌型ＲＣＡフォン・ジャッ
クを備えた任意選択のスピーカ（図示せず）などの外部
装置に接続される。前述の通り、音声ライン信号９８ａ
〜９８ｂもＲＦビデオ信号２２に追加される。
【００５９】実施例では、ＡＤＣ／ＤＡＣ／ＣＯＤＥＣ
５４は、クリスタル・セミコンダクタ社製のＣＳ４２１
６である。この部品は、プログラム式利得を備えたマイ
ク入力と同時にプログラム式減衰器を備えた出力も含ん
でいる。利得と減衰は、どちらもＤＳＰ７４によってプ
ログラム制御される。
５４は、クリスタル・セミコンダクタ社製のＣＳ４２１
６である。この部品は、プログラム式利得を備えたマイ
ク入力と同時にプログラム式減衰器を備えた出力も含ん
でいる。利得と減衰は、どちらもＤＳＰ７４によってプ
ログラム制御される。
【００６０】代替態様として、ＡＤＣ／ＤＡＣ／ＣＯＤ
ＥＣ５４をフィリップス社製のＴＤＡ１３１１ ＤＡＣ
で置き換えることもできる。このチップを使用する場合
は、ＡＤＣ機能とＣＯＤＥＣ機能が使用できなくなる。
ＥＣ５４をフィリップス社製のＴＤＡ１３１１ ＤＡＣ
で置き換えることもできる。このチップを使用する場合
は、ＡＤＣ機能とＣＯＤＥＣ機能が使用できなくなる。
【００６１】ＲＦ変調装置５６は、ＮＴＳＣ／ＰＡＬエ
ンコーダ５２からの複合ビデオ信号９０と、音声ＡＤＣ
／ＤＡＣ／ＣＯＤＥＣ５４からの左右の音声ライン・ア
ウト信号９８ａおよび９８ｂとを搬送周波数上に結合し
て、ＴＶ１６に直接入力するのに適したＲＦビデオ信号
２２を生成する。異なるＰＡＬ（欧州テレビ信号規格）
形式とＮＴＳＣ形式を生成するには、別のＲＦ変調装置
およびクリスタルを使用しなければならない。ＲＦビデ
オ信号２２は、当技術分野で周知の通り、単一の雌型Ｆ
タイプ同軸コネクタにより外部装置に接続される。
ンコーダ５２からの複合ビデオ信号９０と、音声ＡＤＣ
／ＤＡＣ／ＣＯＤＥＣ５４からの左右の音声ライン・ア
ウト信号９８ａおよび９８ｂとを搬送周波数上に結合し
て、ＴＶ１６に直接入力するのに適したＲＦビデオ信号
２２を生成する。異なるＰＡＬ（欧州テレビ信号規格）
形式とＮＴＳＣ形式を生成するには、別のＲＦ変調装置
およびクリスタルを使用しなければならない。ＲＦビデ
オ信号２２は、当技術分野で周知の通り、単一の雌型Ｆ
タイプ同軸コネクタにより外部装置に接続される。
【００６２】次に図４〜図１６および図１７を参照して
説明すると、これらの図には本発明の入力装置１８の一
実施例が示されている。図示の通り、入力装置１８は、
単一のエンクロージャ１００内に収容されたタッチパッ
ド１９と２本のジョイスティック２０ａ、２０ｂとで構
成されている。エンクロージャ１００は、ＡＢＳ−Ｔ
（アクリロニトリル・ブタジエン・スチレン、グレード
Ｔの素材ＡＢＳとしてＷｏｎｇ’ｓ Ｅｌｅｃｔｒｏｎ
ｉｃｓ社（Wongs Industrial Centre, 180 Wai Yip Str
eet, Kwun Tong, Kowloon, Hong Kong）から販売されて
いる）でできている。入力装置１８は、テンプレート・
オーバレイ１０２を受け入れるが、それぞれのオーバレ
イは、本体１０４と、つまみ１０６と、下部の一端にあ
る識別パターン１０８とで構成されている。テンプレー
ト・オーバレイ１０２は、塗工紙、コーティングを施し
た厚紙、またはポリエステル・フィルムなどの薄い材料
でできている。適当なポリエステル・フィルムの１つ
は、デュポン社が製造し、同社の”Ｍｙｌａｒ”という
商標で広く販売されている。本体１０４は、その表面内
または表面上に記入されたグラフィック・イメージを有
する。すなわち、グラフィック・デザインが、書込み、
印刷、ペイント、カービング、エングレービング、シル
クスクリーン、その他の方法で、オーバレイ本体１０４
の表面上または表面内に永続的に付加されている。つま
み１０６は、本体１０４から延伸しており、テンプレー
ト・オーバレイ１０２をつかむ場合に使用する。識別パ
ターン１０８については、図１０〜図１４に関連する説
明で後述する。
説明すると、これらの図には本発明の入力装置１８の一
実施例が示されている。図示の通り、入力装置１８は、
単一のエンクロージャ１００内に収容されたタッチパッ
ド１９と２本のジョイスティック２０ａ、２０ｂとで構
成されている。エンクロージャ１００は、ＡＢＳ−Ｔ
（アクリロニトリル・ブタジエン・スチレン、グレード
Ｔの素材ＡＢＳとしてＷｏｎｇ’ｓ Ｅｌｅｃｔｒｏｎ
ｉｃｓ社（Wongs Industrial Centre, 180 Wai Yip Str
eet, Kwun Tong, Kowloon, Hong Kong）から販売されて
いる）でできている。入力装置１８は、テンプレート・
オーバレイ１０２を受け入れるが、それぞれのオーバレ
イは、本体１０４と、つまみ１０６と、下部の一端にあ
る識別パターン１０８とで構成されている。テンプレー
ト・オーバレイ１０２は、塗工紙、コーティングを施し
た厚紙、またはポリエステル・フィルムなどの薄い材料
でできている。適当なポリエステル・フィルムの１つ
は、デュポン社が製造し、同社の”Ｍｙｌａｒ”という
商標で広く販売されている。本体１０４は、その表面内
または表面上に記入されたグラフィック・イメージを有
する。すなわち、グラフィック・デザインが、書込み、
印刷、ペイント、カービング、エングレービング、シル
クスクリーン、その他の方法で、オーバレイ本体１０４
の表面上または表面内に永続的に付加されている。つま
み１０６は、本体１０４から延伸しており、テンプレー
ト・オーバレイ１０２をつかむ場合に使用する。識別パ
ターン１０８については、図１０〜図１４に関連する説
明で後述する。
【００６３】タッチパッド１９は、指またはスタイラス
２１などで接触できるように露出したパッド表面１１０
を有する。このパッド表面１１０は、その表面内または
表面上に記入されたデフォルト・テンプレート・グラフ
ィック・デザインを有する。すなわち、デフォルト・テ
ンプレート・グラフィック・イメージが、書込み、印
刷、ペイント、カービング、エングレービング、シルク
スクリーン、その他の方法で、パッド表面１１０の表面
上または表面内に永続的に付加されている。
２１などで接触できるように露出したパッド表面１１０
を有する。このパッド表面１１０は、その表面内または
表面上に記入されたデフォルト・テンプレート・グラフ
ィック・デザインを有する。すなわち、デフォルト・テ
ンプレート・グラフィック・イメージが、書込み、印
刷、ペイント、カービング、エングレービング、シルク
スクリーン、その他の方法で、パッド表面１１０の表面
上または表面内に永続的に付加されている。
【００６４】図４に示すように、パッド表面１１０の表
面内または表面上に記入されたデフォルト・テンプレー
ト・グラフィック・デザインによって、「実行」、「終
了」、「停止」、「前項目」、「次項目」、および矢印
キー（上、下、左、右）という各種機能をサポートする
ことができる。代替態様として、「実行」の代わりに
「選択」を使用することもでき、「終了」の代わりに
「取消し」を使用することもできる。さらに代替態様と
して、それぞれのアラビア数字に１つずつ、１０個の矩
形領域をマッピングすることもできる。さらに別の代替
態様として、タッチパッドの任意の領域に英文字を１つ
ずつマッピングすることもできる。また、さらに別の代
替態様として、パッド表面１１０にＱＷＥＲＴＹキーボ
ードをマッピングしてもよい。実際には、ほぼすべての
パターンまたはパターンと記号の組合せを選択できる。
システム１０の対象となる多数のアプリケーションにと
って便利なように、デフォルト・テンプレート・グラフ
ィック・イメージを選ぶ必要がある。
面内または表面上に記入されたデフォルト・テンプレー
ト・グラフィック・デザインによって、「実行」、「終
了」、「停止」、「前項目」、「次項目」、および矢印
キー（上、下、左、右）という各種機能をサポートする
ことができる。代替態様として、「実行」の代わりに
「選択」を使用することもでき、「終了」の代わりに
「取消し」を使用することもできる。さらに代替態様と
して、それぞれのアラビア数字に１つずつ、１０個の矩
形領域をマッピングすることもできる。さらに別の代替
態様として、タッチパッドの任意の領域に英文字を１つ
ずつマッピングすることもできる。また、さらに別の代
替態様として、パッド表面１１０にＱＷＥＲＴＹキーボ
ードをマッピングしてもよい。実際には、ほぼすべての
パターンまたはパターンと記号の組合せを選択できる。
システム１０の対象となる多数のアプリケーションにと
って便利なように、デフォルト・テンプレート・グラフ
ィック・イメージを選ぶ必要がある。
【００６５】入力装置１８は、テンプレート・オーバレ
イ１０２をパッド表面１１０に近接して固定するため
に、（１）ほぼＵ字形のスロット１１４を定義し、３辺
でテンプレート・オーバレイ１０２を固定する３つのま
っすぐなリップ部１１２ａ〜１１２ｃを含む張出しリッ
プ１１２と、（２）残りの１辺でテンプレート・オーバ
レイ１０２を固定する１対のリッジ１１６ａ、１１６ｂ
という、２通りの形態のリテーナを含んでいる。リップ
１１２、スロット１１４、およびリッジ１１６ａ、１１
６ｂについては、図６、図７、および図８に詳細に示
し、これらの図に関連する説明で後述する。
イ１０２をパッド表面１１０に近接して固定するため
に、（１）ほぼＵ字形のスロット１１４を定義し、３辺
でテンプレート・オーバレイ１０２を固定する３つのま
っすぐなリップ部１１２ａ〜１１２ｃを含む張出しリッ
プ１１２と、（２）残りの１辺でテンプレート・オーバ
レイ１０２を固定する１対のリッジ１１６ａ、１１６ｂ
という、２通りの形態のリテーナを含んでいる。リップ
１１２、スロット１１４、およびリッジ１１６ａ、１１
６ｂについては、図６、図７、および図８に詳細に示
し、これらの図に関連する説明で後述する。
【００６６】図４には、入力装置１８を持ち運ぶための
ハンドル１１８と、スタイラス２１を格納するための管
状開口部１２０も示されている。
ハンドル１１８と、スタイラス２１を格納するための管
状開口部１２０も示されている。
【００６７】次に図５を参照して説明すると、同図に
は、テンプレート・オーバレイ１０２がパッド表面１１
０に近接した所定の位置に置かれている入力装置１８の
平面図が示されている。同図に示す通り、オーバレイ１
０２の本体１０４の３辺は、３つのリップ部１１２ａ〜
１１２ｃの下に滑り込んでいる。また、同図には、オー
バレイ１０２のつまみ１０６の両側に１つずつ、オーバ
レイ１０２の本体１０４の残りの１辺を固定するリッジ
１１６ａ、１１６ｂも示されている。オーバレイ１０２
を挿入するには、オーバレイ１０２の本体１０４の左側
と右側をリップ部１１２ａおよび１１２ｃの下に滑り込
ませ、オーバレイ１０２の本体１０４の下側がもう１つ
のリップ部１１２ｂの下に入り込むまでオーバレイ１０
２を下にずらす。最後に、オーバレイ１０２が外れ、つ
まみ１０６は、上側でオーバレイ１０２を固定するリッ
ジ１１６ａ、１１６ｂの間に収まる。
は、テンプレート・オーバレイ１０２がパッド表面１１
０に近接した所定の位置に置かれている入力装置１８の
平面図が示されている。同図に示す通り、オーバレイ１
０２の本体１０４の３辺は、３つのリップ部１１２ａ〜
１１２ｃの下に滑り込んでいる。また、同図には、オー
バレイ１０２のつまみ１０６の両側に１つずつ、オーバ
レイ１０２の本体１０４の残りの１辺を固定するリッジ
１１６ａ、１１６ｂも示されている。オーバレイ１０２
を挿入するには、オーバレイ１０２の本体１０４の左側
と右側をリップ部１１２ａおよび１１２ｃの下に滑り込
ませ、オーバレイ１０２の本体１０４の下側がもう１つ
のリップ部１１２ｂの下に入り込むまでオーバレイ１０
２を下にずらす。最後に、オーバレイ１０２が外れ、つ
まみ１０６は、上側でオーバレイ１０２を固定するリッ
ジ１１６ａ、１１６ｂの間に収まる。
【００６８】図６、図７、および図８は、オーバレイ１
０２のリッジ１１６ａ、１１６ｂの細部を示している。
図７は、つまみ１０６がリッジ１１６ｂを越えて延伸し
ている状態を示している。また、図８は、オーバレイ１
０２の本体１０４がリッジ１１６ｂに突き当たっている
状態を示している。
０２のリッジ１１６ａ、１１６ｂの細部を示している。
図７は、つまみ１０６がリッジ１１６ｂを越えて延伸し
ている状態を示している。また、図８は、オーバレイ１
０２の本体１０４がリッジ１１６ｂに突き当たっている
状態を示している。
【００６９】オーバレイ１０２を取り外すには、親指と
人差し指でつまみ１０６をつかみ、オーバレイ１０２の
本体１０４をリッジ１１６ａ、１１６ｂより上に持ち上
げる。それにより、オーバレイ１０２はＵ字形のリップ
１１２の下からリッジ１１６ａ、１１６ｂの上に滑り出
る。
人差し指でつまみ１０６をつかみ、オーバレイ１０２の
本体１０４をリッジ１１６ａ、１１６ｂより上に持ち上
げる。それにより、オーバレイ１０２はＵ字形のリップ
１１２の下からリッジ１１６ａ、１１６ｂの上に滑り出
る。
【００７０】図９は、３辺でオーバレイ１０２を固定す
るスロット１１４を示している。同図には、タッチパッ
ド・センサ１２２と、オーバレイ・センサ１２４と、複
数のテンプレート・オーバレイ１０２を格納するための
窪み１２６と、エンクロージャ１００と同じ材料でで
き、センサ１２２への接触を検出するのに十分な抵抗力
を提供する、かなり剛性の高いベース１２７も示されて
いる。
るスロット１１４を示している。同図には、タッチパッ
ド・センサ１２２と、オーバレイ・センサ１２４と、複
数のテンプレート・オーバレイ１０２を格納するための
窪み１２６と、エンクロージャ１００と同じ材料でで
き、センサ１２２への接触を検出するのに十分な抵抗力
を提供する、かなり剛性の高いベース１２７も示されて
いる。
【００７１】タッチパッド・センサ１２２は、前記パッ
ド表面１１０に近接して配置され、指またはスタイラス
２１などによってパッド表面１１０上またはその付近に
圧力を加えると、センサ１２２がその接触を検出できる
ような構成になっている。
ド表面１１０に近接して配置され、指またはスタイラス
２１などによってパッド表面１１０上またはその付近に
圧力を加えると、センサ１２２がその接触を検出できる
ような構成になっている。
【００７２】タッチパッド・センサ１０２は、インピー
ダンス方式のセンサ、音響センサ、スイッチ閉止式セン
サなどの多くのタイプのいずれでもよい。例としては、
Ｆｌｏｒｅｌｌａに付与された米国特許第４７３６１９
０号に開示されている装置のような薄膜スイッチ・マト
リックスや、Ｉｔｏ他に付与された米国特許第４５２９
９５９号に開示されている装置のような精密解像度スイ
ッチ閉止式センサなどが考えられる。適当なセンサ１０
２の１つは、部品番号ＰＲ３９９８３としてＷｏｎｇ’
ｓ Ｅｌｅｃｔｒｏｎｉｃｓ社（Wongs Industrial Cen
tre, 180 Wai Yip Street, Kwun Tong, Kowloon, Hong
Kong）から購入することができる。
ダンス方式のセンサ、音響センサ、スイッチ閉止式セン
サなどの多くのタイプのいずれでもよい。例としては、
Ｆｌｏｒｅｌｌａに付与された米国特許第４７３６１９
０号に開示されている装置のような薄膜スイッチ・マト
リックスや、Ｉｔｏ他に付与された米国特許第４５２９
９５９号に開示されている装置のような精密解像度スイ
ッチ閉止式センサなどが考えられる。適当なセンサ１０
２の１つは、部品番号ＰＲ３９９８３としてＷｏｎｇ’
ｓ Ｅｌｅｃｔｒｏｎｉｃｓ社（Wongs Industrial Cen
tre, 180 Wai Yip Street, Kwun Tong, Kowloon, Hong
Kong）から購入することができる。
【００７３】センサ１２２は、スタイラス２１または指
などによるパッド表面１１０への接触、またはパッド表
面１１０に近接するテンプレート・オーバレイ１０２へ
の接触に対する応答として、少なくとも１つの電気信号
を発生する。たとえば、スイッチ閉止式センサでは、通
常、一方の軸上の多くのラインを順次駆動するために複
数のドライバが必要であり、もう一方の軸上のどのライ
ンがそのドライバによって駆動された信号を伝えている
かを検出するために複数のレシーバが必要である。どの
ドライバが信号を発生し、それをどのレシーバで検出し
たかを知ることにより、スイッチの閉止の原因となった
接触の位置を決定することができる。
などによるパッド表面１１０への接触、またはパッド表
面１１０に近接するテンプレート・オーバレイ１０２へ
の接触に対する応答として、少なくとも１つの電気信号
を発生する。たとえば、スイッチ閉止式センサでは、通
常、一方の軸上の多くのラインを順次駆動するために複
数のドライバが必要であり、もう一方の軸上のどのライ
ンがそのドライバによって駆動された信号を伝えている
かを検出するために複数のレシーバが必要である。どの
ドライバが信号を発生し、それをどのレシーバで検出し
たかを知ることにより、スイッチの閉止の原因となった
接触の位置を決定することができる。
【００７４】オーバレイ・センサ１２４は、オーバレイ
１０２上の識別パターン１０８に対応する電気信号を発
生するセンサである。このため、タッチパッド１９のオ
ーバレイ・センサ１２４とテンプレート・オーバレイ１
０２の識別パターン１０８は、位置と装置技術の両面で
対応していなければならない。適当なオーバレイ・セン
サ１２４は、それぞれが角度付きトランスミッタと角度
付きレシーバを１つずつ有する、６個の光電式トランス
ミッタ／レシーバが１列に並んだものである。これらの
トランスミッタとレシーバは当技術分野では周知であ
り、部品番号ＰＲ３９９９０としてＷｏｎｇ’ｓ Ｅｌ
ｅｃｔｒｏｎｉｃｓ社から販売されている。
１０２上の識別パターン１０８に対応する電気信号を発
生するセンサである。このため、タッチパッド１９のオ
ーバレイ・センサ１２４とテンプレート・オーバレイ１
０２の識別パターン１０８は、位置と装置技術の両面で
対応していなければならない。適当なオーバレイ・セン
サ１２４は、それぞれが角度付きトランスミッタと角度
付きレシーバを１つずつ有する、６個の光電式トランス
ミッタ／レシーバが１列に並んだものである。これらの
トランスミッタとレシーバは当技術分野では周知であ
り、部品番号ＰＲ３９９９０としてＷｏｎｇ’ｓ Ｅｌ
ｅｃｔｒｏｎｉｃｓ社から販売されている。
【００７５】図１０に示すように、オーバレイ・センサ
１２４は、エンクロージャ１００に設けた６個の穴１２
８ａ〜１２８ｆを介して識別パターン１０８に光学的に
結合している。それぞれの穴１２８の下には、１つの光
電式トランスミッタ／レシーバ対（図示せず）が置かれ
ている。別の実施例（図示せず）では、オーバレイセン
サ１２４の６個のレシーバ／トランスミッタ対と６個の
穴１２８ａ〜１２８ｆを３つずつ２つのグループに分
け、タッチパッド・センサ１２２の両側に１つずつその
グループを配置することもできる。すなわち、１つのリ
ップ部１１２ａの下に３個の穴１２８ａ〜１２８ｃ（お
よびそれに関連するレシーバ／トランスミッタ対）を配
置し、もう１つのリップ部１１２ｃの下に残りの３個の
穴１２８ｄ〜１２８ｆ（およびそれに関連するレシーバ
／トランスミッタ対）を配置することができる。
１２４は、エンクロージャ１００に設けた６個の穴１２
８ａ〜１２８ｆを介して識別パターン１０８に光学的に
結合している。それぞれの穴１２８の下には、１つの光
電式トランスミッタ／レシーバ対（図示せず）が置かれ
ている。別の実施例（図示せず）では、オーバレイセン
サ１２４の６個のレシーバ／トランスミッタ対と６個の
穴１２８ａ〜１２８ｆを３つずつ２つのグループに分
け、タッチパッド・センサ１２２の両側に１つずつその
グループを配置することもできる。すなわち、１つのリ
ップ部１１２ａの下に３個の穴１２８ａ〜１２８ｃ（お
よびそれに関連するレシーバ／トランスミッタ対）を配
置し、もう１つのリップ部１１２ｃの下に残りの３個の
穴１２８ｄ〜１２８ｆ（およびそれに関連するレシーバ
／トランスミッタ対）を配置することができる。
【００７６】図１１〜図１４は、識別パターン１０８の
例を示している。識別パターン１０８は、テンプレート
・オーバレイ１０２の一端に配置されている。オーバレ
イ・センサ１２４の個々のトランスミッタ／レシーバ対
に１つずつ対応する、６個の個別のマークが配置されて
いる。オーバレイ１０２が所定の位置にあると、識別パ
ターン１０８とセンサ１２４の位置が一致する。３つず
つの穴からなる２つのグループをセンサに使用する前述
の代替実施例の場合は、識別パターン１０８も同様に３
つずつ２つのグループに分け、タッチパッド・センサ１
２２の両側に１つずつそのグループを配置しなければな
らない。
例を示している。識別パターン１０８は、テンプレート
・オーバレイ１０２の一端に配置されている。オーバレ
イ・センサ１２４の個々のトランスミッタ／レシーバ対
に１つずつ対応する、６個の個別のマークが配置されて
いる。オーバレイ１０２が所定の位置にあると、識別パ
ターン１０８とセンサ１２４の位置が一致する。３つず
つの穴からなる２つのグループをセンサに使用する前述
の代替実施例の場合は、識別パターン１０８も同様に３
つずつ２つのグループに分け、タッチパッド・センサ１
２２の両側に１つずつそのグループを配置しなければな
らない。
【００７７】センサ１２４として光電式トランスミッタ
／レシーバ対を使用すると、テンプレート・オーバレイ
１０２内に非常に単純な識別パターン１０８を設計する
ことができる。オーバレイの材料が白であれば、識別パ
ターンの一方の形態として、オーバレイの裏側に黒イン
クまたはペイントを塗布した領域を使用することがで
き、もう一方の形態として、黒インクを塗布していない
白い領域を使用することができる。
／レシーバ対を使用すると、テンプレート・オーバレイ
１０２内に非常に単純な識別パターン１０８を設計する
ことができる。オーバレイの材料が白であれば、識別パ
ターンの一方の形態として、オーバレイの裏側に黒イン
クまたはペイントを塗布した領域を使用することがで
き、もう一方の形態として、黒インクを塗布していない
白い領域を使用することができる。
【００７８】図１１〜図１４には、識別パターンについ
て可能な数種類の組合せの例が示されている。図１１〜
図１４では、０１０００１2、０１１１１０2、００００
００2、および１１１１１１2という２進パターンにそれ
ぞれ対応する識別パターンを示す。したがって、識別パ
ターンは、テンプレート・オーバレイ１０２の一端に所
定の間隔で並んだ明るい領域と暗い領域のグループのよ
うに見える。００００００2というパターンは例示のた
めにのみ示したものである。実際に使用する場合、すべ
てが白の００００００2というパターンは、テンプレー
ト・オーバレイ１０２の不在に対応する。その場合は、
デフォルト・テンプレート・グラフィック・イメージが
使用されるはずなので、このようなパターンはおそらく
使用されないだろう。
て可能な数種類の組合せの例が示されている。図１１〜
図１４では、０１０００１2、０１１１１０2、００００
００2、および１１１１１１2という２進パターンにそれ
ぞれ対応する識別パターンを示す。したがって、識別パ
ターンは、テンプレート・オーバレイ１０２の一端に所
定の間隔で並んだ明るい領域と暗い領域のグループのよ
うに見える。００００００2というパターンは例示のた
めにのみ示したものである。実際に使用する場合、すべ
てが白の００００００2というパターンは、テンプレー
ト・オーバレイ１０２の不在に対応する。その場合は、
デフォルト・テンプレート・グラフィック・イメージが
使用されるはずなので、このようなパターンはおそらく
使用されないだろう。
【００７９】図１５は、本発明の入力装置１８の正面図
であるが、タッチパッド１９の両側に１本ずつジョイス
ティック２０ａ、２０ｂが配置されている状態を示して
いる。同図に示す通り、ジョイスティック２０ａ、２０
ｂは、それぞれの端部に付加されている瞬間押しボタン
・スイッチ１３０ａ、１３０ｂをそれぞれ有する。図１
５は、複数のテンプレート・オーバレイを格納するため
に使用する、窪み１２６に向かって開口している矩形開
口部１３２も示している。
であるが、タッチパッド１９の両側に１本ずつジョイス
ティック２０ａ、２０ｂが配置されている状態を示して
いる。同図に示す通り、ジョイスティック２０ａ、２０
ｂは、それぞれの端部に付加されている瞬間押しボタン
・スイッチ１３０ａ、１３０ｂをそれぞれ有する。図１
５は、複数のテンプレート・オーバレイを格納するため
に使用する、窪み１２６に向かって開口している矩形開
口部１３２も示している。
【００８０】図１６は、図４の線２Ｍ―２Ｍによって示
された平面にほぼ沿って描かれた部分断面図であるが、
本発明の入力装置に使用するジョイスティックの細部を
示している。図１６に示す細部は、ジョイスティック２
０ａおよび２０ｂのどちらについても同じである。しか
も、図１６の細部は９０度回転しても対称であるため、
同図には多くの構造のうちの２つを示すが、実際にはこ
の特定の実施例では同じ構造が４つ使用されている。ジ
ョイスティック２０ａはロッド１３４に付加され、この
ロッドは、開口部１３６を通り、エンクロージャ１００
によって定義された容積内部に向かって延伸している。
ロッド１３４の先端はピボット・ポイント１３８になっ
ており、これがスイッチ・ベース１４０上で旋回する。
スイッチ・ベース１４０は、４本のねじ１４２ａ〜１４
２ｄによりエンクロージャ１００の複数のスタンド１４
４ａ〜１４４ｄに固定され、このスタンドはエンクロー
ジャ１００に物理的に接合されている。開口部１３６
は、環状シール１４６によって密閉され、シールの環は
ロッド１３４の周囲にぴったり付着しており、シールの
外縁は一般的な方法によりエンクロージャ１００の開口
部に物理的に接合されている。
された平面にほぼ沿って描かれた部分断面図であるが、
本発明の入力装置に使用するジョイスティックの細部を
示している。図１６に示す細部は、ジョイスティック２
０ａおよび２０ｂのどちらについても同じである。しか
も、図１６の細部は９０度回転しても対称であるため、
同図には多くの構造のうちの２つを示すが、実際にはこ
の特定の実施例では同じ構造が４つ使用されている。ジ
ョイスティック２０ａはロッド１３４に付加され、この
ロッドは、開口部１３６を通り、エンクロージャ１００
によって定義された容積内部に向かって延伸している。
ロッド１３４の先端はピボット・ポイント１３８になっ
ており、これがスイッチ・ベース１４０上で旋回する。
スイッチ・ベース１４０は、４本のねじ１４２ａ〜１４
２ｄによりエンクロージャ１００の複数のスタンド１４
４ａ〜１４４ｄに固定され、このスタンドはエンクロー
ジャ１００に物理的に接合されている。開口部１３６
は、環状シール１４６によって密閉され、シールの環は
ロッド１３４の周囲にぴったり付着しており、シールの
外縁は一般的な方法によりエンクロージャ１００の開口
部に物理的に接合されている。
【００８１】ジョイスティック２０ａは、ピボット・ポ
イントの周囲で１４度の自由運動が可能である。つま
り、ロッド１３４は、スイッチ・ベース１４０によって
定義される平面に対して完全に垂直な位置から７度の傾
斜範囲内で、ほぼすべての方向に動くことができる。ロ
ッド１３４は、それに物理的に接合されている４つのス
イッチ・アクチュエータ・アーム１４８ａ〜１４８ｄを
有する。アクチュエータ・アーム１４８は、４つのゴム
製ドーム形瞬間押しボタン・スイッチ１５０ａ〜１５０
ｄに近接して配置されており、このスイッチは、スイッ
チ・ベース１４０に物理的に接合されている。アーム１
４８とスイッチ１５０は、ジョイスティック２０ａが垂
直位置から移動したときに１つまたは複数のアーム１４
８によってそれに関連するスイッチ１５０の閉止事象が
起こるような構成になっている。このため、ジョイステ
ィック２０ａの運動は、スイッチ１５０の閉止事象によ
って検出される。代替態様として、ジョイスティック２
０ａ、２０ｂを、当技術分野で周知の電位差計をベース
とするシステムなどの他の構造で実現することもでき
る。
イントの周囲で１４度の自由運動が可能である。つま
り、ロッド１３４は、スイッチ・ベース１４０によって
定義される平面に対して完全に垂直な位置から７度の傾
斜範囲内で、ほぼすべての方向に動くことができる。ロ
ッド１３４は、それに物理的に接合されている４つのス
イッチ・アクチュエータ・アーム１４８ａ〜１４８ｄを
有する。アクチュエータ・アーム１４８は、４つのゴム
製ドーム形瞬間押しボタン・スイッチ１５０ａ〜１５０
ｄに近接して配置されており、このスイッチは、スイッ
チ・ベース１４０に物理的に接合されている。アーム１
４８とスイッチ１５０は、ジョイスティック２０ａが垂
直位置から移動したときに１つまたは複数のアーム１４
８によってそれに関連するスイッチ１５０の閉止事象が
起こるような構成になっている。このため、ジョイステ
ィック２０ａの運動は、スイッチ１５０の閉止事象によ
って検出される。代替態様として、ジョイスティック２
０ａ、２０ｂを、当技術分野で周知の電位差計をベース
とするシステムなどの他の構造で実現することもでき
る。
【００８２】次の図１７を参照して説明すると、同図に
は、入力装置１８内の回路のブロック図が示されてい
る。入力装置１８は、タッチパッド・センサ１２２と、
オーバレイ・センサ１２４と、ジョイスティック・セン
サ２００ａ、２００ｂと、座標決定回路２０２オーバレ
イ検出回路２０４と、１００ミリ秒タイマ２０８と、イ
ンタフェース回路２１０とで構成されているが、いずれ
も図１７に示すように電気回路連絡状態に接続されてい
る。
は、入力装置１８内の回路のブロック図が示されてい
る。入力装置１８は、タッチパッド・センサ１２２と、
オーバレイ・センサ１２４と、ジョイスティック・セン
サ２００ａ、２００ｂと、座標決定回路２０２オーバレ
イ検出回路２０４と、１００ミリ秒タイマ２０８と、イ
ンタフェース回路２１０とで構成されているが、いずれ
も図１７に示すように電気回路連絡状態に接続されてい
る。
【００８３】座標センサ１２２とオーバレイ・センサ１
２４は、図４に関連する説明で前述した通りである。座
標決定回路２０２は、座標センサ１２２、インタフェー
ス回路２１０、および１００ミリ秒タイマ２０８と回路
連絡状態になっている。また、座標決定回路２０２は、
座標センサ１２２から電気信号２０３を受け入れて、指
またはスタイラス２１などによる接触位置に対応するＸ
軸およびＹ軸の値を決定できるように構成されている。
たとえば、座標センサ１２２がスイッチ式センサであれ
ば、座標決定回路２０２は、当技術分野で周知の通り、
どのスイッチが閉止されたかを決定するためのドライバ
およびレシーバと、そのスイッチの位置をパッド表面１
１０との相対関係において意味のある値に変換するため
の論理回路とで構成されるだろう。
２４は、図４に関連する説明で前述した通りである。座
標決定回路２０２は、座標センサ１２２、インタフェー
ス回路２１０、および１００ミリ秒タイマ２０８と回路
連絡状態になっている。また、座標決定回路２０２は、
座標センサ１２２から電気信号２０３を受け入れて、指
またはスタイラス２１などによる接触位置に対応するＸ
軸およびＹ軸の値を決定できるように構成されている。
たとえば、座標センサ１２２がスイッチ式センサであれ
ば、座標決定回路２０２は、当技術分野で周知の通り、
どのスイッチが閉止されたかを決定するためのドライバ
およびレシーバと、そのスイッチの位置をパッド表面１
１０との相対関係において意味のある値に変換するため
の論理回路とで構成されるだろう。
【００８４】オーバレイ検出回路２０４は、オーバレイ
・センサ１２４およびインタフェース回路２１０と回路
連絡状態になっている。このオーバレイ検出回路２０４
は、オーバレイ・センサ１２４から電気信号２０５を受
け入れて、識別パターン１０８に対応するメッセージを
生成するが、識別パターン１０８が欠落している場合
は、前述の通り、００００００2として検出される。
・センサ１２４およびインタフェース回路２１０と回路
連絡状態になっている。このオーバレイ検出回路２０４
は、オーバレイ・センサ１２４から電気信号２０５を受
け入れて、識別パターン１０８に対応するメッセージを
生成するが、識別パターン１０８が欠落している場合
は、前述の通り、００００００2として検出される。
【００８５】方向決定回路２０６は、ジョイスティック
・センサ２００ａ、２００ｂおよびインタフェース回路
２１０と回路連絡状態になっている。ジョイスティック
・センサ２００ａ、２００ｂは、前述の通り、４つのゴ
ム製ドーム形スイッチ１５０ａ〜１５０ｄと２つのジョ
イスティック・スイッチ１３０ａ、１３０ｂとで構成さ
れている。方向決定回路は、これらのスイッチの閉止事
象に基づいてメッセージを生成する。
・センサ２００ａ、２００ｂおよびインタフェース回路
２１０と回路連絡状態になっている。ジョイスティック
・センサ２００ａ、２００ｂは、前述の通り、４つのゴ
ム製ドーム形スイッチ１５０ａ〜１５０ｄと２つのジョ
イスティック・スイッチ１３０ａ、１３０ｂとで構成さ
れている。方向決定回路は、これらのスイッチの閉止事
象に基づいてメッセージを生成する。
【００８６】１００ミリ秒タイマ２０８は、座標決定回
路２０２と電気回路連絡状態になっている。このタイマ
２０８は、１００ミリ秒の期間の時間切れを繰り返し判
定し、その期間の時間切れを示す信号２０９を生成す
る。座標決定回路２０２では、この信号２０９を使用し
て、タイマ２０８が次に１００ミリ秒の期間の時間切れ
を検出するまでの指またはスタイラス２１などの接触位
置の変化を検出する。
路２０２と電気回路連絡状態になっている。このタイマ
２０８は、１００ミリ秒の期間の時間切れを繰り返し判
定し、その期間の時間切れを示す信号２０９を生成す
る。座標決定回路２０２では、この信号２０９を使用し
て、タイマ２０８が次に１００ミリ秒の期間の時間切れ
を検出するまでの指またはスタイラス２１などの接触位
置の変化を検出する。
【００８７】インタフェース回路２１０は、座標決定回
路２０２、オーバレイ検出回路２０４、データ処理装置
１２（シリアル・データ・ライン２２による）、および
その他の入力装置（ある場合は、シリアル・データ・ラ
イン延長部２３による）と回路連絡状態になっている。
インタフェース回路２１０は、座標決定回路２０２が決
定した座標値、オーバレイ検出回路２０４が生成したオ
ーバレイ・メッセージ、および方向決定回路２０６が生
成したメッセージを受け入れて、シリアル・データ・ラ
イン２２を介してこのような情報をデータ処理装置１２
に伝送する。
路２０２、オーバレイ検出回路２０４、データ処理装置
１２（シリアル・データ・ライン２２による）、および
その他の入力装置（ある場合は、シリアル・データ・ラ
イン延長部２３による）と回路連絡状態になっている。
インタフェース回路２１０は、座標決定回路２０２が決
定した座標値、オーバレイ検出回路２０４が生成したオ
ーバレイ・メッセージ、および方向決定回路２０６が生
成したメッセージを受け入れて、シリアル・データ・ラ
イン２２を介してこのような情報をデータ処理装置１２
に伝送する。
【００８８】すべての入力装置は、データ処理装置１２
に対してデイジー・チェーン接続されている。このた
め、インタフェース回路は、他の入力装置からのすべて
のパケットをＣＰＵ３０に渡さなければならない。以下
に詳述するように、データ処理装置１２に接続されてい
る各入力装置には、固有の装置番号が付いている。デー
タ処理装置１２に最も近い装置は装置番号０を有し、デ
ータ処理装置１２から離れれば離れるほど、その装置番
号が大きくなる。しかし、入力装置は自分の装置番号ま
たは他の装置の装置番号を把握しているわけではない。
このため、それぞれの装置は、同じタイプの他の入力装
置から渡されたデータ・パケットの装置番号に１を加え
なければならない。チェーン構成内にあって装置番号が
１５を超える入力装置は無視される。
に対してデイジー・チェーン接続されている。このた
め、インタフェース回路は、他の入力装置からのすべて
のパケットをＣＰＵ３０に渡さなければならない。以下
に詳述するように、データ処理装置１２に接続されてい
る各入力装置には、固有の装置番号が付いている。デー
タ処理装置１２に最も近い装置は装置番号０を有し、デ
ータ処理装置１２から離れれば離れるほど、その装置番
号が大きくなる。しかし、入力装置は自分の装置番号ま
たは他の装置の装置番号を把握しているわけではない。
このため、それぞれの装置は、同じタイプの他の入力装
置から渡されたデータ・パケットの装置番号に１を加え
なければならない。チェーン構成内にあって装置番号が
１５を超える入力装置は無視される。
【００８９】たとえば、αがデータ処理装置１２に接続
され、βがαに接続され、γがβに接続されるという具
合に、同じタイプの３つの入力装置α、β、およびγが
データ処理装置１２に接続されていると想定する。する
と、αは装置番号０を有し、βは装置番号１を有し、γ
は装置番号２を有することになる。これ以外の装置は、
自分の装置番号または他の装置の装置番号を把握してい
ない。それぞれの装置は自分のデータ・パケットに装置
番号０を付けて送ることになる。
され、βがαに接続され、γがβに接続されるという具
合に、同じタイプの３つの入力装置α、β、およびγが
データ処理装置１２に接続されていると想定する。する
と、αは装置番号０を有し、βは装置番号１を有し、γ
は装置番号２を有することになる。これ以外の装置は、
自分の装置番号または他の装置の装置番号を把握してい
ない。それぞれの装置は自分のデータ・パケットに装置
番号０を付けて送ることになる。
【００９０】αがデータ処理装置１２にデータ・パケッ
トを渡す場合、αはデータ処理装置１２に最も近いの
で、デフォルトの装置番号０が正しいことになる。しか
し、βとγも装置番号０を付けてデータ・パケットを送
ってしまう。このような状況を改善するため、それぞれ
の装置は渡されたパケットの装置番号に１を加える。こ
のため、βがγからαにデータ・パケットを渡す場合、
βはその装置番号に１を加え、それにより、γから受け
取ったパケットに装置番号１を付ける。同様に、αがγ
のデータ・パケットをデータ処理装置１２に渡す場合、
αはその装置番号に１を加え、それにより、γから受け
取ったパケットに正しい装置番号２を付ける。したがっ
て、チェーン内の各装置は、同じタイプの装置から受け
取って次の装置に渡される各データ・パケットの装置番
号に１を加えることになる。
トを渡す場合、αはデータ処理装置１２に最も近いの
で、デフォルトの装置番号０が正しいことになる。しか
し、βとγも装置番号０を付けてデータ・パケットを送
ってしまう。このような状況を改善するため、それぞれ
の装置は渡されたパケットの装置番号に１を加える。こ
のため、βがγからαにデータ・パケットを渡す場合、
βはその装置番号に１を加え、それにより、γから受け
取ったパケットに装置番号１を付ける。同様に、αがγ
のデータ・パケットをデータ処理装置１２に渡す場合、
αはその装置番号に１を加え、それにより、γから受け
取ったパケットに正しい装置番号２を付ける。したがっ
て、チェーン内の各装置は、同じタイプの装置から受け
取って次の装置に渡される各データ・パケットの装置番
号に１を加えることになる。
【００９１】このため、他の入力装置（ある場合）から
受け取ったデータ・パケットを渡すことに加え、インタ
フェース回路２１０は、シリアル・データ・ライン延長
部２３を介して同じタイプの装置から受け取ったすべて
のデータ・パケットの装置番号に１を加える。つまり、
インタフェース回路２１０は、変更済み装置番号と未変
更装置番号を付けたデータ・パケットをデータ処理装置
１２に渡すのである。
受け取ったデータ・パケットを渡すことに加え、インタ
フェース回路２１０は、シリアル・データ・ライン延長
部２３を介して同じタイプの装置から受け取ったすべて
のデータ・パケットの装置番号に１を加える。つまり、
インタフェース回路２１０は、変更済み装置番号と未変
更装置番号を付けたデータ・パケットをデータ処理装置
１２に渡すのである。
【００９２】本発明の入力装置１８とともにシステム１
０を使用する方法は非常に簡単である。入力装置は、シ
リアル・ライン２２を介してデータ処理装置１２にデー
タ・パケットを送る。前述の通り、入力装置は入出力共
用プロセッサ３６を介してＣＰＵ３０とのインタフェー
スを取る。それぞれの入力装置は、次の入力装置にデイ
ジー・チェーン接続されている。入出力共用プロセッサ
３６は、データ・パケットを受け取って、それを先入れ
先出し法（ＦＩＦＯ）で格納する。
０を使用する方法は非常に簡単である。入力装置は、シ
リアル・ライン２２を介してデータ処理装置１２にデー
タ・パケットを送る。前述の通り、入力装置は入出力共
用プロセッサ３６を介してＣＰＵ３０とのインタフェー
スを取る。それぞれの入力装置は、次の入力装置にデイ
ジー・チェーン接続されている。入出力共用プロセッサ
３６は、データ・パケットを受け取って、それを先入れ
先出し法（ＦＩＦＯ）で格納する。
【００９３】５０ミリ秒の「目盛り」ごとに、入出力共
用プロセッサ３６はＣＰＵ３０に割り込む。これに対す
る応答として、ＣＰＵは、前述の通り、共用プロセッサ
３６の入出力ポートＡＳ０にある単一バイトにアクセス
し、ＣＰＵによる最後のアクセス以降の目盛り数と、転
送される装置メッセージの数を決定する。１０種類の装
置メッセージを次の表に示す。
用プロセッサ３６はＣＰＵ３０に割り込む。これに対す
る応答として、ＣＰＵは、前述の通り、共用プロセッサ
３６の入出力ポートＡＳ０にある単一バイトにアクセス
し、ＣＰＵによる最後のアクセス以降の目盛り数と、転
送される装置メッセージの数を決定する。１０種類の装
置メッセージを次の表に示す。
【００９４】
【表１】
【００９５】表に示すように、上記のメッセージ構造
は、異なる長さを持ち、対応する入力装置に密接に関連
する構造を持っている。表の装置メッセージは、個々の
入出力装置から入出力共用プロセッサに送られるデータ
の場合、入出力共用プロセッサからＣＰＵに送られるデ
ータと同じである。上記の構造に加え、入力装置１８か
らデータ処理装置１２に破壊されていないデータが確実
に送られるようにするために、入出力装置から入出力共
用プロセッサへ送られる各メッセージにはチェックサム
が付いている。このチェックサムは、チェックサム値が
（合計中の桁上げを無視して）全バイトの合計をゼロに
するのに必要な値になっている、標準のモジュロ２５６
チェックサムである。入出力共用プロセッサは、ＣＰＵ
にデータを送る前にチェックサムを取り除く。このた
め、ＣＰＵが読み取るバイトのストリームは、（１）Ｃ
ＰＵが読み取る最初のバイトが、目盛りの数と入出力装
置メッセージの数を含む特殊なバイトである点と、
（２）チェックサムが欠落する点を除き、入出力共用プ
ロセッサが受け取るバイトのストリームとほぼ同じにな
る。
は、異なる長さを持ち、対応する入力装置に密接に関連
する構造を持っている。表の装置メッセージは、個々の
入出力装置から入出力共用プロセッサに送られるデータ
の場合、入出力共用プロセッサからＣＰＵに送られるデ
ータと同じである。上記の構造に加え、入力装置１８か
らデータ処理装置１２に破壊されていないデータが確実
に送られるようにするために、入出力装置から入出力共
用プロセッサへ送られる各メッセージにはチェックサム
が付いている。このチェックサムは、チェックサム値が
（合計中の桁上げを無視して）全バイトの合計をゼロに
するのに必要な値になっている、標準のモジュロ２５６
チェックサムである。入出力共用プロセッサは、ＣＰＵ
にデータを送る前にチェックサムを取り除く。このた
め、ＣＰＵが読み取るバイトのストリームは、（１）Ｃ
ＰＵが読み取る最初のバイトが、目盛りの数と入出力装
置メッセージの数を含む特殊なバイトである点と、
（２）チェックサムが欠落する点を除き、入出力共用プ
ロセッサが受け取るバイトのストリームとほぼ同じにな
る。
【００９６】ＰＳ／２のマウスおよびキーボード装置は
装置タイプ０としてサポートされている。このキーボー
ドにはチェーン番号０が付き、マウスにはチェーン番号
１が付いている。これらの装置は、シリアル・データ・
リンク２２を介して既存のＰＳ／２プロトコルを使用し
て入出力共用プロセッサによってサポートされる。
装置タイプ０としてサポートされている。このキーボー
ドにはチェーン番号０が付き、マウスにはチェーン番号
１が付いている。これらの装置は、シリアル・データ・
リンク２２を介して既存のＰＳ／２プロトコルを使用し
て入出力共用プロセッサによってサポートされる。
【００９７】この装置タイプ１は、複数のボタンを備え
た装置用である。このメッセージ・タイプを使用して、
最高２５５バイト（１バイト当たり８つのボタン）また
は２０４０個までのボタンをシステムに入力することが
できる。開放状態のボタンは論理０として送られるのに
対し、閉止状態のボタンは論理１として送られる。これ
は可変長メッセージである。
た装置用である。このメッセージ・タイプを使用して、
最高２５５バイト（１バイト当たり８つのボタン）また
は２０４０個までのボタンをシステムに入力することが
できる。開放状態のボタンは論理０として送られるのに
対し、閉止状態のボタンは論理１として送られる。これ
は可変長メッセージである。
【００９８】ジョイスティック２０ａ、２０ｂなどのデ
ィジタル・ジョイスティックは、装置タイプ２としてサ
ポートされている。それぞれのタッチパッド１９には、
２本のジョイスティックが関連付けられている。それぞ
れのジョイスティックには、固有のチェーン番号が付い
ている。それぞれの左ジョイスティックは奇数（１、
３、５、７、９など）になり、それぞれの右ジョイステ
ィックは偶数（０、２、４、６、など）になる。それぞ
れのジョイスティックは独立して報告される。このメッ
セージは固定長メッセージである。ディジタル・ジョイ
スティック・センサが複数のスイッチ１５０ａ〜１５０
ｄで構成されていることを想起されたい。この場合のメ
ッセージは、最高８つまでのスイッチを表す１バイトで
あり、そのスイッチには、運動センサ・スイッチ１５０
ａ〜１５０ｄと、スイッチ１３０ａなどのデータ入力ス
イッチが含まれる。このタイプのメッセージ・バイトの
個々のビットは、上スイッチ（ＭＳＢ）、下スイッチ、
左スイッチ、右スイッチ、スイッチ＃１、スイッチ＃
２、スイッチ＃３、およびスイッチ＃４（ＬＳＢ）を表
す。タッチパッド１９に含まれるジョイスティック２０
ａ、２０ｂには、ボタン１３０が１つずつしか付いてい
ないが、このボタンは、上記のスイッチ＃１に対応す
る。残りの３つのボタンは必ずゼロとして報告される。
ィジタル・ジョイスティックは、装置タイプ２としてサ
ポートされている。それぞれのタッチパッド１９には、
２本のジョイスティックが関連付けられている。それぞ
れのジョイスティックには、固有のチェーン番号が付い
ている。それぞれの左ジョイスティックは奇数（１、
３、５、７、９など）になり、それぞれの右ジョイステ
ィックは偶数（０、２、４、６、など）になる。それぞ
れのジョイスティックは独立して報告される。このメッ
セージは固定長メッセージである。ディジタル・ジョイ
スティック・センサが複数のスイッチ１５０ａ〜１５０
ｄで構成されていることを想起されたい。この場合のメ
ッセージは、最高８つまでのスイッチを表す１バイトで
あり、そのスイッチには、運動センサ・スイッチ１５０
ａ〜１５０ｄと、スイッチ１３０ａなどのデータ入力ス
イッチが含まれる。このタイプのメッセージ・バイトの
個々のビットは、上スイッチ（ＭＳＢ）、下スイッチ、
左スイッチ、右スイッチ、スイッチ＃１、スイッチ＃
２、スイッチ＃３、およびスイッチ＃４（ＬＳＢ）を表
す。タッチパッド１９に含まれるジョイスティック２０
ａ、２０ｂには、ボタン１３０が１つずつしか付いてい
ないが、このボタンは、上記のスイッチ＃１に対応す
る。残りの３つのボタンは必ずゼロとして報告される。
【００９９】マウスやトラックボールなどの座標装置
は、装置タイプ３として報告される。ＩＤに続く最初の
バイトは、その装置用のボタン情報を報告するためのも
のである。最高８個までのボタンを報告することができ
る。次のバイトは、デルタＹ値が後に続くデルタＸ値で
ある。このデルタＸ値とデルタＹ値は、最後に報告され
た装置の位置に基づくものである。必要であれば、アプ
リケーション・プログラムはこれらの値を絶対座標に変
換しなければならない。最大運動は２５５である。実際
の運動が２５５を超えた場合は、２つまたはそれ以上の
メッセージが送られる。これは固定長メッセージであ
る。
は、装置タイプ３として報告される。ＩＤに続く最初の
バイトは、その装置用のボタン情報を報告するためのも
のである。最高８個までのボタンを報告することができ
る。次のバイトは、デルタＹ値が後に続くデルタＸ値で
ある。このデルタＸ値とデルタＹ値は、最後に報告され
た装置の位置に基づくものである。必要であれば、アプ
リケーション・プログラムはこれらの値を絶対座標に変
換しなければならない。最大運動は２５５である。実際
の運動が２５５を超えた場合は、２つまたはそれ以上の
メッセージが送られる。これは固定長メッセージであ
る。
【０１００】タッチパッド１９は、装置タイプ４として
サポートされている。この装置タイプの他の装置として
は、アナログ・ジョイスティックがある。ＩＤに続く最
初のバイトを使用して、ボタン情報が報告される。次の
バイトは、絶対Ｘ座標を報告する場合に使用する。絶対
Ｙ座標が次に続く。絶対Ｘ値および絶対Ｙ値は、それぞ
れ１バイトであり、０〜２５５の範囲に限定される。こ
れは固定長メッセージである。
サポートされている。この装置タイプの他の装置として
は、アナログ・ジョイスティックがある。ＩＤに続く最
初のバイトを使用して、ボタン情報が報告される。次の
バイトは、絶対Ｘ座標を報告する場合に使用する。絶対
Ｙ座標が次に続く。絶対Ｘ値および絶対Ｙ値は、それぞ
れ１バイトであり、０〜２５５の範囲に限定される。こ
れは固定長メッセージである。
【０１０１】タッチパッド・オーバレイ１０２は、装置
タイプ５として報告される。タッチパッド・オーバレイ
は、タッチパッド内の６ビットのセンサ１２４を使用し
て感知される。タッチパッドによってオーバレイの変更
が感知されると、メッセージが生成される。すべてのオ
ーバレイ・コードがアプリケーションに依存しているの
で、アプリケーション・プログラムは各オーバレイのコ
ードを認識していなければならない。このメッセージは
固定長メッセージである。
タイプ５として報告される。タッチパッド・オーバレイ
は、タッチパッド内の６ビットのセンサ１２４を使用し
て感知される。タッチパッドによってオーバレイの変更
が感知されると、メッセージが生成される。すべてのオ
ーバレイ・コードがアプリケーションに依存しているの
で、アプリケーション・プログラムは各オーバレイのコ
ードを認識していなければならない。このメッセージは
固定長メッセージである。
【０１０２】アクション・メッセージの使用目的は、複
数の装置タイプによって行われる生成方法は様々である
が、システムとアプリケーション・プログラムによる使
用および解釈の方法が同じになるような、一般的なセッ
トの事前定義装置独立機能を定義することである。アク
ション・メッセージは、可変長メッセージを使用して、
装置タイプ６として報告される。この特定の実施例で
は、３通りの装置独立機能が定義され、ＳＴＡＲＴ（活
動または処理を開始する）、ＰＡＵＳＥ（活動または処
理を停止する）、およびＳＥＬＥＣＴ（複数の事象また
はアクションから１つを選択する）というこのバイトの
下位３ビットにそれぞれ関連付けられている。上記の機
能を報告するには、これらのビットを設定する。他のす
べてのビットは今後の使用のために予約されており、Ｃ
ＰＵに対してゼロとして報告される。
数の装置タイプによって行われる生成方法は様々である
が、システムとアプリケーション・プログラムによる使
用および解釈の方法が同じになるような、一般的なセッ
トの事前定義装置独立機能を定義することである。アク
ション・メッセージは、可変長メッセージを使用して、
装置タイプ６として報告される。この特定の実施例で
は、３通りの装置独立機能が定義され、ＳＴＡＲＴ（活
動または処理を開始する）、ＰＡＵＳＥ（活動または処
理を停止する）、およびＳＥＬＥＣＴ（複数の事象また
はアクションから１つを選択する）というこのバイトの
下位３ビットにそれぞれ関連付けられている。上記の機
能を報告するには、これらのビットを設定する。他のす
べてのビットは今後の使用のために予約されており、Ｃ
ＰＵに対してゼロとして報告される。
【０１０３】システム・パススルー・メッセージ・タイ
プは、前に定義したどの装置タイプにも適用できない装
置タイプを扱う場合に使用する。メッセージ・タイプ１
４が使用される。これは可変長メッセージである。デー
タの定義は、装置に依存し、アプリケーションに固有の
ものになる。それぞれのアプリケーションは、このタイ
プのメッセージを必須機能に変換しなければならない。
プは、前に定義したどの装置タイプにも適用できない装
置タイプを扱う場合に使用する。メッセージ・タイプ１
４が使用される。これは可変長メッセージである。デー
タの定義は、装置に依存し、アプリケーションに固有の
ものになる。それぞれのアプリケーションは、このタイ
プのメッセージを必須機能に変換しなければならない。
【０１０４】それぞれの装置から送られる最初のメッセ
ージは装置タイプ１５である。これは、ある装置から入
力メッセージが送られることをシステムに通知する場合
に使用する。このメッセージは、入力の報告に使用され
る今後の装置タイプも定義する。これは可変長メッセー
ジである。
ージは装置タイプ１５である。これは、ある装置から入
力メッセージが送られることをシステムに通知する場合
に使用する。このメッセージは、入力の報告に使用され
る今後の装置タイプも定義する。これは可変長メッセー
ジである。
【０１０５】システム電源投入および５０ｍｓ間隔の場
合、入出力共用プロセッサは、カートリッジおよび拡張
センス・ラインを走査し、構成を判定してシステムに警
告し、構成バイトをＣＰＵに送る。これは、電源投入時
にＣＰＵが入出力共用プロセッサから受け取る最初のバ
イトである。入出力共用プロセッサは、変更が感知され
るとモジュール構成割込みを起こすだけである。つま
り、カートリッジ状況が変化すると、システム・リセッ
トが行われ、それにより、入出力共用プロセッサはＣＰ
Ｕにもう１つの構成バイトを送る。関連項目の存在を示
すために、送られるバイト内の適切なビット・セットが
設定される。つまり、ビット０はカートリッジ１に対応
し、ビット１はカートリッジ２に対応し、ビット２は任
意選択のＣＤドライブに対応する。残りのビットは０に
設定される。
合、入出力共用プロセッサは、カートリッジおよび拡張
センス・ラインを走査し、構成を判定してシステムに警
告し、構成バイトをＣＰＵに送る。これは、電源投入時
にＣＰＵが入出力共用プロセッサから受け取る最初のバ
イトである。入出力共用プロセッサは、変更が感知され
るとモジュール構成割込みを起こすだけである。つま
り、カートリッジ状況が変化すると、システム・リセッ
トが行われ、それにより、入出力共用プロセッサはＣＰ
Ｕにもう１つの構成バイトを送る。関連項目の存在を示
すために、送られるバイト内の適切なビット・セットが
設定される。つまり、ビット０はカートリッジ１に対応
し、ビット１はカートリッジ２に対応し、ビット２は任
意選択のＣＤドライブに対応する。残りのビットは０に
設定される。
【０１０６】さらに、ＣＰＵは、入出力共用プロセッサ
３６に情報を書き込むことで、シリアル・リンク２２を
介して入出力装置にデータを伝送することができる。複
数のデータ・バイトが入出力ポートＡＳ０に書き込ま
れ、それぞれのバイトの前にはバイト０３Ｈが付けられ
る。入出力共用プロセッサはこれらのバイトを入出力装
置に書き込む。この機能を使用して、プリンタ（図示せ
ず）などにデータが送られる。
３６に情報を書き込むことで、シリアル・リンク２２を
介して入出力装置にデータを伝送することができる。複
数のデータ・バイトが入出力ポートＡＳ０に書き込ま
れ、それぞれのバイトの前にはバイト０３Ｈが付けられ
る。入出力共用プロセッサはこれらのバイトを入出力装
置に書き込む。この機能を使用して、プリンタ（図示せ
ず）などにデータが送られる。
【０１０７】２本のジョイスティックと、記入済みデフ
ォルト・テンプレート・グラフィック・イメージを備え
たタッチパッドとを有する、本発明の入力装置とのイン
タフェースの取り方も簡単である。システムＢＩＯＳか
らＣＰＵ３０上で実行される割込みハンドラが、入出力
共用プロセッサ３６を介して入力装置からデータを受け
取る。この割込みハンドラは、入出力共用プロセッサ３
６からメモリ３３への伝送を行うだけである。ＣＰＵ３
０上で実行されるアプリケーション・プログラムは、ソ
フトウェア割込みを介して定期的にオペレーティング・
システムのＢＩＯＳへのポーリングを行って、入力が受
け取られたかどうかを判定する。受け取られている場合
は、ソフトウェア割込みに対する応答として、その入力
がオペレーティング・システムによってアプリケーショ
ン・プログラムに送られる。
ォルト・テンプレート・グラフィック・イメージを備え
たタッチパッドとを有する、本発明の入力装置とのイン
タフェースの取り方も簡単である。システムＢＩＯＳか
らＣＰＵ３０上で実行される割込みハンドラが、入出力
共用プロセッサ３６を介して入力装置からデータを受け
取る。この割込みハンドラは、入出力共用プロセッサ３
６からメモリ３３への伝送を行うだけである。ＣＰＵ３
０上で実行されるアプリケーション・プログラムは、ソ
フトウェア割込みを介して定期的にオペレーティング・
システムのＢＩＯＳへのポーリングを行って、入力が受
け取られたかどうかを判定する。受け取られている場合
は、ソフトウェア割込みに対する応答として、その入力
がオペレーティング・システムによってアプリケーショ
ン・プログラムに送られる。
【０１０８】アプリケーション・プログラムは現行テン
プレートを監視する。デフォルト・テンプレート・グラ
フィック・イメージが検出される（オーバレイ・センサ
１２４がすべての伝送タイプの識別パターン１０８、す
なわち、００００００2を検出する）と、アプリケーシ
ョン・プログラムはデフォルト・テンプレートに応じて
動作する。これに対して、テンプレート・オーバレイ１
０２が検出された場合は、アプリケーション・プログラ
ムはその特定のテンプレート・オーバレイ１０２に応じ
て動作する。
プレートを監視する。デフォルト・テンプレート・グラ
フィック・イメージが検出される（オーバレイ・センサ
１２４がすべての伝送タイプの識別パターン１０８、す
なわち、００００００2を検出する）と、アプリケーシ
ョン・プログラムはデフォルト・テンプレートに応じて
動作する。これに対して、テンプレート・オーバレイ１
０２が検出された場合は、アプリケーション・プログラ
ムはその特定のテンプレート・オーバレイ１０２に応じ
て動作する。
【０１０９】その実施例の説明により本発明を例示し、
その実施例をかなり詳細に説明してきたが、これは、特
許請求の範囲をこのような詳細例に制限または限定する
ためのものではない。当業者には、他の利点および変更
態様が容易に明らかになるだろう。たとえば、ＱＷＥＲ
ＴＹまたは他のタイプのキーボードをタッチパッド表面
１００の表面内または表面上に記入できるはずである。
もう１つの例として、座標決定回路２０２、オーバレイ
検出回路２０４、ジョイスティック回路２０６、１００
ミリ秒タイマ２０８、およびインタフェース回路２１０
をすべて１つのマイクロコントローラに実現することも
できる。このため、本発明は、その広い態様から、具体
的な詳細例、典型的な装置と方法、および図示し説明し
た実例に限定されない。したがって、本出願人の一般的
な発明概念の精神または範囲を逸脱せずに、このような
詳細例から離れることは可能である。
その実施例をかなり詳細に説明してきたが、これは、特
許請求の範囲をこのような詳細例に制限または限定する
ためのものではない。当業者には、他の利点および変更
態様が容易に明らかになるだろう。たとえば、ＱＷＥＲ
ＴＹまたは他のタイプのキーボードをタッチパッド表面
１００の表面内または表面上に記入できるはずである。
もう１つの例として、座標決定回路２０２、オーバレイ
検出回路２０４、ジョイスティック回路２０６、１００
ミリ秒タイマ２０８、およびインタフェース回路２１０
をすべて１つのマイクロコントローラに実現することも
できる。このため、本発明は、その広い態様から、具体
的な詳細例、典型的な装置と方法、および図示し説明し
た実例に限定されない。したがって、本出願人の一般的
な発明概念の精神または範囲を逸脱せずに、このような
詳細例から離れることは可能である。
【０１１０】まとめとして、本発明の構成に関して以下
の事項を開示する。
の事項を開示する。
【０１１１】（１）（ａ）指またはスタイラスなどによ
り接触できるように露出されたパッド表面と、（ｂ）前
記パッド表面に近接してテンプレート・オーバレイを脱
着式に固定するためのリテーナと、（ｃ）前記パッド表
面に近接し、スタイラスまたは指などによる前記パッド
表面への接触または前記パッド表面に近接するテンプレ
ート・オーバレイへの接触に応じて電気信号を生成する
ためのタッチパッドであって、前記電気信号が接触位置
の座標に対応するように構成されている、タッチパッド
とを含み、前記パッド表面がそれに関連する記入済みデ
フォルト・テンプレート・グラフィック・イメージを有
することを特徴とする、入力装置。 （２）（ａ）指またはスタイラスなどにより接触できる
ように露出されたパッド表面と、（ｂ）前記パッド表面
に近接してテンプレート・オーバレイを脱着式に固定す
るためのリテーナと、（ｃ）前記パッド表面に近接し、
スタイラスまたは指などによる前記パッド表面への接触
または前記パッド表面に近接するテンプレート・オーバ
レイへの接触に応じて少なくとも１つの電気信号を生成
するための座標センサであって、前記少なくとも１つの
電気信号が接触位置の座標に対応するように構成されて
いる、座標センサと、（ｄ）前記パッド表面に近接する
剛性ベースと、（ｅ）前記座標センサと回路連絡状態に
なっており、前記少なくとも１つの電気信号から、前記
パッド表面に接触したか、または前記パッド表面に近接
するテンプレート・オーバレイに接触したスタイラスま
たは指などの座標を決定するための座標決定回路と、
（ｆ）前記座標決定回路と回路連絡状態になっており、
前記タッチパッドの外部にある装置に決定した座標を送
るためのインタフェース回路とを含み、前記パッド表面
がそれに関連する記入済みデフォルト・テンプレート・
グラフィック・イメージを有することを特徴とする、タ
ッチパッド。 （３）（ａ）中央演算処理装置（ＣＰＵ）と、（ｂ）前
記ＣＰＵと回路連絡状態になっているメモリ回路と、
（ｃ）前記ＣＰＵおよび前記メモリと回路連絡状態にな
っており、ビデオ表示装置上に表示される視覚イメージ
に対応する電気信号を生成するためのビデオ回路と、
（ｄ）前記ＣＰＵと回路連絡状態になっており、外部装
置から前記ＣＰＵに送られる信号のインタフェースを取
るための周辺インタフェース回路と、（ｅ）指またはス
タイラスなどにより接触できるように露出されたパッド
表面と、（ｆ）前記パッド表面に近接してテンプレート
・オーバレイを脱着式に固定するためのリテーナと、
（ｇ）前記パッド表面に近接し、スタイラスまたは指な
どによる前記パッド表面への接触または前記パッド表面
に近接するテンプレート・オーバレイへの接触に応じて
少なくとも１つの電気信号を生成するための座標センサ
であって、前記少なくとも１つの電気信号が接触位置の
座標に対応するように構成されている、座標センサと、
（ｈ）前記パッド表面に近接する剛性ベースと、（ｉ）
前記座標センサと回路連絡状態になっており、前記パッ
ド表面に接触したか、または前記パッド表面に近接する
テンプレート・オーバレイに接触したスタイラスまたは
指などの座標を決定するための座標決定回路と、（ｊ）
前記座標決定回路および前記周辺インタフェース回路と
回路連絡状態になっており、それに決定した座標を送る
ためのインタフェース回路とを含み、前記パッド表面が
それに関連する記入済みデフォルト・テンプレート・グ
ラフィック・イメージを有することを特徴とする、コン
ピュータ・システム。 （４）前記ＣＰＵ上で実行されるアプリケーション・プ
ログラムに決定した座標を送るように構成された、前記
ＣＰＵ上で実行するためのソフトウェア・モジュールを
さらに含むことを特徴とする、上記（３）に記載のコン
ピュータ・システム。 （５）（ａ）テンプレート・オーバレイに関連する識別
構造の存在を検出し、さらに識別構造の不在を検出する
ためのテンプレート・オーバレイ・センサと、（ｂ）前
記テンプレート・オーバレイ・センサおよび前記インタ
フェース回路と回路連絡状態になっており、前記テンプ
レート・オーバレイ・センサにより検出された識別構造
に応じて、識別構造に対応する電気信号を生成するため
のオーバレイ検出回路とをさらに含むことを特徴とす
る、上記（３）に記載のコンピュータ・システム。 （６）（ａ）タッチパッドと、（ｂ）動作上、前記タッ
チパッドに関連する少なくとも２本のジョイスティック
とを含む、入力装置。 （７）前記ジョイスティックが前記タッチパッドの両側
に１本ずつ配置されていることを特徴とする、上記
（６）に記載の入力装置。 （８）（ａ）エンクロージャと、（ｂ）前記エンクロー
ジャに物理的に接合され、指またはスタイラスなどによ
り接触できるように露出されたタッチパッドと、（ｃ）
前記エンクロージャに物理的に接合され、前記タッチパ
ッドの両側に１本ずつ配置されている２本のジョイステ
ィックとを含む、入力装置。 （９）中央エンクロージャ内に密閉された中央演算処理
装置（ＣＰＵ）を有するコンピュータ・システムで使用
するための入力装置において、（ａ）それに関連するジ
ョイスティック回路を有する少なくとも２本のジョイス
ティックであって、前記ジョイスティック回路が、前記
ジョイスティックの運動に応じてジョイスティック信号
を生成するように構成されている、少なくとも２本のジ
ョイスティックと、（ｂ）パッド表面を有し、前記パッ
ド表面への接触に応じて接触位置信号を生成するように
構成されているタッチパッドと、（ｃ）前記ジョイステ
ィック回路および前記タッチパッドと回路連絡状態にな
っており、前記ジョイスティックの運動に対応するデー
タ・パケットをＣＰＵに送るように構成され、さらに指
またはスタイラスなどによる前記パッド表面への接触位
置に対応するデータ・パケットをＣＰＵに送るように構
成されているインタフェース回路とを含む、入力装置。 （１０）入力装置エンクロージャをさらに含み、前記ジ
ョイスティックおよび前記タッチパッドが前記入力装置
エンクロージャに物理的に接合されていることを特徴と
する、上記（９）に記載の入力装置。 （１１）入力装置エンクロージャをさらに含み、前記ジ
ョイスティックおよび前記タッチパッドが、前記入力装
置エンクロージャに物理的に接合されており、さらに前
記タッチパッドが前記入力装置エンクロージャの１面の
中心に配置され、前記ジョイスティックが前記タッチパ
ッドの両側に配置されるように構成されていることを特
徴とする、上記（９）に記載の入力装置。 （１２）入力装置エンクロージャをさらに含み、前記ジ
ョイスティックおよび前記タッチパッドが前記入力装置
エンクロージャに物理的に接合され、前記タッチパッド
が１対の長い辺と１対の短い辺とを有するほぼ矩形の形
状を有し、前記タッチパッドが前記入力装置エンクロー
ジャの１面の中心に配置され、前記ジョイスティックが
前記タッチパッドの短い辺に隣接して配置されているこ
とを特徴とする、上記（９）に記載の入力装置。 （１３）（ａ）中央エンクロージャ内に密閉されたＣＰ
Ｕと、（ｂ）前記ＣＰＵと回路連絡状態になっている第
一および第二のジョイスティックと、（ｃ）前記ＣＰＵ
と回路連絡状態になっているタッチパッドとを含む、コ
ンピュータ・システム。 （１４）入力装置エンクロージャをさらに含み、前記タ
ッチパッドおよび前記第一および第二のジョイスティッ
クが前記入力装置エンクロージャに物理的に接合されて
いることを特徴とする、上記（１３）に記載のコンピュ
ータ・システム。 （１５）入力装置エンクロージャをさらに含み、前記第
一および第二のジョイスティックおよび前記タッチパッ
ドが、前記入力装置エンクロージャに物理的に接合され
ており、さらに前記タッチパッドが前記入力装置エンク
ロージャの１面の中心に配置され、前記ジョイスティッ
クが前記タッチパッドの両側に配置されるように構成さ
れていることを特徴とする、上記（１３）に記載のコン
ピュータ・システム。 （１６）入力装置エンクロージャをさらに含み、前記第
一および第二のジョイスティックおよび前記タッチパッ
ドが前記入力装置エンクロージャに物理的に接合され、
前記タッチパッドが１対の長い辺と１対の短い辺とを有
するほぼ矩形の形状を有し、前記タッチパッドが前記入
力装置エンクロージャの１面の中心に配置され、前記ジ
ョイスティックが前記タッチパッドの短い辺に隣接して
配置されていることを特徴とする、上記（１３）に記載
のコンピュータ・システム。
り接触できるように露出されたパッド表面と、（ｂ）前
記パッド表面に近接してテンプレート・オーバレイを脱
着式に固定するためのリテーナと、（ｃ）前記パッド表
面に近接し、スタイラスまたは指などによる前記パッド
表面への接触または前記パッド表面に近接するテンプレ
ート・オーバレイへの接触に応じて電気信号を生成する
ためのタッチパッドであって、前記電気信号が接触位置
の座標に対応するように構成されている、タッチパッド
とを含み、前記パッド表面がそれに関連する記入済みデ
フォルト・テンプレート・グラフィック・イメージを有
することを特徴とする、入力装置。 （２）（ａ）指またはスタイラスなどにより接触できる
ように露出されたパッド表面と、（ｂ）前記パッド表面
に近接してテンプレート・オーバレイを脱着式に固定す
るためのリテーナと、（ｃ）前記パッド表面に近接し、
スタイラスまたは指などによる前記パッド表面への接触
または前記パッド表面に近接するテンプレート・オーバ
レイへの接触に応じて少なくとも１つの電気信号を生成
するための座標センサであって、前記少なくとも１つの
電気信号が接触位置の座標に対応するように構成されて
いる、座標センサと、（ｄ）前記パッド表面に近接する
剛性ベースと、（ｅ）前記座標センサと回路連絡状態に
なっており、前記少なくとも１つの電気信号から、前記
パッド表面に接触したか、または前記パッド表面に近接
するテンプレート・オーバレイに接触したスタイラスま
たは指などの座標を決定するための座標決定回路と、
（ｆ）前記座標決定回路と回路連絡状態になっており、
前記タッチパッドの外部にある装置に決定した座標を送
るためのインタフェース回路とを含み、前記パッド表面
がそれに関連する記入済みデフォルト・テンプレート・
グラフィック・イメージを有することを特徴とする、タ
ッチパッド。 （３）（ａ）中央演算処理装置（ＣＰＵ）と、（ｂ）前
記ＣＰＵと回路連絡状態になっているメモリ回路と、
（ｃ）前記ＣＰＵおよび前記メモリと回路連絡状態にな
っており、ビデオ表示装置上に表示される視覚イメージ
に対応する電気信号を生成するためのビデオ回路と、
（ｄ）前記ＣＰＵと回路連絡状態になっており、外部装
置から前記ＣＰＵに送られる信号のインタフェースを取
るための周辺インタフェース回路と、（ｅ）指またはス
タイラスなどにより接触できるように露出されたパッド
表面と、（ｆ）前記パッド表面に近接してテンプレート
・オーバレイを脱着式に固定するためのリテーナと、
（ｇ）前記パッド表面に近接し、スタイラスまたは指な
どによる前記パッド表面への接触または前記パッド表面
に近接するテンプレート・オーバレイへの接触に応じて
少なくとも１つの電気信号を生成するための座標センサ
であって、前記少なくとも１つの電気信号が接触位置の
座標に対応するように構成されている、座標センサと、
（ｈ）前記パッド表面に近接する剛性ベースと、（ｉ）
前記座標センサと回路連絡状態になっており、前記パッ
ド表面に接触したか、または前記パッド表面に近接する
テンプレート・オーバレイに接触したスタイラスまたは
指などの座標を決定するための座標決定回路と、（ｊ）
前記座標決定回路および前記周辺インタフェース回路と
回路連絡状態になっており、それに決定した座標を送る
ためのインタフェース回路とを含み、前記パッド表面が
それに関連する記入済みデフォルト・テンプレート・グ
ラフィック・イメージを有することを特徴とする、コン
ピュータ・システム。 （４）前記ＣＰＵ上で実行されるアプリケーション・プ
ログラムに決定した座標を送るように構成された、前記
ＣＰＵ上で実行するためのソフトウェア・モジュールを
さらに含むことを特徴とする、上記（３）に記載のコン
ピュータ・システム。 （５）（ａ）テンプレート・オーバレイに関連する識別
構造の存在を検出し、さらに識別構造の不在を検出する
ためのテンプレート・オーバレイ・センサと、（ｂ）前
記テンプレート・オーバレイ・センサおよび前記インタ
フェース回路と回路連絡状態になっており、前記テンプ
レート・オーバレイ・センサにより検出された識別構造
に応じて、識別構造に対応する電気信号を生成するため
のオーバレイ検出回路とをさらに含むことを特徴とす
る、上記（３）に記載のコンピュータ・システム。 （６）（ａ）タッチパッドと、（ｂ）動作上、前記タッ
チパッドに関連する少なくとも２本のジョイスティック
とを含む、入力装置。 （７）前記ジョイスティックが前記タッチパッドの両側
に１本ずつ配置されていることを特徴とする、上記
（６）に記載の入力装置。 （８）（ａ）エンクロージャと、（ｂ）前記エンクロー
ジャに物理的に接合され、指またはスタイラスなどによ
り接触できるように露出されたタッチパッドと、（ｃ）
前記エンクロージャに物理的に接合され、前記タッチパ
ッドの両側に１本ずつ配置されている２本のジョイステ
ィックとを含む、入力装置。 （９）中央エンクロージャ内に密閉された中央演算処理
装置（ＣＰＵ）を有するコンピュータ・システムで使用
するための入力装置において、（ａ）それに関連するジ
ョイスティック回路を有する少なくとも２本のジョイス
ティックであって、前記ジョイスティック回路が、前記
ジョイスティックの運動に応じてジョイスティック信号
を生成するように構成されている、少なくとも２本のジ
ョイスティックと、（ｂ）パッド表面を有し、前記パッ
ド表面への接触に応じて接触位置信号を生成するように
構成されているタッチパッドと、（ｃ）前記ジョイステ
ィック回路および前記タッチパッドと回路連絡状態にな
っており、前記ジョイスティックの運動に対応するデー
タ・パケットをＣＰＵに送るように構成され、さらに指
またはスタイラスなどによる前記パッド表面への接触位
置に対応するデータ・パケットをＣＰＵに送るように構
成されているインタフェース回路とを含む、入力装置。 （１０）入力装置エンクロージャをさらに含み、前記ジ
ョイスティックおよび前記タッチパッドが前記入力装置
エンクロージャに物理的に接合されていることを特徴と
する、上記（９）に記載の入力装置。 （１１）入力装置エンクロージャをさらに含み、前記ジ
ョイスティックおよび前記タッチパッドが、前記入力装
置エンクロージャに物理的に接合されており、さらに前
記タッチパッドが前記入力装置エンクロージャの１面の
中心に配置され、前記ジョイスティックが前記タッチパ
ッドの両側に配置されるように構成されていることを特
徴とする、上記（９）に記載の入力装置。 （１２）入力装置エンクロージャをさらに含み、前記ジ
ョイスティックおよび前記タッチパッドが前記入力装置
エンクロージャに物理的に接合され、前記タッチパッド
が１対の長い辺と１対の短い辺とを有するほぼ矩形の形
状を有し、前記タッチパッドが前記入力装置エンクロー
ジャの１面の中心に配置され、前記ジョイスティックが
前記タッチパッドの短い辺に隣接して配置されているこ
とを特徴とする、上記（９）に記載の入力装置。 （１３）（ａ）中央エンクロージャ内に密閉されたＣＰ
Ｕと、（ｂ）前記ＣＰＵと回路連絡状態になっている第
一および第二のジョイスティックと、（ｃ）前記ＣＰＵ
と回路連絡状態になっているタッチパッドとを含む、コ
ンピュータ・システム。 （１４）入力装置エンクロージャをさらに含み、前記タ
ッチパッドおよび前記第一および第二のジョイスティッ
クが前記入力装置エンクロージャに物理的に接合されて
いることを特徴とする、上記（１３）に記載のコンピュ
ータ・システム。 （１５）入力装置エンクロージャをさらに含み、前記第
一および第二のジョイスティックおよび前記タッチパッ
ドが、前記入力装置エンクロージャに物理的に接合され
ており、さらに前記タッチパッドが前記入力装置エンク
ロージャの１面の中心に配置され、前記ジョイスティッ
クが前記タッチパッドの両側に配置されるように構成さ
れていることを特徴とする、上記（１３）に記載のコン
ピュータ・システム。 （１６）入力装置エンクロージャをさらに含み、前記第
一および第二のジョイスティックおよび前記タッチパッ
ドが前記入力装置エンクロージャに物理的に接合され、
前記タッチパッドが１対の長い辺と１対の短い辺とを有
するほぼ矩形の形状を有し、前記タッチパッドが前記入
力装置エンクロージャの１面の中心に配置され、前記ジ
ョイスティックが前記タッチパッドの短い辺に隣接して
配置されていることを特徴とする、上記（１３）に記載
のコンピュータ・システム。
【０１１２】
【発明の効果】したがって、本発明の利点は、２人の人
が同時に位置情報を提供できるように構成された入力装
置を提供し、さらに完全なパッケージの形でコマンド・
アクセスを提供することにある。
が同時に位置情報を提供できるように構成された入力装
置を提供し、さらに完全なパッケージの形でコマンド・
アクセスを提供することにある。
【０１１３】さらに、本発明の利点は、デフォルト・テ
ンプレート・グラフィック・イメージからアクセス可能
な一般的なセットの諸機能をソフトウェア・アプリケー
ションに提供すると同時に、ソフトウェア・アプリケー
ションがカスタム・テンプレート・オーバレイにアクセ
スできるようにすることにある。
ンプレート・グラフィック・イメージからアクセス可能
な一般的なセットの諸機能をソフトウェア・アプリケー
ションに提供すると同時に、ソフトウェア・アプリケー
ションがカスタム・テンプレート・オーバレイにアクセ
スできるようにすることにある。
【図面の簡単な説明】
【図１】本発明のシステムの全体レイアウトを示すブロ
ック図である。
ック図である。
【図２】本発明のシステムの全体レイアウトを示すブロ
ック図である。
ック図である。
【図３】本発明のシステムで使用するビデオ・ディジタ
ル・アナログ変換器の詳細を示す概略図である。
ル・アナログ変換器の詳細を示す概略図である。
【図４】デフォルト・テンプレート、２本のジョイステ
ィック、およびテンプレート・オーバレイを備えたタッ
チパッドを示す、本発明の入力装置の平面図である。
ィック、およびテンプレート・オーバレイを備えたタッ
チパッドを示す、本発明の入力装置の平面図である。
【図５】テンプレート・オーバレイがテンプレート・オ
ーバレイ・リテーナに挿入されている、本発明の入力装
置の平面図である。
ーバレイ・リテーナに挿入されている、本発明の入力装
置の平面図である。
【図６】図５に示す本発明の入力装置の一部の拡大部分
平面図である。
平面図である。
【図７】図６の線２Ｄ―２Ｄによって示された平面にほ
ぼ沿って描かれた断面図である。
ぼ沿って描かれた断面図である。
【図８】図６の線２Ｅ―２Ｅによって示された平面にほ
ぼ沿って描かれた断面図である。
ぼ沿って描かれた断面図である。
【図９】図４の線２Ｆ―２Ｆによって示された平面にほ
ぼ沿って描かれた断面図である。
ぼ沿って描かれた断面図である。
【図１０】明確に示すために一部を切り欠いた、図４に
示す本発明の入力装置の部分平面図である。
示す本発明の入力装置の部分平面図である。
【図１１】各種識別パターンを示すテンプレート・オー
バレイの端部の様々な実施例の底面図である。
バレイの端部の様々な実施例の底面図である。
【図１２】各種識別パターンを示すテンプレート・オー
バレイの端部の様々な実施例の底面図である。
バレイの端部の様々な実施例の底面図である。
【図１３】各種識別パターンを示すテンプレート・オー
バレイの端部の様々な実施例の底面図である。
バレイの端部の様々な実施例の底面図である。
【図１４】各種識別パターンを示すテンプレート・オー
バレイの端部の様々な実施例の底面図である。
バレイの端部の様々な実施例の底面図である。
【図１５】本発明の入力装置の正面図である。
【図１６】本発明の入力装置で使用するジョイスティッ
クの詳細を示す、図４の線２Ｍ―２Ｍによって示された
平面にほぼ沿って描かれた部分断面図である。
クの詳細を示す、図４の線２Ｍ―２Ｍによって示された
平面にほぼ沿って描かれた部分断面図である。
【図１７】本発明の入力装置の電気回路を示すブロック
図である。
図である。
１０ コンピュータ・システム １２ データ処理装置 １４ プログラム・カートリッジ １６ テレビ受像機（ＴＶ） １８ 入力装置 １９ タッチパッド ２０ａ ジョイスティック ２０ｂ ジョイスティック ２１ スタイラス ２２ シリアル・データ・リンク ２４ ＲＦビデオ・ライン ２６ エッジ・カード・コネクタ ２８ カートリッジ・コネクタ ３０ 中央演算処理装置（ＣＰＵ） ３１ ＳＹＳＴＥＭバス ３２ 音声／ビデオ（Ａ／Ｖ）コントローラ／共用プロ
セッサ ３３ システム・メモリ ３４ ＳＹＳＴＥＭ’バス ３６ 入出力共用プロセッサ ３８ 追加回路 ３９ 拡張コネクタ ４０ プログラムＲＯＭ ４２ デコーダ
セッサ ３３ システム・メモリ ３４ ＳＹＳＴＥＭ’バス ３６ 入出力共用プロセッサ ３８ 追加回路 ３９ 拡張コネクタ ４０ プログラムＲＯＭ ４２ デコーダ
フロントページの続き (72)発明者 ジェームス・リー・コームズ アメリカ合衆国40515 ケンタッキー州レ キシントン ブルックシャー・サークル 2417
Claims (16)
- 【請求項１】（ａ）指またはスタイラスなどにより接触
できるように露出されたパッド表面と、 （ｂ）前記パッド表面に近接してテンプレート・オーバ
レイを脱着式に固定するためのリテーナと、 （ｃ）前記パッド表面に近接し、スタイラスまたは指な
どによる前記パッド表面への接触または前記パッド表面
に近接するテンプレート・オーバレイへの接触に応じて
電気信号を生成するためのタッチパッドであって、前記
電気信号が接触位置の座標に対応するように構成されて
いる、タッチパッドとを含み、 前記パッド表面がそれに関連する記入済みデフォルト・
テンプレート・グラフィック・イメージを有することを
特徴とする、入力装置。 - 【請求項２】（ａ）指またはスタイラスなどにより接触
できるように露出されたパッド表面と、 （ｂ）前記パッド表面に近接してテンプレート・オーバ
レイを脱着式に固定するためのリテーナと、 （ｃ）前記パッド表面に近接し、スタイラスまたは指な
どによる前記パッド表面への接触または前記パッド表面
に近接するテンプレート・オーバレイへの接触に応じて
少なくとも１つの電気信号を生成するための座標センサ
であって、前記少なくとも１つの電気信号が接触位置の
座標に対応するように構成されている、座標センサと、 （ｄ）前記パッド表面に近接する剛性ベースと、 （ｅ）前記座標センサと回路連絡状態になっており、前
記少なくとも１つの電気信号から、前記パッド表面に接
触したか、または前記パッド表面に近接するテンプレー
ト・オーバレイに接触したスタイラスまたは指などの座
標を決定するための座標決定回路と、 （ｆ）前記座標決定回路と回路連絡状態になっており、
前記タッチパッドの外部にある装置に決定した座標を送
るためのインタフェース回路とを含み、 前記パッド表面がそれに関連する記入済みデフォルト・
テンプレート・グラフィック・イメージを有することを
特徴とする、タッチパッド。 - 【請求項３】（ａ）中央演算処理装置（ＣＰＵ）と、 （ｂ）前記ＣＰＵと回路連絡状態になっているメモリ回
路と、 （ｃ）前記ＣＰＵおよび前記メモリと回路連絡状態にな
っており、ビデオ表示装置上に表示される視覚イメージ
に対応する電気信号を生成するためのビデオ回路と、 （ｄ）前記ＣＰＵと回路連絡状態になっており、外部装
置から前記ＣＰＵに送られる信号のインタフェースを取
るための周辺インタフェース回路と、 （ｅ）指またはスタイラスなどにより接触できるように
露出されたパッド表面と、 （ｆ）前記パッド表面に近接してテンプレート・オーバ
レイを脱着式に固定するためのリテーナと、 （ｇ）前記パッド表面に近接し、スタイラスまたは指な
どによる前記パッド表面への接触または前記パッド表面
に近接するテンプレート・オーバレイへの接触に応じて
少なくとも１つの電気信号を生成するための座標センサ
であって、前記少なくとも１つの電気信号が接触位置の
座標に対応するように構成されている、座標センサと、 （ｈ）前記パッド表面に近接する剛性ベースと、 （ｉ）前記座標センサと回路連絡状態になっており、前
記パッド表面に接触したか、または前記パッド表面に近
接するテンプレート・オーバレイに接触したスタイラス
または指などの座標を決定するための座標決定回路と、 （ｊ）前記座標決定回路および前記周辺インタフェース
回路と回路連絡状態になっており、それに決定した座標
を送るためのインタフェース回路とを含み、 前記パッド表面がそれに関連する記入済みデフォルト・
テンプレート・グラフィック・イメージを有することを
特徴とする、コンピュータ・システム。 - 【請求項４】前記ＣＰＵ上で実行されるアプリケーショ
ン・プログラムに決定した座標を送るように構成され
た、前記ＣＰＵ上で実行するためのソフトウェア・モジ
ュールをさらに含むことを特徴とする、請求項３に記載
のコンピュータ・システム。 - 【請求項５】（ａ）テンプレート・オーバレイに関連す
る識別構造の存在を検出し、さらに識別構造の不在を検
出するためのテンプレート・オーバレイ・センサと、 （ｂ）前記テンプレート・オーバレイ・センサおよび前
記インタフェース回路と回路連絡状態になっており、前
記テンプレート・オーバレイ・センサにより検出された
識別構造に応じて、識別構造に対応する電気信号を生成
するためのオーバレイ検出回路とをさらに含むことを特
徴とする、請求項３に記載のコンピュータ・システム。 - 【請求項６】（ａ）タッチパッドと、 （ｂ）動作上、前記タッチパッドに関連する少なくとも
２本のジョイスティックとを含む、入力装置。 - 【請求項７】前記ジョイスティックが前記タッチパッド
の両側に１本ずつ配置されていることを特徴とする、請
求項６に記載の入力装置。 - 【請求項８】（ａ）エンクロージャと、 （ｂ）前記エンクロージャに物理的に接合され、指また
はスタイラスなどにより接触できるように露出されたタ
ッチパッドと、 （ｃ）前記エンクロージャに物理的に接合され、前記タ
ッチパッドの両側に１本ずつ配置されている２本のジョ
イスティックとを含む、入力装置。 - 【請求項９】中央エンクロージャ内に密閉された中央演
算処理装置（ＣＰＵ）を有するコンピュータ・システム
で使用するための入力装置において、 （ａ）それに関連するジョイスティック回路を有する少
なくとも２本のジョイスティックであって、前記ジョイ
スティック回路が、前記ジョイスティックの運動に応じ
てジョイスティック信号を生成するように構成されてい
る、少なくとも２本のジョイスティックと、 （ｂ）パッド表面を有し、前記パッド表面への接触に応
じて接触位置信号を生成するように構成されているタッ
チパッドと、 （ｃ）前記ジョイスティック回路および前記タッチパッ
ドと回路連絡状態になっており、前記ジョイスティック
の運動に対応するデータ・パケットをＣＰＵに送るよう
に構成され、さらに指またはスタイラスなどによる前記
パッド表面への接触位置に対応するデータ・パケットを
ＣＰＵに送るように構成されているインタフェース回路
とを含む、入力装置。 - 【請求項１０】入力装置エンクロージャをさらに含み、
前記ジョイスティックおよび前記タッチパッドが前記入
力装置エンクロージャに物理的に接合されていることを
特徴とする、請求項９に記載の入力装置。 - 【請求項１１】入力装置エンクロージャをさらに含み、
前記ジョイスティックおよび前記タッチパッドが、前記
入力装置エンクロージャに物理的に接合されており、さ
らに前記タッチパッドが前記入力装置エンクロージャの
１面の中心に配置され、前記ジョイスティックが前記タ
ッチパッドの両側に配置されるように構成されているこ
とを特徴とする、請求項９に記載の入力装置。 - 【請求項１２】入力装置エンクロージャをさらに含み、
前記ジョイスティックおよび前記タッチパッドが前記入
力装置エンクロージャに物理的に接合され、前記タッチ
パッドが１対の長い辺と１対の短い辺とを有するほぼ矩
形の形状を有し、前記タッチパッドが前記入力装置エン
クロージャの１面の中心に配置され、前記ジョイスティ
ックが前記タッチパッドの短い辺に隣接して配置されて
いることを特徴とする、請求項９に記載の入力装置。 - 【請求項１３】（ａ）中央エンクロージャ内に密閉され
たＣＰＵと、 （ｂ）前記ＣＰＵと回路連絡状態になっている第一およ
び第二のジョイスティックと、 （ｃ）前記ＣＰＵと回路連絡状態になっているタッチパ
ッドとを含む、コンピュータ・システム。 - 【請求項１４】入力装置エンクロージャをさらに含み、
前記タッチパッドおよび前記第一および第二のジョイス
ティックが前記入力装置エンクロージャに物理的に接合
されていることを特徴とする、請求項１３に記載のコン
ピュータ・システム。 - 【請求項１５】入力装置エンクロージャをさらに含み、
前記第一および第二のジョイスティックおよび前記タッ
チパッドが、前記入力装置エンクロージャに物理的に接
合されており、さらに前記タッチパッドが前記入力装置
エンクロージャの１面の中心に配置され、前記ジョイス
ティックが前記タッチパッドの両側に配置されるように
構成されていることを特徴とする、請求項１３に記載の
コンピュータ・システム。 - 【請求項１６】入力装置エンクロージャをさらに含み、
前記第一および第二のジョイスティックおよび前記タッ
チパッドが前記入力装置エンクロージャに物理的に接合
され、前記タッチパッドが１対の長い辺と１対の短い辺
とを有するほぼ矩形の形状を有し、前記タッチパッドが
前記入力装置エンクロージャの１面の中心に配置され、
前記ジョイスティックが前記タッチパッドの短い辺に隣
接して配置されていることを特徴とする、請求項１３に
記載のコンピュータ・システム。
Applications Claiming Priority (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| US210672 | 1988-06-23 | ||
| US21067294A | 1994-03-18 | 1994-03-18 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH07261922A true JPH07261922A (ja) | 1995-10-13 |
Family
ID=22783807
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP31796094A Pending JPH07261922A (ja) | 1994-03-18 | 1994-12-21 | タッチパッド、入力装置及びコンピュータ・システム |
Country Status (6)
| Country | Link |
|---|---|
| EP (1) | EP0672981A1 (ja) |
| JP (1) | JPH07261922A (ja) |
| CN (1) | CN1119304A (ja) |
| AU (1) | AU8180494A (ja) |
| SG (1) | SG34211A1 (ja) |
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