JPH0730821A - 順次走査方式対応撮像装置 - Google Patents
順次走査方式対応撮像装置Info
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- JPH0730821A JPH0730821A JP5174077A JP17407793A JPH0730821A JP H0730821 A JPH0730821 A JP H0730821A JP 5174077 A JP5174077 A JP 5174077A JP 17407793 A JP17407793 A JP 17407793A JP H0730821 A JPH0730821 A JP H0730821A
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Abstract
(57)【要約】
【目的】 光電変換部に蓄積した奇数ラインの信号群と
偶数ラインの信号群を異なるタイミングで読み出す撮像
素子を用いた順次走査方式対応撮像装置における動画像
の画像劣化を減少させる。 【構成】 撮像素子１は光電変換部に蓄積した奇数ライ
ンの信号群と偶数ラインの信号群を異なるタイミングで
読み出し出力する。撮像素子１より出力されたアナログ
信号はＡ／Ｄ変換器２でデジタル信号に変換され、順次
走査信号変換器３でＡ／Ｄ変換器２の出力信号を順次走
査信号に変換される。そして、順次走査信号変換回路３
の出力信号をフィルター回路４で垂直方向にフィルター
処理を行い、撮像信号出力として出力する。
偶数ラインの信号群を異なるタイミングで読み出す撮像
素子を用いた順次走査方式対応撮像装置における動画像
の画像劣化を減少させる。 【構成】 撮像素子１は光電変換部に蓄積した奇数ライ
ンの信号群と偶数ラインの信号群を異なるタイミングで
読み出し出力する。撮像素子１より出力されたアナログ
信号はＡ／Ｄ変換器２でデジタル信号に変換され、順次
走査信号変換器３でＡ／Ｄ変換器２の出力信号を順次走
査信号に変換される。そして、順次走査信号変換回路３
の出力信号をフィルター回路４で垂直方向にフィルター
処理を行い、撮像信号出力として出力する。
Description
【０００１】
【産業上の利用分野】本発明は、順次走査方式に対応す
る撮像装置に関するものである。
る撮像装置に関するものである。
【０００２】
【従来の技術】近年、EDTV2等で順次走査動作の撮像装
置が必要になっている。また、順次走査動作を実現する
ために新しいフレームインターライントランスファ型Ch
arge Coupled Device撮像素子（以下、FIT-CCDとする）
が提案されている。
置が必要になっている。また、順次走査動作を実現する
ために新しいフレームインターライントランスファ型Ch
arge Coupled Device撮像素子（以下、FIT-CCDとする）
が提案されている。
【０００３】図９はFIT-CCDの内部構成を示した構成図
である。図９において、９は奇数ライン光電変換部、１
０は偶数ライン光電変換部、１１は垂直転送ライン、１
２は奇数ライン記憶エリア、１３は偶数ライン記憶エリ
ア、２４は水平転送ラインである。
である。図９において、９は奇数ライン光電変換部、１
０は偶数ライン光電変換部、１１は垂直転送ライン、１
２は奇数ライン記憶エリア、１３は偶数ライン記憶エリ
ア、２４は水平転送ラインである。
【０００４】図１０はFIT-CCDの撮像信号出力を示した
信号タイミング図である。以下、図９，図１０を用いて
この新しいFIT-CCDについて説明を行う。
信号タイミング図である。以下、図９，図１０を用いて
この新しいFIT-CCDについて説明を行う。
【０００５】偶数ライン光電変換部１０で変換された信
号（電荷）は、第１の読み出しパルスにより垂直転送ラ
イン１１に転送され、転送された信号は高速転送パルス
により奇数ライン記憶エリア１２に転送される。その
後、奇数ライン光電変換部９で変換された信号（電荷）
は第２の読み出しパルスにより垂直転送ライン１１に転
送され、その後、高速転送パルスにより奇数ライン記憶
エリア１２に記憶された偶数ライン信号を偶数ライン記
憶エリア１３に転送するとともに垂直転送ライン１１に
転送された奇数ライン信号を奇数ライン記憶エリア１２
に転送する。その後、偶数ライン記憶エリア１３と奇数
ライン記憶エリア１２に転送された信号は水平ブランキ
ング期間に１ラインずつ水平転送ライン２４に転送さ
れ、水平転送ライン２４に転送された信号は水平転送パ
ルスにより水平走査に同期して順次撮像素子の出力とし
て出力される。なお、偶数ライン光電変換部１０と奇数
ライン光電変換部９からの信号の読み出しは垂直ブラン
キング期間内に行われる。また、水平転送ライン２４か
らの全ての信号の出力は１フィールド期間内に行われ
る。このような動作の撮像信号出力は図１０で示される
ものとなる。つまり、１フィールドの約半分の期間で奇
数ラインの信号の全てが出力され、残りの半分の期間で
偶数ラインの信号の全てが出力される撮像信号となる。
号（電荷）は、第１の読み出しパルスにより垂直転送ラ
イン１１に転送され、転送された信号は高速転送パルス
により奇数ライン記憶エリア１２に転送される。その
後、奇数ライン光電変換部９で変換された信号（電荷）
は第２の読み出しパルスにより垂直転送ライン１１に転
送され、その後、高速転送パルスにより奇数ライン記憶
エリア１２に記憶された偶数ライン信号を偶数ライン記
憶エリア１３に転送するとともに垂直転送ライン１１に
転送された奇数ライン信号を奇数ライン記憶エリア１２
に転送する。その後、偶数ライン記憶エリア１３と奇数
ライン記憶エリア１２に転送された信号は水平ブランキ
ング期間に１ラインずつ水平転送ライン２４に転送さ
れ、水平転送ライン２４に転送された信号は水平転送パ
ルスにより水平走査に同期して順次撮像素子の出力とし
て出力される。なお、偶数ライン光電変換部１０と奇数
ライン光電変換部９からの信号の読み出しは垂直ブラン
キング期間内に行われる。また、水平転送ライン２４か
らの全ての信号の出力は１フィールド期間内に行われ
る。このような動作の撮像信号出力は図１０で示される
ものとなる。つまり、１フィールドの約半分の期間で奇
数ラインの信号の全てが出力され、残りの半分の期間で
偶数ラインの信号の全てが出力される撮像信号となる。
【０００６】撮像素子から出力された偶数ライン信号と
奇数ライン信号を１水平走査ライン毎に交互に出力する
ことで順次走査信号の出力を行う。
奇数ライン信号を１水平走査ライン毎に交互に出力する
ことで順次走査信号の出力を行う。
【０００７】
【発明が解決しようとする課題】上記構成の撮像素子を
用いた順次走査方式対応撮像装置において、物体が水平
移動時に得られる画像について図１１を用いて説明す
る。
用いた順次走査方式対応撮像装置において、物体が水平
移動時に得られる画像について図１１を用いて説明す
る。
【０００８】図１１のａは撮像素子に対して第１の読み
出しパルスが発生する時刻t1での物体の位置を示してお
り、横軸は水平画素、縦軸は垂直画素でnは水平画素に
おける物体の開始位置である。
出しパルスが発生する時刻t1での物体の位置を示してお
り、横軸は水平画素、縦軸は垂直画素でnは水平画素に
おける物体の開始位置である。
【０００９】図１１のｂは撮像素子に対して第２の読み
出しパルスが発生する時刻t2での物体の位置を示してお
り、横軸は水平画素、縦軸は垂直画素でn+xは水平画素
における物体の開始位置である。
出しパルスが発生する時刻t2での物体の位置を示してお
り、横軸は水平画素、縦軸は垂直画素でn+xは水平画素
における物体の開始位置である。
【００１０】図１１のｃは撮像装置から得られる画像を
示したものである。撮像素子は図１１のａにおける偶数
ライン信号を出力し、その後、図１１のｂにおける奇数
ライン信号を出力する。
示したものである。撮像素子は図１１のａにおける偶数
ライン信号を出力し、その後、図１１のｂにおける奇数
ライン信号を出力する。
【００１１】以上、上記撮像素子を用いた撮像装置より
出力された信号より得られる順次走査信号は図１１のｃ
で示す通り物体の奇数ラインと偶数ラインが水平方向に
ずれるという問題点を有する。
出力された信号より得られる順次走査信号は図１１のｃ
で示す通り物体の奇数ラインと偶数ラインが水平方向に
ずれるという問題点を有する。
【００１２】
【課題を解決するための手段】上記課題を解決するた
め、本発明の順次走査方式対応撮像装置は、光電変換部
に蓄積した奇数ラインの信号群と偶数ラインの信号群を
異なるタイミングで読み出し、１フィールド期間内に、
全ての信号の出力を行うためのタイミングが、前記奇数
ラインの信号群の全てを出力するタイミングと前記偶数
ラインの信号群の全てを出力するタイミングとで異なる
撮像素子と、前記撮像素子より出力されたアナログ信号
をデジタル信号に変換するＡ／Ｄ変換器と、前記Ａ／Ｄ
変換器の出力信号を順次走査信号に変換する順次走査信
号変換回路と、前記順次走査信号変換回路の出力信号を
垂直方向にフィルター処理を行うフィルター回路と、を
備えたものである。
め、本発明の順次走査方式対応撮像装置は、光電変換部
に蓄積した奇数ラインの信号群と偶数ラインの信号群を
異なるタイミングで読み出し、１フィールド期間内に、
全ての信号の出力を行うためのタイミングが、前記奇数
ラインの信号群の全てを出力するタイミングと前記偶数
ラインの信号群の全てを出力するタイミングとで異なる
撮像素子と、前記撮像素子より出力されたアナログ信号
をデジタル信号に変換するＡ／Ｄ変換器と、前記Ａ／Ｄ
変換器の出力信号を順次走査信号に変換する順次走査信
号変換回路と、前記順次走査信号変換回路の出力信号を
垂直方向にフィルター処理を行うフィルター回路と、を
備えたものである。
【００１３】また、本発明の順次走査方式対応撮像装置
は、光電変換部に蓄積した奇数ラインの信号群と偶数ラ
インの信号群を異なるタイミングで読み出し、１フィー
ルド期間内に、前記奇数ラインの信号群の全てを出力し
た後前記偶数ラインの信号群の全てを出力するか、前記
偶数ラインの信号群の全てを出力した後奇数ラインの信
号群の全てを出力する撮像素子と、前記撮像素子が前記
光電変換部に蓄積した電荷を基盤（sub）領域に抜き出
す電子シャッター動作を行うためのパルスを発生する電
子シャッターパルス発生器と、前記撮像素子より出力さ
れたアナログ信号をデジタル信号に変換するＡ／Ｄ変換
器と、前記Ａ／Ｄ変換器の出力信号を順次走査信号に変
換する順次走査信号変換回路と、前記順次走査信号変換
回路の出力信号を垂直方向にフィルター処理を行うフィ
ルター回路と、前記電子シャッターパルス発生器により
定められるシャッタースピードに応じて前記フィルター
回路の特性をコントロールするコントロール回路と、と
を備えたものである。
は、光電変換部に蓄積した奇数ラインの信号群と偶数ラ
インの信号群を異なるタイミングで読み出し、１フィー
ルド期間内に、前記奇数ラインの信号群の全てを出力し
た後前記偶数ラインの信号群の全てを出力するか、前記
偶数ラインの信号群の全てを出力した後奇数ラインの信
号群の全てを出力する撮像素子と、前記撮像素子が前記
光電変換部に蓄積した電荷を基盤（sub）領域に抜き出
す電子シャッター動作を行うためのパルスを発生する電
子シャッターパルス発生器と、前記撮像素子より出力さ
れたアナログ信号をデジタル信号に変換するＡ／Ｄ変換
器と、前記Ａ／Ｄ変換器の出力信号を順次走査信号に変
換する順次走査信号変換回路と、前記順次走査信号変換
回路の出力信号を垂直方向にフィルター処理を行うフィ
ルター回路と、前記電子シャッターパルス発生器により
定められるシャッタースピードに応じて前記フィルター
回路の特性をコントロールするコントロール回路と、と
を備えたものである。
【００１４】
【作用】上記構成により、撮像素子の出力信号をＡ／Ｄ
変換器によりデジタル信号に変換を行い、変換されたデ
ジタル信号を順次走査信号回路により順次走査信号に変
換を行い、変換された順次走査信号をフィルター回路に
より垂直方向のフィルター処理を行うことで、動画像に
おける画像劣化、つまり偶数ラインと奇数ラインでの画
像ずれをなくすことができる。
変換器によりデジタル信号に変換を行い、変換されたデ
ジタル信号を順次走査信号回路により順次走査信号に変
換を行い、変換された順次走査信号をフィルター回路に
より垂直方向のフィルター処理を行うことで、動画像に
おける画像劣化、つまり偶数ラインと奇数ラインでの画
像ずれをなくすことができる。
【００１５】また、動画像撮影時に解像度の向上の為に
電子シャッター機能を有するとき電子シャッターのスピ
ードに応じてコントロール回路によりフィルター回路の
特性を変化させることで垂直解像度の劣化を減少させる
ことができる。
電子シャッター機能を有するとき電子シャッターのスピ
ードに応じてコントロール回路によりフィルター回路の
特性を変化させることで垂直解像度の劣化を減少させる
ことができる。
【００１６】
【実施例】本発明の実施例について説明する。
【００１７】図１は本発明の第１の実施例における順次
走査方式対応撮像装置のブロック図である。図１におい
て、１は撮像素子、２はＡ／Ｄ変換器、３は順次走査信
号変換回路、４はフィルター回路、５は読み出しパルス
発生器、６は転送用パルス発生器である。
走査方式対応撮像装置のブロック図である。図１におい
て、１は撮像素子、２はＡ／Ｄ変換器、３は順次走査信
号変換回路、４はフィルター回路、５は読み出しパルス
発生器、６は転送用パルス発生器である。
【００１８】また、図２は図１におけるフィルター回路
４の一実施例のブロック図である。図２において、１５
は１水平走査期間の遅延回路、１６は１水平走査期間の
遅延回路、１７はフィルター係数k1を乗数とする乗算
器、１８はフィルター係数k2を乗数とする乗算器、１９
はフィルター係数k3を乗数とする乗算器、２０は乗算器
１７と乗算器１８と乗算器１９の出力値の加算を行う加
算器である。
４の一実施例のブロック図である。図２において、１５
は１水平走査期間の遅延回路、１６は１水平走査期間の
遅延回路、１７はフィルター係数k1を乗数とする乗算
器、１８はフィルター係数k2を乗数とする乗算器、１９
はフィルター係数k3を乗数とする乗算器、２０は乗算器
１７と乗算器１８と乗算器１９の出力値の加算を行う加
算器である。
【００１９】また、図３は物体が水平移動したときの順
次走査信号変換回路３から受け取る各ラインの信号を示
した信号波形図である。横軸は時間、縦軸は信号レベル
である。
次走査信号変換回路３から受け取る各ラインの信号を示
した信号波形図である。横軸は時間、縦軸は信号レベル
である。
【００２０】また、図４は順次走査信号変換回路の構成
を示したブロック図である。図４において、２１はフレ
ームメモリ、２２は書き込みアドレス発生器、２３は読
み出しアドレス発生器である。
を示したブロック図である。図４において、２１はフレ
ームメモリ、２２は書き込みアドレス発生器、２３は読
み出しアドレス発生器である。
【００２１】図５は書き込みアドレス発生器２２により
発生する書き込みアドレスとＡ／Ｄ変換器２より出力さ
れる映像信号との関係を示したタイミングチャートであ
る。
発生する書き込みアドレスとＡ／Ｄ変換器２より出力さ
れる映像信号との関係を示したタイミングチャートであ
る。
【００２２】以下、本発明の第１の実施例の動作を、図
１〜図５，図９を用いて説明する。読み出しパルス発生
器５で発生した第１の読み出しパルスにより偶数ライン
光電変換部１０に蓄積された偶数ライン信号を垂直転送
ライン１１に転送する。垂直転送ライン１１に転送され
た偶数ライン信号は転送用パルス発生器６で発生した高
速転送パルスにより奇数ライン記憶エリア１２に転送さ
れる。垂直転送ライン１１に転送された偶数ライン信号
がすべて転送された後、読み出しパルス発生器５で発生
した第２の読み出しパルスにより奇数ライン光電変換部
９に蓄積された奇数ライン信号を垂直転送ライン１１に
転送する。その後転送用パルス発生器６で発生した高速
転送パルスにより、奇数ライン記憶エリア１２に記憶さ
れた偶数ライン信号を偶数ライン記憶エリア１３に転送
するとともに垂直転送ライン１１に転送された奇数ライ
ン信号を奇数ライン記憶エリア１２に転送する。
１〜図５，図９を用いて説明する。読み出しパルス発生
器５で発生した第１の読み出しパルスにより偶数ライン
光電変換部１０に蓄積された偶数ライン信号を垂直転送
ライン１１に転送する。垂直転送ライン１１に転送され
た偶数ライン信号は転送用パルス発生器６で発生した高
速転送パルスにより奇数ライン記憶エリア１２に転送さ
れる。垂直転送ライン１１に転送された偶数ライン信号
がすべて転送された後、読み出しパルス発生器５で発生
した第２の読み出しパルスにより奇数ライン光電変換部
９に蓄積された奇数ライン信号を垂直転送ライン１１に
転送する。その後転送用パルス発生器６で発生した高速
転送パルスにより、奇数ライン記憶エリア１２に記憶さ
れた偶数ライン信号を偶数ライン記憶エリア１３に転送
するとともに垂直転送ライン１１に転送された奇数ライ
ン信号を奇数ライン記憶エリア１２に転送する。
【００２３】垂直転送ライン１１に転送された奇数ライ
ン信号のすべての転送が終了した後偶数ライン記憶エリ
ア１３に記憶された偶数ライン信号と奇数ライン記憶エ
リア１２に記憶された奇数ライン信号は水平ブランキン
グ期間に１ラインずつ水平転送ライン２４に転送され、
水平転送パルスにより水平走査に同期し出力される。
ン信号のすべての転送が終了した後偶数ライン記憶エリ
ア１３に記憶された偶数ライン信号と奇数ライン記憶エ
リア１２に記憶された奇数ライン信号は水平ブランキン
グ期間に１ラインずつ水平転送ライン２４に転送され、
水平転送パルスにより水平走査に同期し出力される。
【００２４】以上の動作により撮像素子１から従来例と
同様の映像信号が出力される。撮像素子１から出力され
た映像信号はＡ／Ｄ変換器２によりデジタル信号に変換
される。
同様の映像信号が出力される。撮像素子１から出力され
た映像信号はＡ／Ｄ変換器２によりデジタル信号に変換
される。
【００２５】順次走査信号変換回路３は図４で示す構成
よりなり、Ａ／Ｄ変換器２より受け取った飛び越し走査
のデジタル信号を順次走査の信号に変換する回路であ
り、フレームメモリ２１は少なくとも１つの入力ポート
と、この入力ポートとは別で非同期動作をする出力ポー
トを少なくとも１つ備えたメモリで、書き込みアドレス
発生器２２で発生した書き込みアドレスとＡ／Ｄ変換さ
れたデジタル信号を受け取り、書き込みアドレスに従い
デジタル信号を記憶し、読み出しアドレス発生器２３に
より発生したアドレスに従い記憶したデジタル信号をフ
ィルター回路４に出力する。書き込みアドレス発生器２
２で発生するアドレスは、図５で示す通りで、フレーム
メモリ２１のアドレスを1,2,・・・,n-1,n,n+1,n+2,・・・,2n
-1,2n,2n+1,2n+2,・・・,3n-1,3n,3n+1,3n+2,・・・（nは水平
画素数）とすると、撮像素子１からの出力信号が偶数ラ
イン信号の時はn+1,n+2,・・・,2n-1,2n,3n+1,3n+2,・・・と
いったアドレスを発生し、撮像素子１からの出力信号が
奇数ライン信号の時は1,2,3,・・・,n-1,n,2n+1,2n+2,……
といったアドレスを発生する。これにより、フレームメ
モリ２１に撮像素子１からの出力信号を順次走査信号の
形式で記憶できる。
よりなり、Ａ／Ｄ変換器２より受け取った飛び越し走査
のデジタル信号を順次走査の信号に変換する回路であ
り、フレームメモリ２１は少なくとも１つの入力ポート
と、この入力ポートとは別で非同期動作をする出力ポー
トを少なくとも１つ備えたメモリで、書き込みアドレス
発生器２２で発生した書き込みアドレスとＡ／Ｄ変換さ
れたデジタル信号を受け取り、書き込みアドレスに従い
デジタル信号を記憶し、読み出しアドレス発生器２３に
より発生したアドレスに従い記憶したデジタル信号をフ
ィルター回路４に出力する。書き込みアドレス発生器２
２で発生するアドレスは、図５で示す通りで、フレーム
メモリ２１のアドレスを1,2,・・・,n-1,n,n+1,n+2,・・・,2n
-1,2n,2n+1,2n+2,・・・,3n-1,3n,3n+1,3n+2,・・・（nは水平
画素数）とすると、撮像素子１からの出力信号が偶数ラ
イン信号の時はn+1,n+2,・・・,2n-1,2n,3n+1,3n+2,・・・と
いったアドレスを発生し、撮像素子１からの出力信号が
奇数ライン信号の時は1,2,3,・・・,n-1,n,2n+1,2n+2,……
といったアドレスを発生する。これにより、フレームメ
モリ２１に撮像素子１からの出力信号を順次走査信号の
形式で記憶できる。
【００２６】読み出しアドレス発生器２３によるアドレ
ス発生はフレームメモリ２１の先頭アドレスから順次発
生させることでフレームメモリ２１の出力信号は順次走
査信号となることで、順次走査信号変換回路３の出力信
号が順次走査の信号となる。
ス発生はフレームメモリ２１の先頭アドレスから順次発
生させることでフレームメモリ２１の出力信号は順次走
査信号となることで、順次走査信号変換回路３の出力信
号が順次走査の信号となる。
【００２７】フィルター回路４は図２で示す２Ｈ型の垂
直方向のローパスフィルターで受け取ったデジタル信号
に対し垂直方向のフィルター処理を行う回路である。こ
こで、順次走査信号変換回路３から受け取る信号を図３
で示す物体の水平移動時における信号とした場合につい
て考える。図３の信号は水平走査ライン毎の信号波形を
示し、ハイレベルが物体の信号レベルを示している。こ
の信号に対して、例えば図２における係数k1,k2,k3をk1
=1/4,k2=1/2,k3=1/4と設定しフィルター処理を行うと、
フィルター回路４の伝達関数が1/4+1/2*Z-1+1/4*Z-2と
なり（Z=順次走査時の１水平走査遅延時間）、この特性
は５２５TV本を零点とするローパスフィルターとなる。
つまり、読み出しタイミングの差による水平方向の信号
のずれを垂直方向にローパスフィルターをかけることに
より、平均化し除去している。これにより１水平走査ラ
イン毎の段差がなくなり図６で示す信号を出力する。
直方向のローパスフィルターで受け取ったデジタル信号
に対し垂直方向のフィルター処理を行う回路である。こ
こで、順次走査信号変換回路３から受け取る信号を図３
で示す物体の水平移動時における信号とした場合につい
て考える。図３の信号は水平走査ライン毎の信号波形を
示し、ハイレベルが物体の信号レベルを示している。こ
の信号に対して、例えば図２における係数k1,k2,k3をk1
=1/4,k2=1/2,k3=1/4と設定しフィルター処理を行うと、
フィルター回路４の伝達関数が1/4+1/2*Z-1+1/4*Z-2と
なり（Z=順次走査時の１水平走査遅延時間）、この特性
は５２５TV本を零点とするローパスフィルターとなる。
つまり、読み出しタイミングの差による水平方向の信号
のずれを垂直方向にローパスフィルターをかけることに
より、平均化し除去している。これにより１水平走査ラ
イン毎の段差がなくなり図６で示す信号を出力する。
【００２８】図７は本発明の第２の実施例における順次
走査方式対応撮像装置のブロック図である。
走査方式対応撮像装置のブロック図である。
【００２９】図７において、１は撮像素子、２はＡ／Ｄ
変換器、３は順次走査信号変換回路、４はフィルター回
路、５は読み出しパルス発生器、６は転送用パルス発生
器、７は電子シャッターパルス発生器、８はコントロー
ル回路で、図１との違いは電子シャッターパルス発生器
７とコントロール回路８が追加されたことであり、その
他の回路等は第１の実施例と殆ど同様なものである。
変換器、３は順次走査信号変換回路、４はフィルター回
路、５は読み出しパルス発生器、６は転送用パルス発生
器、７は電子シャッターパルス発生器、８はコントロー
ル回路で、図１との違いは電子シャッターパルス発生器
７とコントロール回路８が追加されたことであり、その
他の回路等は第１の実施例と殆ど同様なものである。
【００３０】図８は図７におけるフィルター回路４の周
波数特性を示す周波数特性図である。
波数特性を示す周波数特性図である。
【００３１】以下、本発明の第２の実施例の動作を、図
７，図８及び第１の実施例の説明で用いた、図２，図
４，図９，図１１を用いて説明する。
７，図８及び第１の実施例の説明で用いた、図２，図
４，図９，図１１を用いて説明する。
【００３２】図７において、撮像素子１と、Ａ／Ｄ変換
器２と、順次走査信号変換回路３と、読み出しパルス発
生器５と、転送用パルス発生器６は、第１の実施例で説
明した通りである。
器２と、順次走査信号変換回路３と、読み出しパルス発
生器５と、転送用パルス発生器６は、第１の実施例で説
明した通りである。
【００３３】電子シャッターパルス発生器７は、撮像素
子１の偶数ライン光電変換部１０と奇数ライン光電変換
部９のすべての信号が偶数ライン記憶エリア１３と奇数
ライン記憶エリア１２に転送されてから、次の読み出し
パルスが発生する前に、撮像素子１に対し撮像素子１の
偶数ライン光電変換部１０及び奇数ライン光電変換部９
に蓄積された信号を基盤（sub）に掃き出す電子シャッ
ター動作を行わせるためのパルスを発生する。コントロ
ール回路８は電子シャッターパルス発生器７が発生する
パルスによる電子シャッターのスピードに応じてフィル
ター回路４の特性を変化させるための情報をフィルター
回路４に送る。
子１の偶数ライン光電変換部１０と奇数ライン光電変換
部９のすべての信号が偶数ライン記憶エリア１３と奇数
ライン記憶エリア１２に転送されてから、次の読み出し
パルスが発生する前に、撮像素子１に対し撮像素子１の
偶数ライン光電変換部１０及び奇数ライン光電変換部９
に蓄積された信号を基盤（sub）に掃き出す電子シャッ
ター動作を行わせるためのパルスを発生する。コントロ
ール回路８は電子シャッターパルス発生器７が発生する
パルスによる電子シャッターのスピードに応じてフィル
ター回路４の特性を変化させるための情報をフィルター
回路４に送る。
【００３４】フィルター回路４は受け取ったデジタル信
号に対しコントロール回路８より受け取った情報により
フィルターの特性を変化させ垂直方向のフィルター処理
を行う回路で、シャッタースピードが高速になるにつ
れ、フィルターの特性が図８で示す特性のグラフ１，グ
ラフ２，・・・と変化する様にフィルター処理を行う。
号に対しコントロール回路８より受け取った情報により
フィルターの特性を変化させ垂直方向のフィルター処理
を行う回路で、シャッタースピードが高速になるにつ
れ、フィルターの特性が図８で示す特性のグラフ１，グ
ラフ２，・・・と変化する様にフィルター処理を行う。
【００３５】以上の動作により、例えばシャッタースピ
ードが遅い時（静止画像の時）、フィルター回路４にお
ける図２の係数k1,k2,k3をk1=1,k2=0,k3=0とすることに
より、フィルター回路４に入力された信号がフィルター
処理される事なく出力され、また、シャッタースピード
が高速の時（動画像の時）フィルター回路４における図
２の係数k1,k2,k3をk1=1/4,k2=1/2,k3=1/4とすることに
よりフィルター回路４の伝達関数が1/4+1/2*Z-1+1/4*Z
-2となり、これは５２５TV本を零点とするローパスフィ
ルターであり、垂直方向に大きくローパスフィルターを
かける。つまり、シャッタースピードが高速の時は、高
速の被写体を撮影中と考えられ、それ故、図１１のｃに
示す画像のずれも大きくなると考えられ、そのずれを目
立たなくするようフィルター特性をコントロールする。
このように、撮像素子１に対するシャッター動作のスピ
ードに対応してフィルター回路４によるフィルター処理
を行うことで、静止画像に対する垂直解像度を低下させ
ることなく、動画像に対する画像劣化を減少させること
ができる。
ードが遅い時（静止画像の時）、フィルター回路４にお
ける図２の係数k1,k2,k3をk1=1,k2=0,k3=0とすることに
より、フィルター回路４に入力された信号がフィルター
処理される事なく出力され、また、シャッタースピード
が高速の時（動画像の時）フィルター回路４における図
２の係数k1,k2,k3をk1=1/4,k2=1/2,k3=1/4とすることに
よりフィルター回路４の伝達関数が1/4+1/2*Z-1+1/4*Z
-2となり、これは５２５TV本を零点とするローパスフィ
ルターであり、垂直方向に大きくローパスフィルターを
かける。つまり、シャッタースピードが高速の時は、高
速の被写体を撮影中と考えられ、それ故、図１１のｃに
示す画像のずれも大きくなると考えられ、そのずれを目
立たなくするようフィルター特性をコントロールする。
このように、撮像素子１に対するシャッター動作のスピ
ードに対応してフィルター回路４によるフィルター処理
を行うことで、静止画像に対する垂直解像度を低下させ
ることなく、動画像に対する画像劣化を減少させること
ができる。
【００３６】
【発明の効果】以上説明したように、本発明によれば、
奇数ラインの信号と偶数ラインの信号を異なるタイミン
グで読み出す撮像素子を用いた順次走査方式対応撮像装
置での動画像における画像劣化をフィルター処理を行う
ことで減少させることができる。
奇数ラインの信号と偶数ラインの信号を異なるタイミン
グで読み出す撮像素子を用いた順次走査方式対応撮像装
置での動画像における画像劣化をフィルター処理を行う
ことで減少させることができる。
【００３７】また、フィルター処理を撮像素子に対する
シャッター動作のスピードに対応することで静止画に対
する垂直解像度を落とすことなく、動画像に対する画像
劣化を減少させることができ、その実用的価値は大き
い。
シャッター動作のスピードに対応することで静止画に対
する垂直解像度を落とすことなく、動画像に対する画像
劣化を減少させることができ、その実用的価値は大き
い。
【図１】本発明における第１の実施例の順次走査方式対
応撮像装置の構成を示すブロック図
応撮像装置の構成を示すブロック図
【図２】同第１の実施例におけるフィルター回路４の内
部構成例を示すブロック図
部構成例を示すブロック図
【図３】同第１の実施例における順次走査信号変換回路
３の出力を示す波形図
３の出力を示す波形図
【図４】同第１の実施例における順次走査信号変換回路
３の内部構成例を示すブロック図
３の内部構成例を示すブロック図
【図５】図４の順次走査信号変換回路３の動作を示すタ
イミングチャート
イミングチャート
【図６】同第１の実施例における順次走査信号変換回路
３の出力を示す波形図
３の出力を示す波形図
【図７】本発明における第２の実施例の順次走査方式対
応撮像装置の構成を示すブロック図
応撮像装置の構成を示すブロック図
【図８】同第２の実施例におけるフィルター回路４の周
波数特性を示す特性図
波数特性を示す特性図
【図９】従来のFIT-CCDの内部構成を示したブロック図
【図１０】同従来例のFIT-CCDの撮像信号出力を示した
信号タイミング図
信号タイミング図
【図１１】順次走査方式対応撮像装置の動作を示す説明
図
図
１ 撮像素子 ２ Ａ／Ｄ変換器 ３ 順次走査信号変換回路 ４ フィルター回路 ５ 読み出しパルス発生器 ６ 転送用パルス発生器 ７ 電子シャッターパルス発生器 ８ コントロール回路
Claims (2)
- 【請求項１】 光電変換部に蓄積した奇数ラインの信号
群と偶数ラインの信号群を異なるタイミングで読み出
し、１フィールド期間内に、全ての信号の出力を行うた
めのタイミングが、前記奇数ラインの信号群の全てを出
力するタイミングと前記偶数ラインの信号群の全てを出
力するタイミングとで異なる撮像素子と、 前記撮像素子より出力されたアナログ信号をデジタル信
号に変換するＡ／Ｄ変換器と、 前記Ａ／Ｄ変換器の出力信号を順次走査信号に変換する
順次走査信号変換回路と、 前記順次走査信号変換回路の出力信号を垂直方向にフィ
ルター処理を行うフィルター回路と、 を備えたことを特徴とする順次走査方式対応撮像装置。 - 【請求項２】 光電変換部に蓄積した奇数ラインの信号
群と偶数ラインの信号群を異なるタイミングで読み出
し、１フィールド期間内に、全ての信号の出力を行うた
めのタイミングが、前記奇数ラインの信号群の全てを出
力するタイミングと前記偶数ラインの信号群の全てを出
力するタイミングとで異なる撮像素子と、 前記撮像素子が光電変換部に蓄積した電荷を基盤（su
b）領域に抜き出す電子シャッター動作を行うためのパ
ルスを発生する電子シャッターパルス発生器と、 前記撮像素子より出力されたアナログ信号をデジタル信
号に変換するＡ／Ｄ変換器と、 前記Ａ／Ｄ変換器の出力信号を順次走査信号に変換する
順次走査信号変換回路と、 前記順次走査信号変換回路の出力信号を垂直方向にフィ
ルター処理を行うフィルター回路と、 前記電子シャッターパルス発生器により定められるシャ
ッタースピードに応じて前記フィルター回路の特性をコ
ントロールするコントロール回路と、 を備えたことを特徴とする順次走査方式対応撮像装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5174077A JPH0730821A (ja) | 1993-07-14 | 1993-07-14 | 順次走査方式対応撮像装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP5174077A JPH0730821A (ja) | 1993-07-14 | 1993-07-14 | 順次走査方式対応撮像装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0730821A true JPH0730821A (ja) | 1995-01-31 |
Family
ID=15972248
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP5174077A Pending JPH0730821A (ja) | 1993-07-14 | 1993-07-14 | 順次走査方式対応撮像装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0730821A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2012133277A1 (ja) * | 2011-03-31 | 2012-10-04 | シャープ株式会社 | 信号処理装置、制御プログラム、および集積回路 |
-
1993
- 1993-07-14 JP JP5174077A patent/JPH0730821A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2012133277A1 (ja) * | 2011-03-31 | 2012-10-04 | シャープ株式会社 | 信号処理装置、制御プログラム、および集積回路 |
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