JPH0755593B2 - 非接触ｉｃカード - Google Patents
非接触ｉｃカードInfo
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- JPH0755593B2 JPH0755593B2 JP1122787A JP12278789A JPH0755593B2 JP H0755593 B2 JPH0755593 B2 JP H0755593B2 JP 1122787 A JP1122787 A JP 1122787A JP 12278789 A JP12278789 A JP 12278789A JP H0755593 B2 JPH0755593 B2 JP H0755593B2
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- G06F—ELECTRIC DIGITAL DATA PROCESSING
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- G06F1/24—Resetting means
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- G—PHYSICS
- G06—COMPUTING OR CALCULATING; COUNTING
- G06K—GRAPHICAL DATA READING; PRESENTATION OF DATA; RECORD CARRIERS; HANDLING RECORD CARRIERS
- G06K19/00—Record carriers for use with machines and with at least a part designed to carry digital markings
- G06K19/06—Record carriers for use with machines and with at least a part designed to carry digital markings characterised by the kind of the digital marking, e.g. shape, nature, code
- G06K19/067—Record carriers with conductive marks, printed circuits or semiconductor circuit elements, e.g. credit or identity cards also with resonating or responding marks without active components
- G06K19/07—Record carriers with conductive marks, printed circuits or semiconductor circuit elements, e.g. credit or identity cards also with resonating or responding marks without active components with integrated circuit chips
- G06K19/0723—Record carriers with conductive marks, printed circuits or semiconductor circuit elements, e.g. credit or identity cards also with resonating or responding marks without active components with integrated circuit chips the record carrier comprising an arrangement for non-contact communication, e.g. wireless communication circuits on transponder cards, non-contact smart cards or RFIDs
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Description
【発明の詳細な説明】 〔産業上の利用分野〕 この発明は、非接触ICカードに係り、特にカード内蔵さ
れているデータ処理手段の初期化に関するものである。
れているデータ処理手段の初期化に関するものである。
第４図に従来の非接触ICカードの構造を示す。このICカ
ードは、ICチップ（５）、データ送信アンテナ（６）、
データ受信アンテナ（７）、バッテリ（８）及び発振子
（９）を有している。ICチップ（５）には、CPU（１）
とこのCPU（１）にそれぞれ接続されたROM（2a）、RAM
（2b）、データ変調回路（３）及びデータ復調回路
（４）が形成されており、これら変調回路（３）及び復
調回路（４）にそれぞれデータ送信アンテナ（６）及び
データ受信アンテナ（７）が接続される一方、CPU
（１）にはバッテリ（８）及び発振子（９）が接続され
ている。そして、ICカードは、耐環境性の向上を図るた
め、その全体が樹脂等により封止されている。
ードは、ICチップ（５）、データ送信アンテナ（６）、
データ受信アンテナ（７）、バッテリ（８）及び発振子
（９）を有している。ICチップ（５）には、CPU（１）
とこのCPU（１）にそれぞれ接続されたROM（2a）、RAM
（2b）、データ変調回路（３）及びデータ復調回路
（４）が形成されており、これら変調回路（３）及び復
調回路（４）にそれぞれデータ送信アンテナ（６）及び
データ受信アンテナ（７）が接続される一方、CPU
（１）にはバッテリ（８）及び発振子（９）が接続され
ている。そして、ICカードは、耐環境性の向上を図るた
め、その全体が樹脂等により封止されている。
CPU（１）にはバッテリ（８）から電源電圧が供給され
ると共に発振子（９）からはクロック信号が供給され、
これによりCPU（１）は予めROM（2a）に格納されていた
プログラムに基づいて作動する。このICカードは電磁波
を用いて外部とのデータの授受を行うものである。デー
タの受信時には、外部からの電磁波が受信アンテナ
（７）で受信され、復調回路（４）でデータに復調され
た後、CPU（１）に入力される。そして、CPU（１）でデ
ータ処理が行われ、必要に応じてデータがRAM（2b）に
記憶される。一方、データの送信時には、CPU（１）か
らデータが変調回路（３）に出力され、ここで搬送波が
このデータにより変調された後、送信アンテナ（６）か
ら送信される。
ると共に発振子（９）からはクロック信号が供給され、
これによりCPU（１）は予めROM（2a）に格納されていた
プログラムに基づいて作動する。このICカードは電磁波
を用いて外部とのデータの授受を行うものである。デー
タの受信時には、外部からの電磁波が受信アンテナ
（７）で受信され、復調回路（４）でデータに復調され
た後、CPU（１）に入力される。そして、CPU（１）でデ
ータ処理が行われ、必要に応じてデータがRAM（2b）に
記憶される。一方、データの送信時には、CPU（１）か
らデータが変調回路（３）に出力され、ここで搬送波が
このデータにより変調された後、送信アンテナ（６）か
ら送信される。
ところで、CPU（１）がROM（2a）に格納されているプロ
グラムに基づいて所定の動作を行うためには、ICチップ
（５）上に形成されたCPU（１）を駆動前に初期化する
必要がある。しかしながら、ICカードは樹脂等によって
封止されてしまうため、封止後はCPU（１）の初期化を
行うことができなかった。そこで従来は、第４図に示す
ように、予めCPU（１）に接続されたリセット端子（1
0）をICチップ（５）から引き出しておき、樹脂封止前
にこのリセット端子（10）を介してCPU（１）にリセッ
ト信号を入力し、CPU（１）を初期化した後、リセット
端子（10）も含めてICカード全体を封止していた。
グラムに基づいて所定の動作を行うためには、ICチップ
（５）上に形成されたCPU（１）を駆動前に初期化する
必要がある。しかしながら、ICカードは樹脂等によって
封止されてしまうため、封止後はCPU（１）の初期化を
行うことができなかった。そこで従来は、第４図に示す
ように、予めCPU（１）に接続されたリセット端子（1
0）をICチップ（５）から引き出しておき、樹脂封止前
にこのリセット端子（10）を介してCPU（１）にリセッ
ト信号を入力し、CPU（１）を初期化した後、リセット
端子（10）も含めてICカード全体を封止していた。
CPU（１）には常時バッテリ（８）が接続されているの
で、このICカードは封止された後バッテリ（８）が消耗
するまで動作し続ける。このため、ICチップ（５）の耐
量を越える擾乱が外部からICカードに加わった場合に
は、CPU（１）が暴走状態になる恐れがある。外部から
の擾乱としては、例えば温度、電磁波、光、放射線、機
械的応力あるいは静電気等が考えられる。しかしなが
ら、上述したように、ICカードの樹脂封止後はCPU
（１）を初期化することができないので、一旦CPU
（１）が暴走状態になると、なす術はなく、そのICカー
ドは使用に耐えなかった。
で、このICカードは封止された後バッテリ（８）が消耗
するまで動作し続ける。このため、ICチップ（５）の耐
量を越える擾乱が外部からICカードに加わった場合に
は、CPU（１）が暴走状態になる恐れがある。外部から
の擾乱としては、例えば温度、電磁波、光、放射線、機
械的応力あるいは静電気等が考えられる。しかしなが
ら、上述したように、ICカードの樹脂封止後はCPU
（１）を初期化することができないので、一旦CPU
（１）が暴走状態になると、なす術はなく、そのICカー
ドは使用に耐えなかった。
この発明はこのような問題点を解消するためになされた
もので、樹脂等により封止された後でも内蔵されている
CPU等のデータ処理手段の初期化を行うことができる非
接触ICカードを提供することを目的とする。
もので、樹脂等により封止された後でも内蔵されている
CPU等のデータ処理手段の初期化を行うことができる非
接触ICカードを提供することを目的とする。
〔課題を解決するための手段〕 この発明に係るICカードは、外部とのデータの送受信を
非接触で行うためのデータ送受信手段と、データ送受信
手段に接続され且つデータを処理するためのデータ処理
手段と、外部からのリセット信号の受信を非接触で行う
ためのリセット信号受信手段と、リセット信号受信手段
で受信されたリセット信号に基づいてデータ処理手段を
初期化するための初期化手段とを備えたものである。
非接触で行うためのデータ送受信手段と、データ送受信
手段に接続され且つデータを処理するためのデータ処理
手段と、外部からのリセット信号の受信を非接触で行う
ためのリセット信号受信手段と、リセット信号受信手段
で受信されたリセット信号に基づいてデータ処理手段を
初期化するための初期化手段とを備えたものである。
データ送受信手段とリセット信号受信手段が共通のアン
テナを有すると共に、このアンテナで受信された受信信
号からデータ処理手段で処理されるデータとリセット信
号とを分離する分離手段を設けることもできる。
テナを有すると共に、このアンテナで受信された受信信
号からデータ処理手段で処理されるデータとリセット信
号とを分離する分離手段を設けることもできる。
また、データ送受信手段から外部へデータを送信してい
る間は初期化手段の機能を無効とする無効手段を設ける
こともできる。
る間は初期化手段の機能を無効とする無効手段を設ける
こともできる。
この発明においては、リセット信号受信手段が外部から
リセット信号を受信し、このリセット信号に基づいて初
期化手段がデータ処理手段の初期を行う。
リセット信号を受信し、このリセット信号に基づいて初
期化手段がデータ処理手段の初期を行う。
データ送受信樹脂とリセット信号受信手段が共通のアン
テナを有する場合には、分離手段がこのアンテナで受信
された受信信号からデータとリセット信号とを分離す
る。
テナを有する場合には、分離手段がこのアンテナで受信
された受信信号からデータとリセット信号とを分離す
る。
また、無効手段を設けた場合には、データ送受信手段か
ら外部へデータを送信している間は初期化手段が機能し
なくなり、特にデータ送受信手段とリセット信号受信手
段が共通のアンテナを有するときに初期化手段の誤動作
を防止する。
ら外部へデータを送信している間は初期化手段が機能し
なくなり、特にデータ送受信手段とリセット信号受信手
段が共通のアンテナを有するときに初期化手段の誤動作
を防止する。
以下、この発明の実施例を添付図面に基づいて説明す
る。
る。
第１図は本発明の第１実施例に係る非接触ICカードの構
造を示すブロック図である。この非接触ICカードは、IC
チップ（15）、データ送信アンテナ（６）、データ受信
アンテナ（７）、リセット信号受信アンテナ（12）、バ
ッテリ（８）及び発振子（９）を有して。ICチップ（1
5）には、データ処理手段となるCPU（１）とこのCPU
（１）にそれぞれ接続されているROM（2a）、RAM（2
b）、データ変調回路（３）、データ復調回路（４）及
びリセット信号復調回路（11）が形成されている。尚、
リセット信号復調回路（11）はCPU（１）のリセット端
子Ｒに接続されている。データ変調回路（３）及びデー
タ復調回路（４）にそれぞれデータ送信アンテナ（６）
及びデータ受信アンテナ（７）が接続される一方、リセ
ット信号復調回路（11）にはリセット信号受信アンテナ
（12）が接続されている。また、CPU（１）にはバッテ
リ（８）及び発振子（９）が接続されている。
造を示すブロック図である。この非接触ICカードは、IC
チップ（15）、データ送信アンテナ（６）、データ受信
アンテナ（７）、リセット信号受信アンテナ（12）、バ
ッテリ（８）及び発振子（９）を有して。ICチップ（1
5）には、データ処理手段となるCPU（１）とこのCPU
（１）にそれぞれ接続されているROM（2a）、RAM（2
b）、データ変調回路（３）、データ復調回路（４）及
びリセット信号復調回路（11）が形成されている。尚、
リセット信号復調回路（11）はCPU（１）のリセット端
子Ｒに接続されている。データ変調回路（３）及びデー
タ復調回路（４）にそれぞれデータ送信アンテナ（６）
及びデータ受信アンテナ（７）が接続される一方、リセ
ット信号復調回路（11）にはリセット信号受信アンテナ
（12）が接続されている。また、CPU（１）にはバッテ
リ（８）及び発振子（９）が接続されている。
データ変調回路（３）、データ復調回路（４）、データ
送信アンテナ（６）及びデータ受信アンテナ（７）によ
りデータ送受信手段が形成されている。また、リセット
信号受信アンテナ（12）によりリセット信号受信手段
が、リセット信号復調回路（11）により初期化手段が、
RAM（2b）によりデータ記憶手段がそれぞれ形成されて
いる。さらに、ICカードは、耐環境性の向上を図るた
め、その全体が樹脂等により封止されている。
送信アンテナ（６）及びデータ受信アンテナ（７）によ
りデータ送受信手段が形成されている。また、リセット
信号受信アンテナ（12）によりリセット信号受信手段
が、リセット信号復調回路（11）により初期化手段が、
RAM（2b）によりデータ記憶手段がそれぞれ形成されて
いる。さらに、ICカードは、耐環境性の向上を図るた
め、その全体が樹脂等により封止されている。
次に、この実施例の動作を説明する。CPU（１）にはバ
ッテリ（８）から電源電圧が共給されると共に発振子
（９）からはクロック信号が供給されている。このICカ
ードにリセット信号を電磁波で与えると、リセット信号
はリセット信号受信アンテナ（12）で受信され、リセッ
ト信号復調回路（11）で復調された後、CPU（１）のリ
セット端子Ｒに入力する。これにより、CPU（１）の初
期化が行われ、CPU（１）は作動可能状態となる。そし
て、データの受信時には、外部からの電磁波がデータ受
信アンテナ（７）で受信され、データ復調回路（４）で
データに復調された後、CPU（１）に入力される。CPU
（１）は予めROM（2a）に格納されているプログラムに
基づいてデータ処理を行い、必要に応じてデータをRAM
（2b）に記憶する。一方、データの送信時には、CPU
（１）からデータがデータ変調回路（３）に出力され、
ここで搬送波がこのデータにより変調された後、データ
送信アンテナ（６）から外部へ送信される。
ッテリ（８）から電源電圧が共給されると共に発振子
（９）からはクロック信号が供給されている。このICカ
ードにリセット信号を電磁波で与えると、リセット信号
はリセット信号受信アンテナ（12）で受信され、リセッ
ト信号復調回路（11）で復調された後、CPU（１）のリ
セット端子Ｒに入力する。これにより、CPU（１）の初
期化が行われ、CPU（１）は作動可能状態となる。そし
て、データの受信時には、外部からの電磁波がデータ受
信アンテナ（７）で受信され、データ復調回路（４）で
データに復調された後、CPU（１）に入力される。CPU
（１）は予めROM（2a）に格納されているプログラムに
基づいてデータ処理を行い、必要に応じてデータをRAM
（2b）に記憶する。一方、データの送信時には、CPU
（１）からデータがデータ変調回路（３）に出力され、
ここで搬送波がこのデータにより変調された後、データ
送信アンテナ（６）から外部へ送信される。
その後、例えばICカードの使用時毎にデータ送受信に先
がけてリセット信号を電磁波で与える等により、適宜CP
U（１）の初期化を行うことができる。従って、外部か
らの擾乱によりCPU（１）が暴走した場合でも、CPU
（１）を初期化してこのICカードに所望の機能を行わせ
ることが可能となる。
がけてリセット信号を電磁波で与える等により、適宜CP
U（１）の初期化を行うことができる。従って、外部か
らの擾乱によりCPU（１）が暴走した場合でも、CPU
（１）を初期化してこのICカードに所望の機能を行わせ
ることが可能となる。
尚、データとリセット信号はそれぞれ電磁波により搬送
されるので、データを搬送する電磁波とリセット信号を
搬送する電磁波とを判別する必要がある。これらの電磁
波を判別する方法としては、例えば周波数の違いにより
判別する方法、電磁波の強さの違いによって判別する方
法等が考えられる。
されるので、データを搬送する電磁波とリセット信号を
搬送する電磁波とを判別する必要がある。これらの電磁
波を判別する方法としては、例えば周波数の違いにより
判別する方法、電磁波の強さの違いによって判別する方
法等が考えられる。
第２図は、データとリセット信号をそれぞれ搬送する双
方の電磁波の周波数f1及びf2を互いに異ならせることに
よりこれら電磁波を判別するようにした第２実施例の要
部を示す回路図である。ただし、この実施例では、デー
タ送信用の電磁波の周波数とデータ受信用の電磁波の周
波数とは等しく設定されており、データ送受信用として
共通のアンテナ（103）が用いられている。このアンテ
ナ（103）にはコンデンサ（104）が接続されおり、これ
らにより、データ送受信用の搬送波の周波数f1と等しい
共振周波数を有する共振回路（103a）が形成されてい
る。また、アンテナ（103）には抵抗（102）及びトラン
ジスタ（101）を介してゲート回路（100）が接続されて
いる。このゲート回路（100）には、CPU（１）から送信
データ及び搬送波が入力される。さらに、アンテナ（10
3）には受信データの有無を判別するための比較器（10
5）の第１入力端が接続されており、この比較器（105）
の第２入力端には比較器（105）の基準電圧を決定する
ための抵抗（106）及び（107）が接続されている。比較
器（105）の出力端はダイオード（108）を介してCPU
（１）に接続されている。また、ダイオード（108）の
出力端にはコンデンサ（109）及び放電抵抗（110）が接
続されている。
方の電磁波の周波数f1及びf2を互いに異ならせることに
よりこれら電磁波を判別するようにした第２実施例の要
部を示す回路図である。ただし、この実施例では、デー
タ送信用の電磁波の周波数とデータ受信用の電磁波の周
波数とは等しく設定されており、データ送受信用として
共通のアンテナ（103）が用いられている。このアンテ
ナ（103）にはコンデンサ（104）が接続されおり、これ
らにより、データ送受信用の搬送波の周波数f1と等しい
共振周波数を有する共振回路（103a）が形成されてい
る。また、アンテナ（103）には抵抗（102）及びトラン
ジスタ（101）を介してゲート回路（100）が接続されて
いる。このゲート回路（100）には、CPU（１）から送信
データ及び搬送波が入力される。さらに、アンテナ（10
3）には受信データの有無を判別するための比較器（10
5）の第１入力端が接続されており、この比較器（105）
の第２入力端には比較器（105）の基準電圧を決定する
ための抵抗（106）及び（107）が接続されている。比較
器（105）の出力端はダイオード（108）を介してCPU
（１）に接続されている。また、ダイオード（108）の
出力端にはコンデンサ（109）及び放電抵抗（110）が接
続されている。
このICカードには、データ送受信用アンテナ（103）と
は別にリセット信号受信用アンテナ（111）が設けられ
ている。このアンテナ（111）にはコンデンサ（112）が
接続されており、これらにより、リセット信号の搬送波
の周波数f2と等しい共振周波数を有する共振回路（111
a）が形成されている。また、アンテナ（111）にはリセ
ット信号の有無を判別するための比較器（113）の第１
入力端が接続されており、この比較器（113）の第２入
力端には比較器（113）の基準電圧を決定するための抵
抗（114）及び（115）が接続されている。比較器（11
3）の出力端はダイオード（116）を介してCPU（１）に
接続されている。また、ダイオード（116）の出力端に
はコンデンサ（117）及び放電抵抗（118）が接続されて
いる。
は別にリセット信号受信用アンテナ（111）が設けられ
ている。このアンテナ（111）にはコンデンサ（112）が
接続されており、これらにより、リセット信号の搬送波
の周波数f2と等しい共振周波数を有する共振回路（111
a）が形成されている。また、アンテナ（111）にはリセ
ット信号の有無を判別するための比較器（113）の第１
入力端が接続されており、この比較器（113）の第２入
力端には比較器（113）の基準電圧を決定するための抵
抗（114）及び（115）が接続されている。比較器（11
3）の出力端はダイオード（116）を介してCPU（１）に
接続されている。また、ダイオード（116）の出力端に
はコンデンサ（117）及び放電抵抗（118）が接続されて
いる。
そして、データを搬送する周波数f1の電磁波が外部から
このICカードに発せられると、電磁波は共振回路（103
a）で受信され、比較器（105）に入力される。この比較
器（105）においてデータの受信が判別され、比較器（1
05）からハイレベルの信号がダオード（108）を介してC
PU（１）に入力される。また、データの送信時には、CP
U（１）から送信データが搬送波と共にゲート回路（10
0）に入力され、ここで搬送波が送信データにより変調
された後、アンテナ（103）から送信される。尚、搬送
波はCPU（１）に接続された発振子（９）からの発振信
号をもとに生成される。
このICカードに発せられると、電磁波は共振回路（103
a）で受信され、比較器（105）に入力される。この比較
器（105）においてデータの受信が判別され、比較器（1
05）からハイレベルの信号がダオード（108）を介してC
PU（１）に入力される。また、データの送信時には、CP
U（１）から送信データが搬送波と共にゲート回路（10
0）に入力され、ここで搬送波が送信データにより変調
された後、アンテナ（103）から送信される。尚、搬送
波はCPU（１）に接続された発振子（９）からの発振信
号をもとに生成される。
一方、リセット信号を搬送する周波数f2の電磁波が外部
からこのICカードに発せられると、電磁波は今度はリセ
ット信号受信用アンテナ（111）とコンデンサ（112）で
形成される共振回路（111a）で受信され、この共振回路
で発生した電圧が比較器（113）に入力される。この電
圧は比較器（113）において、抵抗（114）及び（115）
により決定される基準電圧と比較され、この場合にはリ
セット信号を搬送する電磁波が受信されたと判別されて
比較器（113）の出力端はハイレベルとなる。このた
め、ダイオード（116）を介してコンデンサ（117）が充
電され、CPU（１）にハイレベルのリセット信号が入力
される。
からこのICカードに発せられると、電磁波は今度はリセ
ット信号受信用アンテナ（111）とコンデンサ（112）で
形成される共振回路（111a）で受信され、この共振回路
で発生した電圧が比較器（113）に入力される。この電
圧は比較器（113）において、抵抗（114）及び（115）
により決定される基準電圧と比較され、この場合にはリ
セット信号を搬送する電磁波が受信されたと判別されて
比較器（113）の出力端はハイレベルとなる。このた
め、ダイオード（116）を介してコンデンサ（117）が充
電され、CPU（１）にハイレベルのリセット信号が入力
される。
また、リセット信号を搬送する周波数f2の電磁波が外部
からこのICカードに送信されない場合には、共振回路
（111a）に電圧が発生せず、このため比較器（113）の
出力端はローレベルとなり、コンデンサ（117）に蓄積
されていた電荷は抵抗（118）により放電される。従っ
て、再び周波数f2の電磁波が受信されるまで、ハイレベ
ルのリセット信号がCPU（１）に入力することはない。
からこのICカードに送信されない場合には、共振回路
（111a）に電圧が発生せず、このため比較器（113）の
出力端はローレベルとなり、コンデンサ（117）に蓄積
されていた電荷は抵抗（118）により放電される。従っ
て、再び周波数f2の電磁波が受信されるまで、ハイレベ
ルのリセット信号がCPU（１）に入力することはない。
第３図は、リセット信号搬送用の電磁波の強さM2をデー
タ搬送用の電磁波の強さM1より強くすることにより、こ
れら双方の電磁波を判別するようにした第３実施例の要
部を示す回路図である。この実施例は、第２図に示した
第２実施例において、二つの共振回路（103a）及び（11
1a）の代わりにデータ送受信とリセット信号受信とに共
通の共振回路（119a）を設けると共に、リセット信号を
CPU（１）に出力するためのダイオード（116）の出力端
とグラウンドとの間にトランジスタ（121）を接続した
ものである。この実施例では、データ送受信用の電磁波
の周波数f3とリセット信号を搬送する電磁波の周波数３
とは等しく設定されており、共振回路（119a）はこれら
電磁波の周波数f3と等しい共振周波数を有している。共
振回路（119a）はアンテナ（119）とこれに接続された
コンデンサ（120）とから形成されており、比較器（10
5）及び（113）と抵抗（102）とにそれぞれ接続されて
いる。また、ダイオード（116）の出力端とグラウンド
間に配置されたトランジスタ（121）は無効手段を構成
するものであり、そのゲートはゲート回路（100）の送
信データ入力端に接続されている。尚、受信データの有
無を判別する比較器（105）及びリセット信号の有無を
判別する比較器（113）の各基準電圧V1及びV2と、強さM
1及びM2の各電磁波を受信したときに共振回路（119a）
にそれぞれ発生する電圧V3及びV4との間に、V1＜V3＜V2
＜V4の関係が成り立つように、抵抗（106）、（107）、
（114）及び（115）が設定されている。この実施例にお
いては、比較器（105）及び（113）と抵抗（106）、（1
07）、（114）及び（115）により分離手段が構成されて
いる。
タ搬送用の電磁波の強さM1より強くすることにより、こ
れら双方の電磁波を判別するようにした第３実施例の要
部を示す回路図である。この実施例は、第２図に示した
第２実施例において、二つの共振回路（103a）及び（11
1a）の代わりにデータ送受信とリセット信号受信とに共
通の共振回路（119a）を設けると共に、リセット信号を
CPU（１）に出力するためのダイオード（116）の出力端
とグラウンドとの間にトランジスタ（121）を接続した
ものである。この実施例では、データ送受信用の電磁波
の周波数f3とリセット信号を搬送する電磁波の周波数３
とは等しく設定されており、共振回路（119a）はこれら
電磁波の周波数f3と等しい共振周波数を有している。共
振回路（119a）はアンテナ（119）とこれに接続された
コンデンサ（120）とから形成されており、比較器（10
5）及び（113）と抵抗（102）とにそれぞれ接続されて
いる。また、ダイオード（116）の出力端とグラウンド
間に配置されたトランジスタ（121）は無効手段を構成
するものであり、そのゲートはゲート回路（100）の送
信データ入力端に接続されている。尚、受信データの有
無を判別する比較器（105）及びリセット信号の有無を
判別する比較器（113）の各基準電圧V1及びV2と、強さM
1及びM2の各電磁波を受信したときに共振回路（119a）
にそれぞれ発生する電圧V3及びV4との間に、V1＜V3＜V2
＜V4の関係が成り立つように、抵抗（106）、（107）、
（114）及び（115）が設定されている。この実施例にお
いては、比較器（105）及び（113）と抵抗（106）、（1
07）、（114）及び（115）により分離手段が構成されて
いる。
そして、データを搬送する強さM1の電磁波が外部からこ
のICカードに発せられると、電磁波は共振回路（119a）
で受信され、この共振回路（119a）に電圧V3が発生す
る。この電圧V3は比較器（105）の基準電圧V1より大き
いので、比較器（105）で受信データであると判別さ
れ、ここから受信データがダイオード（108）を介してC
PU（１）に入力される。このとき、共振回路（119a）で
発生した電圧V3はリセット信号判別用の比較器（113）
にも入力するが、比較器（113）はこの発生電圧V3より
大きな基準電圧V2を有しているので、比較器（113）の
出力端はハイレベルとはならず、リセット信号は出力さ
れない。
のICカードに発せられると、電磁波は共振回路（119a）
で受信され、この共振回路（119a）に電圧V3が発生す
る。この電圧V3は比較器（105）の基準電圧V1より大き
いので、比較器（105）で受信データであると判別さ
れ、ここから受信データがダイオード（108）を介してC
PU（１）に入力される。このとき、共振回路（119a）で
発生した電圧V3はリセット信号判別用の比較器（113）
にも入力するが、比較器（113）はこの発生電圧V3より
大きな基準電圧V2を有しているので、比較器（113）の
出力端はハイレベルとはならず、リセット信号は出力さ
れない。
一方、リセット信号を搬送する強さM2の電磁波が外部か
らこのICカードに発せられると、電磁波は共振回路（11
9a）で受信され、この共振回路（119a）に今度は電圧V4
が発生する。この電圧V4は比較器（113）の基準電圧V2
より大きいので、比較器（113）でリセット信号である
と判別され、ここからリセット信号がダイオード（11
6）を介してCPU（１）に入力される。これにより、CPU
（１）の初期化が行われる。
らこのICカードに発せられると、電磁波は共振回路（11
9a）で受信され、この共振回路（119a）に今度は電圧V4
が発生する。この電圧V4は比較器（113）の基準電圧V2
より大きいので、比較器（113）でリセット信号である
と判別され、ここからリセット信号がダイオード（11
6）を介してCPU（１）に入力される。これにより、CPU
（１）の初期化が行われる。
また、データの送信時には、送信データに対応した電圧
がゲート回路（100）、トランジスタ（101）及び抵抗
（102）を介して共振回路（119a）に印加されるが、こ
の電圧は抵抗（102）から比較器（113）にも印加され
る。このため、リセット信号を必要としないにも拘わら
ず比較器（113）の出力端がハイレベルになる恐れがあ
る。しかしながら、送信データはゲート回路（100）に
入力すると同時に無効手段となるトランジスタ（121）
のゲートにも入力するので、このときトランジスタ（12
1）は送信データによって導通状態となり、コンデンサ
（117）に蓄積される電荷はこのトランジスタ（121）を
介して放電されることとなる。従って、データ送信時に
誤ってハイレベルのリセット信号がCPU（１）に入力さ
れることが防止される。
がゲート回路（100）、トランジスタ（101）及び抵抗
（102）を介して共振回路（119a）に印加されるが、こ
の電圧は抵抗（102）から比較器（113）にも印加され
る。このため、リセット信号を必要としないにも拘わら
ず比較器（113）の出力端がハイレベルになる恐れがあ
る。しかしながら、送信データはゲート回路（100）に
入力すると同時に無効手段となるトランジスタ（121）
のゲートにも入力するので、このときトランジスタ（12
1）は送信データによって導通状態となり、コンデンサ
（117）に蓄積される電荷はこのトランジスタ（121）を
介して放電されることとなる。従って、データ送信時に
誤ってハイレベルのリセット信号がCPU（１）に入力さ
れることが防止される。
この第３実施例によれば、一つのアンテナ（119）でデ
ータの送受信及びリセット信号の受信を行うことができ
るので、内蔵部品の小型化が要求されるICカードには極
めて適したものとなる。
ータの送受信及びリセット信号の受信を行うことができ
るので、内蔵部品の小型化が要求されるICカードには極
めて適したものとなる。
以上説明したように、外部とのデータの送受信を非接触
で行うためのデータ送受信手段と、データ送受信手段に
接続され且つデータを処理するためのデータ処理手段
と、外部からのリセット信号の受信を非接触で行うため
のリセット信号受信手段と、リセット信号受信手段で受
信されたリセット信号に基づいてデータ処理手段を初期
化するための初期化手段とを備えているので、樹脂等に
より封止した後でもデータ処理手段の初期化を行うこと
が可能となる。
で行うためのデータ送受信手段と、データ送受信手段に
接続され且つデータを処理するためのデータ処理手段
と、外部からのリセット信号の受信を非接触で行うため
のリセット信号受信手段と、リセット信号受信手段で受
信されたリセット信号に基づいてデータ処理手段を初期
化するための初期化手段とを備えているので、樹脂等に
より封止した後でもデータ処理手段の初期化を行うこと
が可能となる。
また、データ送受信手段とリセット信号受信手段が共通
のアンテナを有すると共に、このアンテナで受信した受
信信号からデータ処理手段で処理されるデータとリセッ
ト信号とを分離する分離手段を設ければ、ICカードの小
型化を図ることもできる。
のアンテナを有すると共に、このアンテナで受信した受
信信号からデータ処理手段で処理されるデータとリセッ
ト信号とを分離する分離手段を設ければ、ICカードの小
型化を図ることもできる。
さらに、データ送受信手段から外部へデータを送信して
いる間は初期化手段の機能を無効とする無効手段を設け
れば、データの送信時に誤って初期化が行われることが
防止される。
いる間は初期化手段の機能を無効とする無効手段を設け
れば、データの送信時に誤って初期化が行われることが
防止される。
第１図は本発明の第１実施例に係る非接触ICカードの構
造を示すブロック図、第２図は第２実施例を要部を示す
回路図、第３図は第３実施例の要部を示す回路図、第４
図は従来の非接触ICカードを示すブロック図である。 図において、（１）はCPU、（2a）はROM、（2b）はRA
M、（３）はデータ変調回路、（４）はデータ復調回
路、（６）はデータ送信アンテナ、（７）はデータ受信
アンテナ、（11）はリセット信号復調回路、（12）はリ
セット信号受信アンテナである。 なお、各図中同一符号は同一または相当部分を示す。
造を示すブロック図、第２図は第２実施例を要部を示す
回路図、第３図は第３実施例の要部を示す回路図、第４
図は従来の非接触ICカードを示すブロック図である。 図において、（１）はCPU、（2a）はROM、（2b）はRA
M、（３）はデータ変調回路、（４）はデータ復調回
路、（６）はデータ送信アンテナ、（７）はデータ受信
アンテナ、（11）はリセット信号復調回路、（12）はリ
セット信号受信アンテナである。 なお、各図中同一符号は同一または相当部分を示す。
Claims (4)
- 【請求項１】外部とのデータの送受信を非接触で行うた
めのデータ送受信手段と、 前記データ送受信手段に接続され且つデータを処理する
ためのデータ処理手段と、 外部からのリセット信号の受信を非接触で行うためのリ
セット信号受信手段と、 前記リセット信号受信手段で受信された前記リセット信
号に基づいて前記データ処理手段を初期化するための初
期化手段と を備えた非接触ICカード。 - 【請求項２】前記データ送受信手段と前記リセット信号
受信手段は共通のアンテナを有し、前記アンテナで受信
された受信信号から前記データ処理手段で処理されるデ
ータと前記リセット信号とを分離する分離手段を備えた
請求項１記載の非接触ICカード。 - 【請求項３】前記データ送受信手段から外部へデータを
送信している間は前記初期化手段の機能を無効とする無
効手段を備えた請求項１記載の非接触ICカード。 - 【請求項４】前記データ処理手段に接続され且つデータ
を記憶するためのデータ記憶手段を備えた請求項１記載
の非接触ICカード。
Priority Applications (4)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1122787A JPH0755593B2 (ja) | 1989-05-18 | 1989-05-18 | 非接触ｉｃカード |
| US07/394,479 US5068521A (en) | 1989-05-18 | 1989-08-16 | Non-contact ic card |
| GB8920690A GB2231983B (en) | 1989-05-18 | 1989-09-13 | Non-contact ic card |
| FR898912657A FR2647241B1 (fr) | 1989-05-18 | 1989-09-27 | Carte a circuit integre sans contact |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1122787A JPH0755593B2 (ja) | 1989-05-18 | 1989-05-18 | 非接触ｉｃカード |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH02302889A JPH02302889A (ja) | 1990-12-14 |
| JPH0755593B2 true JPH0755593B2 (ja) | 1995-06-14 |
Family
ID=14844612
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1122787A Expired - Lifetime JPH0755593B2 (ja) | 1989-05-18 | 1989-05-18 | 非接触ｉｃカード |
Country Status (4)
| Country | Link |
|---|---|
| US (1) | US5068521A (ja) |
| JP (1) | JPH0755593B2 (ja) |
| FR (1) | FR2647241B1 (ja) |
| GB (1) | GB2231983B (ja) |
Families Citing this family (43)
| Publication number | Priority date | Publication date | Assignee | Title |
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| US5274221A (en) * | 1990-06-22 | 1993-12-28 | Mitsubishi Denki Kabushiki Kaisha | Non-contact integrated circuit card |
| JP2822624B2 (ja) * | 1990-07-03 | 1998-11-11 | 三菱電機株式会社 | 非接触ｉｃカード |
| US5191192A (en) * | 1990-09-10 | 1993-03-02 | Mitsubishi Denki Kabushiki Kaisha | Non-contact type information card and communication system |
| JP2549192B2 (ja) * | 1990-09-19 | 1996-10-30 | 三菱電機株式会社 | 非接触ｉｃカード及びその使用方法 |
| DE69122845T2 (de) * | 1990-12-28 | 1997-02-20 | Mitsubishi Electric Corp | Kontaktlose IC-Karte |
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| JP2713529B2 (ja) * | 1992-08-21 | 1998-02-16 | 三菱電機株式会社 | 信号受信用コイルおよびこれを使用した非接触ｉｃカード |
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- 1989-05-18 JP JP1122787A patent/JPH0755593B2/ja not_active Expired - Lifetime
- 1989-08-16 US US07/394,479 patent/US5068521A/en not_active Expired - Fee Related
- 1989-09-13 GB GB8920690A patent/GB2231983B/en not_active Expired - Fee Related
- 1989-09-27 FR FR898912657A patent/FR2647241B1/fr not_active Expired - Fee Related
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