JPH0759252A - 保護回路 - Google Patents
保護回路Info
- Publication number
- JPH0759252A JPH0759252A JP20143893A JP20143893A JPH0759252A JP H0759252 A JPH0759252 A JP H0759252A JP 20143893 A JP20143893 A JP 20143893A JP 20143893 A JP20143893 A JP 20143893A JP H0759252 A JPH0759252 A JP H0759252A
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- JP
- Japan
- Prior art keywords
- circuit
- fuse
- absorbing element
- load
- surge absorbing
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 230000001681 protective effect Effects 0.000 title 1
- 230000000391 smoking effect Effects 0.000 abstract description 3
- 238000010304 firing Methods 0.000 abstract 2
- 239000000779 smoke Substances 0.000 description 4
- 238000010586 diagram Methods 0.000 description 3
- 239000003990 capacitor Substances 0.000 description 2
- 238000009413 insulation Methods 0.000 description 2
- 230000002159 abnormal effect Effects 0.000 description 1
- 238000010521 absorption reaction Methods 0.000 description 1
- 230000007935 neutral effect Effects 0.000 description 1
Landscapes
- Emergency Protection Circuit Devices (AREA)
- Protection Of Static Devices (AREA)
Abstract
(57)【要約】
【目的】負荷回路を過電流及びサージ電流から保護する
とともにサージ吸収素子の発煙や発火を防止した保護回
路を提供する。 【構成】電源１と負荷２との直列回路に第１のヒューズ
３を直列に接続する。サージ吸収素子Ｚと、第１のヒュ
ーズ３よりも定格容量の小さい第２のヒューズ４との直
列回路を負荷２と並列に電源１に接続する。サージ吸収
素子Ｚの両端に降圧用トランスＴの一次側を接続する。
そして、降圧用トランスＴの二次側にダイオードブリッ
ジＤＢを介して制御回路５を接続する。さらに制御回路
５に操作回路６を接続している。したがって、サージ吸
収素子Ｚが低抵抗の短絡モードになった場合でも、第２
のヒューズ４が溶断してサージ吸収素子Ｚを電源１から
切り離し、サージ吸収素子Ｚの発煙や発火を防止でき
る。
とともにサージ吸収素子の発煙や発火を防止した保護回
路を提供する。 【構成】電源１と負荷２との直列回路に第１のヒューズ
３を直列に接続する。サージ吸収素子Ｚと、第１のヒュ
ーズ３よりも定格容量の小さい第２のヒューズ４との直
列回路を負荷２と並列に電源１に接続する。サージ吸収
素子Ｚの両端に降圧用トランスＴの一次側を接続する。
そして、降圧用トランスＴの二次側にダイオードブリッ
ジＤＢを介して制御回路５を接続する。さらに制御回路
５に操作回路６を接続している。したがって、サージ吸
収素子Ｚが低抵抗の短絡モードになった場合でも、第２
のヒューズ４が溶断してサージ吸収素子Ｚを電源１から
切り離し、サージ吸収素子Ｚの発煙や発火を防止でき
る。
Description
【０００１】
【産業上の利用分野】本発明は、電源と、負荷と、負荷
への電源供給をオン／オフ制御する制御回路とから成る
負荷回路を過電流及びサージ電流から保護する保護回路
に関するものである。
への電源供給をオン／オフ制御する制御回路とから成る
負荷回路を過電流及びサージ電流から保護する保護回路
に関するものである。
【０００２】
【従来の技術】上記の負荷回路としては、例えば図２に
示すように、電源１に負荷２を接続し、電源電圧をトラ
ンスＴで降圧した後ダイオードブリッジＤＢで整流して
制御回路５及び操作回路６に印加するものがある。負荷
２と電源１との間には制御回路５により開閉制御される
スイッチＳＷ1 ，ＳＷ2 が接続されており、操作回路６
からの操作信号に基づいて制御回路５は上記スイッチＳ
Ｗ1 ，ＳＷ2 の開閉制御を行い、負荷２への電源供給を
オン／オフ制御している。
示すように、電源１に負荷２を接続し、電源電圧をトラ
ンスＴで降圧した後ダイオードブリッジＤＢで整流して
制御回路５及び操作回路６に印加するものがある。負荷
２と電源１との間には制御回路５により開閉制御される
スイッチＳＷ1 ，ＳＷ2 が接続されており、操作回路６
からの操作信号に基づいて制御回路５は上記スイッチＳ
Ｗ1 ，ＳＷ2 の開閉制御を行い、負荷２への電源供給を
オン／オフ制御している。
【０００３】また、図２に示す負荷回路にあっては、電
源１と負荷２との間に過電流保護用のヒューズ３が直列
に挿入接続され、さらに負荷２と並列にサージ吸収素子
Ｚと、フィルタとしてのコンデンサＣとが接続されてい
る。ここで、サージ吸収素子Ｚは、ヒューズ３では保護
できないような、雷サージ等の非常に短時間に流れるサ
ージ電流を吸収して回路を保護するものである。
源１と負荷２との間に過電流保護用のヒューズ３が直列
に挿入接続され、さらに負荷２と並列にサージ吸収素子
Ｚと、フィルタとしてのコンデンサＣとが接続されてい
る。ここで、サージ吸収素子Ｚは、ヒューズ３では保護
できないような、雷サージ等の非常に短時間に流れるサ
ージ電流を吸収して回路を保護するものである。
【０００４】すなわち、上記のヒューズ３及びサージ吸
収素子Ｚにより負荷回路の保護回路８が構成されている
のである。
収素子Ｚにより負荷回路の保護回路８が構成されている
のである。
【０００５】
【発明が解決しようとする課題】ところが、上記構成で
は、例えば定格電圧が１００Ｖの負荷回路に２００Ｖの
電源が誤って接続されたり、単相三線電源の中性線が何
らかの原因で欠相してサージ吸収素子Ｚに過電圧（電源
電圧が１００Ｖの場合には約１４０Ｖ〜１７０Ｖ）が印
加されたり、あるいはサージ吸収素子Ｚの定格を越える
サージ電圧がサージ吸収素子Ｚに印加されて絶縁劣化し
た場合に、さらにまたサージ吸収素子Ｚが寿命末期で絶
縁劣化した場合にサージ吸収素子Ｚが低抵抗による短絡
モードとなって温度が異常上昇し、サージ吸収素子Ｚが
発煙したり、さらに発火にいたるなどして危険であると
いう問題がある。
は、例えば定格電圧が１００Ｖの負荷回路に２００Ｖの
電源が誤って接続されたり、単相三線電源の中性線が何
らかの原因で欠相してサージ吸収素子Ｚに過電圧（電源
電圧が１００Ｖの場合には約１４０Ｖ〜１７０Ｖ）が印
加されたり、あるいはサージ吸収素子Ｚの定格を越える
サージ電圧がサージ吸収素子Ｚに印加されて絶縁劣化し
た場合に、さらにまたサージ吸収素子Ｚが寿命末期で絶
縁劣化した場合にサージ吸収素子Ｚが低抵抗による短絡
モードとなって温度が異常上昇し、サージ吸収素子Ｚが
発煙したり、さらに発火にいたるなどして危険であると
いう問題がある。
【０００６】本発明は上記問題点の解決を目的とするも
のであり、負荷回路を過電流やサージ電流から保護する
とともにサージ吸収素子の発煙や発火を防止した保護回
路を提供しようとするものである。
のであり、負荷回路を過電流やサージ電流から保護する
とともにサージ吸収素子の発煙や発火を防止した保護回
路を提供しようとするものである。
【０００７】
【課題を解決するための手段】本発明は、上記目的を達
成するために、電源と、負荷と、電源から負荷への電源
供給をオン／オフ制御する制御回路とを備えて成る負荷
回路を過電流及びサージ電流から保護する保護回路にお
いて、第１のヒューズと、第１のヒューズよりも定格容
量の小さい第２のヒューズと、サージ吸収素子とを具備
し、電源と負荷との直列回路に第１のヒューズを直列に
接続し、サージ吸収素子と第２のヒューズとの直列回路
を負荷と並列に電源に接続するとともに、サージ吸収素
子の両端に制御回路を接続して成ることを特徴とする。
成するために、電源と、負荷と、電源から負荷への電源
供給をオン／オフ制御する制御回路とを備えて成る負荷
回路を過電流及びサージ電流から保護する保護回路にお
いて、第１のヒューズと、第１のヒューズよりも定格容
量の小さい第２のヒューズと、サージ吸収素子とを具備
し、電源と負荷との直列回路に第１のヒューズを直列に
接続し、サージ吸収素子と第２のヒューズとの直列回路
を負荷と並列に電源に接続するとともに、サージ吸収素
子の両端に制御回路を接続して成ることを特徴とする。
【０００８】
【作用】本発明の構成では、電源と、負荷と、電源から
負荷への電源供給をオン／オフ制御する制御回路とを備
えて成る負荷回路を過電流及びサージ電流から保護する
保護回路において、第１のヒューズと、第１のヒューズ
よりも定格容量の小さい第２のヒューズと、サージ吸収
素子とを具備し、電源と負荷との直列回路に第１のヒュ
ーズを直列に接続し、サージ吸収素子と第２のヒューズ
との直列回路を負荷と並列に電源に接続するとともに、
サージ吸収素子の両端に制御回路を接続して保護回路を
構成したので、サージ吸収素子が何らかの原因により低
抵抗の短絡モードになった場合でも、第２のヒューズが
溶断してサージ吸収素子を電源から切離し、低抵抗によ
る短絡モードになったサージ吸収素子が発煙或いは発火
するのを防ぐことができる。
負荷への電源供給をオン／オフ制御する制御回路とを備
えて成る負荷回路を過電流及びサージ電流から保護する
保護回路において、第１のヒューズと、第１のヒューズ
よりも定格容量の小さい第２のヒューズと、サージ吸収
素子とを具備し、電源と負荷との直列回路に第１のヒュ
ーズを直列に接続し、サージ吸収素子と第２のヒューズ
との直列回路を負荷と並列に電源に接続するとともに、
サージ吸収素子の両端に制御回路を接続して保護回路を
構成したので、サージ吸収素子が何らかの原因により低
抵抗の短絡モードになった場合でも、第２のヒューズが
溶断してサージ吸収素子を電源から切離し、低抵抗によ
る短絡モードになったサージ吸収素子が発煙或いは発火
するのを防ぐことができる。
【０００９】
【実施例】本発明の一実施例を図面を参照して説明す
る。図１に本実施例の概略回路構成図を示す。図１に示
すように、電源１と２つのスイッチＳＷ1 ，ＳＷ2 と負
荷２との直列回路に第１のヒューズ３を直列に接続し、
サージ吸収素子Ｚと、第１のヒューズ３よりも定格容量
の小さい第２のヒューズ４との直列回路を負荷２と並列
に電源１に接続するとともに、サージ吸収素子Ｚの両端
に降圧用トランスＴの一次側を接続し、降圧用トランス
Ｔの二次側にダイオードブリッジＤＢを介して制御回路
５を接続して、さらに制御回路５に操作回路６を接続し
ている。制御回路５は、操作回路６からの操作信号に基
づいてスイッチＳＷ1 ，ＳＷ2 を開閉させ、負荷２への
電源供給をオン／オフ制御している。また、降圧用トラ
ンスＴの一次側にはサージ吸収素子Ｚと並列にフィルタ
用コンデンサＣを接続している。すなわち、第１及び第
２のヒューズ３，４とサージ吸収素子Ｚにより保護回路
７が構成されている。
る。図１に本実施例の概略回路構成図を示す。図１に示
すように、電源１と２つのスイッチＳＷ1 ，ＳＷ2 と負
荷２との直列回路に第１のヒューズ３を直列に接続し、
サージ吸収素子Ｚと、第１のヒューズ３よりも定格容量
の小さい第２のヒューズ４との直列回路を負荷２と並列
に電源１に接続するとともに、サージ吸収素子Ｚの両端
に降圧用トランスＴの一次側を接続し、降圧用トランス
Ｔの二次側にダイオードブリッジＤＢを介して制御回路
５を接続して、さらに制御回路５に操作回路６を接続し
ている。制御回路５は、操作回路６からの操作信号に基
づいてスイッチＳＷ1 ，ＳＷ2 を開閉させ、負荷２への
電源供給をオン／オフ制御している。また、降圧用トラ
ンスＴの一次側にはサージ吸収素子Ｚと並列にフィルタ
用コンデンサＣを接続している。すなわち、第１及び第
２のヒューズ３，４とサージ吸収素子Ｚにより保護回路
７が構成されている。
【００１０】上記構成では、第２のヒューズ４は、その
定格容量が第１のヒューズ３のそれよりも小さいものを
使用しているので、従来例において説明したような原因
により電源電圧に異常が生じた場合であって第１のヒュ
ーズ３が溶断せずサージ吸収素子Ｚが低抵抗による短絡
モードになったときでも、第２のヒューズ４が溶断して
サージ吸収素子Ｚを電源１から切り離すことにより、サ
ージ吸収素子Ｚが発煙或いは発火するのを防ぐことがで
きるものである。さらに、第２のヒューズ４が溶断する
ことにより、制御回路５及び操作回路６も同時に電源１
から切り離されて負荷２の制御ができなくなるので、上
記のサージ吸収素子Ｚが短絡モードになったことを知る
ことができる。また、従来のものであればサージ吸収素
子Ｚを交換するためにかなりの手間がかかるが、本願発
明の構成では、第２のヒューズ４を交換するだけでよく
作業が容易で手間がかからない。
定格容量が第１のヒューズ３のそれよりも小さいものを
使用しているので、従来例において説明したような原因
により電源電圧に異常が生じた場合であって第１のヒュ
ーズ３が溶断せずサージ吸収素子Ｚが低抵抗による短絡
モードになったときでも、第２のヒューズ４が溶断して
サージ吸収素子Ｚを電源１から切り離すことにより、サ
ージ吸収素子Ｚが発煙或いは発火するのを防ぐことがで
きるものである。さらに、第２のヒューズ４が溶断する
ことにより、制御回路５及び操作回路６も同時に電源１
から切り離されて負荷２の制御ができなくなるので、上
記のサージ吸収素子Ｚが短絡モードになったことを知る
ことができる。また、従来のものであればサージ吸収素
子Ｚを交換するためにかなりの手間がかかるが、本願発
明の構成では、第２のヒューズ４を交換するだけでよく
作業が容易で手間がかからない。
【００１１】
【発明の効果】本発明は、電源と、負荷と、電源から負
荷への電源供給をオン／オフ制御する制御回路とを備え
て成る負荷回路を過電流及びサージ電流から保護する保
護回路において、第１のヒューズと、第１のヒューズよ
りも定格容量の小さい第２のヒューズと、サージ吸収素
子とを具備し、電源と負荷との直列回路に第１のヒュー
ズを直列に接続し、サージ吸収素子と第２のヒューズと
の直列回路を負荷と並列に電源に接続するとともに、サ
ージ吸収素子の両端に制御回路を接続して保護回路を構
成したので、サージ吸収素子が何らかの原因により低抵
抗の短絡モードになった場合でも、第２のヒューズが溶
断してサージ吸収素子を電源から切離し、サージ吸収素
子からの発煙や発火を予防し、安全性を向上させること
ができるという効果がある。また、第２のヒューズが溶
断することにより、制御回路も電源から切り離されるの
で、制御回路が動作しなくなることによりサージ吸収素
子が短絡モードになったことを検知することができると
いう効果がある。
荷への電源供給をオン／オフ制御する制御回路とを備え
て成る負荷回路を過電流及びサージ電流から保護する保
護回路において、第１のヒューズと、第１のヒューズよ
りも定格容量の小さい第２のヒューズと、サージ吸収素
子とを具備し、電源と負荷との直列回路に第１のヒュー
ズを直列に接続し、サージ吸収素子と第２のヒューズと
の直列回路を負荷と並列に電源に接続するとともに、サ
ージ吸収素子の両端に制御回路を接続して保護回路を構
成したので、サージ吸収素子が何らかの原因により低抵
抗の短絡モードになった場合でも、第２のヒューズが溶
断してサージ吸収素子を電源から切離し、サージ吸収素
子からの発煙や発火を予防し、安全性を向上させること
ができるという効果がある。また、第２のヒューズが溶
断することにより、制御回路も電源から切り離されるの
で、制御回路が動作しなくなることによりサージ吸収素
子が短絡モードになったことを検知することができると
いう効果がある。
【図１】本発明の一実施例を示す概略回路構成図であ
る。
る。
【図２】従来例を示す概略回路構成図である。
１ 電源 ２ 負荷 ３ 第１のヒューズ ４ 第２のヒューズ ５ 制御回路 ６ 操作回路 ７ 保護回路 Ｚ サージ吸収素子
Claims (1)
- 【請求項１】 電源と、負荷と、電源から負荷への電源
供給をオン／オフ制御する制御回路とを備えて成る負荷
回路を過電流及びサージ電流から保護する保護回路にお
いて、第１のヒューズと、第１のヒューズよりも定格容
量の小さい第２のヒューズと、サージ吸収素子とを具備
し、電源と負荷との直列回路に第１のヒューズを直列に
接続し、サージ吸収素子と第２のヒューズとの直列回路
を負荷と並列に電源に接続するとともに、サージ吸収素
子の両端に制御回路を接続して成ることを特徴とする保
護回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP20143893A JPH0759252A (ja) | 1993-08-13 | 1993-08-13 | 保護回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP20143893A JPH0759252A (ja) | 1993-08-13 | 1993-08-13 | 保護回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0759252A true JPH0759252A (ja) | 1995-03-03 |
Family
ID=16441095
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP20143893A Pending JPH0759252A (ja) | 1993-08-13 | 1993-08-13 | 保護回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0759252A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6483686B1 (en) * | 2000-10-26 | 2002-11-19 | Jonie Chou | Circuit for indicating abnormality of three-mode surge absorber of public electric power and a multiple-end fuse |
| JP2017131017A (ja) * | 2016-01-19 | 2017-07-27 | Ｎｅｃプラットフォームズ株式会社 | 電子回路、電子機器、および雷サージ保護素子の劣化判断方法 |
-
1993
- 1993-08-13 JP JP20143893A patent/JPH0759252A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6483686B1 (en) * | 2000-10-26 | 2002-11-19 | Jonie Chou | Circuit for indicating abnormality of three-mode surge absorber of public electric power and a multiple-end fuse |
| JP2017131017A (ja) * | 2016-01-19 | 2017-07-27 | Ｎｅｃプラットフォームズ株式会社 | 電子回路、電子機器、および雷サージ保護素子の劣化判断方法 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A02 | Decision of refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A02 Effective date: 20011211 |