JPH076096A - データ記憶装置 - Google Patents

データ記憶装置

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JPH076096A
JPH076096A JP6074441A JP7444194A JPH076096A JP H076096 A JPH076096 A JP H076096A JP 6074441 A JP6074441 A JP 6074441A JP 7444194 A JP7444194 A JP 7444194A JP H076096 A JPH076096 A JP H076096A
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JP
Japan
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address
data
memory
array
signal
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JP6074441A
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Inventor
Anil Gercekci
アニル・ジャーセッキ
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Motorola Inc
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Abstract

(57)【要約】 【目的】 ＩＣメモリに記憶されたデータを権限のない
かつ詐欺的な検出から的確に保護可能なデータ記憶装置
を提供する。 【構成】 データ記憶装置（９）はデータを記憶するた
めの電子的メモリロケーションのアレイ（２０）を備え
る。アドレス入力端子（１０）はアドレスの発生源に結
合されかつアレイ（２０）のメモリロケーションをアド
レスするために前記アドレス発生源から第１のアドレス
信号を提供するよう結合されている。アドレス暗号化機
構（１４）がアドレス入力端子（１０）と前記アレイ
（２０）の間に結合され第１のアドレス信号を暗号化す
る。アドレス暗号化機構（１４）は直接的な光学的検出
から保護された暗号化データを含み、該暗号化データは
第１のアドレス信号を暗号化するために使用される。

Description

【発明の詳細な説明】
【０００１】
【産業上の利用分野】この発明は一般的にはデータ記憶
装置に関し、特に暗号構成の詳細を知ることができずか
つ内部のデータが検知不能に構成したデータ記憶装置に
関する。
【０００２】
【従来の技術】集積回路（ＩＣ）メモリの各アドレスに
記憶されたデータ値の形式で、例えば、銀行口座の詳細
を含むスマートカード（ｓｍａｒｔ ｃａｒｄｓ）のよ
うなデータ記憶装置は、前記ＩＣの回りのプラスチック
封止の除去、カバー層のエッチング除去、および選択的
に吸収する着色剤の付与によってメモリデータを光学的
に見ることができるようにされる危険がある。
【０００３】ＩＣメモリ内で前記データ値が非順次的に
配列されることになる、アドレス暗号化構成を使用でき
ることが知られている。したがってデータは光学的に分
析した場合に意味のないものに見えるが、前記アドレス
暗号化構成によって正当にアクセスできることになる。
【０００４】
【発明が解決しようとする課題】この構成に伴なう問題
は上に述べたのと同じ光学的検出技術を用いることによ
って、前記暗号化機構が基礎としている暗号化の詳細を
知ることができ、かつしたがってＩＣ内のデータの検出
を行なうことが可能なことである。
【０００５】したがって、本発明は上に述べた不都合を
軽減するデータ記憶装置を提供することを目的とする。
【０００６】
【課題を解決するための手段および作用】データ記憶装
置はデータを記憶するための電子的なメモリロケーショ
ンのアレイを具備する。アドレス入力端子がアドレスの
供給源（ｓｏｕｒｃｅ）への結合を提供しかつ前記メモ
リアレイのメモリロケーションをアドレスするために前
記アドレス供給源から第１のアドレス信号を提供するよ
う結合されている。データ出力端子がデータ受入れ装置
への結合を提供しかつ前記アドレス信号に応じてそこか
らデータ信号を受けるために前記メモリアレイに接続さ
れている。前記データ信号は前記アドレス信号によって
アドレスされたメモリロケーションに格納されたデータ
を示す。前記第１のアドレス信号を暗号化するために前
記アドレス入力端子と前記アレイとの間にアドレス暗号
化機構が結合されている。該アドレス暗号化機構は直接
的な光学的検出から保護される暗号化データを含み、該
暗号化データは前記第１のアドレス信号を暗号化するた
めに使用される。
【０００７】前記データメモリのアレイは暗号化された
方法で格納されるデータを含むリードオンリメモリとす
ることができ、その暗号化は前記暗号化データの構成と
整合している。
【０００８】前記アドレス暗号化機構は不揮発性メモリ
から暗号化データを受けるためのラッチを含み、それに
よって前記不揮発性メモリが通常の動作の間に前記アド
レス暗号化機構と独立に動作できるようにすることがで
きる。
【０００９】このようにして、前記暗号化機構が基礎と
している暗号化についての詳細を知ることができずかつ
ＩＣ内のデータの検出を行なうことが不可能になってい
ることが理解される。
【００１０】
【実施例】以下図面を参照して本発明の実施例を説明す
る。図１を参照すると、スマートカード（ｓｍａｒｔ
ｃａｒｄ）９が示されており、該スマートカード９は該
スマートカード９のアドレス駆動回路（図示せず）から
アドレス信号を受けるためのアドレス入力端子１０を備
えている。スマートカード９はシリコンウェハー上に製
作された集積回路を含むカード、すなわちＩＣカードで
ある。
【００１１】アドレス暗号器１４は前記アドレス入力端
子１０に接続され、後に説明する暗号化キーにしたがっ
て該アドレス入力端子１０から受信されたアドレス信号
を暗号化する。
【００１２】ローデコーダ１６およびコラムデコーダ１
８は別個にアドレス暗号器１４に接続されリードオンリ
メモリ（ＲＯＭ）２０に対するメモリアドレシングを提
供し、該アドレシングは前記アドレス暗号器１４からの
暗号化されたアドレス信号に応答して行なわれる。
【００１３】前記ＲＯＭ２０は電子的なデータを含み、
該電子的なデータはメモリアレイのアドレスに格納され
る。該データは前記ＲＯＭ２０に結合されたローデコー
ダ１６およびコラムデコーダ１８によってアドレスさ
れ、前記ＲＯＭ２０はアドレスされたことに応答してデ
ータ信号をデータ出力端子１２に提供する。各データ信
号は前記アドレスされたアドレスに格納されたデータ値
を示す。
【００１４】データメモリ２０のメモリロケーションの
物理的な配置は前記アドレス入力端子１０において受信
されたアドレス信号に明白に対応するものではないが、
それはこれらの受信されたアドレス信号が暗号器１４に
よって暗号化されているからである。したがって、上で
参照されたメモリロケーションの内容の光学的な検出が
可能であっても、暗号化機構もまた調べられなければ、
前記データから何らかの検出を行なうことはできない。
【００１５】前記データ出力端子１２はデータメモリ２
０からデータ信号を受けるよう結合され前記データ信号
をスマートカード９のデータプロセッサ（図示せず）へ
と提供する。
【００１６】フローティングゲート形トランジスタ構成
で実施された不揮発性ランダムアクセスメモリ（ＮＶＲ
ＡＭ）２２がラッチ２４を介してアドレス暗号器１４に
結合され、データ値の形式で暗号化キーを提供する。
【００１７】動作においては、かつデータメモリ２０の
第１のメモリアドレスに格納された第１の項目のデータ
を参照して、通常の動作の間は、スマートカード９は、
前記第１のメモリアドレスにあることが知られている、
前記第１の項目のデータの値を読み出させることができ
る。
【００１８】したがって、第１のアドレス信号が前記ア
ドレス駆動回路（図示せず）から前記アドレス入力端子
１０に送られる。前記第１のアドレス信号は、所望の値
を含んでいない、第２のメモリアドレスを示しているよ
うに見える。前記アドレス暗号器１４は該第１のアドレ
ス信号をラッチ２４から受け取った暗号化キーにしたが
って符号化する。
【００１９】デコーダ１６および１８は暗号化された第
１のアドレス信号を受け取り、これは今や明らかに前記
新しいメモリアドレスを示している。
【００２０】前記ＲＯＭ２０の第１のメモリアドレスは
したがって暗号化されたアドレス信号に応じてデコーダ
１６および１８によってアドレスされ、かつデータ信号
をデータ出力端子１２に提供し、該信号は前記第１のメ
モリアドレスに格納された第１のデータ値を示してい
る。
【００２１】前記ＮＶＲＡＭ２２は主としてスマートカ
ード９内の他の目的に使用され、したがってスマートカ
ード９の通常の動作の始めに暗号化キーを形成するデー
タ値を受けるためにラッチ２４が使用され、該キーを保
持しかつそれを動作の間にアドレス暗号器１４に供給
し、それによってＮＶＲＡＭ２２が暗号器１４から分離
されかつしたがってスマートカード９の総合的な性能が
アドレス暗号器１４の動作によって妨げられないように
なっている。
【００２２】ＲＯＭ２０に対して上に述べた方法を使用
してＮＶＲＡＭ２２の内容を光学的に検出しようと試み
ても前記暗号化キーを検出可能にはならず、それはフロ
ーティングゲート構成はこれらの方法によって調べるこ
とはできないからであることが理解される。
【００２３】前記ラッチ２４は上に述べたように光学的
に調べることはできるが、それは通常の動作の間にのみ
前記暗号化キーの値を保持するものであり、したがって
もし調べられても、ラッチ２４は前記暗号化キーの値を
含んでいないことになる。したがって、該キーは保安さ
れる。
【００２４】前記アドレス暗号器１４は受信された第１
のアドレス信号を変更するために暗号化キーを使用す
る。一例として、前記暗号化キーは４桁の２進数とする
ことがてき、かつ前記アドレス暗号器は該キーと前記第
１のアドレス信号との加算を行なうようにすることがで
きる。このようにして、暗号器１４はローデコーダ１６
およびコラムデコーダ１８に暗号化された第１のアドレ
ス信号を提供する。
【００２５】前記第１のアドレス信号の暗号化はＲＯＭ
２０内の第１のメモリアドレスの物理的位置がいずれの
明らかな方法においてもその予期される物理的位置に対
応しないことを意味し、したがって暗号化キーの知識な
しには、前記第１のメモリアドレスのロケーションの計
算、およびしたがって前記第１のメモリアドレスの内容
の光学的な決定は不可能である。同じことはＲＯＭ２０
内の全ての他のメモリアドレスについても当てはまる。
【００２６】さらに、デコーダ１６および１８およびア
ドレス暗号器１４の構成の光学的な判定は前記ロケーシ
ョンの知識を与えないが、それは前記暗号化キーが保安
されているからである。
【００２７】このようにして、ＲＯＭ２０に含まれてい
るデータは権限のないかつ詐欺的な光学的検出から保護
される。
【００２８】当業者にはここに説明したものに代わる実
施例が可能であることが理解され、上に述べた装置の構
成を、メモリカートリッジまたは他のデータメモリ装置
のような、スマートカード以外の装置に使用することも
できる。
【００２９】また、ＮＶＲＡＭ２２は、金属／窒化物酸
化物シリコン（ＭＮＯＳ）半導体技術のような、上に述
べたフローティングゲート形トランジスタに代わる技術
によって実施することもできる。
【００３０】さらに、他のデータ記憶媒体のような、前
記ＲＯＭ２０に代わるものを使用することができ、例え
ば消去可能プログラム可能ＲＯＭ（ＥＰＲＯＭ）を使用
することもできる。
【００３１】
【発明の効果】以上のように、本発明によれば、ＩＣカ
ード等の集積回路メモリ内にデータ値を記憶するデータ
記憶装置において、記憶されたデータ内容が権限のない
および詐欺的な検出行為から的確に保護され、銀行口座
情報、個人情報その他のデータが高度に保安される。
【図面の簡単な説明】
【図１】本発明の一実施例に係わるデータ記憶装置の概
略の構成を示すブロック図である。
【符号の説明】
９ スマートカード １０ 入力端子 １２ 出力端子 １４ アドレス暗号器 １６ ローデコーダ １８ コラムデコーダ ２０ ＲＯＭ ２２ ＮＶＲＡＭ ２４ ラッチ

Claims (7)

    【特許請求の範囲】
  1. 【請求項１】 データ記憶装置であって、 データを記憶するための電子的メモリロケーションのア
    レイ、 アドレス発生源に結合されかつ第１のアドレス信号を前
    記アドレス発生源から提供して前記メモリアレイのメモ
    リロケーションをアドレスするよう結合されたアドレス
    入力端子、 データ受信手段に結合されかつ前記アドレス信号に応じ
    て前記メモリアレイからデータ信号を受信するために前
    記メモリアレイに接続されたデータ出力端子であって、
    前記データ信号は前記アドレス信号によってアドレスさ
    れたメモリロケーションに格納されたデータを示すも
    の、そして前記アドレス入力端子と前記アレイとの間に
    結合され前記第１のアドレス信号を暗号化するためのア
    ドレス暗号化手段、 を具備し、前記アドレス暗号化手段は直接的な光学的検
    出から保護される暗号化データを含み、該暗号化データ
    は前記第１のアドレス信号を暗号化するために使用され
    ることを特徴とするデータ記憶装置。
  2. 【請求項２】 前記データメモリのアレイは暗号化され
    た方法で格納されるデータを含むリードオンリメモリで
    あり、該暗号化は前記暗号化データの構成と整合してい
    ることを特徴とする請求項１に記載の装置。
  3. 【請求項３】 前記暗号化データは不揮発性メモリに格
    納されることを特徴とする請求項１または２に記載の装
    置。
  4. 【請求項４】 前記不揮発性メモリはフローティングゲ
    ート構成を有することを特徴とする請求項３に記載の装
    置。
  5. 【請求項５】 前記アドレス暗号化手段は前記不揮発性
    メモリから前記暗号化データを受けるためのラッチを含
    み、それによって前記不揮発性メモリが通常動作の間に
    前記アドレス暗号化手段と独立に動作可能としたことを
    特徴とする請求項３または４に記載の装置。
  6. 【請求項６】 前記装置は半導体集積回路上に製作され
    ることを特徴とする請求項１から請求項５までのいずれ
    か１項に記載の装置。
  7. 【請求項７】 前記請求項１から請求項６までのうちの
    いずれか１項にしたがって構成されたデータ記憶装置を
    具備することを特徴とするスマートカード。
JP6074441A 1993-03-20 1994-03-17 データ記憶装置 Pending JPH076096A (ja)

Applications Claiming Priority (2)

Application Number Priority Date Filing Date Title
GB9305827A GB2276254B (en) 1993-03-20 1993-03-20 Data storage device
GB9305827.9 1993-03-20

Publications (1)

Publication Number Publication Date
JPH076096A true JPH076096A (ja) 1995-01-10

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ID=10732455

Family Applications (1)

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JP6074441A Pending JPH076096A (ja) 1993-03-20 1994-03-17 データ記憶装置

Country Status (8)

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US (1) US5563945A (ja)
EP (1) EP0617383A3 (ja)
JP (1) JPH076096A (ja)
KR (1) KR100330439B1 (ja)
CN (1) CN1038367C (ja)
GB (1) GB2276254B (ja)
SG (1) SG52302A1 (ja)
TW (1) TW331640B (ja)

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