JPH0766658A - フィルタ回路 - Google Patents
フィルタ回路Info
- Publication number
- JPH0766658A JPH0766658A JP23403693A JP23403693A JPH0766658A JP H0766658 A JPH0766658 A JP H0766658A JP 23403693 A JP23403693 A JP 23403693A JP 23403693 A JP23403693 A JP 23403693A JP H0766658 A JPH0766658 A JP H0766658A
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- JP
- Japan
- Prior art keywords
- circuit
- group delay
- filter circuit
- parallel
- filter
- Prior art date
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- Pending
Links
- 239000003990 capacitor Substances 0.000 abstract description 10
- 238000010586 diagram Methods 0.000 description 6
- 230000007423 decrease Effects 0.000 description 3
- 230000000694 effects Effects 0.000 description 1
Landscapes
- Filters And Equalizers (AREA)
Abstract
(57)【要約】
【目的】 簡単な回路で群遅延特性を補正することがで
き、サイズやコストを小さくすることができるフィルタ
回路を得る。 【構成】 フィルタ回路１０は、インダクタ１２とコン
デンサ１４との並列回路１６を含む。複数段の並列回路
１６を、入力端子Ｔｉと出力端子Ｔｏとの間に直列に接
続する。並列回路１６を、コンデンサ１８を介して共通
端子Ｔｃに接続する。並列回路１６は、共振回路として
働く。さらに、並列回路１６に並列に、抵抗２０を接続
する。
き、サイズやコストを小さくすることができるフィルタ
回路を得る。 【構成】 フィルタ回路１０は、インダクタ１２とコン
デンサ１４との並列回路１６を含む。複数段の並列回路
１６を、入力端子Ｔｉと出力端子Ｔｏとの間に直列に接
続する。並列回路１６を、コンデンサ１８を介して共通
端子Ｔｃに接続する。並列回路１６は、共振回路として
働く。さらに、並列回路１６に並列に、抵抗２０を接続
する。
Description
【０００１】
【産業上の利用分野】この発明はフィルタ回路に関し、
特に、複数のＬＣ共振回路を接続したフィルタ回路に関
する。
特に、複数のＬＣ共振回路を接続したフィルタ回路に関
する。
【０００２】
【従来の技術】図７は従来のフィルタ回路の一例を示す
回路図である。フィルタ回路１は、並列に接続されたイ
ンダクタ２とコンデンサ３とを含む。これらのインダク
タ２とコンデンサ３とは共振回路を形成し、複数段の共
振回路が入力端子Ｔｉと出力端子Ｔｏとの間に直列に接
続されている。そして、インダクタ２とコンデンサ３と
の並列回路は、別のコンデンサ４を介して共通端子Ｔｃ
に接続される。
回路図である。フィルタ回路１は、並列に接続されたイ
ンダクタ２とコンデンサ３とを含む。これらのインダク
タ２とコンデンサ３とは共振回路を形成し、複数段の共
振回路が入力端子Ｔｉと出力端子Ｔｏとの間に直列に接
続されている。そして、インダクタ２とコンデンサ３と
の並列回路は、別のコンデンサ４を介して共通端子Ｔｃ
に接続される。
【０００３】このようなフィルタ回路１では、特にロー
パスフィルタの場合、図８に示すように、カットオフ周
波数付近において、群遅延特性が山型のピークを有す
る。テレビなどの映像機器に用いるフィルタの場合、周
波数によって遅延時間が異なると、画質が低下する。そ
のため、フィルタの遅延時間を平坦にする必要がある。
このような場合、図９に示すような群遅延補正回路が用
いられる。群遅延補正回路４はトランス５を含み、トラ
ンス５の入出力間にコンデンサ６が接続されている。ま
た、トランス５と共通端子との間には、インダクタ７と
コンデンサ８の直列回路が接続される。
パスフィルタの場合、図８に示すように、カットオフ周
波数付近において、群遅延特性が山型のピークを有す
る。テレビなどの映像機器に用いるフィルタの場合、周
波数によって遅延時間が異なると、画質が低下する。そ
のため、フィルタの遅延時間を平坦にする必要がある。
このような場合、図９に示すような群遅延補正回路が用
いられる。群遅延補正回路４はトランス５を含み、トラ
ンス５の入出力間にコンデンサ６が接続されている。ま
た、トランス５と共通端子との間には、インダクタ７と
コンデンサ８の直列回路が接続される。
【０００４】このような群遅延補正回路４では、図１０
および図１１に示すように、各素子を適当に選ぶことに
よって、群遅延特性のピークの位置を変えることができ
る。したがって、図１２に示すように、フィルタ回路１
に複数段の群遅延補正回路４を組み合わせることによっ
て、群遅延特性のばらつきを小さくすることができる。
および図１１に示すように、各素子を適当に選ぶことに
よって、群遅延特性のピークの位置を変えることができ
る。したがって、図１２に示すように、フィルタ回路１
に複数段の群遅延補正回路４を組み合わせることによっ
て、群遅延特性のばらつきを小さくすることができる。
【０００５】
【発明が解決しようとする課題】しかしながら、このよ
うな群遅延補正回路を使用すると、その段数が多くなる
ほど回路が大きくなり、サイズ，コストともに大きくな
ってしまう。
うな群遅延補正回路を使用すると、その段数が多くなる
ほど回路が大きくなり、サイズ，コストともに大きくな
ってしまう。
【０００６】それゆえに、この発明の主たる目的は、簡
単な回路で群遅延特性を補正することができ、サイズや
コストを小さくすることができるフィルタ回路を提供す
ることである。
単な回路で群遅延特性を補正することができ、サイズや
コストを小さくすることができるフィルタ回路を提供す
ることである。
【０００７】
【課題を解決するための手段】この発明は、複数のＬＣ
共振回路を接続したフィルタ回路において、複数のＬＣ
共振回路の少なくとも１つに抵抗を挿入することによっ
て遅延特性のピークを小さくした、フィルタ回路であ
る。
共振回路を接続したフィルタ回路において、複数のＬＣ
共振回路の少なくとも１つに抵抗を挿入することによっ
て遅延特性のピークを小さくした、フィルタ回路であ
る。
【０００８】
【作用】ＬＣ共振回路に抵抗を挿入することによって、
減衰特性のポールのＱが下がり、群遅延特性のピークが
小さくなる。
減衰特性のポールのＱが下がり、群遅延特性のピークが
小さくなる。
【０００９】
【発明の効果】この発明によれば、フィルタ回路の群遅
延特性のピークが小さくなるため、群遅延補正回路の段
数を少なくしても、遅延時間の小さい部分を引き上げて
フィルタ回路のピークに合わせることができる。そのた
め、簡単な回路で群遅延特性のばらつきを小さくするこ
とができる。したがって、簡単な回路で優れたフィルタ
特性を得ることができ、回路の小型化およびコストダウ
ンを図ることができる。
延特性のピークが小さくなるため、群遅延補正回路の段
数を少なくしても、遅延時間の小さい部分を引き上げて
フィルタ回路のピークに合わせることができる。そのた
め、簡単な回路で群遅延特性のばらつきを小さくするこ
とができる。したがって、簡単な回路で優れたフィルタ
特性を得ることができ、回路の小型化およびコストダウ
ンを図ることができる。
【００１０】この発明の上述の目的，その他の目的，特
徴および利点は、図面を参照して行う以下の実施例の詳
細な説明から一層明らかとなろう。
徴および利点は、図面を参照して行う以下の実施例の詳
細な説明から一層明らかとなろう。
【００１１】
【実施例】図１はこの発明の一実施例を示す回路図であ
る。フィルタ回路１０は、インダクタ１２とコンデンサ
１４との並列回路１６を含む。このような並列回路１６
が、入力端子Ｔｉと出力端子Ｔｏとの間に複数段直列に
接続される。そして、この並列回路１６と共通端子Ｔｃ
との間に別のコンデンサ１８が接続される。さらに、並
列回路１６に並列に、抵抗２０が接続される。
る。フィルタ回路１０は、インダクタ１２とコンデンサ
１４との並列回路１６を含む。このような並列回路１６
が、入力端子Ｔｉと出力端子Ｔｏとの間に複数段直列に
接続される。そして、この並列回路１６と共通端子Ｔｃ
との間に別のコンデンサ１８が接続される。さらに、並
列回路１６に並列に、抵抗２０が接続される。
【００１２】このフィルタ回路１０では、並列回路１６
が共振回路として働き、このような共振回路が複数段接
続されることによって、フィルタ特性が得られる。この
フィルタ回路１０では、図２に示すように、たとえばロ
ーパスフィルタとして働く。そして、並列回路１６に抵
抗２０を接続することによって、図２の点線に示すよう
に、減衰特性のポールのＱを下げることができる。
が共振回路として働き、このような共振回路が複数段接
続されることによって、フィルタ特性が得られる。この
フィルタ回路１０では、図２に示すように、たとえばロ
ーパスフィルタとして働く。そして、並列回路１６に抵
抗２０を接続することによって、図２の点線に示すよう
に、減衰特性のポールのＱを下げることができる。
【００１３】ローパスフィルタでは、図３に示すよう
に、カットオフ周波数付近に群遅延特性のピークが存在
する。ところが、図３の点線に示すように、並列回路１
６に抵抗２０を接続することにより、群遅延特性のピー
クを下げることができる。従来のフィルタ回路では、図
４に示すように、群遅延特性のピークが大きいため、群
遅延補正回路の段数を多くして、遅延時間の小さい部分
を引き上げる必要があった。しかしながら、この発明の
フィルタ回路１０では、群遅延特性のピークが小さくな
るため、図５に示すように、少ない段数の群遅延補正回
路を用いて、遅延時間の小さい部分を引き上げてフィル
タ回路１０のピークに合わせることができる。したがっ
て、簡単な回路でフィルタ回路１０の群遅延特性のばら
つきを少なくすることができる。また、群遅延補正回路
を削減できるため、回路の小型化を図ることができる。
に、カットオフ周波数付近に群遅延特性のピークが存在
する。ところが、図３の点線に示すように、並列回路１
６に抵抗２０を接続することにより、群遅延特性のピー
クを下げることができる。従来のフィルタ回路では、図
４に示すように、群遅延特性のピークが大きいため、群
遅延補正回路の段数を多くして、遅延時間の小さい部分
を引き上げる必要があった。しかしながら、この発明の
フィルタ回路１０では、群遅延特性のピークが小さくな
るため、図５に示すように、少ない段数の群遅延補正回
路を用いて、遅延時間の小さい部分を引き上げてフィル
タ回路１０のピークに合わせることができる。したがっ
て、簡単な回路でフィルタ回路１０の群遅延特性のばら
つきを少なくすることができる。また、群遅延補正回路
を削減できるため、回路の小型化を図ることができる。
【００１４】なお、上述の実施例では、全ての並列回路
１６に抵抗２０を接続しているが、図６に示すように、
１つの並列回路１６のみに抵抗２０を接続してもよい。
この場合、図２のカットオフ周波数に近いポールＡのＱ
が下がるように、並列回路１６に抵抗２０を接続すれ
ば、大きい効果を得ることができる。
１６に抵抗２０を接続しているが、図６に示すように、
１つの並列回路１６のみに抵抗２０を接続してもよい。
この場合、図２のカットオフ周波数に近いポールＡのＱ
が下がるように、並列回路１６に抵抗２０を接続すれ
ば、大きい効果を得ることができる。
【００１５】この発明によれば、少ない段数の群遅延補
正回路を用いて、フィルタ回路の群遅延特性のばらつき
を小さくすることができるため、従来に比べて回路を削
減することができる。つまり、この発明のフィルタ回路
１０を用いれば、群遅延補正回路を１段以上削減でき、
高品位テレビ用フィルタの場合、２０％以上のコストダ
ウンと小型化を実現することができる。
正回路を用いて、フィルタ回路の群遅延特性のばらつき
を小さくすることができるため、従来に比べて回路を削
減することができる。つまり、この発明のフィルタ回路
１０を用いれば、群遅延補正回路を１段以上削減でき、
高品位テレビ用フィルタの場合、２０％以上のコストダ
ウンと小型化を実現することができる。
【図１】この発明の一実施例を示す回路図である。
【図２】図１に示すフィルタ回路の減衰量の周波数特性
を示すグラフである。
を示すグラフである。
【図３】図１に示すフィルタ回路の遅延時間の周波数特
性を示すグラフである。
性を示すグラフである。
【図４】従来のフィルタ回路と群遅延補正回路とを組み
合わせたときの遅延時間の周波数特性を示すグラフであ
る。
合わせたときの遅延時間の周波数特性を示すグラフであ
る。
【図５】この発明のフィルタ回路と群遅延補正回路とを
組み合わせたときの遅延時間の周波数特性を示すグラフ
である。
組み合わせたときの遅延時間の周波数特性を示すグラフ
である。
【図６】この発明の他の実施例を示す回路図である。
【図７】従来のフィルタ回路の一例を示す回路図であ
る。
る。
【図８】図７に示す従来のフィルタ回路の遅延時間の周
波数特性を示すグラフである。
波数特性を示すグラフである。
【図９】群遅延補正回路の一例を示す回路図である。
【図１０】群遅延補正回路の遅延時間の周波数特性を示
すグラフである。
すグラフである。
【図１１】別の群遅延補正回路の遅延時間の周波数特性
を示すグラフである。
を示すグラフである。
【図１２】フィルタ回路と群遅延補正回路とを組み合わ
せたときの遅延時間の周波数特性を示すグラフである。
せたときの遅延時間の周波数特性を示すグラフである。
１０ フィルタ回路 １２ インダクタンス １４ キャパシタンス １６ 並列回路 １８ キャパシタンス ２０ 抵抗
Claims (1)
- 【請求項１】 複数のＬＣ共振回路を接続したフィルタ
回路において、 前記複数のＬＣ共振回路の少なくとも１つに抵抗を挿入
することによって遅延特性のピークを小さくした、フィ
ルタ回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP23403693A JPH0766658A (ja) | 1993-08-25 | 1993-08-25 | フィルタ回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP23403693A JPH0766658A (ja) | 1993-08-25 | 1993-08-25 | フィルタ回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0766658A true JPH0766658A (ja) | 1995-03-10 |
Family
ID=16964562
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP23403693A Pending JPH0766658A (ja) | 1993-08-25 | 1993-08-25 | フィルタ回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0766658A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2003519950A (ja) * | 1999-12-29 | 2003-06-24 | コーニンクレッカ フィリップス エレクトロニクス エヌ ヴィ | 位相フィルタリングによる増幅器のｃｔｂ低減 |
-
1993
- 1993-08-25 JP JP23403693A patent/JPH0766658A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2003519950A (ja) * | 1999-12-29 | 2003-06-24 | コーニンクレッカ フィリップス エレクトロニクス エヌ ヴィ | 位相フィルタリングによる増幅器のｃｔｂ低減 |
| JP4922522B2 (ja) * | 1999-12-29 | 2012-04-25 | ブロードバンド ロイヤルティ コーポレイション | 位相フィルタリングによる増幅器のｃｔｂ低減 |
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