JPH076950A - 電子、電光および光学的な構成要素に対する構造部品を作製する方法 - Google Patents
電子、電光および光学的な構成要素に対する構造部品を作製する方法Info
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- JPH076950A JPH076950A JP3233480A JP23348091A JPH076950A JP H076950 A JPH076950 A JP H076950A JP 3233480 A JP3233480 A JP 3233480A JP 23348091 A JP23348091 A JP 23348091A JP H076950 A JPH076950 A JP H076950A
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Landscapes
- Recrystallisation Techniques (AREA)
- Crystals, And After-Treatments Of Crystals (AREA)
Abstract
(57)【要約】
【目的】 基板とこの基板の上に付着させた結晶被膜か
らなる、電子、電光および光学構造素子用の構造部品を
作製する方法を提供する。 【構成】 埋め込んだ非晶質層とその上に作製された単
結晶の層を有する結晶性の基板を使用し、前記単結晶層
が混合結晶ないしは化合物に変換される。これ等のもの
は所望の結晶性被膜に一致するか、あるいは格子構造の
点で元の結晶性被膜に近い所望の結晶被膜になる。
らなる、電子、電光および光学構造素子用の構造部品を
作製する方法を提供する。 【構成】 埋め込んだ非晶質層とその上に作製された単
結晶の層を有する結晶性の基板を使用し、前記単結晶層
が混合結晶ないしは化合物に変換される。これ等のもの
は所望の結晶性被膜に一致するか、あるいは格子構造の
点で元の結晶性被膜に近い所望の結晶被膜になる。
Description
【0001】
【産業上の利用分野】この発明は、基板と、この基板の
上に付着させた結晶性被膜から成る、電子、電光および
光学的な構成要素に対する構造部品を作製する方法に関
する。
上に付着させた結晶性被膜から成る、電子、電光および
光学的な構成要素に対する構造部品を作製する方法に関
する。
【0002】
【従来の技術】単結晶の被膜を作製するためには、多く
の場合、利用できる基板材料が大きく制限されている
か、あるいは被膜の品質が低下する。基板と付着物質間
の結晶構造が異なり、格子定数が異なる(格子の不一
致)ため、例えばシリコンウェファー上でのエピタキシ
ャル成長が非常に特別な場合しか行われない。格子定数
が合っていない場合に、付着を行うと、構成要素にたい
てい必要となる厚さの被膜の場合、格子欠陥である転位
が全面にわたって生じる結果になる。これ等の転位の大
多数は新たに成長した被膜を通過して続くので、被膜材
料の電気的な特性、および特に光学特性をひどく悪化さ
せる。例えば、多孔質 Si の上に付着させるような、他
の方法は今まで殆ど行われていない。
の場合、利用できる基板材料が大きく制限されている
か、あるいは被膜の品質が低下する。基板と付着物質間
の結晶構造が異なり、格子定数が異なる(格子の不一
致)ため、例えばシリコンウェファー上でのエピタキシ
ャル成長が非常に特別な場合しか行われない。格子定数
が合っていない場合に、付着を行うと、構成要素にたい
てい必要となる厚さの被膜の場合、格子欠陥である転位
が全面にわたって生じる結果になる。これ等の転位の大
多数は新たに成長した被膜を通過して続くので、被膜材
料の電気的な特性、および特に光学特性をひどく悪化さ
せる。例えば、多孔質 Si の上に付着させるような、他
の方法は今まで殆ど行われていない。
【0003】
【発明が解決しようとする課題】この発明の課題は、上
に述べた難点を大幅に防止する冒頭に述べた様式の方法
を提供することにある。
に述べた難点を大幅に防止する冒頭に述べた様式の方法
を提供することにある。
【0004】
【課題を解決するための手段】上記の課題は、この発明
により、基板と、この基板の上に付着させた結晶性被膜
から成る、電子、電光および光学的な構成要素に対する
構造部品を作製する方法の場合、埋め込んだ非晶質層と
その上に作製した単結晶層とを有する結晶性基板を使用
し、前記単結晶層が、所望の結晶性被膜に一致するか、
あるいは格子構造が元の結晶性被膜よりも所望の結晶被
膜に近い混合結晶あるいは化合物に変換されることによ
って解決されている。
により、基板と、この基板の上に付着させた結晶性被膜
から成る、電子、電光および光学的な構成要素に対する
構造部品を作製する方法の場合、埋め込んだ非晶質層と
その上に作製した単結晶層とを有する結晶性基板を使用
し、前記単結晶層が、所望の結晶性被膜に一致するか、
あるいは格子構造が元の結晶性被膜よりも所望の結晶被
膜に近い混合結晶あるいは化合物に変換されることによ
って解決されている。
【0005】この発明による他の有利な構成は、特許請
求の範囲の従属請求項に記載されている。
求の範囲の従属請求項に記載されている。
【0006】
【作用】この発明により単結晶性の表面層を合金結晶
(混合結晶)あるいは化合物に変換することによって、
一致していない結晶格子が非晶質の被膜で分離され、転
位網の形成が防止されている。何故なら、結晶と非晶質
性の界面では、一致しない結晶格子とは逆に、整合応力
が生じないからである。このように作製された被膜は、
既に所望の製品、所望の被膜であるか、所望の被膜の他
の層を成長させるために適したベース(緩衝層)を形成
する。即ち、この被膜は所望の被膜の他の単結晶性成長
のための種被膜である。
(混合結晶)あるいは化合物に変換することによって、
一致していない結晶格子が非晶質の被膜で分離され、転
位網の形成が防止されている。何故なら、結晶と非晶質
性の界面では、一致しない結晶格子とは逆に、整合応力
が生じないからである。このように作製された被膜は、
既に所望の製品、所望の被膜であるか、所望の被膜の他
の層を成長させるために適したベース(緩衝層)を形成
する。即ち、この被膜は所望の被膜の他の単結晶性成長
のための種被膜である。
【0007】単結晶性の表面層を変換することは種々の
方法で行える。即ち、例えば混合結晶あるいは化合物を
形成するのに必要な成分が単結晶層に添加され、同時
に、あるいはその後に、熱拡散および/または化学反応
で、結晶性被膜を均質化するか、あるいは混合結晶ない
しは化合物を形成するため、被膜の昇温が行われる。
方法で行える。即ち、例えば混合結晶あるいは化合物を
形成するのに必要な成分が単結晶層に添加され、同時
に、あるいはその後に、熱拡散および/または化学反応
で、結晶性被膜を均質化するか、あるいは混合結晶ない
しは化合物を形成するため、被膜の昇温が行われる。
【0008】他の方法では、混合結晶あるいは化学的な
化合物を形成するのに必要な成分をイオン注入で単結晶
層に入れ、この場合、イオン注入に焼鈍処理が後で施さ
れている。
化合物を形成するのに必要な成分をイオン注入で単結晶
層に入れ、この場合、イオン注入に焼鈍処理が後で施さ
れている。
【0009】形成された混合結晶(合金結晶)では、成
分の濃度が成長方向に向けて変化する。その場合、変換
された層の理想的に格子定数があっていない系では、格
子定数の勾配が成長方向に向けて生じる。
分の濃度が成長方向に向けて変化する。その場合、変換
された層の理想的に格子定数があっていない系では、格
子定数の勾配が成長方向に向けて生じる。
【0010】単結晶層を変換する他の方法では、混合結
晶ないしは化合物を形成するために必要な成分を単結晶
層の上にエピタキシャル成長によって付着させ、成分を
エピタキシャル付着させる間、あるいはその後に焼鈍処
理を行う。
晶ないしは化合物を形成するために必要な成分を単結晶
層の上にエピタキシャル成長によって付着させ、成分を
エピタキシャル付着させる間、あるいはその後に焼鈍処
理を行う。
【0011】明らかなように、変換された被膜の格子定
数は基板材料の格子定数とは異なる。その場合、通常の
方法で求めるより高い結晶品質が得られる。このため、
上記被膜はより高い温度安定性を保有する。
数は基板材料の格子定数とは異なる。その場合、通常の
方法で求めるより高い結晶品質が得られる。このため、
上記被膜はより高い温度安定性を保有する。
【0012】電気絶縁され、埋め込んだ非晶質被膜(例
えば、SIMOXウェファーのような被膜)を付けた基
板を使用することによって、新しいフィルムが更に基板
に対して誘電的に絶縁される。従って、この発明による
構造部品は、超小型電子での応用、例えば高周波状況へ
のような応用に対して固有なSIMOX構造体(絶縁電
子部品)の利点を有する。
えば、SIMOXウェファーのような被膜)を付けた基
板を使用することによって、新しいフィルムが更に基板
に対して誘電的に絶縁される。従って、この発明による
構造部品は、超小型電子での応用、例えば高周波状況へ
のような応用に対して固有なSIMOX構造体(絶縁電
子部品)の利点を有する。
【0013】
【実施例】この発明の特別な実施例を、以下に図面と反
応曲線に基づきより詳しく説明する。
応曲線に基づきより詳しく説明する。
【0014】図1から理解できるように、従来の方法で
は、基板の上に単結晶の表面層、つまり所望のフィルム
を、転位網が生じないように、付着させことは成功して
いない。
は、基板の上に単結晶の表面層、つまり所望のフィルム
を、転位網が生じないように、付着させことは成功して
いない。
【0015】図2に示す構造部品では、所望のフィルム
とは異なる格子構造を有する単結晶基板が、非晶質被膜
によって単結晶の表面層(フィルム)から分離されてい
る。この場合、転位網は生じない。
とは異なる格子構造を有する単結晶基板が、非晶質被膜
によって単結晶の表面層(フィルム)から分離されてい
る。この場合、転位網は生じない。
【0016】具体例 1 SiO2の絶縁層上の単結晶 Si-Ge混合結晶 基板としては、 SIMOXウェファー(SIMOX =separatio
n by implantation ofoxygen) が使用された。この市販
の基板は、埋め込んだ非晶質酸化シリコン層と単結晶の
Si 表面層とを付けたシリコンウェファーで構成されて
いる。
n by implantation ofoxygen) が使用された。この市販
の基板は、埋め込んだ非晶質酸化シリコン層と単結晶の
Si 表面層とを付けたシリコンウェファーで構成されて
いる。
【0017】Si 表面層を、先ずプラズマエッチングで
約 20 nmの厚さにエッチングした。このように処理した
基板は、完全で清浄な表面を得るため、エピタキシアル
成長装置中でモレキュラービームエピタキシー(MBE)に
よって( Si のエピタキシー成長で普通のように)純化
された。次いで、 450℃で割合が 80 : 20 の Si とGe
を付着させた。その後の焼き戻し(1100℃, 30分) に
よって、 Si 成長層と付着させた Si と Ge の被膜を完
全に均一化させた。
約 20 nmの厚さにエッチングした。このように処理した
基板は、完全で清浄な表面を得るため、エピタキシアル
成長装置中でモレキュラービームエピタキシー(MBE)に
よって( Si のエピタキシー成長で普通のように)純化
された。次いで、 450℃で割合が 80 : 20 の Si とGe
を付着させた。その後の焼き戻し(1100℃, 30分) に
よって、 Si 成長層と付着させた Si と Ge の被膜を完
全に均一化させた。
【0018】このように作製された Si と Ge の層は、
直接使用するか、またはヘテロ組織や超格子の他のエピ
タキシャル成長に対する中間層として使用できる。
直接使用するか、またはヘテロ組織や超格子の他のエピ
タキシャル成長に対する中間層として使用できる。
【0019】具体例 2 酸化シリコン上の単結晶珪化コバルト 出発材料は、埋め込んだ SiO2 被膜を有するシリコンウ
ェファー、つまりSIMOX ウェファーであった。
ェファー、つまりSIMOX ウェファーであった。
【0020】単結晶の Si 表面層を先ず化学的に洗浄し
て、プラズマエッチングによって所望の厚さにエッチン
グした。次いで、蒸着装置中で超高真空条件下で Co を
蒸発させた。珪化物の形成は、この装置中で熱処理によ
り、その場状態で行われた。
て、プラズマエッチングによって所望の厚さにエッチン
グした。次いで、蒸着装置中で超高真空条件下で Co を
蒸発させた。珪化物の形成は、この装置中で熱処理によ
り、その場状態で行われた。
【0021】得られる層の厚さは選択した系に依存して
いる。 CoSi2の場合、 28 nmの厚さの Co 被膜を付けた
100 nm 厚さの Si 出発材料は固体エピタキシャル成長
の経過後に 100 nm のシリサイド被膜厚さになった。 C
oSi2被膜を完全に反応させるのに必要な温度と焼き戻し
時間は約 600℃と 30 分であった。
いる。 CoSi2の場合、 28 nmの厚さの Co 被膜を付けた
100 nm 厚さの Si 出発材料は固体エピタキシャル成長
の経過後に 100 nm のシリサイド被膜厚さになった。 C
oSi2被膜を完全に反応させるのに必要な温度と焼き戻し
時間は約 600℃と 30 分であった。
【0022】このように作製された構造部品は、電気絶
縁 SiO2 被膜に関して電気的にも結晶的にも高品質の単
結晶シリサイド被膜と言える。
縁 SiO2 被膜に関して電気的にも結晶的にも高品質の単
結晶シリサイド被膜と言える。
【0023】
【発明の効果】この発明による方法によって作製された
結晶性材料の基板上の付着結晶には、格子歪が生じない
ため、作製された構造部品は電子的にも、電光的にも、
更に光学的にも高品位の構造素子となる。
結晶性材料の基板上の付着結晶には、格子歪が生じない
ため、作製された構造部品は電子的にも、電光的にも、
更に光学的にも高品位の構造素子となる。
【図1】格子間隔の合っていない基板上にヘテロエピタ
キシーによる従来の方法で作製した構造部品の模式断面
図である。
キシーによる従来の方法で作製した構造部品の模式断面
図である。
【図2】この発明による方法で作製した対応する構造部
品の模式断面図である。
品の模式断面図である。
───────────────────────────────────────────────────── フロントページの続き (72)発明者 ライネル・ブッツ ドイツ連邦共和国、リンニツヒ−テッツ、 バッハドレシユ、28
Claims (6)
- 【請求項1】 基板と、この基板の上に付着させた結晶
性被膜から成る、電子、電光および光学的な構成要素に
対する構造部品を作製する方法において、埋め込んだ非
晶質層とその上に作製した単結晶層とを有する結晶性基
板を使用し、前記単結晶層が、所望の結晶性被膜に一致
するか、あるいは格子構造が元の結晶性被膜よりも所望
の結晶被膜に近い混合結晶あるいは化合物に変換される
ことを特徴とする方法。 - 【請求項2】 混合結晶あるいは化合物を形成するのに
必要な成分を単結晶層の上に付着させ、熱拡散および/
または化学反応で結晶性層の均質化、あるいは混合結晶
ないし化合物の形成を行うため、同時にあるいは引き続
いて被膜の昇温が行われることを特徴とする請求項1に
記載の方法。 - 【請求項3】 混合結晶あるいは化合物を形成するのに
必要な成分は、イオン注入によって単結晶層に導入され
ることを特徴とする請求項1に記載の方法。 - 【請求項4】 イオン注入の後には、焼鈍処理が行われ
ることを特徴とする請求項3に記載の方法。 - 【請求項5】 混合結晶あるいは化合物を形成するのに
必要な成分を単結晶の層上にエピタキシャル成長によっ
て付着させ、これ等の成分をエピタキシャル成長で付着
させている間、あるいはその後に焼鈍処理が行われるこ
とを特徴とする請求項1に記載の方法。 - 【請求項6】 単結晶の層の厚さは予め変換方法に合わ
せてあることを特徴とする請求項1〜5の何れか1項に
記載の方法。
Applications Claiming Priority (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| DE4029060A DE4029060C2 (de) | 1990-09-13 | 1990-09-13 | Verfahren zur Herstellung von Bauteilen für elektronische, elektrooptische und optische Bauelemente |
| DE40290603 | 1990-09-13 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH076950A true JPH076950A (ja) | 1995-01-10 |
Family
ID=6414180
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3233480A Pending JPH076950A (ja) | 1990-09-13 | 1991-09-12 | 電子、電光および光学的な構成要素に対する構造部品を作製する方法 |
Country Status (5)
| Country | Link |
|---|---|
| US (1) | US5735949A (ja) |
| EP (1) | EP0475378B1 (ja) |
| JP (1) | JPH076950A (ja) |
| CA (1) | CA2051154C (ja) |
| DE (1) | DE4029060C2 (ja) |
Families Citing this family (56)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6749687B1 (en) * | 1998-01-09 | 2004-06-15 | Asm America, Inc. | In situ growth of oxide and silicon layers |
| DE19802977A1 (de) * | 1998-01-27 | 1999-07-29 | Forschungszentrum Juelich Gmbh | Verfahren zur Herstellung einer einkristallinen Schicht auf einem nicht gitterangepaßten Substrat, sowie eine oder mehrere solcher Schichten enthaltendes Bauelement |
| US6338756B2 (en) | 1998-06-30 | 2002-01-15 | Seh America, Inc. | In-situ post epitaxial treatment process |
| US6562128B1 (en) | 2001-11-28 | 2003-05-13 | Seh America, Inc. | In-situ post epitaxial treatment process |
| US6184112B1 (en) * | 1998-12-02 | 2001-02-06 | Advanced Micro Devices, Inc. | Method of forming a MOSFET transistor with a shallow abrupt retrograde dopant profile |
| JP2001050874A (ja) * | 1999-08-04 | 2001-02-23 | Mitsubishi Electric Corp | 半導体基板の検査方法 |
| US6392257B1 (en) | 2000-02-10 | 2002-05-21 | Motorola Inc. | Semiconductor structure, semiconductor device, communicating device, integrated circuit, and process for fabricating the same |
| US6693033B2 (en) | 2000-02-10 | 2004-02-17 | Motorola, Inc. | Method of removing an amorphous oxide from a monocrystalline surface |
| KR20030011083A (ko) | 2000-05-31 | 2003-02-06 | 모토로라 인코포레이티드 | 반도체 디바이스 및 이를 제조하기 위한 방법 |
| US6477285B1 (en) | 2000-06-30 | 2002-11-05 | Motorola, Inc. | Integrated circuits with optical signal propagation |
| US6410941B1 (en) | 2000-06-30 | 2002-06-25 | Motorola, Inc. | Reconfigurable systems using hybrid integrated circuits with optical ports |
| US6501973B1 (en) | 2000-06-30 | 2002-12-31 | Motorola, Inc. | Apparatus and method for measuring selected physical condition of an animate subject |
| US6427066B1 (en) | 2000-06-30 | 2002-07-30 | Motorola, Inc. | Apparatus and method for effecting communications among a plurality of remote stations |
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| AU2001277001A1 (en) | 2000-07-24 | 2002-02-05 | Motorola, Inc. | Heterojunction tunneling diodes and process for fabricating same |
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| WO2002082551A1 (en) | 2001-04-02 | 2002-10-17 | Motorola, Inc. | A semiconductor structure exhibiting reduced leakage current |
| US6709989B2 (en) | 2001-06-21 | 2004-03-23 | Motorola, Inc. | Method for fabricating a semiconductor structure including a metal oxide interface with silicon |
| US6992321B2 (en) | 2001-07-13 | 2006-01-31 | Motorola, Inc. | Structure and method for fabricating semiconductor structures and devices utilizing piezoelectric materials |
| US6646293B2 (en) | 2001-07-18 | 2003-11-11 | Motorola, Inc. | Structure for fabricating high electron mobility transistors utilizing the formation of complaint substrates |
| US6693298B2 (en) | 2001-07-20 | 2004-02-17 | Motorola, Inc. | Structure and method for fabricating epitaxial semiconductor on insulator (SOI) structures and devices utilizing the formation of a compliant substrate for materials used to form same |
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| US20030016567A1 (en) * | 2001-07-23 | 2003-01-23 | Motorola, Inc. | Apparatus including a memory system that utilizes independently accessible arrays for transaction based on processing |
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-
1990
- 1990-09-13 DE DE4029060A patent/DE4029060C2/de not_active Expired - Fee Related
-
1991
- 1991-09-11 CA CA002051154A patent/CA2051154C/en not_active Expired - Fee Related
- 1991-09-11 EP EP91115340A patent/EP0475378B1/de not_active Expired - Lifetime
- 1991-09-12 JP JP3233480A patent/JPH076950A/ja active Pending
- 1991-09-13 US US07/759,571 patent/US5735949A/en not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| EP0475378B1 (de) | 1998-01-07 |
| US5735949A (en) | 1998-04-07 |
| DE4029060C2 (de) | 1994-01-13 |
| DE4029060A1 (de) | 1992-03-19 |
| EP0475378A1 (de) | 1992-03-18 |
| CA2051154A1 (en) | 1992-03-14 |
| CA2051154C (en) | 2000-12-12 |
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|---|---|---|---|
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