JPH0796321B2 - 出力装置 - Google Patents
出力装置Info
- Publication number
- JPH0796321B2 JPH0796321B2 JP61086974A JP8697486A JPH0796321B2 JP H0796321 B2 JPH0796321 B2 JP H0796321B2 JP 61086974 A JP61086974 A JP 61086974A JP 8697486 A JP8697486 A JP 8697486A JP H0796321 B2 JPH0796321 B2 JP H0796321B2
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- Japan
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-
- B—PERFORMING OPERATIONS; TRANSPORTING
- B41—PRINTING; LINING MACHINES; TYPEWRITERS; STAMPS
- B41J—TYPEWRITERS; SELECTIVE PRINTING MECHANISMS, i.e. MECHANISMS PRINTING OTHERWISE THAN FROM A FORME; CORRECTION OF TYPOGRAPHICAL ERRORS
- B41J5/00—Devices or arrangements for controlling character selection
- B41J5/30—Character or syllable selection controlled by recorded information
- B41J5/44—Character or syllable selection controlled by recorded information characterised by storage of recorded information
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- Accessory Devices And Overall Control Thereof (AREA)
- Record Information Processing For Printing (AREA)
Description
【発明の詳細な説明】 ［産業上の利用分野］ 本発明は、着脱可能な外部記憶手段に記憶されている情
報を用いて、外部から入力される文書情報から出力情報
を生成し、出力する出力装置に関するものである。
報を用いて、外部から入力される文書情報から出力情報
を生成し、出力する出力装置に関するものである。
［従来の技術］ 従来のこの種装置として、着脱自在な外部記憶手段とし
てROMカートリッジを具え、そのROMカートリッジの交換
により文字フォントや記録制御方式の切換を可能とした
ものがある。
てROMカートリッジを具え、そのROMカートリッジの交換
により文字フォントや記録制御方式の切換を可能とした
ものがある。
一方、記録媒体に記録を行う記録手段としては、ワイヤ
ドットヘッドを有するもの、サーマルヘッドを有するも
の、インクジェットヘッドを有するもの等、種々のもの
が存在する。
ドットヘッドを有するもの、サーマルヘッドを有するも
の、インクジェットヘッドを有するもの等、種々のもの
が存在する。
［発明が解決しようとする問題点］ しかしながら、このような装置においては、ROMカート
リッジ等外部記憶手段は一般に装置の制御系の各部を連
結するバスラインに接点を介して直結されるので、その
着脱時において生じるチャタリング等のために装置の制
御部が誤動作をしたり、あるいはそのために記録ヘッド
が破壊されてしまうことがある。
リッジ等外部記憶手段は一般に装置の制御系の各部を連
結するバスラインに接点を介して直結されるので、その
着脱時において生じるチャタリング等のために装置の制
御部が誤動作をしたり、あるいはそのために記録ヘッド
が破壊されてしまうことがある。
例えば、インクを吐出させるためのエネルギ作用部に電
気熱変換素子（発熱素子）を有するインクジェットヘッ
ドを記録手段に具えた装置において、記録時にはヘッド
の発熱素子には平均７μsec等所定時間通電されるが、
この通電時間が平均の２倍以上になると素子が熱破壊さ
れる可能性が非常に高い。ところがROMカートリッジは
バスラインに直結されるために、その着脱時にはチャタ
リング等の影響がバスラインを介してMPU等を有する制
御部に波及し、MPUが誤動作して発熱素子には平均通電
時間以上の通電が起り得る。したがって、ROMカートリ
ッジの着脱によりヘッド内の発熱素子が熱破壊される危
険性がある。
気熱変換素子（発熱素子）を有するインクジェットヘッ
ドを記録手段に具えた装置において、記録時にはヘッド
の発熱素子には平均７μsec等所定時間通電されるが、
この通電時間が平均の２倍以上になると素子が熱破壊さ
れる可能性が非常に高い。ところがROMカートリッジは
バスラインに直結されるために、その着脱時にはチャタ
リング等の影響がバスラインを介してMPU等を有する制
御部に波及し、MPUが誤動作して発熱素子には平均通電
時間以上の通電が起り得る。したがって、ROMカートリ
ッジの着脱によりヘッド内の発熱素子が熱破壊される危
険性がある。
［問題点を解決するための手段］ 本発明は、上述の問題点を解決することを目的としてな
されたものであり、着脱可能な外部記憶手段に記憶され
ている情報を用いて、外部から入力される入力情報から
出力情報を生成し出力する出力装置であって、前記出力
装置を制御する制御手段と、前記外部記憶手段を前記出
力装置に装着した状態での前記出力装置側の端子の電位
レベルと前記外部記憶手段を前記出力装置から離脱した
状態での前記出力装置側の端子の電位レベルに基づいて
外部記憶手段の着脱を検出する検出手段と、前記検出手
段で前記外部記憶手段が前記出力装置に装着されたこと
を検出した場合の前記制御手段へのリセット解除信号お
よび前記検出手段で前記外部記憶手段が前記出力装置か
ら離脱されたことを検出した場合の前記制御手段へのリ
セット信号を、それぞれ前記装着時または離脱時から所
定時間経過後に発生する発生手段を有し、前記外部記憶
手段の装着時における前記所定時間を当該装着時点から
バスライン上の信号状態が安定するまでの時間とし、前
記外部記憶手段の離脱時における前記所定時間を前記制
御手段の制御対象に応じて定められる所定時間よりも短
いものとすることを特徴とする。
されたものであり、着脱可能な外部記憶手段に記憶され
ている情報を用いて、外部から入力される入力情報から
出力情報を生成し出力する出力装置であって、前記出力
装置を制御する制御手段と、前記外部記憶手段を前記出
力装置に装着した状態での前記出力装置側の端子の電位
レベルと前記外部記憶手段を前記出力装置から離脱した
状態での前記出力装置側の端子の電位レベルに基づいて
外部記憶手段の着脱を検出する検出手段と、前記検出手
段で前記外部記憶手段が前記出力装置に装着されたこと
を検出した場合の前記制御手段へのリセット解除信号お
よび前記検出手段で前記外部記憶手段が前記出力装置か
ら離脱されたことを検出した場合の前記制御手段へのリ
セット信号を、それぞれ前記装着時または離脱時から所
定時間経過後に発生する発生手段を有し、前記外部記憶
手段の装着時における前記所定時間を当該装着時点から
バスライン上の信号状態が安定するまでの時間とし、前
記外部記憶手段の離脱時における前記所定時間を前記制
御手段の制御対象に応じて定められる所定時間よりも短
いものとすることを特徴とする。
［作用］ 上記構成によれば、外部記憶手段が出力装置に装着され
たとき、または出力装置から離脱されたとき、制御手段
はリセット解除又はリセット状態とされるが、直ちにこ
れらリセット解除等が行われるのではなく、これらリセ
ット解除又はリセットのための信号は所定時間経過後に
発生され、しかもそれぞれの所定時間を、外部記憶手段
の離脱の場合は制御手段の制御対象に応じて定められる
所定時間よりも短いものとし、また装着の場合は、バス
ライン上の信号状態が安定するまでの時間とすることが
できる。
たとき、または出力装置から離脱されたとき、制御手段
はリセット解除又はリセット状態とされるが、直ちにこ
れらリセット解除等が行われるのではなく、これらリセ
ット解除又はリセットのための信号は所定時間経過後に
発生され、しかもそれぞれの所定時間を、外部記憶手段
の離脱の場合は制御手段の制御対象に応じて定められる
所定時間よりも短いものとし、また装着の場合は、バス
ライン上の信号状態が安定するまでの時間とすることが
できる。
［実施例］ 以下、図面を参照して本発明を詳細に説明する。
第１図は本発明の一実施例としての記録装置の一構成例
を示す。ここで、１は記録装置各部を制御する制御部で
あり、主制御部として公知のMPU1A等を含む構成とする
ことができる。２は記録ヘッドであり、例えば吐出エネ
ルギ作用部に発熱素子を有するインクジェットヘッドと
することができる。３は着脱自在な外部記憶手段として
のROMカートリッジであり、記録文字のフォントや記録
紙，文字の大きさ等に応じた制御部１の記録制御手順等
を格納したものとすることができる。
を示す。ここで、１は記録装置各部を制御する制御部で
あり、主制御部として公知のMPU1A等を含む構成とする
ことができる。２は記録ヘッドであり、例えば吐出エネ
ルギ作用部に発熱素子を有するインクジェットヘッドと
することができる。３は着脱自在な外部記憶手段として
のROMカートリッジであり、記録文字のフォントや記録
紙，文字の大きさ等に応じた制御部１の記録制御手順等
を格納したものとすることができる。
10は本発明に係るリセット制御手段としてのリセット回
路であり、ROMカートリッジ３の着脱を検知して、MPU1A
の動作をリセットするリセット信号またはリセット解除
信号を発生する。すなわち、本例にあっては、ROMカー
トリッジ３の着脱をリセット回路10によって検知し、MP
U1Aにリセット信号またはリセット解除信号を送出する
ことによってMPU1Aの動作を制御し、以てMPU1Aの誤動作
に起因した記録ヘッド２内の発熱素子の損壊を防止する
ようにする。
路であり、ROMカートリッジ３の着脱を検知して、MPU1A
の動作をリセットするリセット信号またはリセット解除
信号を発生する。すなわち、本例にあっては、ROMカー
トリッジ３の着脱をリセット回路10によって検知し、MP
U1Aにリセット信号またはリセット解除信号を送出する
ことによってMPU1Aの動作を制御し、以てMPU1Aの誤動作
に起因した記録ヘッド２内の発熱素子の損壊を防止する
ようにする。
第２図は本例に係るリセット回路10の一構成例を示す。
図中ａはリセット回路の端子、ｂは端子ａに接合可能な
ROMカートリッジ３側に設けてある端子であり、端子a,b
間の接続および未接続が、それぞれ、ROMカートリッジ
３の装着および離脱状態に対応する。すなわち、ROMカ
ートリッジ３が装着されているときは端子a,bが接続さ
れ、ROMカートリッジ３が取外されているときは、端子
a,bが切り離されている。
図中ａはリセット回路の端子、ｂは端子ａに接合可能な
ROMカートリッジ３側に設けてある端子であり、端子a,b
間の接続および未接続が、それぞれ、ROMカートリッジ
３の装着および離脱状態に対応する。すなわち、ROMカ
ートリッジ３が装着されているときは端子a,bが接続さ
れ、ROMカートリッジ３が取外されているときは、端子
a,bが切り離されている。
ICは定電圧検知素子であり、そのVSE端子への入力信号
が“H"レベルとなると出力▲▼は“H"レベルに、
VCLは“L"レベルになる。逆に、VSEへの入力信号が“L"
レベルのときは▲▼は“L"レベルに、VCLは“H"
レベルになるものである。この定電圧検知素子として
は、例えば（株）富士通のMB3771を用いることができ
る。
が“H"レベルとなると出力▲▼は“H"レベルに、
VCLは“L"レベルになる。逆に、VSEへの入力信号が“L"
レベルのときは▲▼は“L"レベルに、VCLは“H"
レベルになるものである。この定電圧検知素子として
は、例えば（株）富士通のMB3771を用いることができ
る。
第２図において、ROMカートリッジ３が取外されると、
コンデンサC1が充電され、Ａ点の電位は徐々に上昇して
いく。Ａ点が“H"レベルとなると、トランジスタTrがオ
フ状態となり、Ｂ点は“L"レベルに変化する。すなわ
ち、このとき、定電圧検知素子ICのVSE端子に“L"レベ
ルの信号が入力されることになり、▲▼は“L"レ
ベルに、VCLは“H"レベルになる。また、逆に、ROMカー
トリッジ３が装着されると、コンデンサC1が放電してＡ
点は“L"レベルとなり、これに応じてトランジスタTrは
オン状態となり、Ｂ点は“H"レベルとなる。従って、素
子ICの端子VSEへの入力信号が“H"レベルとなり、▲
▼は“H"レベルに、VCLは“L"レベルになる。
コンデンサC1が充電され、Ａ点の電位は徐々に上昇して
いく。Ａ点が“H"レベルとなると、トランジスタTrがオ
フ状態となり、Ｂ点は“L"レベルに変化する。すなわ
ち、このとき、定電圧検知素子ICのVSE端子に“L"レベ
ルの信号が入力されることになり、▲▼は“L"レ
ベルに、VCLは“H"レベルになる。また、逆に、ROMカー
トリッジ３が装着されると、コンデンサC1が放電してＡ
点は“L"レベルとなり、これに応じてトランジスタTrは
オン状態となり、Ｂ点は“H"レベルとなる。従って、素
子ICの端子VSEへの入力信号が“H"レベルとなり、▲
▼は“H"レベルに、VCLは“L"レベルになる。
この定電圧検知素子ICの出力▲▼とVCLとは逆の
レベルを示す信号であり、MPU1Aの動作論理等、必要に
応じて▲▼またはVCLを適宜MPU1Aのリセット端子
に接続することにより、ROMカートリッジ３の脱着時にM
PU1Aのリセットおよびリセット解除の制御が可能とな
る。
レベルを示す信号であり、MPU1Aの動作論理等、必要に
応じて▲▼またはVCLを適宜MPU1Aのリセット端子
に接続することにより、ROMカートリッジ３の脱着時にM
PU1Aのリセットおよびリセット解除の制御が可能とな
る。
第３図はROMカートリッジ３を取外した直後の、第４図
はROMカートリッジ３を装着した着後のリセット回路10
の各部における電圧と時間との関係を示し、定電圧検知
素子ICに上述の素子MB3771を用いて各部の動作波形を観
測したものである。
はROMカートリッジ３を装着した着後のリセット回路10
の各部における電圧と時間との関係を示し、定電圧検知
素子ICに上述の素子MB3771を用いて各部の動作波形を観
測したものである。
実際には、記録ヘッド２に通常記録時における平均通電
時間の２倍の時間にわたって通電があると、具体的には
平均通電時間が７μsecであれば14μsec以上の通電があ
ると、発熱素子が熱破壊される危険性が高い。すなわ
ち、ROMカートリッジ３を取外すことによってMPU1Aが誤
動作し、記録ヘッド２に14μsec以上の通電が起こると
記録ヘッド２を破壊し得る。そこで、ROMカートリッジ
３を取外ずしてから、14μsec以内にMPU1Aをリセット状
態とするのが望ましいことになる。第３図を観察する
に、本例に係るリセット回路10によれば、ROMカートリ
ッジ３を取外した時点Ｏから信号▲▼またはVCL
によるリセットが有効となるまでの時間（リセット信号
発生時間）τはτ＝10.6,12.2＜14であるので、充分に
上記の条件を満たしている。
時間の２倍の時間にわたって通電があると、具体的には
平均通電時間が７μsecであれば14μsec以上の通電があ
ると、発熱素子が熱破壊される危険性が高い。すなわ
ち、ROMカートリッジ３を取外すことによってMPU1Aが誤
動作し、記録ヘッド２に14μsec以上の通電が起こると
記録ヘッド２を破壊し得る。そこで、ROMカートリッジ
３を取外ずしてから、14μsec以内にMPU1Aをリセット状
態とするのが望ましいことになる。第３図を観察する
に、本例に係るリセット回路10によれば、ROMカートリ
ッジ３を取外した時点Ｏから信号▲▼またはVCL
によるリセットが有効となるまでの時間（リセット信号
発生時間）τはτ＝10.6,12.2＜14であるので、充分に
上記の条件を満たしている。
一方、ROMカートリッジ３はMPU1Aとバスラインを介して
直結されているために、ROMカートリッジ３装着時に発
生するチャタリングによってこのままではバスライン上
の信号が不安定となりMPU1Aが誤動作する危険性があ
る。この理由により、記録ヘッド２に上述と同様に通常
記録時における通電時間の２倍以上の通電が行われる
と、記録ヘッド２が破壊されてしまうことになる。そこ
でROMカートリッジ３を装着してから、MPU1Aへリセット
解除信号を送出するのに数十msec程の遅延時間を設ける
のが好ましい。第４図を観察するに、本例に係るリセッ
ト回路10によれば、ROMカートリッジ３を装着した時点
Ｃから信号▲▼またはVCLによるリセット解除が
なされるまでの時間（リセット解除信号発生時間）τ′
はτ′＝108msecであるので、上記の条件を充分に満た
している。
直結されているために、ROMカートリッジ３装着時に発
生するチャタリングによってこのままではバスライン上
の信号が不安定となりMPU1Aが誤動作する危険性があ
る。この理由により、記録ヘッド２に上述と同様に通常
記録時における通電時間の２倍以上の通電が行われる
と、記録ヘッド２が破壊されてしまうことになる。そこ
でROMカートリッジ３を装着してから、MPU1Aへリセット
解除信号を送出するのに数十msec程の遅延時間を設ける
のが好ましい。第４図を観察するに、本例に係るリセッ
ト回路10によれば、ROMカートリッジ３を装着した時点
Ｃから信号▲▼またはVCLによるリセット解除が
なされるまでの時間（リセット解除信号発生時間）τ′
はτ′＝108msecであるので、上記の条件を充分に満た
している。
すなわち、本例によれば、ROMカートリッジ３の取外し
時または装着時において、それぞれMPU1Aのリセット状
態またはリセット解除状態は適切に制御されるので、MP
U1Aの誤動作が生じず、従って記録ヘッド２が保護され
ることになる。
時または装着時において、それぞれMPU1Aのリセット状
態またはリセット解除状態は適切に制御されるので、MP
U1Aの誤動作が生じず、従って記録ヘッド２が保護され
ることになる。
なお、本発明は上述の実施例にのみ限らず、制御部１や
記録ヘッド２の特性等に応じて種々の要素や構成を採る
ことができるのは勿論である。例えば、第２図示のリセ
ット回路においてトランジスタTrのベース端子と定電圧
検知素子ICのVSE端子とを直接接続するようにしてもよ
い。また、リセット信号およびリセット解除信号の発生
時間は、記録ヘッド２の特性に応じて適宜定めればよ
い。
記録ヘッド２の特性等に応じて種々の要素や構成を採る
ことができるのは勿論である。例えば、第２図示のリセ
ット回路においてトランジスタTrのベース端子と定電圧
検知素子ICのVSE端子とを直接接続するようにしてもよ
い。また、リセット信号およびリセット解除信号の発生
時間は、記録ヘッド２の特性に応じて適宜定めればよ
い。
さらに、上述の実施例では、本発明を、発熱素子を記録
ヘッドに有するインクジェット記録装置に適用した場合
について述べたが、その他のインクジェット記録装置
や、さらにサーマルプリンタ、ワイヤドットプリンタに
も本発明は極めて有効に適用できる。
ヘッドに有するインクジェット記録装置に適用した場合
について述べたが、その他のインクジェット記録装置
や、さらにサーマルプリンタ、ワイヤドットプリンタに
も本発明は極めて有効に適用できる。
以上説明した様に本実施例によれば、外部記憶手段の着
脱時のチャタリング等に起因して生じ得る記録ヘッドの
損壊を防止でき、安全性の高い装置を実現できる。
脱時のチャタリング等に起因して生じ得る記録ヘッドの
損壊を防止でき、安全性の高い装置を実現できる。
［発明の効果］ 以上説明した様に、本発明によれば、着脱可能な外部記
憶手段側端子および装置側端子の形状に何ら特徴を持た
せることなく、外部記憶手段を装置に装着した状態での
装置側端子の電位レベルと外部記憶手段を装置から離脱
した状態での装置側端子の電位レベルに基づいて、外部
記憶手段の着脱を検出することにより、リセット信号或
はリセット解除信号を出力することができるという優れ
た効果を奏する。
憶手段側端子および装置側端子の形状に何ら特徴を持た
せることなく、外部記憶手段を装置に装着した状態での
装置側端子の電位レベルと外部記憶手段を装置から離脱
した状態での装置側端子の電位レベルに基づいて、外部
記憶手段の着脱を検出することにより、リセット信号或
はリセット解除信号を出力することができるという優れ
た効果を奏する。
第１図は本発明記録装置の一構成例を示すブロック図、 第２図は本発明記録装置の主要部としてのリセット回路
の一構成例を示す回路図、 第３図および第４図は、それぞれ、外部記憶手段として
のROMカートリッジを取外したときおよび装着したとき
における第２図示の回路の各部の動作波形を示すタイミ
ングチャートである。 １……制御部、 1A……MPU、 ２……記録ヘッド、 ３……ROMカートリッジ、 a,b……接点、 IC……定電圧検知素子。
の一構成例を示す回路図、 第３図および第４図は、それぞれ、外部記憶手段として
のROMカートリッジを取外したときおよび装着したとき
における第２図示の回路の各部の動作波形を示すタイミ
ングチャートである。 １……制御部、 1A……MPU、 ２……記録ヘッド、 ３……ROMカートリッジ、 a,b……接点、 IC……定電圧検知素子。
Claims (1)
- 【請求項１】着脱可能な外部記憶手段に記憶されている
情報を用いて、外部から入力される入力情報から出力情
報を生成し出力する出力装置であって、 前記出力装置を制御する制御手段と、 前記外部記憶手段を前記出力装置に装着した状態での前
記出力装置側の端子の電位レベルと前記外部記憶手段を
前記出力装置から離脱した状態での前記出力装置側の接
続端子の電位レベルに基づいて外部記憶手段の着脱を検
出する検出手段と、 前記検出手段で前記外部記憶手段が前記出力装置に装着
されたことを検出した場合の前記制御手段へのリセット
解除信号および前記検出手段で前記外部記憶手段が前記
出力装置から離脱されたことを検出した場合の前記制御
手段へのリセット信号を、それぞれ前記装着時または離
脱時から所定時間経過後に発生する発生手段を有し、 前記外部記憶手段の装着時における前記所定時間を当該
装着時点からバスライン上の信号状態が安定するまでの
時間とし、前記外部記憶手段の離脱時における前記所定
時間を前記制御手段の制御対象に応じて定められる所定
時間より短いものとすることを特徴とする出力装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61086974A JPH0796321B2 (ja) | 1986-04-17 | 1986-04-17 | 出力装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP61086974A JPH0796321B2 (ja) | 1986-04-17 | 1986-04-17 | 出力装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS62244671A JPS62244671A (ja) | 1987-10-26 |
| JPH0796321B2 true JPH0796321B2 (ja) | 1995-10-18 |
Family
ID=13901842
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP61086974A Expired - Fee Related JPH0796321B2 (ja) | 1986-04-17 | 1986-04-17 | 出力装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0796321B2 (ja) |
Family Cites Families (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS58194186A (ja) * | 1982-05-07 | 1983-11-12 | Sharp Corp | 着脱可能な記憶装置 |
| US4632398A (en) * | 1983-08-12 | 1986-12-30 | International Business Machines Corporation | Reset system for microcomputer using program cartridges |
| JPS6071966U (ja) * | 1983-10-24 | 1985-05-21 | オムロン株式会社 | マイクロコンピユ−タ装置 |
| JPH074953B2 (ja) * | 1984-09-13 | 1995-01-25 | 株式会社リコー | プリンタコントロ−ラ |
-
1986
- 1986-04-17 JP JP61086974A patent/JPH0796321B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JPS62244671A (ja) | 1987-10-26 |
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|---|---|---|---|
| LAPS | Cancellation because of no payment of annual fees |