JPH08223501A - 衛星伝送と、地上伝送と、ケーブル伝送されたディジタルｔｖデータを復調し復号化する装置、および信号処理装置 - Google Patents
衛星伝送と、地上伝送と、ケーブル伝送されたディジタルｔｖデータを復調し復号化する装置、および信号処理装置Info
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Abstract
(57)【要約】
【課題】 衛星、地上およびケーブル伝送ディジタルＴ
Ｖデータを復調し、復号化する装置を提供することを目
的としている。 【解決手段】 ディジタル信号プロセッサは、衛星、地
上およびケーブル伝送チャネルなどの、多種類のチャネ
ルから受信した信号を選択的に復調し、復号化する。受
信した信号は、ＴＶピクチャ情報などの圧縮ディジタル
・ビデオ情報を表しており、複数の符号化フォーマット
（例えば、選択可能なコード・レートのトレリスまたは
パンクチャド・コード）の１つので符号化されている。
また、受信信号は複数のフォーマット（例えば、ＰＡ
Ｍ、ＱＡＭまたはＰＳＫ）の１つで変調される。復調器
は、複数の変調フォーマットの１つで変調された信号を
選択的に復調し、復号化器は、複数の符号化フォーマッ
トの１つで符号化された復調信号を選択的に復号化す
る。
Ｖデータを復調し、復号化する装置を提供することを目
的としている。 【解決手段】 ディジタル信号プロセッサは、衛星、地
上およびケーブル伝送チャネルなどの、多種類のチャネ
ルから受信した信号を選択的に復調し、復号化する。受
信した信号は、ＴＶピクチャ情報などの圧縮ディジタル
・ビデオ情報を表しており、複数の符号化フォーマット
（例えば、選択可能なコード・レートのトレリスまたは
パンクチャド・コード）の１つので符号化されている。
また、受信信号は複数のフォーマット（例えば、ＰＡ
Ｍ、ＱＡＭまたはＰＳＫ）の１つで変調される。復調器
は、複数の変調フォーマットの１つで変調された信号を
選択的に復調し、復号化器は、複数の符号化フォーマッ
トの１つで符号化された復調信号を選択的に復号化す
る。
Description
【０００１】
【発明の属する技術分野】本発明は、衛星伝送、地上伝
送、ケーブル伝送されたディジタルＴＶデータのマルチ
チャネル受信装置で使用するのに適したディジタル信号
処理装置に関する。
送、ケーブル伝送されたディジタルＴＶデータのマルチ
チャネル受信装置で使用するのに適したディジタル信号
処理装置に関する。
【０００２】なお、本明細書の記述は本件出願の優先権
の基礎たる米国特許出願第３４２，２８０号（１９９４
年１１月１８日出願）および米国特許出願第５０１，７
５２号（１９９５年７月１２日出願）の明細書の記載に
基づくものであって、当該米国特許出願の番号を参照す
ることによって当該米国特許出願の明細書の記載内容が
本明細書の一部分を構成するものとする。
の基礎たる米国特許出願第３４２，２８０号（１９９４
年１１月１８日出願）および米国特許出願第５０１，７
５２号（１９９５年７月１２日出願）の明細書の記載に
基づくものであって、当該米国特許出願の番号を参照す
ることによって当該米国特許出願の明細書の記載内容が
本明細書の一部分を構成するものとする。
【０００３】
【従来の技術】Viterbi アルゴリズム・ベースの畳み込
み復号化器としての分岐メトリック・コンピュータを含
む受信装置に、符号化されたディジタル・データを、ノ
イズの多いチャネルを介して送信機から送信するのに、
畳み込み符号化を含む順方向エラー訂正を使用するの
は、この技術分野では公知のことである。Viterbi アル
ゴリズムは、ノイズの多いチャネルを介して送信される
畳み込み符号化されたビットのシーケンスを復号化する
のに、極普通に用いられている。一連の繰り返し加算−
比較−選択オペレーションが、Viterbi アルゴリズムの
中心となっている。このオペレーションでは、復調器か
らの各受信シンボルに対して計算されたあるメトリック
ス（分岐メトリックスという）が、入力として受信され
る。このような計算は、高データ・レートの信号を衛星
伝送する場合や、ケーブル伝送する場合や、地上伝送す
る場合には、非常に高いレートで行う必要がある。さら
に、異なるチャネルを介して、異なる（しかし、関係の
ある）符号化方式で動作するモデム／復号化器では、分
岐メトリックスを計算するコストは、これらの計算を行
うためのルックアップ・テーブル・メモリや実際のハー
ドウェアの点で過大になっている。
み復号化器としての分岐メトリック・コンピュータを含
む受信装置に、符号化されたディジタル・データを、ノ
イズの多いチャネルを介して送信機から送信するのに、
畳み込み符号化を含む順方向エラー訂正を使用するの
は、この技術分野では公知のことである。Viterbi アル
ゴリズムは、ノイズの多いチャネルを介して送信される
畳み込み符号化されたビットのシーケンスを復号化する
のに、極普通に用いられている。一連の繰り返し加算−
比較−選択オペレーションが、Viterbi アルゴリズムの
中心となっている。このオペレーションでは、復調器か
らの各受信シンボルに対して計算されたあるメトリック
ス（分岐メトリックスという）が、入力として受信され
る。このような計算は、高データ・レートの信号を衛星
伝送する場合や、ケーブル伝送する場合や、地上伝送す
る場合には、非常に高いレートで行う必要がある。さら
に、異なるチャネルを介して、異なる（しかし、関係の
ある）符号化方式で動作するモデム／復号化器では、分
岐メトリックスを計算するコストは、これらの計算を行
うためのルックアップ・テーブル・メモリや実際のハー
ドウェアの点で過大になっている。
【０００４】衛星伝送チャネルの場合には、普通、受信
装置の畳み込み復号化器に知られた幾つかの特定のパン
クチャドQPSK(punctured quaternary phase shift keyi
ng)符号が送信される。地上またはケーブル伝送チャネ
ルの場合には、普通、受信装置の畳み込み復号化器に知
られた幾つかの特定のプラグマティク・トレリス符号(p
ragmatic trellis code)（例えば、QAM(quadrature amp
litude modulation )符号か、PAM(phase amplitude mod
ulation) 符号か、あるいは、PSK(phase shift keyed)
符号のような符号）が送信される。例えば、従来技術
では、プラグマティク・トレリス符号がHDTV(high defi
nition television)をQAM 伝送するための実際の符号と
して使用されている。
装置の畳み込み復号化器に知られた幾つかの特定のパン
クチャドQPSK(punctured quaternary phase shift keyi
ng)符号が送信される。地上またはケーブル伝送チャネ
ルの場合には、普通、受信装置の畳み込み復号化器に知
られた幾つかの特定のプラグマティク・トレリス符号(p
ragmatic trellis code)（例えば、QAM(quadrature amp
litude modulation )符号か、PAM(phase amplitude mod
ulation) 符号か、あるいは、PSK(phase shift keyed)
符号のような符号）が送信される。例えば、従来技術
では、プラグマティク・トレリス符号がHDTV(high defi
nition television)をQAM 伝送するための実際の符号と
して使用されている。
【０００５】
【発明が解決しようとする課題】従来では、Viterbi ア
ルゴリズムをベースとする畳み込み復号化器としての分
岐メトリック・コンピュータを含む受信装置は、単一の
予め定めたタイプの畳み込み符号のみで動作するように
設計されているのが典型的であった。しかし、マルチチ
ャネル・ディジタルＴＶ受信装置が、近い将来、大量生
産マーケットに投入され、やがて、現在使用されている
アナログＴＶ受信装置と置き換えられていく可能性があ
る。ＴＶ受信装置への直接放送衛星伝送は、ＴＶ受信装
置への地上伝送およびケーブル伝送に加えて、既に利用
可能である。従って、望ましいことは、このようなマル
チチャネル・ディジタルＴＶ受信装置の畳み込み復号化
器が、符号のタイプ（必要に応じて、パンクチャド符号
またはプラグマティク・トレリス符号のどちらか）と、
マルチチャネル・ディジタルＴＶ受信装置がそのとき受
信したチャネルの変調のタイプ（必要に応じて、QPSKと
8-PSK の両方を含むPSK か、PAM か、あるいはQAM のい
ずれか）とに選択的に応答することである。さらに、大
量生産された受信装置は、コストの削減と、複雑さの軽
減とを念頭において設計する必要がある。
ルゴリズムをベースとする畳み込み復号化器としての分
岐メトリック・コンピュータを含む受信装置は、単一の
予め定めたタイプの畳み込み符号のみで動作するように
設計されているのが典型的であった。しかし、マルチチ
ャネル・ディジタルＴＶ受信装置が、近い将来、大量生
産マーケットに投入され、やがて、現在使用されている
アナログＴＶ受信装置と置き換えられていく可能性があ
る。ＴＶ受信装置への直接放送衛星伝送は、ＴＶ受信装
置への地上伝送およびケーブル伝送に加えて、既に利用
可能である。従って、望ましいことは、このようなマル
チチャネル・ディジタルＴＶ受信装置の畳み込み復号化
器が、符号のタイプ（必要に応じて、パンクチャド符号
またはプラグマティク・トレリス符号のどちらか）と、
マルチチャネル・ディジタルＴＶ受信装置がそのとき受
信したチャネルの変調のタイプ（必要に応じて、QPSKと
8-PSK の両方を含むPSK か、PAM か、あるいはQAM のい
ずれか）とに選択的に応答することである。さらに、大
量生産された受信装置は、コストの削減と、複雑さの軽
減とを念頭において設計する必要がある。
【０００６】
【課題を解決するための手段】本発明者は、例えば、デ
ィジタルＴＶ信号処理システムのコンテキスト内で、複
数の復調機能と復号化機能を、単一の信号処理デバイス
に効果的に適合させることができることを認識した。開
示されたディジタル信号処理装置には、本発明の原理に
従って、異なるタイプの復調機能と復号化機能を導入し
た選択的変調および復号化要素が設けてある。その結
果、単一の信号処理ネットワークは、異なる信号フォー
マットの信号、例えば、衛星、地上およびケーブルＴＶ
信号のような信号を復調し復号化することができる。
ィジタルＴＶ信号処理システムのコンテキスト内で、複
数の復調機能と復号化機能を、単一の信号処理デバイス
に効果的に適合させることができることを認識した。開
示されたディジタル信号処理装置には、本発明の原理に
従って、異なるタイプの復調機能と復号化機能を導入し
た選択的変調および復号化要素が設けてある。その結
果、単一の信号処理ネットワークは、異なる信号フォー
マットの信号、例えば、衛星、地上およびケーブルＴＶ
信号のような信号を復調し復号化することができる。
【０００７】複数タイプの伝送チャネルから変調ビデオ
信号を受信するシステムでは、本発明の原理による装置
は、復調され復号化された出力信号を出力する。受信さ
れたビデオ信号は、圧縮ディジタル・ビデオ情報、例え
ば、ＴＶピクチャ情報のような情報を表し、複数の符号
化フォーマットのうちの１つ符号化フォーマットで符号
化されている。また、受信されたビデオ信号は複数の変
調フォーマットのうちの１つの変調フォーマットで変調
されている。
信号を受信するシステムでは、本発明の原理による装置
は、復調され復号化された出力信号を出力する。受信さ
れたビデオ信号は、圧縮ディジタル・ビデオ情報、例え
ば、ＴＶピクチャ情報のような情報を表し、複数の符号
化フォーマットのうちの１つ符号化フォーマットで符号
化されている。また、受信されたビデオ信号は複数の変
調フォーマットのうちの１つの変調フォーマットで変調
されている。
【０００８】本発明に係る装置は、複数の変調フォーマ
ットのうちの１つの変調フォーマットで変調された受信
ビデオ信号を選択的に復調し、復調信号を出力する復調
器を含む。本発明に係る装置は、複数の符号化フォーマ
ットのうちの１つの符号化フォーマットで符号化された
変調信号を選択的に復号化する復号化器も含む。
ットのうちの１つの変調フォーマットで変調された受信
ビデオ信号を選択的に復調し、復調信号を出力する復調
器を含む。本発明に係る装置は、複数の符号化フォーマ
ットのうちの１つの符号化フォーマットで符号化された
変調信号を選択的に復号化する復号化器も含む。
【０００９】本発明の特徴によれば、復調器はPAM 、QA
M またはPSK により変調されたビデオ信号を選択的に復
調する。
M またはPSK により変調されたビデオ信号を選択的に復
調する。
【００１０】本発明の別の特徴によれば、選択的復号化
器はトレリスまたはパンクチャド符号フォーマットで符
号化された復調信号を復号化する。
器はトレリスまたはパンクチャド符号フォーマットで符
号化された復調信号を復号化する。
【００１１】本発明のさらに別の特徴によれば、選択的
復号化器は、複数の符号レートから選択された符号レー
トで復調信号を復号化する。
復号化器は、複数の符号レートから選択された符号レー
トで復調信号を復号化する。
【００１２】本発明に係る復号化器は、説明上、分岐メ
トリック・コンピュータとViterbi復号化器を含む畳み
込み復号化器である。第１の実施の形態では、この分岐
メトリック・コンピュータは、供給されたQPSKパンクチ
ャド符号化されたＩ，Ｑ信号入力か、あるいは、複数の
PAM またはQAM 上位アルファベット・プラグマティク・
トレリス符号化されたＩ，Ｑ信号入力のいずれかで動作
するようにプログラムすることができる。第２の実施の
形態では、この分岐メトリック・コンピュータは、さら
に、供給された8-PSK トレリス符号化されたＩ，Ｑ信号
入力でも動作するように選択的にプログラムすることが
できる。
トリック・コンピュータとViterbi復号化器を含む畳み
込み復号化器である。第１の実施の形態では、この分岐
メトリック・コンピュータは、供給されたQPSKパンクチ
ャド符号化されたＩ，Ｑ信号入力か、あるいは、複数の
PAM またはQAM 上位アルファベット・プラグマティク・
トレリス符号化されたＩ，Ｑ信号入力のいずれかで動作
するようにプログラムすることができる。第２の実施の
形態では、この分岐メトリック・コンピュータは、さら
に、供給された8-PSK トレリス符号化されたＩ，Ｑ信号
入力でも動作するように選択的にプログラムすることが
できる。
【００１３】分岐メトリック・コンピュータは、説明
上、２x ビットＩ信号入力と２x ビットＱ信号入力を有
し、（１）２x 記憶ロケーションの実効デプス(depth)
をもち、プリロードされた少なくとも１つのＩ定義ルッ
クアップ・テーブルと少なくとも１つのＱ定義ルックア
ップ・テーブルの４ｍビット幅のエントリを各記憶ロケ
ーションにストアするだけの幅をもつＲＡＭと、（２）
少なくとも４つの加算器からなるグループと、（３）こ
のグループの４加算器からの各和出力を畳み込み復号化
器のViterbi 復号化器に転送する手段とを備えている。
上、２x ビットＩ信号入力と２x ビットＱ信号入力を有
し、（１）２x 記憶ロケーションの実効デプス(depth)
をもち、プリロードされた少なくとも１つのＩ定義ルッ
クアップ・テーブルと少なくとも１つのＱ定義ルックア
ップ・テーブルの４ｍビット幅のエントリを各記憶ロケ
ーションにストアするだけの幅をもつＲＡＭと、（２）
少なくとも４つの加算器からなるグループと、（３）こ
のグループの４加算器からの各和出力を畳み込み復号化
器のViterbi 復号化器に転送する手段とを備えている。
【００１４】第２の実施の形態では、ＲＡＭの幅は、２
つのプリロードされたＩ定義ルックアップ・テーブルと
２つのＱ定義ルックアップ・テーブルの４ｍビット幅の
エントリを各記憶ロケーションにストアするのに充分な
幅になっている。少なくとも４つの加算器からなるグル
ープは、それぞれ４つの加算器からなる第１組と第２組
により編成された８つの加算器を含む。また、このグル
ープの４つの加算器からの各和出力を畳み込み復号化器
のViterbi 復号化器に転送する手段は、４つのコンパレ
ータを含む。４つのコンパレータは、それぞれ、第１組
と第２組の加算器のうちの対応する加算器からの小さい
方の和出力をViterbi 復号化器に転送するようになって
いる。
つのプリロードされたＩ定義ルックアップ・テーブルと
２つのＱ定義ルックアップ・テーブルの４ｍビット幅の
エントリを各記憶ロケーションにストアするのに充分な
幅になっている。少なくとも４つの加算器からなるグル
ープは、それぞれ４つの加算器からなる第１組と第２組
により編成された８つの加算器を含む。また、このグル
ープの４つの加算器からの各和出力を畳み込み復号化器
のViterbi 復号化器に転送する手段は、４つのコンパレ
ータを含む。４つのコンパレータは、それぞれ、第１組
と第２組の加算器のうちの対応する加算器からの小さい
方の和出力をViterbi 復号化器に転送するようになって
いる。
【００１５】
【発明の実施の形態】図１に示すように、マルチチャネ
ル圧縮ディジタルＴＶ(television)受信装置１００は、
複数の異なるチャネルを介して伝送されたディジタル符
号化ＴＶデータを選択的に受信することができる。これ
らのチャネルとして、順方向エラー訂正ＴＶ送信装置１
０４からディジタル符号化ＴＶデータを伝送する衛星伝
送チャネル１０２と、順方向エラー訂正ＴＶ送信装置１
０８からディジタル符号化ＴＶデータを伝送する地上伝
送チャネル１０６と、順方向エラー訂正ＴＶ送信装置１
１２からディジタル符号化ＴＶデータを伝送するケーブ
ル伝送チャネル１１０がある。この分野では公知である
が、送信装置の順方向エラー訂正には、既に符号化され
た圧縮ディジタルＴＶデータの連続送信されるシンボル
・パケットを畳み込み符号化することが含まれる。
ル圧縮ディジタルＴＶ(television)受信装置１００は、
複数の異なるチャネルを介して伝送されたディジタル符
号化ＴＶデータを選択的に受信することができる。これ
らのチャネルとして、順方向エラー訂正ＴＶ送信装置１
０４からディジタル符号化ＴＶデータを伝送する衛星伝
送チャネル１０２と、順方向エラー訂正ＴＶ送信装置１
０８からディジタル符号化ＴＶデータを伝送する地上伝
送チャネル１０６と、順方向エラー訂正ＴＶ送信装置１
１２からディジタル符号化ＴＶデータを伝送するケーブ
ル伝送チャネル１１０がある。この分野では公知である
が、送信装置の順方向エラー訂正には、既に符号化され
た圧縮ディジタルＴＶデータの連続送信されるシンボル
・パケットを畳み込み符号化することが含まれる。
【００１６】これもこの分野では公知であるが、QSPKベ
ースのパンクチャド符号は、畳み込み符号化データを衛
星チャネルを介して伝送するのに採用されるのが典型的
であり、上位アルファベット（すなわち、８、１６、３
２、６４、１２８および２５６）n/n+1 プラグマティク
・トレリス符号は、畳み込み符号化データを地上チャネ
ルまたはケーブル・チャネルを介してPAM ベースの伝送
か、PSK ベースの伝送か、あるいはQAM ベースの伝送を
するのに採用されるのが典型的である。そのため、マル
チチャネル受信装置１００は、マルチチャネルのうち選
択され受信に供されているチャネルに依存して、次によ
うな畳み込み復号化器を導入する必要がある。すなわ
ち、QSPKベースのパンクチャド符号か、あるいは、PAM
ベース、PSK ベースまたはQAM ベースの上位アルファベ
ットn/n+1 プラグマティク・トレリス符号のうちの一方
を復号化することができる畳み込み復号化器を導入する
必要がある。
ースのパンクチャド符号は、畳み込み符号化データを衛
星チャネルを介して伝送するのに採用されるのが典型的
であり、上位アルファベット（すなわち、８、１６、３
２、６４、１２８および２５６）n/n+1 プラグマティク
・トレリス符号は、畳み込み符号化データを地上チャネ
ルまたはケーブル・チャネルを介してPAM ベースの伝送
か、PSK ベースの伝送か、あるいはQAM ベースの伝送を
するのに採用されるのが典型的である。そのため、マル
チチャネル受信装置１００は、マルチチャネルのうち選
択され受信に供されているチャネルに依存して、次によ
うな畳み込み復号化器を導入する必要がある。すなわ
ち、QSPKベースのパンクチャド符号か、あるいは、PAM
ベース、PSK ベースまたはQAM ベースの上位アルファベ
ットn/n+1 プラグマティク・トレリス符号のうちの一方
を復号化することができる畳み込み復号化器を導入する
必要がある。
【００１７】特に、マルチチャネル受信装置１００はデ
ィジタル処理装置を備えている。このディジタル処理装
置は、図２に示すように、受信装置畳み込み復号化器２
００を含み、この分野では公知であるが、一連の連続受
信された畳み込み符号化シンボル・パケットを、信号入
力データとして、受信装置畳み込み復号化器２００に供
給する受信装置復調器２０２を含む。このデータの連続
受信されたシンボル・パケットは、それぞれ、同位相
（Ｉ）プレーン、直角位相（Ｑ）プレーン内のポイント
を定義している。マルチチャネル受信装置１００のディ
ジタル処理装置は、さらに、マイクロコントローラを備
えている。このマイクロコントローラは制御入力を受信
装置畳み込み復号化器２００に供給するマイクロコント
ローラ・インタフェース２０４を含む。
ィジタル処理装置を備えている。このディジタル処理装
置は、図２に示すように、受信装置畳み込み復号化器２
００を含み、この分野では公知であるが、一連の連続受
信された畳み込み符号化シンボル・パケットを、信号入
力データとして、受信装置畳み込み復号化器２００に供
給する受信装置復調器２０２を含む。このデータの連続
受信されたシンボル・パケットは、それぞれ、同位相
（Ｉ）プレーン、直角位相（Ｑ）プレーン内のポイント
を定義している。マルチチャネル受信装置１００のディ
ジタル処理装置は、さらに、マイクロコントローラを備
えている。このマイクロコントローラは制御入力を受信
装置畳み込み復号化器２００に供給するマイクロコント
ローラ・インタフェース２０４を含む。
【００１８】図３に、本発明で採用した受信装置畳み込
み復号化器２００を構成する構成要素相互間の関係を示
すとともに、これら構成要素の外部マイクロコントロー
ラ・インタフェース２０４による制御を示す。図３に示
すように、受信装置畳み込み復号化器２００は、同期回
路３００と、ダミー・データ・インサータ３０２と、分
岐メトリック・コンピュータ３０４と、Viterbi 復号化
器３０６と、畳み込み符号化器３０８と、トレリス・デ
マッパ３１０と、遅延ロジック３１２と、同期モニタ３
１４と、選択手段３１６により構成されている。マイク
ロコントローラ・インタフェース２０４は、畳み込み符
号化器が、パンクチャド符号の復号化器か、あるいは、
トレリス符号の復号化器のいずれかとして動作するよう
に構成した前記構成要素に、仕様のリストを供給する。
図４と図５は、それぞれ、図３に示す畳み込み符号化器
の構成要素が（１）パンクチャド符号の復号化器として
動作するか、（２）トレリス符号の復号化器として動作
するかを説明するための説明図である。
み復号化器２００を構成する構成要素相互間の関係を示
すとともに、これら構成要素の外部マイクロコントロー
ラ・インタフェース２０４による制御を示す。図３に示
すように、受信装置畳み込み復号化器２００は、同期回
路３００と、ダミー・データ・インサータ３０２と、分
岐メトリック・コンピュータ３０４と、Viterbi 復号化
器３０６と、畳み込み符号化器３０８と、トレリス・デ
マッパ３１０と、遅延ロジック３１２と、同期モニタ３
１４と、選択手段３１６により構成されている。マイク
ロコントローラ・インタフェース２０４は、畳み込み符
号化器が、パンクチャド符号の復号化器か、あるいは、
トレリス符号の復号化器のいずれかとして動作するよう
に構成した前記構成要素に、仕様のリストを供給する。
図４と図５は、それぞれ、図３に示す畳み込み符号化器
の構成要素が（１）パンクチャド符号の復号化器として
動作するか、（２）トレリス符号の復号化器として動作
するかを説明するための説明図である。
【００１９】復調器２０２からの出力データは、Ｉ，Ｑ
入力データとして同期回路３００に供給される。説明の
便宜上、ＩデータとＱデータは、それぞれ、６ビットで
定義するものとする。すなわち、入力データは総計１２
本の並列入力コンダクタ上に供給される。よって、Ｉ，
Ｑプレーンの64×64＝4096個のポイントを、それぞれ、
１２ビット入力データのうちの６ビットＩ成分と６ビッ
トＱ成分により定義することができる。同期回路３００
はクロック入力とクロック・イネーブル(Clk Enb) 入力
も受信する。さらに、同期回路３００はマイクロコント
ローラ・インタフェース２０４から制御データを受信す
るとともに、マイクロコントローラ・インタフェース２
０にデータを供給し、同期モニタ３１４に直接結合され
ている。
入力データとして同期回路３００に供給される。説明の
便宜上、ＩデータとＱデータは、それぞれ、６ビットで
定義するものとする。すなわち、入力データは総計１２
本の並列入力コンダクタ上に供給される。よって、Ｉ，
Ｑプレーンの64×64＝4096個のポイントを、それぞれ、
１２ビット入力データのうちの６ビットＩ成分と６ビッ
トＱ成分により定義することができる。同期回路３００
はクロック入力とクロック・イネーブル(Clk Enb) 入力
も受信する。さらに、同期回路３００はマイクロコント
ローラ・インタフェース２０４から制御データを受信す
るとともに、マイクロコントローラ・インタフェース２
０にデータを供給し、同期モニタ３１４に直接結合され
ている。
【００２０】構成要素３０２，３０４，３０６，３０８
および３１０には、それぞれ、制御データがマイクロコ
ントローラ・インタフェース２０４から供給される。さ
らに、図３には図示していないが、構成要素３０２，３
０４，３０６，３０８および３１０にクロックが供給さ
れている。適正に同期をとったＩデータとＱデータは、
データ入力クロック・イネーブル（DICE）と、データ出
力クロック・イネーブル（DOCE）に応答して、同期回路
３００からダミー・データ・インサータ３０２を介して
分岐メトリック・コンピュータ３０４に転送される。さ
らに、適正に同期をとったＩデータとＱデータは、遅延
ロジック３１２を介してトレリス・デマッパ３１０と同
期モニタ３１４に転送される。
および３１０には、それぞれ、制御データがマイクロコ
ントローラ・インタフェース２０４から供給される。さ
らに、図３には図示していないが、構成要素３０２，３
０４，３０６，３０８および３１０にクロックが供給さ
れている。適正に同期をとったＩデータとＱデータは、
データ入力クロック・イネーブル（DICE）と、データ出
力クロック・イネーブル（DOCE）に応答して、同期回路
３００からダミー・データ・インサータ３０２を介して
分岐メトリック・コンピュータ３０４に転送される。さ
らに、適正に同期をとったＩデータとＱデータは、遅延
ロジック３１２を介してトレリス・デマッパ３１０と同
期モニタ３１４に転送される。
【００２１】ダミー・データ・インサータ３０２は、主
に、パンクチャド符号のために使用され、このようなパ
ンクチャド符号に対して、指定された削除マップに対応
するダミー・データを挿入することを担当している。ト
レリス符号の場合は、ダミー・データ・インサータ３０
２は、単に、入力データをその出力端子に渡すだけであ
る。符号および対応する削除マップの選択は、マイクロ
コントローラ・インタフェース２０４を通してダミー・
データ・インサータ３０２へ伝達される。ダミー・デー
タ・インサータ３０２は、採用した符号化方式に依存す
るレートの内部クロックで、データをクロックアウトす
る。入力データと出力データのレートは、（パンクチャ
ド符号の場合）異なるので、データ入力クロック・イネ
ーブル（DICE）信号と、データ出力クロック・イネーブ
ル（DOCE）信号は、一義的である。DICE信号は受信装置
復調器２０２からのクロック・イネーブルであり、一
方、DOCE信号はダミー・データ・インサータ３０２で生
成される（しかも、クロック信号から取り出される）。
特に、ダミー・データ・インサータ３０２は、ＦＩＦＯ
記憶機構と、適正なロケーションのソフト判定サンプル
に書き込むための書込みクロックと、分岐メトリック計
算のためにデータを読み出すための読み出しクロック
（読み出しクロックは書込みクロックよりもレートが高
く、そのクロッキング・レートのために使用されたパン
クチャド符号化に依存する）からなる。ダミー・サンプ
ルは読み出される前に適正なロケーションにも挿入され
る。
に、パンクチャド符号のために使用され、このようなパ
ンクチャド符号に対して、指定された削除マップに対応
するダミー・データを挿入することを担当している。ト
レリス符号の場合は、ダミー・データ・インサータ３０
２は、単に、入力データをその出力端子に渡すだけであ
る。符号および対応する削除マップの選択は、マイクロ
コントローラ・インタフェース２０４を通してダミー・
データ・インサータ３０２へ伝達される。ダミー・デー
タ・インサータ３０２は、採用した符号化方式に依存す
るレートの内部クロックで、データをクロックアウトす
る。入力データと出力データのレートは、（パンクチャ
ド符号の場合）異なるので、データ入力クロック・イネ
ーブル（DICE）信号と、データ出力クロック・イネーブ
ル（DOCE）信号は、一義的である。DICE信号は受信装置
復調器２０２からのクロック・イネーブルであり、一
方、DOCE信号はダミー・データ・インサータ３０２で生
成される（しかも、クロック信号から取り出される）。
特に、ダミー・データ・インサータ３０２は、ＦＩＦＯ
記憶機構と、適正なロケーションのソフト判定サンプル
に書き込むための書込みクロックと、分岐メトリック計
算のためにデータを読み出すための読み出しクロック
（読み出しクロックは書込みクロックよりもレートが高
く、そのクロッキング・レートのために使用されたパン
クチャド符号化に依存する）からなる。ダミー・サンプ
ルは読み出される前に適正なロケーションにも挿入され
る。
【００２２】分岐メトリック・コンピュータ３０６（分
岐メトリック・コンピュータ３０６の詳細は図６および
図７を参照して後程説明する）は、連続して受信された
シンボル・パケットにそれぞれ応答して４個の５ビット
出力を別々に出力する。これら４個の出力と、分岐メト
リック・コンピュータ３０６からのDOCE信号は、Viterb
i 復号化器３０６の入力として入力される。Viterbi 復
号化器３０６は、レートがＲ＝１／２であって、制約長
がｋ＝７の復号化器であり、パンクチャド符号と、トレ
リス符号に対してViterbi アルゴリズムを実行する。こ
のアルゴリズムでは、分岐メトリック・コンピュータ３
０６からの５ビット・メトリック入力を用いて、状態が
更新され、ビット判定が行われる。Viterbi 復号化器３
０６は加算−比較−選択（ＡＣＳ）手段と、パス・メト
リック記憶手段を採用し、トレリスで、各レベルのサー
バイバ・パス(survivor path) 用のメモリを採用してい
る。さらに、Viterbi 復号化器３０６は、累積されたメ
トリックのビルドアップと、オーバフローを回避するた
め、メトリック再正規化も担当している。
岐メトリック・コンピュータ３０６の詳細は図６および
図７を参照して後程説明する）は、連続して受信された
シンボル・パケットにそれぞれ応答して４個の５ビット
出力を別々に出力する。これら４個の出力と、分岐メト
リック・コンピュータ３０６からのDOCE信号は、Viterb
i 復号化器３０６の入力として入力される。Viterbi 復
号化器３０６は、レートがＲ＝１／２であって、制約長
がｋ＝７の復号化器であり、パンクチャド符号と、トレ
リス符号に対してViterbi アルゴリズムを実行する。こ
のアルゴリズムでは、分岐メトリック・コンピュータ３
０６からの５ビット・メトリック入力を用いて、状態が
更新され、ビット判定が行われる。Viterbi 復号化器３
０６は加算−比較−選択（ＡＣＳ）手段と、パス・メト
リック記憶手段を採用し、トレリスで、各レベルのサー
バイバ・パス(survivor path) 用のメモリを採用してい
る。さらに、Viterbi 復号化器３０６は、累積されたメ
トリックのビルドアップと、オーバフローを回避するた
め、メトリック再正規化も担当している。
【００２３】Viterbi 復号化器３０６からの１ビット出
力は、畳み込み符号化器３０８の入力として入力され
る。トレリス符号およびパンクチャド符号に対して、畳
み込み符号化器３０８は、レート１／２の埋込み符号の
うちの２つの送信された符号の最良推測(best estimat
e) を再生成するのにサーブする。また、畳み込み符号
化器３０８からの出力は同期モニタ３１４にも入力さ
れ、パンクチャド符号の同期ステータスを検査する際に
使用される。さらに、Viterbi 復号化器３０６からの１
ビット出力は、選択手段３１６の入力として入力され
る。
力は、畳み込み符号化器３０８の入力として入力され
る。トレリス符号およびパンクチャド符号に対して、畳
み込み符号化器３０８は、レート１／２の埋込み符号の
うちの２つの送信された符号の最良推測(best estimat
e) を再生成するのにサーブする。また、畳み込み符号
化器３０８からの出力は同期モニタ３１４にも入力さ
れ、パンクチャド符号の同期ステータスを検査する際に
使用される。さらに、Viterbi 復号化器３０６からの１
ビット出力は、選択手段３１６の入力として入力され
る。
【００２４】畳み込み符号化器３０８からの２ビット出
力は、トレリス・デマッパ３１０に供給される。トレリ
ス・デマッパ３１０は図５に示すオペレーシヨンのトレ
リス符号化モードに対してシンボル判定を行うことを担
当する。オペレーションがトレリス符号化モードである
場合は、トレリス・デマッパ３１０は、サブセットを選
択するために、畳み込み符号化器３０８からの２ビット
出力を用い、同様に、遅延ロジック３１２を介してトレ
リス・デマッパ３１０に転送された、遅延されたＩ，Ｑ
受信シンボル・データを用いて、シンボル判定を行う。
トレリス・デマッパ３１０からの６ビット出力は、同期
モニタ３１４と選択手段３１６の両方の入力として入力
される。
力は、トレリス・デマッパ３１０に供給される。トレリ
ス・デマッパ３１０は図５に示すオペレーシヨンのトレ
リス符号化モードに対してシンボル判定を行うことを担
当する。オペレーションがトレリス符号化モードである
場合は、トレリス・デマッパ３１０は、サブセットを選
択するために、畳み込み符号化器３０８からの２ビット
出力を用い、同様に、遅延ロジック３１２を介してトレ
リス・デマッパ３１０に転送された、遅延されたＩ，Ｑ
受信シンボル・データを用いて、シンボル判定を行う。
トレリス・デマッパ３１０からの６ビット出力は、同期
モニタ３１４と選択手段３１６の両方の入力として入力
される。
【００２５】遅延ロジック３１２はViterbi 復号化器３
０６／符号化器３０８と、関連する回路とによる遅延を
相殺し、符号化器３０８の出力端子に現れたデータ・ス
トリームを、受信されたシンボル・ストリームと同期さ
せる。マイクロコントローラ・インタフェース２０４か
らの制御入力は、Viterbi 復号化器の４つの可能なパス
・メモリ長のうちの１つを選択する。Viterbi 復号化器
は遅延ロジック３１２の遅延時間を適正に選択するため
にも使用される。
０６／符号化器３０８と、関連する回路とによる遅延を
相殺し、符号化器３０８の出力端子に現れたデータ・ス
トリームを、受信されたシンボル・ストリームと同期さ
せる。マイクロコントローラ・インタフェース２０４か
らの制御入力は、Viterbi 復号化器の４つの可能なパス
・メモリ長のうちの１つを選択する。Viterbi 復号化器
は遅延ロジック３１２の遅延時間を適正に選択するため
にも使用される。
【００２６】同期モニタ３１４は、同期回路３００と、
トレリス・デマッパ３１０からの出力と、符号化器３０
８と、遅延ロジック３１２からの出力と、マイクロコン
トローラ・インタフェース２０４とに結合されている。
同期モニタ３１４はマイクロコントローラ・インタフェ
ース２０４からの監視インターバル指定とともに、分岐
メトリック情報を使用し、同期ステータスを判定する。
また、同期モニタ３１４は任意指定の自動同期をとるた
め、情報を同期回路３００に供給する。オペレーション
の自動同期モードでは、内部同期回路が採用され、同期
化機能をパフォームする。あるいはまた、同期は外部回
路からとることもできる。同期モニタ３１４は位相のあ
いまいさを解決するため、信号を復調器に供給する。こ
の信号は、受信装置復調器２０２での位相のあいまいさ
を相殺する目的だけに使用される。さらに、同期モニタ
は、復調された同期信号を出力する。この同期信号は受
信装置１００の下流側コンポーネントによって使用され
る。
トレリス・デマッパ３１０からの出力と、符号化器３０
８と、遅延ロジック３１２からの出力と、マイクロコン
トローラ・インタフェース２０４とに結合されている。
同期モニタ３１４はマイクロコントローラ・インタフェ
ース２０４からの監視インターバル指定とともに、分岐
メトリック情報を使用し、同期ステータスを判定する。
また、同期モニタ３１４は任意指定の自動同期をとるた
め、情報を同期回路３００に供給する。オペレーション
の自動同期モードでは、内部同期回路が採用され、同期
化機能をパフォームする。あるいはまた、同期は外部回
路からとることもできる。同期モニタ３１４は位相のあ
いまいさを解決するため、信号を復調器に供給する。こ
の信号は、受信装置復調器２０２での位相のあいまいさ
を相殺する目的だけに使用される。さらに、同期モニタ
は、復調された同期信号を出力する。この同期信号は受
信装置１００の下流側コンポーネントによって使用され
る。
【００２７】選択手段３１６は、Viterbi 復号化器３０
６の１ビット出力と、トレリス・デマッパ３１０の６ビ
ット出力を受信する。選択手段３１６は、畳み込み復号
化器がトレリス符号モードで動作しているときは、これ
らの７ビットを全てその出力端子に転送し、畳み込み復
号化器がパンクチャド符号モードで動作しているとき
は、Viterbi 復号化器３０６の出力からの１ビットのみ
を、選択手段３１６の出力端子に転送する。この出力デ
ータはクロックおよびDOCE信号とともに、選択手段３１
６から供給され、受信装置１００の下流側コンポーネン
トによって使用される。
６の１ビット出力と、トレリス・デマッパ３１０の６ビ
ット出力を受信する。選択手段３１６は、畳み込み復号
化器がトレリス符号モードで動作しているときは、これ
らの７ビットを全てその出力端子に転送し、畳み込み復
号化器がパンクチャド符号モードで動作しているとき
は、Viterbi 復号化器３０６の出力からの１ビットのみ
を、選択手段３１６の出力端子に転送する。この出力デ
ータはクロックおよびDOCE信号とともに、選択手段３１
６から供給され、受信装置１００の下流側コンポーネン
トによって使用される。
【００２８】分岐メトリック・コンピュータ３０４の構
造は、ＲＡＭ(random access memory)４００と、メモリ
・バンク０，１のＩ，Ｑ加算器４０２と、メモリ・バン
ク０，１のＩ，Ｑコンパレータ４０４を備えている。Ｒ
ＡＭ４００はROM(read-onlymemory) でも可能である。
ＲＡＭ４００には、マイクロコントローラ・インタフェ
ース２０４から、制御入力として入力された、プログラ
マブルで、事前に計算されたＩ，Ｑルックアップ・テー
ブルが、初期化フェーズ中にプリロードされる。（QPSK
ベースのパンクチャド符号化シンボルをデパンクチャす
る）ダミー・データ・インサータ３０２から、信号入力
としてＲＡＭ４００に転送されたＩ，Ｑ信号に応答し
て、これらのルックアップ・テーブルのＩ，Ｑエントリ
のうちの選択されたエントリがＲＡＭ４００からの出力
として読み出され、入力としてメモリ・バンク０，１の
Ｉ，Ｑ加算器４０２に入力される。メモリ・バンク０，
１のＩ，Ｑ加算器４０２からの出力は、入力としてメモ
リ・バンク０，１のＩ，Ｑコンパレータ４０４へ送ら
れ、メモリ・バンク０，１のＩ，Ｑコンパレータ４０４
からの出力は、入力としてViterbi 復号化器３０６に転
送される。
造は、ＲＡＭ(random access memory)４００と、メモリ
・バンク０，１のＩ，Ｑ加算器４０２と、メモリ・バン
ク０，１のＩ，Ｑコンパレータ４０４を備えている。Ｒ
ＡＭ４００はROM(read-onlymemory) でも可能である。
ＲＡＭ４００には、マイクロコントローラ・インタフェ
ース２０４から、制御入力として入力された、プログラ
マブルで、事前に計算されたＩ，Ｑルックアップ・テー
ブルが、初期化フェーズ中にプリロードされる。（QPSK
ベースのパンクチャド符号化シンボルをデパンクチャす
る）ダミー・データ・インサータ３０２から、信号入力
としてＲＡＭ４００に転送されたＩ，Ｑ信号に応答し
て、これらのルックアップ・テーブルのＩ，Ｑエントリ
のうちの選択されたエントリがＲＡＭ４００からの出力
として読み出され、入力としてメモリ・バンク０，１の
Ｉ，Ｑ加算器４０２に入力される。メモリ・バンク０，
１のＩ，Ｑ加算器４０２からの出力は、入力としてメモ
リ・バンク０，１のＩ，Ｑコンパレータ４０４へ送ら
れ、メモリ・バンク０，１のＩ，Ｑコンパレータ４０４
からの出力は、入力としてViterbi 復号化器３０６に転
送される。
【００２９】特に、ＲＡＭ４００は、機能的には、図７
に示すように、メトリック・メモリ・バンク０と、メト
リック・メモリ・バンク１により編成されている。メモ
リ・バンク０は、１番目のＩサブセット００と１番目の
Ｑサブセット００とを備えた第１サブセット・ペアと、
２番目のＩサブセット０１と２番目のＱサブセット０１
とを備えた第２サブセット・ペアと、３番目のＩサブセ
ット１１と３番目のＱサブセット１１とを備えた第３サ
ブセット・ペアと、４番目のＩサブセット１０と４番目
のＱサブセット１０を備えた第４ブセット・ペアにより
構成されている。メモリ・バンク１もＩ，Ｑサブセット
の４つの同様のペアにより構成されているので、総計８
ペアのＩ，ＱサブセットがＲＡＭ４００に供給される。
８個のＩサブセットは、それぞれ、ＲＡＭ４００へのＩ
信号入力を受信し、８個のＱサブセットは、それぞれ、
ＲＡＭ４００へのＱ信号入力を受信する。一般的に、
Ｉ，Ｑ信号入力は、それぞれ、ｘビット信号である（特
に、図３に示す例では、６ビット信号と仮定する）。８
個のＩサブセットは、それぞれ、ｍビット出力を取り出
し（説明上、４ビット信号出力と仮定する）、８個のＱ
サブセットは、れぞれそ、ｍビット信号出力を取り出
す。
に示すように、メトリック・メモリ・バンク０と、メト
リック・メモリ・バンク１により編成されている。メモ
リ・バンク０は、１番目のＩサブセット００と１番目の
Ｑサブセット００とを備えた第１サブセット・ペアと、
２番目のＩサブセット０１と２番目のＱサブセット０１
とを備えた第２サブセット・ペアと、３番目のＩサブセ
ット１１と３番目のＱサブセット１１とを備えた第３サ
ブセット・ペアと、４番目のＩサブセット１０と４番目
のＱサブセット１０を備えた第４ブセット・ペアにより
構成されている。メモリ・バンク１もＩ，Ｑサブセット
の４つの同様のペアにより構成されているので、総計８
ペアのＩ，ＱサブセットがＲＡＭ４００に供給される。
８個のＩサブセットは、それぞれ、ＲＡＭ４００へのＩ
信号入力を受信し、８個のＱサブセットは、それぞれ、
ＲＡＭ４００へのＱ信号入力を受信する。一般的に、
Ｉ，Ｑ信号入力は、それぞれ、ｘビット信号である（特
に、図３に示す例では、６ビット信号と仮定する）。８
個のＩサブセットは、それぞれ、ｍビット出力を取り出
し（説明上、４ビット信号出力と仮定する）、８個のＱ
サブセットは、れぞれそ、ｍビット信号出力を取り出
す。
【００３０】ＲＡＭ４００からの８個のＩ，Ｑ信号出力
（ｍビット）は、全て、メモリ・バンク０，１のＩ，Ｑ
加算器４０２の各加算器の入力として転送される。特
に、バンク０の第１サブセット・ペアからの２つの出力
は、第１および第２入力として加算器４０２−１に供給
される。バンク０の第２サブセット・ペアからの２つの
出力は、第１および第２入力として加算器４０２−２に
供給される。バンク０の第３サブセット・ペアからの２
つの出力は、第１および第２入力として加算器４０２−
３に供給される。バンク０の第４サブセット・ペアから
の２つの出力は、第１および第２入力として加算器４０
２−４に供給される。バンク１の第１サブセット・ペア
からの２つの出力は、第１および第２入力として加算器
４０２−５に供給される。バンク１の第２サブセット・
ペアからの２つの出力は、第１および第２入力として加
算器４０２−６に供給される。バンク１の第３サブセッ
ト・ペアからの２つの出力は、第１および第２入力とし
て加算器４０２−７に供給される。バンク１の第４サブ
セット・ペアからの２つの出力は、第１および第２入力
として加算器４０２−８に供給される。（ｍ＋１）ビッ
ト出力信号（すなわち、５ビット信号と仮定する）は、
それぞれ、８個の加算器からそれぞれ取り出される。
（ｍビット）は、全て、メモリ・バンク０，１のＩ，Ｑ
加算器４０２の各加算器の入力として転送される。特
に、バンク０の第１サブセット・ペアからの２つの出力
は、第１および第２入力として加算器４０２−１に供給
される。バンク０の第２サブセット・ペアからの２つの
出力は、第１および第２入力として加算器４０２−２に
供給される。バンク０の第３サブセット・ペアからの２
つの出力は、第１および第２入力として加算器４０２−
３に供給される。バンク０の第４サブセット・ペアから
の２つの出力は、第１および第２入力として加算器４０
２−４に供給される。バンク１の第１サブセット・ペア
からの２つの出力は、第１および第２入力として加算器
４０２−５に供給される。バンク１の第２サブセット・
ペアからの２つの出力は、第１および第２入力として加
算器４０２−６に供給される。バンク１の第３サブセッ
ト・ペアからの２つの出力は、第１および第２入力とし
て加算器４０２−７に供給される。バンク１の第４サブ
セット・ペアからの２つの出力は、第１および第２入力
として加算器４０２−８に供給される。（ｍ＋１）ビッ
ト出力信号（すなわち、５ビット信号と仮定する）は、
それぞれ、８個の加算器からそれぞれ取り出される。
【００３１】加算器からの８個の（ｍ＋１）ビット出力
信号は、全て、入力として、メモリ・バンク０，１の
Ｉ，Ｑコンパレータ４０４の各コンパレータに転送され
る。特に、加算器４０２−１および４０２−５からの出
力は、第１および第２入力として、コンパレータ４０４
−１に供給される。加算器４０２−２および４０２−６
からの出力は、第１および第２入力として、コンパレー
タ４０４−２に供給される。加算器４０２−３および４
０２−７からの出力は、第１および第２入力として、コ
ンパレータ４０４−３に供給される。加算器４０２−４
および４０４−８からの出力は、第１および第２入力と
して、コンパレータ４０４−４に供給される。これらコ
ンパレータは、それぞれ、２個の（ｍ＋１）ビット入力
のうちの小さい方の値を、その出力端子に渡す。４個の
コンパレータからの各出力は、分岐メトリック・コンピ
ュータ３０４からの出力を構成し（すなわち、４個の５
ビット出力と仮定する）、Viterbi 復号化器３０６の入
力として供給される。
信号は、全て、入力として、メモリ・バンク０，１の
Ｉ，Ｑコンパレータ４０４の各コンパレータに転送され
る。特に、加算器４０２−１および４０２−５からの出
力は、第１および第２入力として、コンパレータ４０４
−１に供給される。加算器４０２−２および４０２−６
からの出力は、第１および第２入力として、コンパレー
タ４０４−２に供給される。加算器４０２−３および４
０２−７からの出力は、第１および第２入力として、コ
ンパレータ４０４−３に供給される。加算器４０２−４
および４０４−８からの出力は、第１および第２入力と
して、コンパレータ４０４−４に供給される。これらコ
ンパレータは、それぞれ、２個の（ｍ＋１）ビット入力
のうちの小さい方の値を、その出力端子に渡す。４個の
コンパレータからの各出力は、分岐メトリック・コンピ
ュータ３０４からの出力を構成し（すなわち、４個の５
ビット出力と仮定する）、Viterbi 復号化器３０６の入
力として供給される。
【００３２】構造的には、ＲＡＭ４００は、ビット記憶
サイズは固定であり、実効デプス(depth) が２x 個の記
憶ロケーションである（すなわち、この仮定例では、ロ
ケーション１ないし６４に対応し、ｘ＝６である）。Ｒ
ＡＭ ４００のバンク０へのＩ，Ｑ信号入力と、バンク
１へのＩ，Ｑ信号入力は、それぞれ、個々のルックアッ
プ・テーブルと関係付けてある。ＲＡＭ４００の幅は、
予め計算された４個の４ｍビット幅（この仮定例では、
ｍ＝４である）のルックアップ・テーブルをストアする
のに充分な幅になっている。ルックアップ・テーブルは
それぞれ２x 個のエントリにより構成されており、これ
らエントリはプログラマブルＩ，Ｑルックアップ・テー
ブル制御入力端子を介してルックアップ・テーブルに供
給される。従って、ＲＡＭ４００のビット記憶サイズ
は、(2X)(4) (4m)である。すなわち、この仮定例では、
ビット記憶サイズは4096ビットである。パンクチャドQP
SKベースの符号をインプリメントする場合の技法は、最
大のＩ，Ｑ値を渡し、パンクチャド・メトリックスをル
ックアップ・テーブル内の適正なロケーションにストア
するという簡単な技法である。このため、実際のＩ，Ｑ
データをクリッピングする必要があるが、このクリッピ
ングは復号化器２００のフロントエンドでハンドルする
ことができる。さらに、ルックアップ・テーブルは、有
意性の低い方のＩ，Ｑ信号データを無視することによ
り、所望の最大分岐メトリック値を許容するようにプロ
グラムすることができる。
サイズは固定であり、実効デプス(depth) が２x 個の記
憶ロケーションである（すなわち、この仮定例では、ロ
ケーション１ないし６４に対応し、ｘ＝６である）。Ｒ
ＡＭ ４００のバンク０へのＩ，Ｑ信号入力と、バンク
１へのＩ，Ｑ信号入力は、それぞれ、個々のルックアッ
プ・テーブルと関係付けてある。ＲＡＭ４００の幅は、
予め計算された４個の４ｍビット幅（この仮定例では、
ｍ＝４である）のルックアップ・テーブルをストアする
のに充分な幅になっている。ルックアップ・テーブルは
それぞれ２x 個のエントリにより構成されており、これ
らエントリはプログラマブルＩ，Ｑルックアップ・テー
ブル制御入力端子を介してルックアップ・テーブルに供
給される。従って、ＲＡＭ４００のビット記憶サイズ
は、(2X)(4) (4m)である。すなわち、この仮定例では、
ビット記憶サイズは4096ビットである。パンクチャドQP
SKベースの符号をインプリメントする場合の技法は、最
大のＩ，Ｑ値を渡し、パンクチャド・メトリックスをル
ックアップ・テーブル内の適正なロケーションにストア
するという簡単な技法である。このため、実際のＩ，Ｑ
データをクリッピングする必要があるが、このクリッピ
ングは復号化器２００のフロントエンドでハンドルする
ことができる。さらに、ルックアップ・テーブルは、有
意性の低い方のＩ，Ｑ信号データを無視することによ
り、所望の最大分岐メトリック値を許容するようにプロ
グラムすることができる。
【００３３】上述したように、分岐メトリック・コンピ
ュータ３０４は、Viterbi アルゴリズム・ベースの畳み
込み復号化器２００のコンポーネントである。畳み込み
復号化器２００は、ノイズの多いチャネルを介しての衛
星モデムのオペレーションに対して、QPSKベースのパン
クチャド符号を復号化するために用いられ、一方、ノイ
ズの多いチャネルを介しての地上またはケーブルのオペ
レーションに対して、上位アルファベット（１６と、３
２と、６４と、１２８と、２５６ PAM またはQAM また
は8-PSK ）ベースのレートｎ／ｎ＋１・プラグマティク
・トレリス符号を復号化するために用いられる。公知の
ように、チャネル・ノイズのために、Ｉ，Ｑプレーン内
の受信復調シンボルのロケーション・ポイントは、Ｉ，
Ｑプレーン内の送信ロケーション・ポイントからずれる
ことになる。連続して受信された復調シンボルのＩ，Ｑ
プレーン内のロケーション・ポイントは、ＲＡＭ ４０
０へのＩ，Ｑ信号入力によって、２2x（すなわち、この
仮定例では、64×64＝4096である）の解像度で定義され
ている。ＲＡＭ４００に関して注意すべき重要なこと
は、そのメモリ必要量がアルファベット・サイズに依存
しないことである。
ュータ３０４は、Viterbi アルゴリズム・ベースの畳み
込み復号化器２００のコンポーネントである。畳み込み
復号化器２００は、ノイズの多いチャネルを介しての衛
星モデムのオペレーションに対して、QPSKベースのパン
クチャド符号を復号化するために用いられ、一方、ノイ
ズの多いチャネルを介しての地上またはケーブルのオペ
レーションに対して、上位アルファベット（１６と、３
２と、６４と、１２８と、２５６ PAM またはQAM また
は8-PSK ）ベースのレートｎ／ｎ＋１・プラグマティク
・トレリス符号を復号化するために用いられる。公知の
ように、チャネル・ノイズのために、Ｉ，Ｑプレーン内
の受信復調シンボルのロケーション・ポイントは、Ｉ，
Ｑプレーン内の送信ロケーション・ポイントからずれる
ことになる。連続して受信された復調シンボルのＩ，Ｑ
プレーン内のロケーション・ポイントは、ＲＡＭ ４０
０へのＩ，Ｑ信号入力によって、２2x（すなわち、この
仮定例では、64×64＝4096である）の解像度で定義され
ている。ＲＡＭ４００に関して注意すべき重要なこと
は、そのメモリ必要量がアルファベット・サイズに依存
しないことである。
【００３４】現在受信された復調シンボルに対応する０
バンクのＩ，Ｑルックアップ・テーブルのそれぞれの４
ｍビット（この仮定例では、４ビット）エントリによ
り、次のように定義されている。すなわち、現在受信さ
れた復調シンボルのロケーション・ポイントを取り巻
く、４つの特定の有効シンボル・データ点配置サブセッ
トの各ロケーション・ポイントのＩ，Ｑプレーンにおい
て、現在受信された復調シンボルのロケーション・ポイ
ントからの個々の距離のＩ成分とＱ成分を定義してい
る。
バンクのＩ，Ｑルックアップ・テーブルのそれぞれの４
ｍビット（この仮定例では、４ビット）エントリによ
り、次のように定義されている。すなわち、現在受信さ
れた復調シンボルのロケーション・ポイントを取り巻
く、４つの特定の有効シンボル・データ点配置サブセッ
トの各ロケーション・ポイントのＩ，Ｑプレーンにおい
て、現在受信された復調シンボルのロケーション・ポイ
ントからの個々の距離のＩ成分とＱ成分を定義してい
る。
【００３５】QPSKの場合（この場合には、各サブセット
・ロケーション・ポイントは単一のシンポル・ロケーシ
ョン・ポイントのみを定義している）と、上位アルファ
ベットPAM またはQAM の場合（この場合には、各サブセ
ット・ロケーション・ポイントはViterbi 復号化器２０
６が必要とするそのアルファベット内のシンボルの１／
４のサブセットのロケーションに対応しており、トレリ
ス・デマッパ３１０は、そこに供給された遅延受信デー
タに基づいてサブセット内の正しいポイントを選択す
る）には、単一のＩ成分とＱ成分は、４つのサブセット
があいまいなく定義される。そのため、これらの場合に
は、ＲＡＭ４００のバンク０のみが必要である。しか
し、8-PSK の場合には、独立に使用された単一のＩ成分
と単一のＱ成分は、４つのシンボル・サブセットをあい
まいなく定義するには不充分である。そのため、8-PSK
の場合には、バンク０を用いて、０°、９０°、１８０
°、２７０°ロケーション・ポイントが定義される。バ
ンク１（これは上述したバンク０のそれと同じように動
作する）を用いて、４５°、１３５°、２２５°、３１
５°ロケーション・ポイントが定義される。コンパレー
タ４０４−１〜４０４−４は、ＲＡＭ４００のバンク０
とバンク１の両方から取り出されたデータを採用してお
り、コンパレータ４０４−１〜４０４−４を用いて、次
に説明するように、このあいまいさが解決される。
・ロケーション・ポイントは単一のシンポル・ロケーシ
ョン・ポイントのみを定義している）と、上位アルファ
ベットPAM またはQAM の場合（この場合には、各サブセ
ット・ロケーション・ポイントはViterbi 復号化器２０
６が必要とするそのアルファベット内のシンボルの１／
４のサブセットのロケーションに対応しており、トレリ
ス・デマッパ３１０は、そこに供給された遅延受信デー
タに基づいてサブセット内の正しいポイントを選択す
る）には、単一のＩ成分とＱ成分は、４つのサブセット
があいまいなく定義される。そのため、これらの場合に
は、ＲＡＭ４００のバンク０のみが必要である。しか
し、8-PSK の場合には、独立に使用された単一のＩ成分
と単一のＱ成分は、４つのシンボル・サブセットをあい
まいなく定義するには不充分である。そのため、8-PSK
の場合には、バンク０を用いて、０°、９０°、１８０
°、２７０°ロケーション・ポイントが定義される。バ
ンク１（これは上述したバンク０のそれと同じように動
作する）を用いて、４５°、１３５°、２２５°、３１
５°ロケーション・ポイントが定義される。コンパレー
タ４０４−１〜４０４−４は、ＲＡＭ４００のバンク０
とバンク１の両方から取り出されたデータを採用してお
り、コンパレータ４０４−１〜４０４−４を用いて、次
に説明するように、このあいまいさが解決される。
【００３６】加算器４０２−１〜４０２−８は、ＲＡＭ
４００から読み出された有効なデータ点配置のロケー
ション・ポイントまでの距離のＩ成分とＱ成分を用い
て、８個のサブセットによりそれぞれ定義されたいわゆ
るマンハッタン距離（Ｉ＋Ｑ）を計算する。このマンハ
ッタン距離の割当ては、真のユークリッド距離（I2＋
Q2）1/2 ではないが、Ｉ，Ｑプレーン内の近い方のポイ
ントに対する重み付けを、受信されたシンボル・ロケー
ション・ポイントからより遠く離れたＩ，Ｑプレーン内
のポイントよりも大きくした距離尺度である。マンハッ
タン距離メトリックは、Ｉ，Ｑの２次元空間内の２つの
ポイントのＩ，Ｑ座標間の差の和を用いる。この距離尺
度は距離に対してモノトニック（単調）であるが、ポイ
ントへの重み付けは、距離が計算されているポイントに
対する位置により異なる。しかし、マンハッタン距離メ
トリックを用いることにより、Ｉ，Ｑ座標に対する演算
が切り離され、独立に行われる。よって、任意の受信ロ
ケーション・ポイントから有効なデータ点配置のロケー
ション・ポイントまでの可能な距離をストアするのに必
要なメモリ量が大幅に削減される。
４００から読み出された有効なデータ点配置のロケー
ション・ポイントまでの距離のＩ成分とＱ成分を用い
て、８個のサブセットによりそれぞれ定義されたいわゆ
るマンハッタン距離（Ｉ＋Ｑ）を計算する。このマンハ
ッタン距離の割当ては、真のユークリッド距離（I2＋
Q2）1/2 ではないが、Ｉ，Ｑプレーン内の近い方のポイ
ントに対する重み付けを、受信されたシンボル・ロケー
ション・ポイントからより遠く離れたＩ，Ｑプレーン内
のポイントよりも大きくした距離尺度である。マンハッ
タン距離メトリックは、Ｉ，Ｑの２次元空間内の２つの
ポイントのＩ，Ｑ座標間の差の和を用いる。この距離尺
度は距離に対してモノトニック（単調）であるが、ポイ
ントへの重み付けは、距離が計算されているポイントに
対する位置により異なる。しかし、マンハッタン距離メ
トリックを用いることにより、Ｉ，Ｑ座標に対する演算
が切り離され、独立に行われる。よって、任意の受信ロ
ケーション・ポイントから有効なデータ点配置のロケー
ション・ポイントまでの可能な距離をストアするのに必
要なメモリ量が大幅に削減される。
【００３７】コンパレータ４０４−１〜４０４は、それ
ぞれ、バンク０とバンク１から供給された２つのメトリ
ックのうちの小さい方のメトリックを入力として渡すよ
うに設計されている。従って、8-PSK ベースの符号の場
合は、コンパレータ４０４−１〜４０４−２は、それぞ
れ、バンク０またはバンク１からのメトリック入力のの
うちどちらが小さいかにより、どちらかのメトリック入
力を出力として得ることになる。しかし、QPSK、PAM ま
たはQAM ベースの符号の場合には、ＲＡＭ４００のバン
ク１にストアされたＩ，Ｑルックアップ・テーブルは、
最大値のメトリックが入るようにプログラムされている
ので、これらは実効的にはインアクティブになってい
る。従って、コンパレータ４０４−１〜４０４−４は、
それぞれ、ＲＡＭ４００のバンク０から選択されたメト
リックを渡すようになっている。8-PSK ベースの符号を
受信するようには設計されていないマルチチャネル受信
装置では、これらのコンパレータとＲＡＭ４００のメモ
リ・バンク１を除去することができる（除去すると、Ｒ
ＡＭ４００に要求されるメモリ記憶容量が半分に削減さ
れる）。
ぞれ、バンク０とバンク１から供給された２つのメトリ
ックのうちの小さい方のメトリックを入力として渡すよ
うに設計されている。従って、8-PSK ベースの符号の場
合は、コンパレータ４０４−１〜４０４−２は、それぞ
れ、バンク０またはバンク１からのメトリック入力のの
うちどちらが小さいかにより、どちらかのメトリック入
力を出力として得ることになる。しかし、QPSK、PAM ま
たはQAM ベースの符号の場合には、ＲＡＭ４００のバン
ク１にストアされたＩ，Ｑルックアップ・テーブルは、
最大値のメトリックが入るようにプログラムされている
ので、これらは実効的にはインアクティブになってい
る。従って、コンパレータ４０４−１〜４０４−４は、
それぞれ、ＲＡＭ４００のバンク０から選択されたメト
リックを渡すようになっている。8-PSK ベースの符号を
受信するようには設計されていないマルチチャネル受信
装置では、これらのコンパレータとＲＡＭ４００のメモ
リ・バンク１を除去することができる（除去すると、Ｒ
ＡＭ４００に要求されるメモリ記憶容量が半分に削減さ
れる）。
【００３８】
【発明の効果】ここで開示した畳み込み復号化器は、主
に、パンクチャド符号化か、あるいは、プラグマティク
・トレリス符号化圧縮ディジタルＴＶデータを受信する
マルチチャネルＴＶ受信装置で使用されるものである
が、開示した畳み込み復号化器によって復号化すること
ができる符号化データのタイプは、ＴＶデータのみに限
定すべきではなく、開示した畳み込み復号化器により復
号化できる他の種類の符号化データにより採用すること
ができる。
に、パンクチャド符号化か、あるいは、プラグマティク
・トレリス符号化圧縮ディジタルＴＶデータを受信する
マルチチャネルＴＶ受信装置で使用されるものである
が、開示した畳み込み復号化器によって復号化すること
ができる符号化データのタイプは、ＴＶデータのみに限
定すべきではなく、開示した畳み込み復号化器により復
号化できる他の種類の符号化データにより採用すること
ができる。
【００３９】以上説明したように、開示した復号化器装
置は、衛星と、地上と、ケーブルＴＶデータの受信装置
で使用するのに適しており、その上、電話と、直接マイ
クロウェーブと、光ファイバ伝送を含む他の応用分野で
使用するのに適している。
置は、衛星と、地上と、ケーブルＴＶデータの受信装置
で使用するのに適しており、その上、電話と、直接マイ
クロウェーブと、光ファイバ伝送を含む他の応用分野で
使用するのに適している。
【図１】順方向エラー訂正圧縮ディジタルＴＶ送信装置
から送信され、マルチチャネル圧縮ディジタルＴＶ受信
装置によって受信可能な異種タイプの伝送チャネルを示
す図である。
から送信され、マルチチャネル圧縮ディジタルＴＶ受信
装置によって受信可能な異種タイプの伝送チャネルを示
す図である。
【図２】図１のマルチチャネル圧縮ディジタルＴＶ受信
装置の畳み込み復号化器と、入力を復号化器へ印加する
デモジュレータと、デコーダとのマイクロコントローラ
・インタフェース間の関係を示すブロック図である。
装置の畳み込み復号化器と、入力を復号化器へ印加する
デモジュレータと、デコーダとのマイクロコントローラ
・インタフェース間の関係を示すブロック図である。
【図３】図２に示す畳み込み復号化器の構成要素を示す
ブロック図であり、図２のマイクロコントローラ・イン
タフェースが畳み込み復号化器の構成要素にどのように
結合されているかを示すブロック図である。
ブロック図であり、図２のマイクロコントローラ・イン
タフェースが畳み込み復号化器の構成要素にどのように
結合されているかを示すブロック図である。
【図４】図３のマイクロコントローラ・インタフェース
によってパンクチャド・コード復号化モードで動作する
ようにプログラムされているときの、図３に示す畳み込
み復号化器の動作要素を示すブロック図である。
によってパンクチャド・コード復号化モードで動作する
ようにプログラムされているときの、図３に示す畳み込
み復号化器の動作要素を示すブロック図である。
【図５】図３のマイクロコントローラ・インタフェース
によってプラグマティク・トレリス・コード復号化モー
ドで動作するようにプログラムされているときの、図３
に示す畳み込み復号化器の動作要素を示すブロック図で
ある。
によってプラグマティク・トレリス・コード復号化モー
ドで動作するようにプログラムされているときの、図３
に示す畳み込み復号化器の動作要素を示すブロック図で
ある。
【図６】図３に示す分岐メトリック・コンピュータの構
成要素を示すブロック図である。
成要素を示すブロック図である。
【図７】図６に示す分岐メトリック・コンピュータの構
成要素の機能編成を示す図である。
成要素の機能編成を示す図である。
１００ マルチチャネル圧縮ディジタルＴＶ受信装置 １０２ 衛星伝送チャネル １０４ 順方向エラー訂正ＴＶ送信装置 １０６ 地上伝送チャネル １０８ 順方向エラー訂正ＴＶ送信装置 １１０ ケーブル伝送チャネル １１２ 順方向エラー訂正ＴＶ送信装置 ２００ 受信装置畳み込み復号化器 ２０２ 受信装置復調器 ２０４ マイクロコントローラ・インタフェース ３００ 同期回路 ３０２ ダミー・データ・インサータ ３０４ 分岐メトリック・コンピュータ ３０６ Viterbi 復号化器 ３０８ 畳み込み符号化器 ３１０ トレリス・デマッパ ３１２ 遅延ロジック ３１４ 同期モニタ ３１６ 選択手段 ４００ ＲＡＭ ４０２ 加算器 ４０４ コンパレータ
フロントページの続き (72)発明者 クマール ラマスワミ アメリカ合衆国 46201−2598 インディ アナ州 インディアナポリス カレッジ ドライブ 9417−ビー (72)発明者 ジョン シドニー スチュワート アメリカ合衆国 46268 インディアナ州 インディアナポリス ウエスト 71エス ティー ストリート 3655
Claims (11)
- 【請求項１】 ＴＶ信号のような変調ビデオ信号を多種
類の伝送チャネルから受信するのに適したシステムであ
って、前記ビデオ信号は複数の符号化フォーマットのう
ちの１つの符号化フォーマットで符号化された圧縮ディ
ジタル・ビデオ情報を表すとともに、複数の変調フォー
マットのうちの１つの変調フォーマットを示すシステム
の装置において、 前記複数の変調フォーマットのうちの選択された１つの
変調フォーマットに適した方法で、前記変調ビデオ信号
を選択的に復調し、復調された出力信号を生成する復調
器と、 前記複数の符号化フォーマットのうちの選択された１つ
の復号化フォーマットに適した方法で、前記復調信号を
選択的に復号化し、復調され復号化された信号を生成す
る復号化器とを備えたことを特徴とする装置。 - 【請求項２】 請求項１に記載の装置において、前記複
数の符号化フォーマットは、それぞれ、複数の異なる符
号レートから選択された符号レートを用いることを特徴
とする装置。 - 【請求項３】 請求項１に記載の装置において、前記復
号化器と前記復調器は、可変クロック・レートで動作す
ることを特徴とする装置。 - 【請求項４】 請求項１に記載の装置において、前記複
数の変調フォーマットは、PAM 変調を含むことを特徴と
する装置。 - 【請求項５】 請求項１に記載の装置において、前記複
数の変調フォーマットは、QPSK変調を含むことを特徴と
する装置。 - 【請求項６】 請求項１に記載の装置において、前記複
数の変調フォーマットは、QAM 変調を含むことを特徴と
する装置。 - 【請求項７】 請求項１に記載の装置であって、前記復
号化器は同位相（Ｉ）および直交位相（Ｑ）ディジタル
入力信号として、前記復調器から供給された一連の畳み
込み符号化されたシンボル・パケットを畳み込み復号化
する畳み込み復号化器であり、該畳み込み復号化器が分
岐メトリック・コンピュータとViterbi 復号化器を含む
装置において、 前記分岐メトリック・コンピュータは、 ２x 記憶ロケーション（ただし、ｘは２以上の所定の第
１整数である）の実効デプスを有するメモリであり、各
記憶ロケーションは少なくとも１つのＩ定義ルックアッ
プ・テーブルのエントリをストアし、少なくとも１つの
Ｑ定義ルックアップ・テーブルをストアするだけの実効
幅をもち、Ｉ定義ルックアップ・テーブルとＱ定義ルッ
プアップ・テーブルの前記エントリは、それぞれ、第
１、第２、第３および第４のｍビット・メトリック値
（ただし、ｍは２以上の所定の第２整数である）のグル
ープよりなるメモリであり、少なくとも１つのＩ定義ル
ックアップ・テーブルと少なくとも１つのＱ定義ルック
アップ・テーブルを、前記２x記憶ロケーションにプリ
ロードするための制御入力端子を含み、その２x ビット
Ｉ信号入力端子に現在印加されている２x ビット信号の
値によって定義された記憶ロケーションにストアされて
いる前記１つのＩ定義ルックアップ・テーブル・エント
リとその２x ビットＱ信号入力端子に現在印加された２
x ビット信号の値により定義された記憶ロケーションに
ストアされている前記１つのＱ定義ルックアップ・テー
ブル・エントリを読み出すための２x ビットＩ信号入力
端子と、２x ビットＱ信号入力端子とを備えたメモリ
と、 読み出された１つのＩ定義ルックアップ・テーブル・エ
ントリの第１のｍビット・メトリック値を、読み出され
た１つのＱ定義ルックアップ・テーブル・エントリの第
１のｍビット・メトリック値に加え、（ｍ＋１）ビット
和出力を取り出す第１加算器と、読み出された１つのＩ
定義ルックアップ・テーブル・エントリの第２のｍビッ
ト・メトリック値を、読み出された１つのＱ定義ルック
アップ・テーブル・エントリの第２のｍビット・メトリ
ック値に加え、（ｍ＋１）ビット和出力を取り出す第２
加算器と，読み出された１つのＩ定義ルックアップ・テ
ーブル・エントリの第３のｍビット・メトリック値を、
読み出された１つのＱ定義ルックアップ・テーブル・エ
ントリの第３のｍビット・メトリック値に加え、（ｍ＋
１）ビット和出力を取り出す第３加算器と、読み出され
た１つのＩ定義ルックアップ・テーブル・エントリの第
４のｍビット・メトリック値を、読み出された１つのＱ
定義ルックアップ・テーブル・エントリの第４のｍビッ
ト・メトリック値に加え、（ｍ＋１）ビット和出力を取
り出す第４加算器とを含む加算器のグループと、 前記グループの４つの加算器からの各和出力を、前記Vi
terbi 復号化器に転送する手段とを備えたことを特徴と
する装置。 - 【請求項８】 請求項７に記載の装置において、ｘ＝６
およびｍ＝４であることを特徴とする装置。 - 【請求項９】 請求項７に記載の装置において、前記畳
み込み復号化器は、パンクチャド符号化されたQPSKシン
ボル・パケットと、複数の上位アルファベットPAM およ
びQAM n/n+1 ・プラグマティク・トレリス符号化された
シンボル・パケットとを選択的に復号化することができ
るディジタル処理手段と、 前記畳み込み復号化器とのインタフェースを有し、復号
化される選択された符号に従って予め計算されたＩおよ
びＱプログラマブル・ルックアップ・テーブルを、前記
分岐メトリック・コンピュータの前記制御入力端子に供
給する外部マイクロコントローラとを含むことを特徴と
する装置。 - 【請求項１０】 請求項９に記載の装置において、 前記マイクロコントローラのインタフェースの制御の下
で、前記畳み込み復号化器は、パンクチャド符号復号化
モードまたはプラグマティク・トレリス符号復号化モー
ドのいずれかになるように選択的に構成され、 前記ディジタル処理手段は、 該畳み込み復号化器がパンクチャド符号復号化モードで
あるときにのみ動作する手段であって、前記分岐メトリ
ック・コンピュータの前記メモリの前記２x ビットＩ信
号入力端子と２x ビットＱ信号入力端子に、ＩおよびＱ
入力信号が印加される前に、前記畳み込み復号化器に印
加された前記ＩおよびＱ入力信号をデパンクチャするダ
ミー・データ・インサータ手段と、 前記Viterbi 復号化器の再符号化出力に応答し、前記畳
み込み復号化器に印加されたＩおよびＱ入力信号であっ
て遅延されたＩおよびＱ入力信号とに応答する手段であ
って、前記畳み込み復号化器がプラグマティク・トレリ
ス符号復号化モードであるときにのみ動作するトレリス
・デマッパ手段とを含むことを特徴とする装置。 - 【請求項１１】 変調信号を多種類の伝送チャネルから
受信するシステムであって、前記変調信号は複数の符号
化フォーマットのうちの１つのフォーマットで復号化さ
れた圧縮ディジタル・データを表すとともに、複数の変
調フォーマットの１つを示しており、前記多種類の伝送
チャネルは衛星、ケーブルおよび地上チャネルのうちの
少なくとも２つのチャネルを含むシステムの信号処理装
置において、 PAM 、QAM およびPSK を含む前記変調フォーマットのう
ちの選択された１つのフォーマットで、前記変調信号を
選択的に復調して、復調された信号を生成する復調器
と、 パンクチャド符号とトレリス符号化フォーマットを含む
前記符号化フォーマットのうちの選択された１つのフォ
ーマットで、前記復調信号を選択的に復号化し、復調さ
れ復号化された信号を生成する復号化器とを含むことを
特徴とする信号処理装置。
Applications Claiming Priority (4)
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