JPH0830238A - Driving method for image display device - Google Patents
Driving method for image display deviceInfo
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- JPH0830238A JPH0830238A JP16421294A JP16421294A JPH0830238A JP H0830238 A JPH0830238 A JP H0830238A JP 16421294 A JP16421294 A JP 16421294A JP 16421294 A JP16421294 A JP 16421294A JP H0830238 A JPH0830238 A JP H0830238A
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- screen
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- electrode
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- Control Of Indicators Other Than Cathode Ray Tubes (AREA)
- Liquid Crystal (AREA)
- Liquid Crystal Display Device Control (AREA)
Abstract
(57)【要約】
【目的】複数行同時選択を行う液晶表示素子の駆動法に
おいて、仮想行の存在による表示むらを抑える。
【構成】画面を上下の2画面に分けて独立に駆動し、同
時選択される行電極の組の少なくとも1部に、仮想的な
行電極を含ませるとともに、該仮想電極を含む行電極
を、画面の上下に配置することを特徴とする。
(57) [Abstract] [Purpose] In a driving method of a liquid crystal display device for simultaneously selecting a plurality of rows, display unevenness due to the presence of virtual rows is suppressed. [Configuration] A screen is divided into two upper and lower screens and independently driven, and at least a part of a set of row electrodes that are simultaneously selected includes a virtual row electrode, and a row electrode including the virtual electrode is It is characterized by arranging them at the top and bottom of the screen.
Description
【0001】[0001]
【産業上の利用分野】本発明は、高速で応答する液晶に
適した液晶表示装置を駆動する方法に関するものであ
る。特に、本発明は、MLS法(複数ライン同時選択
法、特開平6−27907、USP5262881参
照)でマルチプレックス駆動を行う、単純マトリクス型
液晶表示装置の駆動方法に関するものである。BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a method of driving a liquid crystal display device suitable for a liquid crystal which responds at high speed. In particular, the present invention relates to a driving method of a simple matrix type liquid crystal display device which performs multiplex driving by the MLS method (multiple line simultaneous selection method, see JP-A-6-27907, USP5262881).
【0002】[0002]
【従来の技術】以下、本明細書では、走査電極を行電極
といい、データ電極を列電極ともいうことにする。2. Description of the Related Art Hereinafter, in the present specification, scan electrodes are referred to as row electrodes, and data electrodes are also referred to as column electrodes.
【0003】高度情報化時代に進展にともなって情報表
示媒体へのニーズはますます高まっている。液晶ディス
プレイは薄型、軽量、低消費電力などのメリットを有し
ており、半導体技術との整合性もよくますます普及する
ものと考えられる。一方で普及にともなって画面大型
化、高精細化が求められるようになって大容量表示をす
る方法の模索が始まっている。そのなかでSTN(超ね
じれネマティック)方式はTFT(薄膜トランジスタ)
方式にくらべ製造工程が簡素であり、低コストで生産で
きるので将来の液晶ディスプレイの主流になると考えら
れる。With the progress in the advanced information age, the need for information display media is ever increasing. Liquid crystal displays have advantages such as thinness, light weight, and low power consumption, and are considered to be more and more popular because of their compatibility with semiconductor technology. On the other hand, with the spread, the demand for larger screens and higher definition has started, and the search for a method for large-capacity display has begun. Among them, the STN (super twisted nematic) method is the TFT (thin film transistor).
The manufacturing process is simpler than that of the conventional method, and it can be produced at low cost, so it is expected to become the mainstream of future liquid crystal displays.
【0004】STN方式で大容量表示をするためには従
来から線順次マルチプレクス駆動が行われている。この
方法は各行電極を一本ずつ順次選択するとともに、列電
極を表示したいパターンと対応させて選択するもので、
全行電極が選択されることによって一画面の表示を終え
る。In order to display a large capacity in the STN system, line sequential multiplex driving has been conventionally performed. This method selects each row electrode one by one, and selects the column electrodes corresponding to the pattern to be displayed.
The display of one screen is completed by selecting all the row electrodes.
【0005】しかし、線順次駆動法では、表示容量が大
きくなるにつれて、フレーム応答と呼ばれる問題が起こ
ることが知られている。線順次駆動法では、選択時には
比較的大きく、非選択時には比較的小さい電圧が画素に
印加される。この電圧比は一般に行ライン数が大きくな
るほど(高デューティ駆動となるほど)大きくなる。こ
のため、電圧比が小さいときには電圧実効値に応答して
いた液晶が印加波形に応答するようになる。すなわち、
フレーム応答は選択パルスでの振幅が大きいためオフ時
の透過率が上昇し、選択パルスの周期が長いためオン時
の透過率が減少し結果としてコントラストの低下を引き
起こす現象である。However, it is known that the line-sequential driving method causes a problem called frame response as the display capacity increases. In the line-sequential driving method, a relatively high voltage is applied to the pixels when selected, and a relatively low voltage is applied when the pixels are not selected. This voltage ratio generally increases as the number of row lines increases (higher duty driving). Therefore, when the voltage ratio is small, the liquid crystal that responds to the voltage effective value responds to the applied waveform. That is,
The frame response is a phenomenon in which the transmittance at the time of OFF increases because the amplitude of the selection pulse is large, and the transmittance at the time of ON decreases as the cycle of the selection pulse is long, resulting in a decrease in contrast.
【0006】フレーム応答の発生を抑制するためにフレ
ーム周波数を高くし、これにより選択パルスの周期を短
くする方法が知られているが、これには重大な欠点があ
る。つまり、フレーム周波数を増やすと、印加波形の周
波数スペクトルが高くなるので、表示の不均一を引き起
こし、消費電力が上昇する。また選択パルス幅が狭くな
りすぎるのを防ぐため、フレーム周波数の上限には制限
がある。A method is known in which the frame frequency is increased in order to suppress the occurrence of the frame response, and thereby the period of the selection pulse is shortened, but this has a serious drawback. That is, when the frame frequency is increased, the frequency spectrum of the applied waveform becomes high, which causes non-uniformity of display and increases power consumption. In addition, the upper limit of the frame frequency is limited to prevent the selection pulse width from becoming too narrow.
【0007】周波数スペクトルを高くせずにこの問題を
解決するために、最近、新駆動法が提案された。複数の
行電極(選択電極)を同時に選択するMLS(複数ライ
ン同時選択)法などの方法である。この方法は複数の行
電極を同時に選択し、かつ、列方向の表示パターンを独
立に制御できる方法であり、選択幅を一定に保ったまま
フレーム周期を短くすることができる。すなわちフレー
ム応答を抑制した高コントラスト表示ができる。In order to solve this problem without increasing the frequency spectrum, a new driving method has recently been proposed. A method such as an MLS (multiple line simultaneous selection) method for simultaneously selecting a plurality of row electrodes (selection electrodes). This method is a method in which a plurality of row electrodes can be simultaneously selected and the display pattern in the column direction can be independently controlled, and the frame period can be shortened while keeping the selection width constant. That is, high contrast display with suppressed frame response can be performed.
【0008】MLS法においては、列表示パターンを独
立に制御するために、同時に印加される各行電極には一
定の電圧パルス列が印加される。複数のラインを同時に
選択する駆動法では、複数の行電極に同時に電圧パルス
が印加されることになる。このとき、列方向の表示パタ
ーンを同時にかつ独立に制御するために、行電極には各
々極性の違うパルス電圧が印加される必要がある。行電
極には極性を持つパルスが何回か印加され、トータルで
各画素にはオン、オフに応じた実効電圧が印加される。In the MLS method, in order to control the column display pattern independently, a constant voltage pulse train is applied to each row electrode applied simultaneously. In the driving method in which a plurality of lines are selected at the same time, voltage pulses are simultaneously applied to a plurality of row electrodes. At this time, in order to control the display pattern in the column direction simultaneously and independently, it is necessary to apply pulse voltages having different polarities to the row electrodes. A pulse having a polarity is applied to the row electrode several times, and an effective voltage corresponding to ON / OFF is applied to each pixel in total.
【0009】この各行電極に印加される選択パルス電圧
群はL行K列の行列(これを以後、選択行列(A)とい
う)として表すことができる。選択パルス電圧系列は互
いに直交なベクトル群として表せるため、これらを列要
素として含む行列は直交行列となる。このとき行列内の
各行ベクトルは互いに直交である。行の数Lは同時選択
数に対応し、各行はそれぞれのラインに対応する。たと
えば、L本の選択ラインの中のライン1には、選択行列
(A)の1行目の要素が適応され、1列目の要素、2列
目の要素の順に選択パルスが印加される。本明細書で
は、選択行列(A)の表記において、1は正の選択パル
スを、−1は負の選択パルスを意味することとする。The selection pulse voltage group applied to each row electrode can be expressed as a matrix of L rows and K columns (hereinafter, referred to as a selection matrix (A)). Since the selected pulse voltage series can be represented as mutually orthogonal vector groups, a matrix including these as column elements is an orthogonal matrix. At this time, the row vectors in the matrix are orthogonal to each other. The number L of rows corresponds to the number of simultaneous selections, and each row corresponds to each line. For example, the first row element of the selection matrix (A) is applied to the line 1 of the L selection lines, and the selection pulse is applied in the order of the first column element and the second column element. In the present specification, in the notation of the selection matrix (A), 1 means a positive selection pulse, and −1 means a negative selection pulse.
【0010】列電極には、この行列の各列要素および列
表示パターンに対応した電圧レベルが印加される。すな
わち、列電極電圧系列はこの行電極電圧系列を決める行
列と表示パターンによって決まる。A voltage level corresponding to each column element of this matrix and a column display pattern is applied to the column electrode. That is, the column electrode voltage series is determined by the matrix and the display pattern that determine the row electrode voltage series.
【0011】列電極に印加される電圧波形のシーケンス
は以下のように決定される。図9はその概念を示した説
明図である。4行4列のアダマール行列を例にとって説
明する。列電極iおよび列電極jにおける表示データが
図9(a)に示したようになっているとする。列表示パ
ターンは図9(b)に示すようにベクトル(d)として
表される。ここで列要素が−1の時はオン表示を表し、
1はオフ表示を表している。行電極に、行列の列の順に
順次行電極電圧が印加されていくとすると、列電極電圧
レベルは図9(b)に示すベクトル(v)のようにな
り、その波形は図9(c)のようになる。図9(c)に
おいて、縦軸、横軸はそれぞれ任意単位である。The sequence of voltage waveforms applied to the column electrodes is determined as follows. FIG. 9 is an explanatory diagram showing the concept. A Hadamard matrix of 4 rows and 4 columns will be described as an example. It is assumed that the display data of the column electrode i and the column electrode j are as shown in FIG. The column display pattern is represented as a vector (d) as shown in FIG. 9 (b). Here, when the column element is -1, it indicates ON display,
1 represents the off display. Assuming that the row electrode voltages are sequentially applied to the row electrodes in the order of the columns of the matrix, the column electrode voltage level becomes a vector (v) shown in FIG. 9B, and its waveform is shown in FIG. 9C. become that way. In FIG. 9C, the vertical axis and the horizontal axis are arbitrary units.
【0012】図9(c)の波形は、1つのサブグループ
に対して1つの選択パルス印加するたびに次のサブグル
ープの選択に移る場合であって、サブグループごとに印
加する選択パルスを選択行列内でずらす場合を示してい
る。選択パルスシーケンスが異なれば、それに応じて、
列電圧のシーケンスも異なる。The waveform of FIG. 9 (c) shows the case where each time a selection pulse is applied to one subgroup, the next subgroup is selected. The selection pulse to be applied to each subgroup is selected. The case of shifting in the matrix is shown. If the selection pulse sequence is different,
The sequence of column voltages is also different.
【0013】[0013]
【発明が解決しようとする課題】MLS法においては、
実際に基板上に存在する行電極以外に、仮想的な行電極
を想定して駆動する場合が多い。一つの理由は、全ライ
ンよりも少ない本数の同時選択を行う場合、全行電極本
数が、同時選択する行電極の本数で割り切れるとは限ら
ないので、仮想電極を想定して同時選択される行電極の
数を揃える場合があるためである。つまり、実際の行電
極の数が足りない行電極サブグループに仮想的に行電極
があるものとして、列電極信号を演算し、駆動するので
ある。[Problems to be Solved by the Invention] In the MLS method,
In many cases, driving is performed assuming a virtual row electrode other than the row electrode actually existing on the substrate. One reason is that when performing the simultaneous selection of a smaller number of electrodes than all the lines, the number of all row electrodes is not always divisible by the number of row electrodes to be selected at the same time. This is because the number of electrodes may be the same. That is, the column electrode signal is calculated and driven assuming that the row electrode subgroup in which the actual number of row electrodes is insufficient has virtual row electrodes.
【0014】しかし、本発明者らが開発を進めるうち
に、このような仮想行電極付近に表示むらを生じる場合
のあることが見いだされてきた。特に、上下に画面を分
割し、2画面を独立して駆動した場合にこの表示むらが
問題となることが多い。画面の中央に仮想電極が配置さ
れると、行方向に沿った黒筋もしくは白筋として表示む
らが現れてくるので表示上目立つためである。However, as the inventors proceeded with the development, it has been found that display irregularities may occur in the vicinity of such virtual row electrodes. Particularly, when the screen is divided into upper and lower parts and the two screens are driven independently, this display unevenness often causes a problem. This is because when the virtual electrode is arranged in the center of the screen, display unevenness appears as black stripes or white stripes along the row direction, which is noticeable on the display.
【0015】[0015]
【課題を解決するための手段】本発明は、複数の行電極
と複数の列電極とを有する画像表示装置の行電極を複数
本同時選択して駆動する駆動方法において、画面は2画
面に分けて独立に駆動され、同時選択される行電極の組
の少なくとも1部に、仮想的な行電極を含ませるととも
に、該仮想電極を、画面端部に配置することを特徴とす
る画像表示装置の駆動方法、および、複数の行電極と複
数の列電極とを有する画像表示装置の行電極を複数本同
時選択して駆動する駆動方法において、画面は2画面に
分けて独立に駆動され、同時選択される行電極の組の少
なくとも1部に、仮想的な行電極を含ませるとともに、
該仮想電極を含む行電極の組を、画面端部に配置するこ
とを特徴とする画像表示装置の駆動方法を提供するもの
である。特に、各画面は、2つの画面の間の境界部か
ら、画面の端部に向かって走査されることを特徴とする
上記の画像表示装置の駆動方法を提供する。According to the present invention, in a driving method for simultaneously selecting and driving a plurality of row electrodes of an image display device having a plurality of row electrodes and a plurality of column electrodes, the screen is divided into two screens. Of at least a part of a set of row electrodes that are independently driven and simultaneously selected include a virtual row electrode, and the virtual electrode is arranged at a screen end portion. In a driving method and a driving method of simultaneously driving a plurality of row electrodes of an image display device having a plurality of row electrodes and a plurality of column electrodes, a screen is divided into two screens and driven independently, and simultaneous selection is performed. At least a part of the set of row electrodes to be included includes a virtual row electrode, and
A method for driving an image display device, characterized in that a set of row electrodes including the virtual electrodes is arranged at an end portion of a screen. In particular, the above method for driving an image display device is provided, wherein each screen is scanned from a boundary between the two screens toward an end of the screen.
【0016】すなわち、仮想行電極を画面上の表示むら
の目立たない部分に配置することにより、全体として、
表示むらを大幅に軽減できるのである。That is, by arranging the virtual row electrodes in a portion where the display unevenness on the screen is inconspicuous, as a whole,
The display unevenness can be greatly reduced.
【0017】仮想行電極は現実に存在するものではない
が、実際には、その位置を表示画面上で確定できること
が多い。これは、多くの場合、回路設計を有利にするた
めに、選択パルスシーケンスを一定の規則性を持って印
加し、かつ、同時選択される行電極が一定の規則性を持
って実画面上で配列されるからである。The virtual row electrode does not actually exist, but in reality, its position is often fixed on the display screen. In many cases, in order to make the circuit design advantageous, the selection pulse sequence is applied with a certain regularity, and the row electrodes simultaneously selected have a certain regularity on the real screen. Because they are arranged.
【0018】例えば、同時選択される行電極ごとにひと
かたまりにして、実画面上に配置する場合の例を図2
(a)に示した。図は実走査線が14本、同時選択され
る行電極の本数が3本、独立の選択パルスの数が4個
(A1 〜A4 )の場合である。図の中で、1,2,3,
4,5はそれぞれ行電極サブグループを示す番号であ
り、1−1から5−5は行電極(仮想行電極も含む)を
示す番号である。For example, FIG. 2 shows an example in which row electrodes that are selected at the same time are collectively arranged on the actual screen.
It is shown in (a). The figure shows a case where there are 14 actual scanning lines, the number of row electrodes that are simultaneously selected is 3, and the number of independent selection pulses is 4 (A 1 to A 4 ). In the figure, 1, 2, 3,
Reference numerals 4 and 5 are row electrode subgroups, and reference numerals 1-1 to 5-5 are row electrodes (including virtual row electrodes).
【0019】図2(a)の場合、画面の上部から、行サ
ブグループを選択するごとに選択行列内で選択パルスを
1つ進めながら、行選択を進行していくものとすると、
サブグループ3には、A3 ,A4 ,A1 ,A2 ・・・の
順序で選択パルスが印加されることになる。これを実際
に印加されている選択波形と比較することによって、何
番目の位置の行電極が仮想電極として取り扱われている
かを認識することができる。そして、同時選択される行
電極ごとにひとかたまりにして、実画面上に規則的に配
置されていることを考慮すると、仮想行電極3−3は、
実画面上で上から8行目と9行目の間に配置されている
とみなすことができる。In the case of FIG. 2 (a), row selection proceeds from the top of the screen by advancing the selection pulse by one in the selection matrix each time a row subgroup is selected.
The selection pulse is applied to the sub-group 3 in the order of A 3 , A 4 , A 1 , A 2 . By comparing this with the actually applied selection waveform, it is possible to recognize at which position the row electrode is treated as a virtual electrode. Then, considering that the row electrodes that are simultaneously selected are collectively arranged on the actual screen as a group, the virtual row electrodes 3-3 are
It can be considered that they are arranged between the 8th and 9th lines from the top on the real screen.
【0020】同様に、同時に選択される行電極を実画面
上で分散配置したものが、図2(b)である。この場合
も同様に考察を行うことにより、実電極の12番目と1
3番目との間に仮想電極が挿入されていると、みなすこ
とが可能になる。Similarly, FIG. 2 (b) shows the row electrodes selected at the same time distributedly arranged on the actual screen. In this case as well, by performing the same consideration,
It can be considered that a virtual electrode is inserted between the third and the third position.
【0021】本発明においては、2画面駆動時に、この
ようにして特定される仮想行電極の位置を、画面の上下
に配置することによって、仮想行電極の位置に起因する
表示むらを実質的に軽減することを可能にする。In the present invention, when the two screens are driven, the positions of the virtual row electrodes specified in this way are arranged above and below the screen, so that display unevenness due to the positions of the virtual row electrodes is substantially caused. It is possible to reduce.
【0022】具体的に、仮想行電極を画面の端部に配置
するには、たとえば、図2(a)の場合は、1番目のサ
ブグループに仮想電極を含ませ、1−1の行電極が仮想
電極となるようなシーケンスで駆動すればよい。図2
(b)の場合も同様に、1番目のサブグループに仮想電
極を含ませ、1−1の行電極が仮想電極となるようなシ
ーケンスで駆動すればよいことになる。Specifically, in order to arrange the virtual row electrodes at the edges of the screen, for example, in the case of FIG. 2A, the virtual electrodes are included in the first sub-group, and the row electrodes 1-1. It is sufficient to drive in a sequence so that becomes a virtual electrode. Figure 2
Also in the case of (b), similarly, it is sufficient that the first subgroup includes the virtual electrodes and the 1-1 row electrodes are driven in a sequence so as to become the virtual electrodes.
【0023】本発明においては、仮想電極を複数の行電
極サブグループに分散するので、仮想電極の存在に起因
する表示むらが分散されるため、表示品位の向上が期待
できる。In the present invention, since the virtual electrodes are distributed to the plurality of row electrode subgroups, the display unevenness due to the presence of the virtual electrodes is distributed, so that the display quality can be expected to be improved.
【0024】また、図2(a)のように、同時選択され
る行電極ごとにひとかたまりにしている場合は、仮想電
極を含む行電極サブグループを画面の端部(上下)に配
置するだけで、表示むら低減に相当の効果がある。Further, as shown in FIG. 2A, when the row electrodes to be simultaneously selected are grouped together, the row electrode subgroup including the virtual electrodes is simply arranged at the edge (upper and lower) of the screen. , Has a considerable effect in reducing display unevenness.
【0025】さらに、本発明では、各画面は、2つの画
面の間の境界部から、画面の端部に向かって走査される
ことが好ましい。すなわち、上下の2分割を行った場合
は、上画面は、上から下に走査し、下画面は下から上に
走査することが好ましい。仮想電極に起因する列電圧変
動は、次に走査するサブグループに対しても影響するこ
とが多いため、走査の最後に位置するようにすることが
有利だからである。列電圧変動が、次に走査するサブグ
ループに対しても影響するのは、次のサブグループにお
いて、仮想電極を含むサブグループで生じた波形歪みを
元に戻す方向に、新たな波形歪みが生じることが多いた
めである。Further, in the present invention, each screen is preferably scanned from the boundary between the two screens toward the end of the screen. That is, when upper and lower halves are divided, it is preferable to scan the upper screen from top to bottom and scan the lower screen from bottom to top. This is because the column voltage fluctuation caused by the virtual electrode often affects the subgroup to be scanned next, so that it is advantageous to position it at the end of scanning. The column voltage fluctuation also affects the subgroup to be scanned next. In the next subgroup, a new waveform distortion is generated in a direction to restore the waveform distortion generated in the subgroup including the virtual electrode. This is because there are many cases.
【0026】本発明における駆動法は、特開平6−27
907公報、USP5262881に記載されているよ
うな回路を基本として用いて実現することが可能であ
る。The driving method in the present invention is disclosed in JP-A-6-27.
It can be realized by using a circuit as described in Japanese Patent Application No. 907, USP5262881 as a basis.
【0027】回路の構成の1例のブロック図を図4に示
した。これは、RGBそれぞれ16階調表示を行うため
の回路である。データ信号を、16階調の信号をMSB
からLSBまで4ビットの信号としてデータ前処理回路
51に入力する。データ前処理回路51は後段の列信号
形成に適したフォーマットとタイミングで列信号発生回
路52に入力されるデータ信号を出力するための回路で
ある。列信号発生回路52には、データ前処理回路51
から出力されるデータ信号と直交関数発生回路55から
出力される直交関数信号とが入力される。A block diagram of an example of the circuit configuration is shown in FIG. This is a circuit for displaying 16 gradations for each of RGB. Data signal, 16 gradation signal MSB
To LSB are input to the data preprocessing circuit 51 as 4-bit signals. The data preprocessing circuit 51 is a circuit for outputting a data signal input to the column signal generation circuit 52 with a format and timing suitable for forming a column signal in the subsequent stage. The column signal generation circuit 52 includes a data preprocessing circuit 51.
The data signal output from the input terminal and the orthogonal function signal output from the orthogonal function generation circuit 55 are input.
【0028】列信号発生回路52は両信号を用いて所定
の演算を行い列信号を形成した後、列ドライバ53に出
力する。列ドライバ53は所定の基準電圧を用いて、入
力される列信号から液晶パネル56の列電極に印加する
列電極電圧を形成して液晶パネル56に出力する。一
方、液晶パネル56の行電極には、直交関数発生回路5
から出力される直交関数信号を行ドライバ54で変換し
た行電極電圧が印加される。これらの回路は、必要に応
じてタイミング回路等を備え、所定のタイミングにコン
トロールされて動作する。The column signal generation circuit 52 performs a predetermined operation using both signals to form a column signal, and then outputs the column signal to the column driver 53. The column driver 53 uses a predetermined reference voltage to form a column electrode voltage applied to the column electrode of the liquid crystal panel 56 from the input column signal and outputs the column electrode voltage to the liquid crystal panel 56. On the other hand, the orthogonal function generating circuit 5 is connected to the row electrodes of the liquid crystal panel 56.
A row electrode voltage obtained by converting the orthogonal function signal output by the row driver 54 is applied. These circuits are provided with a timing circuit and the like as necessary, and are controlled and operated at a predetermined timing.
【0029】本発明で用いられている直交関数は、直交
関数発生回路55が発生する。直交関数発生回路55
は、直交関数信号発生のたびに演算を行い信号形成する
こともできる。しかし、あらかじめ、使用する直交関数
信号をROMに保存しておき、それを適当なタイミング
で読み出すほうが簡便性の点で好ましい。すなわち、液
晶パネル56への電圧印加タイミングを規定するパルス
を計数し、計数値をアドレス信号としてROM内の直交
関数信号を順次読み出すようにする。The orthogonal function used in the present invention is generated by the orthogonal function generating circuit 55. Orthogonal function generating circuit 55
Can also perform calculation every time an orthogonal function signal is generated to form a signal. However, it is preferable in terms of simplicity that the orthogonal function signal to be used is stored in the ROM in advance and the signal is read out at an appropriate timing. That is, the pulses that define the voltage application timing to the liquid crystal panel 56 are counted, and the orthogonal function signals in the ROM are sequentially read using the counted value as an address signal.
【0030】データ前処理回路51は、具体的には、図
5のような構成である。信号処理は、階調情報を持った
4ビットの画像データをR、G、B3ビットずつ4組に
分けて行う。すなわち、MSB(23 )、2ndMSB
(22 )、3rdMSB(21 )、LSB(20 )の4
組に信号を分けて、並列処理を行う。The data preprocessing circuit 51 is specifically constructed as shown in FIG. The signal processing is performed by dividing 4-bit image data having gradation information into 4 sets of R, G, and B 3 bits. That is, MSB (2 3 ), 2ndMSB
4 of (2 2 ), 3rdMSB (2 1 ), LSB (2 0 ).
The signals are divided into sets and parallel processing is performed.
【0031】入力された3ビットのデータは5段直並列
変換器11で15ビットのデータに変換してメモリ12
に送られる。具体的には、5段シフトレジスタの入力端
子にシリアルなデータを入力しその5個の各タップ出力
をメモリ12に入力する。The input 3-bit data is converted into 15-bit data by the 5-stage serial / parallel converter 11 and is stored in the memory 12.
Sent to Specifically, serial data is input to the input terminal of the 5-stage shift register, and each of the five tap outputs is input to the memory 12.
【0032】メモリ12としてはデータ幅16ビットの
VRAMを用いた。メモリ12への書き込みは直接アク
セスモードを用いて以下のように行う。すなわち、同じ
列電極に対応した行電極上のデータは、同時選択される
7本の行電極について隣り合う7個のアドレスに格納す
る。このようにすることにより、後段のメモリからの読
み出しが高速に行えるとともに、演算が容易になる。As the memory 12, a VRAM having a data width of 16 bits was used. Writing to the memory 12 is performed as follows using the direct access mode. That is, the data on the row electrodes corresponding to the same column electrode is stored in seven adjacent addresses for the seven row electrodes selected at the same time. By doing so, reading from the memory in the subsequent stage can be performed at high speed, and the operation becomes easy.
【0033】メモリ12からの読み出しは高速な順次ア
クセスモードでLCDの駆動タイミングに応じて行い、
4組の15ビットデータをデータフォーマット変換回路
16へ送る。Reading from the memory 12 is performed in a high-speed sequential access mode in accordance with the LCD drive timing.
The four sets of 15-bit data are sent to the data format conversion circuit 16.
【0034】データフォーマット変換回路16は、各階
調ごとに15ビット幅で並列に送られたデータをRGB
ごとの20ビット幅の並列信号に整理し直す回路であ
り、通常は、回路基板上で適宜の配線を行うことにより
足りる。The data format conversion circuit 16 converts the data sent in parallel with a 15-bit width for each gradation into RGB.
This is a circuit for rearranging parallel signals each having a 20-bit width, and it is usually sufficient to perform appropriate wiring on the circuit board.
【0035】データフォーマット変換回路16でRGB
3組の20ビットデータに変換されたのち、データは階
調決定回路15へ送られる。階調決定回路15では1ド
ット当り4ビットの階調データをオン/オフ1ビットの
データに変換してサブ画面の映像信号とし、サブ画面を
たとえば15サイクルかけて階調表示を実現するフレー
ム変調用回路である。The data format conversion circuit 16 outputs RGB
After being converted into three sets of 20-bit data, the data is sent to the gradation determining circuit 15. The gradation determination circuit 15 converts 4-bit gradation data per dot into ON / OFF 1-bit data to form a video signal for a sub-screen, and the sub-screen is subjected to, for example, 15 cycles to perform frame modulation for realizing gradation display. Circuit.
【0036】具体的には、20ビット幅のデータを所定
のタイミングで5ビット幅データに分配するデマルチプ
レクサを用いた。どのビットがどのサブ画面に対応する
かは、フレームカウンタによる計数によって決められ
る。このようにして5ドット分の階調データに相当する
20ビットのデータを5ビットの階調のないシリアルデ
ータに変換して縦横変換回路13に出力する。Specifically, a demultiplexer for distributing 20-bit width data into 5-bit width data at a predetermined timing is used. Which bit corresponds to which sub-screen is determined by counting by the frame counter. In this way, the 20-bit data corresponding to the gradation data for 5 dots is converted into 5-bit serial data without gradation and is output to the vertical / horizontal conversion circuit 13.
【0037】縦横変換回路13は5ピクセルの表示デー
タを7回転送して蓄えておき、これを7ピクセルのデー
タとして5回に分けて読み出す回路である。2組の5×
7ビットレジスタで構成されている。縦横変換回路13
からデータ信号は列信号発生回路52に送られる。The vertical-to-horizontal conversion circuit 13 is a circuit which transfers display data of 5 pixels seven times and stores the display data, and reads this as data of 7 pixels in five times. 2 sets of 5x
It consists of a 7-bit register. Vertical-to-horizontal conversion circuit 13
To the column signal generation circuit 52.
【0038】列信号発生回路52は、図6に示した構成
である。7ビットのデータ信号を排他的論理和ゲート2
3、23、・・・に入力する。排他的論理和ゲート23
にはそれぞれ直交関数発生回路5からの信号も入力され
る。排他的論理和ゲート23の出力は加算器21で同時
選択される行電極について加算される。The column signal generation circuit 52 has the structure shown in FIG. Exclusive OR gate 2 for 7-bit data signal
Input to 3, 23, .... Exclusive OR gate 23
A signal from the orthogonal function generating circuit 5 is also input to each. The outputs of the exclusive OR gates 23 are added to the row electrodes simultaneously selected by the adder 21.
【0039】また、列ドライバ53は、図7のような構
成になっている。シフトレジスタ31、ラッチ32、デ
コーダー33、および電圧分割器34からなっている。
電圧レベル選別器33としてはデマルチプレクサを用
い、1行分のデータをシフトレジスタ31に送り込んだ
段階で表示データの列電圧への変換を行う。The column driver 53 has a structure as shown in FIG. It comprises a shift register 31, a latch 32, a decoder 33, and a voltage divider 34.
A demultiplexer is used as the voltage level selector 33, and when the data for one row is sent to the shift register 31, the display data is converted into the column voltage.
【0040】さらに、行ドライバ54は、図8のような
構成になっている。駆動パターンレジスタ41、選択信
号レジスタ42、およびデコーダー43からなる。選択
信号レジスタ42の内容によって同時選択行が決めら
れ、駆動パターンレジスタ41の内容によって選択され
た各行にどちらの極性の選択信号を出力するかが決めら
れる。非選択行は0Vが出力される。Further, the row driver 54 has a structure as shown in FIG. It includes a drive pattern register 41, a selection signal register 42, and a decoder 43. The contents of the selection signal register 42 determine the simultaneously selected rows, and the contents of the drive pattern register 41 determine which polarity the selection signal is output to. 0V is output to the non-selected rows.
【0041】図4〜図8は回路の一例として示したもの
であり、本発明の本質を損しない限り、さまざまな回路
の採用が可能である。4 to 8 are shown as an example of a circuit, and various circuits can be adopted without impairing the essence of the present invention.
【0042】[0042]
【実施例】図4〜図8に示した回路を用いて、液晶表示
パネルを以下の要領で駆動した。液晶表示パネルは9.
4インチのVGAモジュール(画素数480×640×
3(RGB))で背面バックライトを備える。液晶表示
パネルの応答時間は立ち上がりと立ち下がりとの平均で
60msである。480本の行電極を上下240本ずつ
に分けて、2画面駆動した。7本の行を同時選択すると
ともに、同時選択される行電極は画面上でひとかたまり
に隣り合うように配置し、かつサブグループごとの選択
で、選択行列の列を1つ進める方式(方式1)で駆動し
た。2画面駆動(上下分割)を行ったので、サブグルー
プの数は35となり、そのうち5本が仮想電極の扱いに
なった。バイアスはコントラスト比がほぼ最大となるよ
うに調整し、表示のコントラスト比は30:1、最大輝
度は100cd/m2 となった。EXAMPLE A liquid crystal display panel was driven in the following manner using the circuits shown in FIGS. The liquid crystal display panel is 9.
4-inch VGA module (number of pixels 480 x 640 x
3 (RGB)) with a back backlight. The response time of the liquid crystal display panel is 60 ms on average of rising and falling. The 480 row electrodes were divided into upper and lower 240 electrodes to drive two screens. A method in which seven rows are selected simultaneously, row electrodes to be simultaneously selected are arranged so as to be adjacent to each other in a lump on the screen, and the selection matrix is advanced by one column in each selection (method 1) Driven by. Since two screens were driven (vertical division), the number of subgroups was 35, and 5 of them were treated as virtual electrodes. The bias was adjusted so that the contrast ratio became almost maximum, and the display contrast ratio was 30: 1 and the maximum brightness was 100 cd / m 2 .
【0043】実施例1として、図1(a)に示したよう
な仮想行電極配置とシーケンスで駆動した。すなわち、
上画面では行電極サブグループ1のうちの1−1から1
−5の行電極を仮想電極とし、下画面では行電極サブグ
ループ35のうちの35−3から35−7の行電極を仮
想電極とし、行電極サブグループの番号の小さいほうか
ら大きいほうに走査を行った。As Example 1, driving was performed in a virtual row electrode arrangement and sequence as shown in FIG. That is,
In the upper screen, 1-1 to 1 of row electrode subgroup 1
The row electrode of -5 is used as a virtual electrode, and the row electrodes of row electrode subgroups 35-3 to 35-7 are used as virtual electrodes in the lower screen, and scanning is performed from the smallest row electrode subgroup number to the largest row electrode subgroup number. I went.
【0044】実施例2として、図1(b)に示したよう
な仮想行電極配置とシーケンスで駆動した。上画面、下
画面とも行電極サブグループ1のうちの1−1から1−
5の行電極を仮想電極とし、行電極サブグループの番号
の小さいほうから大きいほうに走査を行った。As Example 2, driving was performed in a virtual row electrode arrangement and sequence as shown in FIG. Both the upper screen and the lower screen are 1-1 to 1-of the row electrode subgroup 1.
The row electrode of No. 5 was used as a virtual electrode, and scanning was performed from the smallest row electrode subgroup number to the largest row electrode subgroup number.
【0045】比較例として、図3に示したような仮想行
電極配置とシーケンスで駆動した。上画面、下画面とも
行電極サブグループ35のうちの35−3から35−7
の行電極を仮想電極とし、行電極サブグループの番号の
小さいほうから大きいほうに走査を行った。As a comparative example, driving was performed in a virtual row electrode arrangement and sequence as shown in FIG. 35-3 to 35-7 of the row electrode subgroup 35 for both the upper screen and the lower screen
The row electrodes were used as virtual electrodes, and scanning was performed from the smallest row electrode subgroup number to the largest row electrode subgroup number.
【0046】結果として、上下画面の境界付近の表示む
らのもっとも小さかったのは、実施例2であり、次が実
施例1であり、比較例は、最も表示むらが大きかった。As a result, the display unevenness in the vicinity of the boundaries between the upper and lower screens was the smallest in Example 2, the next was Example 1, and the comparative example had the largest display unevenness.
【0047】[0047]
【発明の効果】本発明によれば、複数行同時選択を行っ
て2画面駆動する液晶表示素子の駆動法において、仮想
行の存在による表示むらを抑えることが可能になる。According to the present invention, it is possible to suppress display unevenness due to the presence of virtual rows in a driving method of a liquid crystal display element in which a plurality of rows are simultaneously selected and two screens are driven.
【図1】(a)は実施例1の画面上の仮想行電極の配置
とシーケンスを説明する説明図、(b)は実施例2の画
面上の仮想行電極の配置とシーケンスを説明する説明図FIG. 1A is an explanatory view for explaining the arrangement and sequence of virtual row electrodes on the screen of Embodiment 1, and FIG. 1B is an explanatory view for explaining the arrangement and sequence of virtual row electrodes on the screen of Embodiment 2. Figure
【図2】(a)、(b)は画面上の仮想行電極の配置を
説明する説明図2A and 2B are explanatory views for explaining the arrangement of virtual row electrodes on the screen.
【図3】比較例の画面上の仮想行電極の配置とシーケン
スを説明する説明図FIG. 3 is an explanatory diagram illustrating the arrangement and sequence of virtual row electrodes on the screen of a comparative example.
【図4】本発明の駆動方法を実現するための駆動回路の
1例を示す回路図FIG. 4 is a circuit diagram showing an example of a drive circuit for realizing the drive method of the present invention.
【図5】データ前処理回路1を示すブロック図FIG. 5 is a block diagram showing a data preprocessing circuit 1.
【図6】列信号発生回路2を示すブロック図FIG. 6 is a block diagram showing a column signal generation circuit 2.
【図7】列ドライバ3を示すブロック図FIG. 7 is a block diagram showing a column driver 3.
【図8】行ドライバ4を示すブロック図FIG. 8 is a block diagram showing a row driver 4.
【図9】(a)〜(c)はMLS法での電圧印加方法を
説明する概念図および波形図9A to 9C are conceptual diagrams and waveform diagrams for explaining a voltage application method in the MLS method.
21:列信号発生回路 22:列信号発生回路 31:ラッチ回路 32:選択回路 51:データ前処理回路 52:列信号発生回路 53:列ドライバ 54:行ドライバ 55:直行関数発生回路 56:液晶パネル 21: Column signal generation circuit 22: Column signal generation circuit 31: Latch circuit 32: Selection circuit 51: Data preprocessing circuit 52: Column signal generation circuit 53: Column driver 54: Row driver 55: Orthogonal function generation circuit 56: Liquid crystal panel
───────────────────────────────────────────────────── フロントページの続き (72)発明者 桑田 武志 神奈川県横浜市神奈川区羽沢町1150番地 旭硝子株式会社中央研究所内 ─────────────────────────────────────────────────── ─── Continued Front Page (72) Inventor Takeshi Kuwata 1150 Hazawa-machi, Kanagawa-ku, Yokohama, Kanagawa Prefecture Asahi Glass Co., Ltd. Central Research Laboratory
Claims (3)
像表示装置の行電極を複数本同時選択して駆動する駆動
方法において、 画面は2画面に分けて独立に駆動され、 同時選択される行電極の組の少なくとも1部に、仮想的
な行電極を含ませるとともに、該仮想電極を、画面端部
に配置することを特徴とする画像表示装置の駆動方法。1. A driving method for simultaneously selecting and driving a plurality of row electrodes of an image display device having a plurality of row electrodes and a plurality of column electrodes, wherein a screen is divided into two screens and independently driven, and simultaneous selection is performed. A method for driving an image display device, characterized in that a virtual row electrode is included in at least a part of a set of row electrodes to be formed, and the virtual electrode is arranged at an end portion of a screen.
像表示装置の行電極を複数本同時選択して駆動する駆動
方法において、 画面は2画面に分けて独立に駆動され、 同時選択される行電極の組の少なくとも1部に、仮想的
な行電極を含ませるとともに、該仮想電極を含む行電極
の組を、画面端部に配置することを特徴とする画像表示
装置の駆動方法。2. A driving method for simultaneously selecting and driving a plurality of row electrodes of an image display device having a plurality of row electrodes and a plurality of column electrodes, wherein a screen is divided into two screens and driven independently, and simultaneous selection is performed. Driving method for an image display device, characterized in that a virtual row electrode is included in at least a part of the set of row electrodes, and the set of row electrodes including the virtual electrode is arranged at an end portion of the screen. .
画面の端部に向かって走査されることを特徴とする請求
項1または請求項2記載の画像表示装置の駆動方法。3. Each screen, from the boundary between the two screens,
The driving method for an image display device according to claim 1, wherein scanning is performed toward an end portion of the screen.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16421294A JPH0830238A (en) | 1994-07-15 | 1994-07-15 | Driving method for image display device |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP16421294A JPH0830238A (en) | 1994-07-15 | 1994-07-15 | Driving method for image display device |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0830238A true JPH0830238A (en) | 1996-02-02 |
Family
ID=15788803
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP16421294A Pending JPH0830238A (en) | 1994-07-15 | 1994-07-15 | Driving method for image display device |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0830238A (en) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO1998008132A1 (en) * | 1996-08-19 | 1998-02-26 | Seiko Epson Corporation | Method of driving liquid crystal device |
-
1994
- 1994-07-15 JP JP16421294A patent/JPH0830238A/en active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO1998008132A1 (en) * | 1996-08-19 | 1998-02-26 | Seiko Epson Corporation | Method of driving liquid crystal device |
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