JPH0845859A - 半導体製造方法 - Google Patents

半導体製造方法

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JPH0845859A
JPH0845859A JP19596294A JP19596294A JPH0845859A JP H0845859 A JPH0845859 A JP H0845859A JP 19596294 A JP19596294 A JP 19596294A JP 19596294 A JP19596294 A JP 19596294A JP H0845859 A JPH0845859 A JP H0845859A
Authority
JP
Japan
Prior art keywords
wafer
reaction furnace
furnace
particles
semiconductor manufacturing
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Pending
Application number
JP19596294A
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English (en)
Inventor
Takahiro Maeda
孝浩 前田
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Kokusai Denki Electric Inc
Original Assignee
Kokusai Electric Co Ltd
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Publication date
Application filed by Kokusai Electric Co Ltd filed Critical Kokusai Electric Co Ltd
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Abstract

(57)【要約】 【目的】半導体製造過程に於けるパーティクルやヘイズ
の発生を低減させる。 【構成】反応炉内にウェーハを装入して化学気相成長に
よりウェーハ表面に各種薄膜を生成する半導体製造方法
に於いて、ウェーハの反応炉内への装入速度を20mm/m
in以下、装入時の反応炉内温度を600℃以下とし、反
応炉内に装入する時のウェーハに加わる単位時間当たり
の熱量を少なくしてクラックの発生を抑制すると共にウ
ェーハ表面に付着した不純物が脱離するに充分な時間を
与え、不純物による反応炉内の汚染を防止し、ウェーハ
表面にパーティクルが付着し、ヘイズが発生するのを防
止する。

Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】本発明は半導体製造方法、特に化
学気相成長によりウェーハ表面に各種薄膜を生成する半
導体製造方法に関するものである。
【0002】
【従来の技術】半導体製造方法の1つに化学気相成長に
よりウェーハ表面に各種薄膜を生成するものがある。
【0003】先ず図3に於いて化学気相成長により半導
体を製造する縦型CVD装置、特に縦型CVD装置の主
要部である縦型炉を説明する。
【0004】該縦型CVD装置は、ヒータに囲まれた縦
型反応管内にウェーハを水平姿勢で多段に装入し、ヒー
タで所定の温度に加熱した状態でSiH4 −N2 O或は
TEOS等の反応ガスを導入し、ウェーハ表面にSiO
2 等の薄膜を生成するものである。
【0005】ヒータ1の内部に外部反応管2が設けら
れ、該外部反応管2の下端にインレットフランジ4が気
密に設けられ、該インレットフランジ4に下端を支持さ
れた内部反応管3が前記外部反応管2と同心に設けられ
ている。前記内部反応管3と前記外部反応管2との間に
は下端が閉塞された円筒状の空間5が形成される。前記
インレットフランジ4には反応ガス導入ポート6が前記
内部反応管3の下方に位置して連通すると共に排気管7
が前記空間5の下端に連通する様設けられている。
【0006】ウェーハ8を水平姿勢で多段に保持するボ
ート9はボートキャップ10を介して金属製炉口蓋11
に支持され、前記ボート9は該金属製炉口蓋11を介し
図示しないボートエレベータに昇降可能に支持され、前
記内部反応管3内に装入される様になっている。前記ボ
ート9が内部反応管3内に完全に装入された状態では、
金属製炉口蓋11が前記インレットフランジ4に気密に
当接し、外部反応管2内を気密に閉塞する様になってい
る。
【0007】ウェーハの処理を行う場合は、前記ボート
9にウェーハ8を水平姿勢で多段に装填し、ウェーハが
装填されたボート9が前記内部反応管3内に装入され、
ヒータ1により内部が所定の温度に加熱された状態で、
前記反応ガス導入ポート6より前記内部反応管3の下端
から反応ガスが導入され、ウェーハ8が処理され、更に
反応後のガスは外部反応管2内部からインレットフラン
ジ4を経て前記排気管7、真空配管(図示せず)から排
気される。
【0008】通常SiO2 成膜時には、SiH4 −N2
O系で800℃、TEOS熱分解では700℃で反応炉
内の温度を保持し、前記ボート9の装入速度を100mm
/minとして処理していた。
【0009】
【発明が解決しようとする課題】近年、半導体素子の高
密度化が進み更に生産性の向上の為、ウェーハ径は増々
大きくなっている。ウェーハの大径化に伴い、ウェーハ
を反応炉内に挿入する際の熱ストレスの影響が大きくな
り、ウェーハ表面上に生成した膜にクラックが発生し、
薄膜が破損して発塵の原因となっていた。この発塵は成
膜後にパーティクルやヘイズ(HAZE:薄膜の表面荒
れ)となり、半導体素子の品質、歩留まりの低下を招い
ていた。
【0010】本発明は斯かる実情に鑑み、半導体製造過
程に於けるパーティクルやヘイズの発生を低減する半導
体製造方法を提供する。
【0011】
【課題を解決するための手段】本発明は、反応炉内にウ
ェーハを装入して化学気相成長によりウェーハ表面に各
種薄膜を生成する半導体製造方法に於いて、ウェーハの
反応炉内への装入速度を20mm/min以下、装入時の反応
炉内温度を600℃以下とするものである。
【0012】
【作用】ウェーハの反応炉内装入時の反応炉内温度を6
00℃以下とし、反応炉内に装入する時のウェーハに加
わる単位時間当たりの熱量を少なくしてクラックの発生
を抑制し、更に装入速度を20mm/min以下とし装入速度
を低下させることでウェーハ表面に付着した不純物が脱
離するに充分な時間を与え、不純物による反応炉内の汚
染を防止し、ウェーハ表面にパーティクルが付着し、ヘ
イズが発生するのを防止する。
【0013】
【実施例】以下、図面を参照しつつ本発明の一実施例を
説明する。
【0014】本発明者は種々の実験を行った結果、パー
ティクル、ヘイズの発生量は装入時の炉内温度、装入速
度と大きな関係があることを確認した。
【0015】図1に炉内温度が700℃である場合にウ
ェーハの装入速度を変化させた場合の、ウェーハ装入速
度とパーティクルの発生個数との関係を示す。図1に示
す如くウェーハ装入速度が50mm/min位迄はウェーハ装
入速度の低下と共にパーティクルの発生個数は急激に減
少し、その後はウェーハ装入速度の低下と共に緩やかに
減少する。
【0016】又、図2にウェーハ装入速度を20mm/min
として炉内温度を変化させた場合の、炉内温度とパーテ
ィクルの発生個数との関係を示す。図2に示す如く炉内
温度が高温側から600℃迄はパーティクルの発生個数
が顕著に減少し、550℃より温度が低下してもパーテ
ィクルの発生個数については殆ど変化がない。
【0017】以上の関係から、反応炉内に装入する時の
ウェーハに加わる単位時間当たりの熱量が少なくなると
クラックの発生が抑制され、装入速度を低下させること
でウェーハ表面に付着した不純物が脱離するに充分な時
間が与えられるので、不純物による反応炉内の汚染を防
止し、ウェーハ表面にパーティクルが付着し、ヘイズが
発生するのを防止できる。
【0018】即ち、装入時炉内温度を600℃迄下げ、
装入速度を20mm/min迄遅くすることでパーティクル、
ヘイズの発生量は著しく減少する。表1は、ウェーハ装
入速度と反応炉内温度とパーティクル発生量、ヘイズ発
生量との具体的関係を示すものである。
【0019】
【表1】
【0020】表1でも分る様に、パーティクルの目標値
を30個とするとウェーハ装入速度20mm/min以下、反
応炉内温度600℃以下の製造条件が得られる。
【0021】尚、本発明はCVD製造方法のSiO2
に効果があるが、勿論他のポリシリコン膜、窒化膜、リ
ンドープトポリシリコン膜、アモルファスシリコン膜、
等にも効果があることは勿論である。
【0022】
【発明の効果】以上述べた如く本発明によれば、成膜時
のパーティクル及びヘイズの発生を抑制するので、半導
体素子製造上の歩留まりが向上し、膜のクラックの発生
を抑制できることにより、ダミーウェーハ、ボートの洗
浄メンテナンスサイクルが長くなり、生産性が向上する
等の優れた効果を発揮する。
【図面の簡単な説明】
【図1】炉内温度が700℃である場合にウェーハの装
入速度を変化させた場合の、ウェーハ装入速度とパーテ
ィクルの発生個数との関係を示す線図である。
【図2】ウェーハ装入速度を20mm/minとして炉内温度
を変化させた場合の、炉内温度とパーティクルの発生個
数との関係を示す線図である。
【図3】縦型CVD装置の主要部である縦型炉の説明図
である。
【符号の説明】
1 ヒータ 2 外部反応管 3 内部反応管 4 インレットフランジ 5 空間 6 反応ガス導入ポート 7 排気管 8 ウェーハ 9 ボート 10 ボートキャップ 11 金属製炉口蓋

Claims (1)

    【特許請求の範囲】
  1. 【請求項1】 反応炉内にウェーハを装入して化学気相
    成長によりウェーハ表面に各種薄膜を生成する半導体製
    造方法に於いて、ウェーハの反応炉内への装入速度を2
    0mm/min以下、装入時の反応炉内温度を600℃以下と
    することを特徴とする半導体製造方法。
JP19596294A 1994-07-28 1994-07-28 半導体製造方法 Pending JPH0845859A (ja)

Priority Applications (1)

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JP19596294A JPH0845859A (ja) 1994-07-28 1994-07-28 半導体製造方法

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JP19596294A JPH0845859A (ja) 1994-07-28 1994-07-28 半導体製造方法

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Publication Number Publication Date
JPH0845859A true JPH0845859A (ja) 1996-02-16

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ID=16349888

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Application Number Title Priority Date Filing Date
JP19596294A Pending JPH0845859A (ja) 1994-07-28 1994-07-28 半導体製造方法

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JP (1) JPH0845859A (ja)

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US6294228B1 (en) 1998-11-04 2001-09-25 Nec Corporation Method for forming thin films
US9487859B2 (en) 2014-03-24 2016-11-08 Tokyo Electron Limited Operating method of vertical heat treatment apparatus, storage medium, and vertical heat treatment apparatus

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US6294228B1 (en) 1998-11-04 2001-09-25 Nec Corporation Method for forming thin films
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