JPH0846078A - 多層配線構造の半導体装置 - Google Patents

多層配線構造の半導体装置

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JPH0846078A
JPH0846078A JP6174236A JP17423694A JPH0846078A JP H0846078 A JPH0846078 A JP H0846078A JP 6174236 A JP6174236 A JP 6174236A JP 17423694 A JP17423694 A JP 17423694A JP H0846078 A JPH0846078 A JP H0846078A
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Abstract

(57)【要約】 【目的】信号配線と電源／グランド系導体との幾何学的
形状を含め、高速信号伝送に適した多層配線構造の半導
体装置を提供すること。 【構成】複数の平行ストリップ状導体パターンを有する
電源／グランド系層11-1，11-2の間に信号配線層Ｓ1 ，
Ｓ2 が形成されている。各層間は絶縁層20により隔てら
れている。信号配線層Ｓ1 の各配線13-1は電源層11-1の
導体パターン12-1に平行な配置であり、信号配線層Ｓ2
の各配線13-2はグランド層11-2の導体パターン12-2に平
行な配置である。

Description

【発明の詳細な説明】
【０００１】
【産業上の利用分野】この発明は、多層配線基板（マル
チチップ・モジュール用多層基板）により複数の半導体
素子を実装する多層配線構造の半導体装置に関する。
【０００２】
【従来の技術】図８は従来の多層配線構造の半導体装置
に使用されている多層配線基板の電源／グランド系層と
信号配線層を示す分解斜視図である。網目状の導体パタ
ーンを有する電源／グランド系層31-1，31-2の間に信号
配線層Ｓ1 ，Ｓ2 が形成されている。各層間は絶縁層20
により隔てられている。
【０００３】図９は図８のグランド層31-2と信号配線層
Ｓ2 の導体パターンを抜き出し矢印Ａの方向から透視し
た平面図である。信号配線層Ｓ2 の配線パターンＳＰ9
はグランド層11-2における直交する導体パターンＧＰ9
の一方側の方向と同じ方向、他方側に対し９０゜の方向
に図示しない絶縁層を隔てて並列される。なお、電源層
11-1と信号配線層Ｓ1 の導体パターンを抜き出し矢印Ｂ
の方向からみた構成も同じ構成と考えてよい。
【０００４】上記手法で表す平面図として他に考えられ
たパターンを図１０〜図１２に示す。図１０の配線パタ
ーンＳＰ10はグランド層における直交する導体パターン
ＧＰ10の一方及び他方側に対し４５゜の方向に伸長し配
置される。また、図１１のグランド層は直交する導体パ
ターンＧＰ11の一方側が極端に少ない本数の配列であ
り、その少ない本数の配列と同じ方向に配線パターンＳ
Ｐ11が配置される。また、図１２はグランド層が平面の
導体パターンＧＰ12であり、図示しない絶縁層を隔てて
配線パターンＳＰ11が配置される。。
【０００５】高速信号伝送に適した信号配線構造を得る
には線路容量及び線路インダクタンスに関する検討が必
要である。なぜなら、信号伝搬遅延定数ｔｐｄは次式で
表されるからである。
【０００６】
【数１】
【０００７】まず、線路容量Ｃについて考える。容量は
互いの層間の質と距離が同じとすれば、対向する面積に
比例して大きくなる。図９，図１０，図１１，図１２そ
れぞれの配線容量Ｃは、パターンを相対的にみて、だい
たい図１２が最も大きく、図１１が最も小さく、図９と
図１０はその間に位置付けられる。
【０００８】次に、線路インダクタンスＬについて考え
る。図０６を参照すると、線路インダクタンスは信号配
線ＳＰの自己インダクタンスＬｓ、グランド層ＧＰの自
己インダクタンスＬｇ、これら相互インダクタンスをＭ
とすると、大略次式で表せる。
【０００９】
【数２】 すなわち、信号配線層ＳＰの信号電流ＳＩが発生する
と、グランド層ＧＰの電流ＧＩはこの信号電流ＳＩと逆
向きに流れる（リターン電流）。このリターン電流によ
って信号配線層ＳＰとグランド層ＧＰとの間の相互イン
ダクタンスが作用し、線路インダクタンスが低減され
る。相互インダクタンスＭは並行する線路どうしで最大
になり、直交する線路どうしでは０になる。多層配線構
造において相互インダクタンスは線路インダクタンスを
低減させるための重要な要素である。
【００１０】図９，図１０，図１１，図１２それぞれの
相互インダクタンスＭは、パターンを相対的にみて、だ
いたい図１２が最も大きく、図１１が最も小さく、図９
と図１０はその間であると考えられる。従って、それぞ
れの線路インダクタンスＬは図１１が最も大きく、図５
が最も小さく、図９と図１０はその間に位置付けられ
る。
【００１１】上記(1) 式の線路インダクタンスＬの占め
る割合は配線容量Ｃに比べて大きい。図９から図１１の
構成は線路容量は低減されるものの、信号電流と逆方向
の電源／グランド電流が流れ難く、相互インダクタンス
が作用しないため線路インダクタンスを著しく増加させ
てしまう。この結果、(1) 式で表した伝搬遅延が増大
し、高速信号伝送に適さない。従って、高速信号伝送に
適した信号配線構造を得るには線路インダクタンスＬを
低減するような構造が望ましいといえる。このような観
点から、図１２の電源／グランド系層の導体パターンの
ように開口部や不連続部分のない信号配線方向に連続な
平面パターンがよい。
【００１２】しかし、多層配線基板において、絶縁層に
ポリイミドのような樹脂材料を用いた場合、絶縁層を形
成するプロセス中、ガスや水分を放出させる。これを外
部に抜け易くするためには、開口部を設けた網目状パタ
ーンの電源／グランド系層を使用しなければならない。
【００１３】網目状パターンの電源／グランド系層は上
述のように信号線に対して伝搬遅延を増加させたり、波
形歪みが生じる等、平面パターンの電源／グランド系層
と比較して電気的特性が劣化する。
【００１４】これまで、網目状パターンに関する電気的
特性評価、解析例は少ない。従来の網目状パターンの設
計手法としては、信号線と電源／グランド系層間に形成
される線路容量を求め、ＴＥＭ（transverse electro-
magnetic）波近似により求める手法が一般的であった。
しかし、上記 (1)式のように、高速信号伝送に適した信
号配線構造を得るには線路容量だけではなく線路インダ
クタンスの制御が必要なことがわかった。
【００１５】
【発明が解決しようとする課題】このように、従来の網
目状パターンの電源／グランド系層と信号配線の関係を
導くＴＥＭ波近似手法では、線路インダクタンスに関す
る情報が得られず、網目状パターンを設計する際に誤り
を招く恐れがある。特に線路容量を最適化させるパター
ンと、線路インダクタンスを最適化させるパターンは必
ずしも一致しないのでパターン設計上留意しなければな
らない。
【００１６】この発明は上記のような事情を考慮してな
されたものであり、その目的は、信号配線と電源／グラ
ンド系導体との幾何学的形状を含め、高速信号伝送に適
した多層配線構造の半導体装置を提供することにある。
【００１７】
【課題を解決するための手段】この発明の多層配線構造
の半導体装置は、それぞれ所定の電位が与えられる複数
の平行ストリップ状導体からなる電位供給系層と、前記
電位供給系層に絶縁物層を隔てて積層され、前記平行ス
トリップ状導体と平行な配線で構成される信号配線層と
を具備したことを特徴とする。
【００１８】
【作用】信号伝送の高速化の要求が著しいマルチチップ
・モジュール等では、電気的特性の劣化をいかに抑える
かが配線基板性能を左右する要因となっている。この発
明では、電位供給系層を平行なストリップ状導体で形成
する。かつそのストリップ状導体を電位供給系層の直
下、あるいは直上に配置される信号配線と平行になるよ
うに構成する。このとき、平行ストリップ状導体のパタ
ーンの導体幅を信号配線の２倍以下、パターン・ピッチ
を信号配線幅の３．０倍以下にすれば、伝搬遅延を最小
に、かつ波形歪みの少ない最適パターンが得られる。
【００１９】
【実施例】高速信号伝送ではＴＥＭ波を伝送しなければ
ならないが、これには同軸ケーブルに代表されるような
２導体系伝送線路が必要である。２導体系伝送線路を配
線基板のような２次元構造に適用したものが、マイクロ
・ストリップ線路やコプレナ線路と呼ばれる線路構造で
ある。このような線路は、信号配線と電源／グランド系
層からなり、電源／グランド系層は信号配線方向に連続
であることが望ましい。しかし、配線基板プロセス上、
電源／グランド系導体層を完全な平面パターンにはでき
ない。
【００２０】この発明は電源／グランド系層の導体パタ
ーンと信号配線との幾何学的位置関係を電気的特性の観
点から解析、評価して多層配線構造の最適化を図ったも
のであり、以下にその構成を説明する。
【００２１】図１はこの発明の第１実施例に係る多層配
線構造の半導体装置に使用される多層配線基板の電源／
グランド系層と信号配線層を示す分解斜視図である。複
数の平行ストリップ状導体からなる導体パターンを有す
る電源／グランド系層11-1，11-2の間に信号配線層Ｓ1
，Ｓ2 が形成されている。各層間は絶縁層20により隔
てられている。
【００２２】この図１の構成の場合、電源／グランド系
層11-1，11-2のうち、11-1は電源層、11-2はグランド層
となっており、信号配線層Ｓ1 の各配線13-1は電源層11
-1の導体パターン12-1に平行な配置であり、信号配線層
Ｓ2 の各配線13-2はグランド層11-2の導体パターン12-2
に平行な配置である。
【００２３】すなわち、信号配線13（13-1，13-2）に平
行な電源／グランド系の導体パターン12（12-1，12-2）
が構成されることが重要である。この構成によれば、電
源／グランド系層に流れるリターン電流は信号電流と逆
向きに妨げられることなく流れる。これにより、信号配
線と電源／グランド系層間の相互インダクタンスによ
り、線路インダクタンスが低減される。
【００２４】さらに、電源／グランド系層の導体パター
ンは信号配線と以下のような幾何学的関係を有すると
き、線路容量、線路インダクタンスとも最適化される。
その構成を図２を参照して説明する。図２は図１の電源
／グランド系層11-2と信号配線層Ｓ2 の導体パターンを
抜き出し矢印Ａの方向から透視した平面図である。信号
配線層Ｓ2 の配線パターンは電源／グランド系層11-2に
おける平行ストリップ状導体パターンと平行に配置され
るが、信号配線13-2がこの平行ストリップ状導体と向か
い合わせの配置関係をオン・グリッド（On grid ）と呼
び、平行ストリップ状導体の隣り合う２本の間の領域と
向かい合わせの配置関係をオフ・グリッド（Off grid）
と呼ぶことにする。信号配線の配置は電源／グランド系
層の導体パターン（平行ストリップ状導体）と上記いず
れかの関係をとる。なお、図１における電源／グランド
系層11-1と信号配線層Ｓ1 の導体パターンを抜き出し矢
印Ｂの方向からみた構成も同じ構成と考えてよい。
【００２５】たとえば、上記グランド層11-2において、
平行ストリップ状導体それぞれの幅をＷｇ、導体のパタ
ーン・ピッチをＰｂ、信号配線層の配線幅をＷｓとすれ
ば、電源／グランド系層の導体パターンと信号配線との
幾何学的関係、 Ｗｇ≦２．０Ｗｓ，Ｐｂ≦３．０Ｗｓ …(3) の各条件を満たすとき、信号配線13-2がOn grid でも、
Off gridでも線路パラメータがほぼ等しくなる。従っ
て、高速信号伝送を満足する電気的特性を有し、かつパ
ラメータ制御が容易な配線パターンが提供できる。これ
により、図１の構成は前記図１２の平面グランドパター
ンと同等な電気特性を持つように構成可能となる。
【００２６】図３は上記第２実施例に係る多層配線構造
の半導体装置に使用される多層配線基板の電源／グラン
ド系層と信号配線層を示す分解斜視図である。複数の平
行ストリップ状導体からなる導体パターンを有する電源
／グランド系層21-1，21-2の間に信号配線層Ｓ1 ，Ｓ2
が形成されている。各層間は絶縁層20により隔てられて
いる。電源／グランド系層21-1，21-2の各導体パターン
は適宜ヴィアホール15による接続手段が適用される。こ
れにより、電源／グランド系層21-1，21-2は共に混在電
位層となっている。また、第１実施例と同様に、信号配
線層Ｓ1 の各配線13-1は電源／グランド系層21-1の導体
パターン22-1に平行な配置であり、信号配線層Ｓ2 の各
配線13-2は電源／グランド系層21-2の導体パターン22-2
に平行な配置である。
【００２７】図４は図３の電源／グランド系層21-2と信
号配線層Ｓ2 の導体パターンを抜き出し矢印Ａの方向か
ら透視した平面図である。信号配線層Ｓ2 の配線パター
ンは電源／グランド系層21-2における平行ストリップ状
導体パターンと平行に配置され、オン・グリッド（On g
rid ）、オフ・グリッド（Off grid）の配置関係は前記
図２と同様である。この図４において、15はヴィアホー
ルであり、ヴィアホールの形成位置の条件を示してい
る。Ｐａはヴィアホールを形成する間隔を示す。電源／
グランド系層のストリップ状導体のパターン・ピッチを
Ｐｂとして、 Ｐａ≦２０Ｐｂ …(4) 上記 (4)式で表される関係を満たすようなヴィアホール
15を形成し、電源／グランド系層21-1と21-2の各ストリ
ップ状導体どうしを所望のヴィアホール15にて適宜接続
することにより、さらに電気的特性に優れる基板を提供
することができる。ヴィアホール15による接続は、上記
(4) 式のごとく電源／グランド系層の導体パターン・ピ
ッチの２０倍以内の間隔、あるいは伝搬される信号波長
の１／４以下の間隔で行われてもよい。
【００２８】図５、図６はそれぞれ上記第２の実施例に
係る混在電位系層の電源／グランド系導体層のパターン
の一例を示す図４に準ずる平面図である。図５は上述し
たヴィアホール15の配置条件を適用し図３に示すような
接続手段を施し電源／グランド系層の導体パターン22に
おいて電源導体（Power ）とグランド導体（Ground）を
交互に配置した構成である。素子の実装を考えた場合こ
のような配置構成が好ましい。また、図６は電源導体
（Power ）とグランド導体（Ground）をヴィアホール位
置等を考慮して、適宜配置したものである。同一層内に
おける電源導体とグランド導体は、基板用途に応じて選
択配置すればよい。
【００２９】上記構成によれば、複数の電源／グランド
系層を有する配線基板において、平面グランド・パター
ンと同等な電気的特性を持つことができる。すなわち、
電源／グランド系層が混在電位層となり、これが２層以
上存在し、その導体パターンが絶縁物層20を隔てて積層
される最も近い信号配線層の信号配線が前記図４の位置
関係を満たすように配置されていればよい。
【００３０】なお、多層配線基板の導体材料は、Ｃｕ，
Ａｌ等の導電性材料、絶縁層材料には、ポリイミド等の
樹脂材料、アルミナ等のセラミック材料など基板プロセ
ス、基板用途により適宜選択するものとする。また、絶
縁層の厚さ、導体層の厚さ等は、電気設計上、特性イン
ピーダンス等を基に必要とされる値を選ぶものとする。
【００３１】図７は各導体パターンを用いた場合の信号
の伝搬遅延の解析、評価を示す波形図である。ロジック
の“０”レベルから“１”レベルへの信号変化を示して
おり、レベルＶＴがＣＭＯＳロジックの切換点である。
各波形において、1 は本願の電源／グランド系層と信号
配線層の配置関係を適用した場合の特性、2 前記図１２
の平面パターンの電源／グランド系層を用いた場合の特
性、3 は前記図１０の網目状パターンの電源／グランド
系層と信号配線層の配置関係（４５゜メッシュタイプ）
の特性、4 は前記図９の網目状パターンの電源／グラン
ド系層と信号配線層の配置関係（９０゜タイプ）の特性
を示す。この図からも明らかなように平面グランドパタ
ーンと同等な電気特性を持つようになり、高速信号伝送
に好適な信号線路構造が達成できることがわかる。
“１”レベルの初期に振動がみられるが、この時点での
振動は信号伝送に全く支障ない。
【００３２】
【発明の効果】以上説明したようにこの発明によれば、
従来の網目状パターンと異なり、平行ストリップ状パタ
ーンを信号配線と平行に配置させた構成により、平面状
の電源／グランド系パターンを使用した場合と同等の電
気的特性を有する高速信号伝送に適した多層配線構造の
半導体装置を提供することができる。
【図面の簡単な説明】
【図１】この発明の第１実施例に係る多層配線構造の半
導体装置に使用される多層配線基板の電源／グランド系
層と信号配線層を示す分解斜視図。
【図２】図１の構成の一部分を抜き出し所定方向から透
視した平面図。
【図３】この発明の第２実施例に係る多層配線構造の半
導体装置に使用される多層配線基板の電源／グランド系
層と信号配線層を示す分解斜視図。
【図４】図３の構成の一部分を抜き出し所定方向から透
視した平面図であり、ヴィアホール形成位置の条件を追
加した平面図。
【図５】第２実施例に係る混在電位系層の電源／グラン
ド系導体層のパターンの一例を示す図４に準ずる第１の
平面図。
【図６】第２実施例に係る混在電位系層の電源／グラン
ド系導体層のパターンの一例を示す図４に準ずる第２の
平面図。
【図７】この発明に係る信号の伝搬遅延の解析、評価を
示す波形図。
【図８】従来の多層配線構造の半導体装置に使用されて
いる多層配線基板の電源／グランド系層と信号配線層を
示す分解斜視図。
【図９】図８の構成の一部分を抜き出し所定方向から透
視した従来の第１平面図。
【図１０】図９に準ずる従来の第２の平面図。
【図１１】図９に準ずる従来の第３の平面図。
【図１２】図９に準ずる従来の第４の平面図。
【図１３】線路インダクタンスを説明するための斜視
図。
【符号の説明】
11-1，11-2，21-1，21-2…電源／グランド系層、12-1，
12-2，22-1，22-2…導体パターン、20…絶縁層、Ｓ1 ，
Ｓ2 …信号配線層、15…ヴィアホール。

Claims (9)

    【特許請求の範囲】
  1. 【請求項１】 それぞれ所定の電位が与えられる複数の
    平行ストリップ状導体からなる電位供給系層と、 前記電位供給系層に絶縁物層を隔てて積層され、前記平
    行ストリップ状導体と平行な配線で構成される信号配線
    層とを具備したことを特徴とする多層配線構造の半導体
    装置。
  2. 【請求項２】 前記電位供給系層と信号配線層の相関関
    係を有する層が絶縁物層を隔てて複数層構成されること
    を特徴とする請求項１記載の多層配線構造の半導体装
    置。
  3. 【請求項３】 前記電位供給系層における平行ストリッ
    プ状導体それぞれの幅は前記信号配線層における配線幅
    それぞれの２倍以下、かつ前記平行ストリップ状導体の
    パターン・ピッチは前記配線幅それぞれの３．０倍以下
    であることを特徴とする請求項１記載の多層配線構造の
    半導体装置。
  4. 【請求項４】 前記信号配線層における配線は前記電位
    供給系層の平行ストリップ状導体と向かい合わせの第１
    の配置、前記平行ストリップ状導体の隣り合う２本の間
    の領域と向かい合わせの第２の配置のいずれかの配置構
    成であることを特徴とする請求項３記載の多層配線構造
    の半導体装置。
  5. 【請求項５】 前記電位供給系層が２層あるときその第
    １層と第２層は互いの平行ストリップ状導体をこの平行
    ストリップ状導体のパターンピッチの２０倍以内の間隔
    でヴィアホールにて適宜接続する手段を有することを特
    徴とする請求項２記載の多層配線構造の半導体装置。
  6. 【請求項６】 信号配線層と電源／グランド系層で構成
    される複数の半導体素子を実装する多層配線基板を具備
    し、前記電源／グランド系層が複数の平行ストリップ状
    導体からなり、この平行ストリップ状導体が前記電源／
    グランド系層の直下あるいは直上にある前記信号配線層
    の配線に対して平行に配置されたことを特徴とする多層
    配線構造の半導体装置。
  7. 【請求項７】 前記電源／グランド系層の平行ストリッ
    プ状導体それぞれの幅は前記信号配線層における配線幅
    それぞれの２倍以下、かつ前記平行ストリップ状導体の
    パターン・ピッチは前記配線幅それぞれの３．０倍以下
    であることを特徴とする請求項８記載の多層配線構造の
    半導体装置。
  8. 【請求項８】 前記電源／グランド系層が前記信号配線
    層を隔てて少なくとも２層あり、互いの前記平行ストリ
    ップ状導体の対応箇所をこの平行ストリップ状導体のパ
    ターンピッチの２０倍以内の間隔でヴィアホールにて適
    宜接続する手段を具備したことを特徴とする請求項７記
    載の多層配線構造の半導体装置。
  9. 【請求項９】 前記平行ストリップ状導体のパターンが
    電源系とグランド系交互に配置されることを特徴とする
    請求項７または８いずれか記載の多層配線構造の半導体
    装置。
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