JPH0897722A - シーケンサ用のｄａ変換増設ユニット - Google Patents
シーケンサ用のｄａ変換増設ユニットInfo
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- JPH0897722A JPH0897722A JP23576294A JP23576294A JPH0897722A JP H0897722 A JPH0897722 A JP H0897722A JP 23576294 A JP23576294 A JP 23576294A JP 23576294 A JP23576294 A JP 23576294A JP H0897722 A JPH0897722 A JP H0897722A
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Abstract
(57)【要約】
【目的】 標準的なシーケンサ２０と組み合わせてアナ
ログ信号からなる出力信号を得る。 【構成】 シーケンサ２０からのａビットのデータ信号
Ｓ1 を共通に入力するｎ組のＤＡ変換器１３、１３…を
設ける。各ＤＡ変換器１３は、シーケンサ２０からの選
択信号Ｓ2i（ｉ＝１、２…ｎ）に呼応してデータ信号Ｓ
1 をアナログ変換し、電圧増幅器１５、電流増幅器１６
を介して電圧信号、電流信号を出力する。
ログ信号からなる出力信号を得る。 【構成】 シーケンサ２０からのａビットのデータ信号
Ｓ1 を共通に入力するｎ組のＤＡ変換器１３、１３…を
設ける。各ＤＡ変換器１３は、シーケンサ２０からの選
択信号Ｓ2i（ｉ＝１、２…ｎ）に呼応してデータ信号Ｓ
1 をアナログ変換し、電圧増幅器１５、電流増幅器１６
を介して電圧信号、電流信号を出力する。
Description
【０００１】
【産業上の利用分野】この発明は、自動機械等の制御装
置として広く使用されているシーケンサと組み合わせる
シーケンサ用のＤＡ変換増設ユニットに関する。
置として広く使用されているシーケンサと組み合わせる
シーケンサ用のＤＡ変換増設ユニットに関する。
【０００２】
【従来の技術】あらゆる自動機械や自動設備等の電気制
御装置として、シーケンサが広く採用されている。
御装置として、シーケンサが広く採用されている。
【０００３】シーケンサは、従来のワイアドロジック制
御装置に代わる汎用の論理制御装置であり、内蔵のマイ
クロコンピュータを介し、論理制御内容を簡便に構築
し、変更することができる点に特徴がある。すなわち、
このものは、専用の表示制御ユニットを備えており、表
示制御ユニットを介し、所定の手順により、制御内容を
設定し、設定された制御内容を表示し、必要に応じ、こ
れを任意に変更することが可能である。
御装置に代わる汎用の論理制御装置であり、内蔵のマイ
クロコンピュータを介し、論理制御内容を簡便に構築
し、変更することができる点に特徴がある。すなわち、
このものは、専用の表示制御ユニットを備えており、表
示制御ユニットを介し、所定の手順により、制御内容を
設定し、設定された制御内容を表示し、必要に応じ、こ
れを任意に変更することが可能である。
【０００４】なお、シーケンサは、一般に、ディジタル
信号からなる入力信号を入力し、出力ユニットを介し、
所定の制御対象を制御するためのディジタル信号を出力
するようになっており、アナログ信号からなる出力信号
は、取り扱わないのが普通である。出力信号としてアナ
ログ信号を取り扱うとすれば、出力ユニットにＤＡ変換
器（ディジタルアナログ変換器をいう、以下同じ）を含
める必要があり、全体コストが過大になってしまうから
である。
信号からなる入力信号を入力し、出力ユニットを介し、
所定の制御対象を制御するためのディジタル信号を出力
するようになっており、アナログ信号からなる出力信号
は、取り扱わないのが普通である。出力信号としてアナ
ログ信号を取り扱うとすれば、出力ユニットにＤＡ変換
器（ディジタルアナログ変換器をいう、以下同じ）を含
める必要があり、全体コストが過大になってしまうから
である。
【０００５】
【発明が解決しようとする課題】かかる従来技術による
ときは、標準的なシーケンサは、アナログ信号を出力す
る機能を備えていないので、アナログ信号からなる出力
信号を必要とする場合は、その都度、外部に専用のＤＡ
変換装置を設けることを要し、全体システムが複雑とな
る上、設計製造に過大な時間やコストを要するという問
題が避けられなかった。
ときは、標準的なシーケンサは、アナログ信号を出力す
る機能を備えていないので、アナログ信号からなる出力
信号を必要とする場合は、その都度、外部に専用のＤＡ
変換装置を設けることを要し、全体システムが複雑とな
る上、設計製造に過大な時間やコストを要するという問
題が避けられなかった。
【０００６】そこで、この発明の目的は、シーケンサの
出力ユニットからのデータ信号、選択信号によって動作
する複数のＤＡ変換器を基板上に搭載することによっ
て、標準的なシーケンサと組み合わせ、アナログ信号か
らなる出力信号を簡単に出力させることができるシーケ
ンサ用のＤＡ変換増設ユニットを提供することにある。
出力ユニットからのデータ信号、選択信号によって動作
する複数のＤＡ変換器を基板上に搭載することによっ
て、標準的なシーケンサと組み合わせ、アナログ信号か
らなる出力信号を簡単に出力させることができるシーケ
ンサ用のＤＡ変換増設ユニットを提供することにある。
【０００７】
【課題を解決するための手段】かかる目的を達成するた
めのこの発明の構成は、シーケンサの出力ユニットから
時系列的に出力されるデータ信号を共通に入力する複数
のＤＡ変換器を基板上に搭載してなり、ＤＡ変換器は、
それぞれ、シーケンサの出力ユニットからデータ信号に
同期して出力される選択信号に呼応してデータ信号をア
ナログ変換して出力することをその要旨とする。
めのこの発明の構成は、シーケンサの出力ユニットから
時系列的に出力されるデータ信号を共通に入力する複数
のＤＡ変換器を基板上に搭載してなり、ＤＡ変換器は、
それぞれ、シーケンサの出力ユニットからデータ信号に
同期して出力される選択信号に呼応してデータ信号をア
ナログ変換して出力することをその要旨とする。
【０００８】なお、ＤＡ変換器は、フォトカプラ回路を
介してデータ信号を入力することができ、さらに、フォ
トカプラ回路を介して選択信号を入力することができ
る。
介してデータ信号を入力することができ、さらに、フォ
トカプラ回路を介して選択信号を入力することができ
る。
【０００９】また、ＤＡ変換器は、出力側に電圧増幅
器、電流増幅器を並列に接続することができる。
器、電流増幅器を並列に接続することができる。
【００１０】
【作用】かかる発明の構成によるときは、複数のＤＡ変
換器は、シーケンサの出力から時系列的に出力されるデ
ータ信号を共通に入力し、データ信号に同期して出力さ
れる選択信号に呼応して、入力されるデータ信号をアナ
ログ変換して出力する。すなわち、各ＤＡ変換器は、選
択信号が与えられることにより、その時点において、デ
ータ信号に含まれるディジタルデータをアナログ信号に
変換して出力することが可能である。なお、全体は、基
板上に搭載されているから、コンパクトな増設ユニット
として構成することができる。
換器は、シーケンサの出力から時系列的に出力されるデ
ータ信号を共通に入力し、データ信号に同期して出力さ
れる選択信号に呼応して、入力されるデータ信号をアナ
ログ変換して出力する。すなわち、各ＤＡ変換器は、選
択信号が与えられることにより、その時点において、デ
ータ信号に含まれるディジタルデータをアナログ信号に
変換して出力することが可能である。なお、全体は、基
板上に搭載されているから、コンパクトな増設ユニット
として構成することができる。
【００１１】フォトカプラ回路を介してデータ信号、選
択信号をＤＡ変換器に入力すれば、フォトカプラ回路
は、データ信号ライン、選択信号ラインに有害なノイズ
が混入しても、これを遮断し、ＤＡ変換器が不用意に破
損してしまうことを有効に防止することができる。
択信号をＤＡ変換器に入力すれば、フォトカプラ回路
は、データ信号ライン、選択信号ラインに有害なノイズ
が混入しても、これを遮断し、ＤＡ変換器が不用意に破
損してしまうことを有効に防止することができる。
【００１２】ＤＡ変換器の出力側に電圧増幅器、電流増
幅器を接続すれば、必要に応じ、電圧信号、電流信号の
いずれかの出力信号を選択して出力することが可能であ
る。
幅器を接続すれば、必要に応じ、電圧信号、電流信号の
いずれかの出力信号を選択して出力することが可能であ
る。
【００１３】
【実施例】以下、図面を以って実施例を説明する。
【００１４】シーケンサ用のＤＡ変換増設ユニット（以
下、単に増設ユニットという）１０は、ｎ組のＤＡ変換
器１３、１３…を図示しない基板上に搭載してなる（図
１）。ただし、ｎは、ｎ≧２の任意の整数である。
下、単に増設ユニットという）１０は、ｎ組のＤＡ変換
器１３、１３…を図示しない基板上に搭載してなる（図
１）。ただし、ｎは、ｎ≧２の任意の整数である。
【００１５】増設ユニット１０には、シーケンサ２０の
出力ユニット２１からのデータ信号Ｓ1 、選択信号Ｓ2i
（ｉ＝１、２…ｎ）が入力されている。データ信号Ｓ1
は、ａビットのディジタル信号であり、フォトカプラ回
路１１を介し、ＤＡ変換器１３、１３…に対して共通に
入力されている。そこで、出力ユニット２１、フォトカ
プラ回路１１、ＤＡ変換器１３、１３…は、ａ本の信号
バスを介して接続されているものとする。ただし、ａ
は、各ＤＡ変換器１３のビット数に一致する任意の整数
であり、ａ＝８、１０、１２等に定めるのがよい。
出力ユニット２１からのデータ信号Ｓ1 、選択信号Ｓ2i
（ｉ＝１、２…ｎ）が入力されている。データ信号Ｓ1
は、ａビットのディジタル信号であり、フォトカプラ回
路１１を介し、ＤＡ変換器１３、１３…に対して共通に
入力されている。そこで、出力ユニット２１、フォトカ
プラ回路１１、ＤＡ変換器１３、１３…は、ａ本の信号
バスを介して接続されているものとする。ただし、ａ
は、各ＤＡ変換器１３のビット数に一致する任意の整数
であり、ａ＝８、１０、１２等に定めるのがよい。
【００１６】選択信号Ｓ2iは、フォトカプラ回路１２を
介し、各ＤＡ変換器１３に対して個別に入力されてい
る。
介し、各ＤＡ変換器１３に対して個別に入力されてい
る。
【００１７】各ＤＡ変換器１３の出力側には、信号増幅
器１４を介し、電圧増幅器１５、電流増幅器１６が並列
に接続されている。また、各電圧増幅器１５、各電流増
幅器１６の出力は、それぞれ出力端子Ｔai（ｉ＝１、２
…ｎ）、Ｔbi（ｉ＝１、２…ｎ）に導かれている。
器１４を介し、電圧増幅器１５、電流増幅器１６が並列
に接続されている。また、各電圧増幅器１５、各電流増
幅器１６の出力は、それぞれ出力端子Ｔai（ｉ＝１、２
…ｎ）、Ｔbi（ｉ＝１、２…ｎ）に導かれている。
【００１８】フォトカプラ回路１１は、データ信号Ｓ1
の各ビットに対応して、ａ組のフォトカプラ式の信号絶
縁回路１１ａ、１１ａ…を内蔵している（図２）。ただ
し、ここでは、任意の１組の信号絶縁回路１１ａのみ
が、シーケンサ２０の出力ユニット２１内の対応する１
組の信号発生回路２１ａとともに図示されている。
の各ビットに対応して、ａ組のフォトカプラ式の信号絶
縁回路１１ａ、１１ａ…を内蔵している（図２）。ただ
し、ここでは、任意の１組の信号絶縁回路１１ａのみ
が、シーケンサ２０の出力ユニット２１内の対応する１
組の信号発生回路２１ａとともに図示されている。
【００１９】シーケンサ２０側の信号発生回路２１ａ
は、電源Ｅと、出力用のトランジスタＴとの組合せから
なっている。トランジスタＴのベースは、シーケンサ２
０の図示しない論理部に接続されており、論理部からの
制御信号Ｓに従い、所定のタイミングにおいてハイレベ
ル、ローレベルに変化する。
は、電源Ｅと、出力用のトランジスタＴとの組合せから
なっている。トランジスタＴのベースは、シーケンサ２
０の図示しない論理部に接続されており、論理部からの
制御信号Ｓに従い、所定のタイミングにおいてハイレベ
ル、ローレベルに変化する。
【００２０】電源Ｅのプラス側、トランジスタＴのコレ
クタ側は、外部に引き出され、信号絶縁回路１１ａにお
いて、分圧用の抵抗Ｒ1 、Ｒ2 を介して接続されてい
る。また、抵抗Ｒ1 と並列に、フォトカプラＰＣの入力
側と、保護用のダイオードＤとが接続されており、フォ
トカプラＰＣの出力側は、フォトカプラ回路１１の外部
に引き出されている。
クタ側は、外部に引き出され、信号絶縁回路１１ａにお
いて、分圧用の抵抗Ｒ1 、Ｒ2 を介して接続されてい
る。また、抵抗Ｒ1 と並列に、フォトカプラＰＣの入力
側と、保護用のダイオードＤとが接続されており、フォ
トカプラＰＣの出力側は、フォトカプラ回路１１の外部
に引き出されている。
【００２１】フォトカプラ回路１２には、選択信号Ｓ2i
に対応して、ｎ組のフォトカプラ式の信号絶縁回路１２
ａ、１２ａ…が内蔵されている。ただし、各信号絶縁回
路１２ａは、図２の信号絶縁回路１１ａと全く同様に構
成されている。
に対応して、ｎ組のフォトカプラ式の信号絶縁回路１２
ａ、１２ａ…が内蔵されている。ただし、各信号絶縁回
路１２ａは、図２の信号絶縁回路１１ａと全く同様に構
成されている。
【００２２】いま、図２において、トランジスタＴのベ
ースがハイレベルになり、トランジスタＴが導通する
と、電源ＥによってフォトカプラＰＣの入力側に電流が
流れ、フォトカプラＰＣの出力側に出力信号が発生す
る。したがって、フォトカプラ回路１１は、ａ組の信号
絶縁回路１１ａ、１１ａ…を内蔵していることにより、
出力ユニット２１からのａビットのデータ信号Ｓ1 をそ
のまま中継してＤＡ変換器１３、１３…に出力すること
ができる。同様に、フォトカプラ回路１２は、ｎ組の信
号絶縁回路１２ａ、１２ａ…を内蔵していることによ
り、出力ユニット２１からのｎ個の選択信号Ｓ2iをその
まま中継して、所定のＤＡ変換器１３に出力することが
できる。
ースがハイレベルになり、トランジスタＴが導通する
と、電源ＥによってフォトカプラＰＣの入力側に電流が
流れ、フォトカプラＰＣの出力側に出力信号が発生す
る。したがって、フォトカプラ回路１１は、ａ組の信号
絶縁回路１１ａ、１１ａ…を内蔵していることにより、
出力ユニット２１からのａビットのデータ信号Ｓ1 をそ
のまま中継してＤＡ変換器１３、１３…に出力すること
ができる。同様に、フォトカプラ回路１２は、ｎ組の信
号絶縁回路１２ａ、１２ａ…を内蔵していることによ
り、出力ユニット２１からのｎ個の選択信号Ｓ2iをその
まま中継して、所定のＤＡ変換器１３に出力することが
できる。
【００２３】一方、出力ユニット２１は、データ信号Ｓ
1 として、第１番目から第ｎ番目までのａビットのディ
ジタルデータを時系列的に出力するものとする（図
３）。また、出力ユニット２１は、同時に、データ信号
Ｓ1 に同期して選択信号Ｓ2iを時系列的に出力するもの
とする（同図）。ただし、選択信号Ｓ2iは、第ｉ番目の
ディジタルデータが確立した後、微少時間Ｔ0 後に出力
され、十分長い持続時間Ｔ1 の後、第ｉ番目のディジタ
ルデータの消滅前に、十分な余裕時間Ｔ2 だけ早く消滅
するものとする。
1 として、第１番目から第ｎ番目までのａビットのディ
ジタルデータを時系列的に出力するものとする（図
３）。また、出力ユニット２１は、同時に、データ信号
Ｓ1 に同期して選択信号Ｓ2iを時系列的に出力するもの
とする（同図）。ただし、選択信号Ｓ2iは、第ｉ番目の
ディジタルデータが確立した後、微少時間Ｔ0 後に出力
され、十分長い持続時間Ｔ1 の後、第ｉ番目のディジタ
ルデータの消滅前に、十分な余裕時間Ｔ2 だけ早く消滅
するものとする。
【００２４】そこで、各ＤＡ変換器１３は、選択信号Ｓ
2iの立下り時点において、入力されているデータ信号Ｓ
1 のディジタルデータをアナログ変換し、それを保持し
て出力するものとすれば、第ｉ番目のＤＡ変換器１３
は、データ信号Ｓ1 の第ｉ番目のディジタルデータのみ
を抽出し、それをアナログ変換した上、アナログ信号と
して出力することができる。データ信号Ｓ1 は、フォト
カプラ回路１１を介し、ＤＡ変換器１３、１３…に対し
て共通に入力され、選択信号Ｓ2iは、フォトカプラ回路
１２を介し、第ｉ番目のＤＡ変換器１３に入力されてお
り、したがって、第ｉ番目のＤＡ変換器１３は、選択信
号Ｓ2iに呼応して、データ信号Ｓ1 の第ｉ番目のディジ
タルデータをアナログ変換することができるからであ
る。
2iの立下り時点において、入力されているデータ信号Ｓ
1 のディジタルデータをアナログ変換し、それを保持し
て出力するものとすれば、第ｉ番目のＤＡ変換器１３
は、データ信号Ｓ1 の第ｉ番目のディジタルデータのみ
を抽出し、それをアナログ変換した上、アナログ信号と
して出力することができる。データ信号Ｓ1 は、フォト
カプラ回路１１を介し、ＤＡ変換器１３、１３…に対し
て共通に入力され、選択信号Ｓ2iは、フォトカプラ回路
１２を介し、第ｉ番目のＤＡ変換器１３に入力されてお
り、したがって、第ｉ番目のＤＡ変換器１３は、選択信
号Ｓ2iに呼応して、データ信号Ｓ1 の第ｉ番目のディジ
タルデータをアナログ変換することができるからであ
る。
【００２５】よって、第ｉ番目のＤＡ変換器１３は、電
圧増幅器１５、出力端子Ｔaiを介し、データ信号Ｓ1 の
第ｉ番目のディジタルデータに相当する電圧信号を出力
することができ、電流増幅器１６、出力端子Ｔbiを介
し、それに相当する電流信号を外部に出力することがで
きる。
圧増幅器１５、出力端子Ｔaiを介し、データ信号Ｓ1 の
第ｉ番目のディジタルデータに相当する電圧信号を出力
することができ、電流増幅器１６、出力端子Ｔbiを介
し、それに相当する電流信号を外部に出力することがで
きる。
【００２６】なお、各ＤＡ変換器１３は、市販の一般的
なＤＡ変換器を使用するとき、約数ｍＳ程度の変換時間
Ｔc を必要とする。そこで、持続時間Ｔ1 、余裕時間Ｔ
2 は、Ｔ1 ≒Ｔ2 ≧Ｔc にとることが好ましく、微少時
間Ｔ0 は、Ｔ0 ＞０にとる必要がある。また、出力端子
Ｔai、Ｔbiからの電圧信号、電流信号は、それぞれ電圧
増幅器１５、電流増幅器１６の仕様により、各ＤＡ変換
器１３のフルスパンに対し、たとえば、０〜１０Ｖの電
圧スパン、４〜２０ｍＡの電流スパンを対応させること
ができる。
なＤＡ変換器を使用するとき、約数ｍＳ程度の変換時間
Ｔc を必要とする。そこで、持続時間Ｔ1 、余裕時間Ｔ
2 は、Ｔ1 ≒Ｔ2 ≧Ｔc にとることが好ましく、微少時
間Ｔ0 は、Ｔ0 ＞０にとる必要がある。また、出力端子
Ｔai、Ｔbiからの電圧信号、電流信号は、それぞれ電圧
増幅器１５、電流増幅器１６の仕様により、各ＤＡ変換
器１３のフルスパンに対し、たとえば、０〜１０Ｖの電
圧スパン、４〜２０ｍＡの電流スパンを対応させること
ができる。
【００２７】以上の説明において、増設ユニット１０
は、１枚の基板上に組み立て、データ信号Ｓ1 用、選択
信号Ｓ2i用の各コネクタ、出力端子Ｔai用、出力端子Ｔ
bi用の各コネクタを設けることにより、標準的なシーケ
ンサと組合せ可能なコンパクトな増設ユニットとしてま
とめることができる。なお、電圧増幅器１５、１５…、
電流増幅器１６、１６…は、それぞれの一方のみを設置
し、他方を省略することにより、電圧信号または電流信
号の一方のみを出力信号として出力させるようにしても
よい。
は、１枚の基板上に組み立て、データ信号Ｓ1 用、選択
信号Ｓ2i用の各コネクタ、出力端子Ｔai用、出力端子Ｔ
bi用の各コネクタを設けることにより、標準的なシーケ
ンサと組合せ可能なコンパクトな増設ユニットとしてま
とめることができる。なお、電圧増幅器１５、１５…、
電流増幅器１６、１６…は、それぞれの一方のみを設置
し、他方を省略することにより、電圧信号または電流信
号の一方のみを出力信号として出力させるようにしても
よい。
【００２８】
【発明の効果】以上説明したように、この発明によれ
ば、シーケンサの出力ユニットから時系列的に出力され
るデータ信号を共通に入力する複数のＤＡ変換器を設け
ることによって、各ＤＡ変換器は、出力ユニットからの
選択信号に呼応してデータ信号をアナログ変換し、シー
ケンサからのディジタルデータをアナログ信号からなる
出力信号として出力させることができるから、アナログ
信号からなる出力信号を必要とするシステムに対し、簡
便に対応することができるという優れた効果がある。
ば、シーケンサの出力ユニットから時系列的に出力され
るデータ信号を共通に入力する複数のＤＡ変換器を設け
ることによって、各ＤＡ変換器は、出力ユニットからの
選択信号に呼応してデータ信号をアナログ変換し、シー
ケンサからのディジタルデータをアナログ信号からなる
出力信号として出力させることができるから、アナログ
信号からなる出力信号を必要とするシステムに対し、簡
便に対応することができるという優れた効果がある。
【図面の簡単な説明】
【図１】 全体構成ブロック系統図
【図２】 図１の要部詳細図
【図３】 動作説明線図
Ｓ1 …データ信号 Ｓ2i（ｉ＝１、２…ｎ）…選択信号 １０…ＤＡ変換増設ユニット １１、１２…フォトカプラ回路 １３…ＤＡ変換器 １５…電圧増幅器 １６…電流増幅器 ２０…シーケンサ ２１…出力ユニット
Claims (4)
- 【請求項１】 シーケンサの出力ユニットから時系列的
に出力されるデータ信号を共通に入力する複数のＤＡ変
換器を基板上に搭載してなり、前記ＤＡ変換器は、それ
ぞれ、シーケンサの出力ユニットからデータ信号に同期
して出力される選択信号に呼応してデータ信号をアナロ
グ変換して出力することを特徴とするシーケンサ用のＤ
Ａ変換増設ユニット。 - 【請求項２】 前記ＤＡ変換器は、フォトカプラ回路を
介してデータ信号を入力することを特徴とする請求項１
記載のシーケンサ用のＤＡ変換増設ユニット。 - 【請求項３】 前記ＤＡ変換器は、フォトカプラ回路を
介して選択信号を入力することを特徴とする請求項１ま
たは請求項２記載のシーケンサ用のＤＡ変換増設ユニッ
ト。 - 【請求項４】 前記ＤＡ変換器は、出力側に電圧増幅
器、電流増幅器を並列に接続することを特徴とする請求
項１ないし請求項３のいずれか記載のシーケンサ用のＤ
Ａ変換増設ユニット。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP23576294A JPH0897722A (ja) | 1994-09-29 | 1994-09-29 | シーケンサ用のｄａ変換増設ユニット |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP23576294A JPH0897722A (ja) | 1994-09-29 | 1994-09-29 | シーケンサ用のｄａ変換増設ユニット |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0897722A true JPH0897722A (ja) | 1996-04-12 |
Family
ID=16990865
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP23576294A Pending JPH0897722A (ja) | 1994-09-29 | 1994-09-29 | シーケンサ用のｄａ変換増設ユニット |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0897722A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP1052780A3 (de) * | 1999-05-12 | 2003-08-06 | Siemens Aktiengesellschaft | Integrierter Schaltkreis mit einem A/D- oder D/A-Wandler mit galvanischer Trennung |
| JP2009245432A (ja) * | 2008-03-30 | 2009-10-22 | Advantest Corp | 電源回路および試験装置 |
-
1994
- 1994-09-29 JP JP23576294A patent/JPH0897722A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| EP1052780A3 (de) * | 1999-05-12 | 2003-08-06 | Siemens Aktiengesellschaft | Integrierter Schaltkreis mit einem A/D- oder D/A-Wandler mit galvanischer Trennung |
| JP2009245432A (ja) * | 2008-03-30 | 2009-10-22 | Advantest Corp | 電源回路および試験装置 |
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