JPH09192830A - 消耗電極式アーク溶接機 - Google Patents
消耗電極式アーク溶接機Info
- Publication number
- JPH09192830A JPH09192830A JP8008114A JP811496A JPH09192830A JP H09192830 A JPH09192830 A JP H09192830A JP 8008114 A JP8008114 A JP 8008114A JP 811496 A JP811496 A JP 811496A JP H09192830 A JPH09192830 A JP H09192830A
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- JP
- Japan
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- circuit
- signal
- welding
- welding voltage
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- Arc Welding Control (AREA)
- Generation Of Surge Voltage And Current (AREA)
Abstract
(57)【要約】
【課題】 入力電源電圧が変動しても溶接出力電圧の変
動を抑制し、突き出し長さの変動等の変動に対して溶接
出力電圧の変動を抑制する。 【解決手段】 溶接電圧検出信号を出力する溶接電圧検
出回路部１と、短絡アーク判定信号を出力する短絡アー
ク判定回路部２と、短絡時の仮の電位を設定する短絡仮
想電圧設定回路部３と、短絡アーク判定信号により溶接
電圧検出信号もしくは短絡仮想電圧設定回路部３の出力
のいずれかを選択して出力するスイッチング回路部４
と、溶接電圧設定信号を出力する溶接電圧設定回路部５
と、溶接電圧設定回路部５の出力とスイッチング回路部
４の出力とを比較し演算増幅する演算増幅回路部６と、
インバータ部のスイッチング素子を駆動する駆動信号を
出力するＰＷＭ回路部７を備えている。
動を抑制し、突き出し長さの変動等の変動に対して溶接
出力電圧の変動を抑制する。 【解決手段】 溶接電圧検出信号を出力する溶接電圧検
出回路部１と、短絡アーク判定信号を出力する短絡アー
ク判定回路部２と、短絡時の仮の電位を設定する短絡仮
想電圧設定回路部３と、短絡アーク判定信号により溶接
電圧検出信号もしくは短絡仮想電圧設定回路部３の出力
のいずれかを選択して出力するスイッチング回路部４
と、溶接電圧設定信号を出力する溶接電圧設定回路部５
と、溶接電圧設定回路部５の出力とスイッチング回路部
４の出力とを比較し演算増幅する演算増幅回路部６と、
インバータ部のスイッチング素子を駆動する駆動信号を
出力するＰＷＭ回路部７を備えている。
Description
【０００１】
【発明の属する技術分野】本発明は、溶接ワイヤと溶接
母材（以下単にワイヤ、母材と言う。）との間にアーク
を発生させて溶接を行う消耗電極式アーク溶接機に関す
る。
母材（以下単にワイヤ、母材と言う。）との間にアーク
を発生させて溶接を行う消耗電極式アーク溶接機に関す
る。
【０００２】
【従来の技術】ワイヤと母材との間にアークを発生させ
て溶接を行う従来例のアーク溶接機では、図２に示すよ
うに、アーク期間中及び短絡期間中のいずれにおいて
も、溶接電圧検出信号と溶接電圧設定信号とを比較し、
演算増幅するのが一般的であった。図２において１２は
３相入力電源、１３はダイオード整流回路、１１はイン
バータ部のスイッチング素子、１４は変圧器、１５はダ
イオード整流回路、１６はリアクトル、１７はトーチ、
１９は母材をしめす。
て溶接を行う従来例のアーク溶接機では、図２に示すよ
うに、アーク期間中及び短絡期間中のいずれにおいて
も、溶接電圧検出信号と溶接電圧設定信号とを比較し、
演算増幅するのが一般的であった。図２において１２は
３相入力電源、１３はダイオード整流回路、１１はイン
バータ部のスイッチング素子、１４は変圧器、１５はダ
イオード整流回路、１６はリアクトル、１７はトーチ、
１９は母材をしめす。
【０００３】このように従来の溶接機は、溶接電圧を検
出して溶接電圧検出信号を出力する溶接電圧検出回路部
１と、前記溶接電圧検出信号を入力として、短絡または
アークを判定して短絡アーク判定信号を出力する短絡ア
ーク判定回路部２と、溶接電圧を設定して溶接電圧設定
信号を出力する溶接電圧設定回路部５と、前記溶接電圧
設定信号と前記スイッチング回路部４の出力信号とを比
較し、演算増幅して演算増幅信号を出力する演算増幅回
路部６と、前記演算増幅信号を入力としてインバータ部
のスイッチング素子１１を駆動する駆動信号を出力する
ＰＷＭ回路部７を有する構成になっていた。
出して溶接電圧検出信号を出力する溶接電圧検出回路部
１と、前記溶接電圧検出信号を入力として、短絡または
アークを判定して短絡アーク判定信号を出力する短絡ア
ーク判定回路部２と、溶接電圧を設定して溶接電圧設定
信号を出力する溶接電圧設定回路部５と、前記溶接電圧
設定信号と前記スイッチング回路部４の出力信号とを比
較し、演算増幅して演算増幅信号を出力する演算増幅回
路部６と、前記演算増幅信号を入力としてインバータ部
のスイッチング素子１１を駆動する駆動信号を出力する
ＰＷＭ回路部７を有する構成になっていた。
【０００４】前記演算増幅回路部６内には増幅部の他に
演算増幅回路部６の出力を安定させるために図示しない
積分部が装備されている。この積分部は、コンデンサ等
で構成されるため、この演算増幅回路部６は遅れ要素を
持つ。
演算増幅回路部６の出力を安定させるために図示しない
積分部が装備されている。この積分部は、コンデンサ等
で構成されるため、この演算増幅回路部６は遅れ要素を
持つ。
【０００５】上記の場合、溶接電圧検出回路部１の出力
信号には、短絡時の低い電位とアーク時の高い電位が発
生する。一方、演算増幅の比較対象となる出力電圧設定
回路部５の出力信号は、前記出力信号の短絡時の電位と
アーク時の電位との間の一定電位である。
信号には、短絡時の低い電位とアーク時の高い電位が発
生する。一方、演算増幅の比較対象となる出力電圧設定
回路部５の出力信号は、前記出力信号の短絡時の電位と
アーク時の電位との間の一定電位である。
【０００６】
【発明が解決しようとする課題】上記従来の溶接機で
は、増幅度を高めると、短絡時の増幅演算結果とアーク
時の増幅演算結果は全く違う値となり、演算増幅回路部
６は遅れ要素を持つため短絡終期時の演算結果がアーク
初期に現れるので、溶接性能が悪化する。このため増幅
度を下げざるを得なくなる。
は、増幅度を高めると、短絡時の増幅演算結果とアーク
時の増幅演算結果は全く違う値となり、演算増幅回路部
６は遅れ要素を持つため短絡終期時の演算結果がアーク
初期に現れるので、溶接性能が悪化する。このため増幅
度を下げざるを得なくなる。
【０００７】また、増幅度を低くすると、入力電源電圧
が変動しても、溶接出力電圧の変動を抑制しきれない。
また、ワイヤ先端と母材間距離（以下突き出し長さとい
う）の変動等により溶接中に溶接出力電圧が変動して
も、設定した溶接電圧にすばやくもどすことができな
い。
が変動しても、溶接出力電圧の変動を抑制しきれない。
また、ワイヤ先端と母材間距離（以下突き出し長さとい
う）の変動等により溶接中に溶接出力電圧が変動して
も、設定した溶接電圧にすばやくもどすことができな
い。
【０００８】本発明は上記の問題点を解決することを目
的とするもので、入力電源電圧が変動しても、溶接出力
電圧の変動を抑制し、また、ワイヤ先端と母材間距離
（以下突き出し長さという）の変動等により溶接中に溶
接出力電圧が変動しても、設定した溶接電圧にすばやく
もどすことができる消耗電極式アーク溶接機を提供する
ものである。
的とするもので、入力電源電圧が変動しても、溶接出力
電圧の変動を抑制し、また、ワイヤ先端と母材間距離
（以下突き出し長さという）の変動等により溶接中に溶
接出力電圧が変動しても、設定した溶接電圧にすばやく
もどすことができる消耗電極式アーク溶接機を提供する
ものである。
【０００９】
【課題を解決するための手段】上記課題を解決するため
に本発明の消耗電極式アーク溶接機は、溶接電圧を検出
して溶接電圧検出信号を出力する溶接電圧検出回路部
と、前記溶接電圧検出信号を入力として短絡またはアー
クを判定して短絡アーク判定信号を出力する短絡アーク
判定回路部と、短絡時の所定の電位を設定して短絡仮想
電圧信号を出力する短絡仮想電圧設定回路部と、前記短
絡アーク判定信号により前記溶接電圧検出信号もしくは
前記短絡仮想電圧信号のいずれかを選択して出力するス
イッチング回路部と、溶接電圧を設定して溶接電圧設定
信号を出力する溶接電圧設定回路部と、前記溶接電圧設
定信号と前記スイッチング回路部の出力信号とを比較し
演算増幅して演算増幅信号を出力する演算増幅回路部
と、前記演算増幅信号を入力としてインバータ部のスイ
ッチング素子を駆動する駆動信号を出力するＰＷＭ回路
部を有するものである。
に本発明の消耗電極式アーク溶接機は、溶接電圧を検出
して溶接電圧検出信号を出力する溶接電圧検出回路部
と、前記溶接電圧検出信号を入力として短絡またはアー
クを判定して短絡アーク判定信号を出力する短絡アーク
判定回路部と、短絡時の所定の電位を設定して短絡仮想
電圧信号を出力する短絡仮想電圧設定回路部と、前記短
絡アーク判定信号により前記溶接電圧検出信号もしくは
前記短絡仮想電圧信号のいずれかを選択して出力するス
イッチング回路部と、溶接電圧を設定して溶接電圧設定
信号を出力する溶接電圧設定回路部と、前記溶接電圧設
定信号と前記スイッチング回路部の出力信号とを比較し
演算増幅して演算増幅信号を出力する演算増幅回路部
と、前記演算増幅信号を入力としてインバータ部のスイ
ッチング素子を駆動する駆動信号を出力するＰＷＭ回路
部を有するものである。
【００１０】
【発明の実施の形態】上記構成において、短絡仮想電圧
設定回路部の短絡仮想電圧信号の設定電位を、溶接電圧
検出回路部の溶接電圧検出信号内の短絡時の電位より高
く、アーク時の電位近傍に設定する。するとスイッチン
グ回路部の出力信号は、短絡時であってもアーク時と同
様の電位になる。このため、増幅度を高く設定しても、
短絡終期時の演算結果が、演算増幅回路部内の積分部の
遅れ要素によりアーク初期に現れても影響はない。これ
らにより、増幅度を高めることができる。
設定回路部の短絡仮想電圧信号の設定電位を、溶接電圧
検出回路部の溶接電圧検出信号内の短絡時の電位より高
く、アーク時の電位近傍に設定する。するとスイッチン
グ回路部の出力信号は、短絡時であってもアーク時と同
様の電位になる。このため、増幅度を高く設定しても、
短絡終期時の演算結果が、演算増幅回路部内の積分部の
遅れ要素によりアーク初期に現れても影響はない。これ
らにより、増幅度を高めることができる。
【００１１】以下、本発明の一実施の形態を、図１を参
照して説明する。図１は、本発明の実施例における消耗
電極式アーク溶接機の構成を示すブロック図である。
照して説明する。図１は、本発明の実施例における消耗
電極式アーク溶接機の構成を示すブロック図である。
【００１２】図１において１は溶接電圧検出回路部であ
り、溶接機の出力端もしくは変圧器１４の磁束の変化よ
り溶接電圧を検出して溶接電圧検出信号を出力する。こ
の溶接電圧検出信号により、短絡アーク判定回路部２
で、ワイヤ先端の状態が、短絡かアークかを判定し、こ
の短絡アーク判定信号をスイッチング回路部４に伝え
る。
り、溶接機の出力端もしくは変圧器１４の磁束の変化よ
り溶接電圧を検出して溶接電圧検出信号を出力する。こ
の溶接電圧検出信号により、短絡アーク判定回路部２
で、ワイヤ先端の状態が、短絡かアークかを判定し、こ
の短絡アーク判定信号をスイッチング回路部４に伝え
る。
【００１３】３は短絡時の仮の電位を設定して短絡仮想
電圧信号を出力する短絡仮想電圧設定回路部であり、５
は溶接電圧を設定して溶接電圧設定信号を出力する溶接
電圧設定回路部である。スイッチング回路部４では、ア
ーク時には溶接電圧検出回路部１の出力である溶接電圧
検出信号を選択し、短絡時には短絡仮想電圧設定回路部
３の出力信号である短絡仮想電圧信号を選択して、演算
増幅回路部６に出力する。
電圧信号を出力する短絡仮想電圧設定回路部であり、５
は溶接電圧を設定して溶接電圧設定信号を出力する溶接
電圧設定回路部である。スイッチング回路部４では、ア
ーク時には溶接電圧検出回路部１の出力である溶接電圧
検出信号を選択し、短絡時には短絡仮想電圧設定回路部
３の出力信号である短絡仮想電圧信号を選択して、演算
増幅回路部６に出力する。
【００１４】演算増幅回路部６は、スイッチング回路部
４の出力と、溶接電圧設定回路部５の溶接電圧設定信号
とを比較して演算増幅する演算増幅回路部６であり、こ
の演算増幅回路部６内には増幅部の他に積分部が装備さ
れている。この積分部は、コンデンサ等で構成されるた
め、この演算増幅回路部６は遅れ要素を持つ。演算増幅
回路部６の出力信号はＰＷＭ回路部７に出力され、ＰＷ
Ｍ回路部７の出力信号がインバータ部のスイッチング素
子１１の入力信号となる。
４の出力と、溶接電圧設定回路部５の溶接電圧設定信号
とを比較して演算増幅する演算増幅回路部６であり、こ
の演算増幅回路部６内には増幅部の他に積分部が装備さ
れている。この積分部は、コンデンサ等で構成されるた
め、この演算増幅回路部６は遅れ要素を持つ。演算増幅
回路部６の出力信号はＰＷＭ回路部７に出力され、ＰＷ
Ｍ回路部７の出力信号がインバータ部のスイッチング素
子１１の入力信号となる。
【００１５】本実施の形態において、短絡仮想電圧設定
回路部３の短絡仮想電圧信号の設定電位を、溶接電圧検
出回路部１の溶接電圧検出信号内の短絡時の電位より高
く、アーク時の電位近傍に設定する。するとスイッチン
グ回路部４の出力信号は、短絡時であってもアーク時と
同様の電位になる。このため、増幅度を高く設定して
も、短絡終期時の演算結果が、演算増幅回路部６内の積
分部の遅れ要素によりアーク初期に現れても影響はな
い。
回路部３の短絡仮想電圧信号の設定電位を、溶接電圧検
出回路部１の溶接電圧検出信号内の短絡時の電位より高
く、アーク時の電位近傍に設定する。するとスイッチン
グ回路部４の出力信号は、短絡時であってもアーク時と
同様の電位になる。このため、増幅度を高く設定して
も、短絡終期時の演算結果が、演算増幅回路部６内の積
分部の遅れ要素によりアーク初期に現れても影響はな
い。
【００１６】これにより、増幅度を高めることができる
ので、入力電源電圧の変動があっても設定した溶接電圧
に保持し、溶接中に溶接出力電圧が変動しても、設定し
た溶接電圧にすばやくもどすことができる。
ので、入力電源電圧の変動があっても設定した溶接電圧
に保持し、溶接中に溶接出力電圧が変動しても、設定し
た溶接電圧にすばやくもどすことができる。
【００１７】
【発明の効果】以上のように、本発明によると、入力電
源電圧が変動しても溶接出力電圧の変動を抑制し、突き
出し長さの変動等の外的な変動により溶接中に溶接出力
電圧が変動しても、設定した溶接電圧にすばやくもどそ
うとする。これらにより良好な溶接作業性を維持でき
る。
源電圧が変動しても溶接出力電圧の変動を抑制し、突き
出し長さの変動等の外的な変動により溶接中に溶接出力
電圧が変動しても、設定した溶接電圧にすばやくもどそ
うとする。これらにより良好な溶接作業性を維持でき
る。
【図１】本発明の一実施の形態における消耗電極式アー
ク溶接機の構成を示すブロック図
ク溶接機の構成を示すブロック図
【図２】従来の消耗電極式アーク溶接機の構成を示すブ
ロック図
ロック図
１ 溶接電圧検出回路部 ２ 短絡アーク判定回路部 ３ 短絡仮想電圧設定回路部 ４ スイッチング回路部 ５ 溶接電圧設定回路部 ６ 演算増幅回路部 ７ ＰＷＭ回路部 １１ インバータ部 １２ ３相入力電源 １３ ダイオード整流回路 １４ 変圧器 １５ ダイオード整流回路 １６ リアクトル １７ トーチ １９ 母材
───────────────────────────────────────────────────── フロントページの続き (72)発明者 谷本 順三 大阪府門真市大字門真1006番地 松下電器 産業株式会社内
Claims (1)
- 【請求項１】溶接電圧を検出して溶接電圧検出信号を出
力する溶接電圧検出回路部と、前記溶接電圧検出信号を
入力として短絡またはアークを判定して短絡アーク判定
信号を出力する短絡アーク判定回路部と、短絡時の仮の
電位を設定して短絡仮想電圧信号を出力する短絡仮想電
圧設定回路部と、前記短絡アーク判定信号により前記溶
接電圧検出信号もしくは前記短絡仮想電圧信号のいずれ
かを選択して出力するスイッチング回路部と、溶接電圧
を設定して溶接電圧設定信号を出力する溶接電圧設定回
路部と、前記溶接電圧設定信号と前記スイッチング回路
部の出力信号とを比較し演算増幅して演算増幅信号を出
力する演算増幅回路部と、前記演算増幅信号を入力とし
てインバータ部のスイッチング素子を駆動する駆動信号
を出力するＰＷＭ回路部とを有する消耗電極式アーク溶
接機。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP00811496A JP3360515B2 (ja) | 1996-01-22 | 1996-01-22 | 消耗電極式アーク溶接機 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP00811496A JP3360515B2 (ja) | 1996-01-22 | 1996-01-22 | 消耗電極式アーク溶接機 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH09192830A true JPH09192830A (ja) | 1997-07-29 |
| JP3360515B2 JP3360515B2 (ja) | 2002-12-24 |
Family
ID=11684271
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP00811496A Expired - Fee Related JP3360515B2 (ja) | 1996-01-22 | 1996-01-22 | 消耗電極式アーク溶接機 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3360515B2 (ja) |
-
1996
- 1996-01-22 JP JP00811496A patent/JP3360515B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JP3360515B2 (ja) | 2002-12-24 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
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